JPS58132427U - アナログ信号遅延回路 - Google Patents

アナログ信号遅延回路

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JPS58132427U
JPS58132427U JP2952382U JP2952382U JPS58132427U JP S58132427 U JPS58132427 U JP S58132427U JP 2952382 U JP2952382 U JP 2952382U JP 2952382 U JP2952382 U JP 2952382U JP S58132427 U JPS58132427 U JP S58132427U
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JP
Japan
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analog signal
delay circuit
signal delay
bias voltage
input
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Pending
Application number
JP2952382U
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English (en)
Inventor
憲司 永田
Original Assignee
クラリオン株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の遅延回路を示す図、第２図は本考案の一
実施例の遅延回路を示す図、第３図は本考案の信号入力
路のバイアス電圧と入力信号レベルとの関係を示す図で
ある。 ＢＢＤ・・・・・・アナログ信号遅延素子、ａ・・・・
・・信号入力路、ＡＭＰ・・・・・・増幅器、Ｄ・・・
・・・ダイオード、Ｖｃｃ・・・・・・電源電圧、Ｒ□
、　Ｒ２，Ｒ３，Ｒ４・・・・・・抵抗、Ｃ１，Ｃ２・
・・・・・コンデンサ、Ｑ工、Ｑ２・・・・・・トラン
ジスタ、ＶＲ・・・・・・可変抵抗。

Claims (1)

    【実用新案登録請求の範囲】
  1. アナログ信号遅延素子の信号入力路にミ入力信号レベル
    に対応して制御されるバイアス電圧を加えることを特徴
    とするアナログ信号遅延回路。
JP2952382U 1982-03-02 1982-03-02 アナログ信号遅延回路 Pending JPS58132427U (ja)

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JPS58132427U true JPS58132427U (ja) 1983-09-07

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JP2952382U Pending JPS58132427U (ja) 1982-03-02 1982-03-02 アナログ信号遅延回路

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5528525A (en) * 1978-08-17 1980-02-29 Toshiba Corp Input bias control system for charge transfer element

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5528525A (en) * 1978-08-17 1980-02-29 Toshiba Corp Input bias control system for charge transfer element

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