JPS58129587A - 信号処理回路 - Google Patents
信号処理回路Info
- Publication number
- JPS58129587A JPS58129587A JP57011256A JP1125682A JPS58129587A JP S58129587 A JPS58129587 A JP S58129587A JP 57011256 A JP57011256 A JP 57011256A JP 1125682 A JP1125682 A JP 1125682A JP S58129587 A JPS58129587 A JP S58129587A
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- Japan
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- image signal
- background
- amplifier
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06V—IMAGE OR VIDEO RECOGNITION OR UNDERSTANDING
- G06V10/00—Arrangements for image or video recognition or understanding
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- Investigating Or Analysing Biological Materials (AREA)
- Investigating Or Analysing Materials By Optical Means (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、ラインセンサやエリヤセンサ等から得られゐ
画像信号を入力し、シェーデング等の影響を受けない画
像信号に変換する信号処理回路に関するものである。
画像信号を入力し、シェーデング等の影響を受けない画
像信号に変換する信号処理回路に関するものである。
第１図は、血液標本上に散在する血球の願黴鏡画倫を、
ＴＶ右カメラを通して電気信号として取り出した場合の
画像信号の一例を示す波形図である。
ＴＶ右カメラを通して電気信号として取り出した場合の
画像信号の一例を示す波形図である。
この波形図において、０点は白血球であり、０点は赤血
球を示している。このような画像信号においては、両端
部分で、入射光が角度をもつことからシェーデングの影
響を受け、基準レベルが一定でない。このため、画像信
号を処理し、この中から、例えば白血球を検出するよう
な場合、最適なスレッシ曹ルドを位置くよって異ならし
めなければならない。
球を示している。このような画像信号においては、両端
部分で、入射光が角度をもつことからシェーデングの影
響を受け、基準レベルが一定でない。このため、画像信
号を処理し、この中から、例えば白血球を検出するよう
な場合、最適なスレッシ曹ルドを位置くよって異ならし
めなければならない。
従来、この種の装置においては、マイクロコンビーータ
やメモリ手段を用い、各位置での最適なスレッシ曹ルド
をメモリ手段にあらかじめ記憶させておいて補正するよ
うにしている。しかしながら、このような手法は、構成
が複雑となるうぇに１予じめ最適なスレッＶ１ルドを設
定しなければならないという欠点がある。
やメモリ手段を用い、各位置での最適なスレッシ曹ルド
をメモリ手段にあらかじめ記憶させておいて補正するよ
うにしている。しかしながら、このような手法は、構成
が複雑となるうぇに１予じめ最適なスレッＶ１ルドを設
定しなければならないという欠点がある。
ここにおいて、本発明は、簡単な構成で７エーデングの
影響を受けない画像信号を得ることのできる信号処理回
路を実現しようとするものである。
影響を受けない画像信号を得ることのできる信号処理回
路を実現しようとするものである。
本発明に係る装置は、可変利得増幅器と、画像信号の中
の背景を抽出する回路とを備え、増幅器の利得を、背景
を示す信号時においてはその出力が一定になるように制
御し、背景以外を示す信号時には、直前の利得を保持す
るように制御するようにした点ＫＩＩＩＩ愼がある。
の背景を抽出する回路とを備え、増幅器の利得を、背景
を示す信号時においてはその出力が一定になるように制
御し、背景以外を示す信号時には、直前の利得を保持す
るように制御するようにした点ＫＩＩＩＩ愼がある。
本発明は、透過光利用の類黴鏡画像などでは、明るい背
景の中に目的画像が散在１−ている場合が多く、このよ
うな場合、通常背景は意味を持たず、得られる画像信号
は所定レベルの信号でよいという点く着目してなされて
いる。
景の中に目的画像が散在１−ている場合が多く、このよ
うな場合、通常背景は意味を持たず、得られる画像信号
は所定レベルの信号でよいという点く着目してなされて
いる。
ｆｌｉ２図は、本発明に係る装置の一例を示す構成ブロ
ック図である。図において、Ｔ、は画像信号が印加され
る入力端子、Ａ、は入力端子Ｔ、に印加される画像信号
・１を増幅する増幅器、Ｒｆは抵抗、ＦＥＴは可変抵抗
として作用する電界効果トランジスタ、ＴＱは出力端子
である。ＦＥＴは、そのゲートに印加される信号に応じ
て抵抗が変わり、これによって増幅１１Ａ、の帰還電圧
が変ってその利得が制御できるようＫなっている。
ック図である。図において、Ｔ、は画像信号が印加され
る入力端子、Ａ、は入力端子Ｔ、に印加される画像信号
・１を増幅する増幅器、Ｒｆは抵抗、ＦＥＴは可変抵抗
として作用する電界効果トランジスタ、ＴＱは出力端子
である。ＦＥＴは、そのゲートに印加される信号に応じ
て抵抗が変わり、これによって増幅１１Ａ、の帰還電圧
が変ってその利得が制御できるようＫなっている。
ＧＣは、その出力端がＦＥＴのゲート極に接続された利
得制御回路で、一方の入力端にスイッチＳを介して増幅
器Ａ１の出力信号が印加され、他方の入力端に所定出力
レベルを決める基準電圧ｖ８が印加された演算増幅器Ａ
２．及びこの演算増幅器の入出力端間に接続されたコン
デンサＣで構成されている。
得制御回路で、一方の入力端にスイッチＳを介して増幅
器Ａ１の出力信号が印加され、他方の入力端に所定出力
レベルを決める基準電圧ｖ８が印加された演算増幅器Ａ
２．及びこの演算増幅器の入出力端間に接続されたコン
デンサＣで構成されている。
ＢＰは、入力端子Ｔ、に印加されるｉＩ像信号を入力と
し、この＊儂信号中の背景を示す部分を抽出する背景抽
出回路である。この背景抽出回路は、画像信号・１を一
方の入力とする演算増幅器Ａｇｘｊｌ像信号・ｉを積分
する積分器ＩＮＴ 、この積分器ＩＮＴの出力が一端に
印加されるコンデンサｃ４、このコンデンサＣ１の他端
と増幅−１５の出力端間に接続されたダイオードＤ１及
びダイオードＤ２．抵抗Ｒ１とで構成されている。ここ
で、演算増幅器Ａ５．ダイオードＤ＋ＩＤ２ｅ 抵抗Ｒ
４及びコンデンサＣ１は、ｉｉｉ＊信号・１のピークト
ラッキング回路を構成している。積分器ＩＮＴは、抵抗
Ｒ，コンデンサＣ２，演算増幅器Ａ４で構成されている
。ここで、Ｓ、、 ｓ２は、コンデンサｃ、、ｃ２ｉｃ
貯えられた電荷を放電させるためのスイッチである。ｃ
ｏｐは、画像信号・１と、増幅器Ａ５の出力信号とを比
較する比較器、Ｇは比較器ＣＯＰの出力側に設けたゲー
ト回路である。
し、この＊儂信号中の背景を示す部分を抽出する背景抽
出回路である。この背景抽出回路は、画像信号・１を一
方の入力とする演算増幅器Ａｇｘｊｌ像信号・ｉを積分
する積分器ＩＮＴ 、この積分器ＩＮＴの出力が一端に
印加されるコンデンサｃ４、このコンデンサＣ１の他端
と増幅−１５の出力端間に接続されたダイオードＤ１及
びダイオードＤ２．抵抗Ｒ１とで構成されている。ここ
で、演算増幅器Ａ５．ダイオードＤ＋ＩＤ２ｅ 抵抗Ｒ
４及びコンデンサＣ１は、ｉｉｉ＊信号・１のピークト
ラッキング回路を構成している。積分器ＩＮＴは、抵抗
Ｒ，コンデンサＣ２，演算増幅器Ａ４で構成されている
。ここで、Ｓ、、 ｓ２は、コンデンサｃ、、ｃ２ｉｃ
貯えられた電荷を放電させるためのスイッチである。ｃ
ｏｐは、画像信号・１と、増幅器Ａ５の出力信号とを比
較する比較器、Ｇは比較器ＣＯＰの出力側に設けたゲー
ト回路である。
この上うに構成した装置の動作を、次Ｋ１ｇＳｆｇの波
形図を参照しながら説明する◎ 増幅器Ａ１０入力端には、第５図ピ）Ｋ示すような画像
信号・ｌが印加され、ここで増幅される。増幅器Ａ、の
利得Ｇは、ＦＥＴのチャンネル抵抗をＲＦＥＴとすれば
、（１）式で表わされる。
形図を参照しながら説明する◎ 増幅器Ａ１０入力端には、第５図ピ）Ｋ示すような画像
信号・ｌが印加され、ここで増幅される。増幅器Ａ、の
利得Ｇは、ＦＥＴのチャンネル抵抗をＲＦＥＴとすれば
、（１）式で表わされる。
背量抽出回路ＢＰにおいて、演算増幅６人５の一方の入
力端には、第５図（イ）Ｋ示すような画像信号ｅ１が印
加され、また、積分器ＩＮＴの入力端に４同じ画像信号
・１が印加されている。ここで、画像信号・ｉは、シェ
ーデングの影響を受は中央部が脹らんだ信号波形となっ
ている。積分器ＩＮＴの動作を制御するコンデンサ０２
に並列に接続されたスイッチＳ２は、第３図（ロ）に示
すように１画像信号・１の中央部（脹らんだ付近）に至
るまでオンとなってお如、その後オフとなって、画像信
号・１を積分する動作をなす。演算増幅器１５．ダイオ
ードＤ１．Ｄ２．抵抗Ｒ１及びコンデンサＣ１は、ピー
クトラッキング回路を構成しており、画像信号・１のピ
ークトラッキングを行う◎ここで、画像信号・ｉは、そ
の中央部が脹らんだ信号波形であるところから、画像信
号の骨◆令→→左半分、右上り波形部分では、これがそ
のまま画像信号中の背景を示す信号となる０ところが、
画像信号の右半分、右下り波形部分では、このｔｔでは
常にホールド状態となって背景を示す信号が抽出されな
い。それ故に１この装置においては、画像信号の右半分
に相当する区間、積分１） ＩＮＴを動作させ、コンデ
ンサＣ１の一端に画像信号町を積分して得られる三角波
信号を加えてコンデンサＣ１の電圧を逆方向に修正する
ようＫＬ、これＫよりてピークトラッキングがｍｓ信信
号全区間に亘って行なえるようにし、画像信号の中から
背景に関連した信号を確実に抽出できるようにしている
。なお、積分器ＩＮＴＯ回路定数は、その出力端に得ら
れる三角波信号の面積が、画像信号中のシェーゾングの
影響程度によって所定の最適値になるように設定される
ものとする０ ＩＥｓ図に）は、演算増幅−１の出力信号・Ｂの波形図
である。この出力信号ｓＢは、画像信号ｅ、の背景に関
連した信号であって、そのレベルは、・ｌに対してダイ
オードＤ１１Ｄ２の順方向電圧分だけ低いものとなる。
力端には、第５図（イ）Ｋ示すような画像信号ｅ１が印
加され、また、積分器ＩＮＴの入力端に４同じ画像信号
・１が印加されている。ここで、画像信号・ｉは、シェ
ーデングの影響を受は中央部が脹らんだ信号波形となっ
ている。積分器ＩＮＴの動作を制御するコンデンサ０２
に並列に接続されたスイッチＳ２は、第３図（ロ）に示
すように１画像信号・１の中央部（脹らんだ付近）に至
るまでオンとなってお如、その後オフとなって、画像信
号・１を積分する動作をなす。演算増幅器１５．ダイオ
ードＤ１．Ｄ２．抵抗Ｒ１及びコンデンサＣ１は、ピー
クトラッキング回路を構成しており、画像信号・１のピ
ークトラッキングを行う◎ここで、画像信号・ｉは、そ
の中央部が脹らんだ信号波形であるところから、画像信
号の骨◆令→→左半分、右上り波形部分では、これがそ
のまま画像信号中の背景を示す信号となる０ところが、
画像信号の右半分、右下り波形部分では、このｔｔでは
常にホールド状態となって背景を示す信号が抽出されな
い。それ故に１この装置においては、画像信号の右半分
に相当する区間、積分１） ＩＮＴを動作させ、コンデ
ンサＣ１の一端に画像信号町を積分して得られる三角波
信号を加えてコンデンサＣ１の電圧を逆方向に修正する
ようＫＬ、これＫよりてピークトラッキングがｍｓ信信
号全区間に亘って行なえるようにし、画像信号の中から
背景に関連した信号を確実に抽出できるようにしている
。なお、積分器ＩＮＴＯ回路定数は、その出力端に得ら
れる三角波信号の面積が、画像信号中のシェーゾングの
影響程度によって所定の最適値になるように設定される
ものとする０ ＩＥｓ図に）は、演算増幅−１の出力信号・Ｂの波形図
である。この出力信号ｓＢは、画像信号ｅ、の背景に関
連した信号であって、そのレベルは、・ｌに対してダイ
オードＤ１１Ｄ２の順方向電圧分だけ低いものとなる。
比較器ＣＯＰは、一方の入力端に印加されゐ画像信号６
にと、他方の入力端に印加される演算増幅器Ａ５の出力
信号、すなわち、背景に関連した信号・８とを比較し、
第３図（ホ）Ｋ示すように背景区間を示す信号”ＢＯを
出力する。この出力信号”Ｂ（ｌは、同期信号区間は出
力信号−ＢＯが阻止されるゲート回路Ｇを介して取り出
され、この信号によって、スイッチＳが駆動される。
にと、他方の入力端に印加される演算増幅器Ａ５の出力
信号、すなわち、背景に関連した信号・８とを比較し、
第３図（ホ）Ｋ示すように背景区間を示す信号”ＢＯを
出力する。この出力信号”Ｂ（ｌは、同期信号区間は出
力信号−ＢＯが阻止されるゲート回路Ｇを介して取り出
され、この信号によって、スイッチＳが駆動される。
利得制御回路ＧＣｆＣおいて、スイッチＳは、ゲート回
路Ｇから出−力され名背景区間を示す信号・ＢＯによっ
て、背景区間はオン、目的画像のある区間はオフに駆動
される。スイッチＳがオンの状態では、このスイッチＳ
、増幅器Ａ２． ＦＥＴ、増幅器Ａ１を含んで負帰還
ループが構成される。この負帰還ループは、増幅器Ａ１
の出力信号・０が、増幅器Ａ２の他方の入力端に印加さ
れている基準電圧Ｖ８に対応した一定のレベルの信号と
なるように、ＦＥＴのデャンネル抵抗ＲＦＥＴを変え、
増幅Ｉｔ人、の利得Ｇ （（１）式参照）を制御する。
路Ｇから出−力され名背景区間を示す信号・ＢＯによっ
て、背景区間はオン、目的画像のある区間はオフに駆動
される。スイッチＳがオンの状態では、このスイッチＳ
、増幅器Ａ２． ＦＥＴ、増幅器Ａ１を含んで負帰還
ループが構成される。この負帰還ループは、増幅器Ａ１
の出力信号・０が、増幅器Ａ２の他方の入力端に印加さ
れている基準電圧Ｖ８に対応した一定のレベルの信号と
なるように、ＦＥＴのデャンネル抵抗ＲＦＥＴを変え、
増幅Ｉｔ人、の利得Ｇ （（１）式参照）を制御する。
一方、スイッチＳがオフの状ｌＩ（目的画像のある区間
）では、増幅器Ａ２． コンデンサＣで構成される回路
は、スイッチＳをオフにする直前の出力電圧・０を保持
し、この電圧・０に対応して増幅器Ａ１の利得を制御す
る。
）では、増幅器Ａ２． コンデンサＣで構成される回路
は、スイッチＳをオフにする直前の出力電圧・０を保持
し、この電圧・０に対応して増幅器Ａ１の利得を制御す
る。
このような動作によって、増幅器Ａ１の出力電圧ｃｏは
、入力される画像信号の中の背景区間は、基準電圧ＶＳ
で定まる所定レベルになり、全体としてシェーゾングの
影響をなくすることができる。また、例えば光源の明る
さが変って画像信号の全体のレベルが変動しても、その
影響迎受けることはない。また、目的画愉区間では、そ
の直前の背景区間の修正結果によって利得が制御される
ので、実時間で位置的な補正を行なうことができる。
、入力される画像信号の中の背景区間は、基準電圧ＶＳ
で定まる所定レベルになり、全体としてシェーゾングの
影響をなくすることができる。また、例えば光源の明る
さが変って画像信号の全体のレベルが変動しても、その
影響迎受けることはない。また、目的画愉区間では、そ
の直前の背景区間の修正結果によって利得が制御される
ので、実時間で位置的な補正を行なうことができる。
第４図は、第１図に示す画像信号を第２図回路の入力端
に印加した場合の出力信号１０の波形図である。
に印加した場合の出力信号１０の波形図である。
なお、上記の実施例では、背景抽出回路ＢＰにおいて、
積分器ＩＮＴｔ画律信号の右半分に相当する時間だけ働
かせるものであるが、シェーゾングの影響の程度に応じ
て画像信号の全区間あるいは特定区間だけ働かせるよう
にしてもよい。また、増幅器Ａ１の利得をＦｉｅＴを用
いて制御するものであるが、他の回路手段によって利得
を制御するようにしてもよい。
積分器ＩＮＴｔ画律信号の右半分に相当する時間だけ働
かせるものであるが、シェーゾングの影響の程度に応じ
て画像信号の全区間あるいは特定区間だけ働かせるよう
にしてもよい。また、増幅器Ａ１の利得をＦｉｅＴを用
いて制御するものであるが、他の回路手段によって利得
を制御するようにしてもよい。
本発明に係る装置は、ＣＣＤラインセンサによって白血
球の検出を行う場合、２インセンサからの画像信号を処
理するための回路あるいは、ＴＶカメラから得られる映
倫信号を処理するだめの回路等、各種の信号処理回路と
して適用が可能である。
球の検出を行う場合、２インセンサからの画像信号を処
理するための回路あるいは、ＴＶカメラから得られる映
倫信号を処理するだめの回路等、各種の信号処理回路と
して適用が可能である。
以上説明したように、本発明によれば、簡単な構成でシ
ェーゾング等め影響を受けない画像信号（映倫信号）が
得られる信号処理回路が実現できる０
ェーゾング等め影響を受けない画像信号（映倫信号）が
得られる信号処理回路が実現できる０
Claims (2)
- （１）画像信号を入力しこの画像信号を増幅する可変利
得増幅器、前記画像信号を入力しこの画像信号の中の背
景に関連した信号を抽出する回路、前記画像信号と前記
背景抽出回路の出力信号とを比較する比較器、この比較
器の出力端から得られる背景区間を示す信号によってオ
ンに駆動されるスイッチ、一方の入力端に前記スイッチ
を介して前記可変利得増幅器の出力信号が与えられ他方
の入力端に所定の基準電圧が印加され演算増幅器を含み
前記可変利得増幅器の利得を制御する利得制御回路を真
備し、前記可変利得増幅器の利得は、その出力信号が背
景区間においては所定の一定値になるような利得に制御
され、背景区間以外の区間ではその直前の利得を保持す
るように制御される信号処理回路。 - （２）背景抽出回路は、画像信号を積分する積分器と、
この積分器からの三角波信号と画像信号とを入力とし画
像信号のピークをトラッキングするピークトラッキング
回路とを含んで構成される特許請求の範囲第１項記載の
信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57011256A JPS58129587A (ja) | 1982-01-27 | 1982-01-27 | 信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57011256A JPS58129587A (ja) | 1982-01-27 | 1982-01-27 | 信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58129587A true JPS58129587A (ja) | 1983-08-02 |
| JPH0140377B2 JPH0140377B2 (ja) | 1989-08-28 |
Family
ID=11772853
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57011256A Granted JPS58129587A (ja) | 1982-01-27 | 1982-01-27 | 信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58129587A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5587281A (en) * | 1978-12-26 | 1980-07-01 | Omron Tateisi Electronics Co | Picture-signal processing method |
| JPS56131258A (en) * | 1980-03-19 | 1981-10-14 | Hitachi Ltd | Photoelectric converter |
| JPS56135285A (en) * | 1980-03-25 | 1981-10-22 | Nec Corp | White level tracking circuit |
-
1982
- 1982-01-27 JP JP57011256A patent/JPS58129587A/ja active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5587281A (en) * | 1978-12-26 | 1980-07-01 | Omron Tateisi Electronics Co | Picture-signal processing method |
| JPS56131258A (en) * | 1980-03-19 | 1981-10-14 | Hitachi Ltd | Photoelectric converter |
| JPS56135285A (en) * | 1980-03-25 | 1981-10-22 | Nec Corp | White level tracking circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0140377B2 (ja) | 1989-08-28 |
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