JPS58125160A - マイクロコンピユ−タ制御回路 - Google Patents
マイクロコンピユ−タ制御回路Info
- Publication number
- JPS58125160A JPS58125160A JP735382A JP735382A JPS58125160A JP S58125160 A JPS58125160 A JP S58125160A JP 735382 A JP735382 A JP 735382A JP 735382 A JP735382 A JP 735382A JP S58125160 A JPS58125160 A JP S58125160A
- Authority
- JP
- Japan
- Prior art keywords
- microcomputer
- control
- switch
- output
- control circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/01—Input arrangements or combined input and output arrangements for interaction between user and computer
- G06F3/02—Input arrangements using manually operated switches, e.g. using keyboards or dials
- G06F3/0227—Cooperation and interconnection of the input arrangement with other functional units of a computer
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- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、７つのマイクロコンビュータカ発生する制御
信号出力により、他のマイクロコンピュータの動作を制
御するようにしたマイクロコンピュータ制御（ロ）路に
関する。
信号出力により、他のマイクロコンピュータの動作を制
御するようにしたマイクロコンピュータ制御（ロ）路に
関する。
近年、マイクロコンピュータの発展はめざましく、特に
、マイクロコンピュータの基本構成要素である、データ
の出し入れを行う入出力部、演算及びデータ処理を行う
中央処理部、プログラム保持用及びデータ保持用のメモ
リ部等の各部が、７つの大規模集積回路素子として集積
化されたワンチップ・マイクロコンピュータが、種々の
分野で応用されている。斯かるマイクロコンピュータを
複数個使用する場合、し１］えば、制御用マイクロコン
ピュータからの制御信号出力により、他のマイクロコン
ピュータを、制御して、この制御されるマイクロコンピ
ュータから所望の出力を得るようにする場合、通常、各
マイクロコンピュータのシリアル出力ボート及びシリア
ル入力ポートが使用され、マイクロコンピュータ間でシ
リアル情報の伝達を行うようにされる。これは、マイク
ロコンピュータ間でバラＶル情報の伝達を行おうとする
と、出力ポート及び入力ホートラ多数必要とするこ、と
になり、入・出力ポート数の点から制約されるからであ
る。、シかしながら、シリアル情報の伝達にあっては、
情報伝達の高速化がはかれない、シリアル情報処理用の
プログラムを追加しなければならない等の不都合がある
。
、マイクロコンピュータの基本構成要素である、データ
の出し入れを行う入出力部、演算及びデータ処理を行う
中央処理部、プログラム保持用及びデータ保持用のメモ
リ部等の各部が、７つの大規模集積回路素子として集積
化されたワンチップ・マイクロコンピュータが、種々の
分野で応用されている。斯かるマイクロコンピュータを
複数個使用する場合、し１］えば、制御用マイクロコン
ピュータからの制御信号出力により、他のマイクロコン
ピュータを、制御して、この制御されるマイクロコンピ
ュータから所望の出力を得るようにする場合、通常、各
マイクロコンピュータのシリアル出力ボート及びシリア
ル入力ポートが使用され、マイクロコンピュータ間でシ
リアル情報の伝達を行うようにされる。これは、マイク
ロコンピュータ間でバラＶル情報の伝達を行おうとする
と、出力ポート及び入力ホートラ多数必要とするこ、と
になり、入・出力ポート数の点から制約されるからであ
る。、シかしながら、シリアル情報の伝達にあっては、
情報伝達の高速化がはかれない、シリアル情報処理用の
プログラムを追加しなければならない等の不都合がある
。
本発明は、被制御マイクロコノピユータとして、複数個
のスイッチが外部接続され、それらのうちのいずれかが
動作せしめられたとき、その動作せしめられたスイッチ
を検知して、それに対応した出カケ生ずる、いわゆる、
キースキャニング型の人力部を備えたマイクロコンピユ
ータラ用い、制句１１マイクロコンピュータからの制御
信号にもとすいて上述の複数個のスイッチを動作せしめ
ることにより被制御マイクロコンピュータの制御を行う
る人・出力ポート数を別設増加せしめることなくコノピ
ユータの制御ができるようにしたマイクロコンピュータ
制御回路を提供するものである１、以下、本発明の実施
例について図を参照して説明する。
のスイッチが外部接続され、それらのうちのいずれかが
動作せしめられたとき、その動作せしめられたスイッチ
を検知して、それに対応した出カケ生ずる、いわゆる、
キースキャニング型の人力部を備えたマイクロコンピユ
ータラ用い、制句１１マイクロコンピュータからの制御
信号にもとすいて上述の複数個のスイッチを動作せしめ
ることにより被制御マイクロコンピュータの制御を行う
る人・出力ポート数を別設増加せしめることなくコノピ
ユータの制御ができるようにしたマイクロコンピュータ
制御回路を提供するものである１、以下、本発明の実施
例について図を参照して説明する。
第７図は本発明に係るマイクロコンピュータ制御回路の
−し１を示す。／は制御マイクロコンピュータで、ワン
チップ瞭マイクロコンピュータとされている。制御マイ
クロニンピユータ／は制御信号発生部コからの制御信号
を第一の出力ポート３を介して送出する。この例では、
制御信号は夫々位相が相違するｑ種のパルス信号Ｃａ、
Ｃｂ。
−し１を示す。／は制御マイクロコンピュータで、ワン
チップ瞭マイクロコンピュータとされている。制御マイ
クロニンピユータ／は制御信号発生部コからの制御信号
を第一の出力ポート３を介して送出する。この例では、
制御信号は夫々位相が相違するｑ種のパルス信号Ｃａ、
Ｃｂ。
Ｃｃ及びＣｄで形成される、また、この例では、制御マ
イクロコンピュータ／にはタイマ一部りが内蔵されてい
て、制御信号発生部λの動作がタイマ一部グにより制御
される。さらに、Ｓは入力ポートでタイマ一部グに接続
されており、乙は第二の出力ポートで互いに位相が相違
する一種のクロックパルスＣＰｔ及びＣＦ２ ’ｉ送出
する。７はキースイッチマトリクスで、制御マイクロコ
ノピユータ／に、キースキャニング式入力制御部を形成
するｔう接続されている。即ち、このキースイッチマト
リクス７には、第二の出力ボート乙からのクロックパル
スＣＰｔ及びＣＦ２が供給され、これらのいずれかが、
キースイッチマトリクス７中のオンとされたキースイッ
チに対応したタイミングで入力ポートＳに入力されて、
これにより匍ｊ御マイクロコンピュータ／内のタイマ一
部りが制御される。
イクロコンピュータ／にはタイマ一部りが内蔵されてい
て、制御信号発生部λの動作がタイマ一部グにより制御
される。さらに、Ｓは入力ポートでタイマ一部グに接続
されており、乙は第二の出力ポートで互いに位相が相違
する一種のクロックパルスＣＰｔ及びＣＦ２ ’ｉ送出
する。７はキースイッチマトリクスで、制御マイクロコ
ノピユータ／に、キースキャニング式入力制御部を形成
するｔう接続されている。即ち、このキースイッチマト
リクス７には、第二の出力ボート乙からのクロックパル
スＣＰｔ及びＣＦ２が供給され、これらのいずれかが、
キースイッチマトリクス７中のオンとされたキースイッ
チに対応したタイミングで入力ポートＳに入力されて、
これにより匍ｊ御マイクロコンピュータ／内のタイマ一
部りが制御される。
このように、制御マイクロコンピュータ／に於いては、
キースイッチマトリクス７の操作によりタイマ一部グの
設定がなされ、このタイマ一部グの出力によって動作が
制御される制御信号発生部λから、グ神のパルス信号ｃ
、、Ｃｂ、ｃ０及びＣｄで形成される制御信号が送出さ
れるのである。
キースイッチマトリクス７の操作によりタイマ一部グの
設定がなされ、このタイマ一部グの出力によって動作が
制御される制御信号発生部λから、グ神のパルス信号ｃ
、、Ｃｂ、ｃ０及びＣｄで形成される制御信号が送出さ
れるのである。
一方、ｇは被制御マイクロコンピュータで、これもワノ
チップ・マイクロコンピュータとされている４、この被
制御マイクロコンピュータｇｒｒｓ、、出力イバ号形成
部９で形成さｎる出力信号Ｐを第一の出力ポート１０か
ら送出する１、ここで、出力信号Ｐは、例えば、電子選
局装置に対する選局電圧等である。また、／／ａ、／／
ｂ、／／ｃ及び／／ｄは入力ポートで出力信号形成部９
への制御信号を外部から受は入れ、さらに、／２は第二
の出力ポートでクロックパルスｃｐ３’ｉ送出する。／
３はスイッチ部で、夫々が被制御マイクロコノピユータ
ｇに接続された複数個、例えば、グ個のスイッチ／ｌＩ
。
チップ・マイクロコンピュータとされている４、この被
制御マイクロコンピュータｇｒｒｓ、、出力イバ号形成
部９で形成さｎる出力信号Ｐを第一の出力ポート１０か
ら送出する１、ここで、出力信号Ｐは、例えば、電子選
局装置に対する選局電圧等である。また、／／ａ、／／
ｂ、／／ｃ及び／／ｄは入力ポートで出力信号形成部９
への制御信号を外部から受は入れ、さらに、／２は第二
の出力ポートでクロックパルスｃｐ３’ｉ送出する。／
３はスイッチ部で、夫々が被制御マイクロコノピユータ
ｇに接続された複数個、例えば、グ個のスイッチ／ｌＩ
。
１５、／乙及び７７を内蔵している、これら７個のスイ
ッチの夫々の一端は共通接続されて第二の出力ポート／
Ωに接゛続され、また、夫々の他端は入力ボート／／ａ
、／／ｂ、／／ｃ及び／／ｄに夫々接続されている。従
って、被制御マイクロコンピュータｇに於いては、ダ個
のスイッチ／’Ｉ、／ｊｔ。
ッチの夫々の一端は共通接続されて第二の出力ポート／
Ωに接゛続され、また、夫々の他端は入力ボート／／ａ
、／／ｂ、／／ｃ及び／／ｄに夫々接続されている。従
って、被制御マイクロコンピュータｇに於いては、ダ個
のスイッチ／’Ｉ、／ｊｔ。
／乙及び／７のいずれかがオンとされるとき、第二の出
力ポート／２からのクロックパルスＣＰ３が対応する入
力ポート／／ａ、／／ｂ、／／。及び／／ｄのいずれか
に、出力信号形成部ワへの制御信号として供給され、出
力信号形成部９はこれに応じた出力信号Ｐを形成する１
、 上述の制御マイクロコンピュータ／と被制御マイクロコ
ンピュータざとの間には、スイッチ制御 “回路
／ｇが配されている。スイッチ制御回路７ｇは、制御マ
イクロコンピュータ／からの制御信号を形成するダ種の
パルス信号Ｃａ 、 Ｃｂ 、 Ｃｃ及びＣｄが夫々供
給されるりつの入力端と、被制御マイクロコンピュータ
ｇに接続されたグ個のスイッチ／’ｌ、／！；、／Ａ及
び／７の夫々の制御端に夫々接続され、スイッチ動作信
号Ｓ ａ ＋ Ｓ ｂ ｒＳｃ及びＳｄを供給するｑつ
の出力端を有してい、る３、スイッチ／グ、／！；、／
乙及び／７は、スイッチＩ＋を作信号Ｓａ、Ｓｂ、Ｓｃ
及びＳｄが、例えば、高７ベルのときオンとなり、低レ
ベルのときオフとなる。さらに、スイッチ制御回路／ｇ
には１ｔｉｌｌ Ｎマイクロコンピュータ／からのりａ
ツクパルスＣＰｌが供給され、このスイッチ制御回路／
ｇは、ｑつの入力端からのパルス信号Ｃａ、Ｃｂ、ｃ。
力ポート／２からのクロックパルスＣＰ３が対応する入
力ポート／／ａ、／／ｂ、／／。及び／／ｄのいずれか
に、出力信号形成部ワへの制御信号として供給され、出
力信号形成部９はこれに応じた出力信号Ｐを形成する１
、 上述の制御マイクロコンピュータ／と被制御マイクロコ
ンピュータざとの間には、スイッチ制御 “回路
／ｇが配されている。スイッチ制御回路７ｇは、制御マ
イクロコンピュータ／からの制御信号を形成するダ種の
パルス信号Ｃａ 、 Ｃｂ 、 Ｃｃ及びＣｄが夫々供
給されるりつの入力端と、被制御マイクロコンピュータ
ｇに接続されたグ個のスイッチ／’ｌ、／！；、／Ａ及
び／７の夫々の制御端に夫々接続され、スイッチ動作信
号Ｓ ａ ＋ Ｓ ｂ ｒＳｃ及びＳｄを供給するｑつ
の出力端を有してい、る３、スイッチ／グ、／！；、／
乙及び／７は、スイッチＩ＋を作信号Ｓａ、Ｓｂ、Ｓｃ
及びＳｄが、例えば、高７ベルのときオンとなり、低レ
ベルのときオフとなる。さらに、スイッチ制御回路／ｇ
には１ｔｉｌｌ Ｎマイクロコンピュータ／からのりａ
ツクパルスＣＰｌが供給され、このスイッチ制御回路／
ｇは、ｑつの入力端からのパルス信号Ｃａ、Ｃｂ、ｃ。
及びｃｄのノベル全クロックパルスＣＰｌの、ρＩＬＬ
ば、立下り時点でラッチするラッチ回路として動作し、
斯かるラッチ動作によりスイッチ動作信号Ｓａ、Ｓｂ
＋ Ｓ（Ｂ及びＳｄｋ形成する。
ば、立下り時点でラッチするラッチ回路として動作し、
斯かるラッチ動作によりスイッチ動作信号Ｓａ、Ｓｂ
＋ Ｓ（Ｂ及びＳｄｋ形成する。
上述の如くの構成において、制御マイクロコンピュータ
／は、９種のパルス信号Ｃａ ＋ Ｃｂｒｃｏ及びＣｄ
の夫々のクロックパルスＣＰｌに対する位相関係が異な
る第一から第四の制御信号を選択的に送出する。、第一
の制御信号は、第Ω図Ａに示される如く、パルス信号Ｃ
Ｂ ＋ Ｃｌ） ＋ Ｃ（及びＣｄの位相が、クロック
パルスＣＰｌの立下り時点に於いて、パルス信号Ｃａの
みが高Ｖペル部となり、他のパルス信号Ｃｂ、Ｃｃ及び
Ｃｄは低レベル部となるようにされたものとなる。また
、第二。
／は、９種のパルス信号Ｃａ ＋ Ｃｂｒｃｏ及びＣｄ
の夫々のクロックパルスＣＰｌに対する位相関係が異な
る第一から第四の制御信号を選択的に送出する。、第一
の制御信号は、第Ω図Ａに示される如く、パルス信号Ｃ
Ｂ ＋ Ｃｌ） ＋ Ｃ（及びＣｄの位相が、クロック
パルスＣＰｌの立下り時点に於いて、パルス信号Ｃａの
みが高Ｖペル部となり、他のパルス信号Ｃｂ、Ｃｃ及び
Ｃｄは低レベル部となるようにされたものとなる。また
、第二。
第三及び第四の制御信号は、同様に、第３図Ａ。
第ｑ図Ａ及び第Ｓ図Ａに示される如く、夫々、パルス信
号Ｃｂのみ、パルス信号Ｃ０のみ及びパルス信号Ｃｄの
みがりａツクパルスＣＰ／の立下り時点に於いて高Ｖペ
ル部となるようにされたものとなる、このため、制御マ
イクロコンピュータ／がら第一の制御信号が送出された
ときには、スイッチ制御回路／ｇでは、クロックパルス
ＣＰｌの立下り時点で、パルス信号Ｃ８の高Ｖペル部と
パルス信号Ｃｂ、ｃｏ及びＣｄの低レベル部がラッチさ
れ、これにもとすきそのｑつの出力端から夫々送出され
るスイッチ動作信号Ｓａ 、ｓｂ 、Ｓｃ及びＳｄは、
第λ図Ｂに示される如く、スイッチ動作信号Ｓａのみが
高Ｖペルをとり、他は低レベルをとるものとなる。従っ
て、この時、被制御マイクロコンピュータｇに接続され
たスイッチ／ｙのみがオフとな抄、被制御マイクロコン
ピュータｇは、クロックパルスＣＰ、７がスイッチ／４
’に介して入力ポート／／ａに供給されて、これに対応
した出力信号、例えば、電子選局装置に対する第一の選
局電圧を第一の出力ポート１０から送出する。また、１
ｆｉｌｌ Ｉｌ’ｌｌ マイクロコンピュータ／から、
第二、第三もしくけ第四の制御信号が送出されたときに
は、スイッチ制御回路／ｇでは、クロックパルスＣＰｔ
０ヴ下り時点で、夫々、パルス信号Ｃｂの高Ｖペル部と
他のパルス信号の低レベル部、パルス信号ＣｃＯ高ノベ
ル部と他のパルス信号の低レベル部、もしｎｅｔ、パル
ス信号ＣｄＯ高ノベル部と他のパルス信号の低レベル部
がラッチされ、これにもとすき、夫々のときのスイッチ
動作信号Ｓａ、Ｓｂ。
号Ｃｂのみ、パルス信号Ｃ０のみ及びパルス信号Ｃｄの
みがりａツクパルスＣＰ／の立下り時点に於いて高Ｖペ
ル部となるようにされたものとなる、このため、制御マ
イクロコンピュータ／がら第一の制御信号が送出された
ときには、スイッチ制御回路／ｇでは、クロックパルス
ＣＰｌの立下り時点で、パルス信号Ｃ８の高Ｖペル部と
パルス信号Ｃｂ、ｃｏ及びＣｄの低レベル部がラッチさ
れ、これにもとすきそのｑつの出力端から夫々送出され
るスイッチ動作信号Ｓａ 、ｓｂ 、Ｓｃ及びＳｄは、
第λ図Ｂに示される如く、スイッチ動作信号Ｓａのみが
高Ｖペルをとり、他は低レベルをとるものとなる。従っ
て、この時、被制御マイクロコンピュータｇに接続され
たスイッチ／ｙのみがオフとな抄、被制御マイクロコン
ピュータｇは、クロックパルスＣＰ、７がスイッチ／４
’に介して入力ポート／／ａに供給されて、これに対応
した出力信号、例えば、電子選局装置に対する第一の選
局電圧を第一の出力ポート１０から送出する。また、１
ｆｉｌｌ Ｉｌ’ｌｌ マイクロコンピュータ／から、
第二、第三もしくけ第四の制御信号が送出されたときに
は、スイッチ制御回路／ｇでは、クロックパルスＣＰｔ
０ヴ下り時点で、夫々、パルス信号Ｃｂの高Ｖペル部と
他のパルス信号の低レベル部、パルス信号ＣｃＯ高ノベ
ル部と他のパルス信号の低レベル部、もしｎｅｔ、パル
ス信号ＣｄＯ高ノベル部と他のパルス信号の低レベル部
がラッチされ、これにもとすき、夫々のときのスイッチ
動作信号Ｓａ、Ｓｂ。
ＳＣ及びＳｄは、第３図Ｂ、第を図Ｂもしくは第ｓ図Ｂ
に示される如く、スイッチ動作信号ｓｂのみが高レベル
をとって他は低レベルをとる、スイッチ動作信号Ｓ。の
みが高レベルをとって他は低レベルをとる、もしくは、
スイッチ動作信号Ｓｄのみが高レベルをとって他は低レ
ベルをとるものとなる。従って、斯かる第二、第三もし
くは第四の制御信号が送出されたときには、スイッチ／
Ｓ。
に示される如く、スイッチ動作信号ｓｂのみが高レベル
をとって他は低レベルをとる、スイッチ動作信号Ｓ。の
みが高レベルをとって他は低レベルをとる、もしくは、
スイッチ動作信号Ｓｄのみが高レベルをとって他は低レ
ベルをとるものとなる。従って、斯かる第二、第三もし
くは第四の制御信号が送出されたときには、スイッチ／
Ｓ。
／乙もしくは／７のみがオンとなり、被制御マイクロコ
ンピュータｇは、夫々のときに、クロックパルスＣＰ３
がスイッチ１５．／乙もしくは／７を介して入力ポート
／／ｂ、／／。もしくは／／ｄに供給されて、これに対
応した出力信号、例えば、電子選局装置に対する第二、
第三もしくは第四の選局電圧を第一の出力ポート１０か
ら夫々送出する１、このようにして、制御マイクロコン
ピュータ／が発生するグ種の制御信号にもとすき、被制
御マイクロコンピュータどの動作が制御されるのである
。
ンピュータｇは、夫々のときに、クロックパルスＣＰ３
がスイッチ１５．／乙もしくは／７を介して入力ポート
／／ｂ、／／。もしくは／／ｄに供給されて、これに対
応した出力信号、例えば、電子選局装置に対する第二、
第三もしくは第四の選局電圧を第一の出力ポート１０か
ら夫々送出する１、このようにして、制御マイクロコン
ピュータ／が発生するグ種の制御信号にもとすき、被制
御マイクロコンピュータどの動作が制御されるのである
。
以上説明した如く、本発明に係るコンピュータ制御回路
によれば、７つのマイクロコンピュータによる他のマイ
クロコンピュータの制御を、各マイクロコンピュータの
入・出力ポート数を別設増加せ［７めることなく、また
、両マイクロコンピュータ間でシリアル情報の伝達をす
ることなく高速で、行うことができる。
によれば、７つのマイクロコンピュータによる他のマイ
クロコンピュータの制御を、各マイクロコンピュータの
入・出力ポート数を別設増加せ［７めることなく、また
、両マイクロコンピュータ間でシリアル情報の伝達をす
ることなく高速で、行うことができる。
なお、上述の実施［？ｌＪでは、制御マイクロコンピュ
ータが発生する制御信号は９種で、夫々がグ種のパルス
信号で形成されており、また、被制御マイクロコンピュ
ータには７個のスイッチが接続されているが、これら制
御信号の数、制御信号を形成するパルス信号の数、スイ
ッチの数等は、必要に応じて任意に設定することができ
るものである。。
ータが発生する制御信号は９種で、夫々がグ種のパルス
信号で形成されており、また、被制御マイクロコンピュ
ータには７個のスイッチが接続されているが、これら制
御信号の数、制御信号を形成するパルス信号の数、スイ
ッチの数等は、必要に応じて任意に設定することができ
るものである。。
さらに、被制御マイクロコンピュータに接続源れる複数
個のスイッチの２個以上が、同時に動作せしめられるよ
うにされてもよい、う
個のスイッチの２個以上が、同時に動作せしめられるよ
うにされてもよい、う
第１図は本発明に係るマイクロコンピュータ制（ｆ１４
１回路の一例全示すブロック接続図、第ユ図、第３図＋
’ｊ’＋ｑ図及び第３図は第１図に示されるし１１の
１肋作説明に供される波形図である。
１回路の一例全示すブロック接続図、第ユ図、第３図＋
’ｊ’＋ｑ図及び第３図は第１図に示されるし１１の
１肋作説明に供される波形図である。
Claims (1)
- 制御信号全発生する制御マイクロコンピュータ部と、複
数個のスイッチが接続され、それらのうちのいずれかが
動作せしめられたとき、該動作せしめられたスイッチに
対応した出力を発生する被制御マイクロコノピユータ部
との間に、上記制御マイクロコンピュータ部からの制御
信号が供給される入力端と上記複数のスイッチの夫々の
制御端に夫々接続される複数の出力端とを有するスイッ
チ制御回路部が配され、該スイッチ制御回路部が、−上
記制御信号の内容に応じて選択される上記複数の出力端
の少なくとも７つから、スイッチ動作出力を発生して該
出力端が接続された上記複数のスイッチの少なくとも７
つ全動作せしめるようにすることにより、上記制御信号
にもとず〈上記被制御マイクロコノピユータ部の制御を
行うようにしたマイクロコンピュータ制御回路１
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP735382A JPS58125160A (ja) | 1982-01-20 | 1982-01-20 | マイクロコンピユ−タ制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP735382A JPS58125160A (ja) | 1982-01-20 | 1982-01-20 | マイクロコンピユ−タ制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58125160A true JPS58125160A (ja) | 1983-07-26 |
Family
ID=11663586
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP735382A Pending JPS58125160A (ja) | 1982-01-20 | 1982-01-20 | マイクロコンピユ−タ制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58125160A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04124076U (ja) * | 1991-04-19 | 1992-11-11 | 株式会社釣研 | 釣り用掛止環 |
-
1982
- 1982-01-20 JP JP735382A patent/JPS58125160A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04124076U (ja) * | 1991-04-19 | 1992-11-11 | 株式会社釣研 | 釣り用掛止環 |
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