JPH11205785A - 無線通信システムのビデオデータ伝送方法及び装置 - Google Patents
無線通信システムのビデオデータ伝送方法及び装置Info
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- JPH11205785A JPH11205785A JP35856497A JP35856497A JPH11205785A JP H11205785 A JPH11205785 A JP H11205785A JP 35856497 A JP35856497 A JP 35856497A JP 35856497 A JP35856497 A JP 35856497A JP H11205785 A JPH11205785 A JP H11205785A
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- H04N19/85—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using pre-processing or post-processing specially adapted for video compression
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- H04N21/40—Client devices specifically adapted for the reception of or interaction with content, e.g. set-top-box [STB]; Operations thereof
- H04N21/43—Processing of content or additional data, e.g. demultiplexing additional data from a digital video stream; Elementary client operations, e.g. monitoring of home network or synchronising decoder's clock; Client middleware
- H04N21/434—Disassembling of a multiplex stream, e.g. demultiplexing audio and video streams, extraction of additional data from a video stream; Remultiplexing of multiplex streams; Extraction or processing of SI; Disassembling of packetised elementary stream
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- Signal Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
- Information Transfer Systems (AREA)
- Computer And Data Communications (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】
【課題】 計算時間を短くでき、複雑性を緩和すること
ができると共に、エラーに強いビデオデータ伝送方法及
び装置を提供することを目的とする。 【解決手段】 Ｎ個のＶＬＣデータブロックを一時的に
格納する臨時メモリ２０１と、臨時メモリ２０１に格納
されたＮ個のブロックを一定な第１ビットレートＳ１よ
り小さいビットレートで格納する待機メモリ２０８と、
データブロックを臨時メモリ２０１に格納するためのア
ドレス信号を発生し、ＶＬＣデータブロックを待機メモ
リ２０８に格納するためのアドレス信号を発生するビッ
トカウンタ２０６と、ビットカウンタ２０６を制御して
臨時メモリ２０１から一定な第１ビットレートＳ１より
小さいビットレートでブロックデータを読み出し、さら
に待機メモリ２０８に書き込むよう制御する制御部２０
４を備えた構成とした。
ができると共に、エラーに強いビデオデータ伝送方法及
び装置を提供することを目的とする。 【解決手段】 Ｎ個のＶＬＣデータブロックを一時的に
格納する臨時メモリ２０１と、臨時メモリ２０１に格納
されたＮ個のブロックを一定な第１ビットレートＳ１よ
り小さいビットレートで格納する待機メモリ２０８と、
データブロックを臨時メモリ２０１に格納するためのア
ドレス信号を発生し、ＶＬＣデータブロックを待機メモ
リ２０８に格納するためのアドレス信号を発生するビッ
トカウンタ２０６と、ビットカウンタ２０６を制御して
臨時メモリ２０１から一定な第１ビットレートＳ１より
小さいビットレートでブロックデータを読み出し、さら
に待機メモリ２０８に書き込むよう制御する制御部２０
４を備えた構成とした。
Description
【０００１】
【発明の属する技術分野】本発明は、無線通信システム
において、無線チャンネル又はエラー強度の低い送／受
信データのチャンネルコーディングパケット化方法に係
り、特に可変レートビットストリームの欠点が補える無
線通信システムにおいてビデオデータ伝送方法及び装置
に関する。
において、無線チャンネル又はエラー強度の低い送／受
信データのチャンネルコーディングパケット化方法に係
り、特に可変レートビットストリームの欠点が補える無
線通信システムにおいてビデオデータ伝送方法及び装置
に関する。
【０００２】
【従来の技術】通常、無線通信システムで、無線チャン
ネルを通じたデータ伝送の場合（特に、６４Ｋｂｐｓ以
上の伝送率の場合）、固定率ビットストリームが可変率
ビットストリームに比べビットエラー率が低いと知られ
ている。
ネルを通じたデータ伝送の場合（特に、６４Ｋｂｐｓ以
上の伝送率の場合）、固定率ビットストリームが可変率
ビットストリームに比べビットエラー率が低いと知られ
ている。
【０００３】図１（ａ）から（ｄ）は、１９９５年６
月、日本のＮＴＴ移動通信ネットワーク社より提案され
た方法であって、長さの異なるビットストリームを同一
な一定長さＳを有する固定率ビットストリームに変換す
る方法を示している。特に、図１（ａ）のように、長さ
の異なるＮ個のブロック（又はシンボル）ｂ１〜ｂｎが
ある場合、図１（ｂ）から（ｄ）に示したように、一定
ビットレート長さＳより短くコーディングされたシンボ
ル（又は、ブロック）ｂ２、ｂ３の後に、一定ビットレ
ートより長くコーディングされたシンボル（又はブロッ
ク）ｂ１、ｂｎ−１の一部を埋め込むことによって、全
てのシンボル（又はブロック）を一定ビットレートで同
時に伝送させ得る再配置方法に関する。
月、日本のＮＴＴ移動通信ネットワーク社より提案され
た方法であって、長さの異なるビットストリームを同一
な一定長さＳを有する固定率ビットストリームに変換す
る方法を示している。特に、図１（ａ）のように、長さ
の異なるＮ個のブロック（又はシンボル）ｂ１〜ｂｎが
ある場合、図１（ｂ）から（ｄ）に示したように、一定
ビットレート長さＳより短くコーディングされたシンボ
ル（又は、ブロック）ｂ２、ｂ３の後に、一定ビットレ
ートより長くコーディングされたシンボル（又はブロッ
ク）ｂ１、ｂｎ−１の一部を埋め込むことによって、全
てのシンボル（又はブロック）を一定ビットレートで同
時に伝送させ得る再配置方法に関する。
【０００４】しかし、このような従来の方法は、全ての
ブロック（又は、シンボル）ｂ１〜ｂｎに同一長さＳを
有させるＶＬＣ（Ｖａｒｉａｂｌｅ Ｌｅｎｇｔｈ Ｃ
ｏｄｉｎｇ）がなされるまで待ち合わせねばならない。
かつ、非常に長いシンボルｂ１（図１（ａ））は、図１
（ｂ）及び（ｃ）のように数回分離して他の短いシンボ
ルｂ２、ｂ３に埋め込むべきであり、よって長い処理時
間がかかる問題がある。
ブロック（又は、シンボル）ｂ１〜ｂｎに同一長さＳを
有させるＶＬＣ（Ｖａｒｉａｂｌｅ Ｌｅｎｇｔｈ Ｃ
ｏｄｉｎｇ）がなされるまで待ち合わせねばならない。
かつ、非常に長いシンボルｂ１（図１（ａ））は、図１
（ｂ）及び（ｃ）のように数回分離して他の短いシンボ
ルｂ２、ｂ３に埋め込むべきであり、よって長い処理時
間がかかる問題がある。
【０００５】
【発明が解決しようとする課題】従って、本発明の目的
は、計算時間及び複雑性が縮められるビデオデータ伝送
方法及び装置を提供することにある。本発明の他の目的
は、同一な計算時間と複雑性でエラーに強いビデオデー
タ伝送方法及び回路を提供することにある。
は、計算時間及び複雑性が縮められるビデオデータ伝送
方法及び装置を提供することにある。本発明の他の目的
は、同一な計算時間と複雑性でエラーに強いビデオデー
タ伝送方法及び回路を提供することにある。
【０００６】
【課題を解決するための手段】このような目的を達成す
るために、本発明のビデオデータ伝送装置において、臨
時メモリはＮ個のＶＬＣデータブロック（又は、シンボ
ル）を一時的に貯蔵し、待機メモリは、データブロック
の伝送前に、前記臨時メモリに貯蔵されたＮ個のブロッ
クを一定のビットレートより小さいビットレートで順に
貯蔵する。さらに、ビットカウンタはデータブロックを
前記臨時メモリにソーティングするためのアドレス信号
を発生し、スタートポイントの異なるＶＬＣデータブロ
ックを前記待機メモリに貯蔵するためのアドレス信号を
発生する。制御部は、一定な第１ビットレートより小さ
いビットレートでブロック（又は、シンボル）データを
読み出し、かつ前記待機メモリに前記臨時メモリから読
み出したデータを書き込むために前記入力ブロックデー
タの状態をチェックして前記ビットカウンタを制御す
る。
るために、本発明のビデオデータ伝送装置において、臨
時メモリはＮ個のＶＬＣデータブロック（又は、シンボ
ル）を一時的に貯蔵し、待機メモリは、データブロック
の伝送前に、前記臨時メモリに貯蔵されたＮ個のブロッ
クを一定のビットレートより小さいビットレートで順に
貯蔵する。さらに、ビットカウンタはデータブロックを
前記臨時メモリにソーティングするためのアドレス信号
を発生し、スタートポイントの異なるＶＬＣデータブロ
ックを前記待機メモリに貯蔵するためのアドレス信号を
発生する。制御部は、一定な第１ビットレートより小さ
いビットレートでブロック（又は、シンボル）データを
読み出し、かつ前記待機メモリに前記臨時メモリから読
み出したデータを書き込むために前記入力ブロックデー
タの状態をチェックして前記ビットカウンタを制御す
る。
【０００７】
【発明の実施の形態】以下、本発明に従う好適な一実施
の形態を添付図面を参照しつつ詳細に説明する。図２
は、本発明の一実施の形態によるビデオデータ伝送装置
のブロック図である。同図において、臨時メモリ２０１
はＮ個のＶＬＣデータブロック（又は、シンボル）を一
時的に貯蔵し、待機メモリ２０８は、データブロックの
伝送前に、前記臨時メモリ２０１に貯蔵されたＮ個のブ
ロックｂ１〜ｂｎを一定のビットレートＳ１より小さい
ビットレートで順に貯蔵する。さらに、ビットカウンタ
２０６は、データブロックを前記臨時メモリ２０１にソ
ーティングするためのアドレス信号を発生し、スタート
ポイントの異なるＶＬＣデータブロックを前記待機メモ
リ２０８に貯蔵するためのアドレス信号を発生する。制
御部２０４は、一定な第１ビットレートＳ１より小さい
ビットレートにブロック（又は、シンボル）データを読
み出し、かつ前記待機メモリ２０８に前記臨時メモリ２
０１から読み出したデータを書き込むために前記入力ブ
ロックデータの状態をチェックして前記ビットカウンタ
２０６を制御する。
の形態を添付図面を参照しつつ詳細に説明する。図２
は、本発明の一実施の形態によるビデオデータ伝送装置
のブロック図である。同図において、臨時メモリ２０１
はＮ個のＶＬＣデータブロック（又は、シンボル）を一
時的に貯蔵し、待機メモリ２０８は、データブロックの
伝送前に、前記臨時メモリ２０１に貯蔵されたＮ個のブ
ロックｂ１〜ｂｎを一定のビットレートＳ１より小さい
ビットレートで順に貯蔵する。さらに、ビットカウンタ
２０６は、データブロックを前記臨時メモリ２０１にソ
ーティングするためのアドレス信号を発生し、スタート
ポイントの異なるＶＬＣデータブロックを前記待機メモ
リ２０８に貯蔵するためのアドレス信号を発生する。制
御部２０４は、一定な第１ビットレートＳ１より小さい
ビットレートにブロック（又は、シンボル）データを読
み出し、かつ前記待機メモリ２０８に前記臨時メモリ２
０１から読み出したデータを書き込むために前記入力ブ
ロックデータの状態をチェックして前記ビットカウンタ
２０６を制御する。
【０００８】図３（ａ）及び（ｂ）は、本発明の一実施
の形態によって異なるスタートポイントを有するよう処
理されたブロックｂ１〜ｂｎを示したものである。図３
（ａ）は、図２の臨時メモリ２０１に貯蔵された長さの
異なるＮ個のシンボル（又は、ブロック）ｂ１〜ｂｎを
示したものである。図３（ｂ）はビットカウンタ２０６
から発生するアドレス信号に応じて、待機メモリ２０８
に貯蔵されたＮ個のシンボル（又は、ブロック）ｂ１’
〜ｂｎ’を示したものであり、ここで、各シンボルは一
定の第１ビットレートＳ１内で異なるスタートポイント
を有する。
の形態によって異なるスタートポイントを有するよう処
理されたブロックｂ１〜ｂｎを示したものである。図３
（ａ）は、図２の臨時メモリ２０１に貯蔵された長さの
異なるＮ個のシンボル（又は、ブロック）ｂ１〜ｂｎを
示したものである。図３（ｂ）はビットカウンタ２０６
から発生するアドレス信号に応じて、待機メモリ２０８
に貯蔵されたＮ個のシンボル（又は、ブロック）ｂ１’
〜ｂｎ’を示したものであり、ここで、各シンボルは一
定の第１ビットレートＳ１内で異なるスタートポイント
を有する。
【０００９】図４は、本発明の一実施の形態による臨時
メモリ２０１に貯蔵されたＮ個のシンボル（又は、ブロ
ック）ｂ１〜ｂｎを待機メモリ２０８に伝送する流れ図
である。図４を参照すれば、まず、図３（ａ）のよう
に、Ｎ個のシンボル（又はブロック）ｂ１〜ｂｎを前記
臨時メモリ２０１に順次に貯蔵する。現在のシンボルが
最後のシンボルであれば、臨時メモリ２０１に貯蔵され
た各シンボルデータを順次に読み出し、各該当シンボル
が一定の第１ビットレートＳ１より大きいか小さいかを
チェックする。次いで、選択された該当シンボルが前記
一定の第１ビットレートＳ１より大きいと、前記一定の
第１ビットレートＳ１ほどのデータを待機メモリ２０８
に移動させる。最終的に、制御部２０４は前記一定の第
１ビットレートＳ１ほどの次のブロックデータを読み出
して前記待機メモリ２０８に移動させる。
メモリ２０１に貯蔵されたＮ個のシンボル（又は、ブロ
ック）ｂ１〜ｂｎを待機メモリ２０８に伝送する流れ図
である。図４を参照すれば、まず、図３（ａ）のよう
に、Ｎ個のシンボル（又はブロック）ｂ１〜ｂｎを前記
臨時メモリ２０１に順次に貯蔵する。現在のシンボルが
最後のシンボルであれば、臨時メモリ２０１に貯蔵され
た各シンボルデータを順次に読み出し、各該当シンボル
が一定の第１ビットレートＳ１より大きいか小さいかを
チェックする。次いで、選択された該当シンボルが前記
一定の第１ビットレートＳ１より大きいと、前記一定の
第１ビットレートＳ１ほどのデータを待機メモリ２０８
に移動させる。最終的に、制御部２０４は前記一定の第
１ビットレートＳ１ほどの次のブロックデータを読み出
して前記待機メモリ２０８に移動させる。
【００１０】以下、図２から図４を参照して本発明の一
実施の形態を詳細に説明する。送信側の計算時間を縮
め、受信側の複雑性を低減させるために、図３（ａ）及
び（ｂ）に示したように、選択されたシンボル（又は、
ブロック）が一定の第１ビットレートＳ１を有しない場
合は、前記選択されたシンボル（又は、ブロック）の一
部のみビットで充填されて待機メモリ２０８に伝送され
る。
実施の形態を詳細に説明する。送信側の計算時間を縮
め、受信側の複雑性を低減させるために、図３（ａ）及
び（ｂ）に示したように、選択されたシンボル（又は、
ブロック）が一定の第１ビットレートＳ１を有しない場
合は、前記選択されたシンボル（又は、ブロック）の一
部のみビットで充填されて待機メモリ２０８に伝送され
る。
【００１１】図４を参照すれば、制御部２０４は４ａ過
程で、臨時メモリ２０１を書込みモードと設定し、ビッ
トカウンタ２０６を制御してアドレス信号を発生し、受
信されたデータを図３（ａ）のように各ブロック（又
は、シンボル）ずつ４ｂから４ｄ過程を通じて順次に臨
時メモリ２０１に貯蔵する。即ち、前記４ｂ過程で、制
御部２０４は現在受信されたデータが最後のブロックｂ
ｎのデータかをチェックする。前記４ｂ過程で最後のブ
ロックのデータでなければ、４ｄ過程で図３（ａ）に示
したように、順次に各ブロックｂ１〜ｂｎを貯蔵する。
前記４ｂ過程で現在のデータが最後のブロックｂｎのデ
ータの時は、制御部２０４は臨時メモリ２０１を読出し
モードと設定し、ビットカウンタ２０６の制御下でアド
レスを発生してデータを読み出す。４ｅから４ｈ過程
で、制御部２０４は、前記ビットカウンタ２０６から発
生するアドレスに応じて前記臨時メモリ２０１に貯蔵さ
れたＮ個の各ブロック（又は、シンボル）を一定の第１
ビットレートＳ１に読み出し、書込みモードと指定され
た待機メモリ２０８に貯蔵する。
程で、臨時メモリ２０１を書込みモードと設定し、ビッ
トカウンタ２０６を制御してアドレス信号を発生し、受
信されたデータを図３（ａ）のように各ブロック（又
は、シンボル）ずつ４ｂから４ｄ過程を通じて順次に臨
時メモリ２０１に貯蔵する。即ち、前記４ｂ過程で、制
御部２０４は現在受信されたデータが最後のブロックｂ
ｎのデータかをチェックする。前記４ｂ過程で最後のブ
ロックのデータでなければ、４ｄ過程で図３（ａ）に示
したように、順次に各ブロックｂ１〜ｂｎを貯蔵する。
前記４ｂ過程で現在のデータが最後のブロックｂｎのデ
ータの時は、制御部２０４は臨時メモリ２０１を読出し
モードと設定し、ビットカウンタ２０６の制御下でアド
レスを発生してデータを読み出す。４ｅから４ｈ過程
で、制御部２０４は、前記ビットカウンタ２０６から発
生するアドレスに応じて前記臨時メモリ２０１に貯蔵さ
れたＮ個の各ブロック（又は、シンボル）を一定の第１
ビットレートＳ１に読み出し、書込みモードと指定され
た待機メモリ２０８に貯蔵する。
【００１２】即ち、図３（ａ）及び（ｂ）のように、一
定の第１ビットレートＳ１より長いブロックｂ１は、ま
ず一定のビットレートＳ１ほどの待機メモリ２０８の一
番目のブロックｂ１’に貯蔵され、前記ブロックｂ１’
の残りデータは、図３（ｂ）に示したように、待機メモ
リ２０８の次のブロックｂ２’の開始部分に貯蔵され
る。前記処理過程を全ての残りブロックｂ２’〜ｂｎ’
で繰り返し行う、一方、４ｉ過程で、現在のブロックが
最後のブロックｂｎ’であれば、前記制御部２０４は処
理を終了する。
定の第１ビットレートＳ１より長いブロックｂ１は、ま
ず一定のビットレートＳ１ほどの待機メモリ２０８の一
番目のブロックｂ１’に貯蔵され、前記ブロックｂ１’
の残りデータは、図３（ｂ）に示したように、待機メモ
リ２０８の次のブロックｂ２’の開始部分に貯蔵され
る。前記処理過程を全ての残りブロックｂ２’〜ｂｎ’
で繰り返し行う、一方、４ｉ過程で、現在のブロックが
最後のブロックｂｎ’であれば、前記制御部２０４は処
理を終了する。
【００１３】図５は、本発明の他の実施の形態によるビ
デオデータ伝送装置のブロック図である。同図におい
て、臨時メモリ２０１はＮ個のＶＬＣデータブロック
（又は、シンボル）ｂ１〜ｂｎを一時的に貯蔵し、待機
メモリ２０８は、シンボルデータの伝送前に、前記臨時
メモリ２０１に貯蔵されたＮ個のシンボルが一定の第２
ビットレートＳ２になるよう順次に貯蔵する。ビットカ
ウンタ２０６はデータシンボルを前記臨時メモリ２０１
にソーティングするためのアドレス信号を発生し、前記
臨時メモリ２０１に貯蔵されたデータブロック（又は、
シンボル）の状態に応じてビットレートの異なるデータ
シンボルを一定な同一第２ビットレートＳ２で待機メモ
リ２０８に貯蔵するためのアドレス信号を発生する。
デオデータ伝送装置のブロック図である。同図におい
て、臨時メモリ２０１はＮ個のＶＬＣデータブロック
（又は、シンボル）ｂ１〜ｂｎを一時的に貯蔵し、待機
メモリ２０８は、シンボルデータの伝送前に、前記臨時
メモリ２０１に貯蔵されたＮ個のシンボルが一定の第２
ビットレートＳ２になるよう順次に貯蔵する。ビットカ
ウンタ２０６はデータシンボルを前記臨時メモリ２０１
にソーティングするためのアドレス信号を発生し、前記
臨時メモリ２０１に貯蔵されたデータブロック（又は、
シンボル）の状態に応じてビットレートの異なるデータ
シンボルを一定な同一第２ビットレートＳ２で待機メモ
リ２０８に貯蔵するためのアドレス信号を発生する。
【００１４】コーデック５１０は前記全てのデータブロ
ック（又は、シンボル）の状態に応じてビットカウンタ
２０６を制御して可変レートを異にし、同一な一定の第
２ビットレートＳ２を発生する。制御部２０４は、前記
入力シンボル（又は、ブロック）データの状態をチェッ
クして前記ビットカウンタ２０６を制御し、前記コーデ
ック５１０が前記臨時メモリ２０１から前記一定な同一
第２ビットレートＳ２のブロック（又は、シンボルデー
タ）を読み出すよう制御し、前記コーデック５１０を通
じて前記臨時メモリ２０１から読み出したデータを待機
メモリ２０８に書き込むよう制御する。
ック（又は、シンボル）の状態に応じてビットカウンタ
２０６を制御して可変レートを異にし、同一な一定の第
２ビットレートＳ２を発生する。制御部２０４は、前記
入力シンボル（又は、ブロック）データの状態をチェッ
クして前記ビットカウンタ２０６を制御し、前記コーデ
ック５１０が前記臨時メモリ２０１から前記一定な同一
第２ビットレートＳ２のブロック（又は、シンボルデー
タ）を読み出すよう制御し、前記コーデック５１０を通
じて前記臨時メモリ２０１から読み出したデータを待機
メモリ２０８に書き込むよう制御する。
【００１５】図６（ａ）及び（ｂ）は、図５の実施の形
態によるビット平面処理を示したものである。図７は、
本発明の他の実施の形態によるビデオデータ伝送を示し
た流れ図である。同図を参照すれば、まず、制御部２０
４は、図６（ａ）、（ｂ）に示したように、Ｎ個のシン
ボル（又はブロック）ｂ１〜ｂｎを順次に前記臨時メモ
リ２０１に貯蔵する。その後、現在のシンボルが最後の
シンボル（例えば、Ｎ番目のシンボル）ｂｎかをチェッ
クし可変レートにコーディングする。この時、現在のシ
ンボルが最後でなければ、前記臨時メモリ２０１に貯蔵
された各シンボルデータを読出し続け、各該当シンボル
のビットレートを計算してエンコーディングビットレー
トを決定する。次いで、前記決定された該当シンボルを
コンボルーション（ｃｏｎｖｏｌｕｔｉｏｎ）コーディ
ングを通じて待機メモリ２０８に移動させる。次いで、
前記制御部２０４は前記一定な第２ビットレートＳ２ほ
ど次のブロックデータを読み出して前記待機メモリ２０
８に移動させる。
態によるビット平面処理を示したものである。図７は、
本発明の他の実施の形態によるビデオデータ伝送を示し
た流れ図である。同図を参照すれば、まず、制御部２０
４は、図６（ａ）、（ｂ）に示したように、Ｎ個のシン
ボル（又はブロック）ｂ１〜ｂｎを順次に前記臨時メモ
リ２０１に貯蔵する。その後、現在のシンボルが最後の
シンボル（例えば、Ｎ番目のシンボル）ｂｎかをチェッ
クし可変レートにコーディングする。この時、現在のシ
ンボルが最後でなければ、前記臨時メモリ２０１に貯蔵
された各シンボルデータを読出し続け、各該当シンボル
のビットレートを計算してエンコーディングビットレー
トを決定する。次いで、前記決定された該当シンボルを
コンボルーション（ｃｏｎｖｏｌｕｔｉｏｎ）コーディ
ングを通じて待機メモリ２０８に移動させる。次いで、
前記制御部２０４は前記一定な第２ビットレートＳ２ほ
ど次のブロックデータを読み出して前記待機メモリ２０
８に移動させる。
【００１６】図７で説明された本発明の他の実施の形態
は非均衡エラー保護（Ｕｎｅｑｕａｌ Ｅｒｒｏｒ Ｐ
ｒｏｔｅｃｔｉｏｎ：ＵＥＰ）を用いて固定レートビッ
トストリームを形成する方法であって、ＶＬＣシンボル
（又は、ブロック）を重要度によって異なるウェートで
チャンネルコーディングを施す。
は非均衡エラー保護（Ｕｎｅｑｕａｌ Ｅｒｒｏｒ Ｐ
ｒｏｔｅｃｔｉｏｎ：ＵＥＰ）を用いて固定レートビッ
トストリームを形成する方法であって、ＶＬＣシンボル
（又は、ブロック）を重要度によって異なるウェートで
チャンネルコーディングを施す。
【００１７】図７を参照すれば、７ａ過程で、制御部２
０４は臨時メモリ２０１を書込みモードと設定し、ビッ
トカウンタ２０６を制御してアドレス信号を発生し、受
信されたデータを臨時メモリ２０１に貯蔵し、７ｂから
７ｄ過程で、図６（ａ）に示したように、各ブロック
（又は、シンボル）ずつ順に臨時メモリ２０１に貯蔵す
る。特に、前記７ｂ過程で、制御部２０４は現在受信さ
れたデータが最後のブロックｂｎのデータか否かをチェ
ックする。前記７ｂ過程で最後のブロックｂｎのデータ
でなければ、７ｃ及び７ｄ過程で、制御部２０４は順次
に各ブロックｂ１〜ｂｎを臨時メモリ２０１に貯蔵す
る。
０４は臨時メモリ２０１を書込みモードと設定し、ビッ
トカウンタ２０６を制御してアドレス信号を発生し、受
信されたデータを臨時メモリ２０１に貯蔵し、７ｂから
７ｄ過程で、図６（ａ）に示したように、各ブロック
（又は、シンボル）ずつ順に臨時メモリ２０１に貯蔵す
る。特に、前記７ｂ過程で、制御部２０４は現在受信さ
れたデータが最後のブロックｂｎのデータか否かをチェ
ックする。前記７ｂ過程で最後のブロックｂｎのデータ
でなければ、７ｃ及び７ｄ過程で、制御部２０４は順次
に各ブロックｂ１〜ｂｎを臨時メモリ２０１に貯蔵す
る。
【００１８】しかし、前記７ｂ過程で現在の受信された
データが最後のブロックのデータのときは、７ｅ過程
で、制御部２０４は臨時メモリ２０１に貯蔵された現在
のシンボルデータが最後のシンボルｂｎ’に対応するか
をチェックする。前記７ｅ過程でそうでなければ、７ｆ
過程で、制御部２０４は臨時メモリ２０１を読出しモー
ドと設定し、ビットカウンタ２０６の制御下でアドレス
を臨時メモリ２０１に発生し、シンボルデータを読出
し、７ｇ過程で制御部２０４はシンボル（又は、ブロッ
ク）のビット数を計算する。７ｈ過程で、制御部２０４
は前記計算されたビットレートに応じて該当シンボルが
同一な一定の第２ビットレートＳ２を有するようエンコ
ーディングビットレートを決定し、７ｉ過程で、コーデ
ック５１０を制御してコンボルーションコーディングを
行う。前記７ｉ過程のコンボルーションコーディング結
果は、７ｊ過程で、図６（ｂ）のように書込みモードと
設定された待機メモリ２０８に貯蔵する。
データが最後のブロックのデータのときは、７ｅ過程
で、制御部２０４は臨時メモリ２０１に貯蔵された現在
のシンボルデータが最後のシンボルｂｎ’に対応するか
をチェックする。前記７ｅ過程でそうでなければ、７ｆ
過程で、制御部２０４は臨時メモリ２０１を読出しモー
ドと設定し、ビットカウンタ２０６の制御下でアドレス
を臨時メモリ２０１に発生し、シンボルデータを読出
し、７ｇ過程で制御部２０４はシンボル（又は、ブロッ
ク）のビット数を計算する。７ｈ過程で、制御部２０４
は前記計算されたビットレートに応じて該当シンボルが
同一な一定の第２ビットレートＳ２を有するようエンコ
ーディングビットレートを決定し、７ｉ過程で、コーデ
ック５１０を制御してコンボルーションコーディングを
行う。前記７ｉ過程のコンボルーションコーディング結
果は、７ｊ過程で、図６（ｂ）のように書込みモードと
設定された待機メモリ２０８に貯蔵する。
【００１９】即ち、図６（ａ）のように相異なるビット
レートを有するブロックｂ１〜ｂｎは、図６（ｂ）のよ
うに同一な一定の第２ビットレートＳ２のブロックｂ
１’〜ｂｎ’に変換されて待機メモリ２０８に貯蔵され
る。７ｅ過程でブロック（又は、シンボル）のデータが
最後ｂｎ’になるまで前記処理過程を繰り返し行う。こ
の時、コーデック５１０のコンボルーションコーディン
グの性能はレート（入力／出力）で決定される。即ち、
レートが低いほど、即ち入力シンボル数に対して出力シ
ンボル数が多いと、リダンダンシが増加し、よってエラ
ー強度が増大される。図６（ａ）のｂ１のように長いＶ
ＬＣコードは多くの高周波成分を有し、短いＶＬＣコー
ドは低周波成分を多く含むことを意味する。
レートを有するブロックｂ１〜ｂｎは、図６（ｂ）のよ
うに同一な一定の第２ビットレートＳ２のブロックｂ
１’〜ｂｎ’に変換されて待機メモリ２０８に貯蔵され
る。７ｅ過程でブロック（又は、シンボル）のデータが
最後ｂｎ’になるまで前記処理過程を繰り返し行う。こ
の時、コーデック５１０のコンボルーションコーディン
グの性能はレート（入力／出力）で決定される。即ち、
レートが低いほど、即ち入力シンボル数に対して出力シ
ンボル数が多いと、リダンダンシが増加し、よってエラ
ー強度が増大される。図６（ａ）のｂ１のように長いＶ
ＬＣコードは多くの高周波成分を有し、短いＶＬＣコー
ドは低周波成分を多く含むことを意味する。
【００２０】従って、本発明の実施の形態によれば、大
多数の低周波成分の含まれたシンボル（又は、ブロッ
ク）のエラー強度を向上させる以外に、固定されたビッ
トレートが得られる。即ち、ビットカウンタ２０６は臨
時メモリ２０１に貯蔵されたシンボルデータのビット数
を認識し、コーデック５１０はシンボルデータが同一な
一定の第２ビットレートＳ２を有するよう可変レートコ
ーディングを行う。前記コーディングされたシンボルデ
ータは待機メモリ２０８に貯蔵された後、再びマルチプ
レクサ（ＭＵＸ）に送られる。前記動作は全てのＶＬＣ
データに対して繰り返し行われる。
多数の低周波成分の含まれたシンボル（又は、ブロッ
ク）のエラー強度を向上させる以外に、固定されたビッ
トレートが得られる。即ち、ビットカウンタ２０６は臨
時メモリ２０１に貯蔵されたシンボルデータのビット数
を認識し、コーデック５１０はシンボルデータが同一な
一定の第２ビットレートＳ２を有するよう可変レートコ
ーディングを行う。前記コーディングされたシンボルデ
ータは待機メモリ２０８に貯蔵された後、再びマルチプ
レクサ（ＭＵＸ）に送られる。前記動作は全てのＶＬＣ
データに対して繰り返し行われる。
【００２１】
【発明の効果】以上から述べてきたように、本発明は、
無線チャンネル或いはエラー回復率の低いチャンネルを
通じたビデオ及び他のデータ伝送時、可変レートデータ
を容易に固定レートデータに変換させることによりチャ
ンネルのエラー強度を強化させ、かつ前記可変レートチ
ャンネルコーデックを用いて重要度の高いシンボルに対
する保護をさらに強めることによりバーストエラーを最
小化し得る。
無線チャンネル或いはエラー回復率の低いチャンネルを
通じたビデオ及び他のデータ伝送時、可変レートデータ
を容易に固定レートデータに変換させることによりチャ
ンネルのエラー強度を強化させ、かつ前記可変レートチ
ャンネルコーデックを用いて重要度の高いシンボルに対
する保護をさらに強めることによりバーストエラーを最
小化し得る。
【図１】 （ａ）〜（ｄ）は従来の相異なる長さを有す
るビットストリームを固定レートに変換した例を示した
図である。
るビットストリームを固定レートに変換した例を示した
図である。
【図２】 本発明の一実施の形態によるビデオデータ伝
送装置のブロック図である。
送装置のブロック図である。
【図３】 （ａ）及び（ｂ）は図２の実施の形態による
ビット平面処理を示した図である。
ビット平面処理を示した図である。
【図４】 図２の実施の形態による流れ図である。
【図５】 本発明の他の実施の形態によるビデオデータ
伝送装置のブロック図である。
伝送装置のブロック図である。
【図６】 （ａ）及び（ｂ）は図５の実施の形態による
ビット平面処理を示した図である。
ビット平面処理を示した図である。
【図７】 図５の実施の形態による流れ図である。
２０１ 臨時メモリ ２０４ 制御部 ２０６ ビットカウンタ ２０８ 待機メモリ ５１０ コーデック ｂ１，ｂ２，…，ｂｎ ブロック（シンボル） Ｓ１ 第１ビットレート Ｓ２ 第２ビットレート
Claims (4)
- 【請求項１】 ビデオデータ伝送装置において、 Ｎ個のＶＬＣデータブロックを一時的に貯蔵する臨時メ
モリと、 ブロックデータの伝送前に、前記臨時メモリに貯蔵され
たＮ個のブロックを一定な第１ビットレートより小さい
ビットレートで貯蔵する待機メモリと、 データブロックを前記臨時メモリに貯蔵するためのアド
レス信号を発生し、スタートポイントの異なるＶＬＣデ
ータブロックを前記待機貯蔵に貯蔵するためのアドレス
信号を発生するビットカウンタと、 前記入力ブロックデータの状態をチェックして前記ビッ
トカウンタを制御することによって、前記臨時メモリか
ら一定な第１ビットレートより小さいビットレートでブ
ロックデータを読み出し、前記臨時メモリから読み出し
たデータを前記待機メモリに書き込むよう制御する制御
部とよりなることを特徴とする装置。 - 【請求項２】 ビデオデータの伝送方法において、 Ｎ個のシンボルを臨時メモリに一つずつ順に貯蔵する第
１過程と、 前記第１過程で、現在のシンボルが最後のシンボルであ
れば、臨時メモリに貯蔵された各シンボルデータを順次
に読み出し、各該当シンボルが一定な第１ビットレート
より大きいか小さいかをチェックする第２過程と、 前記第２過程で、選択された該当シンボルが前記一定な
第１ビットレートより大きいと、前記一定な第１ビット
レートほどのデータを待機メモリに移動する第３過程
と、 前記第３過程で最後のシンボルデータの時は処理を終わ
らせ、そうでなければ前記一定な第１ビットレートほど
次のブロックデータを読み出して前記待機メモリに再移
動させる第４過程とよりなることを特徴とする方法。 - 【請求項３】 ビデオデータ伝送装置において、 Ｎ個のＶＬＣデータブロックを一時的に貯蔵する臨時メ
モリと、 ブロックデータの伝送前に、前記臨時メモリに貯蔵され
たＮ個のブロックを一定な第２ビットレートで貯蔵する
待機メモリと、 データシンボルを前記臨時メモリにソーティングするた
めのアドレス信号を発生し、前記臨時メモリに貯蔵され
たデータブロックの状態に応じてビットレートの異なる
データシンボルを一定な第２ビットレートで貯蔵するた
めのアドレス信号を発生するビットカウンタと、 前記全てのデータブロックの状態に応じてビットカウン
タを制御して可変レートを異にし、一定な同一第２ビッ
トレートを発生するコーデックと、 前記入力シンボルデータの状態をチェックして前記ビッ
トカウンタを制御し、前記コーデックが前記可変レート
を異にして同一な一定の第２ビットレートで臨時メモリ
に貯蔵されたブロックデータを読み出すよう制御し、前
記コーデックを通じて前記臨時メモリから読み出したデ
ータを前記待機メモリに書き込むよう制御する制御部と
よりなることを特徴とする装置。 - 【請求項４】 ビデオデータの伝送方法において、 Ｎ個のシンボル（又はブロック）を順次に前記臨時メモ
リに貯蔵する第１過程と、 前記第１過程で、現在のシンボルが最後のシンボルかを
チェックして可変レートにコーディングし、現在のシン
ボルが最後でなければ、前記臨時メモリに貯蔵された各
シンボルデータを読出し続け、各該当シンボルのビット
レートを計算してエンコーディングビットレートを決定
する第２過程と、 前記第２過程で決定された該当シンボルをコンボルーシ
ョンコーディングを通じて待機メモリに移動させる第３
過程と、 前記第３過程で最後のシンボルデータの時は処理を終わ
らせ、そうでなければ前記一定な第２ビットレートほど
次のブロックのデータを読み出して前記待機メモリに再
移動させる第４過程とよりなることを特徴とする方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35856497A JPH11205785A (ja) | 1997-12-25 | 1997-12-25 | 無線通信システムのビデオデータ伝送方法及び装置 |
| DE1997158031 DE19758031C2 (de) | 1997-12-25 | 1997-12-29 | Verfahren und Vorrichtung für das Übertragen von Videodaten in einem Funkkommunikationssystem |
| US09/001,916 US6278738B1 (en) | 1997-12-25 | 1997-12-31 | Method and device for transmitting video data in radio communication system |
| CN98104258A CN1124741C (zh) | 1997-12-25 | 1998-01-16 | 在无线电通信系统中发射视频数据的方法和装置 |
Applications Claiming Priority (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP35856497A JPH11205785A (ja) | 1997-12-25 | 1997-12-25 | 無線通信システムのビデオデータ伝送方法及び装置 |
| DE1997158031 DE19758031C2 (de) | 1997-12-25 | 1997-12-29 | Verfahren und Vorrichtung für das Übertragen von Videodaten in einem Funkkommunikationssystem |
| US09/001,916 US6278738B1 (en) | 1997-12-25 | 1997-12-31 | Method and device for transmitting video data in radio communication system |
| CN98104258A CN1124741C (zh) | 1997-12-25 | 1998-01-16 | 在无线电通信系统中发射视频数据的方法和装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11205785A true JPH11205785A (ja) | 1999-07-30 |
Family
ID=27430025
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP35856497A Pending JPH11205785A (ja) | 1997-12-25 | 1997-12-25 | 無線通信システムのビデオデータ伝送方法及び装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6278738B1 (ja) |
| JP (1) | JPH11205785A (ja) |
| CN (1) | CN1124741C (ja) |
| DE (1) | DE19758031C2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7752550B2 (en) * | 2003-09-23 | 2010-07-06 | At&T Intellectual Property I, Lp | System and method for providing managed point to point services |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5440691A (en) * | 1992-02-27 | 1995-08-08 | Digital Equipment Corporation, Pat. Law Group | System for minimizing underflowing transmit buffer and overflowing receive buffer by giving highest priority for storage device access |
| DE4222547A1 (de) * | 1992-07-09 | 1994-01-13 | Philips Patentverwaltung | Schaltungsanordnung zur Steuerung eines Pufferspeichers |
| JP3224465B2 (ja) * | 1993-12-22 | 2001-10-29 | シャープ株式会社 | 画像符号化装置 |
| US5903775A (en) * | 1996-06-06 | 1999-05-11 | International Business Machines Corporation | Method for the sequential transmission of compressed video information at varying data rates |
| US6084910A (en) * | 1997-01-31 | 2000-07-04 | Hughes Electronics Corporation | Statistical multiplexer for video signals |
| US6151075A (en) * | 1997-06-11 | 2000-11-21 | Lg Electronics Inc. | Device and method for converting frame rate |
-
1997
- 1997-12-25 JP JP35856497A patent/JPH11205785A/ja active Pending
- 1997-12-29 DE DE1997158031 patent/DE19758031C2/de not_active Expired - Fee Related
- 1997-12-31 US US09/001,916 patent/US6278738B1/en not_active Expired - Fee Related
-
1998
- 1998-01-16 CN CN98104258A patent/CN1124741C/zh not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US6278738B1 (en) | 2001-08-21 |
| CN1124741C (zh) | 2003-10-15 |
| DE19758031A1 (de) | 1999-07-01 |
| DE19758031C2 (de) | 2003-09-11 |
| CN1223524A (zh) | 1999-07-21 |
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