JPH1048271A - 電圧監視回路 - Google Patents
電圧監視回路Info
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- JPH1048271A JPH1048271A JP9125286A JP12528697A JPH1048271A JP H1048271 A JPH1048271 A JP H1048271A JP 9125286 A JP9125286 A JP 9125286A JP 12528697 A JP12528697 A JP 12528697A JP H1048271 A JPH1048271 A JP H1048271A
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Abstract
ことができ、且つ温度及び工程の変数に対して安定した
回路特性を有する省エネルギーの電圧監視回路を提供す
ること。 【解決手段】 本発明の電圧監視回路は、外部電源電圧
によって充電されて充電電圧を発生する充電手段110
と、前記充電手段の充電電圧のレベルが所定レベルに達
すると出力状態が反転する監視電圧検出手段120と、
前記監視電圧検出手段の出力信号をラッチするラッチ手
段130と、前記充電手段の充電電圧が前記所定のレベ
ルに達するまで前記ラッチ手段をリセットするリセット
手段140とを備えていることを特徴とする。
Description
り、特に半導体メモリ装置において電源投入後の初期低
電圧による内部回路の誤動作を防止するために、適正電
圧レベル以上に電圧が上昇した状態で内部回路へ電源電
圧が伝達されるようにするための制御信号を発生する電
圧監視回路に関する。
部回路の全ての部位に電源電圧が適正電圧レベルまで達
する過渡区間が存在する。従って、この区間の間は内部
回路の誤動作を防止するために内部回路への電源電圧の
印加を遮断する。
は、外部電源電圧によって充電されて充電電圧を発生す
る充電手段10と、この充電手段10の充電電圧のレベ
ルが所定のレベルに達すると、出力状態が反転する監視
電圧検出手段20と、この監視電圧検出手段20の出力
信号を反転させるインバータ30とから構成されてい
る。
ーオン)されると、充電手段10のPMOSトランジス
タ12がターンオンされ、第1ノードN1に連結された
キャパシタ14への電荷蓄積が始まって充電される。キ
ャパシタ14の充電電圧、即ち第1ノードN1の電圧レ
ベルが監視電圧検出手段20、すなわちPMOSトラン
ジスタ22及びNMOSトランジスタ24からなるイン
バータのトリップポイント(trip point)に達すると、第
2ノードN2の電圧レベルが高レベルから低レベルに状
態遷移し始める。このため、第2ノードN2に連結され
ているインバータ30の出力φVCCHは低レベルから
高レベルに状態遷移する。
ら高レベルに状態遷移する時点は、ダイオードとして動
作するPMOSトランジスタ12の抵抗の大きさ、キャ
パシタ14の容量、及び2つのインバータ20,30の
トリップポイントの調整で決定される。
は、パワーオン以降、第1ノードN1の電圧レベルが電
源電圧レベルに上昇する際の傾きが緩やかな場合には、
所望の電圧レベル時点より一層低い電圧レベルから出力
φVCCHが状態遷移してしまうために、内部回路の誤
動作を誘発する恐れがあるという短所をもっていた。
点、即ち監視電圧検出レベルがインバータ20のNMO
Sトランジスタ24のしきい電圧Vtレベルに限定され
るので、更に高い電圧レベルから出力状態遷移が起こる
ようにすることは不可能であった。
電圧監視回路に比べて監視電圧検出レベルをさらに高め
ることができるように補完された回路の構成を示す。
0におけるNMOSトランジスタ44のソースと接地と
の間に監視電圧調整手段50をさらに備えているところ
である。
ンが連結されたNMOSトランジスタ52のダイオード
構成でなされている。即ち、監視電圧調整手段50はN
MOSトランジスタのしきい電圧Vtだけインバータの
トリップポインタを上昇させるように働く。
用したものであって、図7の回路と異なり、監視電圧レ
ベルをnVtだけ高めるために、監視電圧検出手段60
をn個のインバータ端から構成し、各インバータ端と接
地との間には監視電圧調整手段70をそれぞれ連結して
いる。監視電圧調整手段70はインバータ端の数が増加
するほどに各インバータに連結されるダイオードの数が
減少する。
ン/オフが繰り返された場合、インバータ端(62,6
4)(66,68)の第2ノードN2、第3ノードN3
が完全に0Vに放電せず、1Vのしきい電圧Vtのレベ
ルにまでしか落ちないので、後端のインバータが弱くタ
ーンオンされ、電源電圧から接地への直流電流経路が形
成されるために電力を消耗する。これは半導体装置の低
電力化に逆行してしまう。
ドN2の状態遷移時点を上げるためにN−1個のインバ
ータ端が追加されるので、設計上難しくなり、レイアウ
トの面積が増えることになる。特にダイオードは温度に
敏感なので、温度変化と工程変化につれ出力状態遷移時
点も影響を受けて回路の安定度が低下するという問題点
も発生する。
技術の問題点を解決するためのもので、その目的は監視
電圧検出レベルを適正レベルに調整することができ、且
つ温度及び工程の変化に対して安定した回路特性を有す
る電圧監視回路を提供することにある。
圧監視回路を提供することにある。
に、本発明の電圧監視回路は、外部電源電圧によって充
電されて充電電圧を発生する充電手段と、前記充電手段
の充電電圧のレベルが所定レベルに達すると出力状態が
反転する監視電圧検出手段と、前記監視電圧検出手段の
出力信号をラッチするラッチ手段と、前記充電手段の充
電電圧が前記所定のレベルに達するまで前記ラッチ手段
をリセットするリセット手段とを備えることを特徴とす
る。
ノードとの間に連結された順方向ダイオード連結のPM
OSトランジスタと、前記第1ノードと接地との間に連
結されたキャパシタと、前記第1ノードと前記外部電源
電圧との間に連結された逆方向ダイオード連結のPMO
Sトランジスタと、前記接地と前記第1ノードとの間に
連結された逆方向ダイオード連結のNMOSトランジス
タとを備えることを特徴とする。
3ノートとの間に連結され、前記充電手段の充電電圧に
応じてスイッチングされるNMOSトランジスタと、前
記第3ノードと接地との間に直列に連結された複数のダ
イオード連結のNMOSトランジスタとを備えることを
特徴とする。
記監視電圧検出手段の出力との間に連結され、前記ラッ
チ手段の出力に応じてスイッチングされる第1PMOS
トランジスタと、前記外部電源電圧と前記ラッチ手段の
出力との間に連結され、前記監視電圧検出手段の出力に
応じてスイッチングされる第2PMOSトランジスタと
を備える。
電圧のレベルがトリップポイントに達すると出力が反転
するインバータと、前記ラッチ手段の出力と接地との間
に連結され、前記前記インバータの出力に応じてスイッ
チングされるNMOSトランジスタとを備えることを特
徴とする。
バッファリングして出力する出力バッファ手段をさらに
備え、前記出力バッファ手段は、前記ラッチ手段の出力
を反転させる第1インバータと、前記第1インバータの
出力を反転させる第2インバータと、出力ノードと前記
外部電源電圧との間に連結された逆方向ダイオード連結
のPMOSトランジスタと、前記接地と前記出力ノード
との間に連結された逆方向ダイオード連結のNMOSト
ランジスタを備えることを特徴とする。
発明による実施形態をさらに詳しく説明する。
視回路の回路図を示す。
圧検出手段120と、ラッチ手段130と、リセット手
段140とを含んでいる。
部電源電圧VCCと接地VSSとの間に連結された順方
向ダイオード連結のPMOSトランジスタPM1と、第
1ノードN1と接地VSSとの間に連結されたキャパシ
タCとから構成されている。
圧と充電電圧との差がしきい電圧以下となればオフされ
る。
ドN2と第3ノードN3との間に連結され、前記充電手
段110の充電電圧に応じてスイッチングされるNMO
SトランジスタNM1と、第3ノードN3と接地VSS
との間に直列に連結された複数のダイオード連結のNM
OSトランジスタNM2,NM3とを備えている。即
ち、充電電圧がVgs(NM1)+2Vtになると、N
MOSトランジスタNM1がターンオンされて第2ノー
ドN2の電位がVCCから2Vtに落ちる。これによ
り、監視電圧はVgs(NM1)+2Vtに決定され
る。従って、監視電圧は直列連結されたダイオード連結
のNMOSトランジスタの個数で調整することができ
る。
CCと監視電圧検出手段120の出力との間に連結さ
れ、ラッチ手段130の出力φVCCHに応じてスイッ
チングされるPMOSトランジスタPM2と、外部電源
電圧VCCとラッチ手段130の出力との間に連結さ
れ、監視電圧検出手段120の出力に応じてスイッチン
グされるPMOSトランジスタPM3とを備えている。
したがって、例えばφVCCHがロー状態の場合にはP
MOSトランジスタPM2がターンオンされて第2ノー
ドN2の電位をVCCにすることになる。この際、PM
OSトランジスタPM3は第2ノードN2がVCCに保
持されるので、ターンオフ状態を保持する。このような
状態で第2ノードN2の電位が上述したように監視電圧
検出手段120によってVgs(NM1)+2Vtに落
ちると、PMOSトランジスタPM3がターンオンされ
てφVCCHがハイ状態になるので、PMOSトランジ
スタPM2はターンオフされて第2ノードに電流供給が
遮断される。よって、監視電圧検出手段120を通して
直流電流パスが形成されないので電力消耗を防止するこ
とができる。
0の充電電圧のレベルがトリップポイントに達すると出
力が反転するインバータG1と、ラッチ手段130の出
力と接地VSSとの間に連結され、インバータG1の出
力に応じてスイッチングされるNMOSトランジスタN
M4とを備えている。即ち、電源投入の初期に充電電圧
がインバータG1のトリップポイントである1Vを超え
る前には第4ノードN4をVCCに保持してNMOSト
ランジスタNM4をターンオンさせてφVCCHをロー
状態にすることにより、ラッチ手段130をリセットさ
せる。充電電圧がインバータG1のトリップポイント以
上に増加すると、第4ノードN4をロー状態に保持して
NMOSトランジスタNM4をターンオフさせることに
より、Vgs(NM1)+2Vtの監視電圧になった
時、監視電圧検出手段120の出力がラッチ手段130
にラッチされるようにする。
電圧監視回路の回路図を示す。第2実施形態に係る電圧
監視回路は、充電手段110のPMOSトランジスタP
M1と第1ノードN1との間に、ゲートが第1ノードに
連結されたPMOSトランジスタPM4をさらに備え、
且つ第1ノードN1と前記外部電源電圧VCCとの間に
連結された逆方向ダイオード連結のPMOSトランジス
タPM5、及び前記接地VSSと前記第1ノードN1と
の間に連結された逆方向ダイオード連結のNMOSトラ
ンジスタNM5をさらに含んでいる。
の電位がVCCよりしきい電圧だけ高くなった場合にV
CCにバイパスさせる役割を果たし、NMOSトランジ
スタNM5は第1ノードの電位が接地VSSよりしきい
電圧だけ低い電位に落ちた場合に接地VSSにバイパス
させる役割を果たすことにより、異常電圧から素子を保
護する。
VCCと第4ノードN4との間に連結され、充電電圧に
応じてスイッチングされるPMOSトランジスタPM6
と、前記第4ノードと接地VSSとの間に直列に連結さ
れ、前記充電電圧に応じて同時にスイッチングされる複
数のNMOSトランジスタNM6,NM7とから構成さ
れている。このようなインバータG1の構成は1つのN
MOSトランジスタから構成した場合に比べてインバー
タのトリップポイントを一層高めることができる。
ラッチ手段130の出力をバッファリングして出力する
出力バッファ手段150をさらに備えている。前記出力
バッファ手段150は、ラッチ手段130の出力を反転
させる第1インバータG2と、前記第1インバータG2
の出力を反転させる第2インバータG3と、出力φVC
CHと前記外部電源電圧VCCとの間に連結された逆方
向ダイオード連結のPMOSトランジスタPM9と、接
地VSSと出力φVCCHとの間に連結された逆方向ダ
イオード連結のNMOSトランジスタNM11とを含ん
でいる。ここで、PM9とNM11は上述したPM5及
びNM5と同じ素子保護の役割を果たす。
と同様に、外部電源電圧VCCと第5ノードN5との間
に連結され、前記ラッチ手段130の出力に応じてスイ
ッチングされるPMOSトランジスタPM7と、第5ノ
ードN5と接地VSSとの間に直列に連結され、前記ラ
ッチ手段の出力に応じて同時にスイッチングされる複数
のNMOSトランジスタNM8,NM9を含んでいる。
第2インバータG3は通常のインバータ構成でPMOS
トランジスタPM8とNMOSトランジスタNM10と
から構成されている。
・効果を説明する。
定による入力に対する出力特性を示す波形図である。
μsにした時、本発明の電圧監視回路の監視電圧検出手
段120の第3ノードN3にダイオードを連結しない場
合には監視電圧が1.8V(図3の(A))、一つを連
結した場合には監視電圧が3V(図3の(B))、2つ
を連結した場合には監視電圧が4.4V(図3の
(C))であることをそれぞれ示している。
の電圧監視回路の工程及び温度による監視電圧の変動を
示す。即ち、工程と温度の条件が最も劣悪な状態(図
4)や或いは最適の状態(図5)において、従来の監視
電圧の変動幅が大きいのに対して、本発明の監視電圧の
変動幅は非常に小さいことが分かる。
タ端をn端に連結しなくても極めて簡単な回路構成によ
ってnVtの監視電圧の調整が可能なので適正レベルの
監視電圧を調整することができるのみならず、ダイオー
ドの連結を各インバータ端ごとに順次に減少させながら
構成する必要がなくなるために、相対的にそれほどダイ
オードの個数を増やすことがないので、温度及び工程変
化による監視電圧の変動が抑制でき、回路の動作特性が
安定する。
電力が消耗され、その他には直流電流パスの遮断された
状態に保持されるので、低電力化を図ることができる。
成を示す回路図である。
成を示す回路図である。
力に対する出力特性を示す波形図である。
最も劣悪な条件における温度及び工程変数の変化による
監視電圧の変動特性を示す波形図である。
最適条件における温度及び工程変数の変化による監視電
圧の変動特性を示す波形図である。
る。
ある。
路図である。
・、PM9 PMOSトランジスタ 14、C キャパシタ 20、120 監視電圧検出手段 24、44、52、64、68NM1、NM2、・・
・、NM11 NMOSトランジスタ 30、G1、G2、G3 インバータ 130 ラッチ手段 140 リセット手段 150 出力バッファ手段 N1,N2,N3,N4,N5,N6 ノード
Claims (9)
- 【請求項1】 外部電源電圧によって充電されて充電電
圧を発生する充電手段と、 前記充電手段の充電電圧のレベルが所定レベルに達する
と出力状態が反転する監視電圧検出手段と、 前記監視電圧検出手段の出力信号をラッチするラッチ手
段と、 前記充電手段の充電電圧が前記所定のレベルに達するま
で前記ラッチ手段をリセットするリセット手段とを備え
ることを特徴とする電圧監視回路。 - 【請求項2】 前記充電手段は、 前記外部電源電圧と第1ノードとの間に連結された順方
向ダイオード連結のPMOSトランジスタと、 前記第1ノードと接地との間に連結されたキャパシタ
と、 前記第1ノードと前記外部電源電圧との間に連結された
逆方向ダイオード連結のPMOSトランジスタと、 前記接地と前記第1ノードとの間に連結された逆方向ダ
イオード連結のNMOSトランジスタとを備えることを
特徴とする請求項1記載の電圧監視回路。 - 【請求項3】 前記監視電圧検出手段は、 第2ノードと第3ノードとの間に連結され、前記充電手
段の充電電圧に応じてスイッチングされるNMOSトラ
ンジスタと、 前記第3ノードと接地との間に直列に連結された複数の
ダイオード連結のNMOSトランジスタとを備えること
を特徴とする請求項1記載の電圧監視回路。 - 【請求項4】 前記ラッチ手段は、 前記外部電源電圧と前記監視電圧検出手段の出力との間
に連結され、前記ラッチ手段の出力に応じてスイッチン
グされる第1PMOSトランジスタと、 前記外部電源電圧と前記ラッチ手段の出力との間に連結
され、前記監視電圧検出手段の出力に応じてスイッチン
グされる第2PMOSトランジスタとを備えることを特
徴とする請求項1記載の電圧監視回路。 - 【請求項5】 前記リセット手段は、 前記充電手段の充電電圧のレベルがトリップポイントに
達すると出力が反転するインバータと、 前記ラッチ手段の出力と接地との間に連結され、前記イ
ンバータの出力に応じてスイッチングされるNMOSト
ランジスタとを備えることを特徴とする請求項1記載の
電圧監視回路。 - 【請求項6】 前記インバータは、 前記外部電源電圧と第4ノードとの間に連結され、前記
充電電圧に応じてスイッチングされるPMOSトランジ
スタと、 前記第4ノードと接地との間に直列に連結され、前記充
電電圧に応じて同時にスイッチングされる複数のNMO
Sトランジスタとを備えることを特徴とする請求項5記
載の電圧監視回路。 - 【請求項7】 前記ラッチ手段の出力をバッファリング
して出力する出力バッファ手段をさらに備えることを特
徴とする請求項1記載の電圧監視回路。 - 【請求項8】 前記出力バッファ手段は、 前記ラッチ手段の出力を反転させる第1インバータと、 前記第1インバータの出力を反転させる第2インバータ
と、 出力ノードと前記外部電源電圧との間に連結された逆方
向ダイオード連結のPMOSトランジスタと、 前記接地と前記出力ノードとの間に連結された逆方向ダ
イオード連結のNMOSトランジスタとを備えることを
特徴とする請求項7記載の電圧監視回路。 - 【請求項9】 前記第1インバータは、 前記外部電源電圧と第5ノードとの間に連結され、前記
ラッチ手段の出力に応じてスイッチングされるPMOS
トランジスタと、 前記第5ノードと接地との間に直列に連結され、前記ラ
ッチ手段の出力に応じて同時にスイッチングされる複数
のNMOSトランジスタとを備えることを特徴とする請
求項8記載の電圧監視回路。
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