JPH1032495A - データ処理装置および方法 - Google Patents
データ処理装置および方法Info
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- JPH1032495A JPH1032495A JP18916396A JP18916396A JPH1032495A JP H1032495 A JPH1032495 A JP H1032495A JP 18916396 A JP18916396 A JP 18916396A JP 18916396 A JP18916396 A JP 18916396A JP H1032495 A JPH1032495 A JP H1032495A
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
- H03M7/30—Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/01—Conversion of standards, e.g. involving analogue television standards or digital television standards processed at pixel level
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
- H04N19/90—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using coding techniques not provided for in groups H04N19/10-H04N19/85, e.g. fractals
- H04N19/98—Adaptive-dynamic-range coding [ADRC]
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S707/00—Data processing: database and file management or data structures
- Y10S707/99931—Database or file accessing
- Y10S707/99937—Sorting
Abstract
(57)【要約】
【課題】 簡単なハードウェア構成でクラス分類を行う
ようにする。 【解決手段】 画素データは、順次、回路ブロック４１
Ａ乃至４７Ａで比較され、小さい方の画素データは、回
路ブロック５１Ｂ乃至５４Ｂに供給され、さらに、小さ
い方の画素データが回路ブロック７１Ｂ，７２Ｂに供給
される。回路ブロック７１Ｂ，７２Ｂに供給された画素
データのうち、小さい方の画素データが回路ブロック９
１Ｂに供給され、画素データの最小値が求められる。最
大値に関しても、基本的に同様にして求めることができ
る。これらのデータに基づいて、クラスコード生成のた
めのしきい値が求められる。
ようにする。 【解決手段】 画素データは、順次、回路ブロック４１
Ａ乃至４７Ａで比較され、小さい方の画素データは、回
路ブロック５１Ｂ乃至５４Ｂに供給され、さらに、小さ
い方の画素データが回路ブロック７１Ｂ，７２Ｂに供給
される。回路ブロック７１Ｂ，７２Ｂに供給された画素
データのうち、小さい方の画素データが回路ブロック９
１Ｂに供給され、画素データの最小値が求められる。最
大値に関しても、基本的に同様にして求めることができ
る。これらのデータに基づいて、クラスコード生成のた
めのしきい値が求められる。
Description
【０００１】
【発明の属する技術分野】本発明は、データ処理装置お
よび方法に関し、例えば、ＳＤ(Standard Definition）
ＴＶ画像からＨＤ（Hight Definition）ＴＶ画像を生成
する解像度創造や、圧縮符号化における適応復号、時空
間間引き補間等に用いて好適なデータ処理装置および方
法に関する。
よび方法に関し、例えば、ＳＤ(Standard Definition）
ＴＶ画像からＨＤ（Hight Definition）ＴＶ画像を生成
する解像度創造や、圧縮符号化における適応復号、時空
間間引き補間等に用いて好適なデータ処理装置および方
法に関する。
【０００２】
【従来の技術】従来のＡＤＲＣ（Adaptive Dynamic Ran
ge Coding）符号化を使用したクラス分類手法において
は、クラスを形成するタップを画素単位でずらしなが
ら、毎回（画素毎に）計算するようにしている。例え
ば、図４に示すように、水平方向の１５タップでクラス
を形成する場合、注目画素を中心として、タップを形成
する１５画素のデータを持ってきて、その最大値、最小
値を検出し、ダイナミックレンジを計算した後、ＡＤＲ
Ｃ符号化を行う。
ge Coding）符号化を使用したクラス分類手法において
は、クラスを形成するタップを画素単位でずらしなが
ら、毎回（画素毎に）計算するようにしている。例え
ば、図４に示すように、水平方向の１５タップでクラス
を形成する場合、注目画素を中心として、タップを形成
する１５画素のデータを持ってきて、その最大値、最小
値を検出し、ダイナミックレンジを計算した後、ＡＤＲ
Ｃ符号化を行う。
【０００３】図５は、従来のＡＤＲＣクラス形成回路の
一例の構成を示すブロック図である。ＡＤＲＣクラス形
成回路は、レジスタ１−１乃至１−１６、クラスコード
発生回路１７−１より構成されている。次に、クラスコ
ード発生回路１７−１について説明する。
一例の構成を示すブロック図である。ＡＤＲＣクラス形
成回路は、レジスタ１−１乃至１−１６、クラスコード
発生回路１７−１より構成されている。次に、クラスコ
ード発生回路１７−１について説明する。
【０００４】Ｃｌｏｃｋ信号に従って、図示せぬ入力端
子から入力された１画素の画素値に対応するデータ（以
下、画素データという）は、レジスタ１−１、クラスコ
ード発生回路１７−１を構成するレジスタ２、比較器
４、レジスタ８、および比較器１０に供給される。ま
た、ロード信号ＬＤ１が、ＡＮＤゲート３，９、レジス
タ５，１２に供給される。
子から入力された１画素の画素値に対応するデータ（以
下、画素データという）は、レジスタ１−１、クラスコ
ード発生回路１７−１を構成するレジスタ２、比較器
４、レジスタ８、および比較器１０に供給される。ま
た、ロード信号ＬＤ１が、ＡＮＤゲート３，９、レジス
タ５，１２に供給される。
【０００５】また、ロード信号ＬＤ２とイネーブル信号
ＯＥ１が、レジスタ（クラス生成回路）１６に供給され
る。このロード信号ＬＤ２およびイネーブル信号ＯＥ１
は、１５クロックに１回、信号レベルがＬ（ロー）とな
るようになされている。
ＯＥ１が、レジスタ（クラス生成回路）１６に供給され
る。このロード信号ＬＤ２およびイネーブル信号ＯＥ１
は、１５クロックに１回、信号レベルがＬ（ロー）とな
るようになされている。
【０００６】レジスタ１−１に供給された画素データ
は、クロック信号に従って、レジスタ１−２に供給され
る。同様にして、レジスタ１−２に供給された画素デー
タは、クロック信号に従って、順次、１クロックずつ遅
延され、レジスタ１−１６まで転送されていく。レジス
タ１−１６より出力された画素データは、加算器６に供
給される。
は、クロック信号に従って、レジスタ１−２に供給され
る。同様にして、レジスタ１−２に供給された画素デー
タは、クロック信号に従って、順次、１クロックずつ遅
延され、レジスタ１−１６まで転送されていく。レジス
タ１−１６より出力された画素データは、加算器６に供
給される。
【０００７】一方、レジスタ２、比較器４、ＡＮＤゲー
ト３により、最小値ＭＩＮが検出され、レジスタ５に供
給される。比較器４は、レジスタ２より端子Ａに供給さ
れたデータと端子Ｂに供給されたデータとを比較して、
端子Ａに供給されたデータの方が大きければ、出力信号
のレベルをＬにする。比較器４からの信号レベルがＬの
出力は、ＡＮＤゲート３を介して、レジスタ２のロード
パルスとなる。これにより、レジスタ２に新たなデータ
（端子Ｂに供給された画素データ）が取り込まれ、保持
される。このようにして、最終的に、レジスタ２により
１５個の画素データのうちの最も小さい画素データが保
持されることになる。
ト３により、最小値ＭＩＮが検出され、レジスタ５に供
給される。比較器４は、レジスタ２より端子Ａに供給さ
れたデータと端子Ｂに供給されたデータとを比較して、
端子Ａに供給されたデータの方が大きければ、出力信号
のレベルをＬにする。比較器４からの信号レベルがＬの
出力は、ＡＮＤゲート３を介して、レジスタ２のロード
パルスとなる。これにより、レジスタ２に新たなデータ
（端子Ｂに供給された画素データ）が取り込まれ、保持
される。このようにして、最終的に、レジスタ２により
１５個の画素データのうちの最も小さい画素データが保
持されることになる。
【０００８】ＬＤ１の信号レベルがＬになったタイミン
グで、レジスタ２に保持されている最小値ＭＩＮが、レ
ジスタ５に取り込まれる。そして、レジスタ５において
は、最小値ＭＩＮが保持され、加算器６に供給される。
加算器６においては、レジスタ１−１６から供給された
画素データと、レジスタ５より供給された最小値ＭＩＮ
の符号を反転したものが加算され、加算結果としてのデ
ータ（画素データ−最小値ＭＩＮ）がレジスタ７を介し
て量子化回路１４に供給される。
グで、レジスタ２に保持されている最小値ＭＩＮが、レ
ジスタ５に取り込まれる。そして、レジスタ５において
は、最小値ＭＩＮが保持され、加算器６に供給される。
加算器６においては、レジスタ１−１６から供給された
画素データと、レジスタ５より供給された最小値ＭＩＮ
の符号を反転したものが加算され、加算結果としてのデ
ータ（画素データ−最小値ＭＩＮ）がレジスタ７を介し
て量子化回路１４に供給される。
【０００９】また、レジスタ８、比較器１０、ＡＮＤゲ
ート９により、最大値ＭＡＸが検出され、加算器１１に
供給される。比較器１０は、比較器４の場合と同様に、
端子Ａに供給されたデータと端子Ｂに供給されたデータ
とを比較して、端子Ａに供給されたデータの方が大きけ
れば、出力信号のレベルをＬにする。比較器１０からの
信号レベルがＬの出力信号は、ＡＮＤゲート９を介し
て、レジスタ８のロードパルスとなる。これにより、レ
ジスタ８に新たな画素データ（端子Ａに供給された画素
データ）が取り込まれ、保持される。このようにして、
最終的に、レジスタ８により１５個の画素データのうち
の最も大きい画素データが保持されることになる。
ート９により、最大値ＭＡＸが検出され、加算器１１に
供給される。比較器１０は、比較器４の場合と同様に、
端子Ａに供給されたデータと端子Ｂに供給されたデータ
とを比較して、端子Ａに供給されたデータの方が大きけ
れば、出力信号のレベルをＬにする。比較器１０からの
信号レベルがＬの出力信号は、ＡＮＤゲート９を介し
て、レジスタ８のロードパルスとなる。これにより、レ
ジスタ８に新たな画素データ（端子Ａに供給された画素
データ）が取り込まれ、保持される。このようにして、
最終的に、レジスタ８により１５個の画素データのうち
の最も大きい画素データが保持されることになる。
【００１０】加算器１１においては、レジスタ８より供
給された最大値ＭＡＸから、レジスタ２より供給された
最小値ＭＩＮの符号を反転したものが加算され、ダイナ
ミックレンジＤＲが算出される。算出されたダイナミッ
クレンジＤＲは、レジスタ１２に供給され、そこで保持
される。レジスタ１２に保持されたダイナミックレンジ
ＤＲは、レジスタ１３を介して量子化回路１４に供給さ
れる。量子化回路１４においては、レジスタ７から供給
された画素データとレジスタ１３から供給されたダイナ
ミックレンジＤＲとから、クラス形成回路に供給された
画素データの量子化が行われる。
給された最大値ＭＡＸから、レジスタ２より供給された
最小値ＭＩＮの符号を反転したものが加算され、ダイナ
ミックレンジＤＲが算出される。算出されたダイナミッ
クレンジＤＲは、レジスタ１２に供給され、そこで保持
される。レジスタ１２に保持されたダイナミックレンジ
ＤＲは、レジスタ１３を介して量子化回路１４に供給さ
れる。量子化回路１４においては、レジスタ７から供給
された画素データとレジスタ１３から供給されたダイナ
ミックレンジＤＲとから、クラス形成回路に供給された
画素データの量子化が行われる。
【００１１】量子化回路１４において量子化された画素
データは、順次、レジスタ１５−１に供給され、クロッ
ク信号に従って、レジスタ１５−８まで伝送される。そ
して、レジスタ１５−１乃至１５−７に保持されている
量子化された画素データは、それぞれ次のレジスタに伝
送されるとともに、１５−８に保持されている量子化さ
れた画素データは、クラス生成回路１６に供給される。
クラス生成回路１６においては、量子化された８つの画
素データから、１つのクラスコードが生成され、出力さ
れる。
データは、順次、レジスタ１５−１に供給され、クロッ
ク信号に従って、レジスタ１５−８まで伝送される。そ
して、レジスタ１５−１乃至１５−７に保持されている
量子化された画素データは、それぞれ次のレジスタに伝
送されるとともに、１５−８に保持されている量子化さ
れた画素データは、クラス生成回路１６に供給される。
クラス生成回路１６においては、量子化された８つの画
素データから、１つのクラスコードが生成され、出力さ
れる。
【００１２】この量子化回路１４は、例えば、ＲＯＭ
（Read Only Memory）で構成される。この場合、レジス
タ１３から供給されるダイナミックレンジＤＲ、レジス
タ７より供給されるデータ（画素データ−最小値ＭＩ
Ｎ）、およびそれらに対応する量子化コードが関連づけ
て記憶されている。
（Read Only Memory）で構成される。この場合、レジス
タ１３から供給されるダイナミックレンジＤＲ、レジス
タ７より供給されるデータ（画素データ−最小値ＭＩ
Ｎ）、およびそれらに対応する量子化コードが関連づけ
て記憶されている。
【００１３】
【発明が解決しようとする課題】しかしながら、上記回
路においては、クラスコードが算出されるまでに、３０
クロック以上のスループットディレイが生じる。また、
注目画素を１つずらす毎にリアルタイムでクラスコード
の計算を行うとすると、図６に示したように、クラス形
成回路を１５個並列し、出力されるクラスコードを選択
する必要があるため、ハードウェアがかなり重いものと
なる課題があった。特に、量子化の部分がＲＯＭで構成
されているため重くなっている。
路においては、クラスコードが算出されるまでに、３０
クロック以上のスループットディレイが生じる。また、
注目画素を１つずらす毎にリアルタイムでクラスコード
の計算を行うとすると、図６に示したように、クラス形
成回路を１５個並列し、出力されるクラスコードを選択
する必要があるため、ハードウェアがかなり重いものと
なる課題があった。特に、量子化の部分がＲＯＭで構成
されているため重くなっている。
【００１４】本発明はこのような状況に鑑みてなされた
ものであり、精度を落とすことなく、クラス分類を行う
ためのハードウェアを簡略化することができるようにす
るものである。
ものであり、精度を落とすことなく、クラス分類を行う
ためのハードウェアを簡略化することができるようにす
るものである。
【００１５】
【課題を解決するための手段】請求項１に記載のデータ
処理装置は、クラスを形成する複数のデータを順次、記
憶する記憶手段と、記憶手段に記憶されたデータの大小
を順次、比較し、勝ち抜き方式によってデータの最大値
と最小値を検出する第１の検出手段と、第１の検出手段
によって求められたデータの最大値と最小値から、その
差分としてのダイナミックレンジを検出する第２の検出
手段と、第２の検出手段により検出されたダイナミック
レンジに基づいて、データを量子化するための複数のし
きい値を演算する演算手段とを備えることを特徴とす
る。
処理装置は、クラスを形成する複数のデータを順次、記
憶する記憶手段と、記憶手段に記憶されたデータの大小
を順次、比較し、勝ち抜き方式によってデータの最大値
と最小値を検出する第１の検出手段と、第１の検出手段
によって求められたデータの最大値と最小値から、その
差分としてのダイナミックレンジを検出する第２の検出
手段と、第２の検出手段により検出されたダイナミック
レンジに基づいて、データを量子化するための複数のし
きい値を演算する演算手段とを備えることを特徴とす
る。
【００１６】請求項４に記載のデータ処理装置は、入力
されたデータと所定の基準値との大小を比較し、比較結
果を出力する比較手段と、比較手段の所定のものから出
力された比較結果に基づいて、他の比較手段から出力さ
れた比較結果のうちのいずれかを選択的に出力する出力
手段とを備えることを特徴とする。
されたデータと所定の基準値との大小を比較し、比較結
果を出力する比較手段と、比較手段の所定のものから出
力された比較結果に基づいて、他の比較手段から出力さ
れた比較結果のうちのいずれかを選択的に出力する出力
手段とを備えることを特徴とする。
【００１７】請求項５に記載のデータ処理方法は、クラ
スを形成する複数のデータを順次、記憶し、記憶された
データの大小を順次、比較し、勝ち抜き方式によってデ
ータの最大値と最小値を検出し、検出されたデータの最
大値と最小値から、その差分としてのダイナミックレン
ジを検出し、検出されたダイナミックレンジに基づい
て、量子化のための複数のしきい値を演算することを特
徴とする。
スを形成する複数のデータを順次、記憶し、記憶された
データの大小を順次、比較し、勝ち抜き方式によってデ
ータの最大値と最小値を検出し、検出されたデータの最
大値と最小値から、その差分としてのダイナミックレン
ジを検出し、検出されたダイナミックレンジに基づい
て、量子化のための複数のしきい値を演算することを特
徴とする。
【００１８】請求項６に記載のデータ処理方法は、入力
されたデータと所定の基準値との大小を比較し、比較結
果を出力し、出力された所定の比較結果に基づいて、出
力された他の比較結果のうちのいずれかを選択的に出力
することを特徴とする。
されたデータと所定の基準値との大小を比較し、比較結
果を出力し、出力された所定の比較結果に基づいて、出
力された他の比較結果のうちのいずれかを選択的に出力
することを特徴とする。
【００１９】請求項１に記載のデータ処理装置において
は、記憶手段が、クラスを形成する複数のデータを順
次、記憶し、第１の検出手段が、記憶手段に記憶された
データの大小を順次、比較し、勝ち抜き方式によってデ
ータの最大値と最小値を検出し、第２の検出手段が、第
１の検出手段によって求められたデータの最大値と最小
値から、その差分としてのダイナミックレンジを検出
し、演算手段が、第２の検出手段により検出されたダイ
ナミックレンジに基づいて、データを量子化するための
複数のしきい値を演算する。
は、記憶手段が、クラスを形成する複数のデータを順
次、記憶し、第１の検出手段が、記憶手段に記憶された
データの大小を順次、比較し、勝ち抜き方式によってデ
ータの最大値と最小値を検出し、第２の検出手段が、第
１の検出手段によって求められたデータの最大値と最小
値から、その差分としてのダイナミックレンジを検出
し、演算手段が、第２の検出手段により検出されたダイ
ナミックレンジに基づいて、データを量子化するための
複数のしきい値を演算する。
【００２０】請求項４に記載のデータ処理装置において
は、比較手段が、入力されたデータと所定の基準値との
大小を比較し、比較結果を出力し、出力手段が、比較手
段の所定のものから出力された比較結果に基づいて、他
の比較手段から出力された比較結果のうちのいずれかを
選択的に出力する。
は、比較手段が、入力されたデータと所定の基準値との
大小を比較し、比較結果を出力し、出力手段が、比較手
段の所定のものから出力された比較結果に基づいて、他
の比較手段から出力された比較結果のうちのいずれかを
選択的に出力する。
【００２１】請求項５に記載のデータ処理方法において
は、クラスを形成する複数のデータを順次、記憶し、記
憶されたデータの大小を順次、比較し、勝ち抜き方式に
よってデータの最大値と最小値を検出し、検出されたデ
ータの最大値と最小値から、その差分としてのダイナミ
ックレンジを検出し、検出されたダイナミックレンジに
基づいて、量子化のための複数のしきい値を演算する。
は、クラスを形成する複数のデータを順次、記憶し、記
憶されたデータの大小を順次、比較し、勝ち抜き方式に
よってデータの最大値と最小値を検出し、検出されたデ
ータの最大値と最小値から、その差分としてのダイナミ
ックレンジを検出し、検出されたダイナミックレンジに
基づいて、量子化のための複数のしきい値を演算する。
【００２２】請求項６に記載のデータ処理方法において
は、入力されたデータと所定の基準値との大小を比較
し、比較結果を出力し、出力された所定の比較結果に基
づいて、出力された他の比較結果のうちのいずれかを選
択的に出力する。
は、入力されたデータと所定の基準値との大小を比較
し、比較結果を出力し、出力された所定の比較結果に基
づいて、出力された他の比較結果のうちのいずれかを選
択的に出力する。
【００２３】
【発明の実施の形態】以下に、本発明の実施例を説明す
るが、その前に、特許請求の範囲に記載の発明の各手段
と以下の実施例との対応関係を明らかにするために、各
手段の後の括弧内に、対応する実施例（但し、一例）を
付加して、本発明の特徴を記述すると、次のようにな
る。
るが、その前に、特許請求の範囲に記載の発明の各手段
と以下の実施例との対応関係を明らかにするために、各
手段の後の括弧内に、対応する実施例（但し、一例）を
付加して、本発明の特徴を記述すると、次のようにな
る。
【００２４】即ち、請求項１に記載のデータ処理装置
は、クラスを形成する複数のデータを順次、記憶する記
憶手段（例えば、図１のレジスタ２１乃至３５）と、記
憶手段に記憶されたデータの大小を順次、比較し、勝ち
抜き方式によってデータの最大値と最小値を検出する第
１の検出手段（例えば、図１の回路ブロック４１Ａ乃至
４７Ａ、回路ブロック５１Ｂ乃至５４Ｂ、回路ブロック
６１Ｃ乃至６４Ｃ、回路ブロック７１Ｂ，７２Ｂ，８１
Ｃ，８２Ｃ，９１Ｂ，１０１Ｃ）と、第１の検出手段に
よって求められたデータの最大値と最小値から、その差
分としてのダイナミックレンジを検出する第２の検出手
段（例えば、図１の加算器１１３）と、第２の検出手段
により検出されたダイナミックレンジに基づいて、デー
タを量子化するための複数のしきい値を演算する演算手
段（例えば、図１のシフトレジスタ１１４，１１５、加
算器１１６乃至１１９）とを備えることを特徴とする。
は、クラスを形成する複数のデータを順次、記憶する記
憶手段（例えば、図１のレジスタ２１乃至３５）と、記
憶手段に記憶されたデータの大小を順次、比較し、勝ち
抜き方式によってデータの最大値と最小値を検出する第
１の検出手段（例えば、図１の回路ブロック４１Ａ乃至
４７Ａ、回路ブロック５１Ｂ乃至５４Ｂ、回路ブロック
６１Ｃ乃至６４Ｃ、回路ブロック７１Ｂ，７２Ｂ，８１
Ｃ，８２Ｃ，９１Ｂ，１０１Ｃ）と、第１の検出手段に
よって求められたデータの最大値と最小値から、その差
分としてのダイナミックレンジを検出する第２の検出手
段（例えば、図１の加算器１１３）と、第２の検出手段
により検出されたダイナミックレンジに基づいて、デー
タを量子化するための複数のしきい値を演算する演算手
段（例えば、図１のシフトレジスタ１１４，１１５、加
算器１１６乃至１１９）とを備えることを特徴とする。
【００２５】請求項３に記載のデータ処理装置は、演算
手段によって演算されたしきい値に基づいて、データを
量子化する量子化手段（例えば、図２の量子化回路１３
１−１乃至１３１−１５）と、データが量子化手段によ
って量子化された量子化結果に基づいて、クラスを生成
するクラス生成手段（例えば、図２のレジスタ１３６）
とをさらに備えることを特徴とする。
手段によって演算されたしきい値に基づいて、データを
量子化する量子化手段（例えば、図２の量子化回路１３
１−１乃至１３１−１５）と、データが量子化手段によ
って量子化された量子化結果に基づいて、クラスを生成
するクラス生成手段（例えば、図２のレジスタ１３６）
とをさらに備えることを特徴とする。
【００２６】請求項４に記載のデータ処理装置は、入力
されたデータと所定の基準値との大小を比較し、比較結
果を出力する比較手段（例えば、図２の比較器１３２−
１，１３３−１，１３４−１）と、比較手段の所定のも
のから出力された比較結果に基づいて、他の比較手段か
ら出力された比較結果のうちのいずれかを選択的に出力
する出力手段（例えば、図２のセレクタ１３５−１）と
を備えることを特徴とする。
されたデータと所定の基準値との大小を比較し、比較結
果を出力する比較手段（例えば、図２の比較器１３２−
１，１３３−１，１３４−１）と、比較手段の所定のも
のから出力された比較結果に基づいて、他の比較手段か
ら出力された比較結果のうちのいずれかを選択的に出力
する出力手段（例えば、図２のセレクタ１３５−１）と
を備えることを特徴とする。
【００２７】なお、勿論この記載は、各手段を上記した
ものに限定することを意味するものではない。
ものに限定することを意味するものではない。
【００２８】図１および図２は、本発明のデータ処理装
置を適用したＡＤＲＣクラス生成回路の一実施例の構成
を示すブロック図である。図１は、入力されたデータを
量子化するためのしきい値を算出する部分のブロック図
であり、図２は、入力されたデータを量子化し、クラス
コードを生成する部分のブロック図である。
置を適用したＡＤＲＣクラス生成回路の一実施例の構成
を示すブロック図である。図１は、入力されたデータを
量子化するためのしきい値を算出する部分のブロック図
であり、図２は、入力されたデータを量子化し、クラス
コードを生成する部分のブロック図である。
【００２９】図１において、レジスタ２１乃至３７は、
入力された画素値に対応する画素データを順次１５画素
分保持するようになされている。回路ブロック４１Ａ乃
至４７Ａは、入力された２つの画素データの大小比較を
行った後、出力するようになされている。
入力された画素値に対応する画素データを順次１５画素
分保持するようになされている。回路ブロック４１Ａ乃
至４７Ａは、入力された２つの画素データの大小比較を
行った後、出力するようになされている。
【００３０】回路ブロック５１Ｂ乃至５４Ｂには、回路
ブロック４１Ａ乃至４７Ａから出力される小さい方の画
素データがそれぞれ２つずつ入力され、そのうちの小さ
い方の画素データを出力するようになされている。ま
た、回路ブロック６１Ｃ乃至６４Ｃには、それぞれ回路
ブロック４１Ａ乃至４７Ａより出力される大きい方の画
素データのうちの２つが入力され、そのうちの大きい方
の画素データを出力するようになされている。
ブロック４１Ａ乃至４７Ａから出力される小さい方の画
素データがそれぞれ２つずつ入力され、そのうちの小さ
い方の画素データを出力するようになされている。ま
た、回路ブロック６１Ｃ乃至６４Ｃには、それぞれ回路
ブロック４１Ａ乃至４７Ａより出力される大きい方の画
素データのうちの２つが入力され、そのうちの大きい方
の画素データを出力するようになされている。
【００３１】回路ブロック７１Ｂ、７２Ｂには、回路ブ
ロック５１Ｂ乃至５４Ｂより出力される画素データがそ
れぞれ２つずつ入力され、そのうちの小さい方の画素デ
ータを出力するようになされている。また、回路ブロッ
ク８１Ｂ、８２Ｂには、回路ブロック６１Ｂ乃至６４Ｂ
より出力される画素データがそれぞれ２つずつ入力さ
れ、そのうちの大きい方の画素データを出力するように
なされている。
ロック５１Ｂ乃至５４Ｂより出力される画素データがそ
れぞれ２つずつ入力され、そのうちの小さい方の画素デ
ータを出力するようになされている。また、回路ブロッ
ク８１Ｂ、８２Ｂには、回路ブロック６１Ｂ乃至６４Ｂ
より出力される画素データがそれぞれ２つずつ入力さ
れ、そのうちの大きい方の画素データを出力するように
なされている。
【００３２】回路ブロック９１Ｂには、回路ブロック７
１Ｂ，７２Ｂから出力される画素データが入力され、そ
のうちの小さい方の画素データを出力するようになされ
ている。回路ブロック１０１Ｃには、回路ブロック８１
Ｂ，８２Ｂから出力される画素データが入力され、その
うちの大きい方の画素データを出力するようになされて
いる。
１Ｂ，７２Ｂから出力される画素データが入力され、そ
のうちの小さい方の画素データを出力するようになされ
ている。回路ブロック１０１Ｃには、回路ブロック８１
Ｂ，８２Ｂから出力される画素データが入力され、その
うちの大きい方の画素データを出力するようになされて
いる。
【００３３】次に、その動作について説明する。レジス
タ２１乃至３７は、入力された画素値に対応する画素デ
ータを、順次１５画素分保持し、回路ブロック４１Ａ乃
至４７Ａにおいて、まず、隣合う画素の間でそれぞれ大
小比較を行い、大きい方の画素データと小さい方の画素
データを振り分けていく。
タ２１乃至３７は、入力された画素値に対応する画素デ
ータを、順次１５画素分保持し、回路ブロック４１Ａ乃
至４７Ａにおいて、まず、隣合う画素の間でそれぞれ大
小比較を行い、大きい方の画素データと小さい方の画素
データを振り分けていく。
【００３４】例えば、回路ブロック４１Ａを構成する比
較器４１１においては、レジスタ２１から端子ａに供給
された画素データ（ａ）と、レジスタ２２から端子ｂに
供給された画素データ（ｂ）とが比較され、比較結果に
対応する信号（ｓ）が出力される。比較器４１１の比較
結果に基づいて、セレクタ４１２は、画素データａと画
素データｂのうちの小さい方のデータを出力し、セレク
タ４１３は、画素データａと画素データｂのうちの大き
い方の画素データを出力する。
較器４１１においては、レジスタ２１から端子ａに供給
された画素データ（ａ）と、レジスタ２２から端子ｂに
供給された画素データ（ｂ）とが比較され、比較結果に
対応する信号（ｓ）が出力される。比較器４１１の比較
結果に基づいて、セレクタ４１２は、画素データａと画
素データｂのうちの小さい方のデータを出力し、セレク
タ４１３は、画素データａと画素データｂのうちの大き
い方の画素データを出力する。
【００３５】例えば、比較器４１１は、画素データａが
画素データｂより大きいとき、レベル１の信号ｓを出力
し、画素データａが画素データｂより小さいかまたは等
しいとき、レベル０の信号ｓを出力する。セレクタ４１
２は、比較器４１１より供給された信号ｓのレベルが１
のとき、端子ａより入力された画素データａ，端子ｂよ
り入力された画素データｂのうち、画素データｂを出力
し、信号ｓのレベルが０のとき、画素データａを出力す
る。セレクタ４１３は、比較器４１１より供給された信
号ｓのレベルが１のとき、端子ａより入力された画素デ
ータａ，端子ｂより入力された画素データｂのうち、画
素データａを出力し、信号ｓのレベルが０のとき、画素
データｂを出力する。
画素データｂより大きいとき、レベル１の信号ｓを出力
し、画素データａが画素データｂより小さいかまたは等
しいとき、レベル０の信号ｓを出力する。セレクタ４１
２は、比較器４１１より供給された信号ｓのレベルが１
のとき、端子ａより入力された画素データａ，端子ｂよ
り入力された画素データｂのうち、画素データｂを出力
し、信号ｓのレベルが０のとき、画素データａを出力す
る。セレクタ４１３は、比較器４１１より供給された信
号ｓのレベルが１のとき、端子ａより入力された画素デ
ータａ，端子ｂより入力された画素データｂのうち、画
素データａを出力し、信号ｓのレベルが０のとき、画素
データｂを出力する。
【００３６】以下、同様にして、回路ブロック４２Ａ乃
至４７Ａにおいて、入力された画素データの大小比較が
行われ、大きい方の画素データと小さい方の画素データ
に振り分けられる。
至４７Ａにおいて、入力された画素データの大小比較が
行われ、大きい方の画素データと小さい方の画素データ
に振り分けられる。
【００３７】以上が第１階層の動作であり、次の階層へ
と演算が進んでいく。
と演算が進んでいく。
【００３８】次の階層、即ち、回路ブロック５１Ｂ乃至
５４Ｂ、回路ブロック６１Ｃ乃至６４Ｃにおいては、回
路ブロック４１Ａ乃至４７Ａより供給された画素データ
の大小が比較され、回路ブロック５１Ｂ乃至５４Ｂにお
いては、小さい方の画素データが検出され、回路ブロッ
ク６１Ｃ乃至６４Ｃにおいては、大きい方の画素データ
が検出され、出力される。
５４Ｂ、回路ブロック６１Ｃ乃至６４Ｃにおいては、回
路ブロック４１Ａ乃至４７Ａより供給された画素データ
の大小が比較され、回路ブロック５１Ｂ乃至５４Ｂにお
いては、小さい方の画素データが検出され、回路ブロッ
ク６１Ｃ乃至６４Ｃにおいては、大きい方の画素データ
が検出され、出力される。
【００３９】回路ブロック５１Ｂ乃至５４Ｂには、回路
ブロック４１Ａ乃至４７Ａより出力される小さい方の画
素データがそれぞれ２つずつ供給される。例えば、回路
ブロック５１Ｂにおいては、比較器５１１により、回路
ブロック４１Ａと回路ブロック４２Ａより供給された小
さい方の画素データの大小が比較され、その比較結果に
基づいて、セレクタ５１２により、小さい方の画素デー
タが出力される。回路ブロック５２Ｂ乃至５４Ｂにおい
ても、同様にして、回路ブロック４３Ａ乃至４７Ａより
供給された画素データのうちの小さい方の画素データが
出力される。
ブロック４１Ａ乃至４７Ａより出力される小さい方の画
素データがそれぞれ２つずつ供給される。例えば、回路
ブロック５１Ｂにおいては、比較器５１１により、回路
ブロック４１Ａと回路ブロック４２Ａより供給された小
さい方の画素データの大小が比較され、その比較結果に
基づいて、セレクタ５１２により、小さい方の画素デー
タが出力される。回路ブロック５２Ｂ乃至５４Ｂにおい
ても、同様にして、回路ブロック４３Ａ乃至４７Ａより
供給された画素データのうちの小さい方の画素データが
出力される。
【００４０】一方、回路ブロック６１Ｃ乃至６４Ｃに
は、回路ブロック４１Ａ乃至４７Ａより出力される大き
い方の画素データがそれぞれ２つずつ供給される。例え
ば、回路ブロック６１Ｃにおいては、比較器６１１によ
り、回路ブロック４１Ａと回路ブロック４２Ａより供給
された大きい方の画素データの大小が比較され、その比
較結果に基づいて、セレクタ６１２により、大きい方の
画素データが出力される。回路ブロック６２Ｃ乃至６４
Ｃにおいても、同様にして、回路ブロック４３Ａ乃至４
７Ａより供給された画素データのうちの大きい方の画素
データが出力される。
は、回路ブロック４１Ａ乃至４７Ａより出力される大き
い方の画素データがそれぞれ２つずつ供給される。例え
ば、回路ブロック６１Ｃにおいては、比較器６１１によ
り、回路ブロック４１Ａと回路ブロック４２Ａより供給
された大きい方の画素データの大小が比較され、その比
較結果に基づいて、セレクタ６１２により、大きい方の
画素データが出力される。回路ブロック６２Ｃ乃至６４
Ｃにおいても、同様にして、回路ブロック４３Ａ乃至４
７Ａより供給された画素データのうちの大きい方の画素
データが出力される。
【００４１】以上が、第２階層における動作であり、次
の階層へと演算が進んでいく。
の階層へと演算が進んでいく。
【００４２】次の階層、即ち、回路ブロック７１Ｂ，７
２Ｂ、８１Ｃ、８２Ｃにおいては、回路ブロック５１Ｂ
乃至回路ブロック５４Ｂ、回路ブロック６１Ｃ乃至６４
Ｃより供給された画素データの大小が比較され、回路ブ
ロック７１Ｂ，７２Ｂにおいては、小さい方の画素デー
タが検出され、回路ブロック８１Ｃ，８２Ｃにおいて
は、大きい方の画素データが検出され、出力される。
２Ｂ、８１Ｃ、８２Ｃにおいては、回路ブロック５１Ｂ
乃至回路ブロック５４Ｂ、回路ブロック６１Ｃ乃至６４
Ｃより供給された画素データの大小が比較され、回路ブ
ロック７１Ｂ，７２Ｂにおいては、小さい方の画素デー
タが検出され、回路ブロック８１Ｃ，８２Ｃにおいて
は、大きい方の画素データが検出され、出力される。
【００４３】例えば、回路ブロック７１Ｂにおいては、
回路ブロック５１Ｂより供給された画素データと、回路
ブロック５２Ｂより供給された画素データが比較され、
小さい方の画素データが出力される。回路ブロック７２
Ｂにおいては、回路ブロック５３Ｂより供給された画素
データと、回路ブロック５４Ｂより供給された画素デー
タが比較され、小さい方の画素データが出力される。
回路ブロック５１Ｂより供給された画素データと、回路
ブロック５２Ｂより供給された画素データが比較され、
小さい方の画素データが出力される。回路ブロック７２
Ｂにおいては、回路ブロック５３Ｂより供給された画素
データと、回路ブロック５４Ｂより供給された画素デー
タが比較され、小さい方の画素データが出力される。
【００４４】また、回路ブロック８１Ｃにおいては、回
路ブロック６１Ｃより供給された画素データと、回路ブ
ロック６２Ｃより供給された画素データが比較され、大
きい方の画素データが出力される。回路ブロック８２Ｃ
においては、回路ブロック６３Ｃより供給された画素デ
ータと、回路ブロック６４Ｃより供給された画素データ
が比較され、大きい方の画素データが出力される。
路ブロック６１Ｃより供給された画素データと、回路ブ
ロック６２Ｃより供給された画素データが比較され、大
きい方の画素データが出力される。回路ブロック８２Ｃ
においては、回路ブロック６３Ｃより供給された画素デ
ータと、回路ブロック６４Ｃより供給された画素データ
が比較され、大きい方の画素データが出力される。
【００４５】以上が、第３階層における動作であり、次
の階層へと演算が進んでいく。
の階層へと演算が進んでいく。
【００４６】次の階層、即ち、回路ブロック９１Ｂおよ
び１０１Ｃには、回路ブロック７１Ｂ、７２Ｂ、８１
Ｃ、８２Ｃからの画素データがそれぞれ２つずつ供給さ
れ、大小比較が行われ、回路ブロック９１Ｂにおいて
は、小さい方の画素データが検出され、回路ブロック１
０１Ｃにおいては、大きい方の画素データが検出され、
出力される。
び１０１Ｃには、回路ブロック７１Ｂ、７２Ｂ、８１
Ｃ、８２Ｃからの画素データがそれぞれ２つずつ供給さ
れ、大小比較が行われ、回路ブロック９１Ｂにおいて
は、小さい方の画素データが検出され、回路ブロック１
０１Ｃにおいては、大きい方の画素データが検出され、
出力される。
【００４７】回路ブロック９１Ｂには、回路ブロック７
１Ｂからの画素データと回路ブロック７２Ｂからの画素
データが供給され、大小比較が行われ、小さい方の画素
データが出力される。回路ブロック１０１Ｃには、回路
ブロック８１Ｃからの画素データと回路ブロック８２Ｃ
からの画素データが供給され、大小比較が行われ、大き
い方の画素データが出力される。
１Ｂからの画素データと回路ブロック７２Ｂからの画素
データが供給され、大小比較が行われ、小さい方の画素
データが出力される。回路ブロック１０１Ｃには、回路
ブロック８１Ｃからの画素データと回路ブロック８２Ｃ
からの画素データが供給され、大小比較が行われ、大き
い方の画素データが出力される。
【００４８】以上のようにして、勝ち抜き方式により、
最終的に、レジスタ２１乃至３５より供給された画素デ
ータのうちの最大値と最小値がそれぞれ検出される。
最終的に、レジスタ２１乃至３５より供給された画素デ
ータのうちの最大値と最小値がそれぞれ検出される。
【００４９】回路ブロック９１Ｂより出力された画素デ
ータの最小値は、レジスタ１１２に供給され記憶され
る。回路ブロック１０１Ｃより出力された画素データの
最大値は、レジスタ１１１に供給され、記憶される。
ータの最小値は、レジスタ１１２に供給され記憶され
る。回路ブロック１０１Ｃより出力された画素データの
最大値は、レジスタ１１１に供給され、記憶される。
【００５０】レジスタ１１１に記憶された画素データ
と、レジスタ１１２に記憶された画素データの極性を反
転したものがそれぞれ加算器１１３に供給される。加算
器１１３においては、レジスタ１１１より供給された画
素データとレジスタ１１２より供給された画素データの
極性が反転されたものを加算することにより、画素デー
タの最大値と最小値の差分、即ち、ダイナミックレンジ
ＤＲを演算する。
と、レジスタ１１２に記憶された画素データの極性を反
転したものがそれぞれ加算器１１３に供給される。加算
器１１３においては、レジスタ１１１より供給された画
素データとレジスタ１１２より供給された画素データの
極性が反転されたものを加算することにより、画素デー
タの最大値と最小値の差分、即ち、ダイナミックレンジ
ＤＲを演算する。
【００５１】加算器１１３において演算されたダイナミ
ックレンジＤＲは、シフトレジスタ１１４および１１５
に供給され、シフトレジスタ１１４においては、画素デ
ータを下位の方向に１ビットだけシフトすることによ
り、その１／２の値が求められる。シフトレジスタ１１
５においては、画素データを下位の方向に２ビットだけ
シフトすることにより、その１／４の値が求められる。
ックレンジＤＲは、シフトレジスタ１１４および１１５
に供給され、シフトレジスタ１１４においては、画素デ
ータを下位の方向に１ビットだけシフトすることによ
り、その１／２の値が求められる。シフトレジスタ１１
５においては、画素データを下位の方向に２ビットだけ
シフトすることにより、その１／４の値が求められる。
【００５２】シフトレジスタ１１４から出力される値と
シフトレジスタ１１５より出力される値とは、加算器１
１６において加算され、さらに、加算器１１７におい
て、レジスタ１１２より出力される画素データの最小値
と加算され、レジスタ１２０に供給され記憶される。こ
の値を、画素データを量子化するためのしきい値（ＴＨ
１）とする。
シフトレジスタ１１５より出力される値とは、加算器１
１６において加算され、さらに、加算器１１７におい
て、レジスタ１１２より出力される画素データの最小値
と加算され、レジスタ１２０に供給され記憶される。こ
の値を、画素データを量子化するためのしきい値（ＴＨ
１）とする。
【００５３】シフトレジスタ１１４より出力される値と
レジスタ１１２より出力される画素データの最小値と
は、加算器１１８において加算され、レジスタ１２１に
供給され記憶される。この値を、画素データを量子化す
るためのしきい値（ＴＨ２）とする。
レジスタ１１２より出力される画素データの最小値と
は、加算器１１８において加算され、レジスタ１２１に
供給され記憶される。この値を、画素データを量子化す
るためのしきい値（ＴＨ２）とする。
【００５４】また、シフトレジスタ１１５より出力され
る値とレジスタ１１２より出力される画素データの最小
値とは、加算器１１９において加算され、レジスタ１２
２に供給され記憶される。この値を、画素データを量子
化するためのしきい値（ＴＨ３）とする。
る値とレジスタ１１２より出力される画素データの最小
値とは、加算器１１９において加算され、レジスタ１２
２に供給され記憶される。この値を、画素データを量子
化するためのしきい値（ＴＨ３）とする。
【００５５】ここでは、簡単のため、図３を参照して後
述するように、２ビットＡＤＲＣの量子化とした。しき
い値ＴＨ１乃至ＴＨ３を改めて式に直すと、式（１）乃
至式（３）のようになる。
述するように、２ビットＡＤＲＣの量子化とした。しき
い値ＴＨ１乃至ＴＨ３を改めて式に直すと、式（１）乃
至式（３）のようになる。
【００５６】 ＴＨ１＝ＤＲ／２＋ＤＲ／４＋ＭＩＮ ・・・（式１） ＴＨ２＝ＤＲ／２＋ＭＩＮ ・・・（式２） ＴＨ３＝ＤＲ／４＋ＭＩＮ ・・・（式３）
【００５７】図２は、ＡＤＲＣクラス生成回路におい
て、量子化およびクラスコードの生成を行う部分の構成
例を示すブロック図である。ＡＤＲＣクラス生成回路
は、量子化回路１３１−１乃至１３１−１５、レジスタ
１３６より構成されている。量子化回路１３１−１は、
比較器１３２−１、１３３−１、１３４−１と、セレク
タ１３５−１により構成されている。
て、量子化およびクラスコードの生成を行う部分の構成
例を示すブロック図である。ＡＤＲＣクラス生成回路
は、量子化回路１３１−１乃至１３１−１５、レジスタ
１３６より構成されている。量子化回路１３１−１は、
比較器１３２−１、１３３−１、１３４−１と、セレク
タ１３５−１により構成されている。
【００５８】比較器１３２−１、１３３−１、１３４−
１には、レジスタ３７より出力された画素データｄ０が
供給される。また、比較器１３２−１には、先に演算さ
れたしきい値ＴＨ１が供給され、比較器１３３−１に
は、しきい値ＴＨ２が供給され、比較器１３４−１に
は、しきい値ＴＨ３が供給される。
１には、レジスタ３７より出力された画素データｄ０が
供給される。また、比較器１３２−１には、先に演算さ
れたしきい値ＴＨ１が供給され、比較器１３３−１に
は、しきい値ＴＨ２が供給され、比較器１３４−１に
は、しきい値ＴＨ３が供給される。
【００５９】比較器１３２−１は、入力された画素デー
タｄ０としきい値ＴＨ１とを比較し、画素データｄ０の
方がしきい値ＴＨ１より大きい場合、レベルＨの信号を
出力し、画素データｄ０の方がしきい値ＴＨ１より小さ
いかまたは等しい場合、レベルＬの信号を出力するよう
になされている。同様に、比較器１３３−１は、入力さ
れた画素データｄ０としきい値ＴＨ２とを比較し、画素
データｄ０の方がしきい値ＴＨ２より大きい場合、レベ
ルＨの信号を出力し、画素データｄ０の方がしきい値Ｔ
Ｈ２より小さいかまたは等しい場合、レベルＬの信号を
出力するようになされている。さらに、比較器１３４−
１は、入力された画素データｄ０としきい値ＴＨ３とを
比較し、画素データｄ０の方がしきい値ＴＨ３より大き
い場合、レベルＨの信号を出力し、画素データｄ０の方
がしきい値ＴＨ３より小さいかまたは等しい場合、レベ
ルＬの信号を出力するようになされている。
タｄ０としきい値ＴＨ１とを比較し、画素データｄ０の
方がしきい値ＴＨ１より大きい場合、レベルＨの信号を
出力し、画素データｄ０の方がしきい値ＴＨ１より小さ
いかまたは等しい場合、レベルＬの信号を出力するよう
になされている。同様に、比較器１３３−１は、入力さ
れた画素データｄ０としきい値ＴＨ２とを比較し、画素
データｄ０の方がしきい値ＴＨ２より大きい場合、レベ
ルＨの信号を出力し、画素データｄ０の方がしきい値Ｔ
Ｈ２より小さいかまたは等しい場合、レベルＬの信号を
出力するようになされている。さらに、比較器１３４−
１は、入力された画素データｄ０としきい値ＴＨ３とを
比較し、画素データｄ０の方がしきい値ＴＨ３より大き
い場合、レベルＨの信号を出力し、画素データｄ０の方
がしきい値ＴＨ３より小さいかまたは等しい場合、レベ
ルＬの信号を出力するようになされている。
【００６０】そして、セレクタ１３５−１は、比較器１
３３−１の出力信号がレベルＨである場合、即ち、画素
データｄ０がしきい値ＴＨ２より大きい場合、端子ｂよ
り入力された比較器１３２−１からの信号を選択的に出
力する。一方、比較器１３３−１の出力信号がレベルＬ
である場合、即ち、画素データｄ０がしきい値ＴＨ２よ
り小さいかまたは等しい場合、端子ａより入力された比
較器１３４−１からの信号を選択的に出力する。
３３−１の出力信号がレベルＨである場合、即ち、画素
データｄ０がしきい値ＴＨ２より大きい場合、端子ｂよ
り入力された比較器１３２−１からの信号を選択的に出
力する。一方、比較器１３３−１の出力信号がレベルＬ
である場合、即ち、画素データｄ０がしきい値ＴＨ２よ
り小さいかまたは等しい場合、端子ａより入力された比
較器１３４−１からの信号を選択的に出力する。
【００６１】まず、比較器１３３−１からの出力信号の
レベルがＨである場合、即ち、画素データｄ０がしきい
値ＴＨ２より大きい場合、「１」が出力される。そし
て、その場合、セレクタ１３５−１は、端子ｂから入力
された信号、即ち、比較器１３２−１の出力信号を選択
的に出力する。比較器１３２−１からの出力信号は、画
素データｄ０がしきい値ＴＨ１より大きい場合、レベル
Ｈであり、「１」が出力される。また、画素データｄ０
がしきい値ＴＨ１より小さいかまたは等しい場合、レベ
ルＬの信号「０」が出力される。
レベルがＨである場合、即ち、画素データｄ０がしきい
値ＴＨ２より大きい場合、「１」が出力される。そし
て、その場合、セレクタ１３５−１は、端子ｂから入力
された信号、即ち、比較器１３２−１の出力信号を選択
的に出力する。比較器１３２−１からの出力信号は、画
素データｄ０がしきい値ＴＨ１より大きい場合、レベル
Ｈであり、「１」が出力される。また、画素データｄ０
がしきい値ＴＨ１より小さいかまたは等しい場合、レベ
ルＬの信号「０」が出力される。
【００６２】従って、量子化回路１３１−１からは、画
素データｄ０がしきい値ＴＨ１より大きい場合、２ビッ
トのデータ「１１」が出力され、画素データｄ０がしき
い値ＴＨ１より小さいかまたは等しく、かつ、画素デー
タｄ０がしきい値ＴＨ２より大きい場合、２ビットのデ
ータ「１０」が出力される。
素データｄ０がしきい値ＴＨ１より大きい場合、２ビッ
トのデータ「１１」が出力され、画素データｄ０がしき
い値ＴＨ１より小さいかまたは等しく、かつ、画素デー
タｄ０がしきい値ＴＨ２より大きい場合、２ビットのデ
ータ「１０」が出力される。
【００６３】次に、比較器１３３−１からの出力信号の
レベルがＬである場合、即ち、画素データｄ０がしきい
値ＴＨ２より小さいかまたは等しい場合、「０」が出力
される。そして、その場合、セレクタ１３５−１は、端
子ａから入力された信号、即ち、比較器１３４−１の出
力信号を選択的に出力する。比較器１３４−１からの出
力信号は、画素データｄ０がしきい値ＴＨ３より大きい
場合、レベルＨであり、「１」が出力される。また、画
素データｄ０がしきい値ＴＨ３より小さいかまたは等し
い場合、レベルＬであり、「０」が出力される。
レベルがＬである場合、即ち、画素データｄ０がしきい
値ＴＨ２より小さいかまたは等しい場合、「０」が出力
される。そして、その場合、セレクタ１３５−１は、端
子ａから入力された信号、即ち、比較器１３４−１の出
力信号を選択的に出力する。比較器１３４−１からの出
力信号は、画素データｄ０がしきい値ＴＨ３より大きい
場合、レベルＨであり、「１」が出力される。また、画
素データｄ０がしきい値ＴＨ３より小さいかまたは等し
い場合、レベルＬであり、「０」が出力される。
【００６４】従って、量子化回路１３１−１からは、画
素データｄ０がしきい値ＴＨ２より小さいかまたは等し
く、かつ、しきい値ＴＨ３より大きい場合、２ビットの
データ「０１」が出力され、画素データｄ０がしきい値
ＴＨ３より小さいかまたは等しい場合、２ビットのデー
タ「００」が出力される。
素データｄ０がしきい値ＴＨ２より小さいかまたは等し
く、かつ、しきい値ＴＨ３より大きい場合、２ビットの
データ「０１」が出力され、画素データｄ０がしきい値
ＴＨ３より小さいかまたは等しい場合、２ビットのデー
タ「００」が出力される。
【００６５】このようにして、画素データがエンコード
され、２ビット量子化値に変換される。
され、２ビット量子化値に変換される。
【００６６】量子化回路１３１−２乃至１３１−１５の
構成および動作は、量子化回路１３１−１の場合と基本
的に同様であるので、ここではそれらの説明は省略する
が、入力された画素データｄ１乃至ｄ１４としきい値Ｔ
Ｈ１乃至ＴＨ３に基づいて、２ビットのデータが出力さ
れる。
構成および動作は、量子化回路１３１−１の場合と基本
的に同様であるので、ここではそれらの説明は省略する
が、入力された画素データｄ１乃至ｄ１４としきい値Ｔ
Ｈ１乃至ＴＨ３に基づいて、２ビットのデータが出力さ
れる。
【００６７】図３は、画素データｄ０乃至ｄ１４が、し
きい値ＴＨ１乃至ＴＨ３に従って、２ビットＡＤＲＣに
より量子化される様子を表している。この場合、例え
ば、画素データｄ０は、しきい値ＴＨ２より小さいかま
たは等しく、かつ、しきい値ＴＨ３より大きいので、上
述したようにして、「０１」に量子化される。また、画
素データｄ２（左から３番目のデータ）は、しきい値Ｔ
Ｈ３より小さいかまたは等しいので、「００」に量子化
される。画素データｄ４（左から５番目のデータ）は、
しきい値ＴＨ１より大きいので、「１１」に量子化され
る。画素データｄ５（左から６番目のデータ）は、しき
い値ＴＨ１より小さいかまたは等しく、かつ、しきい値
ＴＨ２より大きいので、「１０」に量子化される。
きい値ＴＨ１乃至ＴＨ３に従って、２ビットＡＤＲＣに
より量子化される様子を表している。この場合、例え
ば、画素データｄ０は、しきい値ＴＨ２より小さいかま
たは等しく、かつ、しきい値ＴＨ３より大きいので、上
述したようにして、「０１」に量子化される。また、画
素データｄ２（左から３番目のデータ）は、しきい値Ｔ
Ｈ３より小さいかまたは等しいので、「００」に量子化
される。画素データｄ４（左から５番目のデータ）は、
しきい値ＴＨ１より大きいので、「１１」に量子化され
る。画素データｄ５（左から６番目のデータ）は、しき
い値ＴＨ１より小さいかまたは等しく、かつ、しきい値
ＴＨ２より大きいので、「１０」に量子化される。
【００６８】次に、量子化回路１３１−１乃至１３１−
１５の出力データ（２ビット量子化値）は、レジスタ１
３６に供給される。そして、これらの２ビット量子化値
からなる３０（＝１５×２）ビットの量子化コードは、
最終的にまとめられてクラスコードとして出力される。
１５の出力データ（２ビット量子化値）は、レジスタ１
３６に供給される。そして、これらの２ビット量子化値
からなる３０（＝１５×２）ビットの量子化コードは、
最終的にまとめられてクラスコードとして出力される。
【００６９】以上のように、量子化回路１３１−１乃至
１３１−１５を構成することにより、ＡＤＲＣクラスコ
ードの生成が簡単になるとともに、ゲートの規模を減少
させることができるので、よりＬＳＩ化に適したものと
なる。
１３１−１５を構成することにより、ＡＤＲＣクラスコ
ードの生成が簡単になるとともに、ゲートの規模を減少
させることができるので、よりＬＳＩ化に適したものと
なる。
【００７０】従来のＡＤＲＣクラス形成回路との差異を
改めて明確にすると、以下の点が挙げられる。第１に、
画素データの最大値および最小値の検出を、並列方式か
ら順次勝ち抜き方式に変更したこと、第２に、量子化回
路をＲＯＭから論理合成に変更したことである。
改めて明確にすると、以下の点が挙げられる。第１に、
画素データの最大値および最小値の検出を、並列方式か
ら順次勝ち抜き方式に変更したこと、第２に、量子化回
路をＲＯＭから論理合成に変更したことである。
【００７１】これにより、ＡＤＲＣ符号化を使用したク
ラス分類手法のハードウェア化に際して、ハードウェア
を簡略化することができる。
ラス分類手法のハードウェア化に際して、ハードウェア
を簡略化することができる。
【００７２】なお、上記実施例においては、量子化回路
１３１−１乃至１３１−１５において行われる量子化を
２ビットＡＤＲＣとしたが、１ビットまたは３ビット以
上のＡＤＲＣ符号化を行うようにすることも可能であ
る。
１３１−１乃至１３１−１５において行われる量子化を
２ビットＡＤＲＣとしたが、１ビットまたは３ビット以
上のＡＤＲＣ符号化を行うようにすることも可能であ
る。
【００７３】また、上記実施例においては、画素データ
の最大値と最小値の差分の１／２の値と１／４の値を最
小値に加算することにより、しきい値ＴＨ１乃至ＴＨ３
を演算するようにしたが、画素データの最大値と最小値
の差分の１／２の値と、１／４の値を最大値から減算す
ることにより、しきい値ＴＨ１乃至ＴＨ３を演算するよ
うにすることも可能である。
の最大値と最小値の差分の１／２の値と１／４の値を最
小値に加算することにより、しきい値ＴＨ１乃至ＴＨ３
を演算するようにしたが、画素データの最大値と最小値
の差分の１／２の値と、１／４の値を最大値から減算す
ることにより、しきい値ＴＨ１乃至ＴＨ３を演算するよ
うにすることも可能である。
【００７４】さらに、上記実施例においては、画像信号
を処理する場合について説明したが、画像信号に限定さ
れるものではなく、音声信号等の他の信号を処理する場
合にも本発明を適用することが可能である。
を処理する場合について説明したが、画像信号に限定さ
れるものではなく、音声信号等の他の信号を処理する場
合にも本発明を適用することが可能である。
【００７５】
【発明の効果】請求項１に記載のデータ処理装置、およ
び請求項５に記載のデータ処理方法によれば、クラスを
形成する複数のデータを順次、記憶し、記憶されたデー
タの大小を順次、比較し、勝ち抜き方式によってデータ
の最大値と最小値を検出し、検出されたデータの最大値
と最小値から、その差分としてのダイナミックレンジを
検出し、検出されたダイナミックレンジに基づいて、量
子化のための複数のしきい値を演算するようにしたの
で、簡単なハードウェアを用いてクラス分類を行うよう
にすることができる。
び請求項５に記載のデータ処理方法によれば、クラスを
形成する複数のデータを順次、記憶し、記憶されたデー
タの大小を順次、比較し、勝ち抜き方式によってデータ
の最大値と最小値を検出し、検出されたデータの最大値
と最小値から、その差分としてのダイナミックレンジを
検出し、検出されたダイナミックレンジに基づいて、量
子化のための複数のしきい値を演算するようにしたの
で、簡単なハードウェアを用いてクラス分類を行うよう
にすることができる。
【００７６】請求項４に記載のデータ処理装置、および
請求項６に記載のデータ処理方法によれば、入力された
データと所定の基準値との大小を比較し、比較結果を出
力し、出力された所定の比較結果に基づいて、出力され
た他の比較結果のうちのいずれかを選択的に出力するよ
うにしたので、簡単なハードウェアを用いて量子化を行
うようにすることができる。
請求項６に記載のデータ処理方法によれば、入力された
データと所定の基準値との大小を比較し、比較結果を出
力し、出力された所定の比較結果に基づいて、出力され
た他の比較結果のうちのいずれかを選択的に出力するよ
うにしたので、簡単なハードウェアを用いて量子化を行
うようにすることができる。
【図１】本発明のデータ処理装置を応用したＡＤＲＣク
ラス生成回路の一実施例の構成を示すブロック図であ
る。
ラス生成回路の一実施例の構成を示すブロック図であ
る。
【図２】本発明のデータ処理装置を応用したＡＤＲＣク
ラス生成回路の一実施例の構成を示すブロック図であ
る。
ラス生成回路の一実施例の構成を示すブロック図であ
る。
【図３】画素データｄ０乃至ｄ１４としきい値ＴＨ１乃
至ＴＨ３の関係を示す図である。
至ＴＨ３の関係を示す図である。
【図４】水平１５タップのクラス形成画素の例を示す図
である。
である。
【図５】従来のＡＤＲＣクラス形成回路の基本回路例を
示すブロック図である。
示すブロック図である。
【図６】並列化された従来のクラス形成回路の例を示す
ブロック図である。
ブロック図である。
１−１乃至１−１６ レジスタ，２，５，７，８，１
２，１３ レジスタ，３，９ ＡＮＤゲート，４，１０
比較器，６，１１ 加算器，１４ 量子化回路，１５
−１乃至１５−８，１６ レジスタ，１７−１乃至１７
−１５ クラスコード発生回路，２１乃至３７ レジス
タ，４１Ａ乃至４７Ａ，５１Ｂ乃至５４Ｂ，６１Ｃ乃至
６４Ｃ，７１Ｂ，７２Ｂ，８１Ｂ，８２Ｃ，９１Ｂ，１
０１Ｃ 回路ブロック，１１１，１１２，１２０，１２
１，１２２ レジスタ，１１３，１１６，１１７ 加算
器，１１４，１１５ シフトレジスタ，１３１−１乃至
１３１−１５ 量子化回路，１３２−１，１３３−１，
１３４−１ 比較器，１３５−１ セレクタ，１３６
レジスタ
２，１３ レジスタ，３，９ ＡＮＤゲート，４，１０
比較器，６，１１ 加算器，１４ 量子化回路，１５
−１乃至１５−８，１６ レジスタ，１７−１乃至１７
−１５ クラスコード発生回路，２１乃至３７ レジス
タ，４１Ａ乃至４７Ａ，５１Ｂ乃至５４Ｂ，６１Ｃ乃至
６４Ｃ，７１Ｂ，７２Ｂ，８１Ｂ，８２Ｃ，９１Ｂ，１
０１Ｃ 回路ブロック，１１１，１１２，１２０，１２
１，１２２ レジスタ，１１３，１１６，１１７ 加算
器，１１４，１１５ シフトレジスタ，１３１−１乃至
１３１−１５ 量子化回路，１３２−１，１３３−１，
１３４−１ 比較器，１３５−１ セレクタ，１３６
レジスタ
Claims (6)
- 【請求項１】 入力されたデータを、前記データの周辺
のデータに基づいて、クラスに分類し、前記クラス毎に
前記データを処理するデータ処理装置において、 前記クラスを形成する複数のデータを順次、記憶する記
憶手段と、 前記記憶手段に記憶された前記データの大小を順次、比
較し、勝ち抜き方式によって前記データの最大値と最小
値を検出する第１の検出手段と、 前記第１の検出手段によって求められた前記データの最
大値と最小値から、その差分としてのダイナミックレン
ジを検出する第２の検出手段と、 前記第２の検出手段により検出された前記ダイナミック
レンジに基づいて、前記データを量子化するための複数
のしきい値を演算する演算手段とを備えることを特徴と
するデータ処理装置。 - 【請求項２】 前記演算手段は、シフト演算および加算
演算によって、複数の前記しきい値を演算することを特
徴とする請求項１に記載のデータ処理装置。 - 【請求項３】 前記演算手段によって演算された前記し
きい値に基づいて、前記データを量子化する量子化手段
と、 前記データが前記量子化手段によって量子化された量子
化結果に基づいて、前記クラスを生成するクラス生成手
段とをさらに備えることを特徴とする請求項１に記載の
データ処理装置。 - 【請求項４】 入力されたデータと所定の基準値との大
小を比較し、比較結果を出力する比較手段と、 前記比較手段の所定のものから出力された比較結果に基
づいて、他の前記比較手段から出力された前記比較結果
のうちのいずれかを選択的に出力する出力手段とを備え
ることを特徴とするデータ処理装置。 - 【請求項５】 入力されたデータを、前記データの周辺
のデータに基づいて、クラスに分類し、前記クラス毎に
前記データを処理するデータ処理方法において、 前記クラスを形成する複数のデータを順次、記憶し、 記憶された前記データの大小を順次、比較し、勝ち抜き
方式によって前記データの最大値と最小値を検出し、 検出された前記データの最大値と最小値から、その差分
としてのダイナミックレンジを検出し、 検出された前記ダイナミックレンジに基づいて、量子化
のための複数のしきい値を演算することを特徴とするデ
ータ処理方法。 - 【請求項６】 入力されたデータと所定の基準値との大
小を比較し、比較結果を出力し、 出力された所定の前記比較結果に基づいて、出力された
他の前記比較結果のうちのいずれかを選択的に出力する
ことを特徴とするデータ処理方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18916396A JPH1032495A (ja) | 1996-07-18 | 1996-07-18 | データ処理装置および方法 |
| CN97117499A CN1101993C (zh) | 1996-07-18 | 1997-07-18 | 数据处理设备及其方法 |
| KR1019970034235A KR100565868B1 (ko) | 1996-07-18 | 1997-07-18 | 데이타처리장치및그방법 |
| US09/349,297 US6112205A (en) | 1996-07-18 | 1999-07-07 | Data processing equipment and method for classifying data into classes in accordance with a plurality of thresholds for quantizing data |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18916396A JPH1032495A (ja) | 1996-07-18 | 1996-07-18 | データ処理装置および方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1032495A true JPH1032495A (ja) | 1998-02-03 |
Family
ID=16236521
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18916396A Pending JPH1032495A (ja) | 1996-07-18 | 1996-07-18 | データ処理装置および方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6112205A (ja) |
| JP (1) | JPH1032495A (ja) |
| KR (1) | KR100565868B1 (ja) |
| CN (1) | CN1101993C (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010533396A (ja) * | 2007-06-28 | 2010-10-21 | クゥアルコム・インコーポレイテッド | 格納およびバスバンド幅の要求を最小限に抑える効率的な画像圧縮方式 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003065733A1 (en) * | 2002-02-01 | 2003-08-07 | Matsushita Electric Industrial Co., Ltd. | Moving image coding method and moving image decoding method |
| JP4265291B2 (ja) * | 2003-06-06 | 2009-05-20 | ソニー株式会社 | 情報信号の処理装置および処理方法、並びに情報信号の処理方法を実行するためのプログラム |
Family Cites Families (19)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| NL148421B (nl) * | 1971-02-19 | 1976-01-15 | Nederlanden Staat | Stelsel voor het lezen van tekens. |
| IT1155557B (it) * | 1982-07-19 | 1987-01-28 | Cselt Centro Studi Lab Telecom | Metdodo e dispositivo per la codifica del segnale d immagine con riduzione di ridondanza a distorsione localmente uniforme |
| DE3343404A1 (de) * | 1983-11-30 | 1985-06-05 | Siemens AG, 1000 Berlin und 8000 München | Schaltungsanordnung zur schnellen ermittlung der betragsmaessig groessten differenz von drei binaer dargestellten zahlenwerten |
| IT1195350B (it) * | 1986-10-21 | 1988-10-12 | Cselt Centro Studi Lab Telecom | Procedimento e dispositivo per la codifica e decodifica del segnale vocale mediante estrazione di para metri e tecniche di quantizzazione vettoriale |
| JPH02170787A (ja) * | 1988-12-23 | 1990-07-02 | Matsushita Electric Ind Co Ltd | ベクトル量子化符号化器とベクトル量子化復号化器 |
| US4992868A (en) * | 1989-02-28 | 1991-02-12 | Holtz Klaus E | True information television (TITV) and vision system |
| JP2969867B2 (ja) * | 1990-08-31 | 1999-11-02 | ソニー株式会社 | ディジタル画像信号の高能率符号化装置 |
| JPH04181884A (ja) * | 1990-11-16 | 1992-06-29 | Sony Corp | 映像信号記録装置 |
| JP2906671B2 (ja) * | 1990-12-28 | 1999-06-21 | ソニー株式会社 | ディジタルビデオ信号の高能率符号化装置およびその方法 |
| US5651026A (en) * | 1992-06-01 | 1997-07-22 | Hughes Electronics | Robust vector quantization of line spectral frequencies |
| US5481554A (en) * | 1992-09-02 | 1996-01-02 | Sony Corporation | Data transmission apparatus for transmitting code data |
| US5351047A (en) * | 1992-09-21 | 1994-09-27 | Laboratory Automation, Inc. | Data decoding method and apparatus |
| US5850261A (en) * | 1992-10-15 | 1998-12-15 | Sony Corporation | Efficient variable length encoder and decoder |
| JPH0787327A (ja) * | 1993-09-17 | 1995-03-31 | Fuji Xerox Co Ltd | 画像符号化装置 |
| JP3590996B2 (ja) * | 1993-09-30 | 2004-11-17 | ソニー株式会社 | ディジタル画像信号の階層符号化および復号装置 |
| KR100213015B1 (ko) * | 1994-03-31 | 1999-08-02 | 윤종용 | 양자화 방법 및 회로 |
| US5619693A (en) * | 1994-05-02 | 1997-04-08 | Tandem Computers Incorporated | Method for sorting and storing data employing dynamic sort tree reconfiguration in volatile memory |
| JP3013746B2 (ja) * | 1995-04-26 | 2000-02-28 | 日本電気株式会社 | デジタル輪郭補償装置 |
| US5825313A (en) * | 1995-08-01 | 1998-10-20 | Sony Corporation | Information signal encoding apparatus, encoding method thereof, information signal decoding method, and information signal record medium thereof |
-
1996
- 1996-07-18 JP JP18916396A patent/JPH1032495A/ja active Pending
-
1997
- 1997-07-18 KR KR1019970034235A patent/KR100565868B1/ko not_active IP Right Cessation
- 1997-07-18 CN CN97117499A patent/CN1101993C/zh not_active Expired - Fee Related
-
1999
- 1999-07-07 US US09/349,297 patent/US6112205A/en not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010533396A (ja) * | 2007-06-28 | 2010-10-21 | クゥアルコム・インコーポレイテッド | 格納およびバスバンド幅の要求を最小限に抑える効率的な画像圧縮方式 |
| US8331663B2 (en) | 2007-06-28 | 2012-12-11 | Qualcomm Incorporated | Efficient image compression scheme to minimize storage and bus bandwidth requirements |
Also Published As
| Publication number | Publication date |
|---|---|
| KR980012964A (ko) | 1998-04-30 |
| CN1177866A (zh) | 1998-04-01 |
| CN1101993C (zh) | 2003-02-19 |
| US6112205A (en) | 2000-08-29 |
| KR100565868B1 (ko) | 2006-09-14 |
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