JPH10181079A - 画像記録装置 - Google Patents
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- JPH10181079A JPH10181079A JP34347796A JP34347796A JPH10181079A JP H10181079 A JPH10181079 A JP H10181079A JP 34347796 A JP34347796 A JP 34347796A JP 34347796 A JP34347796 A JP 34347796A JP H10181079 A JPH10181079 A JP H10181079A
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- solid
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
- G06K15/02—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers
- G06K15/12—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers
- G06K15/1238—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers simultaneously exposing more than one point
- G06K15/1242—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers simultaneously exposing more than one point on one main scanning line
- G06K15/1247—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers simultaneously exposing more than one point on one main scanning line using an array of light sources, e.g. a linear array
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/435—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of radiation to a printing material or impression-transfer material
- B41J2/447—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of radiation to a printing material or impression-transfer material using arrays of radiation sources
- B41J2/45—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of radiation to a printing material or impression-transfer material using arrays of radiation sources using light-emitting diode [LED] or laser arrays
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- Printers Or Recording Devices Using Electromagnetic And Radiation Means (AREA)
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Abstract
(57)【要約】
【課題】 固体記録素子を用いたプリンタにおいて、記
録ヘッドの構成を簡略化してコストダウンを図る。 【解決手段】 LEDチップ30-1〜30-56内に配列された12
8個の記録素子を時分割して駆動する画像記録装置であ
って、シリアルに入力される1ライン分の画素データ列
から各LEDチップに対応して、連続する128bitの画素デ
ータを56本の信号線に順次シリアルに出力するシフトレ
ジスタ11-1〜11-56と、該56個の画素データを7個ずつ8
回に時分割して出力する選択器12-1〜12-56と、選択器
から出力される画素データを、対応するLEDチップ30-1
〜30-56毎に保持するレジスタ21を備えた。
録ヘッドの構成を簡略化してコストダウンを図る。 【解決手段】 LEDチップ30-1〜30-56内に配列された12
8個の記録素子を時分割して駆動する画像記録装置であ
って、シリアルに入力される1ライン分の画素データ列
から各LEDチップに対応して、連続する128bitの画素デ
ータを56本の信号線に順次シリアルに出力するシフトレ
ジスタ11-1〜11-56と、該56個の画素データを7個ずつ8
回に時分割して出力する選択器12-1〜12-56と、選択器
から出力される画素データを、対応するLEDチップ30-1
〜30-56毎に保持するレジスタ21を備えた。
Description
【０００１】
【発明の属する技術分野】本発明は、複写機、ファクシ
ミリ、プリンタ等の画像記録装置において、固体記録素
子アレイを用いて画像記録を行う画像記録装置に関す
る。
ミリ、プリンタ等の画像記録装置において、固体記録素
子アレイを用いて画像記録を行う画像記録装置に関す
る。
【０００２】
【従来の技術】近年、固体記録素子を走査する機能を、
記録チップ内部にもつ自己走査型の記録チップが提案さ
れた。その一例として、128個の発光素子がアレイ状に
配列された自己走査型のLEDチップの等価回路を図４に
示す。
記録チップ内部にもつ自己走査型の記録チップが提案さ
れた。その一例として、128個の発光素子がアレイ状に
配列された自己走査型のLEDチップの等価回路を図４に
示す。
【０００３】図４において、L1〜L128は記録素子として
の発光用サイリスタ、S1〜S128は転送用サイリスタであ
り、ΦＩは128個の発光素子に対応する画素データがシ
リアルに入力される信号線、ΦSSはこのLEDチップの動
作開始を指示するスタート信号、ΦS1及びΦS2は発光さ
せるべき素子を順次シフトするためのシフト信号であ
る。これらの動作について、図５に示したタイミングチ
ャートを用いて説明する。
の発光用サイリスタ、S1〜S128は転送用サイリスタであ
り、ΦＩは128個の発光素子に対応する画素データがシ
リアルに入力される信号線、ΦSSはこのLEDチップの動
作開始を指示するスタート信号、ΦS1及びΦS2は発光さ
せるべき素子を順次シフトするためのシフト信号であ
る。これらの動作について、図５に示したタイミングチ
ャートを用いて説明する。
【０００４】まず、スタート信号ΦSSをLからHにする(t
1)。次のタイミングで、シフト信号ΦS1をHからLにする
ことにより、転送用サイリスタＳ１がオンになり(t2)、
そのゲート電圧はアノード電位、即ち約５Ｖとなる。こ
こで、ΦＩをLにすることで、記録用サイリスタL１が発
光し(t3)、Hに戻すと消灯する（ｔ４）。ΦＩをHのまま
にしておけば、記録用サイリスタL１は発光しない(t3〜
t4)。
1)。次のタイミングで、シフト信号ΦS1をHからLにする
ことにより、転送用サイリスタＳ１がオンになり(t2)、
そのゲート電圧はアノード電位、即ち約５Ｖとなる。こ
こで、ΦＩをLにすることで、記録用サイリスタL１が発
光し(t3)、Hに戻すと消灯する（ｔ４）。ΦＩをHのまま
にしておけば、記録用サイリスタL１は発光しない(t3〜
t4)。
【０００５】次に、シフト信号ΦS2をHからLにすること
により、転送用サイリスタS2がオンになる(t5)。次のタ
イミングで、シフト信号ΦS1をLからHにすると、転送用
サイリスタＳ１がオフになり(t6)、よってオン状態の転
送用サイリスタはS2のみとなる。ここで、ΦＩをLにす
ることで、記録用サイリスタL2が発光し(t7)、Hに戻す
と消灯する(t8)。ΦＩをHのままにしておけば、記録用
サイリスタL２は発光しない(t7〜t8)。
により、転送用サイリスタS2がオンになる(t5)。次のタ
イミングで、シフト信号ΦS1をLからHにすると、転送用
サイリスタＳ１がオフになり(t6)、よってオン状態の転
送用サイリスタはS2のみとなる。ここで、ΦＩをLにす
ることで、記録用サイリスタL2が発光し(t7)、Hに戻す
と消灯する(t8)。ΦＩをHのままにしておけば、記録用
サイリスタL２は発光しない(t7〜t8)。
【０００６】以上の動作を繰り返し行うことで、128個
の転送用サイリスタS1〜S128は順次走査され、各々の転
送用サイリスタに対応する記録用サイリスタL1〜L128が
画素データに応じて発光することとなる。
の転送用サイリスタS1〜S128は順次走査され、各々の転
送用サイリスタに対応する記録用サイリスタL1〜L128が
画素データに応じて発光することとなる。
【０００７】次に、従来の自己走査型LEDチップの駆動
制御部における画素データの流れを図６に示す。図６に
おいて、30-1〜30-nは前述した自己走査型LEDチップ、4
0ー1〜40-55はそれぞれ128bitのシフトレジスタ、50-1〜
50-nはそれぞれ自己走査型LEDチップ30-1〜30-nに対応
する128個の画素データをラッチするラッチ回路であ
り、以下、これらの動作について説明する。
制御部における画素データの流れを図６に示す。図６に
おいて、30-1〜30-nは前述した自己走査型LEDチップ、4
0ー1〜40-55はそれぞれ128bitのシフトレジスタ、50-1〜
50-nはそれぞれ自己走査型LEDチップ30-1〜30-nに対応
する128個の画素データをラッチするラッチ回路であ
り、以下、これらの動作について説明する。
【０００８】まず、１ライン目の画素データ128×n個が
1bit幅の信号線Φ1より入力される。これらの画素デー
タ列はシフトレジスタ40-1〜40-nへ順次入力される。12
8×ｎ個の画素データが全てシフトレジスタ40-1〜40-n
へ入力されたところで、各々のシフトレジスタに対応す
るラッチ50-1〜50-nがそれら画素データを各々１２８ｂ
ｉｔずつラッチし、続いてシフトレジスタ40-1〜40-nに
は２ライン目の画素データが入力されてくる。一方、ラ
ッチ回路50-1〜50-nは保持している１２８ｂｉｔの画素
データを、各々に対応する自己走査型LEDチップ30-1〜3
0-nへ１ｂｉｔずつシリアルに転送する。
1bit幅の信号線Φ1より入力される。これらの画素デー
タ列はシフトレジスタ40-1〜40-nへ順次入力される。12
8×ｎ個の画素データが全てシフトレジスタ40-1〜40-n
へ入力されたところで、各々のシフトレジスタに対応す
るラッチ50-1〜50-nがそれら画素データを各々１２８ｂ
ｉｔずつラッチし、続いてシフトレジスタ40-1〜40-nに
は２ライン目の画素データが入力されてくる。一方、ラ
ッチ回路50-1〜50-nは保持している１２８ｂｉｔの画素
データを、各々に対応する自己走査型LEDチップ30-1〜3
0-nへ１ｂｉｔずつシリアルに転送する。
【０００９】そして、前述したように、各LEDチップ30-
1〜30-n内において、記録素子が順次走査され、転送さ
れてくる画素データに応じて選択的に発光することとな
る。
1〜30-n内において、記録素子が順次走査され、転送さ
れてくる画素データに応じて選択的に発光することとな
る。
【００１０】
【発明が解決しようとする課題】このように、それぞれ
の記録チップ内で各記録素子を時分割して駆動する場
合、シリアル入力される１ライン分の画素データを全て
パラレルに変換して出力するシフトレジスタと、該1ラ
イン分の画素データ全てをラッチして対応する記録チッ
プ毎にシリアル出力するラッチ部が必要であり、このラ
ッチが記録ヘッドのコスト高を招く原因となっていた。
また、シフトレジスタとラッチを結ぶ信号線の本数もコ
スト高を招いていた。
の記録チップ内で各記録素子を時分割して駆動する場
合、シリアル入力される１ライン分の画素データを全て
パラレルに変換して出力するシフトレジスタと、該1ラ
イン分の画素データ全てをラッチして対応する記録チッ
プ毎にシリアル出力するラッチ部が必要であり、このラ
ッチが記録ヘッドのコスト高を招く原因となっていた。
また、シフトレジスタとラッチを結ぶ信号線の本数もコ
スト高を招いていた。
【００１１】本発明は係る課題を鑑みてなされたもの
で、固体記録素子の記録ヘッドの規模を小さくし、安価
な画像記録装置を提供することを目的とする。
で、固体記録素子の記録ヘッドの規模を小さくし、安価
な画像記録装置を提供することを目的とする。
【００１２】
【課題を解決するための手段】本発明における画像記録
装置は、夫夫固体記録素子がＮ個配列されたＭ個の固体
記録素子アレイと、前記固体記録素子アレイ内に配列さ
れた各々N個の固体記録素子を時分割して駆動する駆動
手段を有する画像記録装置であって、シリアルに入力さ
れる1ライン分の画素データ列から前記Ｍ個の固体記録
素子アレイに対応して連続するNビットの画素データを
順次シリアルに出力するＭ本の出力線を備えたシフトレ
ジスタと、前記シフトレジスタの前記Ｍ本の出力線から
出力されるＭビットの画素データをＬビットずつの画素
データとして順次切り換えて時分割出力する選択器と、
前記選択器から出力されるＬビットの画素データを各画
素データに対応する前記固体記録素子アレイ毎に保持す
る保持手段を有し、前記駆動手段は前記保持手段に保持
された画素データに応じて前記固体記録素子アレイ内の
記録素子を駆動することを特徴とする。
装置は、夫夫固体記録素子がＮ個配列されたＭ個の固体
記録素子アレイと、前記固体記録素子アレイ内に配列さ
れた各々N個の固体記録素子を時分割して駆動する駆動
手段を有する画像記録装置であって、シリアルに入力さ
れる1ライン分の画素データ列から前記Ｍ個の固体記録
素子アレイに対応して連続するNビットの画素データを
順次シリアルに出力するＭ本の出力線を備えたシフトレ
ジスタと、前記シフトレジスタの前記Ｍ本の出力線から
出力されるＭビットの画素データをＬビットずつの画素
データとして順次切り換えて時分割出力する選択器と、
前記選択器から出力されるＬビットの画素データを各画
素データに対応する前記固体記録素子アレイ毎に保持す
る保持手段を有し、前記駆動手段は前記保持手段に保持
された画素データに応じて前記固体記録素子アレイ内の
記録素子を駆動することを特徴とする。
【００１３】
【発明の実施の形態】以下、本発明の一実施形態につい
て詳細に説明する。
て詳細に説明する。
【００１４】図１に自己走査型LEDチップ30-1〜30-56、
及びその駆動ICチップ20-1〜20-4、I/F回路部10からな
る記録ヘッドの該略図を示す。
及びその駆動ICチップ20-1〜20-4、I/F回路部10からな
る記録ヘッドの該略図を示す。
【００１５】ここで、例えばA3用紙に記録するためには
A3用紙の短辺に相当する約300mm、A4用紙に記録するた
めには同じく約216mmの幅にわたって記録素子を配列す
る必要があり、例えば600dpiの解像度で記録するために
は、128個の記録素子を含むLEDチップをA3記録の場合56
個、A4記録の場合40個要することとなる。
A3用紙の短辺に相当する約300mm、A4用紙に記録するた
めには同じく約216mmの幅にわたって記録素子を配列す
る必要があり、例えば600dpiの解像度で記録するために
は、128個の記録素子を含むLEDチップをA3記録の場合56
個、A4記録の場合40個要することとなる。
【００１６】ここでA3記録、A4記録のいずれの場合にも
無駄が生じないよう、駆動ICチップ1個当たりが駆動す
るLEDチップの数を56と40の最大公約数即ち8として、A3
記録の場合7個、A4記録の場合5個の駆動ICチップが動作
するよう構成する方法も考えられるが、7個の駆動ICチ
ップをA3用紙の幅に実装するのは困難である。
無駄が生じないよう、駆動ICチップ1個当たりが駆動す
るLEDチップの数を56と40の最大公約数即ち8として、A3
記録の場合7個、A4記録の場合5個の駆動ICチップが動作
するよう構成する方法も考えられるが、7個の駆動ICチ
ップをA3用紙の幅に実装するのは困難である。
【００１７】そこで、本実施例においては、4個の駆動IC
チップ20-1〜20-4により14個のLEDチップを駆動する構
成とした。これによると、4個の駆動ICチップをA3用紙
の幅に実装すればよい。また、A3記録の際は4個の駆動I
Cチップが駆動すればよく、一方、A4記録の際は2個のLE
Dチップを余分に駆動してしまうが3個の駆動ICチップが
動作すればよい。以上の理由により、駆動ICチップ20-1
〜20-4は、LEDチップを各々14個ずつ駆動するよう構成
した。
チップ20-1〜20-4により14個のLEDチップを駆動する構
成とした。これによると、4個の駆動ICチップをA3用紙
の幅に実装すればよい。また、A3記録の際は4個の駆動I
Cチップが駆動すればよく、一方、A4記録の際は2個のLE
Dチップを余分に駆動してしまうが3個の駆動ICチップが
動作すればよい。以上の理由により、駆動ICチップ20-1
〜20-4は、LEDチップを各々14個ずつ駆動するよう構成
した。
【００１８】例えば、駆動ICチップ20-1はLEDチップ30-
1に対して画素データ線（前述のΦIに相当）Φ23-1、ス
タート信号（ΦSSに相当）Φ24、シフト信号（ΦS1、Φ
S2に相当）Φ25-1、Φ26-1を出力する。また、LEDチッ
プ30-2に対しては画素データ線Φ23-2、スタート信号Φ
24、シフト信号Φ25-2、Φ26-2を出力し、以下同様にし
て、LEDチップ30-14に対して画素データ線Φ23-14、ス
タート信号Φ24、シフト信号Φ25-14、Φ26-14を出力す
る。ここで、スタート信号に対応するΦ24は各LEDチッ
プ30-1〜30-14に共通であるので、駆動ICチップ30-1か
らの出力は１本のみとし並列に接続した。また、画素デ
ータを伝送するΦ24は駆動電流値を調整するために外部
のチップ抵抗を介してLEDチップの共通カソードと接続
する。
1に対して画素データ線（前述のΦIに相当）Φ23-1、ス
タート信号（ΦSSに相当）Φ24、シフト信号（ΦS1、Φ
S2に相当）Φ25-1、Φ26-1を出力する。また、LEDチッ
プ30-2に対しては画素データ線Φ23-2、スタート信号Φ
24、シフト信号Φ25-2、Φ26-2を出力し、以下同様にし
て、LEDチップ30-14に対して画素データ線Φ23-14、ス
タート信号Φ24、シフト信号Φ25-14、Φ26-14を出力す
る。ここで、スタート信号に対応するΦ24は各LEDチッ
プ30-1〜30-14に共通であるので、駆動ICチップ30-1か
らの出力は１本のみとし並列に接続した。また、画素デ
ータを伝送するΦ24は駆動電流値を調整するために外部
のチップ抵抗を介してLEDチップの共通カソードと接続
する。
【００１９】図２は駆動ICチップ20-1〜20-4へ画素デー
タを供給するためのI/F回路部10を示す詳細図である。
タを供給するためのI/F回路部10を示す詳細図である。
【００２０】図２において、11-1〜11-56は各々128個の
１ｂｉｔのシフトレジスタと128ｂｉｔのラッチからな
るシフトレジスタであって、これらは直列に接続されて
おり、シフトレジスタ11-56側からΦ1を通して1ライン
分のラスタ画素データが入力されている。
１ｂｉｔのシフトレジスタと128ｂｉｔのラッチからな
るシフトレジスタであって、これらは直列に接続されて
おり、シフトレジスタ11-56側からΦ1を通して1ライン
分のラスタ画素データが入力されている。
【００２１】12-1〜12-56は選択器であり、各シフトレ
ジスタ11-1〜11-56からの各々1bitの画素データ出力が
入力されている。これら選択器12-1〜12-56は、連続す
る7個ずつ各出力許可信号線Φ2-1〜2-8に接続され、タ
イミング信号発生部13からを通して出力許可が与えられ
ると、出力線Φ3-1〜3-7へ画素データを出力する。13は
種々のタイミング信号を発生するタイミング信号発生部
である。
ジスタ11-1〜11-56からの各々1bitの画素データ出力が
入力されている。これら選択器12-1〜12-56は、連続す
る7個ずつ各出力許可信号線Φ2-1〜2-8に接続され、タ
イミング信号発生部13からを通して出力許可が与えられ
ると、出力線Φ3-1〜3-7へ画素データを出力する。13は
種々のタイミング信号を発生するタイミング信号発生部
である。
【００２２】これらにおいて、はじめに、１ライン分の
画素データ、即ち128×14×4画素分のラスタ画素データ
列がΦ１からシリアルに入力され、シフトレジスタ11-1
〜11-56の各々へ順に128bitずつ入力される。そして、
シフトレジスタ11-1〜11-56は、1ライン分の画素データ
列の中の連続する128bitの画素データ列のうち先ず先頭
の各々1bit、即ち各LEDチップ30-1〜30-56内の記録素子
L１に対応する計56個の画素データを各選択器12-1〜12-
56へ出力する。
画素データ、即ち128×14×4画素分のラスタ画素データ
列がΦ１からシリアルに入力され、シフトレジスタ11-1
〜11-56の各々へ順に128bitずつ入力される。そして、
シフトレジスタ11-1〜11-56は、1ライン分の画素データ
列の中の連続する128bitの画素データ列のうち先ず先頭
の各々1bit、即ち各LEDチップ30-1〜30-56内の記録素子
L１に対応する計56個の画素データを各選択器12-1〜12-
56へ出力する。
【００２３】さらに、次のタイミングで、シフトレジス
タ11-1〜11-56は、1ライン分の画素データ列の中の連続
する128bitの画素データ列のうち2番目の各々1bit、即
ち各LEDチップ30-1〜30-56内の記録素子L2に対応する計
56個の画素データを各選択器12-1〜12-56へ出力する。
以下、同様にして、各記録素子L3〜L128に対応する画素
データを出力することにより、各シフトレジスタ11-1〜
11-56は、各LEDチップ30-1〜30-56に対応して連続する1
28bitの画素データを、各々選択器12-1〜12-56にシリア
ルに出力したことになる。
タ11-1〜11-56は、1ライン分の画素データ列の中の連続
する128bitの画素データ列のうち2番目の各々1bit、即
ち各LEDチップ30-1〜30-56内の記録素子L2に対応する計
56個の画素データを各選択器12-1〜12-56へ出力する。
以下、同様にして、各記録素子L3〜L128に対応する画素
データを出力することにより、各シフトレジスタ11-1〜
11-56は、各LEDチップ30-1〜30-56に対応して連続する1
28bitの画素データを、各々選択器12-1〜12-56にシリア
ルに出力したことになる。
【００２４】このようにして、選択器12-1〜12-56に入
力された56個の画素データは、タイミング発生部13から
発生される出力許可信号Φ2-1〜2-8のタイミングに同期
して7個ずつ選択され、Φ3-1〜3-7へ出力される。ここ
で、１本の出力許可信号は連続する7個の選択器へ共通
して入力されており、タイミング信号発生部13はΦ2-1
〜2-8を順次オンにすることにより、選択器12-1〜12-
7、12-8〜12-14、…12-50〜12-56が順に7個ずつ選択さ
れる。つまり、選択器12-1〜12-56はシフトレジスタ11-
1〜11-56の出力線から出力される画素データを7個ずつ8
回に時分割して出力する。
力された56個の画素データは、タイミング発生部13から
発生される出力許可信号Φ2-1〜2-8のタイミングに同期
して7個ずつ選択され、Φ3-1〜3-7へ出力される。ここ
で、１本の出力許可信号は連続する7個の選択器へ共通
して入力されており、タイミング信号発生部13はΦ2-1
〜2-8を順次オンにすることにより、選択器12-1〜12-
7、12-8〜12-14、…12-50〜12-56が順に7個ずつ選択さ
れる。つまり、選択器12-1〜12-56はシフトレジスタ11-
1〜11-56の出力線から出力される画素データを7個ずつ8
回に時分割して出力する。
【００２５】例えばいま、出力許可信号Φ2-1がオンに
なると、画素データ線Φ3-1〜3-7へ、それぞれLEDチッ
プ30-1〜30-7内の記録素子L1に対応する画素データが出
力される。次に出力許可信号Φ2-2がHになると、それぞ
れLEDチップ30-8〜30-14内の記録素子L1に対応する画素
データが出力される。以下、同様にして、出力許可信号
Φ2-3〜2-8が順次Hになり、各LEDチップ30-15〜30-56内
の記録素子L1に対応するデータが出力される。
なると、画素データ線Φ3-1〜3-7へ、それぞれLEDチッ
プ30-1〜30-7内の記録素子L1に対応する画素データが出
力される。次に出力許可信号Φ2-2がHになると、それぞ
れLEDチップ30-8〜30-14内の記録素子L1に対応する画素
データが出力される。以下、同様にして、出力許可信号
Φ2-3〜2-8が順次Hになり、各LEDチップ30-15〜30-56内
の記録素子L1に対応するデータが出力される。
【００２６】このようにして、各LEDチップ30-1〜30-56
内の記録素子L1に対応する画素データが全て出力される
と、各シフトレジスタ11-1〜11-56は格納されている画
素データを1bitシフトし、各LEDチップ30-1〜30-56内の
記録素子L2に対応する画素データを、次に、出力許可信
号Φ2-1が2度目にオンになると、Φ3-1〜3-7へそれぞれ
LEDチップ30-1〜30-7内の記録素子L２に対応するデータ
が出力される。
内の記録素子L1に対応する画素データが全て出力される
と、各シフトレジスタ11-1〜11-56は格納されている画
素データを1bitシフトし、各LEDチップ30-1〜30-56内の
記録素子L2に対応する画素データを、次に、出力許可信
号Φ2-1が2度目にオンになると、Φ3-1〜3-7へそれぞれ
LEDチップ30-1〜30-7内の記録素子L２に対応するデータ
が出力される。
【００２７】以下同様にして、Φ2-8が128回目にオンに
なったところで、１ライン分の全ての画素データがΦ3-
1〜3-7へ出力されたことになる。
なったところで、１ライン分の全ての画素データがΦ3-
1〜3-7へ出力されたことになる。
【００２８】次に、４つの駆動ICチップ20-1〜20-4につ
いて、駆動ICチップ20-1を例にとり説明する。図３は駆
動ICチップ20-1の詳細図であるが、他の駆動ICチップ20
-2〜20-4も同様に構成される。
いて、駆動ICチップ20-1を例にとり説明する。図３は駆
動ICチップ20-1の詳細図であるが、他の駆動ICチップ20
-2〜20-4も同様に構成される。
【００２９】１個の駆動ICチップは、I/F回路部10から
画素データ線Φ3-1〜3-7を通して2回に分けて出力され
る１4画素分の画素データに応じて、１４個のLEDチップ
を駆動しており、図3において、21-1A〜21-２Bはそれぞ
れ７ｂｉｔのレジスタ、22-1〜22-14は選択器、23-1〜2
3-14、24、25-1〜25-14、26-1〜26-14はドライバ、27は
デコーダである。
画素データ線Φ3-1〜3-7を通して2回に分けて出力され
る１4画素分の画素データに応じて、１４個のLEDチップ
を駆動しており、図3において、21-1A〜21-２Bはそれぞ
れ７ｂｉｔのレジスタ、22-1〜22-14は選択器、23-1〜2
3-14、24、25-1〜25-14、26-1〜26-14はドライバ、27は
デコーダである。
【００３０】駆動ICチップ20-1は、レジスタを2組備え
ており、格納動作と出力動作を、交互に切り替える構成
としている。即ち、レジスタ21-1A及び21-2Aへ画素デー
タを格納するのと並行して、21-1B及び21-2Bから画素デ
ータを出力し、また、レジスタ21-3及び21-4へ画素デー
タを格納するのと並行して21-1及び21-2から画素データ
を出力する。
ており、格納動作と出力動作を、交互に切り替える構成
としている。即ち、レジスタ21-1A及び21-2Aへ画素デー
タを格納するのと並行して、21-1B及び21-2Bから画素デ
ータを出力し、また、レジスタ21-3及び21-4へ画素デー
タを格納するのと並行して21-1及び21-2から画素データ
を出力する。
【００３１】格納動作においては、信号線Φ3-1〜3-7よ
り7画素分の画素データがパラレルに入力されると、レ
ジスタ21-1A〜21-２Bのいずれかに画素データが格納さ
れる。ここで、格納すべきレジスタを指定するための信
号として、I/F回路部１０内のタイミング信号発生部13
より、2bitのセレクト信号SEL1及びSEL2を通して、例え
ば00、01、11、10として送られてくる。デコーダ27は、
これをデコードし、画素データを格納すべきレジスタに
対してオンを出力し、当該レジスタはＩ／Ｆ回路部10か
らΦ3-1〜3-7を通して入力されている画素データを格納
する。また、出力動作においては、２bitのセレクト信
号のうちの上位ビット、例えばSEL2が選択器22-1〜22-1
4に入力されており、レジスタ21-1及び21-2、またはレ
ジスタ21-3及び21-4からの出力を選択器22-1〜22-14で
交互に選択して出力する。
り7画素分の画素データがパラレルに入力されると、レ
ジスタ21-1A〜21-２Bのいずれかに画素データが格納さ
れる。ここで、格納すべきレジスタを指定するための信
号として、I/F回路部１０内のタイミング信号発生部13
より、2bitのセレクト信号SEL1及びSEL2を通して、例え
ば00、01、11、10として送られてくる。デコーダ27は、
これをデコードし、画素データを格納すべきレジスタに
対してオンを出力し、当該レジスタはＩ／Ｆ回路部10か
らΦ3-1〜3-7を通して入力されている画素データを格納
する。また、出力動作においては、２bitのセレクト信
号のうちの上位ビット、例えばSEL2が選択器22-1〜22-1
4に入力されており、レジスタ21-1及び21-2、またはレ
ジスタ21-3及び21-4からの出力を選択器22-1〜22-14で
交互に選択して出力する。
【００３２】これにより、駆動ICチップ20-1に接続され
ている14個のLEDチップ30-1〜30-14に並列に画素データ
が供給される。
ている14個のLEDチップ30-1〜30-14に並列に画素データ
が供給される。
【００３３】以下、これらの動作の流れについて詳細に
説明する。
説明する。
【００３４】まず、前述のI/F回路部10から信号線Φ3-1
〜3-7を通して、記録チップ30-1〜30-7内の記録素子L１
に対応する画素データが入力される。ここで、セレクト
信号がレジスタ21-1Aを指定することにより、画素デー
タがレジスタ21-1Aへ格納される。次のタイミングで、
記録チップ30-8〜30-14内の記録素子L1に対応する画素
データが、レジスタ21-2Aへ格納される。
〜3-7を通して、記録チップ30-1〜30-7内の記録素子L１
に対応する画素データが入力される。ここで、セレクト
信号がレジスタ21-1Aを指定することにより、画素デー
タがレジスタ21-1Aへ格納される。次のタイミングで、
記録チップ30-8〜30-14内の記録素子L1に対応する画素
データが、レジスタ21-2Aへ格納される。
【００３５】更に、次のタイミングで入力される記録チ
ップ30-15〜30-21内の記録素子L１に対応する画素デー
タが、図示していない駆動ICチップ20-2内のレジスタ21
-3Aに格納され、更に、次にタイミングで入力される記
録チップ30-22〜30-28内の記録素子L1に対応する画素デ
ータが、図示していない駆動ICチップ20-2内のレジスタ
21-4Aへ格納される。
ップ30-15〜30-21内の記録素子L１に対応する画素デー
タが、図示していない駆動ICチップ20-2内のレジスタ21
-3Aに格納され、更に、次にタイミングで入力される記
録チップ30-22〜30-28内の記録素子L1に対応する画素デ
ータが、図示していない駆動ICチップ20-2内のレジスタ
21-4Aへ格納される。
【００３６】以下、同様にして、最後に記録チップ30-5
0〜30-56内の記録素子L1に対応する画素データが図示し
ていない駆動ICチップ20-4内のレジスタ21-8Aに格納さ
れることで、全ての記録チップ30-1〜30-56内の記録素
子L1に対応する画素データが、レジスタ21-1A〜21-8A内
に格納されたことになる。
0〜30-56内の記録素子L1に対応する画素データが図示し
ていない駆動ICチップ20-4内のレジスタ21-8Aに格納さ
れることで、全ての記録チップ30-1〜30-56内の記録素
子L1に対応する画素データが、レジスタ21-1A〜21-8A内
に格納されたことになる。
【００３７】次に、そしてSEL2によって、各レジスタ21
-1A〜21-8A内に格納されたデータが同時に選択器22で選
択され、各々に対応するドライバ23へ送られて、各記録
チップ記録素子L1を駆動する。
-1A〜21-8A内に格納されたデータが同時に選択器22で選
択され、各々に対応するドライバ23へ送られて、各記録
チップ記録素子L1を駆動する。
【００３８】この出力動作、即ち記録チップ30-50〜30-
56内の記録素子L１に対応する画素データが出力される
のと並行して、記録チップ30-50〜30-56内の記録素子L
２に対応する画素データが入力されてくる。これらの画
素データも上述したのと同様に、各記録チップ30-1〜30
-56内の記録素子L2で記録すべき画素データがΦ3-1〜Φ
3-7を通して送られてくる。これら画素データを、L1の
場合と同様にして、レジスタ21-1B〜21-56Bへ格納す
る。
56内の記録素子L１に対応する画素データが出力される
のと並行して、記録チップ30-50〜30-56内の記録素子L
２に対応する画素データが入力されてくる。これらの画
素データも上述したのと同様に、各記録チップ30-1〜30
-56内の記録素子L2で記録すべき画素データがΦ3-1〜Φ
3-7を通して送られてくる。これら画素データを、L1の
場合と同様にして、レジスタ21-1B〜21-56Bへ格納す
る。
【００３９】以上のようにして、出力動作と格納動作を
レジスタ21-1A〜21-8Aとレジスタ21-1B〜21-8Bが交互に
行うことにより、1ライン分の画素データが全て出力さ
れることになる。
レジスタ21-1A〜21-8Aとレジスタ21-1B〜21-8Bが交互に
行うことにより、1ライン分の画素データが全て出力さ
れることになる。
【００４０】なお、各選択器22より選択され出力される
画素データは各ドライバ23に入力され、各LEDチップ30-
1〜30-56を駆動する駆動電流がオンまたはオフされる。
画素データは各ドライバ23に入力され、各LEDチップ30-
1〜30-56を駆動する駆動電流がオンまたはオフされる。
【００４１】また、I/F回路部30内のタイミング信号発
生部13より発せれるΦSS、ΦS1、ΦS2も駆動ICチップ20-1
〜20-14内のドライバ24、25、26によって、各LEDチップ
を駆動する駆動電流がオンまたはオフされる。
生部13より発せれるΦSS、ΦS1、ΦS2も駆動ICチップ20-1
〜20-14内のドライバ24、25、26によって、各LEDチップ
を駆動する駆動電流がオンまたはオフされる。
【００４２】各LEDチップ内30-1〜30-56は従来例で説明
した自己走査型LEDアレイと同様に構成される。
した自己走査型LEDアレイと同様に構成される。
【００４３】以上説明した各部の動作により、画素デー
タに応じて、各記録素子が点灯または消灯し、これら照
射光を例えば感光体上に結像し、よく知られる電子写真
プロセスによって記録用紙上に所望の画像を記録するこ
とができる。
タに応じて、各記録素子が点灯または消灯し、これら照
射光を例えば感光体上に結像し、よく知られる電子写真
プロセスによって記録用紙上に所望の画像を記録するこ
とができる。
【００４４】（その他の実施例）上記実施例において
は、駆動ICチップ1個当たり、14個のLEDチップを駆動す
る構成について説明したが、駆動ICチップ1個当たり、8
個のLEDチップを駆動するよう構成してもよい。こうす
るとA3用紙相当の画像を記録する場合は７つの駆動ICチ
ップ、A4用紙相当の画像を記録する場合は５つの駆動IC
チップを駆動すればよく、それぞれにおける冗長数は0
となる。この場合、図３のレジスタ21をそれぞれ４ｂｉ
ｔ幅とすれば、図2のI/F回路部のマトリクスは4*14とな
る。また、図３のレジスタ21をそれぞれ8bit幅とすれ
ば、図2のI/F回路部のマトリクスは8*7となる。
は、駆動ICチップ1個当たり、14個のLEDチップを駆動す
る構成について説明したが、駆動ICチップ1個当たり、8
個のLEDチップを駆動するよう構成してもよい。こうす
るとA3用紙相当の画像を記録する場合は７つの駆動ICチ
ップ、A4用紙相当の画像を記録する場合は５つの駆動IC
チップを駆動すればよく、それぞれにおける冗長数は0
となる。この場合、図３のレジスタ21をそれぞれ４ｂｉ
ｔ幅とすれば、図2のI/F回路部のマトリクスは4*14とな
る。また、図３のレジスタ21をそれぞれ8bit幅とすれ
ば、図2のI/F回路部のマトリクスは8*7となる。
【００４５】また、駆動ICチップ1個当たり、７個のLED
チップを駆動するよう構成してもよい。こうするとA3用
紙相当の画像を記録する場合は８つの駆動ICチップ、A4
用紙相当の画像を記録する場合は６個の駆動ICチップを
駆動すればよい。
チップを駆動するよう構成してもよい。こうするとA3用
紙相当の画像を記録する場合は８つの駆動ICチップ、A4
用紙相当の画像を記録する場合は６個の駆動ICチップを
駆動すればよい。
【００４６】また、上記実施例においては、I/F回路部1
0内のシフトレジスタ11-1〜11-56は画素データを1bit幅
で順次転送する構成について説明したが、4〜16bit幅で
転送するよう構成しても良い。
0内のシフトレジスタ11-1〜11-56は画素データを1bit幅
で順次転送する構成について説明したが、4〜16bit幅で
転送するよう構成しても良い。
【００４７】また、上記実施例においては、記録チップ
として記録チップ内部に自己走査機能を有する自己走査
型のLEDチップを例にとり説明したが、同様の走査機能
を記録チップ内部または外部に有する時分割駆動可能な
記録チップでも構わない。
として記録チップ内部に自己走査機能を有する自己走査
型のLEDチップを例にとり説明したが、同様の走査機能
を記録チップ内部または外部に有する時分割駆動可能な
記録チップでも構わない。
【００４８】さらには、記録素子も、他の発光素子や更
には発熱素子等でも構わない。
には発熱素子等でも構わない。
【００４９】
【発明の効果】本発明によれば、シリアル入力される１
ライン分の画素データから各固体記録素子アレイに対応
する画素データを各固体記録素子アレイ毎にシリアル出
力し、その複数の出力を選択器が時分割して保持手段へ
転送することにより、記録ヘッドの回路規模を小さくす
ることができ、安価な画像記録装置を提供することが可
能となる。
ライン分の画素データから各固体記録素子アレイに対応
する画素データを各固体記録素子アレイ毎にシリアル出
力し、その複数の出力を選択器が時分割して保持手段へ
転送することにより、記録ヘッドの回路規模を小さくす
ることができ、安価な画像記録装置を提供することが可
能となる。
【図１】本実施例におけるLEDプリンタの記録ヘッドの
該略図
該略図
【図２】本実施例におけるI/F回路部の説明図
【図３】本実施例における駆動ICチップの説明図
【図４】自己走査型LEDチップの説明図
【図５】自己走査型LEDチップの動作タイミングチャー
ト
ト
【図６】従来のLEDプリンタの記録ヘッドの該略図
１０ Ｉ／Ｆ回路部 １１ レジスタ １２ 選択器 １３ タイミング信号発生回路 ２０ 駆動ＩＣチップ ２１ レジスタ ２２ 選択器 ２３、２４、２５、２６ ドライバ ２７ デコーダ ３０ ＬＥＤチップ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 大坪 俊彦 東京都大田区下丸子３丁目30番２号キヤノ ン株式会社内
Claims (7)
- 【請求項１】 夫夫固体記録素子がＮ個配列されたＭ個
の固体記録素子アレイと、 前記固体記録素子アレイ内に配列された各々N個の固体
記録素子を時分割して駆動する駆動手段を有する画像記
録装置であって、 シリアルに入力される1ライン分の画素データ列から前
記Ｍ個の固体記録素子アレイに対応して連続するNビッ
トの画素データを順次シリアルに出力するＭ本の出力線
を備えたシフトレジスタと、 前記シフトレジスタの前記Ｍ本の出力線から出力される
Ｍビットの画素データをＬビットずつの画素データとし
て順次切り換えて時分割出力する選択器と、 前記選択器から出力されるＬビットの画素データを各画
素データに対応する前記固体記録素子アレイ毎に保持す
る保持手段を有し、 前記駆動手段は前記保持手段に保持された画素データに
応じて前記固体記録素子アレイ内の記録素子を駆動する
ことを特徴とする画像記録装置。 - 【請求項２】 前記駆動手段は4個または３個の駆動チ
ップで構成され、該駆動チップは各々14個の固体記録群
を駆動することを特徴とする請求項1記載の画像記録装
置。 - 【請求項３】 前記駆動手段は７個または５個の駆動チ
ップで構成され、該駆動チップは各々８個の固体記録素
子アレイを駆動することを特徴とする請求項1記載の画
像記録装置。 - 【請求項４】 前記駆動手段は８個または６個の駆動チ
ップで形成され、該駆動チップは各々７個の固体記録素
子アレイを駆動することを特徴とする請求項1記載の画
像記録装置。 - 【請求項５】 前記固体記録チップは内部に走査機能を
有することを特徴とする請求項1記載の画像記録装置。 - 【請求項６】 前記記録素子は発光素子であることを特
徴とする請求項1記載の画像記録装置。 - 【請求項７】 前記発光素子は発光サイリスタであるこ
とを特徴とする請求項６記載の画像記録装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34347796A JP3703234B2 (ja) | 1996-12-24 | 1996-12-24 | 画像記録装置 |
| US08/993,156 US6002420A (en) | 1996-12-24 | 1997-12-18 | Image recording apparatus using solid recording device array |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34347796A JP3703234B2 (ja) | 1996-12-24 | 1996-12-24 | 画像記録装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10181079A true JPH10181079A (ja) | 1998-07-07 |
| JP3703234B2 JP3703234B2 (ja) | 2005-10-05 |
Family
ID=18361829
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34347796A Expired - Fee Related JP3703234B2 (ja) | 1996-12-24 | 1996-12-24 | 画像記録装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6002420A (ja) |
| JP (1) | JP3703234B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US6853396B1 (en) | 1999-09-20 | 2005-02-08 | Sanyo Electric Co., Ltd. | Driving ic and optical print head |
| JP2007168329A (ja) * | 2005-12-22 | 2007-07-05 | Kyocera Corp | 発光装置の設計支援方法、発光装置、画像形成装置および設計支援プログラム |
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| JPH11138899A (ja) * | 1997-11-11 | 1999-05-25 | Canon Inc | 画像形成装置 |
| JPH11192744A (ja) * | 1997-12-29 | 1999-07-21 | Canon Inc | Ｌｅｄアレイ駆動装置および方法 |
| JPH11216896A (ja) * | 1998-02-03 | 1999-08-10 | Fujitsu Ltd | 露光装置 |
| JP4066501B2 (ja) * | 1998-04-10 | 2008-03-26 | 富士ゼロックス株式会社 | ２次元発光素子アレイおよびその駆動方法 |
| JP2000094745A (ja) * | 1998-09-25 | 2000-04-04 | Fuji Xerox Co Ltd | 画像形成装置及び２次元発光素子アレイ |
| JP4289743B2 (ja) | 1999-10-26 | 2009-07-01 | キヤノン株式会社 | 画像形成装置 |
| EP1221372B1 (en) * | 2001-01-05 | 2005-06-08 | Hewlett-Packard Company | Integrated programmable fire pulse generator for inkjet printhead assembly |
| US6585339B2 (en) * | 2001-01-05 | 2003-07-01 | Hewlett Packard Co | Module manager for wide-array inkjet printhead assembly |
| US6726298B2 (en) | 2001-02-08 | 2004-04-27 | Hewlett-Packard Development Company, L.P. | Low voltage differential signaling communication in inkjet printhead assembly |
| US6726300B2 (en) | 2002-04-29 | 2004-04-27 | Hewlett-Packard Development Company, L.P. | Fire pulses in a fluid ejection device |
| JP2004082583A (ja) * | 2002-08-28 | 2004-03-18 | Oki Data Corp | Ｌｅｄヘッドおよび画像形成装置 |
| US7989825B2 (en) * | 2003-06-26 | 2011-08-02 | Fuji Xerox Co., Ltd. | Lens-attached light-emitting element and method for manufacturing the same |
| JP2011110762A (ja) * | 2009-11-25 | 2011-06-09 | Seiko Epson Corp | 露光ヘッド、画像形成装置 |
Family Cites Families (5)
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|---|---|---|---|---|
| US5093675A (en) * | 1987-04-20 | 1992-03-03 | Canon Kabushiki Kaisha | Hand-held recording apparatus |
| EP0917213A1 (en) * | 1988-03-18 | 1999-05-19 | Nippon Sheet Glass Co., Ltd. | Self-scanning light-emitting element array |
| US5063451A (en) * | 1988-07-11 | 1991-11-05 | Canon Kabushiki Kaisha | Hand held recording apparatus with window on lower body portion for viewing recording position |
| US5600363A (en) * | 1988-12-28 | 1997-02-04 | Kyocera Corporation | Image forming apparatus having driving means at each end of array and power feeding substrate outside head housing |
| US5457488A (en) * | 1993-04-12 | 1995-10-10 | Oki Electric Industry Co., Ltd. | Method and apparatus for controlling array of light-emitting elements |
-
1996
- 1996-12-24 JP JP34347796A patent/JP3703234B2/ja not_active Expired - Fee Related
-
1997
- 1997-12-18 US US08/993,156 patent/US6002420A/en not_active Expired - Lifetime
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1215050A1 (en) * | 1999-09-20 | 2002-06-19 | Sanyo Electric Co., Ltd. | Driving ic and optical print head |
| EP1215050A4 (en) * | 1999-09-20 | 2003-03-26 | Sanyo Electric Co | INTEGRATED PILOT CIRCUIT AND OPTICAL PRINTHEAD |
| US6853396B1 (en) | 1999-09-20 | 2005-02-08 | Sanyo Electric Co., Ltd. | Driving ic and optical print head |
| JP2007168329A (ja) * | 2005-12-22 | 2007-07-05 | Kyocera Corp | 発光装置の設計支援方法、発光装置、画像形成装置および設計支援プログラム |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3703234B2 (ja) | 2005-10-05 |
| US6002420A (en) | 1999-12-14 |
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