JPH0965362A - 映像信号再生装置 - Google Patents
映像信号再生装置Info
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- JPH0965362A JPH0965362A JP7240990A JP24099095A JPH0965362A JP H0965362 A JPH0965362 A JP H0965362A JP 7240990 A JP7240990 A JP 7240990A JP 24099095 A JP24099095 A JP 24099095A JP H0965362 A JPH0965362 A JP H0965362A
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- JP
- Japan
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- frame
- color
- signal
- circuit
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- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】
【課題】 １フレーム分のＮＴＳＣ映像データからＥＩ
Ａ ＲＳ−１７０Ａ規格の４フィールド・シーケンスを
満足する色信号を作ることにより、画面上部の色を正し
く表示できるようにして回路構成の単純化を図った映像
信号再生装置を提供する。 【解決手段】 メモリ回路１に１フレームのＮＴＳＣ映
像データを５２５×９１０個のデータにして０〜５２５
×９０９番地のアドレスに格納してある。メモリコント
ローラ２により偶数フレームでは０〜５２５×９１１番
地まで読み出し、奇数フレームでは０〜５２５×９０７
番地まで読み出すことにより、各フレーム毎に基準サブ
キャリア位相を１８０°ずらして読み出し、４フィール
ド・シーケンスを満足する色信号を作ることができる。
メモリ回路１から読み出された映像データは、Ｄ／Ａ変
換器３でアナログデータに変換され増幅されて出力され
る。これにより色を正しく表示でき、簡単な回路構成に
できる。
Ａ ＲＳ−１７０Ａ規格の４フィールド・シーケンスを
満足する色信号を作ることにより、画面上部の色を正し
く表示できるようにして回路構成の単純化を図った映像
信号再生装置を提供する。 【解決手段】 メモリ回路１に１フレームのＮＴＳＣ映
像データを５２５×９１０個のデータにして０〜５２５
×９０９番地のアドレスに格納してある。メモリコント
ローラ２により偶数フレームでは０〜５２５×９１１番
地まで読み出し、奇数フレームでは０〜５２５×９０７
番地まで読み出すことにより、各フレーム毎に基準サブ
キャリア位相を１８０°ずらして読み出し、４フィール
ド・シーケンスを満足する色信号を作ることができる。
メモリ回路１から読み出された映像データは、Ｄ／Ａ変
換器３でアナログデータに変換され増幅されて出力され
る。これにより色を正しく表示でき、簡単な回路構成に
できる。
Description
【０００１】
【発明の属する技術分野】本発明は、１フレーム分のＮ
ＴＳＣ映像データしか持たない映像信号再生装置、さら
に詳しくいえば、１フレーム分のＮＴＳＣ映像データか
らＮＴＳＣ信号の４フィールドシーケンスを満足する色
信号を作ることができる映像信号再生装置に関する。
ＴＳＣ映像データしか持たない映像信号再生装置、さら
に詳しくいえば、１フレーム分のＮＴＳＣ映像データか
らＮＴＳＣ信号の４フィールドシーケンスを満足する色
信号を作ることができる映像信号再生装置に関する。
【０００２】
【従来の技術】図５にカラー・テレビジョン・スタジオ
の出力映像同期信号の規格を示す。これはＲＳ−１７０
Ａ規格としてＥＩＡが制定したもので、この同期信号規
格の主な目的は、受像機に対するより安定な映像信号
の供給，映像信号のディジタル化が進み、ＶＴＲやス
イッチャを用いた編集などで２系統以上の映像信号を組
み合わせる場合に各映像信号の連続性を保つことであ
る。そのため規格の１つにカラー・フィールド，カラー
・フレームが定義されている。これによれば、フィール
ド，からなるカラー・フレームＡ（偶数フレーム）
とフィールド，からなるカラー・フレームＢ（奇数
フレーム）が規定されている。そしてカラー・フィール
ド，，，の垂直ブランキング期間に基準サブキ
ャリア位相が規定されている。各カラー・フィールド
，，，の間の基準サブチャネルの位相ずれは９
０°となっており、これにより各フレームの間の色の連
続性が確保され色が正確に表示される。
の出力映像同期信号の規格を示す。これはＲＳ−１７０
Ａ規格としてＥＩＡが制定したもので、この同期信号規
格の主な目的は、受像機に対するより安定な映像信号
の供給，映像信号のディジタル化が進み、ＶＴＲやス
イッチャを用いた編集などで２系統以上の映像信号を組
み合わせる場合に各映像信号の連続性を保つことであ
る。そのため規格の１つにカラー・フィールド，カラー
・フレームが定義されている。これによれば、フィール
ド，からなるカラー・フレームＡ（偶数フレーム）
とフィールド，からなるカラー・フレームＢ（奇数
フレーム）が規定されている。そしてカラー・フィール
ド，，，の垂直ブランキング期間に基準サブキ
ャリア位相が規定されている。各カラー・フィールド
，，，の間の基準サブチャネルの位相ずれは９
０°となっており、これにより各フレームの間の色の連
続性が確保され色が正確に表示される。
【０００３】図６は、フロッピーディスク等の記録媒体
に記録される電子スチルカメラシステムの映像信号を再
生する回路の一例を示す図である。電子スチルカメラに
おいては、映像信号として輝度信号Ｙと色差信号Ｒ−
Ｙ，Ｂ−Ｙがメモリ回路２０に分離して格納される。再
生動作では輝度信号Ｙ，色差信号Ｒ−ＹおよびＢ−Ｙが
メモリ回路２０より同時に読み出され、Ｄ／Ａ変換器２
２，２３および２４でそれぞれアナログ信号に変換され
る。Ｄ／Ａ変換器２３および２４の出力は変調器２５で
サブキャリアＦSCによって変調され、その変調波は加算
器２６でＤ／Ａ変換器２２からの輝度信号Ｙと加算さ
れ、ビデオアンプ２７で所定レベルまで増幅した後、外
部に出力される。この映像再生回路は、Ｄ／Ａ変換しア
ナログ信号にしてからサブキャリアにより直接変調され
輝度信号に重畳しているので、上記ＲＳ−１７０Ａ規格
を満足する色情報が搭載されており色再現に問題を生ず
ることはない。
に記録される電子スチルカメラシステムの映像信号を再
生する回路の一例を示す図である。電子スチルカメラに
おいては、映像信号として輝度信号Ｙと色差信号Ｒ−
Ｙ，Ｂ−Ｙがメモリ回路２０に分離して格納される。再
生動作では輝度信号Ｙ，色差信号Ｒ−ＹおよびＢ−Ｙが
メモリ回路２０より同時に読み出され、Ｄ／Ａ変換器２
２，２３および２４でそれぞれアナログ信号に変換され
る。Ｄ／Ａ変換器２３および２４の出力は変調器２５で
サブキャリアＦSCによって変調され、その変調波は加算
器２６でＤ／Ａ変換器２２からの輝度信号Ｙと加算さ
れ、ビデオアンプ２７で所定レベルまで増幅した後、外
部に出力される。この映像再生回路は、Ｄ／Ａ変換しア
ナログ信号にしてからサブキャリアにより直接変調され
輝度信号に重畳しているので、上記ＲＳ−１７０Ａ規格
を満足する色情報が搭載されており色再現に問題を生ず
ることはない。
【０００４】
【発明が解決しようとする課題】ところで、上記映像再
生回路は、多チャネルのＤ／Ａ変換器と、サブキャリア
により変調する変調器（色差信号を色信号に変換するエ
ンコード処理回路）と、Ｙ＋Ｃ回路を有していることか
ら、映像再生に対して単純な回路構成にしたいという要
請がある。そこで、本件発明者は輝度信号と色差信号と
からなる映像信号を、色差信号から色情報に変換し輝度
信号に加算するディジタル処理を行ってメモリ回路に格
納しておき、後にＤ／Ａ変換して出力することにより、
回路構成の単純化を図ることを考えた。このように構成
すれば、Ｄ／Ａ変換器は１個となり、エンコード処理回
路を省くことが可能となる。
生回路は、多チャネルのＤ／Ａ変換器と、サブキャリア
により変調する変調器（色差信号を色信号に変換するエ
ンコード処理回路）と、Ｙ＋Ｃ回路を有していることか
ら、映像再生に対して単純な回路構成にしたいという要
請がある。そこで、本件発明者は輝度信号と色差信号と
からなる映像信号を、色差信号から色情報に変換し輝度
信号に加算するディジタル処理を行ってメモリ回路に格
納しておき、後にＤ／Ａ変換して出力することにより、
回路構成の単純化を図ることを考えた。このように構成
すれば、Ｄ／Ａ変換器は１個となり、エンコード処理回
路を省くことが可能となる。
【０００５】しかしながら、このように作られる１フレ
ーム分のＮＴＳＣ信号は、図５の同期信号規格に対応さ
せると、カラー・フレームＡの部分の情報しか持ってお
らず、カラー・フレームＢの部分のサブキャリア位相の
情報が欠如している。そのため、上記１フレーム分のＮ
ＴＳＣ信号をメモリ回路からそのまま読み出しＤ／Ａ変
換してモニタに表示させた場合には、カラー・フレーム
Ｂの部分の基準サブキャリア位相情報がないので、色信
号がロックされず画面上部の色が正しく表示されないと
いう問題が生ずる。本発明の目的は、１フレーム分のＮ
ＴＳＣ映像データからＥＩＡ ＲＳ−１７０Ａ規格の４
フィールド・シーケンスを満足する色信号を作ることに
より、画面上部の色を正しく表示できるようにして回路
構成の単純化を図った映像信号再生装置を提供すること
にある。
ーム分のＮＴＳＣ信号は、図５の同期信号規格に対応さ
せると、カラー・フレームＡの部分の情報しか持ってお
らず、カラー・フレームＢの部分のサブキャリア位相の
情報が欠如している。そのため、上記１フレーム分のＮ
ＴＳＣ信号をメモリ回路からそのまま読み出しＤ／Ａ変
換してモニタに表示させた場合には、カラー・フレーム
Ｂの部分の基準サブキャリア位相情報がないので、色信
号がロックされず画面上部の色が正しく表示されないと
いう問題が生ずる。本発明の目的は、１フレーム分のＮ
ＴＳＣ映像データからＥＩＡ ＲＳ−１７０Ａ規格の４
フィールド・シーケンスを満足する色信号を作ることに
より、画面上部の色を正しく表示できるようにして回路
構成の単純化を図った映像信号再生装置を提供すること
にある。
【０００６】
【課題を解決するための手段】前記目的を達成するため
に本発明による映像信号再生装置は、ＮＴＳＣ映像デー
タを再生する映像信号再生装置であって、前記１フレー
ム分のＮＴＳＣ映像データを０〜５２５×９０９番地ま
でのアドレスに格納するメモリ回路と、偶数フレームで
は前記メモリ回路の０〜５２５×９１１番地までのアド
レスよりデータを読み出し、奇数フレームでは前記メモ
リ回路の０〜５２５×９０７番地までのアドレスよりデ
ータを読み出すことにより１フレーム毎に基準サブキャ
リア位相を１８０°ずらして読み出すメモリコントロー
ラとを備え、ＮＴＳＣ信号の４フィールドシーケンスに
対応した色信号を作るように構成されている。また、本
発明は、１フレーム分のＮＴＳＣ映像データを再生する
映像信号再生装置であって、前記１フレーム分のＮＴＳ
Ｃ映像データを０〜５２５×９０９番地までのアドレス
に格納するメモリ回路と、前記メモリ回路の出力を２デ
ータ分遅延させるデレイ回路と、前記ＮＴＳＣ映像デー
タをアナログデータに変換するＤ／Ａ変換器と、偶数フ
レームのときは前記メモリ回路の出力に、奇数フレーム
のときは前記デレイ回路の出力に前記Ｄ／Ａ変換器の入
力を切替接続する切替器とを備え、１フレーム毎に基準
サブキャリア位相を１８０°ずらしＮＴＳＣ信号の４フ
ィールドシーケンスに対応した色信号を作るように構成
されている。
に本発明による映像信号再生装置は、ＮＴＳＣ映像デー
タを再生する映像信号再生装置であって、前記１フレー
ム分のＮＴＳＣ映像データを０〜５２５×９０９番地ま
でのアドレスに格納するメモリ回路と、偶数フレームで
は前記メモリ回路の０〜５２５×９１１番地までのアド
レスよりデータを読み出し、奇数フレームでは前記メモ
リ回路の０〜５２５×９０７番地までのアドレスよりデ
ータを読み出すことにより１フレーム毎に基準サブキャ
リア位相を１８０°ずらして読み出すメモリコントロー
ラとを備え、ＮＴＳＣ信号の４フィールドシーケンスに
対応した色信号を作るように構成されている。また、本
発明は、１フレーム分のＮＴＳＣ映像データを再生する
映像信号再生装置であって、前記１フレーム分のＮＴＳ
Ｃ映像データを０〜５２５×９０９番地までのアドレス
に格納するメモリ回路と、前記メモリ回路の出力を２デ
ータ分遅延させるデレイ回路と、前記ＮＴＳＣ映像デー
タをアナログデータに変換するＤ／Ａ変換器と、偶数フ
レームのときは前記メモリ回路の出力に、奇数フレーム
のときは前記デレイ回路の出力に前記Ｄ／Ａ変換器の入
力を切替接続する切替器とを備え、１フレーム毎に基準
サブキャリア位相を１８０°ずらしＮＴＳＣ信号の４フ
ィールドシーケンスに対応した色信号を作るように構成
されている。
【０００７】上記構成によれば、１フレーム分のＮＴＳ
Ｃ映像データから疑似的にＥＩＡＲＳ−１７０Ａ規格の
ＮＴＳＣ信号を作ることができ、色信号を正しく再現す
ることができる。
Ｃ映像データから疑似的にＥＩＡＲＳ−１７０Ａ規格の
ＮＴＳＣ信号を作ることができ、色信号を正しく再現す
ることができる。
【０００８】
【発明の実施の形態】以下、図面を参照して本発明の実
施の形態を説明する。図１は、本発明による映像信号再
生装置の実施例を示す回路ブロック図である。メモリ回
路１には、輝度信号Ｙと色信号Ｃとを加算した１フレー
ム（フィールド，）分のＮＴＳＣ信号の映像データ
が格納されている 映像データサンプルは１画面５２５ラインに対し、各ラ
イン毎４ＦSCでサンプリングして９１０個のデータを取
っており、１フレーム分のＮＴＳＣ信号の映像データ
は、合計で５２５×９１０個のデータより構成されてい
る。この映像データはメモリコントローラ２の制御の下
に読み出される。読み出されたデータは、Ｄ／Ａ変換器
３によってアナログ信号に変換され、ビデオアンプ４で
所定レベルまで増幅されて出力される。
施の形態を説明する。図１は、本発明による映像信号再
生装置の実施例を示す回路ブロック図である。メモリ回
路１には、輝度信号Ｙと色信号Ｃとを加算した１フレー
ム（フィールド，）分のＮＴＳＣ信号の映像データ
が格納されている 映像データサンプルは１画面５２５ラインに対し、各ラ
イン毎４ＦSCでサンプリングして９１０個のデータを取
っており、１フレーム分のＮＴＳＣ信号の映像データ
は、合計で５２５×９１０個のデータより構成されてい
る。この映像データはメモリコントローラ２の制御の下
に読み出される。読み出されたデータは、Ｄ／Ａ変換器
３によってアナログ信号に変換され、ビデオアンプ４で
所定レベルまで増幅されて出力される。
【０００９】図２は、図１のメモリコントローラのリセ
ット回路部分を示す図である。メモリコントローラ２
は、偶数フレーム読み出しカウンタ６，奇数フレーム読
み出しカウンタ７，Ｖカウンタ５および切替器８を有し
ている。Ｖカウンタ５の出力により切替器８が切り替え
られ、偶数フレーム読み出しカウンタ６出力と奇数フレ
ーム読み出しカウンタ７出力が選択される。偶数フレー
ム読み出しカウンタ６が後述の（５２５×９０９＋２）
番地までカウントすると、リセット信号が入力され０番
地にリセットされる。同様に奇数フレーム読み出しカウ
ンタ７が（５２５×９０９−２）番地までカウントする
と、リセット信号が入力され０番地にリセットされる。
ット回路部分を示す図である。メモリコントローラ２
は、偶数フレーム読み出しカウンタ６，奇数フレーム読
み出しカウンタ７，Ｖカウンタ５および切替器８を有し
ている。Ｖカウンタ５の出力により切替器８が切り替え
られ、偶数フレーム読み出しカウンタ６出力と奇数フレ
ーム読み出しカウンタ７出力が選択される。偶数フレー
ム読み出しカウンタ６が後述の（５２５×９０９＋２）
番地までカウントすると、リセット信号が入力され０番
地にリセットされる。同様に奇数フレーム読み出しカウ
ンタ７が（５２５×９０９−２）番地までカウントする
と、リセット信号が入力され０番地にリセットされる。
【００１０】図３は、メモリコントローラの読み出し制
御を説明するための図である。輝度信号については１フ
レーム分の映像信号（カラー・フレームＡ）のみで再生
できる。しかしながら、色信号は、１フレーム分の映像
信号だけではＥＩＡＲＳ−１７０Ａのカラー・フレーム
Ｂの基準サブキャリア位相のデータを持っていない。カ
ラー・フレームＡの基準サブキャリア位相に対しカラー
・フレームＢの基準サブキャリア位相は相互に１８０°
ずれたものとなる。ここで、データは図３（ａ）に示す
ようにサブキャリア周波数に対し４ＦSCでサンプリング
して得ているので、１サンプルデータ当たり９０°，２
サンプルデータで１８０°の位相ずれが生ずることとな
る。
御を説明するための図である。輝度信号については１フ
レーム分の映像信号（カラー・フレームＡ）のみで再生
できる。しかしながら、色信号は、１フレーム分の映像
信号だけではＥＩＡＲＳ−１７０Ａのカラー・フレーム
Ｂの基準サブキャリア位相のデータを持っていない。カ
ラー・フレームＡの基準サブキャリア位相に対しカラー
・フレームＢの基準サブキャリア位相は相互に１８０°
ずれたものとなる。ここで、データは図３（ａ）に示す
ようにサブキャリア周波数に対し４ＦSCでサンプリング
して得ているので、１サンプルデータ当たり９０°，２
サンプルデータで１８０°の位相ずれが生ずることとな
る。
【００１１】そこで図３（ｂ）（ｃ）に示すように偶数
フレーム（カラー・フレームＡ）ではメモリ回路の（５
２５×９０９＋２）番地までのアドレスを読み出し、奇
数フレームでは（５２５×９０９−２）番地までのアド
レスを読み出すことによりＥＩＡ ＲＳ−１７０Ａ規格
の４フィールド・シーケンスを作り出すことができる。
（５２５×９０９＋１）番地および（５２５×９０９＋
２）番地のアドレスには映像データは格納されていな
い。したがって、このアドレスを読み出すことによりつ
ぎの奇数フレームでは２サンプル分、すなわち１８０°
読み出しタイミングが遅延することとなる。奇数フレー
ムでは（５２５×９０９−２）番地まで読み出し、（５
２５×９０９−１）番地および（５２５×９０９）番地
のアドレスは読み出さない。この偶数フレームおよび奇
数フレームの読み出しアドレスを平均化すると、各フレ
ーム（５２５×９０９）番地まで読み出したこととな
り、この読み出し動作を繰り返すことになる。
フレーム（カラー・フレームＡ）ではメモリ回路の（５
２５×９０９＋２）番地までのアドレスを読み出し、奇
数フレームでは（５２５×９０９−２）番地までのアド
レスを読み出すことによりＥＩＡ ＲＳ−１７０Ａ規格
の４フィールド・シーケンスを作り出すことができる。
（５２５×９０９＋１）番地および（５２５×９０９＋
２）番地のアドレスには映像データは格納されていな
い。したがって、このアドレスを読み出すことによりつ
ぎの奇数フレームでは２サンプル分、すなわち１８０°
読み出しタイミングが遅延することとなる。奇数フレー
ムでは（５２５×９０９−２）番地まで読み出し、（５
２５×９０９−１）番地および（５２５×９０９）番地
のアドレスは読み出さない。この偶数フレームおよび奇
数フレームの読み出しアドレスを平均化すると、各フレ
ーム（５２５×９０９）番地まで読み出したこととな
り、この読み出し動作を繰り返すことになる。
【００１２】図４は、本発明の他の実施例を示す回路ブ
ロック図である。この例は、メモリコントローラの読み
出し制御によってＥＩＡ ＲＳ−１７０Ａ規格の４フィ
ールド・シーケンスを作り出すのではなく、メモリ回路
９からは０〜（５２５×９０９）番地のデータを繰り返
し読み出し、以降の回路によって欠けている色情報を作
り出すものである。偶数フレーム出力の場合はＶカウン
タ出力により切替器１１はメモリ回路９の出力とＤ／Ａ
変換器１２の出力を直接接続し、０〜（５２５×９０
９）番地のデータを読み出しＤ／Ａ変換器１２でアナロ
グ信号に変換してビデオアンプ１３で所定レベルまで増
幅して出力する。０〜（５２５×９０９）番地までのデ
ータを読み出すと、つぎは奇数フレーム出力となり、切
替器１１はデレイ回路１０の出力に切り替えられ、０〜
（５２５×９０９）番地までのデータが読み出される。
デレイ回路１０は、２サンプルデータ分遅延させるた
め、１８０°位相がずれて出力される。この動作を繰り
返すことにより、欠けている色情報を作りモニタに正し
い色を表示することができる。
ロック図である。この例は、メモリコントローラの読み
出し制御によってＥＩＡ ＲＳ−１７０Ａ規格の４フィ
ールド・シーケンスを作り出すのではなく、メモリ回路
９からは０〜（５２５×９０９）番地のデータを繰り返
し読み出し、以降の回路によって欠けている色情報を作
り出すものである。偶数フレーム出力の場合はＶカウン
タ出力により切替器１１はメモリ回路９の出力とＤ／Ａ
変換器１２の出力を直接接続し、０〜（５２５×９０
９）番地のデータを読み出しＤ／Ａ変換器１２でアナロ
グ信号に変換してビデオアンプ１３で所定レベルまで増
幅して出力する。０〜（５２５×９０９）番地までのデ
ータを読み出すと、つぎは奇数フレーム出力となり、切
替器１１はデレイ回路１０の出力に切り替えられ、０〜
（５２５×９０９）番地までのデータが読み出される。
デレイ回路１０は、２サンプルデータ分遅延させるた
め、１８０°位相がずれて出力される。この動作を繰り
返すことにより、欠けている色情報を作りモニタに正し
い色を表示することができる。
【００１３】
【発明の効果】以上、説明したように本発明は、１フレ
ーム分のＮＴＳＣ映像データを０〜５２５×９０９番地
までのアドレスに格納するメモリ回路と、偶数フレーム
では前記メモリ回路の０〜５２５×９１１番地までのア
ドレスよりデータを読み出し、奇数フレームでは前記メ
モリ回路の０〜５２５×９０７番地までのアドレスより
データを読み出すことにより１フレーム毎に基準サブキ
ャリア位相を１８０°ずらして読み出すメモリコントロ
ーラとを備えることにより、１フレーム分のＮＴＳＣ映
像データからＥＩＡ ＲＳ−１７０Ａ規格の４フィール
ド・シーケンスを満足する色信号を作り画面上部の色を
正しく表示できるので、回路構成の単純化を図ることが
できるという効果がある。
ーム分のＮＴＳＣ映像データを０〜５２５×９０９番地
までのアドレスに格納するメモリ回路と、偶数フレーム
では前記メモリ回路の０〜５２５×９１１番地までのア
ドレスよりデータを読み出し、奇数フレームでは前記メ
モリ回路の０〜５２５×９０７番地までのアドレスより
データを読み出すことにより１フレーム毎に基準サブキ
ャリア位相を１８０°ずらして読み出すメモリコントロ
ーラとを備えることにより、１フレーム分のＮＴＳＣ映
像データからＥＩＡ ＲＳ−１７０Ａ規格の４フィール
ド・シーケンスを満足する色信号を作り画面上部の色を
正しく表示できるので、回路構成の単純化を図ることが
できるという効果がある。
【図１】本発明による映像信号再生装置の実施例を示す
回路ブロック図である。
回路ブロック図である。
【図２】図１のメモリコントローラのリセット回路部分
を示す図である。
を示す図である。
【図３】メモリ回路から映像データを読み出す制御方法
を説明するための図である。
を説明するための図である。
【図４】本発明の他の実施例を示す回路ブロック図であ
る。
る。
【図５】ＥＩＡ ＲＳ−１７０Ａ規格のカラー・フレー
ムＡ，Ｂの垂直ブランキング期間を示す図である。
ムＡ，Ｂの垂直ブランキング期間を示す図である。
【図６】輝度信号および色差信号で構成される映像信号
をＮＳＴＣ信号に変換する回路例を示す回路ブロック図
である。
をＮＳＴＣ信号に変換する回路例を示す回路ブロック図
である。
１，９，２０…メモリ回路 ２，２１…メモリコントローラ ３，１２，２２，２３，２４…Ｄ／Ａ変換器 ４…ビデオアンプ ５…Ｖカウンタ ６…偶数フレーム読み出しカウンタ ７…奇数フレーム読み出しカウンタ ８，１１…切替器 １０…デレイ回路 １３，２７…ビデオアンプ ２５…変調器 ２６…加算器
Claims (2)
- 【請求項１】 ＮＴＳＣ映像データを再生する映像信
号再生装置であって、 １フレーム分のＮＴＳＣ映像データを０〜５２５×９０
９番地までのアドレスに格納するメモリ回路と、 偶数フレームでは前記メモリ回路の０〜５２５×９１１
番地までのアドレスよりデータを読み出し、奇数フレー
ムでは前記メモリ回路の０〜５２５×９０７番地までの
アドレスよりデータを読み出すことにより１フレーム毎
に基準サブキャリア位相を１８０°ずらして読み出すメ
モリコントローラとを備え、 ＮＴＳＣ信号の４フィールドシーケンスに対応した色信
号を作ることを特徴とする映像信号再生装置。 - 【請求項２】 ＮＴＳＣ映像データを再生する映像信
号再生装置であって、 １フレーム分のＮＴＳＣ映像データを０〜５２５×９０
９番地までのアドレスに格納するメモリ回路と、 前記メモリ回路の出力を２データ分遅延させるデレイ回
路と、 前記ＮＴＳＣ映像データをアナログデータに変換するＤ
／Ａ変換器と、 偶数フレームのときは前記メモリ回路の出力に、奇数フ
レームのときは前記デレイ回路の出力に前記Ｄ／Ａ変換
器の入力を切替接続する切替器とを備え、 １フレーム毎に基準サブキャリア位相を１８０°ずらし
ＮＴＳＣ信号の４フィールドシーケンスに対応した色信
号を作ることを特徴とする映像信号再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7240990A JPH0965362A (ja) | 1995-08-25 | 1995-08-25 | 映像信号再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7240990A JPH0965362A (ja) | 1995-08-25 | 1995-08-25 | 映像信号再生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0965362A true JPH0965362A (ja) | 1997-03-07 |
Family
ID=17067687
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7240990A Pending JPH0965362A (ja) | 1995-08-25 | 1995-08-25 | 映像信号再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0965362A (ja) |
-
1995
- 1995-08-25 JP JP7240990A patent/JPH0965362A/ja active Pending
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