JPH09281945A - Ｒｇｂビデオインターフェース装置の画像取込開始位置設定方法 - Google Patents
Ｒｇｂビデオインターフェース装置の画像取込開始位置設定方法Info
- Publication number
- JPH09281945A JPH09281945A JP8092128A JP9212896A JPH09281945A JP H09281945 A JPH09281945 A JP H09281945A JP 8092128 A JP8092128 A JP 8092128A JP 9212896 A JP9212896 A JP 9212896A JP H09281945 A JPH09281945 A JP H09281945A
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- Japan
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】
【課題】 現在までのＲＧＢビデオインターフェース装
置の画像取込開始位置設定方法は、印刷結果をオペレー
タが判断して手動調整を行っていたが、本発明は、この
判断および調整をＣＰＵが行い、自動で調整することを
課題とする。 【解決手段】 ＣＰＵが、取込信号生成回路へ遅延時間
を初期値から１周期分まで順次設定していき、その各々
での画像を画像メモリへ格納し、その結果から、ＣＰＵ
１０が、水平同期信号と取込信号の位相関係が良くなる
ような遅延時間を判断して、取込信号生成回路７へ遅延
時間を設定することにより自動で調整する。
置の画像取込開始位置設定方法は、印刷結果をオペレー
タが判断して手動調整を行っていたが、本発明は、この
判断および調整をＣＰＵが行い、自動で調整することを
課題とする。 【解決手段】 ＣＰＵが、取込信号生成回路へ遅延時間
を初期値から１周期分まで順次設定していき、その各々
での画像を画像メモリへ格納し、その結果から、ＣＰＵ
１０が、水平同期信号と取込信号の位相関係が良くなる
ような遅延時間を判断して、取込信号生成回路７へ遅延
時間を設定することにより自動で調整する。
Description
【０００１】
【発明の属する技術分野】この発明は、ＣＲＴを表示す
るアナログ信号をデジタルデータに変換してデータ格納
装置にデータを格納するＲＧＢビデオインターフェース
装置に関するものである。
るアナログ信号をデジタルデータに変換してデータ格納
装置にデータを格納するＲＧＢビデオインターフェース
装置に関するものである。
【０００２】
【従来の技術】図２は、ＲＧＢビデオインターフェース
装置の概略を示す図である。
装置の概略を示す図である。
【０００３】図において、１はホスト装置からの映像信
号が入力される映像信号入力端子であり、２はＲＧＢの
映像信号から１つを選択する選択回路であり、３は選択
回路２からの映像信号を増幅する増幅器であり、４は増
幅器３で増幅されたアナログの映像信号をデジタル信号
に変換するＡ／Ｄコンバータであり、５はＡ／Ｄコンバ
ータでデジタルに変換された映像信号を格納する画像メ
モリであり、６はホスト装置からの同期信号が入力され
る同期信号入力端子であり、７は同期信号入力端子から
の同期信号をもとに映像信号の取込を行う取込信号を生
成する取込信号生成回路であり、８は取込信号と映像信
号の位相関係を変えるため、取込信号へ遅延時間を付加
する取込信号遅延回路であり、９は画像メモリ５を制御
するためのメモリ制御回路であり、１０はＲＧＢビデオ
インターフェース装置全体を制御するＣＰＵであり、１
１は装置とオペレータとのインターフェースを行う操作
パネルである。
号が入力される映像信号入力端子であり、２はＲＧＢの
映像信号から１つを選択する選択回路であり、３は選択
回路２からの映像信号を増幅する増幅器であり、４は増
幅器３で増幅されたアナログの映像信号をデジタル信号
に変換するＡ／Ｄコンバータであり、５はＡ／Ｄコンバ
ータでデジタルに変換された映像信号を格納する画像メ
モリであり、６はホスト装置からの同期信号が入力され
る同期信号入力端子であり、７は同期信号入力端子から
の同期信号をもとに映像信号の取込を行う取込信号を生
成する取込信号生成回路であり、８は取込信号と映像信
号の位相関係を変えるため、取込信号へ遅延時間を付加
する取込信号遅延回路であり、９は画像メモリ５を制御
するためのメモリ制御回路であり、１０はＲＧＢビデオ
インターフェース装置全体を制御するＣＰＵであり、１
１は装置とオペレータとのインターフェースを行う操作
パネルである。
【０００４】次に、従来のＲＧＢビデオインターフェー
ス装置の画像取込開始位置設定方法について説明する。
ス装置の画像取込開始位置設定方法について説明する。
【０００５】まず初めに、画像の取り込みについて説明
する。画像の取り込みは、画像データをもつ映像信号の
１画素分データに周期の一致した取込信号を水平同期信
号等により生成し、その取込信号により画像の取り込み
を行う。
する。画像の取り込みは、画像データをもつ映像信号の
１画素分データに周期の一致した取込信号を水平同期信
号等により生成し、その取込信号により画像の取り込み
を行う。
【０００６】画像取込開始位置の設定とは、画像を取込
む取込信号の取込開始位置を映像信号の画像開始位置に
合わせることである。映像信号の画像開始位置は、ＣＲ
Ｔを表示する信号の中で水平方向の同期をとっている水
平同期信号の同期信号部分からＣＲＴの画素のｎ個分
（ｎはＣＲＴを表示する信号により違う）のところにあ
る。
む取込信号の取込開始位置を映像信号の画像開始位置に
合わせることである。映像信号の画像開始位置は、ＣＲ
Ｔを表示する信号の中で水平方向の同期をとっている水
平同期信号の同期信号部分からＣＲＴの画素のｎ個分
（ｎはＣＲＴを表示する信号により違う）のところにあ
る。
【０００７】よって、画像取込開始位置の設定は、水平
同期信号の同期信号部分からＣＲＴの画素のｎ個分をＣ
ＲＴの画素の１個分に周期が一致する取込信号により数
えて設定する。
同期信号の同期信号部分からＣＲＴの画素のｎ個分をＣ
ＲＴの画素の１個分に周期が一致する取込信号により数
えて設定する。
【０００８】しかし、画像取込開始位置の設定が、水平
同期信号の同期信号部分からＣＲＴの画素のｎ個分を数
えて設定しているため、水平同期信号と取込信号の位相
関係が悪い場合、例えば、取込信号が水平同期信号の同
期信号部の立上り、立下がりに一致した場合、ＣＲＴの
画素のｎ個分をｎ−１個分と数えることがある。
同期信号の同期信号部分からＣＲＴの画素のｎ個分を数
えて設定しているため、水平同期信号と取込信号の位相
関係が悪い場合、例えば、取込信号が水平同期信号の同
期信号部の立上り、立下がりに一致した場合、ＣＲＴの
画素のｎ個分をｎ−１個分と数えることがある。
【０００９】上記問題を防ぐため、このＣＲＴの画素の
ｎ個分をｎ−１個分と数えることが無いように、取込信
号と水平同期信号の位相関係を設定して、画像取込開始
位置を設定しなければならない。従来は、取込信号と水
平同期信号の位相関係を取込信号の一周期分少しずつ変
えて行き、その各々で印刷を行い、その印刷結果からＣ
ＲＴの画素のｎ個分をｎ−１個分と数えることが無いよ
うな位置を判断して、取込信号と水平同期信号の位相関
係を再設定していた。
ｎ個分をｎ−１個分と数えることが無いように、取込信
号と水平同期信号の位相関係を設定して、画像取込開始
位置を設定しなければならない。従来は、取込信号と水
平同期信号の位相関係を取込信号の一周期分少しずつ変
えて行き、その各々で印刷を行い、その印刷結果からＣ
ＲＴの画素のｎ個分をｎ−１個分と数えることが無いよ
うな位置を判断して、取込信号と水平同期信号の位相関
係を再設定していた。
【００１０】
【発明が解決しようとする課題】上述したように従来の
画像取込開始位置の設定方法では、印刷結果をオペレー
タが判断して手動調整を行っていたが、本発明は、この
判断および調整をＣＰＵが行い、自動で調整することを
課題とする。
画像取込開始位置の設定方法では、印刷結果をオペレー
タが判断して手動調整を行っていたが、本発明は、この
判断および調整をＣＰＵが行い、自動で調整することを
課題とする。
【００１１】
【発明が解決するための手段】ＣＰＵが、取込信号生成
回路へ遅延時間を初期値から１周期分まで順次設定して
いき、その各々での画像を画像メモリへ格納し、その結
果から、ＣＰＵ１０が、水平同期信号と取込信号の位相
関係が良くなるような遅延時間を判断して、取込信号生
成回路７へ遅延時間を設定することにより自動で調整す
る。
回路へ遅延時間を初期値から１周期分まで順次設定して
いき、その各々での画像を画像メモリへ格納し、その結
果から、ＣＰＵ１０が、水平同期信号と取込信号の位相
関係が良くなるような遅延時間を判断して、取込信号生
成回路７へ遅延時間を設定することにより自動で調整す
る。
【００１２】
【発明の実施の形態】以下に、この発明の実施の形態を
説明する。
説明する。
【００１３】図２は、ＲＧＢビデオインターフェース装
置の概略を示す図である。図において、１はホスト装置
からの映像信号が入力される映像信号入力端子であり、
２はＲＧＢの映像信号から１つを選択する選択回路であ
り、３は選択回路２からの映像信号を増幅する増幅器で
あり、４は増幅器３で増幅されたアナログの映像信号を
デジタル信号に変換するＡ／Ｄコンバータであり、５は
Ａ／Ｄコンバータでデジタルに変換された映像信号を格
納する画像メモリであり、６はホスト装置からの同期信
号が入力される同期信号入力端子であり、７は同期信号
入力端子からの同期信号をもとに映像信号の取込を行う
取込信号を生成する取込信号生成回路であり、８は取込
信号と映像信号の位相関係を変えるため、取込信号へ遅
延時間を付加する取込信号遅延回路であり、９は画像メ
モリ５を制御するためのメモリ制御回路であり、１０は
ＲＧＢビデオインターフェース装置全体を制御するＣＰ
Ｕであり、１１は装置とオペレータとのインターフェー
スを行う操作パネルである。
置の概略を示す図である。図において、１はホスト装置
からの映像信号が入力される映像信号入力端子であり、
２はＲＧＢの映像信号から１つを選択する選択回路であ
り、３は選択回路２からの映像信号を増幅する増幅器で
あり、４は増幅器３で増幅されたアナログの映像信号を
デジタル信号に変換するＡ／Ｄコンバータであり、５は
Ａ／Ｄコンバータでデジタルに変換された映像信号を格
納する画像メモリであり、６はホスト装置からの同期信
号が入力される同期信号入力端子であり、７は同期信号
入力端子からの同期信号をもとに映像信号の取込を行う
取込信号を生成する取込信号生成回路であり、８は取込
信号と映像信号の位相関係を変えるため、取込信号へ遅
延時間を付加する取込信号遅延回路であり、９は画像メ
モリ５を制御するためのメモリ制御回路であり、１０は
ＲＧＢビデオインターフェース装置全体を制御するＣＰ
Ｕであり、１１は装置とオペレータとのインターフェー
スを行う操作パネルである。
【００１４】図１は、画像取込開始位置設定方法をフロ
ーチャート図で示したものである。
ーチャート図で示したものである。
【００１５】図３は、水平同期信号と取込信号および取
込信号に遅延時間を設定した取込信号の関係を示したも
のである。
込信号に遅延時間を設定した取込信号の関係を示したも
のである。
【００１６】図４は、画像の左端の１列または一部を黒
以外の画像データで表示したものである。
以外の画像データで表示したものである。
【００１７】まず、取込信号に遅延時間ｔ＝０を設定す
る(図３の取込信号０）。次に、図４に示す画像を取込
み、画像データの１列または一部の和または平均を算出
した値を画像メモリ５に格納する。次に、遅延時間をｔ
＝ａ(図３の取込信号ａ）、ｔ＝２ａ(図３の取込信号２
ａ）、ｔ＝３ａ(図３の取込信号３ａ）、・・・ｔ＝Ｔ
−２ａ(図３の取込信号Ｔ−２ａ）、ｔ＝Ｔ−ａ(図３の
取込信号Ｔ−ａ）(Ｔは取込信号の周期、ａは遅延時間
変更量）に設定し各々の画像を取込み、画像データの１
列または一部の和または平均を算出した値を画像メモリ
５に格納する。次に、和または平均の各々の値から傾き
を算出する。
る(図３の取込信号０）。次に、図４に示す画像を取込
み、画像データの１列または一部の和または平均を算出
した値を画像メモリ５に格納する。次に、遅延時間をｔ
＝ａ(図３の取込信号ａ）、ｔ＝２ａ(図３の取込信号２
ａ）、ｔ＝３ａ(図３の取込信号３ａ）、・・・ｔ＝Ｔ
−２ａ(図３の取込信号Ｔ−２ａ）、ｔ＝Ｔ−ａ(図３の
取込信号Ｔ−ａ）(Ｔは取込信号の周期、ａは遅延時間
変更量）に設定し各々の画像を取込み、画像データの１
列または一部の和または平均を算出した値を画像メモリ
５に格納する。次に、和または平均の各々の値から傾き
を算出する。
【００１８】傾きの絶対値が最大値になるのは、取込信
号が水平同期信号の同期信号部の立上り・立下がりに一
致した場合である。水平同期信号の同期信号部の立上り
・立下がりと取込信号の立上りが一致した場合や近い場
合は、同期信号部の立上り・立下りを０と数えたり１と
数えたりして、画像取込開始位置までの数がｎ個分とｎ
−１個分になり、一致した場合には取込信号ｎ個分と数
える確率とｎ−１個分と数える確率が５０：５０とな
る。
号が水平同期信号の同期信号部の立上り・立下がりに一
致した場合である。水平同期信号の同期信号部の立上り
・立下がりと取込信号の立上りが一致した場合や近い場
合は、同期信号部の立上り・立下りを０と数えたり１と
数えたりして、画像取込開始位置までの数がｎ個分とｎ
−１個分になり、一致した場合には取込信号ｎ個分と数
える確率とｎ−１個分と数える確率が５０：５０とな
る。
【００１９】この場合、取り込んだ画像データの和また
は平均は、本来の値の半分で傾きは最大となり、この位
相から１／２周期のところでは本来の値となる。よっ
て、傾きの絶対値が最大値になるところから１／２周期
のところに遅延時間を設定する。
は平均は、本来の値の半分で傾きは最大となり、この位
相から１／２周期のところでは本来の値となる。よっ
て、傾きの絶対値が最大値になるところから１／２周期
のところに遅延時間を設定する。
【００２０】次に、図２、図４から図６を参照しなが
ら、他の実施の形態について説明する。
ら、他の実施の形態について説明する。
【００２１】図５は、この実施の形態の画像取込開始位
置設定方法をフローチャート図で示したものである。
置設定方法をフローチャート図で示したものである。
【００２２】図６は、水平同期信号および水平同期信号
に遅延時間を設定した水平同期信号と取込信号の関係を
示したものである。
に遅延時間を設定した水平同期信号と取込信号の関係を
示したものである。
【００２３】まず、水平同期信号に遅延時間ｔs＝０を
設定する。(図６の遅延時間を設定した取込信号０、初
期値）次に、図４に示す画像を取込み、画像データの１
列または一部の和または平均を算出した値を画像メモリ
５に格納する。次に、遅延時間をｔs＝ｂ、ｔs＝２ｂ、
ｔs＝３ｂ、・・・ｔs＝Ｔ−２ｂ、ｔs＝Ｔ−ｂ (Ｔは
取込信号の周期、ｂは遅延時間変更量）に設定し各々の
画像を取込み、画像データの１列または一部の和または
平均を算出した値を画像メモリ５に格納する。次に、和
または平均の各々の値から傾きを算出する。
設定する。(図６の遅延時間を設定した取込信号０、初
期値）次に、図４に示す画像を取込み、画像データの１
列または一部の和または平均を算出した値を画像メモリ
５に格納する。次に、遅延時間をｔs＝ｂ、ｔs＝２ｂ、
ｔs＝３ｂ、・・・ｔs＝Ｔ−２ｂ、ｔs＝Ｔ−ｂ (Ｔは
取込信号の周期、ｂは遅延時間変更量）に設定し各々の
画像を取込み、画像データの１列または一部の和または
平均を算出した値を画像メモリ５に格納する。次に、和
または平均の各々の値から傾きを算出する。
【００２４】傾きの絶対値が最大値になるのは、取込信
号が水平同期信号の同期信号部の立上り・立下がりに一
致した場合である。水平同期信号の同期信号部の立上り
・立下がりと取込信号の立上りが一致した場合や近い場
合は、同期信号部の立上り・立下りを０と数えたり１と
数えたりして、画像取込開始位置までの数がｎ個分とｎ
−１個分になり、一致した場合には取込信号ｎ個分と数
える確率とｎ−１個分と数える確率が５０：５０とな
る。
号が水平同期信号の同期信号部の立上り・立下がりに一
致した場合である。水平同期信号の同期信号部の立上り
・立下がりと取込信号の立上りが一致した場合や近い場
合は、同期信号部の立上り・立下りを０と数えたり１と
数えたりして、画像取込開始位置までの数がｎ個分とｎ
−１個分になり、一致した場合には取込信号ｎ個分と数
える確率とｎ−１個分と数える確率が５０：５０とな
る。
【００２５】この場合、取り込んだ画像データの和また
は平均は、本来の値の半分で傾きは最大となり、この位
相から１／２周期のところでは本来の値となる。よっ
て、傾きの絶対値が最大値になるところから１／２周期
のところに遅延時間を設定する。
は平均は、本来の値の半分で傾きは最大となり、この位
相から１／２周期のところでは本来の値となる。よっ
て、傾きの絶対値が最大値になるところから１／２周期
のところに遅延時間を設定する。
【００２６】
【発明の効果】本発明によれば、ＣＰＵ１０が、取込信
号生成回路７へ遅延時間を初期値から１周期分まで順次
設定していき、その各々での画像を画像メモリ５へ格納
し、その結果から、ＣＰＵ１０が、水平同期信号と取込
信号の位相関係が良くなるような遅延時間を判断して、
取込信号生成回路７へ遅延時間を設定することにしたの
で、オペレータが、信号の波形を理解して、印刷を行い
ながら設定することがなく、容易に正しい画像取込開始
位置設定方法を得ることができる。
号生成回路７へ遅延時間を初期値から１周期分まで順次
設定していき、その各々での画像を画像メモリ５へ格納
し、その結果から、ＣＰＵ１０が、水平同期信号と取込
信号の位相関係が良くなるような遅延時間を判断して、
取込信号生成回路７へ遅延時間を設定することにしたの
で、オペレータが、信号の波形を理解して、印刷を行い
ながら設定することがなく、容易に正しい画像取込開始
位置設定方法を得ることができる。
【図１】 この発明の一実施の形態を示すフローチャー
ト図
ト図
【図２】 ＲＧＢビデオインターフェース装置の概略を
示すブロック図
示すブロック図
【図３】 この発明の一実施の形態の説明図
【図４】 この発明の一実施の形態および他の実施の形
態の説明図
態の説明図
【図５】 この発明の他の実施の形態を示すフローチャ
ート図
ート図
【図６】 この発明の他の実施例の説明図
１は映像信号入力端子、２は選択回路、３は増幅器、４
はＡ／Ｄコンバータ、５は画像メモリ、６は同期信号入
力端子、７は取込信号生成回路、８は取込信号遅延回
路、９はメモリ制御回路、１０はＣＰＵ、１１は操作パ
ネル。
はＡ／Ｄコンバータ、５は画像メモリ、６は同期信号入
力端子、７は取込信号生成回路、８は取込信号遅延回
路、９はメモリ制御回路、１０はＣＰＵ、１１は操作パ
ネル。
Claims (1)
- 【請求項１】画像信号に位相の一致した画像取込開始位
置を設定して、画像信号を取り込むＲＧＢビデオインタ
ーフェース装置の画像取込開始位置設定方法において、 画像込開始位置の初期値から一周期ずらして行き、各々
の取込結果から、画像信号(水平同期信号)と取込信号の
位相を合わせる制御部を備えたことを特徴とするＲＧＢ
ビデオインターフェース装置の画像取込開始位置設定方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8092128A JPH09281945A (ja) | 1996-04-15 | 1996-04-15 | Ｒｇｂビデオインターフェース装置の画像取込開始位置設定方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8092128A JPH09281945A (ja) | 1996-04-15 | 1996-04-15 | Ｒｇｂビデオインターフェース装置の画像取込開始位置設定方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09281945A true JPH09281945A (ja) | 1997-10-31 |
Family
ID=14045807
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8092128A Withdrawn JPH09281945A (ja) | 1996-04-15 | 1996-04-15 | Ｒｇｂビデオインターフェース装置の画像取込開始位置設定方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09281945A (ja) |
-
1996
- 1996-04-15 JP JP8092128A patent/JPH09281945A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20030701 |