JPH09147101A - 画像信号処理装置および方法 - Google Patents
画像信号処理装置および方法Info
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- JPH09147101A JPH09147101A JP7328358A JP32835895A JPH09147101A JP H09147101 A JPH09147101 A JP H09147101A JP 7328358 A JP7328358 A JP 7328358A JP 32835895 A JP32835895 A JP 32835895A JP H09147101 A JPH09147101 A JP H09147101A
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Landscapes
- Image Processing (AREA)
- Picture Signal Circuits (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】
【課題】 輝度分布に応じた極め細かい輝度補正を行
う。 【解決手段】 Ａ／Ｄ変換回路２からディジタル化され
た輝度値Ｙが変換ＲＯＭ３、領域別輝度分布回路４およ
びＡＤＲＣ回路５を通過することによって、１フィール
ドまたは１フレームの全輝度値の度数分布の領域毎の符
号化がなされ、ｎビットのコードとして、出力される。
ブロック化回路７、ＡＤＲＣ回路８を通過することによ
って、注目画素を中心としてブロック化された画素に対
して符号化がなされ、ｍビットのコードとして出力され
る。ブロック化回路９、平均化回路１０を通過すること
によって、ブロック化された画素の輝度値を平均化した
後、シフトしｐビットのコードとして出力される。縮退
ＲＯＭ１１では、（ｎ＋ｍ＋ｐ）ビットからｑビットへ
縮退され、ｑビットのクラスコードに応じた係数データ
が係数ＲＯＭ１４から読み出され、積和演算される。
う。 【解決手段】 Ａ／Ｄ変換回路２からディジタル化され
た輝度値Ｙが変換ＲＯＭ３、領域別輝度分布回路４およ
びＡＤＲＣ回路５を通過することによって、１フィール
ドまたは１フレームの全輝度値の度数分布の領域毎の符
号化がなされ、ｎビットのコードとして、出力される。
ブロック化回路７、ＡＤＲＣ回路８を通過することによ
って、注目画素を中心としてブロック化された画素に対
して符号化がなされ、ｍビットのコードとして出力され
る。ブロック化回路９、平均化回路１０を通過すること
によって、ブロック化された画素の輝度値を平均化した
後、シフトしｐビットのコードとして出力される。縮退
ＲＯＭ１１では、（ｎ＋ｍ＋ｐ）ビットからｑビットへ
縮退され、ｑビットのクラスコードに応じた係数データ
が係数ＲＯＭ１４から読み出され、積和演算される。
Description
【０００１】
【発明の属する技術分野】この発明は、画像信号の輝度
値をクラス分類適応処理を用いて補正するようにした画
像信号処理装置および方法に関する。
値をクラス分類適応処理を用いて補正するようにした画
像信号処理装置および方法に関する。
【０００２】
【従来の技術】通常、画像信号処理装置において、輝度
補正は、画面内の輝度値の積分値（全受光量に相当す
る）を求め、これに応じてアンプのゲインを変化させる
ことで輝度補正を行っていた。
補正は、画面内の輝度値の積分値（全受光量に相当す
る）を求め、これに応じてアンプのゲインを変化させる
ことで輝度補正を行っていた。
【０００３】
【発明が解決しようとする課題】しかしながら、空間内
で見るとどの画素にも一定のゲインが掛かっており、暗
い部分のみを明るくしたり、明るい部分のみを暗くした
り、という細かい補正を行うことができなかった。
で見るとどの画素にも一定のゲインが掛かっており、暗
い部分のみを明るくしたり、明るい部分のみを暗くした
り、という細かい補正を行うことができなかった。
【０００４】従って、この発明の目的は、輝度分布のパ
ターン分類に応じた輝度補正と、空間内のパターン分類
および輝度値の平均値に応じた部分的な輝度補正とを行
うことによりきめの細かい輝度補正を行うことができる
画像信号処理装置および方法を提供することにある。
ターン分類に応じた輝度補正と、空間内のパターン分類
および輝度値の平均値に応じた部分的な輝度補正とを行
うことによりきめの細かい輝度補正を行うことができる
画像信号処理装置および方法を提供することにある。
【０００５】
【課題を解決するための手段】請求項１に記載の発明
は、映像信号の輝度値に対して、所定期間内の度数分布
を測定する手段と、度数分布を適当な領域に分割して領
域内の積算値を正規化することによって、度数分布をパ
ターン化して、ｎビットで表現する第１のクラス分類手
段と、予めクラス毎に最小自乗法による学習処理で求め
られた係数データが格納された係数メモリと、第１のク
ラス分類手段からのｎビットにより、係数データを係数
メモリから読み出し、線形１次結合演算によって、補正
輝度値を予測する手段とからなることを特徴とする画像
信号処理装置である。
は、映像信号の輝度値に対して、所定期間内の度数分布
を測定する手段と、度数分布を適当な領域に分割して領
域内の積算値を正規化することによって、度数分布をパ
ターン化して、ｎビットで表現する第１のクラス分類手
段と、予めクラス毎に最小自乗法による学習処理で求め
られた係数データが格納された係数メモリと、第１のク
ラス分類手段からのｎビットにより、係数データを係数
メモリから読み出し、線形１次結合演算によって、補正
輝度値を予測する手段とからなることを特徴とする画像
信号処理装置である。
【０００６】また、請求項６に記載の発明は、映像信号
の輝度値に対して、所定期間内の度数分布を測定するス
テップと、度数分布を適当な領域に分割して領域内の積
算値を正規化することによって、度数分布をパターン化
して、ｎビットで表現する第１のクラス分類のステップ
と、予めクラス毎に最小自乗法による学習処理で求めら
れた係数データが格納された係数メモリと、第１のクラ
ス分類手段からのｎビットにより、係数データを係数メ
モリから読み出し、線形１次結合演算によって、補正輝
度値を予測するステップとからなることを特徴とする画
像信号処理方法である。
の輝度値に対して、所定期間内の度数分布を測定するス
テップと、度数分布を適当な領域に分割して領域内の積
算値を正規化することによって、度数分布をパターン化
して、ｎビットで表現する第１のクラス分類のステップ
と、予めクラス毎に最小自乗法による学習処理で求めら
れた係数データが格納された係数メモリと、第１のクラ
ス分類手段からのｎビットにより、係数データを係数メ
モリから読み出し、線形１次結合演算によって、補正輝
度値を予測するステップとからなることを特徴とする画
像信号処理方法である。
【０００７】１フィールドまた１フレーム内の輝度値の
度数の積算値に対してＡＤＲＣ符号化（適応的ダイナミ
ックレンジ符号化）を行うことにより、ｎビットのコー
ドが発生し、注目画素の周辺の空間内の複数の画素、す
なわちブロック化された画素に対してＡＤＲＣ符号化を
行うことにより、ｍビットのコードが発生し、ブロック
化された画素の輝度値の平均値をシフトすることによっ
て、ｐ（＜８）ビットのコードが発生し、縮退ＲＯＭに
よって、（ｎ＋ｍ＋ｐ）ビットからｑビットに減少させ
たクラスコードが発生し、このクラスコードに応じた係
数データが読み出され、その係数データを用いた線形１
次結合式によって、補正された輝度値が生成される。
度数の積算値に対してＡＤＲＣ符号化（適応的ダイナミ
ックレンジ符号化）を行うことにより、ｎビットのコー
ドが発生し、注目画素の周辺の空間内の複数の画素、す
なわちブロック化された画素に対してＡＤＲＣ符号化を
行うことにより、ｍビットのコードが発生し、ブロック
化された画素の輝度値の平均値をシフトすることによっ
て、ｐ（＜８）ビットのコードが発生し、縮退ＲＯＭに
よって、（ｎ＋ｍ＋ｐ）ビットからｑビットに減少させ
たクラスコードが発生し、このクラスコードに応じた係
数データが読み出され、その係数データを用いた線形１
次結合式によって、補正された輝度値が生成される。
【０００８】
【発明の実施の形態】以下、この発明の一実施例につい
て図面を参照して説明する。図１において、１で示す入
力端子からの画像信号の内、輝度信号ＹがＡ／Ｄ変換器
２によってアナログ信号からディジタル信号に変換され
る。このＡ／Ｄ変換器２では、例えば１３．５ＭHzのク
ロックでサンプリングが行われた場合、画像のサイズ
は、１フレームあたり、横７２０画素×縦４８０ライン
程度となる。ディジタル信号に変換された輝度信号は、
Ａ／Ｄ変換器２から変換ＲＯＭ３および遅延回路６へ供
給される。
て図面を参照して説明する。図１において、１で示す入
力端子からの画像信号の内、輝度信号ＹがＡ／Ｄ変換器
２によってアナログ信号からディジタル信号に変換され
る。このＡ／Ｄ変換器２では、例えば１３．５ＭHzのク
ロックでサンプリングが行われた場合、画像のサイズ
は、１フレームあたり、横７２０画素×縦４８０ライン
程度となる。ディジタル信号に変換された輝度信号は、
Ａ／Ｄ変換器２から変換ＲＯＭ３および遅延回路６へ供
給される。
【０００９】変換ＲＯＭ３では、供給された輝度値と領
域の対応付けが行われる。具体的には、８ビット（０〜
２５５）からなる輝度値が入力され、この輝度値をある
複数の領域、例えばｓ個の領域に分ける働きが変換ＲＯ
Ｍ３では行われる。また、この変換ＲＯＭ３によって分
けられた複数の領域毎に、領域別輝度分布回路４では、
例えば１フィールドまたは１フレーム内の度数の積算が
行われる。その積算値は、ＡＤＲＣ回路５へ供給され
る。ＡＤＲＣ回路５では、後述するように、領域毎に、
例えばａビットの量子化が行われ、トータルｎビット
（ｎ＝ｓ×ａ）のコードが発生する。このｎビットのコ
ードは、ＡＤＲＣ回路５から縮退ＲＯＭ１１へ供給され
る。
域の対応付けが行われる。具体的には、８ビット（０〜
２５５）からなる輝度値が入力され、この輝度値をある
複数の領域、例えばｓ個の領域に分ける働きが変換ＲＯ
Ｍ３では行われる。また、この変換ＲＯＭ３によって分
けられた複数の領域毎に、領域別輝度分布回路４では、
例えば１フィールドまたは１フレーム内の度数の積算が
行われる。その積算値は、ＡＤＲＣ回路５へ供給され
る。ＡＤＲＣ回路５では、後述するように、領域毎に、
例えばａビットの量子化が行われ、トータルｎビット
（ｎ＝ｓ×ａ）のコードが発生する。このｎビットのコ
ードは、ＡＤＲＣ回路５から縮退ＲＯＭ１１へ供給され
る。
【００１０】ここで、変換ＲＯＭ３、領域別輝度分布回
路４およびＡＤＲＣ回路５の動作を図２を用いて説明す
る。図２Ａに示すように、例えば１フィールドまたは１
フレーム内の輝度値の度数分布を計数しようとする場
合、本来ならば２５６レベル毎の度数分布を計数する。
しかしながら、図２Ｂに示すように、輝度レベルを、例
えば適当なしきい値でもってｓ個の領域に分割し、その
領域番号と入力輝度値を対応付けるＲＯＭを挿入するこ
とで任意の領域分けを行う。この領域分けは、単純に均
等分割するか、不均等分割するか、間引くかあるいは領
域のオーバーラップを認めるか等、種々のバリエーショ
ンを試すことができる。
路４およびＡＤＲＣ回路５の動作を図２を用いて説明す
る。図２Ａに示すように、例えば１フィールドまたは１
フレーム内の輝度値の度数分布を計数しようとする場
合、本来ならば２５６レベル毎の度数分布を計数する。
しかしながら、図２Ｂに示すように、輝度レベルを、例
えば適当なしきい値でもってｓ個の領域に分割し、その
領域番号と入力輝度値を対応付けるＲＯＭを挿入するこ
とで任意の領域分けを行う。この領域分けは、単純に均
等分割するか、不均等分割するか、間引くかあるいは領
域のオーバーラップを認めるか等、種々のバリエーショ
ンを試すことができる。
【００１１】図２Ｃは、ＡＤＲＣ回路５が１ビットのＡ
ＤＲＣを行い、このＡＤＲＣ回路５が６ビットのコード
を出力する一例である。このコードは、いわゆる輝度の
度数分布をパターン化したもので、これを見ることで輝
度分布が暗い方か、明るい方かに偏っているかどうかを
判定することができる。
ＤＲＣを行い、このＡＤＲＣ回路５が６ビットのコード
を出力する一例である。このコードは、いわゆる輝度の
度数分布をパターン化したもので、これを見ることで輝
度分布が暗い方か、明るい方かに偏っているかどうかを
判定することができる。
【００１２】一方、遅延回路６において、上述の度数分
布のパターンコードを生成するまでの時間（１フィール
ドまたは１フレーム＋α）だけ、遅延が行われ、その出
力は、ブロック化回路７および９、さらに遅延回路１２
へ供給される。ブロック化回路７では、補正しようとす
る注目画素の周辺の空間内の複数の画素が選択され、ブ
ロック化される。そのブロック化された画素は、ＡＤＲ
Ｃ回路８へ供給される。
布のパターンコードを生成するまでの時間（１フィール
ドまたは１フレーム＋α）だけ、遅延が行われ、その出
力は、ブロック化回路７および９、さらに遅延回路１２
へ供給される。ブロック化回路７では、補正しようとす
る注目画素の周辺の空間内の複数の画素が選択され、ブ
ロック化される。そのブロック化された画素は、ＡＤＲ
Ｃ回路８へ供給される。
【００１３】ＡＤＲＣ回路８では、後述するように、ブ
ロック化された画素から最大値および最小値が選択さ
れ、各画素が再量子化されｍビットのコードが発生され
る。このコードは、いわゆる空間の輝度の変化の様子を
パターン化したものである。このコードによるクラス分
類は、輝度補正そのものより、Ｓ／Ｎ比の改善、解像度
の改善等に効果をもたらす。
ロック化された画素から最大値および最小値が選択さ
れ、各画素が再量子化されｍビットのコードが発生され
る。このコードは、いわゆる空間の輝度の変化の様子を
パターン化したものである。このコードによるクラス分
類は、輝度補正そのものより、Ｓ／Ｎ比の改善、解像度
の改善等に効果をもたらす。
【００１４】ブロック化回路９において、補正しようと
する注目画素の周辺の空間内の複数の画素が選択され、
ブロック化される。このブロック化回路９においてなさ
れるブロック化と、ブロック化回路７においてなされる
ブロック化とは、異なっても良い。ブロック化された画
素は、ブロック化回路９から平均化回路１０へ供給され
る。平均化回路１０では、注目画素付近の輝度の平均値
が算出され、算出された平均値は、シフトされ、ｐ（＜
８）ビットに量子化される。
する注目画素の周辺の空間内の複数の画素が選択され、
ブロック化される。このブロック化回路９においてなさ
れるブロック化と、ブロック化回路７においてなされる
ブロック化とは、異なっても良い。ブロック化された画
素は、ブロック化回路９から平均化回路１０へ供給され
る。平均化回路１０では、注目画素付近の輝度の平均値
が算出され、算出された平均値は、シフトされ、ｐ（＜
８）ビットに量子化される。
【００１５】このように、ブロック化された各画素の輝
度の平均値が算出され、すなわち輝度レベルをクラス分
類の１つとすることで、レベル方向での補正の仕方に変
化を持たせることができる。例えば、明るい部分や暗い
部分のみを補正したり、γ特性を考慮した補正を行うこ
とが可能となる。また、輝度レベルの平均化による作用
は、輝度補正が過敏に利くのを防止する役割も果たす。
度の平均値が算出され、すなわち輝度レベルをクラス分
類の１つとすることで、レベル方向での補正の仕方に変
化を持たせることができる。例えば、明るい部分や暗い
部分のみを補正したり、γ特性を考慮した補正を行うこ
とが可能となる。また、輝度レベルの平均化による作用
は、輝度補正が過敏に利くのを防止する役割も果たす。
【００１６】以上の説明で、３種類のクラス分類コード
が生成されたが、これを単純に組み合わると分類数が膨
大になり、後述する係数ＲＯＭの容量が膨大になる。そ
こでＡＤＲＣ回路５からのｎビット、ＡＤＲＣ回路８か
らのｍビットおよび平均化回路１０からのｐビットは、
縮退ＲＯＭ１１へ供給され、縮退ＲＯＭ１１において、
供給された各ビット数を縮退させる。具体的には、縮退
ＲＯＭ１１では、クラスを縮退させるために、（ｎ＋ｍ
＋ｐ）ビットからｑビットに減少させたクラスコード
（インデックス）が発生される。
が生成されたが、これを単純に組み合わると分類数が膨
大になり、後述する係数ＲＯＭの容量が膨大になる。そ
こでＡＤＲＣ回路５からのｎビット、ＡＤＲＣ回路８か
らのｍビットおよび平均化回路１０からのｐビットは、
縮退ＲＯＭ１１へ供給され、縮退ＲＯＭ１１において、
供給された各ビット数を縮退させる。具体的には、縮退
ＲＯＭ１１では、クラスを縮退させるために、（ｎ＋ｍ
＋ｐ）ビットからｑビットに減少させたクラスコード
（インデックス）が発生される。
【００１７】なお、縮退の方法について、ここでは詳細
を述べないが、（ｎ＋ｍ＋ｐ）ビットで学習した全クラ
スに対応する係数組から、ベクトル量子化的手法とし
て、係数間ノルムの小さいものをまとめて縮退させる方
法などを使用するものとする。すなわち、２つの係数組
の間で、対応する係数の距離（係数間ノルム）を求め、
これに基づいて、係数の組をまとめる。
を述べないが、（ｎ＋ｍ＋ｐ）ビットで学習した全クラ
スに対応する係数組から、ベクトル量子化的手法とし
て、係数間ノルムの小さいものをまとめて縮退させる方
法などを使用するものとする。すなわち、２つの係数組
の間で、対応する係数の距離（係数間ノルム）を求め、
これに基づいて、係数の組をまとめる。
【００１８】このように、縮退ＲＯＭ１１から最終的に
ｑビットのクラスコードが発生し、そのｑビットのクラ
スコードは、係数ＲＯＭ１４1 〜１４N へ供給される。
係数ＲＯＭ１４1 〜１４N では、供給されたクラスコー
ドでアドレッシングされ、係数データが読み出される。
読み出された係数データは、それぞれ乗算器１５1 〜１
５N へ供給される。
ｑビットのクラスコードが発生し、そのｑビットのクラ
スコードは、係数ＲＯＭ１４1 〜１４N へ供給される。
係数ＲＯＭ１４1 〜１４N では、供給されたクラスコー
ドでアドレッシングされ、係数データが読み出される。
読み出された係数データは、それぞれ乗算器１５1 〜１
５N へ供給される。
【００１９】遅延合わせが行われる遅延回路１２の出力
がブロック化回路１３へ供給され、そのブロック化回路
１３では、注目画素の周辺の複数の画素がブロック化さ
れる。ブロック化された各画素値は、乗算器１５1 〜１
５N へ供給される。乗算器１５1 〜１５N では、係数Ｒ
ＯＭ１４1 〜１４N からの係数データと、ブロック化さ
れた各画素値が乗算され、その乗算出力は、加算器１６
へ供給される。加算器１６では、乗算器１５1 〜１５N
からの乗算出力が加算される。
がブロック化回路１３へ供給され、そのブロック化回路
１３では、注目画素の周辺の複数の画素がブロック化さ
れる。ブロック化された各画素値は、乗算器１５1 〜１
５N へ供給される。乗算器１５1 〜１５N では、係数Ｒ
ＯＭ１４1 〜１４N からの係数データと、ブロック化さ
れた各画素値が乗算され、その乗算出力は、加算器１６
へ供給される。加算器１６では、乗算器１５1 〜１５N
からの乗算出力が加算される。
【００２０】すなわち、乗算器１５1 〜１５N および加
算器１６によって、積和演算することで、輝度補正値の
予測が行われる。その予測値は、Ｄ／Ａ変換回路１７に
おいて、Ｄ／Ａ変換され、補正後の輝度値Ｙ´として出
力端子１８から取り出される。
算器１６によって、積和演算することで、輝度補正値の
予測が行われる。その予測値は、Ｄ／Ａ変換回路１７に
おいて、Ｄ／Ａ変換され、補正後の輝度値Ｙ´として出
力端子１８から取り出される。
【００２１】ここで、ＡＤＲＣ回路５またはＡＤＲＣ回
路８として使用される構成の一例を図３に示し説明す
る。入力端子２１からブロック化されたデータが供給さ
れる。供給されたデータは、最大値検出回路２２、最小
値検出回路２３および遅延回路２５へ供給される。最大
値検出回路２２において、ブロック内の画素値の最大と
なる値が検出され、最小値検出回路２３において、ブロ
ック内の画素値の最小となる値が検出される。減算器２
４では、最大値から最小値が減算され、そのブロックの
ダイナミックレンジＤＲが算出される。算出されたダイ
ナミックレンジＤＲは、適応再量子化回路２７へ供給さ
れる。
路８として使用される構成の一例を図３に示し説明す
る。入力端子２１からブロック化されたデータが供給さ
れる。供給されたデータは、最大値検出回路２２、最小
値検出回路２３および遅延回路２５へ供給される。最大
値検出回路２２において、ブロック内の画素値の最大と
なる値が検出され、最小値検出回路２３において、ブロ
ック内の画素値の最小となる値が検出される。減算器２
４では、最大値から最小値が減算され、そのブロックの
ダイナミックレンジＤＲが算出される。算出されたダイ
ナミックレンジＤＲは、適応再量子化回路２７へ供給さ
れる。
【００２２】遅延回路２５では、最大値検出回路２２お
よび最小値検出回路２３がそれぞれ検出にかかる時間遅
延が行われ、１画素ずつ出力される。減算器２６では、
ブロック化された各画素から最小値が減算され、その減
算値は、適応再量子化回路２７へ供給される。適応再量
子化回路２７では、ダイナミックレンジＤＲに応じた所
定の量子化ステップ幅を用いて、減算値の量子化を画素
毎に行う。並列化回路２８では、量子化された画素がブ
ロック単位で並列化され、出力端子２９からコード化デ
ータとして出力される。
よび最小値検出回路２３がそれぞれ検出にかかる時間遅
延が行われ、１画素ずつ出力される。減算器２６では、
ブロック化された各画素から最小値が減算され、その減
算値は、適応再量子化回路２７へ供給される。適応再量
子化回路２７では、ダイナミックレンジＤＲに応じた所
定の量子化ステップ幅を用いて、減算値の量子化を画素
毎に行う。並列化回路２８では、量子化された画素がブ
ロック単位で並列化され、出力端子２９からコード化デ
ータとして出力される。
【００２３】ここで、係数ＲＯＭに記憶される係数デー
タを生成する学習のためのブロック図を図４に示す。入
力端子１から供給された輝度信号Ｙは、Ａ／Ｄ変換回路
２へ供給され、Ａ／Ｄ変換回路２では、例えば１３．５
ＭHzでサンプリングされ、変換ＲＯＭ３および遅延回路
６へ出力される。変換ＲＯＭ３では、上述したように供
給された輝度値がある複数の領域、例えばｓ個の領域に
分けられる。そして、領域別輝度分布回路４では、分け
られたｓ個の領域毎に、例えば１フィールドまたは１フ
レーム内の度数の乗算が行われる。ＡＤＲＣ回路５で
は、例えばａビットの量子化が行われ、トータルｎビッ
ト（ｎ＝ｓ×ａ）のコードが発生する。このｎビットの
コードは、ＡＤＲＣ回路５から縮退ＲＯＭ１１へ供給さ
れる。
タを生成する学習のためのブロック図を図４に示す。入
力端子１から供給された輝度信号Ｙは、Ａ／Ｄ変換回路
２へ供給され、Ａ／Ｄ変換回路２では、例えば１３．５
ＭHzでサンプリングされ、変換ＲＯＭ３および遅延回路
６へ出力される。変換ＲＯＭ３では、上述したように供
給された輝度値がある複数の領域、例えばｓ個の領域に
分けられる。そして、領域別輝度分布回路４では、分け
られたｓ個の領域毎に、例えば１フィールドまたは１フ
レーム内の度数の乗算が行われる。ＡＤＲＣ回路５で
は、例えばａビットの量子化が行われ、トータルｎビッ
ト（ｎ＝ｓ×ａ）のコードが発生する。このｎビットの
コードは、ＡＤＲＣ回路５から縮退ＲＯＭ１１へ供給さ
れる。
【００２４】遅延回路６では、ｎビットのコードが生成
されるまでの時間（１フィールドまたは１フレーム＋
α）だけ、遅延が行われ、その出力は、ブロック化回路
７および９、さらに遅延回路１２へ供給される。ブロッ
ク化回路７では、注目画素の周辺の空間内の複数の画素
が選択され、ブロック化される。そのブロック化された
画素は、ＡＤＲＣ回路８へ供給される。ＡＤＲＣ回路８
では、ブロック化された画素からｍビットのコードが発
生され、縮退ＲＯＭ１１へ供給される。
されるまでの時間（１フィールドまたは１フレーム＋
α）だけ、遅延が行われ、その出力は、ブロック化回路
７および９、さらに遅延回路１２へ供給される。ブロッ
ク化回路７では、注目画素の周辺の空間内の複数の画素
が選択され、ブロック化される。そのブロック化された
画素は、ＡＤＲＣ回路８へ供給される。ＡＤＲＣ回路８
では、ブロック化された画素からｍビットのコードが発
生され、縮退ＲＯＭ１１へ供給される。
【００２５】ブロック化回路９では、注目画素の周辺の
空間内の複数の画素が選択され、ブロック化される。上
述したように、ブロック化回路７とのブロック化とは異
なっても良い。平均化回路１０では、注目画素付近の輝
度の平均値が算出され、算出された平均値は、シフトさ
れ、ｐ（＜８）ビットに量子化され、縮退ＲＯＭ１１へ
供給される。
空間内の複数の画素が選択され、ブロック化される。上
述したように、ブロック化回路７とのブロック化とは異
なっても良い。平均化回路１０では、注目画素付近の輝
度の平均値が算出され、算出された平均値は、シフトさ
れ、ｐ（＜８）ビットに量子化され、縮退ＲＯＭ１１へ
供給される。
【００２６】縮退ＲＯＭ１１では、上述するように、ク
ラスを縮退させるために、（ｎ＋ｍ＋ｐ）ビットからｑ
ビットに減少させたクラスコード（インデックス）が発
生される。このように、縮退ＲＯＭ１１から最終的にｑ
ビットのクラスコードが発生し、そのｑビットのクラス
コードは、学習回路３３へへ供給される。
ラスを縮退させるために、（ｎ＋ｍ＋ｐ）ビットからｑ
ビットに減少させたクラスコード（インデックス）が発
生される。このように、縮退ＲＯＭ１１から最終的にｑ
ビットのクラスコードが発生し、そのｑビットのクラス
コードは、学習回路３３へへ供給される。
【００２７】遅延によるタイミング合わせが行われる遅
延回路１２の出力がブロック化回路１３へ供給され、そ
のブロック化回路１３では、注目画素の周辺の複数の画
素がブロック化される。ブロック化された各画素値が学
習回路３３へ供給される。
延回路１２の出力がブロック化回路１３へ供給され、そ
のブロック化回路１３では、注目画素の周辺の複数の画
素がブロック化される。ブロック化された各画素値が学
習回路３３へ供給される。
【００２８】そして、入力端子３１から教師用の映像信
号の対応する画素の輝度信号Ｙが入力される。この教師
用の輝度信号Ｙには、プロのカメラマンが撮影した映像
信号、または照明条件の良い映像信号が使用され、また
動画のみとは限らず静止画を使用しても良い。その教師
用の輝度信号Ｙは、Ａ／Ｄ変換回路３２において、アナ
ログ信号からディジタル信号へ変換され、学習回路３３
に入力される。学習回路３３では、ｎタップの線形一時
結合モデルを形成し、その各係数データを学習回路３３
で算出する。算出された各係数データは、出力端子３４
から取り出され、係数ＲＯＭへ格納される。また、学習
回路３３は、以下に述べる最小自乗法にてクラス毎に係
数データを学習するものである。
号の対応する画素の輝度信号Ｙが入力される。この教師
用の輝度信号Ｙには、プロのカメラマンが撮影した映像
信号、または照明条件の良い映像信号が使用され、また
動画のみとは限らず静止画を使用しても良い。その教師
用の輝度信号Ｙは、Ａ／Ｄ変換回路３２において、アナ
ログ信号からディジタル信号へ変換され、学習回路３３
に入力される。学習回路３３では、ｎタップの線形一時
結合モデルを形成し、その各係数データを学習回路３３
で算出する。算出された各係数データは、出力端子３４
から取り出され、係数ＲＯＭへ格納される。また、学習
回路３３は、以下に述べる最小自乗法にてクラス毎に係
数データを学習するものである。
【００２９】学習の方法として、多数の補正対象入力画
素と教師用の画像の値との関係を求める方法として、最
小自乗法を採用した。まず、上述した値の間に線形１次
結合の関係があると仮定し、以下に線形一次結合モデル
を示す。
素と教師用の画像の値との関係を求める方法として、最
小自乗法を採用した。まず、上述した値の間に線形１次
結合の関係があると仮定し、以下に線形一次結合モデル
を示す。
【００３０】線形一次結合モデル：（観測方程式） ＸＷ＝Ｙ （１）
【数１】
【００３１】最小自乗法による解放：（残差方程式）
【数２】
【００３２】式（３）から、各ｗi 最確値を見いだすに
は、
は、
【数３】 を最小にする条件、すなわち
【００３３】
【数４】 なる、Ｎ個の条件を入れてこれを満足するｗ1 、ｗ2 、
・・・、ｗN を見いだせばよい。式（３）より、
・・・、ｗN を見いだせばよい。式（３）より、
【００３４】
【数５】 となり、式（４）条件をｉ＝１，２，・・・，Ｎについ
て立てればそれぞれ、
て立てればそれぞれ、
【００３５】
【数６】 が得られる。ここで、式（３）および式（６）から次式
の正規方程式が得られる。
の正規方程式が得られる。
【００３６】
【数７】 これは、ちょうど未知数の数Ｎ個だけある連立方程式で
あるから、これより最確値たる各ｗi を求めることがで
きる。
あるから、これより最確値たる各ｗi を求めることがで
きる。
【００３７】正確には、式（７）でｗi にかかる
【数８】 のマトリクスが正則であれば解くことができる。（ただ
し、ｋ＝１，２，・・・，Ｎ、ｌ＝１，２，・・・，
Ｎ）実際には、Gauss-Jordanの消去法（掃き出し法）を
用いて連立方程式を解くことになる。
し、ｋ＝１，２，・・・，Ｎ、ｌ＝１，２，・・・，
Ｎ）実際には、Gauss-Jordanの消去法（掃き出し法）を
用いて連立方程式を解くことになる。
【００３８】次に、最小自乗法の演算を行うハードウェ
アのブロック図を図５に示す。図４の学習のブロック図
において、補正対象の画素を中心としてブロックの画素
値と対応する教師用の画素値が入力されると共に、クラ
スコード（インデックス）が入力される。最小自乗法の
回路は、大きく分けて正規方程式生成回路４１とＣＰＵ
４２からなり、その正規方程式生成回路４１は、乗算器
アレイ４３、加算メモリ４４およびデコード部４５から
なる。
アのブロック図を図５に示す。図４の学習のブロック図
において、補正対象の画素を中心としてブロックの画素
値と対応する教師用の画素値が入力されると共に、クラ
スコード（インデックス）が入力される。最小自乗法の
回路は、大きく分けて正規方程式生成回路４１とＣＰＵ
４２からなり、その正規方程式生成回路４１は、乗算器
アレイ４３、加算メモリ４４およびデコード部４５から
なる。
【００３９】ＣＰＵ４２は、係数データを求めるため、
例えば掃き出し法の演算を行うＣＰＵからなる。乗算器
アレイ４３には、注目画素位置に対して１組のメモリ
（またはレジスタ）が存在し、加算メモリ４４には、ク
ラスの数だけ組のメモリ（またはレジスタ）が存在す
る。また、デコード部４５では、供給されるクラスコー
ド（インデックス）がデコードされる。
例えば掃き出し法の演算を行うＣＰＵからなる。乗算器
アレイ４３には、注目画素位置に対して１組のメモリ
（またはレジスタ）が存在し、加算メモリ４４には、ク
ラスの数だけ組のメモリ（またはレジスタ）が存在す
る。また、デコード部４５では、供給されるクラスコー
ド（インデックス）がデコードされる。
【００４０】乗算器アレイ４３について、図６を用いて
説明する。補正対象の画素を中心としてブロックの画素
値と対応する教師用の画素値δｙは、正規方程式回路４
１の乗算器アレイ４３において、図６に示すように各要
素どうしの乗算が行われ、その結果が加算メモリ４４へ
供給される。
説明する。補正対象の画素を中心としてブロックの画素
値と対応する教師用の画素値δｙは、正規方程式回路４
１の乗算器アレイ４３において、図６に示すように各要
素どうしの乗算が行われ、その結果が加算メモリ４４へ
供給される。
【００４１】そして、加算メモリ４４について、図７を
用いて説明する。加算メモリ４４は、加算器アレイ５１
およびメモリ（またはレジスタ）アレイ５２1 〜５２N
から構成される。乗算器アレイ４３からの結果とメモリ
（またはレジスタ）アレイ５２からの出力が供給され、
その加算結果がメモリ（またはレジスタ）アレイ５２に
出力される。どのメモリ（またはレジスタ）アレイ５２
1 〜５２N が選択されるかは、クラスコード（インデッ
クス）がデコード部４５でデコードされることで一意に
決定される。つまり、インデックスによって決定される
クラス毎にメモリ（またはレジスタ）アレイ５２が選択
されて、積和演算の結果がインデックスによって決定さ
れたメモリ（またはレジスタ）アレイ５２に更新され、
記憶される。
用いて説明する。加算メモリ４４は、加算器アレイ５１
およびメモリ（またはレジスタ）アレイ５２1 〜５２N
から構成される。乗算器アレイ４３からの結果とメモリ
（またはレジスタ）アレイ５２からの出力が供給され、
その加算結果がメモリ（またはレジスタ）アレイ５２に
出力される。どのメモリ（またはレジスタ）アレイ５２
1 〜５２N が選択されるかは、クラスコード（インデッ
クス）がデコード部４５でデコードされることで一意に
決定される。つまり、インデックスによって決定される
クラス毎にメモリ（またはレジスタ）アレイ５２が選択
されて、積和演算の結果がインデックスによって決定さ
れたメモリ（またはレジスタ）アレイ５２に更新され、
記憶される。
【００４２】なお、各々のアレイの位置は、正規方程式
（７）のｗi にかかる
（７）のｗi にかかる
【数９】 の位置に対応する。正規方程式（７）を見てわかるよう
に右上の項を反転すれば左下と同じものになるため、各
アレイは三角形の形状をしている。
に右上の項を反転すれば左下と同じものになるため、各
アレイは三角形の形状をしている。
【００４３】以上のようにして、ある一定期間の間にク
ラス毎に積和演算が行われて画素位置毎のさらにクラス
毎の正規方程式が生成される。クラス毎の正規方程式の
各項の結果は、それぞれのクラスに対応するメモリ（ま
たはレジスタ）アレイに記憶されており、次にそれらの
クラス毎の正規方程式の各項が掃き出し法の計算回路に
供給される。この計算はＣＰＵ４２によって行われる。
計算された係数データの組は、図１に示す係数ＲＯＭ１
４で構成される係数テーブルに書き込まれて使用され
る。
ラス毎に積和演算が行われて画素位置毎のさらにクラス
毎の正規方程式が生成される。クラス毎の正規方程式の
各項の結果は、それぞれのクラスに対応するメモリ（ま
たはレジスタ）アレイに記憶されており、次にそれらの
クラス毎の正規方程式の各項が掃き出し法の計算回路に
供給される。この計算はＣＰＵ４２によって行われる。
計算された係数データの組は、図１に示す係数ＲＯＭ１
４で構成される係数テーブルに書き込まれて使用され
る。
【００４４】ここで、この発明の他の実施例を図８のブ
ロック図を用いて説明する。入力端子１から供給された
輝度信号Ｙは、Ａ／Ｄ変換回路２へ供給され、Ａ／Ｄ変
換回路２では、例えば１３．５ＭHzでサンプリングさ
れ、平均値／標準偏差回路５５および遅延回路６へ出力
される。平均値／標準偏差回路５５では、供給された輝
度値の例えば１フィールドまたは１フレーム当りの平均
値および標準偏差が求められる。平均値／標準偏差回路
５５において、輝度値毎の度数分布を求めるためのテー
ブルを持ち、１フィールド期間または１フレーム期間に
乗算した度数分布から、図９に示すように輝度の平均値
が算出されると共に、標準偏差も算出される。また、式
（８）には、輝度の平均値を算出する計算式を示し、式
（９）には、標準偏差を算出する計算式を示す。
ロック図を用いて説明する。入力端子１から供給された
輝度信号Ｙは、Ａ／Ｄ変換回路２へ供給され、Ａ／Ｄ変
換回路２では、例えば１３．５ＭHzでサンプリングさ
れ、平均値／標準偏差回路５５および遅延回路６へ出力
される。平均値／標準偏差回路５５では、供給された輝
度値の例えば１フィールドまたは１フレーム当りの平均
値および標準偏差が求められる。平均値／標準偏差回路
５５において、輝度値毎の度数分布を求めるためのテー
ブルを持ち、１フィールド期間または１フレーム期間に
乗算した度数分布から、図９に示すように輝度の平均値
が算出されると共に、標準偏差も算出される。また、式
（８）には、輝度の平均値を算出する計算式を示し、式
（９）には、標準偏差を算出する計算式を示す。
【００４５】 平均値＝Σ（輝度値×度数）／全度数 （８） 標準偏差＝√（Σ（輝度値−平均値）2 ×度数）／全度数） （９）
【００４６】量子化回路５６では、算出された平均値お
よび標準偏差がそれぞれａビット、ｂビットで量子化さ
れて、トータルｎビット（ｎ＝ａ＋ｂ）のコードが発生
される。このｎビットのコードが量子化回路５６から縮
退ＲＯＭ１１へ供給される。さらに、このｎビットのコ
ードは、いわゆる輝度分布をパターン化したもので、こ
れを見ることで輝度分布が暗い方か、明るい方かに偏っ
ているかどうか、また、輝度分布が平坦か急峻かを判定
することができる。
よび標準偏差がそれぞれａビット、ｂビットで量子化さ
れて、トータルｎビット（ｎ＝ａ＋ｂ）のコードが発生
される。このｎビットのコードが量子化回路５６から縮
退ＲＯＭ１１へ供給される。さらに、このｎビットのコ
ードは、いわゆる輝度分布をパターン化したもので、こ
れを見ることで輝度分布が暗い方か、明るい方かに偏っ
ているかどうか、また、輝度分布が平坦か急峻かを判定
することができる。
【００４７】遅延回路６では、ｎビットのコードが生成
されるまでの時間（１フィールドまたは１フレーム＋
α）だけ、遅延が行われ、その出力は、ブロック化回路
７および９、さらに遅延回路１２へ供給される。ブロッ
ク化回路７では、注目画素の周辺の空間内の複数の画素
が選択され、ブロック化される。そのブロック化された
画素は、ＡＤＲＣ回路８へ供給される。ＡＤＲＣ回路８
では、ブロック化された画素からｍビットのコードが発
生され、縮退ＲＯＭ１１へ供給される。
されるまでの時間（１フィールドまたは１フレーム＋
α）だけ、遅延が行われ、その出力は、ブロック化回路
７および９、さらに遅延回路１２へ供給される。ブロッ
ク化回路７では、注目画素の周辺の空間内の複数の画素
が選択され、ブロック化される。そのブロック化された
画素は、ＡＤＲＣ回路８へ供給される。ＡＤＲＣ回路８
では、ブロック化された画素からｍビットのコードが発
生され、縮退ＲＯＭ１１へ供給される。
【００４８】ブロック化回路９では、注目画素の周辺の
空間内の複数の画素が選択され、ブロック化される。上
述したように、ブロック化回路７とのブロック化とは異
なっても良い。平均化回路１０では、注目画素付近の輝
度の平均値が算出され、算出された平均値は、シフトさ
れ、ｐ（＜８）ビットに量子化され、縮退ＲＯＭ１１へ
供給される。
空間内の複数の画素が選択され、ブロック化される。上
述したように、ブロック化回路７とのブロック化とは異
なっても良い。平均化回路１０では、注目画素付近の輝
度の平均値が算出され、算出された平均値は、シフトさ
れ、ｐ（＜８）ビットに量子化され、縮退ＲＯＭ１１へ
供給される。
【００４９】縮退ＲＯＭ１１では、上述したように、ク
ラスを縮退させるために、（ｎ＋ｍ＋ｐ）ビットからｑ
ビットに減少させたクラスコード（インデックス）が発
生される。このように、縮退ＲＯＭ１１から最終的にｑ
ビットのクラスコードが発生し、そのｑビットのクラス
コードは、係数ＲＯＭ１４1 〜１４N へ供給される。係
数ＲＯＭ１４1 〜１４N では、供給されたクラスコード
でアドレッシングされ、係数データが読み出される。読
み出された係数データは、それぞれ乗算器１５1 〜１５
N へ供給される。
ラスを縮退させるために、（ｎ＋ｍ＋ｐ）ビットからｑ
ビットに減少させたクラスコード（インデックス）が発
生される。このように、縮退ＲＯＭ１１から最終的にｑ
ビットのクラスコードが発生し、そのｑビットのクラス
コードは、係数ＲＯＭ１４1 〜１４N へ供給される。係
数ＲＯＭ１４1 〜１４N では、供給されたクラスコード
でアドレッシングされ、係数データが読み出される。読
み出された係数データは、それぞれ乗算器１５1 〜１５
N へ供給される。
【００５０】遅延によるタイミング合わせが行われる遅
延回路１２の出力がブロック化回路１３へ供給され、そ
のブロック化回路１３では、注目画素の周辺の複数の画
素がブロック化される。ブロック化された各画素値は、
乗算器１５1 〜１５N へ供給される。乗算器１５1 〜１
５N では、係数ＲＯＭ１４1 〜１４N からの係数データ
と、ブロック化された各画素値が乗算され、その乗算値
は、加算器１６へ供給される。加算器１６では、乗算器
１５1 〜１５N からの乗算値が加算される。
延回路１２の出力がブロック化回路１３へ供給され、そ
のブロック化回路１３では、注目画素の周辺の複数の画
素がブロック化される。ブロック化された各画素値は、
乗算器１５1 〜１５N へ供給される。乗算器１５1 〜１
５N では、係数ＲＯＭ１４1 〜１４N からの係数データ
と、ブロック化された各画素値が乗算され、その乗算値
は、加算器１６へ供給される。加算器１６では、乗算器
１５1 〜１５N からの乗算値が加算される。
【００５１】すなわち、乗算器１５1 〜１５N および加
算器１６において、積和演算することで、輝度補正値の
予測が行われる。その予測値は、Ｄ／Ａ変換回路１７に
おいて、Ｄ／Ａ変換され、補正後の輝度値Ｙ´として出
力端子１８から取り出される。
算器１６において、積和演算することで、輝度補正値の
予測が行われる。その予測値は、Ｄ／Ａ変換回路１７に
おいて、Ｄ／Ａ変換され、補正後の輝度値Ｙ´として出
力端子１８から取り出される。
【００５２】ここで、量子化回路の一例を図１０に示し
説明する。入力端子６１から輝度値が供給される。供給
された輝度値は、輝度度数分布テーブル６２へ供給さ
れ、輝度度数分布テーブル６２において、例えば１フィ
ールドまたは１フレーム内の輝度レベルの度数分布のテ
ーブルが生成される。生成されたテーブルに基づいて、
平均値算出回路６３では、平均値が式（８）により算出
され、算出された平均値は、標準偏差算出回路６４へ供
給されると共に、出力端子６５から取り出される。標準
偏差算出回路６４では、度数分布のテーブルと平均値か
ら標準偏差が式（９）により算出され、算出された標準
偏差は、出力端子６６から取り出される。取り出された
標準偏差が小さいときは、度数分布の幅は狭く、標準偏
差が大きいときは、度数分布の幅は広くなる。
説明する。入力端子６１から輝度値が供給される。供給
された輝度値は、輝度度数分布テーブル６２へ供給さ
れ、輝度度数分布テーブル６２において、例えば１フィ
ールドまたは１フレーム内の輝度レベルの度数分布のテ
ーブルが生成される。生成されたテーブルに基づいて、
平均値算出回路６３では、平均値が式（８）により算出
され、算出された平均値は、標準偏差算出回路６４へ供
給されると共に、出力端子６５から取り出される。標準
偏差算出回路６４では、度数分布のテーブルと平均値か
ら標準偏差が式（９）により算出され、算出された標準
偏差は、出力端子６６から取り出される。取り出された
標準偏差が小さいときは、度数分布の幅は狭く、標準偏
差が大きいときは、度数分布の幅は広くなる。
【００５３】ここで、係数ＲＯＭに記憶される係数デー
タを生成する学習のためのブロック図を図１１に示す。
入力端子１から供給された輝度信号Ｙは、Ａ／Ｄ変換回
路２へ供給され、Ａ／Ｄ変換回路２では、例えば１３．
５ＭHzでサンプリングされ、平均値／標準偏差算出回路
５５および遅延回路６へ出力される。平均値／標準偏差
算出回路５５では、上述したように供給された輝度値の
例えば１フィールドまたは１フレーム当りの平均値およ
び標準偏差が求められる。平均値／標準偏差算出回路５
５において、輝度レベル毎の度数分布を求めるためのテ
ーブルを持ち、１フィールド期間または１フレーム期間
に乗算した度数分布から、図９に示すように輝度の平均
値が算出されると共に、標準偏差も算出される。また、
式（８）には、輝度の平均値を算出する計算式を示し、
式（９）には、標準偏差を算出する計算式を示す。
タを生成する学習のためのブロック図を図１１に示す。
入力端子１から供給された輝度信号Ｙは、Ａ／Ｄ変換回
路２へ供給され、Ａ／Ｄ変換回路２では、例えば１３．
５ＭHzでサンプリングされ、平均値／標準偏差算出回路
５５および遅延回路６へ出力される。平均値／標準偏差
算出回路５５では、上述したように供給された輝度値の
例えば１フィールドまたは１フレーム当りの平均値およ
び標準偏差が求められる。平均値／標準偏差算出回路５
５において、輝度レベル毎の度数分布を求めるためのテ
ーブルを持ち、１フィールド期間または１フレーム期間
に乗算した度数分布から、図９に示すように輝度の平均
値が算出されると共に、標準偏差も算出される。また、
式（８）には、輝度の平均値を算出する計算式を示し、
式（９）には、標準偏差を算出する計算式を示す。
【００５４】量子化回路５６では、算出された平均値お
よび標準偏差に対してそれぞれａビット、ｂビットで量
子化されて、トータルｎビット（ｎ＝ａ＋ｂ）のコード
を発生する。このｎビットのコードは、量子化回路５６
から縮退ＲＯＭ１１へ供給される。さらに、このｎビッ
トのコードは、いわゆる輝度分布をパターン化したもの
で、これを見ることで輝度分布が暗い方か、明るい方か
に偏っているかどうか、また、平坦か急峻かを判定する
ことができる。
よび標準偏差に対してそれぞれａビット、ｂビットで量
子化されて、トータルｎビット（ｎ＝ａ＋ｂ）のコード
を発生する。このｎビットのコードは、量子化回路５６
から縮退ＲＯＭ１１へ供給される。さらに、このｎビッ
トのコードは、いわゆる輝度分布をパターン化したもの
で、これを見ることで輝度分布が暗い方か、明るい方か
に偏っているかどうか、また、平坦か急峻かを判定する
ことができる。
【００５５】遅延回路６では、ｎビットのコードが生成
されるまでの時間（１フィールドまたは１フレーム＋
α）だけ、遅延が行われ、その出力は、ブロック化回路
７および９、さらに遅延回路１２へ供給される。ブロッ
ク化回路７では、注目画素の周辺の空間内の複数の画素
が選択され、ブロック化される。そのブロック化された
画素は、ＡＤＲＣ回路８へ供給される。ＡＤＲＣ回路８
では、ブロック化された画素からｍビットのコードが発
生され、縮退ＲＯＭ１１へ供給される。
されるまでの時間（１フィールドまたは１フレーム＋
α）だけ、遅延が行われ、その出力は、ブロック化回路
７および９、さらに遅延回路１２へ供給される。ブロッ
ク化回路７では、注目画素の周辺の空間内の複数の画素
が選択され、ブロック化される。そのブロック化された
画素は、ＡＤＲＣ回路８へ供給される。ＡＤＲＣ回路８
では、ブロック化された画素からｍビットのコードが発
生され、縮退ＲＯＭ１１へ供給される。
【００５６】ブロック化回路９では、注目画素の周辺の
空間内の複数の画素が選択され、ブロック化される。上
述したように、ブロック化回路７とのブロック化とは異
なっても良い。平均化回路１０では、注目画素付近の輝
度の平均値が算出され、算出された平均値は、シフトさ
れ、ｐ（＜８）ビットに量子化され、縮退ＲＯＭ１１へ
供給される。
空間内の複数の画素が選択され、ブロック化される。上
述したように、ブロック化回路７とのブロック化とは異
なっても良い。平均化回路１０では、注目画素付近の輝
度の平均値が算出され、算出された平均値は、シフトさ
れ、ｐ（＜８）ビットに量子化され、縮退ＲＯＭ１１へ
供給される。
【００５７】縮退ＲＯＭ１１では、上述するように、ク
ラスを縮退させるために、（ｎ＋ｍ＋ｐ）ビットからｑ
ビットに減少させたクラスコード（インデックス）が発
生される。このように、縮退ＲＯＭ１１から最終的にｑ
ビットのクラスコードが発生し、そのｑビットのクラス
コードは、学習回路３３へ供給される。
ラスを縮退させるために、（ｎ＋ｍ＋ｐ）ビットからｑ
ビットに減少させたクラスコード（インデックス）が発
生される。このように、縮退ＲＯＭ１１から最終的にｑ
ビットのクラスコードが発生し、そのｑビットのクラス
コードは、学習回路３３へ供給される。
【００５８】遅延合わせが行われる遅延回路１２の出力
がブロック化回路１３へ供給され、そのブロック化回路
１３では、注目画素の周辺の複数の画素がブロック化さ
れる。ブロック化された各画素値は、学習回路３３へ供
給される。
がブロック化回路１３へ供給され、そのブロック化回路
１３では、注目画素の周辺の複数の画素がブロック化さ
れる。ブロック化された各画素値は、学習回路３３へ供
給される。
【００５９】そして、入力端子３１から教師用の映像信
号の対応する画素の輝度信号Ｙが入力される。その教師
用の輝度信号Ｙは、Ａ／Ｄ変換回路３２において、アナ
ログ信号からディジタル信号へ変換され、学習回路３３
に入力される。学習回路３３では、ｎタップの線形一時
結合モデルを形成し、その各係数データを学習回路３３
で算出する。算出された各係数データは、出力端子３４
から取り出され、係数ＲＯＭへ格納される。また、学習
回路３３は、上述した最小自乗法にてクラス毎に係数デ
ータを学習するものである。
号の対応する画素の輝度信号Ｙが入力される。その教師
用の輝度信号Ｙは、Ａ／Ｄ変換回路３２において、アナ
ログ信号からディジタル信号へ変換され、学習回路３３
に入力される。学習回路３３では、ｎタップの線形一時
結合モデルを形成し、その各係数データを学習回路３３
で算出する。算出された各係数データは、出力端子３４
から取り出され、係数ＲＯＭへ格納される。また、学習
回路３３は、上述した最小自乗法にてクラス毎に係数デ
ータを学習するものである。
【００６０】この実施例では、すべてハードウェアで実
現する方法を記載したが、ディジタル化されたデータを
計算機に取り込むことでソフトウェアで計算しても良
い。
現する方法を記載したが、ディジタル化されたデータを
計算機に取り込むことでソフトウェアで計算しても良
い。
【００６１】
【発明の効果】この発明に依れば、輝度分布のパターン
分類から全体の輝度補正を行う効果と、空間内のパター
ン分類および輝度値の平均値から部分的な輝度補正を行
う効果を待ち合わせており、よりきめの細かい輝度補正
を行うことが可能となる。
分類から全体の輝度補正を行う効果と、空間内のパター
ン分類および輝度値の平均値から部分的な輝度補正を行
う効果を待ち合わせており、よりきめの細かい輝度補正
を行うことが可能となる。
【図１】この発明の画像信号処理装置の一実施例を示す
ブロック図である。
ブロック図である。
【図２】この発明に係る度数分布の説明に用いる一例の
度数分布図である。
度数分布図である。
【図３】この発明に係るＡＤＲＣ回路の一例のブロック
図である。
図である。
【図４】この発明に係る係数データの学習するための一
例のブロック図である。
例のブロック図である。
【図５】この発明に係る学習回路の一例のブロック図で
ある。
ある。
【図６】この発明に係る乗算器アレイの説明に用いる一
例の略線図である。
例の略線図である。
【図７】この発明に係る加算メモリの説明に用いる一例
の略線図である。
の略線図である。
【図８】この発明の画像信号処理装置の他の実施例を示
すブロック図である。
すブロック図である。
【図９】この発明に係る度数分布の説明に用いる他の一
例の度数分布図である。
例の度数分布図である。
【図１０】この発明に係る量子化回路の一例のブロック
図である。
図である。
【図１１】この発明に係る係数データの学習するための
一例のブロック図である。
一例のブロック図である。
２、１７ Ａ／Ｄ変換回路 ３ 変換ＲＯＭ ４ 領域別輝度分布回路 ５、８ ＡＤＲＣ回路 ６、１２ 遅延回路 ７、９、１３ ブロック化回路 １０ 平均化回路 １１ 縮退ＲＯＭ １４ 係数ＲＯＭ １５ 乗算器 １６ 加算器
Claims (7)
- 【請求項１】 映像信号の輝度値に対して、所定期間内
の度数分布を測定する手段と、 上記度数分布を適当な領域に分割して上記領域内の積算
値を正規化することによって、上記度数分布をパターン
化して、ｎビットで表現する第１のクラス分類手段と、 予めクラス毎に最小自乗法による学習処理で求められた
係数データが格納された係数メモリと、 上記第１のクラス分類手段からのｎビットにより、上記
係数データを上記係数メモリから読み出し、線形１次結
合演算によって、補正輝度値を予測する手段とからなる
ことを特徴とする画像信号処理装置。 - 【請求項２】 映像信号の輝度値に対して、所定期間内
の度数分布を測定する手段と、 上記度数分布の平均値および標準偏差が算出され、上記
平均値および標準偏差を量子化することによって、量子
化された上記平均値および標準偏差をまとめて、ｎビッ
トで表現する第１のクラス分類手段と、 予めクラス毎に最小自乗法による学習処理で求められた
係数データが格納された係数メモリと、 上記第１のクラス分類手段からのｎビットにより、上記
係数データを上記係数メモリから読み出し、線形１次結
合演算によって、補正輝度値を予測する手段とからなる
ことを特徴とする画像信号処理装置。 - 【請求項３】 請求項１または請求項２に記載の画像信
号処理装置において、 注目画素の周辺画素を含む複数個の画素をブロック化
し、ブロック毎に空間のパターン分類を行い、上記注目
画素に関してｍビットで表現する第２のクラス分類手段
とをさらに有することを特徴とする画像信号処理装置。 - 【請求項４】 請求項１または請求項２に記載の画像信
号処理装置において、 注目画素の周辺画素の輝度値を平均化し、平均化された
上記輝度値をｐビットで表現する第３のクラス分類手段
とをさらに有することを特徴とする画像信号処理装置。 - 【請求項５】 請求項１または請求項２に記載の画像信
号処理装置において、 注目画素の周辺画素を含む複数個の画素をブロック化
し、ブロック毎に空間のパターン分類を行い、上記注目
画素に関してｍビットで表現する第２のクラス分類手段
と、 注目画素の周辺画素の輝度値を平均化し、平均化された
上記輝度値をｐビットで表現する第３のクラス分類手段
と、 上記第１、第２および第３のクラス分類手段によって表
現された上記ｎビット、ｍビットおよびｐビットを組合
せ、（ｎ＋ｍ＋ｐ）ビットのクラス分類情報から、縮退
することによってｐ（＜（ｎ＋ｍ＋ｐ））ビットのクラ
ス分類情報を生成する手段とからなることを特徴とする
画像信号処理装置。 - 【請求項６】 映像信号の輝度値に対して、所定期間内
の度数分布を測定するステップと、 上記度数分布を適当な領域に分割して上記領域内の積算
値を正規化することによって、上記度数分布をパターン
化して、ｎビットで表現する第１のクラス分類のステッ
プと、 予めクラス毎に最小自乗法による学習処理で求められた
係数データが格納された係数メモリと、 上記第１のクラス分類手段からのｎビットにより、上記
係数データを上記係数メモリから読み出し、線形１次結
合演算によって、補正輝度値を予測するステップとから
なることを特徴とする画像信号処理方法。 - 【請求項７】 映像信号の輝度値に対して、所定期間内
の度数分布を測定するステップと、 上記度数分布の平均値および標準偏差が算出され、上記
平均値および標準偏差を量子化することによって、量子
化された上記平均値および標準偏差をまとめて、ｎビッ
トで表現する第１のクラス分類のステップと、 予めクラス毎に最小自乗法による学習処理で求められた
係数データが格納された係数メモリと、 上記第１のクラス分類手段からのｎビットにより、上記
係数データを上記係数メモリから読み出し、線形１次結
合演算によって、補正輝度値を予測するステップとから
なることを特徴とする画像信号処理方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32835895A JP3791029B2 (ja) | 1995-11-22 | 1995-11-22 | 画像信号処理装置および方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32835895A JP3791029B2 (ja) | 1995-11-22 | 1995-11-22 | 画像信号処理装置および方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09147101A true JPH09147101A (ja) | 1997-06-06 |
| JP3791029B2 JP3791029B2 (ja) | 2006-06-28 |
Family
ID=18209361
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32835895A Expired - Lifetime JP3791029B2 (ja) | 1995-11-22 | 1995-11-22 | 画像信号処理装置および方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3791029B2 (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001339731A (ja) * | 2000-05-24 | 2001-12-07 | Sony Corp | 画像信号処理装置及び画像信号処理方法 |
| WO2002062055A1 (fr) * | 2001-01-31 | 2002-08-08 | Sanyo Electric Co., Ltd. | Circuit de traitement d'image |
| WO2003058593A1 (fr) * | 2001-12-28 | 2003-07-17 | Sanyo Electric Co., Ltd. | Procede de commande de la luminance d'un ecran electroluminescent organique et circuit de commande de luminance |
| US7248599B2 (en) | 2000-05-26 | 2007-07-24 | Sony Corporation | Signal processing apparatus |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPH07123308A (ja) * | 1993-08-30 | 1995-05-12 | Sony Corp | 電子ズーム装置及び電子ズーム方法 |
| JPH07274201A (ja) * | 1994-03-28 | 1995-10-20 | Sony Corp | 適応フィルタ装置及び適応フィルタ処理方法 |
-
1995
- 1995-11-22 JP JP32835895A patent/JP3791029B2/ja not_active Expired - Lifetime
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| US7304654B2 (en) | 2001-12-28 | 2007-12-04 | Sanyo Electric Co., Ltd. | Organic EL display luminance control method and luminance control circuit |
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| Publication number | Publication date |
|---|---|
| JP3791029B2 (ja) | 2006-06-28 |
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