JPH08234931A - Ｐｃｍｃｉａをビデオインタ−フェ−スとするコンピュータ - Google Patents
Ｐｃｍｃｉａをビデオインタ−フェ−スとするコンピュータInfo
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- JPH08234931A JPH08234931A JP7038630A JP3863095A JPH08234931A JP H08234931 A JPH08234931 A JP H08234931A JP 7038630 A JP7038630 A JP 7038630A JP 3863095 A JP3863095 A JP 3863095A JP H08234931 A JPH08234931 A JP H08234931A
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N21/40—Client devices specifically adapted for the reception of or interaction with content, e.g. set-top-box [STB]; Operations thereof
- H04N21/41—Structure of client; Structure of client peripherals
- H04N21/414—Specialised client platforms, e.g. receiver in car or embedded in a mobile appliance
- H04N21/4143—Specialised client platforms, e.g. receiver in car or embedded in a mobile appliance embedded in a Personal Computer [PC]
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- General Engineering & Computer Science (AREA)
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Abstract
(57)【要約】
【目的】本発明は、カード接続口に既存のカードが接続
された際は、カード接続口とシステムバスとの間を選択
的に接続し、カードに固有の例えば通信等の機能拡張を
可能にする。又、カード接続口に、高画質の画像処理機
能をもつ新規なカードが接続された際は、カード接続口
と動画専用バスとの間を選択的に接続し、接続されたカ
ードに固有の高画質画像処理機能の拡張を可能にする。 【構成】ＰＣＭＣＩＡカードコネクタ１８に接続された
ＰＣカード２，３との間でデータを入出力制御するＰＣ
ＭＣＩＡコントローラ１６と、動画データの表示処理機
能をもつマルチメディアディスプレイコントローラ１７
との間に動画専用バス１９を設け、ＰＣＭＣＩＡコント
ローラ１６内に、ＰＣＭＣＩＡカードコネクタ１８と動
画専用バス１９との間、又は上記コネクタ１８とシステ
ムバス１０との間を選択的に接続する切換制御回路１６
ａを設けたことを特徴とする。
された際は、カード接続口とシステムバスとの間を選択
的に接続し、カードに固有の例えば通信等の機能拡張を
可能にする。又、カード接続口に、高画質の画像処理機
能をもつ新規なカードが接続された際は、カード接続口
と動画専用バスとの間を選択的に接続し、接続されたカ
ードに固有の高画質画像処理機能の拡張を可能にする。 【構成】ＰＣＭＣＩＡカードコネクタ１８に接続された
ＰＣカード２，３との間でデータを入出力制御するＰＣ
ＭＣＩＡコントローラ１６と、動画データの表示処理機
能をもつマルチメディアディスプレイコントローラ１７
との間に動画専用バス１９を設け、ＰＣＭＣＩＡコント
ローラ１６内に、ＰＣＭＣＩＡカードコネクタ１８と動
画専用バス１９との間、又は上記コネクタ１８とシステ
ムバス１０との間を選択的に接続する切換制御回路１６
ａを設けたことを特徴とする。
Description
【０００１】
【産業上の利用分野】本発明は、カードの接続口に接続
されたカードを用いて動画処理機能を実現できるＰＣＭ
ＣＩをビデオインタ−フェ−スとするコンピュータ及び
同コンピュ−タに用いられるカードに関する。
されたカードを用いて動画処理機能を実現できるＰＣＭ
ＣＩをビデオインタ−フェ−スとするコンピュータ及び
同コンピュ−タに用いられるカードに関する。
【０００２】
【従来の技術】近年、ポータブルコンピュータの発達と
ともに、マルチメディアパソコンと呼ばれるコンピュー
タが開発されている。このコンピュータでは、テキスト
データやグラフィックスデータの他に動画や静止画等の
画像データがＣＲＴに表示可能である。画像データの表
示は、従来よりテレビやビデオ等で使用されているＹＵ
Ｖ信号を用いて行なわれるので、コンピュータ本体に内
蔵されているＲＧＢの表示回路を用いてテキストデータ
やグラフィックスデータを表示し、画像データの表示は
オプションボードをコンピュータ本体に接続して行な
う。このようなオプションボードとしては、例えば、米
国C-Cube Microsystems のＣＬ−４５０（Registered T
radmark ）Development Board がある。このボードはＭ
ＰＥＧ（Moving Picture Coding Experts Group ）vide
o algorithm を用いて、ＭＰＥＧ compressed video 信
号を伸張し、ＹＵＶ信号をＲＧＢ信号に変換して出力す
る。なお、ＭＰＥＧはカラー動画像蓄積用符号化方式の
標準化を進める組織であり、ＩＳＯ（国際標準化機構）
とＩＥＣ（国際電気標準会議）が共同で進めるＪＴＣＩ
（情報処理関連国際標準化技術委員会）の下部組織に当
たる、一方で、カラー動画像蓄積用の符号化方式を指す
こともある。ＣＤ−ＲＯＭへの応用を考えたＭＰＥＧ−
１と、より高画質を目指したＭＰＥＧ−２がある。それ
ぞれ転送速度は、１．５Ｍビット／秒以下と５Ｍ−１０
Ｍビット／秒である。
ともに、マルチメディアパソコンと呼ばれるコンピュー
タが開発されている。このコンピュータでは、テキスト
データやグラフィックスデータの他に動画や静止画等の
画像データがＣＲＴに表示可能である。画像データの表
示は、従来よりテレビやビデオ等で使用されているＹＵ
Ｖ信号を用いて行なわれるので、コンピュータ本体に内
蔵されているＲＧＢの表示回路を用いてテキストデータ
やグラフィックスデータを表示し、画像データの表示は
オプションボードをコンピュータ本体に接続して行な
う。このようなオプションボードとしては、例えば、米
国C-Cube Microsystems のＣＬ−４５０（Registered T
radmark ）Development Board がある。このボードはＭ
ＰＥＧ（Moving Picture Coding Experts Group ）vide
o algorithm を用いて、ＭＰＥＧ compressed video 信
号を伸張し、ＹＵＶ信号をＲＧＢ信号に変換して出力す
る。なお、ＭＰＥＧはカラー動画像蓄積用符号化方式の
標準化を進める組織であり、ＩＳＯ（国際標準化機構）
とＩＥＣ（国際電気標準会議）が共同で進めるＪＴＣＩ
（情報処理関連国際標準化技術委員会）の下部組織に当
たる、一方で、カラー動画像蓄積用の符号化方式を指す
こともある。ＣＤ−ＲＯＭへの応用を考えたＭＰＥＧ−
１と、より高画質を目指したＭＰＥＧ−２がある。それ
ぞれ転送速度は、１．５Ｍビット／秒以下と５Ｍ−１０
Ｍビット／秒である。
【０００３】さらに、米国インテル社のＤＶＩ（Digita
l Video Interactive ）ボードが知られている。このＤ
ＶＩボードには、画像を圧縮／伸長するための８２７５
０ＰＢチップ、画像データを格納するＶＲＡＭ，画像デ
ータの表示を制御する８２７５ＤＢチップ等が実装され
ている。
l Video Interactive ）ボードが知られている。このＤ
ＶＩボードには、画像を圧縮／伸長するための８２７５
０ＰＢチップ、画像データを格納するＶＲＡＭ，画像デ
ータの表示を制御する８２７５ＤＢチップ等が実装され
ている。
【０００４】しかしながら、このようなオプションボー
ドをコンピュータ本体に接続した場合、コンピュータ本
体に内蔵されるＲＧＢ系の表示サブシステムと、オプシ
ョンボード上のＹＵＶ系の表示サブシステムの２つのサ
ブシステムが存在することになり、回路構成が冗長とな
る欠点を有している。
ドをコンピュータ本体に接続した場合、コンピュータ本
体に内蔵されるＲＧＢ系の表示サブシステムと、オプシ
ョンボード上のＹＵＶ系の表示サブシステムの２つのサ
ブシステムが存在することになり、回路構成が冗長とな
る欠点を有している。
【０００５】また、ラップトップタイプのポータブルコ
ンピュータの発達とともに、ＴＥＴカラーＬＣＤ等のフ
ラットパネルを採用したポータブルコンピュータに於い
ても、テキストデータ、グラフィックスデータ、動画デ
ータおよび静止画データ等の画像データの表示およびそ
れらの混在表示をフラットパネルディスプレイを用いて
行なうことが望まれている。
ンピュータの発達とともに、ＴＥＴカラーＬＣＤ等のフ
ラットパネルを採用したポータブルコンピュータに於い
ても、テキストデータ、グラフィックスデータ、動画デ
ータおよび静止画データ等の画像データの表示およびそ
れらの混在表示をフラットパネルディスプレイを用いて
行なうことが望まれている。
【０００６】一方、近年、パーソナルコンピュータに於
いては、米国の標準化団体であるＰＣＭＣＩＡ（Person
al Computer Memory Card International Association
）、及びＪＥＩＤＡの標準仕様に準拠したＰＣカード
のスロットをもつ機器が普及しつつある。このＰＣカー
ドを、動画データの入出力制御を行なう動画キャプチ
ャ、ＭＰＥＧデコーダ等に用いるべく種々の開発がなさ
れている。
いては、米国の標準化団体であるＰＣＭＣＩＡ（Person
al Computer Memory Card International Association
）、及びＪＥＩＤＡの標準仕様に準拠したＰＣカード
のスロットをもつ機器が普及しつつある。このＰＣカー
ドを、動画データの入出力制御を行なう動画キャプチ
ャ、ＭＰＥＧデコーダ等に用いるべく種々の開発がなさ
れている。
【０００７】このようなオプションカードを用いたシス
テムを実現しようとしたとき、従来の標準バス仕様（例
えばＩＳＡバス仕様）によるパーソナルコンピュータシ
ステムに於いては、ＮＴＳＣ方式によるＴＶ画像と同等
の解像度を確保しようとすると、その画像処理にバスの
転送スピードが追い付かず、従って画質（解像度）を落
として表示処理しなければならない。他の手段として
は、ＩＳＡバス等に代えて、例えばＰＣＩ（Peripheral
Component Interconnect ）バス等の高速バスをもつ構
成としなければならない。
テムを実現しようとしたとき、従来の標準バス仕様（例
えばＩＳＡバス仕様）によるパーソナルコンピュータシ
ステムに於いては、ＮＴＳＣ方式によるＴＶ画像と同等
の解像度を確保しようとすると、その画像処理にバスの
転送スピードが追い付かず、従って画質（解像度）を落
として表示処理しなければならない。他の手段として
は、ＩＳＡバス等に代えて、例えばＰＣＩ（Peripheral
Component Interconnect ）バス等の高速バスをもつ構
成としなければならない。
【０００８】
【発明が解決しようとする課題】上述したように、パー
ソナルコンピュータシステムに於いて、標準化されたカ
ードを用い、動画処理の機能拡張を図ろうとしたとき、
従来の標準バス仕様によるシステムに於いては、通常の
ＴＶ画像等に比して、画質（解像度）の低下を余儀なく
される。又、この問題を解決しようとしたときは、シス
テムバスを高速バス化する必要があり、この際はコスト
高、大電力化、構成の繁雑化等の不具合を招くという問
題が生じる。
ソナルコンピュータシステムに於いて、標準化されたカ
ードを用い、動画処理の機能拡張を図ろうとしたとき、
従来の標準バス仕様によるシステムに於いては、通常の
ＴＶ画像等に比して、画質（解像度）の低下を余儀なく
される。又、この問題を解決しようとしたときは、シス
テムバスを高速バス化する必要があり、この際はコスト
高、大電力化、構成の繁雑化等の不具合を招くという問
題が生じる。
【０００９】本発明は上記実情に鑑みなされたもので、
既存の標準化されたシステムバスを用いて構成されたシ
ステムに於いて、既存のオプションカードに加えて、高
速で動作する新規のオプションカードを用いた高画質の
動画処理機能を実現できるポータブルコンピュータを提
供することを目的とする。
既存の標準化されたシステムバスを用いて構成されたシ
ステムに於いて、既存のオプションカードに加えて、高
速で動作する新規のオプションカードを用いた高画質の
動画処理機能を実現できるポータブルコンピュータを提
供することを目的とする。
【００１０】又、本発明は、既存の標準化されたバスを
用いてオプションカードを用いた高画質の動画処理機能
と、既存のオプションカードを用いたカードに固有の処
理機能とを簡単な構成にて両立させることのできるオプ
ションカードを使用するポータブルコンピュータを提供
することを目的とする。
用いてオプションカードを用いた高画質の動画処理機能
と、既存のオプションカードを用いたカードに固有の処
理機能とを簡単な構成にて両立させることのできるオプ
ションカードを使用するポータブルコンピュータを提供
することを目的とする。
【００１１】又、本発明は、既存の標準化されたバス仕
様による、オプションカードスロットをもつシステムに
て、高画質の動画処理機能を容易に実現できるオプショ
ンカードを提供することを目的とする。
様による、オプションカードスロットをもつシステムに
て、高画質の動画処理機能を容易に実現できるオプショ
ンカードを提供することを目的とする。
【００１２】
【課題を解決するための手段】本発明は、例えばＰＣＭ
ＣＩＡカードスロット等のカード接続口をもつポータブ
ルコンピュータシステムに於いて、カード接続口に接続
されたカード（例えばＰＣカード）との間でデータを入
出力制御するカードコントローラと、動画データの表示
処理機能をもつディスプレイコントローラとの間に動画
データをダイレクトに転送する動画専用バスを設け、カ
ードコントローラ内に、カード接続口と動画専用バスと
の間又はカード接続口とシステムバスとの間を選択的に
接続する切換制御回路を設けたことを特徴とする。
ＣＩＡカードスロット等のカード接続口をもつポータブ
ルコンピュータシステムに於いて、カード接続口に接続
されたカード（例えばＰＣカード）との間でデータを入
出力制御するカードコントローラと、動画データの表示
処理機能をもつディスプレイコントローラとの間に動画
データをダイレクトに転送する動画専用バスを設け、カ
ードコントローラ内に、カード接続口と動画専用バスと
の間又はカード接続口とシステムバスとの間を選択的に
接続する切換制御回路を設けたことを特徴とする。
【００１３】
【作用】カード接続口に、例えば通信カード等、既存の
カードが接続された際は、カードコントローラの切換制
御回路が、カード接続口とシステムバスとの間を選択的
に接続し、カード接続口に接続されたカードに固有の例
えば通信等の既存のカードによる機能拡張を可能にす
る。又、カード接続口に、高画質の画像処理機能をも
つ、高速データ転送を必要とする新規なカードが接続さ
れた際は、カードコントローラの切換制御回路が、カー
ド接続口と動画専用バスとの間を選択的に接続し、カー
ド接続口に接続されたカードに固有の高画質画像処理機
能の拡張を可能にする。
カードが接続された際は、カードコントローラの切換制
御回路が、カード接続口とシステムバスとの間を選択的
に接続し、カード接続口に接続されたカードに固有の例
えば通信等の既存のカードによる機能拡張を可能にす
る。又、カード接続口に、高画質の画像処理機能をも
つ、高速データ転送を必要とする新規なカードが接続さ
れた際は、カードコントローラの切換制御回路が、カー
ド接続口と動画専用バスとの間を選択的に接続し、カー
ド接続口に接続されたカードに固有の高画質画像処理機
能の拡張を可能にする。
【００１４】また，この発明によればＰＣカードからの
動画データをＰＣ本体に出力する際にＰＣＭＣＩＡ規格
のピンのうちアドレスＡ２５−７を使用して供給するよ
うに構成されている．すなわちアドレスピンのうち上位
アドレスピンを使用して供給するように構成しているの
で，アドレス値が下位アドレスに比べて変動が少ないの
で不都合を生じることはない．さらに，上記アドレスピ
ンを用いて動画データを出力するマルチメディアモード
において，アドレス（Ａ２０−０）をＰＣカードに供給
する必要が生じた場合にも時分割制御によりデータバス
（Ｄ１５−０）を用いて上記アドレスを供給するように
構成されている．
動画データをＰＣ本体に出力する際にＰＣＭＣＩＡ規格
のピンのうちアドレスＡ２５−７を使用して供給するよ
うに構成されている．すなわちアドレスピンのうち上位
アドレスピンを使用して供給するように構成しているの
で，アドレス値が下位アドレスに比べて変動が少ないの
で不都合を生じることはない．さらに，上記アドレスピ
ンを用いて動画データを出力するマルチメディアモード
において，アドレス（Ａ２０−０）をＰＣカードに供給
する必要が生じた場合にも時分割制御によりデータバス
（Ｄ１５−０）を用いて上記アドレスを供給するように
構成されている．
【００１５】
【実施例】以下図面を参照して本発明の一実施例を説明
する。図１は本発明の一実施例の構成を示すブロック図
である。図１に於いて、１はＩＳＡバス等の標準仕様に
よるシステムバスにより構成されたパーソナルコンピュ
ータ本体（以下ＰＣ本体と称す）であり、ここでは上記
標準バス仕様下に於いて、高画質画像処理を含む各種の
ＰＣカードによる拡張機能を実現するカードインタフェ
ース機構を備えてなる。
する。図１は本発明の一実施例の構成を示すブロック図
である。図１に於いて、１はＩＳＡバス等の標準仕様に
よるシステムバスにより構成されたパーソナルコンピュ
ータ本体（以下ＰＣ本体と称す）であり、ここでは上記
標準バス仕様下に於いて、高画質画像処理を含む各種の
ＰＣカードによる拡張機能を実現するカードインタフェ
ース機構を備えてなる。
【００１６】２及び３はそれぞれＰＣ本体１のカードス
ロットに接続可能な、高画質動画処理機能を実現する、
新規なＰＣカードであり、ここでは、ＭＰＥＧデコーダ
カード２と、動画キャプチャカード３の２種のＰＣカー
ドを例示している。
ロットに接続可能な、高画質動画処理機能を実現する、
新規なＰＣカードであり、ここでは、ＭＰＥＧデコーダ
カード２と、動画キャプチャカード３の２種のＰＣカー
ドを例示している。
【００１７】ＭＰＥＧデコーダカード２は、ＣＤ−ＲＯ
Ｍ等に格納されている、圧縮されたサウンド及び画像デ
ータを伸長処理してＰＣ本体１に出力する機能をもつも
ので、ＭＰＥＧインタフェース（Ｉ／Ｆ）２１、ＣＩＳ
（Card Information Structure）２２、ＣＯＲ（Config
uration Option Resister ）２３、ＭＰＥＧサウンドデ
コーダ（MPEG Sound）２４、ＭＰＥＧビデオデコーダ
（MPEG Video）２５、ＲＡＭ２６, コンフィグレジスタ
(Configuration Register) ２７等を内蔵し、ＰＣ本体
１よりコンフィグレジスタ(Configuration Register)
２７に“１”がセットされることにより、カード側端子
の信号が高画質動画処理のための新規ＰＣカードを使用
する、特定カードインタフェース仕様を示すモード（図
３参照）に切り替わる。又、ＭＰＥＧインタフェース
（Ｉ／Ｆ）２１に於けるアドレスラッチ機構の構成は図
４に示される。このＭＰＥＧのアドレスは図３に示すよ
うに２１ビットを必要とし、ここでは上記コンフィグレ
ジスタ（Configuration Register ）２７に“１”がセ
ットされると、図４に示すアドレス２１ビット（Ａ０−
Ａ２０）の入力が可能となる。この際のアドレス制御動
作は後述する。
Ｍ等に格納されている、圧縮されたサウンド及び画像デ
ータを伸長処理してＰＣ本体１に出力する機能をもつも
ので、ＭＰＥＧインタフェース（Ｉ／Ｆ）２１、ＣＩＳ
（Card Information Structure）２２、ＣＯＲ（Config
uration Option Resister ）２３、ＭＰＥＧサウンドデ
コーダ（MPEG Sound）２４、ＭＰＥＧビデオデコーダ
（MPEG Video）２５、ＲＡＭ２６, コンフィグレジスタ
(Configuration Register) ２７等を内蔵し、ＰＣ本体
１よりコンフィグレジスタ(Configuration Register)
２７に“１”がセットされることにより、カード側端子
の信号が高画質動画処理のための新規ＰＣカードを使用
する、特定カードインタフェース仕様を示すモード（図
３参照）に切り替わる。又、ＭＰＥＧインタフェース
（Ｉ／Ｆ）２１に於けるアドレスラッチ機構の構成は図
４に示される。このＭＰＥＧのアドレスは図３に示すよ
うに２１ビットを必要とし、ここでは上記コンフィグレ
ジスタ（Configuration Register ）２７に“１”がセ
ットされると、図４に示すアドレス２１ビット（Ａ０−
Ａ２０）の入力が可能となる。この際のアドレス制御動
作は後述する。
【００１８】又、動画キャプチャカード３は、ＴＶ、Ｖ
ＴＲ、ビデオカメラ等の画像をＰＣ本体１に取り込み、
表示出力する拡張機能を実現するもので、上記したＭＰ
ＥＧデコーダカード２と同様のＣＩＳ（Card Informati
on Structure）、及びＣＯＲ（Configuration Option R
egister ）およびコンフィグレジスタ(ConfigurationRe
gister)２７と、アナログのステレオサウンド信号をＰ
ＷＭ(Pulse Width Modulation)ステレオサウンドデータ
に変換するＰＷＭジェネレータ、ＮＴＳＣ、ＰＡＬ等の
ビデオ信号（video ）をＹ（輝度）信号及びＵＶ（色）
信号に分離し、同期信号とともに出力するビデオデコー
ダ（VideoDecorder ）を内蔵している。
ＴＲ、ビデオカメラ等の画像をＰＣ本体１に取り込み、
表示出力する拡張機能を実現するもので、上記したＭＰ
ＥＧデコーダカード２と同様のＣＩＳ（Card Informati
on Structure）、及びＣＯＲ（Configuration Option R
egister ）およびコンフィグレジスタ(ConfigurationRe
gister)２７と、アナログのステレオサウンド信号をＰ
ＷＭ(Pulse Width Modulation)ステレオサウンドデータ
に変換するＰＷＭジェネレータ、ＮＴＳＣ、ＰＡＬ等の
ビデオ信号（video ）をＹ（輝度）信号及びＵＶ（色）
信号に分離し、同期信号とともに出力するビデオデコー
ダ（VideoDecorder ）を内蔵している。
【００１９】１０乃至１９Ａ，１９ＢはそれぞれＰＣ本
体１の構成要素をなすもので、このうち、１０はＣＰ
Ｕ、メモリ、及び各種ＩＯ等との間のデータ授受に供さ
れる、標準仕様によるシステムバスであり、例えばＩＳ
Ａバス（ＩＳＡ−ＢＵＳ）により実現される。
体１の構成要素をなすもので、このうち、１０はＣＰ
Ｕ、メモリ、及び各種ＩＯ等との間のデータ授受に供さ
れる、標準仕様によるシステムバスであり、例えばＩＳ
Ａバス（ＩＳＡ−ＢＵＳ）により実現される。
【００２０】１１はシステム全体の制御を司るＣＰＵで
あり、ここではメインメモリ１２に格納されたＰＣＭＣ
ＩＡ管理プログラムに従うＰＣＭＣＩＡドライバ１２Ａ
の処理で、後述するＰＣＭＣＩＡコントローラ１６内の
バス切換制御により、動画専用バス１９Ａを用いて、新
規ＰＣカード（ＭＰＥＧデコーダカード２、動画キャプ
チャカード３等）の使用による高画質の動画処理機能を
実現する。
あり、ここではメインメモリ１２に格納されたＰＣＭＣ
ＩＡ管理プログラムに従うＰＣＭＣＩＡドライバ１２Ａ
の処理で、後述するＰＣＭＣＩＡコントローラ１６内の
バス切換制御により、動画専用バス１９Ａを用いて、新
規ＰＣカード（ＭＰＥＧデコーダカード２、動画キャプ
チャカード３等）の使用による高画質の動画処理機能を
実現する。
【００２１】１２はＣＰＵ１１の制御に供される各種プ
ログラムの格納領域、作業領域等が割り付けられるメイ
ンメモリ（主記憶）であり、ここでは、プログラム格納
領域に、ＰＣＭＣＩＡ管理プログラムに含まれるＰＣＭ
ＣＩＡドライバ（PCMCIA-DRV）１２Ａが格納され、ＣＰ
Ｕ１１によりアクセス制御されて、通信等、既存のＰＣ
カードを用いたカード拡張機能、及び、高画質動画処理
のための、ＭＰＥＧデコーダカード２、動画キャプチャ
カード３等の新規ＰＣカードを用いたカード拡張機能を
実現している。
ログラムの格納領域、作業領域等が割り付けられるメイ
ンメモリ（主記憶）であり、ここでは、プログラム格納
領域に、ＰＣＭＣＩＡ管理プログラムに含まれるＰＣＭ
ＣＩＡドライバ（PCMCIA-DRV）１２Ａが格納され、ＣＰ
Ｕ１１によりアクセス制御されて、通信等、既存のＰＣ
カードを用いたカード拡張機能、及び、高画質動画処理
のための、ＭＰＥＧデコーダカード２、動画キャプチャ
カード３等の新規ＰＣカードを用いたカード拡張機能を
実現している。
【００２２】１３及び１４はそれぞれ大容量の外部記憶
装置であり、１３はハードディスク装置（ＨＤＤ）、１
４はＣＤ−ＲＯＭである。ここではこれらの大容量記憶
装置に圧縮された画像データ及びサウンドデータが保存
され、ＣＰＵ１１の制御の下にリード／ライト制御され
る。
装置であり、１３はハードディスク装置（ＨＤＤ）、１
４はＣＤ−ＲＯＭである。ここではこれらの大容量記憶
装置に圧縮された画像データ及びサウンドデータが保存
され、ＣＰＵ１１の制御の下にリード／ライト制御され
る。
【００２３】１５はＣＰＵ１１の制御の下にサウンドデ
ータを入出力制御するオーディオコントローラ（Audio-
CONT）であり、後述するＰＣＭＣＩＡコントローラ１６
から出力されるオーディオ信号線１９Ｂ上のＰＷＭサウ
ンドデータをアナログ信号に変換するフィルタ１５ｄ、
マイクロフォン（ＭＩＣ）または図示しないＬＩＮＥ入
力によるアナログ信号と上記フィルタ１５ｄからのアナ
ログ信号を選択して出力するマルチプレクサ（ＭＵＸ）
１５Ｃ，上記選択出力された可聴周波数帯のアナログ信
号をデジタルデータに変換し、システムバス１０上に出
力するアナログ−デジタルコンバータ（Ｄ／Ａ）１５ｂ
から出力されるアナログ信号と、フィルタ１５ｄから出
力されるアナログ信号が合成され出力される。
ータを入出力制御するオーディオコントローラ（Audio-
CONT）であり、後述するＰＣＭＣＩＡコントローラ１６
から出力されるオーディオ信号線１９Ｂ上のＰＷＭサウ
ンドデータをアナログ信号に変換するフィルタ１５ｄ、
マイクロフォン（ＭＩＣ）または図示しないＬＩＮＥ入
力によるアナログ信号と上記フィルタ１５ｄからのアナ
ログ信号を選択して出力するマルチプレクサ（ＭＵＸ）
１５Ｃ，上記選択出力された可聴周波数帯のアナログ信
号をデジタルデータに変換し、システムバス１０上に出
力するアナログ−デジタルコンバータ（Ｄ／Ａ）１５ｂ
から出力されるアナログ信号と、フィルタ１５ｄから出
力されるアナログ信号が合成され出力される。
【００２４】１６は各種ＰＣカードの入出力インタフェ
ースを実現するＰＣＭＣＩＡコントローラ（PCMCIA-CON
T ）であり、ここでは、通信等の既存ＰＣカードを使用
する際の、通常のカードインタフェース仕様を示すモー
ドＡと、高画質動画処理のための、ＭＰＥＧデコーダカ
ード２、動画キャプチャカード３等の新規ＰＣカードを
使用する際の、特定のカードインタフェース仕様を示す
モードＢとの端子切替え制御機能をもつ。ここでは通信
等の既存ＰＣカードを使用するシステムバス１０経由に
よるモードＡの端子接続と、高画質動画処理のための新
規ＰＣカードを使用する動画専用バス１９経由によるモ
ードＢの端子接続（図２及び図３参照）とを切替えるバ
ス切換制御機能をもつ切換制御回路（ＣＯＮＴ）１６
ａ、新規ＰＣカードを使用する際にモードＢを指定する
“１”がセットされ、既存ＰＣカードを使用する際にモ
ードＡを指定する“０”がセットされるモード制御ビッ
トをもつ制御レジスタ（Reg ）１６ｂ等をもつ。
ースを実現するＰＣＭＣＩＡコントローラ（PCMCIA-CON
T ）であり、ここでは、通信等の既存ＰＣカードを使用
する際の、通常のカードインタフェース仕様を示すモー
ドＡと、高画質動画処理のための、ＭＰＥＧデコーダカ
ード２、動画キャプチャカード３等の新規ＰＣカードを
使用する際の、特定のカードインタフェース仕様を示す
モードＢとの端子切替え制御機能をもつ。ここでは通信
等の既存ＰＣカードを使用するシステムバス１０経由に
よるモードＡの端子接続と、高画質動画処理のための新
規ＰＣカードを使用する動画専用バス１９経由によるモ
ードＢの端子接続（図２及び図３参照）とを切替えるバ
ス切換制御機能をもつ切換制御回路（ＣＯＮＴ）１６
ａ、新規ＰＣカードを使用する際にモードＢを指定する
“１”がセットされ、既存ＰＣカードを使用する際にモ
ードＡを指定する“０”がセットされるモード制御ビッ
トをもつ制御レジスタ（Reg ）１６ｂ等をもつ。
【００２５】レジスタ（Reg ）１６ｂのモード制御ビッ
トには、ＰＣＭＣＩＡドライバ（PCMCIA-DRV）１２Ａに
従うＣＰＵ１１の制御の下に、ＰＣＭＣＩＡカードスロ
ット１８にＭＰＥＧデコーダカード２、動画キャプチャ
カード３等の新規ＰＣカードが接続されていることが認
識されたとき、当該新規ＰＣカードを使用するモードＢ
を指定する“１”がセットされ、既存ＰＣカードが接続
されていることが認識されたとき、モードＡを指定する
“０”がセットされる。
トには、ＰＣＭＣＩＡドライバ（PCMCIA-DRV）１２Ａに
従うＣＰＵ１１の制御の下に、ＰＣＭＣＩＡカードスロ
ット１８にＭＰＥＧデコーダカード２、動画キャプチャ
カード３等の新規ＰＣカードが接続されていることが認
識されたとき、当該新規ＰＣカードを使用するモードＢ
を指定する“１”がセットされ、既存ＰＣカードが接続
されていることが認識されたとき、モードＡを指定する
“０”がセットされる。
【００２６】図５にレジスタ１６ｂの各ビットのアサイ
ンメントを示す。なお、上述したコンフィグレジスタ２
７も図５に示すビットアサインメントを持つ。図５に示
すようにビット０はビデオ制御ビットであり、このビッ
トに”１”がセットされると、上述したＭＰＥＧデコー
ダカード２や動画キャプチャカード３を使用するモード
が指定される。具体的には、ＭＰＥＧデコータカード２
からの伸張画像データが画像専用バス１９Ａを介してＭ
ＭＤＣ１７に供給される。また、ビット１はオーディオ
制御ビットであり、このビットに”１”がセットされる
と、ＭＰＥＧデコーダカード２、ビデオキャプチャカー
ド３あるいは図示しない例えばＭＩＤＩ(Musical Instr
ument Digital Inteface) カード等の音声信号のみを処
理するカードからの音声情報がオーディオ信号線１９Ｂ
を介してオーディオコントローラ１５に供給される。さ
らに、ビット７に”１”がセットされると”ゲートアレ
イで構成されたＰＣＭＣＩＡコントローラ１６がプログ
ラマブルであることを示す。このビット７はリードオン
リであり、例えばＰＣ本体のメーカー側で書き込みを行
う。
ンメントを示す。なお、上述したコンフィグレジスタ２
７も図５に示すビットアサインメントを持つ。図５に示
すようにビット０はビデオ制御ビットであり、このビッ
トに”１”がセットされると、上述したＭＰＥＧデコー
ダカード２や動画キャプチャカード３を使用するモード
が指定される。具体的には、ＭＰＥＧデコータカード２
からの伸張画像データが画像専用バス１９Ａを介してＭ
ＭＤＣ１７に供給される。また、ビット１はオーディオ
制御ビットであり、このビットに”１”がセットされる
と、ＭＰＥＧデコーダカード２、ビデオキャプチャカー
ド３あるいは図示しない例えばＭＩＤＩ(Musical Instr
ument Digital Inteface) カード等の音声信号のみを処
理するカードからの音声情報がオーディオ信号線１９Ｂ
を介してオーディオコントローラ１５に供給される。さ
らに、ビット７に”１”がセットされると”ゲートアレ
イで構成されたＰＣＭＣＩＡコントローラ１６がプログ
ラマブルであることを示す。このビット７はリードオン
リであり、例えばＰＣ本体のメーカー側で書き込みを行
う。
【００２７】切替制御回路（ＣＯＮＴ）１６ａは、レジ
スタ（Reg ）１６ｂのモード制御ビットの内容に従い、
通信等の既存ＰＣカードを使用するシステムバス１０経
由によるモードＡの端子接続と、高画質動画処理のため
のＭＰＥＧデコーダカード２、動画キャプチャカード３
等の新規ＰＣカードを使用する動画専用バス１９経由に
よるモードＢの端子接続とを切替えるバス切換制御機能
をもつ。この際のＰＣＭＣＩＡの各端子の切替内容の具
体例を図２及び図３に示している。
スタ（Reg ）１６ｂのモード制御ビットの内容に従い、
通信等の既存ＰＣカードを使用するシステムバス１０経
由によるモードＡの端子接続と、高画質動画処理のため
のＭＰＥＧデコーダカード２、動画キャプチャカード３
等の新規ＰＣカードを使用する動画専用バス１９経由に
よるモードＢの端子接続とを切替えるバス切換制御機能
をもつ。この際のＰＣＭＣＩＡの各端子の切替内容の具
体例を図２及び図３に示している。
【００２８】図６は切り替え制御回路１６ｂの詳細回路
図である。同図に示すように、切り替え制御回路１６ａ
は例えばマルチプレクサ等で実現されるスイッチ回路１
６ｃ、１６ｄを有している。スイッチ１６ｃはレジスタ
１６ｂのビット０が”０”のとき、図３に示すスタンダ
ートモードになる。すなわち、スイッチ１６ｃはバス１
６ｅをバス１６ｆに接続し、ＩＳＡバス１０介してＣＰ
Ｕ１１からのアドレスデータＡ７−２５がＰＣカード２
（３）に供給される。またレジスタ１６ｂのビット０
が”１”のとき図３に示すマルチメディアモードとな
る。すなわちスイッチ１６ｃはバス１６ｅを動画専用バ
ス１９Ａに接続し、８ビットの輝度信号Ｙ７−０、８ビ
ットの色信号ＵＶ７ー０、水平同期信号ＨＲＥＦ、垂直
同期信号ＶＳＹＮＣ、およびピクセルクロック信号ＰＣ
ＬＫがマルチメディアディスプレイコントローラ１７に
供給される。 この際図３に示すように上記８ビットの
輝度信号Ｙ７−０が図２に示すＰＣＭＣＩＡのピンアサ
インメントの４７番ピン（Ａ１８端子）及至５０番ピン
（Ａ２１端子）及び５３番ピン（Ａ２２端子）及至５６
番ピン（Ａ２５端子）を介して画像専用バス１９Ａ上に
出力される。また、８ビットの色信号ＵＶ７−０が図２
に示すＰＣＭＣＩＡピンアサインメントの８番ピン（Ａ
１０端子）、１０番ピン（Ａ１１端子）及至１４番ピン
（Ａ１４端子）、１９番ピン（Ａ１６端子）、２０番ピ
ン（Ａ１５端子）および４６番ピン（Ａ１７端子）を介
して画像専用バス１９Ａ上に出力される。さらに水平同
期信号ＨＲＥＦ、垂直同期信号ＶＳＹＮＣ、及びＰＣＬ
Ｋ信号がそれぞれ図２に示すＰＣＭＣＩＡピンアサイン
メントの１１番ピン（Ａ９端子）、１２番ピン（Ａ８端
子）および２２番ピン（Ａ２２端子）を介して画像専用
バス１９Ａに出力される。この実施例においては、アド
レスのＭＳＢ（Ａ２５）から順次マルチメディアモード
の信号（Ｙ７−０、ＵＶ７−０）、ＨＲＥＦ、ＶＳＹＮ
Ｃ、ＰＣＬＫ）をアサインすることにより既存のＰＣＭ
ＣＩＡ規格の端子を流用することによる不都合を生じな
いように構成されている。すなわち、図４に示すように
アドレスＡ７については、図２に示すＰＣＭＣＩＡピン
アサインメントの６番ピン（Ｄ７端子）を介して時分割
でアドレスデータを出力し、アドレスＡ８からＡ１５に
ついては図２に示すＰＣＭＣＩＡピンアサインメントの
６４番ピン（Ｄ８端子）及至６６番ピン（Ｄ１０端
子）、および３７番ピン（Ｄ１１端子）及至４１番ピン
（Ｄ１５端子）を介して時分割でアドレスデータを出力
し、アドレスＡ１６からＡ２０については３０番ピン
（Ｄ４端子）及至３２番ピン（Ｄ２端子）および２番ピ
ン（Ｄ３端子）及至３番ピン（Ｄ４端子）を介して時分
割でアドレスデータを出力するように構成されている。
このように、例えば上述した各マルチメディア信号をア
ドレス端子Ａ７及至Ａ２５を使用して出力しても、図４
に示すようにアドレスＡ０−２０をデータバスＤ０−１
５を介して時分割制御によりＭＰＥＧデコーダカード２
に供給するように構成されているので不都合は生じな
い。
図である。同図に示すように、切り替え制御回路１６ａ
は例えばマルチプレクサ等で実現されるスイッチ回路１
６ｃ、１６ｄを有している。スイッチ１６ｃはレジスタ
１６ｂのビット０が”０”のとき、図３に示すスタンダ
ートモードになる。すなわち、スイッチ１６ｃはバス１
６ｅをバス１６ｆに接続し、ＩＳＡバス１０介してＣＰ
Ｕ１１からのアドレスデータＡ７−２５がＰＣカード２
（３）に供給される。またレジスタ１６ｂのビット０
が”１”のとき図３に示すマルチメディアモードとな
る。すなわちスイッチ１６ｃはバス１６ｅを動画専用バ
ス１９Ａに接続し、８ビットの輝度信号Ｙ７−０、８ビ
ットの色信号ＵＶ７ー０、水平同期信号ＨＲＥＦ、垂直
同期信号ＶＳＹＮＣ、およびピクセルクロック信号ＰＣ
ＬＫがマルチメディアディスプレイコントローラ１７に
供給される。 この際図３に示すように上記８ビットの
輝度信号Ｙ７−０が図２に示すＰＣＭＣＩＡのピンアサ
インメントの４７番ピン（Ａ１８端子）及至５０番ピン
（Ａ２１端子）及び５３番ピン（Ａ２２端子）及至５６
番ピン（Ａ２５端子）を介して画像専用バス１９Ａ上に
出力される。また、８ビットの色信号ＵＶ７−０が図２
に示すＰＣＭＣＩＡピンアサインメントの８番ピン（Ａ
１０端子）、１０番ピン（Ａ１１端子）及至１４番ピン
（Ａ１４端子）、１９番ピン（Ａ１６端子）、２０番ピ
ン（Ａ１５端子）および４６番ピン（Ａ１７端子）を介
して画像専用バス１９Ａ上に出力される。さらに水平同
期信号ＨＲＥＦ、垂直同期信号ＶＳＹＮＣ、及びＰＣＬ
Ｋ信号がそれぞれ図２に示すＰＣＭＣＩＡピンアサイン
メントの１１番ピン（Ａ９端子）、１２番ピン（Ａ８端
子）および２２番ピン（Ａ２２端子）を介して画像専用
バス１９Ａに出力される。この実施例においては、アド
レスのＭＳＢ（Ａ２５）から順次マルチメディアモード
の信号（Ｙ７−０、ＵＶ７−０）、ＨＲＥＦ、ＶＳＹＮ
Ｃ、ＰＣＬＫ）をアサインすることにより既存のＰＣＭ
ＣＩＡ規格の端子を流用することによる不都合を生じな
いように構成されている。すなわち、図４に示すように
アドレスＡ７については、図２に示すＰＣＭＣＩＡピン
アサインメントの６番ピン（Ｄ７端子）を介して時分割
でアドレスデータを出力し、アドレスＡ８からＡ１５に
ついては図２に示すＰＣＭＣＩＡピンアサインメントの
６４番ピン（Ｄ８端子）及至６６番ピン（Ｄ１０端
子）、および３７番ピン（Ｄ１１端子）及至４１番ピン
（Ｄ１５端子）を介して時分割でアドレスデータを出力
し、アドレスＡ１６からＡ２０については３０番ピン
（Ｄ４端子）及至３２番ピン（Ｄ２端子）および２番ピ
ン（Ｄ３端子）及至３番ピン（Ｄ４端子）を介して時分
割でアドレスデータを出力するように構成されている。
このように、例えば上述した各マルチメディア信号をア
ドレス端子Ａ７及至Ａ２５を使用して出力しても、図４
に示すようにアドレスＡ０−２０をデータバスＤ０−１
５を介して時分割制御によりＭＰＥＧデコーダカード２
に供給するように構成されているので不都合は生じな
い。
【００２９】また、制御レジスタ１６ｂのビット１が”
１”にセットされると、スイッチ１６ｄはＰＣカード２
（３）の−ＳＰＫＲ端子と−ＩＮＰＡＣＫ端子をオーデ
ィオ信号線１９Ｂに接続する。この結果、オーディオ左
ＰＷＭ信号とオーディオ右ＰＷＭ信号がそれぞれ−ＳＰ
ＫＲ端子と−ＩＮＰＡＣＫ端子からオーディオ信号線１
９Ｂを介してオーディオコントローラ１５に供給され
る。１７はＭＰＥＧ、ＴＶ等の動画データ及び静止画デ
ータ（グラフィックスデータ）等の画像データを表示出
力制御するマルチメディアディスプレイコントローラ
（ＭＭＤＣ）であり、ビデオ表示制御回路（Video ）１
７ａ、グラフィックス表示制御回路（Graphics）１７
ｂ、マルチプレクサ（ＭＵＸ）１７ｃ等により構成され
る。
１”にセットされると、スイッチ１６ｄはＰＣカード２
（３）の−ＳＰＫＲ端子と−ＩＮＰＡＣＫ端子をオーデ
ィオ信号線１９Ｂに接続する。この結果、オーディオ左
ＰＷＭ信号とオーディオ右ＰＷＭ信号がそれぞれ−ＳＰ
ＫＲ端子と−ＩＮＰＡＣＫ端子からオーディオ信号線１
９Ｂを介してオーディオコントローラ１５に供給され
る。１７はＭＰＥＧ、ＴＶ等の動画データ及び静止画デ
ータ（グラフィックスデータ）等の画像データを表示出
力制御するマルチメディアディスプレイコントローラ
（ＭＭＤＣ）であり、ビデオ表示制御回路（Video ）１
７ａ、グラフィックス表示制御回路（Graphics）１７
ｂ、マルチプレクサ（ＭＵＸ）１７ｃ等により構成され
る。
【００３０】ビデオ表示制御回路（Video ）１７ａは、
ビデオデータを貯えるビデオバッファ、及び同バッファ
に貯えられたＹＵＶデータをＲＧＢ信号に変換するＹＵ
Ｖ−ＲＧＢ変換回路等をもつ。グラフィックス表示制御
回路（Graphics）１７ｂは、グラフィックスデータを貯
えるＲＡＭのアクセス機構、グラフィックスデータバッ
ファ等をもつ。マルチプレクサ（ＭＵＸ）１７ｃは、上
記ビデオ表示制御回路（Video ）又はグラフィックス表
示制御回路（Graphics）の出力データを選択し、表示出
力データとして標準装備されたＬＣＤ表示パネル（ＬＣ
Ｄ）、又は外部ＣＲＴモニタ（ＣＲＴ）に出力する。
ビデオデータを貯えるビデオバッファ、及び同バッファ
に貯えられたＹＵＶデータをＲＧＢ信号に変換するＹＵ
Ｖ−ＲＧＢ変換回路等をもつ。グラフィックス表示制御
回路（Graphics）１７ｂは、グラフィックスデータを貯
えるＲＡＭのアクセス機構、グラフィックスデータバッ
ファ等をもつ。マルチプレクサ（ＭＵＸ）１７ｃは、上
記ビデオ表示制御回路（Video ）又はグラフィックス表
示制御回路（Graphics）の出力データを選択し、表示出
力データとして標準装備されたＬＣＤ表示パネル（ＬＣ
Ｄ）、又は外部ＣＲＴモニタ（ＣＲＴ）に出力する。
【００３１】この際のＭＰＥＧを対象としたマルチメデ
ィアディスプレイコントローラの詳細な構成及び作用は
例えば特願平５−１２１３０５号（フレームバッファに
画像データを格納するマルチメディア表示制御システ
ム）に開示されているので、ここではその説明を省略す
る。
ィアディスプレイコントローラの詳細な構成及び作用は
例えば特願平５−１２１３０５号（フレームバッファに
画像データを格納するマルチメディア表示制御システ
ム）に開示されているので、ここではその説明を省略す
る。
【００３２】１８はＰＣＭＣＩＡカードスロットであ
り、ここでは、通信カード等の既存ＰＣカードの他に、
高画質動画処理のための、ＭＰＥＧデコーダカード２、
動画キャプチャカード３等の新規ＰＣカードが接続され
る。
り、ここでは、通信カード等の既存ＰＣカードの他に、
高画質動画処理のための、ＭＰＥＧデコーダカード２、
動画キャプチャカード３等の新規ＰＣカードが接続され
る。
【００３３】このＰＣＭＣＩＡカードスロット１８の端
子構成は図２に示され、当該端子の新規ＰＣカード使用
時に於ける各使用形態は図３に示される。１９ＡはＰＣ
ＭＣＩＡコントローラ（PCMCIA-CONT ）１６とマルチメ
ディアディスプレイコントローラ（ＭＭＤＣ）１７との
間に設けられた動画専用バスであり、ここでは、ＰＣＭ
ＣＩＡカードスロット１８の各端子のうち、図３に示す
１９端子（Ａ２５−１８，Ａ１７−１０，Ａ９，Ａ８，
Ａ７等）に相当する１９本の信号線により構成され、Ｐ
ＣＭＣＩＡコントローラ（PCMCIA-CONT ）１６の切替制
御回路（ＣＯＮＴ）１６ａから出力されるクロック及び
同期信号を含む動画データをダイレクトにマルチメディ
アディスプレイコントローラ（ＭＭＤＣ）１７のビデオ
表示制御回路（Video ）に高速転送する。この際の動画
専用バス１９Ａによる具体的な信号及び各信号の転送方
向は図３に示される。この動画専用バス１９Ａ上の具体
的な信号及び各信号の転送方向は後述する。
子構成は図２に示され、当該端子の新規ＰＣカード使用
時に於ける各使用形態は図３に示される。１９ＡはＰＣ
ＭＣＩＡコントローラ（PCMCIA-CONT ）１６とマルチメ
ディアディスプレイコントローラ（ＭＭＤＣ）１７との
間に設けられた動画専用バスであり、ここでは、ＰＣＭ
ＣＩＡカードスロット１８の各端子のうち、図３に示す
１９端子（Ａ２５−１８，Ａ１７−１０，Ａ９，Ａ８，
Ａ７等）に相当する１９本の信号線により構成され、Ｐ
ＣＭＣＩＡコントローラ（PCMCIA-CONT ）１６の切替制
御回路（ＣＯＮＴ）１６ａから出力されるクロック及び
同期信号を含む動画データをダイレクトにマルチメディ
アディスプレイコントローラ（ＭＭＤＣ）１７のビデオ
表示制御回路（Video ）に高速転送する。この際の動画
専用バス１９Ａによる具体的な信号及び各信号の転送方
向は図３に示される。この動画専用バス１９Ａ上の具体
的な信号及び各信号の転送方向は後述する。
【００３４】１９ＢはＰＣＭＣＩＡカードスロット１８
に動画キャプチャカード３が接続された際に、ＰＣＭＣ
ＩＡコントローラ（PCMCIA-CONT ）１６より出力される
２ビットのオーディオＰＷＭ信号（図３のＬＥＦＴ及び
ＲＩＧＨＴ信号）をオーディオコントローラ（Audio-CO
NT）１５に転送するオーディオ信号線である。この際の
オーディオ信号線１９Ｂ上の各信号及びその内容につい
ては後述する。
に動画キャプチャカード３が接続された際に、ＰＣＭＣ
ＩＡコントローラ（PCMCIA-CONT ）１６より出力される
２ビットのオーディオＰＷＭ信号（図３のＬＥＦＴ及び
ＲＩＧＨＴ信号）をオーディオコントローラ（Audio-CO
NT）１５に転送するオーディオ信号線である。この際の
オーディオ信号線１９Ｂ上の各信号及びその内容につい
ては後述する。
【００３５】図２は、ＰＣＭＣＩＡカードスロット１８
の各端子の内容を示す図であり、図３は、ＰＣＭＣＩＡ
カードスロット１８に、ＭＰＥＧデコーダカード２、又
は動画キャプチャカード３が接続された際の各端子の使
用形態を示す図である。
の各端子の内容を示す図であり、図３は、ＰＣＭＣＩＡ
カードスロット１８に、ＭＰＥＧデコーダカード２、又
は動画キャプチャカード３が接続された際の各端子の使
用形態を示す図である。
【００３６】ここでは図２に示すＰＣＭＣＩＡカードス
ロット１８の各端子のうち、ピン番号４７〜５０，５３
〜５６、８，１０〜１４，１９〜２２，４６、３３のＡ
２５−１８，Ａ１７−１０，Ａ９，Ａ８，Ａ７でなる１
９端子（図３参照）と、ピン番号６２，６３の−ＳＰＫ
Ｒ，−ＳＴＳＣＨＧでなる２端子（図３参照）の計２１
端子が信号切換えの対象となる。
ロット１８の各端子のうち、ピン番号４７〜５０，５３
〜５６、８，１０〜１４，１９〜２２，４６、３３のＡ
２５−１８，Ａ１７−１０，Ａ９，Ａ８，Ａ７でなる１
９端子（図３参照）と、ピン番号６２，６３の−ＳＰＫ
Ｒ，−ＳＴＳＣＨＧでなる２端子（図３参照）の計２１
端子が信号切換えの対象となる。
【００３７】ＰＣＭＣＩＡカードスロット１８に動画キ
ャプチャカード３が接続された際は、図３に示す１９端
子（Ａ２５−１８，Ａ１７−１０，Ａ９，Ａ８，Ａ７）
が、それぞれ動画キャプチャカード３からＰＣ本体１へ
の動画情報転送に供され、図３で示す２端子（−ＳＰＫ
Ｒ、−ＳＴＳＣＨＧ）が、それぞれ動画キャプチャカー
ド３からＰＣ本体１（オーディオコントローラ（Audio-
CONT）１５）への音声等、サウンドデータの転送に供さ
れる。
ャプチャカード３が接続された際は、図３に示す１９端
子（Ａ２５−１８，Ａ１７−１０，Ａ９，Ａ８，Ａ７）
が、それぞれ動画キャプチャカード３からＰＣ本体１へ
の動画情報転送に供され、図３で示す２端子（−ＳＰＫ
Ｒ、−ＳＴＳＣＨＧ）が、それぞれ動画キャプチャカー
ド３からＰＣ本体１（オーディオコントローラ（Audio-
CONT）１５）への音声等、サウンドデータの転送に供さ
れる。
【００３８】尚、図中、Ｙ７−０は８ビットの輝度信
号、ＵＶ７−０は同じく色信号、ＨＲＥＦは水平同期信
号、ＶＳＹＮＣは垂直同期信号、ＰＣＬＫはピクセルク
ロックである。又、ＬＥＦＴはオーディオレフトＰＷＭ
信号を、ＲＩＧＨＴはオーディオライトＰＷＭ信号をそ
れぞれ表す。
号、ＵＶ７−０は同じく色信号、ＨＲＥＦは水平同期信
号、ＶＳＹＮＣは垂直同期信号、ＰＣＬＫはピクセルク
ロックである。又、ＬＥＦＴはオーディオレフトＰＷＭ
信号を、ＲＩＧＨＴはオーディオライトＰＷＭ信号をそ
れぞれ表す。
【００３９】ＰＣＭＣＩＡカードスロット１８にＭＰＥ
Ｇデコーダカード２が接続された際は、図３に示す１９
端子（Ａ２５−１８，Ａ１７−１０，Ａ９，Ａ８，Ａ
７）と、信号切換えの対象には含まれないＡ６−０，Ｄ
１５−０がＰＣ本体１との間の動画データの授受に供さ
れる。ここではアドレス指定に２１ビットを必要とする
ので、図４に示すような、データライン（Ｄ１５−０）
を用いた時分割制御によるアドレス転送手段がＭＰＥＧ
インタフェース（Ｉ／Ｆ）２１に用意される。
Ｇデコーダカード２が接続された際は、図３に示す１９
端子（Ａ２５−１８，Ａ１７−１０，Ａ９，Ａ８，Ａ
７）と、信号切換えの対象には含まれないＡ６−０，Ｄ
１５−０がＰＣ本体１との間の動画データの授受に供さ
れる。ここではアドレス指定に２１ビットを必要とする
ので、図４に示すような、データライン（Ｄ１５−０）
を用いた時分割制御によるアドレス転送手段がＭＰＥＧ
インタフェース（Ｉ／Ｆ）２１に用意される。
【００４０】図４は、上記ＭＰＥＧデコーダカード２の
ＭＰＥＧインタフェース（Ｉ／Ｆ）２１に設けられたア
ドレスラッチ機構の構成を示す図である。図４に示すよ
うにマルチメディアモードにおけるＰＣ本体とＰＣカー
ドとの間のアドレスのやりとりは時分割制御によりデー
タバス（Ｄ１５−０）を介して行われる。これはマルチ
メディアモードにおいては動画データ（Ｙ７−０、ＵＶ
７−０）、ＨＲＥＦ、ＶＳＹＮＣ、ＰＣＬＫ）及びオー
ディオＰＷＭ信号がソレスピンＡ２５−７および−ＳＰ
ＫＲ、−ＩＮＰＡＣＫピンを介して転送されるため、そ
の間にアドレスを供給する必要が生じた場合には時分割
制御によりデータバス（Ｄ１５−０）を介してアドレス
をラッチするように構成されている。そして、アドレス
値が頻繁に変動する下位１６ビットとアドレス値が下位
ビットに比べて変動しない上位ビット（Ａ２０−１６）
とをラッチ回路２０２ａ、２０２ｃとライッチ回路２０
２ｂとに分け、デコーダ２０１のデコード出力（”０”
または”２”）によりいずれかが選択されるように構成
されている。ここでは図３に示すように、アドレス指定
に２１ビット（Ａ２０−０）を必要とすることから、Ｍ
ＰＥＧデコーダカード２内に、図４に示すようなデータ
ライン（Ｄ１５−０）を用いた時分割制御によるアドレ
ス転送手段が設けられる。ここでは、アドレスライン
（Ａ６−０）につながるデコーダ（ＤＥＣ）２０１に時
分割制御データを連続的に順次セットして、そのデコー
ド内容が“０”のとき、ラッチ回路（ＬＡＴＣＨ）２０
２ａ，２０２ｃに、それぞれ各８ビット（計１６ビッ
ト）のアドレス（Ａ７−０，Ａ１５−８）をラッチし、
デコード内容が“２”のとき、ラッチ回路（ＬＡＴＣ
Ｈ）２０２ｂに５ビットのアドレス（Ａ２０−１６）を
ラッチして、ＭＰＥＧデコーダ（ＭＰＥＧサウンドデコ
ーダ（MPEG Sound）２４、及びＭＰＥＧビデオデコーダ
（MPEG Video）２５）に供給している。アドレスライン
Ａ６−０を介してデコータ２０１に供給される時分割制
御データ例えばカードドライバにより供給される。
ＭＰＥＧインタフェース（Ｉ／Ｆ）２１に設けられたア
ドレスラッチ機構の構成を示す図である。図４に示すよ
うにマルチメディアモードにおけるＰＣ本体とＰＣカー
ドとの間のアドレスのやりとりは時分割制御によりデー
タバス（Ｄ１５−０）を介して行われる。これはマルチ
メディアモードにおいては動画データ（Ｙ７−０、ＵＶ
７−０）、ＨＲＥＦ、ＶＳＹＮＣ、ＰＣＬＫ）及びオー
ディオＰＷＭ信号がソレスピンＡ２５−７および−ＳＰ
ＫＲ、−ＩＮＰＡＣＫピンを介して転送されるため、そ
の間にアドレスを供給する必要が生じた場合には時分割
制御によりデータバス（Ｄ１５−０）を介してアドレス
をラッチするように構成されている。そして、アドレス
値が頻繁に変動する下位１６ビットとアドレス値が下位
ビットに比べて変動しない上位ビット（Ａ２０−１６）
とをラッチ回路２０２ａ、２０２ｃとライッチ回路２０
２ｂとに分け、デコーダ２０１のデコード出力（”０”
または”２”）によりいずれかが選択されるように構成
されている。ここでは図３に示すように、アドレス指定
に２１ビット（Ａ２０−０）を必要とすることから、Ｍ
ＰＥＧデコーダカード２内に、図４に示すようなデータ
ライン（Ｄ１５−０）を用いた時分割制御によるアドレ
ス転送手段が設けられる。ここでは、アドレスライン
（Ａ６−０）につながるデコーダ（ＤＥＣ）２０１に時
分割制御データを連続的に順次セットして、そのデコー
ド内容が“０”のとき、ラッチ回路（ＬＡＴＣＨ）２０
２ａ，２０２ｃに、それぞれ各８ビット（計１６ビッ
ト）のアドレス（Ａ７−０，Ａ１５−８）をラッチし、
デコード内容が“２”のとき、ラッチ回路（ＬＡＴＣ
Ｈ）２０２ｂに５ビットのアドレス（Ａ２０−１６）を
ラッチして、ＭＰＥＧデコーダ（ＭＰＥＧサウンドデコ
ーダ（MPEG Sound）２４、及びＭＰＥＧビデオデコーダ
（MPEG Video）２５）に供給している。アドレスライン
Ａ６−０を介してデコータ２０１に供給される時分割制
御データ例えばカードドライバにより供給される。
【００４１】ここで上記構成に於けるシステムの動作を
説明する。システムの初期化処理では、ＰＣＭＣＩＡ管
理プログラムに従うＣＰＵ１１の処理で、ＰＣＭＣＩＡ
カ−ドスロット１８に接続されているカ−ドの種類が認
識される。
説明する。システムの初期化処理では、ＰＣＭＣＩＡ管
理プログラムに従うＣＰＵ１１の処理で、ＰＣＭＣＩＡ
カ−ドスロット１８に接続されているカ−ドの種類が認
識される。
【００４２】ここで、ＰＣ本体１のＰＣＭＣＩＡカ−ド
スロット１８に、ＭＰＥＧデコ−ダカード２が接続され
ていることを認識すると、ＰＣＭＣＩＡドライバ（PCMC
IA-DRV）１２Ａの処理により、制御レジスタ１６ｂおよ
びコンフィグレジスタ２７の各ビット０が”０”にセッ
トされる。この結果、図６に示すスイッチ１６ｃにより
バス１６ｆとバス１６ｅが接続され、ＣＰＵ１１からの
アドレスがＩＳＡバス１０を介してＭＰＥＧデコーダカ
ード２に供給される。そして通常のＰＣＭＣＩＡ規格の
ピンアサインメントにもとずいてＣＤ−ＲＯＭ１４から
読みだした圧縮動画データおよびそれに付随するサウン
ドデータをカード２内のＲＡＭ２６に格納する。次に、
制御レジスタ１６ｂおよびコンフィグレジスタ２７の各
ビット０およびビット１を”１”にセットする。この結
果、図６に示すスイッチ１６ｃにより動画専用バス１９
Ａとバス１６ｅとが接続されるとともにスイッチ１６ｄ
により−ＩＮＰＡＣＫ端子と−ＳＰＫＲ端子とがオーデ
ィオ信号線１９Ｂに接続される。カード２はＲＡＭ２６
に格納された圧縮動画データ及び圧縮サウンドデータは
それぞれＲＭＰＥＧデコーダ（ＭＰＥＧサウンドデコー
ダ（MPEG Sound）２４、及びＭＰＥＧビデオデコーダ
（MPEG Video）２５）にて伸長処理し、ＰＣ本体１に返
す。この伸長処理された動画データは、ＰＣＭＣＩＡコ
ントローラ（PCMCIA-CONT ）１６の切替制御回路（ＣＯ
ＮＴ）１６ａによる図３に示す切り換え制御の下に、動
画専用バス１９Ａをダイレクトに経由して、マルチメデ
ィアディスプレイコントローラ（ＭＭＤＣ）１７に高速
転送され、標準装備されたＬＣＤ表示パネル（ＬＣ
Ｄ）、又は外部ＣＲＴモニタ（ＣＲＴ）に表示出力され
る。又、伸長処理されたサウンドデータは、オーディオ
信号線１９Ｂを介しオーディオコントローラ（Audio-CO
NT）１５に送られて、スピーカ（Speaker ）より出力さ
れる。
スロット１８に、ＭＰＥＧデコ−ダカード２が接続され
ていることを認識すると、ＰＣＭＣＩＡドライバ（PCMC
IA-DRV）１２Ａの処理により、制御レジスタ１６ｂおよ
びコンフィグレジスタ２７の各ビット０が”０”にセッ
トされる。この結果、図６に示すスイッチ１６ｃにより
バス１６ｆとバス１６ｅが接続され、ＣＰＵ１１からの
アドレスがＩＳＡバス１０を介してＭＰＥＧデコーダカ
ード２に供給される。そして通常のＰＣＭＣＩＡ規格の
ピンアサインメントにもとずいてＣＤ−ＲＯＭ１４から
読みだした圧縮動画データおよびそれに付随するサウン
ドデータをカード２内のＲＡＭ２６に格納する。次に、
制御レジスタ１６ｂおよびコンフィグレジスタ２７の各
ビット０およびビット１を”１”にセットする。この結
果、図６に示すスイッチ１６ｃにより動画専用バス１９
Ａとバス１６ｅとが接続されるとともにスイッチ１６ｄ
により−ＩＮＰＡＣＫ端子と−ＳＰＫＲ端子とがオーデ
ィオ信号線１９Ｂに接続される。カード２はＲＡＭ２６
に格納された圧縮動画データ及び圧縮サウンドデータは
それぞれＲＭＰＥＧデコーダ（ＭＰＥＧサウンドデコー
ダ（MPEG Sound）２４、及びＭＰＥＧビデオデコーダ
（MPEG Video）２５）にて伸長処理し、ＰＣ本体１に返
す。この伸長処理された動画データは、ＰＣＭＣＩＡコ
ントローラ（PCMCIA-CONT ）１６の切替制御回路（ＣＯ
ＮＴ）１６ａによる図３に示す切り換え制御の下に、動
画専用バス１９Ａをダイレクトに経由して、マルチメデ
ィアディスプレイコントローラ（ＭＭＤＣ）１７に高速
転送され、標準装備されたＬＣＤ表示パネル（ＬＣ
Ｄ）、又は外部ＣＲＴモニタ（ＣＲＴ）に表示出力され
る。又、伸長処理されたサウンドデータは、オーディオ
信号線１９Ｂを介しオーディオコントローラ（Audio-CO
NT）１５に送られて、スピーカ（Speaker ）より出力さ
れる。
【００４３】又、ＰＣＭＣＩＡカードスロット１８に動
画キャプチャカード３が接続された際も上記ＭＰＥＧデ
コーダカード２の場合と同様に、コンフィグレジスタ２
７のビット０およびビット１に、高画質動画処理のため
の新規ＰＣカードを使用する、特定カードインタフェー
ス仕様のモードＢを示す“１”がセットされ、更に、Ｐ
ＣＭＣＩＡコントローラ（PCMCIA-CONT ）１６に設けら
れた制御レジスタ（Reg ）１６ｂのモード制御ビット
（ビットＤ０，Ｄ１）に、同じく“１”がセットされ
る。この動画キャプチャカード３の場合は、ＴＶ、ＶＴ
Ｒ等の画像をＰＣ本体１に取り込み、上記ＭＰＥＧデコ
ーダカード２の場合と同様に、ＰＣＭＣＩＡコントロー
ラ（PCMCIA-CONT ）１６の切替制御回路（ＣＯＮＴ）１
６ａによる図３に示す切り換え制御の下に、動画専用バ
ス１９Ａをダイレクトに経由して、マルチメディアディ
スプレイコントローラ（ＭＭＤＣ）１７に高速転送さ
れ、標準装備されたＬＣＤ表示パネル（ＬＣＤ）、又は
外部ＣＲＴモニタ（ＣＲＴ）に表示出力される。
画キャプチャカード３が接続された際も上記ＭＰＥＧデ
コーダカード２の場合と同様に、コンフィグレジスタ２
７のビット０およびビット１に、高画質動画処理のため
の新規ＰＣカードを使用する、特定カードインタフェー
ス仕様のモードＢを示す“１”がセットされ、更に、Ｐ
ＣＭＣＩＡコントローラ（PCMCIA-CONT ）１６に設けら
れた制御レジスタ（Reg ）１６ｂのモード制御ビット
（ビットＤ０，Ｄ１）に、同じく“１”がセットされ
る。この動画キャプチャカード３の場合は、ＴＶ、ＶＴ
Ｒ等の画像をＰＣ本体１に取り込み、上記ＭＰＥＧデコ
ーダカード２の場合と同様に、ＰＣＭＣＩＡコントロー
ラ（PCMCIA-CONT ）１６の切替制御回路（ＣＯＮＴ）１
６ａによる図３に示す切り換え制御の下に、動画専用バ
ス１９Ａをダイレクトに経由して、マルチメディアディ
スプレイコントローラ（ＭＭＤＣ）１７に高速転送さ
れ、標準装備されたＬＣＤ表示パネル（ＬＣＤ）、又は
外部ＣＲＴモニタ（ＣＲＴ）に表示出力される。
【００４４】また、図示しないＭＩＤＩカードのように
音声信号のみを処理するカードが接続された場合にはコ
ンフィグレジスタ２７のビット１に”１”がセットさ
れ、さらに制御レジスタ１６ｂのビット１に”１”がセ
ットされる。この結果、ＭＩＤＩカードからのサウンド
データがオーディオ信号線１９Ｂを介してオーディオコ
ントローラ１９に供給される。
音声信号のみを処理するカードが接続された場合にはコ
ンフィグレジスタ２７のビット１に”１”がセットさ
れ、さらに制御レジスタ１６ｂのビット１に”１”がセ
ットされる。この結果、ＭＩＤＩカードからのサウンド
データがオーディオ信号線１９Ｂを介してオーディオコ
ントローラ１９に供給される。
【００４５】上記したように、カード接続口となるＰＣ
ＭＣＩＡカードスロット１８に、例えば通信カード等、
既存のカードが接続された際は、ＰＣＭＣＩＡコントロ
ーラ（PCMCIA-CONT ）１６の切替制御回路（ＣＯＮＴ）
１６ａが、ＰＣＭＣＩＡカードスロット１８とシステム
バス１０との間を選択的に接続し、ＰＣＭＣＩＡカード
スロット１８に接続されたカードに固有の例えば通信等
の機能拡張を可能にする。又、ＰＣＭＣＩＡカードスロ
ット１８に、高画質の画像処理機能をもつ、高速データ
転送を必要とする、ＭＰＥＧデコーダカード２、動画キ
ャプチャカード３等の新規なカードが接続された際は、
ＰＣＭＣＩＡコントローラ（PCMCIA-CONT ）１６の切替
制御回路（ＣＯＮＴ）１６ａが、ＰＣＭＣＩＡカードス
ロット１８と動画専用バス１９Ａとの間を選択的に接続
し、ＰＣＭＣＩＡカードスロット１８に接続された、Ｍ
ＰＥＧデコーダカード２、動画キャプチャカード３等に
固有の高画質画像処理機能の拡張を可能にする。
ＭＣＩＡカードスロット１８に、例えば通信カード等、
既存のカードが接続された際は、ＰＣＭＣＩＡコントロ
ーラ（PCMCIA-CONT ）１６の切替制御回路（ＣＯＮＴ）
１６ａが、ＰＣＭＣＩＡカードスロット１８とシステム
バス１０との間を選択的に接続し、ＰＣＭＣＩＡカード
スロット１８に接続されたカードに固有の例えば通信等
の機能拡張を可能にする。又、ＰＣＭＣＩＡカードスロ
ット１８に、高画質の画像処理機能をもつ、高速データ
転送を必要とする、ＭＰＥＧデコーダカード２、動画キ
ャプチャカード３等の新規なカードが接続された際は、
ＰＣＭＣＩＡコントローラ（PCMCIA-CONT ）１６の切替
制御回路（ＣＯＮＴ）１６ａが、ＰＣＭＣＩＡカードス
ロット１８と動画専用バス１９Ａとの間を選択的に接続
し、ＰＣＭＣＩＡカードスロット１８に接続された、Ｍ
ＰＥＧデコーダカード２、動画キャプチャカード３等に
固有の高画質画像処理機能の拡張を可能にする。
【００４６】尚、上記した実施例は、ＭＰＥＧデコーダ
カード２と、動画キャプチャカード３とを例に示した
が、これに限らず、他の高画質画像処理機能を実現する
カードについても上記実施例と同様に使用可能である。
カード２と、動画キャプチャカード３とを例に示した
が、これに限らず、他の高画質画像処理機能を実現する
カードについても上記実施例と同様に使用可能である。
【００４７】
【発明の効果】以上詳記したように本発明によれば、既
存の標準化されたシステムバスを用いて構成されたシス
テムに於いて、既存のオプションカードに加えて、高速
で動作する新規のオプションカードを用いた高画質の動
画処理機能を実現できる。
存の標準化されたシステムバスを用いて構成されたシス
テムに於いて、既存のオプションカードに加えて、高速
で動作する新規のオプションカードを用いた高画質の動
画処理機能を実現できる。
【００４８】又、既存の標準化されたバスを用いてオプ
ションカードを用いた高画質の動画処理機能と、既存の
オプションカードを用いたカードに固有の処理機能とを
簡単な構成にて両立させることができる。
ションカードを用いた高画質の動画処理機能と、既存の
オプションカードを用いたカードに固有の処理機能とを
簡単な構成にて両立させることができる。
【００４９】又、既存の標準化されたバス仕様による、
オプションカードスロットをもつシステムにて、高画質
の動画処理機能を容易に実現できるオプションカードが
提供できる。
オプションカードスロットをもつシステムにて、高画質
の動画処理機能を容易に実現できるオプションカードが
提供できる。
【図１】本発明の一実施例の構成を示すブロック図。
【図２】ＰＣＭＣＩＡカードスロットの各端子の内容を
示す図。
示す図。
【図３】上記実施例に於いて、ＰＣＭＣＩＡカードスロ
ットに、ＭＰＥＧデコーダカード、又は動画キャプチャ
カードが接続された際の各接続状態時に於ける、端子の
使用形態を示す図。
ットに、ＭＰＥＧデコーダカード、又は動画キャプチャ
カードが接続された際の各接続状態時に於ける、端子の
使用形態を示す図。
【図４】上記実施例に於けるＭＰＥＧデコーダカードの
ＭＰＥＧインタフェース（Ｉ／Ｆ）に於けるアドレスラ
ッチ機構の構成を示す図。
ＭＰＥＧインタフェース（Ｉ／Ｆ）に於けるアドレスラ
ッチ機構の構成を示す図。
【図５】図１に示す制御レジスタ１６ｂ及びコンフィグ
レジスタ２７のビットアサインメントを示す図。
レジスタ２７のビットアサインメントを示す図。
【図６】図１に示す切り替え制御回路１６ａの詳細回路
図。
図。
１…パーソナルコンピュータ本体（ＰＣ本体）、２…Ｍ
ＰＥＧデコーダカード、３…動画キャプチャカード、１
０…システムバス（ＩＳＡバス）、１１…ＣＰＵ、１２
…メインメモリ（主記憶）、１２…ＡＰＣＭＣＩＡドラ
イバ（PCMCIA-DRV）、１２Ａ…ＰＣＭＣＩＡドライバ
（PCMCIA-DRV）、１３…ハードディスク装置（ＨＤ
Ｄ）、１４…ＣＤ−ＲＯＭ、１５…オーディオコントロ
ーラ（Audio-CONT）、１５ａ…アナログ−ディジタルコ
ンバータ（Ａ／Ｄ）、１５ｂ…ディジタル−アナログコ
ンバータ（Ｄ／Ａ）、１５ｃ…マルチプレクサ、１５ｄ
・・・フィルタ、１６…ＰＣＭＣＩＡコントローラ（PC
MCIA-CONT ）、１６ａ…切換制御回路（ＣＯＮＴ）、１
６ｂ…制御レジスタ（Reg ）、１６ｃ，１６ｄ・・・・
スイッチ、１６ｅ，１６ｆ・・・バス、１７…マルチメ
ディアディスプレイコントローラ（ＭＭＤＣ）、１８…
ＰＣＭＣＩＡカードスロット、１９Ａ…動画専用バス、
１９Ｂ…オーディオ信号線、２１…ＭＰＥＧインタフェ
ース（Ｉ／Ｆ）、２２…ＣＩＳ（Card Information Str
ucture）、２３…ＣＯＲ（Configuration Option Regis
ter ）、２４…ＭＰＥＧサウンドデコーダ（MPEG Soun
d）、２５…ＭＰＥＧビデオデコーダ（MPEG Video）、
２６…ＲＡＭ、２７・・・コンフィグレジスタ（Config
uration Register）。
ＰＥＧデコーダカード、３…動画キャプチャカード、１
０…システムバス（ＩＳＡバス）、１１…ＣＰＵ、１２
…メインメモリ（主記憶）、１２…ＡＰＣＭＣＩＡドラ
イバ（PCMCIA-DRV）、１２Ａ…ＰＣＭＣＩＡドライバ
（PCMCIA-DRV）、１３…ハードディスク装置（ＨＤ
Ｄ）、１４…ＣＤ−ＲＯＭ、１５…オーディオコントロ
ーラ（Audio-CONT）、１５ａ…アナログ−ディジタルコ
ンバータ（Ａ／Ｄ）、１５ｂ…ディジタル−アナログコ
ンバータ（Ｄ／Ａ）、１５ｃ…マルチプレクサ、１５ｄ
・・・フィルタ、１６…ＰＣＭＣＩＡコントローラ（PC
MCIA-CONT ）、１６ａ…切換制御回路（ＣＯＮＴ）、１
６ｂ…制御レジスタ（Reg ）、１６ｃ，１６ｄ・・・・
スイッチ、１６ｅ，１６ｆ・・・バス、１７…マルチメ
ディアディスプレイコントローラ（ＭＭＤＣ）、１８…
ＰＣＭＣＩＡカードスロット、１９Ａ…動画専用バス、
１９Ｂ…オーディオ信号線、２１…ＭＰＥＧインタフェ
ース（Ｉ／Ｆ）、２２…ＣＩＳ（Card Information Str
ucture）、２３…ＣＯＲ（Configuration Option Regis
ter ）、２４…ＭＰＥＧサウンドデコーダ（MPEG Soun
d）、２５…ＭＰＥＧビデオデコーダ（MPEG Video）、
２６…ＲＡＭ、２７・・・コンフィグレジスタ（Config
uration Register）。
Claims (14)
- 【請求項１】 カード接続口と、このカード接続口に接
続されたカードとの間でデータを入出力制御するカード
コントローラと、動画データの表示処理機能をもつディ
スプレイコントローラと、上記各コントローラ相互の間
に設けられた動画専用バスと、上記各コントローラが接
続されるシステムバスと、上記カードコントローラ内に
あって、カード接続口と動画専用バスとの間又はカード
接続口とシステムバスとの間を選択的に接続する切換制
御回路とを具備してなることを特徴とするポータブルコ
ンピュータ。 - 【請求項２】 カード接続口と、このカード接続口に接
続されたカードとの間でデータを入出力制御するカード
コントローラと、動画データの表示処理機能をもつディ
スプレイコントローラと、上記動画データに付随する音
声情報を入出力制御するオーディオコントローラと、上
記各コントローラが接続されるシステムバスと、上記カ
ードコントローラとディスプレイコントローラとの間に
設けられた動画専用バスと、上記カードコントローラと
オーディオコントローラとの間に設けられたオーディオ
信号線と、上記カードコントローラ内に設けられ、上位
処理装置の切換接続指示に従い、カード接続口とシステ
ムバスとの間、又は、カード接続口と動画専用バス及び
オーディオ信号線との間を選択的に接続する切換制御回
路とを具備してなることを特徴とするポータブルコンピ
ュータ。 - 【請求項３】 カード接続口と、このカード接続口に接
続されたカードとの間でデータを入出力制御するカード
コントローラと、動画データの表示処理機能をもつディ
スプレイコントローラと、上記動画データに付随するサ
ウンドデータを入出力制御するオーディオコントローラ
と、上記各コントローラ及び大容量記憶装置が接続され
るシステムバスと、上記カードコントローラとディスプ
レイコントローラとの間に設けられた動画専用バスと、
上記カードコントローラとオーディオコントローラとの
間に設けられたオーディオ信号線と、カード接続口に接
続されたカードの種類を認識し、高画質の動画処理機能
をもたないカードが接続されたことを認識したとき、通
常のカードインタフェース仕様を示すモードＡの指示を
出し、高画質の動画処理機能をもつカードが接続された
ことを認識したとき、特定のカードインタフェース仕様
を示すモードＢの指示を出す手段と、上記カードコント
ローラ内に設けられ、モードＡの指示に従い、カード接
続口とシステムバスとの間を選択的に接続し、モードＢ
の指示に従い、カード接続口と動画専用バス及びオーデ
ィオ信号線との間を所定の信号割付けにより選択的に接
続する切換制御回路とを具備してなることを特徴とする
ポータブルコンピュータ。 - 【請求項４】 動画専用バスには、動画データと、同期
信号と、クロック信号の各転送路が設けられる請求項１
又は２又は３記載のポータブルコンピュータ。 - 【請求項５】 カードコントローラ内の切換制御回路
は、同コントローラ内部に設けられたレジスタの設定に
従い切換制御される請求項１又は２又は３記載のポータ
ブルコンピュータ。 - 【請求項６】 カードコントローラ内のレジスタには、
カード接続口に接続されたカードの認識種別に従う情報
が設定される請求項５記載のポータブルコンピュータ。 - 【請求項７】 カード接続口はＰＣＭＣＩＡ規格に準拠
する端子構造をなし、レジスタの設定内容に従い、予め
定められた複数の端子が異なる使用形態となる請求項５
記載のポータブルコンピュータ。 - 【請求項８】 ポータブルコンピュータ本体のカード接
続口に接続されるカードであって、上記本体より特定の
値が設定されるレジスタと、このレジスタに特定の値が
設定されたとき、カードコネクタの端子使用形態を切替
制御する手段とを具備してなることを特徴とするポータ
ブルコンピュータに用いられるカード。 - 【請求項９】 前記ポータブルコンピュータ本体とカー
ドとの間で転送されるアドレスをラッチするアドレスラ
ッチ回路を有し、データバスを用いて前記アドレスを時
分割制御により転送することを特徴とする請求項８記載
のカード。 - 【請求項１０】 前記アドレスを上位ビットと下位ビッ
トに分け、それぞれ異なるラッチ回路にラッチし、いず
れかのラッチ回路選択する選択手段をさらに有すること
を特徴とする請求項９記載のカード。 - 【請求項１１】 カード接続口と、このカード接続口に
接続されたカードとの間でデータを入出力制御するカー
ドコントローラと、動画データの表示処理機能をもつデ
ィスプレイコントローラと、上記カードからの音声情報
を入出力制御するオーディオコントローラと、上記各コ
ントローラが接続されるシステムバスと、上記カードコ
ントローラとディスプレイコントローラとの間に設けら
れた動画専用バスと、上記カードコントローラとオーデ
ィオコントローラとの間に設けられたオーディオ信号線
と、上記カードコントローラ内に設けられ、上位処理装
置の切換接続指示に従い、カード接続口とシステムバス
との間、又は、カード接続口と動画専用バス及びオーデ
ィオ信号線との間を選択的に接続する切換制御回路とを
具備してなることを特徴とするポータブルコンピュー
タ。 - 【請求項１２】 前記カードから供給される音声情報は
ＰＷＭ(Pulse WidthModulation)信号であり、前記オー
ディオコントローラは前記ＰＷＭ信号をアナログ信号に
変換するフィルタを備えていることを特徴とする請求項
１１に記載のポータブルコンピュータ。 - 【請求項１３】 前記カードはＰＣＭＣＩＡ規格にもと
ずくカードであり、前記カードからの動画データはアド
レスピンを介して供給され、前記カードからの音声情報
はデデジタル音声信号ピンおよびリザーブピンを介して
出力されることを特徴とする請求項１１に記載のポータ
ブルコンピュータ。 - 【請求項１４】 前記動画データは輝度信号（Ｙ７−
０）、色信号（ＵＶ７−０）、水平同期信号（ＨＲＥ
Ｆ）、垂直同期信号（ＶＳＹＮＣ）、およびピクセルク
ロック信号（ＰＣＬＫ）であり、前記音声情報はオーデ
ィオ左ＰＷＭ信号およびオーディオ右ＰＷＭ信号であ
り、前記動画データをＰＣＭＣＩＡ規格のアドレスピン
（Ａ２５ー７）に割当、前記音声情報をＰＣＭＣＩＡ規
格の−ＳＰＫＲピンおよび−ＩＮＰＡＣＫピンに割り当
てたことを特徴とする請求項１３に記載のポータブルコ
ンピュータ。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03863095A JP3272896B2 (ja) | 1995-02-27 | 1995-02-27 | ポータブルコンピュータおよびそれに用いられるカード |
| US08/458,690 US5826044A (en) | 1994-06-06 | 1995-06-02 | Display control system having a PCMCIA interface |
| US08/890,347 US5907686A (en) | 1994-06-06 | 1997-07-09 | Display control system having a PCMCIA interface |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03863095A JP3272896B2 (ja) | 1995-02-27 | 1995-02-27 | ポータブルコンピュータおよびそれに用いられるカード |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08234931A true JPH08234931A (ja) | 1996-09-13 |
| JP3272896B2 JP3272896B2 (ja) | 2002-04-08 |
Family
ID=12530566
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03863095A Expired - Fee Related JP3272896B2 (ja) | 1994-06-06 | 1995-02-27 | ポータブルコンピュータおよびそれに用いられるカード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3272896B2 (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19980080890A (ko) * | 1997-03-31 | 1998-11-25 | 이데이노부유키 | 전자 장치 |
| KR20010044324A (ko) * | 2001-02-06 | 2001-06-05 | 이완근 | Pda용 공중파 tv 수신방법, 장치 및 이를 이용한영상표시장치 |
| US6297794B1 (en) | 1996-10-11 | 2001-10-02 | Kabushiki Kaisha Toshiba | Method of switching video sources and computer system employing this method |
| US7103057B2 (en) | 2000-08-01 | 2006-09-05 | Kabushiki Kaisha Toshiba | Information processing apparatus and communication function expansion method |
| US7621769B1 (en) | 2004-04-09 | 2009-11-24 | Nvidia Corporation | Edge connector for field changeable graphics system |
| JP2010517399A (ja) * | 2007-01-25 | 2010-05-20 | ソニー エリクソン モバイル コミュニケーションズ， エービー | コンフィギュラブル・シリアルメモリインタフェース |
-
1995
- 1995-02-27 JP JP03863095A patent/JP3272896B2/ja not_active Expired - Fee Related
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6297794B1 (en) | 1996-10-11 | 2001-10-02 | Kabushiki Kaisha Toshiba | Method of switching video sources and computer system employing this method |
| KR19980080890A (ko) * | 1997-03-31 | 1998-11-25 | 이데이노부유키 | 전자 장치 |
| US7103057B2 (en) | 2000-08-01 | 2006-09-05 | Kabushiki Kaisha Toshiba | Information processing apparatus and communication function expansion method |
| KR20010044324A (ko) * | 2001-02-06 | 2001-06-05 | 이완근 | Pda용 공중파 tv 수신방법, 장치 및 이를 이용한영상표시장치 |
| US7621769B1 (en) | 2004-04-09 | 2009-11-24 | Nvidia Corporation | Edge connector for field changeable graphics system |
| JP2010134949A (ja) * | 2004-04-09 | 2010-06-17 | Nvidia Corp | フィールドチェンジアブルグラフィックシステム |
| JP2010517399A (ja) * | 2007-01-25 | 2010-05-20 | ソニー エリクソン モバイル コミュニケーションズ， エービー | コンフィギュラブル・シリアルメモリインタフェース |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3272896B2 (ja) | 2002-04-08 |
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