JPH08228302A - 水平リニアリティ補正方式 - Google Patents
水平リニアリティ補正方式Info
- Publication number
- JPH08228302A JPH08228302A JP3331095A JP3331095A JPH08228302A JP H08228302 A JPH08228302 A JP H08228302A JP 3331095 A JP3331095 A JP 3331095A JP 3331095 A JP3331095 A JP 3331095A JP H08228302 A JPH08228302 A JP H08228302A
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- JP
- Japan
- Prior art keywords
- data
- horizontal
- frame memory
- horizontal linearity
- memory
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- Pending
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- Details Of Television Scanning (AREA)
Abstract
(57)【要約】
【構成】表示画面を記憶するフレームメモリと、水平リ
ニアリティの補正デジタル制御データを記憶保持する手
段と、前記フレームメモリから表示データを読出す速度
を可変制御する手段を有し、前記制御データと入力同期
信号により前記フレームメモリから表示データを読出す
速度を可変制御することにより管面全体にわたって画素
間隔を等しくするよう制御する。 【効果】対応する水平周波数範囲において良好な水平リ
ニアリティ補正を行うことが出来る。
ニアリティの補正デジタル制御データを記憶保持する手
段と、前記フレームメモリから表示データを読出す速度
を可変制御する手段を有し、前記制御データと入力同期
信号により前記フレームメモリから表示データを読出す
速度を可変制御することにより管面全体にわたって画素
間隔を等しくするよう制御する。 【効果】対応する水平周波数範囲において良好な水平リ
ニアリティ補正を行うことが出来る。
Description
【０００１】
【産業上の利用分野】本発明は、ＣＲＴディスプレイモ
ニタの水平リニアリティ補正に関する。
ニタの水平リニアリティ補正に関する。
【０００２】
【従来の技術】近年、ＣＲＴディスプレイモニタは画面
の平面化が進むとともに、多種の水平，垂直周波数に追
従しながら表示を行うマルチスキャンタイプの需要が伸
びてきており、それに対応した水平リニアリティ補正が
必要となってきた。
の平面化が進むとともに、多種の水平，垂直周波数に追
従しながら表示を行うマルチスキャンタイプの需要が伸
びてきており、それに対応した水平リニアリティ補正が
必要となってきた。
【０００３】以下、従来の技術について説明する。
【０００４】図２は、従来のＣＲＴディスプレイモニタ
の全体を示すブロック図である。図において、１は映像
信号、５は水平同期信号、６は垂直同期信号、１４はビ
デオ出力回路、１５は垂直偏向回路、１６は水平偏向回
路、１７は高圧回路、１８は垂直偏向コイル、１９は水
平偏向コイル、２０はＣＲＴである。
の全体を示すブロック図である。図において、１は映像
信号、５は水平同期信号、６は垂直同期信号、１４はビ
デオ出力回路、１５は垂直偏向回路、１６は水平偏向回
路、１７は高圧回路、１８は垂直偏向コイル、１９は水
平偏向コイル、２０はＣＲＴである。
【０００５】従来の水平偏向回路として、ＮＨＫ カラ
ーテレビ教科書［上］（昭和５９年５月１０日発行）の
第１６８頁から第１８２頁に記載されているものが挙げ
られる。図３は、この従来の水平偏向回路１６を示すも
のである。図３において、２２は水平出力トランジス
タ、２３はダンパダイオード、２４は共振コンデンサ、
２５は水平リニアリティコイル、２６は水平補正コンデ
ンサ、２７はフライバックトランス、２８は電源を示
す。
ーテレビ教科書［上］（昭和５９年５月１０日発行）の
第１６８頁から第１８２頁に記載されているものが挙げ
られる。図３は、この従来の水平偏向回路１６を示すも
のである。図３において、２２は水平出力トランジス
タ、２３はダンパダイオード、２４は共振コンデンサ、
２５は水平リニアリティコイル、２６は水平補正コンデ
ンサ、２７はフライバックトランス、２８は電源を示
す。
【０００６】次に、動作について説明する。水平出力ト
ランジスタ２２が、水平周波数でオン／オフさせること
により、この水平出力トランジスタ２２は電源２８から
フライバックトランス２７を介して加えられる電源電圧
をスイッチングする。これにより水平出力トランジスタ
２２の電流とダンパダイオード２３、及び、共振コンデ
ンサ２４の電流とが交互に水平偏向コイル１９を流れ、
これにより発生する磁界によって電子ビームをＣＲＴの
水平方向に走査させることができる。
ランジスタ２２が、水平周波数でオン／オフさせること
により、この水平出力トランジスタ２２は電源２８から
フライバックトランス２７を介して加えられる電源電圧
をスイッチングする。これにより水平出力トランジスタ
２２の電流とダンパダイオード２３、及び、共振コンデ
ンサ２４の電流とが交互に水平偏向コイル１９を流れ、
これにより発生する磁界によって電子ビームをＣＲＴの
水平方向に走査させることができる。
【０００７】このような水平偏向回路では、主に、２種
類の水平直線性（リニアリティ）悪化要因がある。一つ
は、ＣＲＴの蛍光面の曲率の中心と偏向中心が異なるた
めに発生する、画面中央で縮み、左右両端で伸びるとい
うものであり、他の一つは、出力回路内の直列抵抗によ
る時定数によって偏向電流の直線性が失われるために生
じる、画面左側が伸び、画面右側が縮むというものであ
る。
類の水平直線性（リニアリティ）悪化要因がある。一つ
は、ＣＲＴの蛍光面の曲率の中心と偏向中心が異なるた
めに発生する、画面中央で縮み、左右両端で伸びるとい
うものであり、他の一つは、出力回路内の直列抵抗によ
る時定数によって偏向電流の直線性が失われるために生
じる、画面左側が伸び、画面右側が縮むというものであ
る。
【０００８】この為、従来は、前者についてはＳ字補正
コンデンサ２６によって左右で画面が縮むような偏向電
流を発生し、後者については、水平偏向コイルに直列に
インダクタンス特性の可飽和リアクタ２５（水平リニア
リティコイル）を接続することにより、画面の左側で縮
み、画面の右側で伸びるような偏向電流を発生し水平方
向の二つの歪を補正している。
コンデンサ２６によって左右で画面が縮むような偏向電
流を発生し、後者については、水平偏向コイルに直列に
インダクタンス特性の可飽和リアクタ２５（水平リニア
リティコイル）を接続することにより、画面の左側で縮
み、画面の右側で伸びるような偏向電流を発生し水平方
向の二つの歪を補正している。
【０００９】また、他の従来の技術として、特開平２−
１３１７６号公報を挙げることが出来る。この従来技術
について以下に説明する。管面の形状に対応したデジタ
ル制御データを保持しこのデジタル制御データに対応し
た制御信号を送出する制御手段と、この制御手段からの
制御信号を基に管面に対する水平偏向ビームの単位時間
当りの走査距離が管面全体で等しくなる補正水平偏向電
流を水平偏向コイルに供給する偏向電流供給手段を有
し、デジタル制御データに対応した制御信号を偏向電流
供給手段へ送出して補正水平偏向電流を水平偏向コイル
に供給させ、管面に対し単位時間当りの走査距離が等し
くなる水平偏向ビームを発生させ水平リニアリティを補
正する。
１３１７６号公報を挙げることが出来る。この従来技術
について以下に説明する。管面の形状に対応したデジタ
ル制御データを保持しこのデジタル制御データに対応し
た制御信号を送出する制御手段と、この制御手段からの
制御信号を基に管面に対する水平偏向ビームの単位時間
当りの走査距離が管面全体で等しくなる補正水平偏向電
流を水平偏向コイルに供給する偏向電流供給手段を有
し、デジタル制御データに対応した制御信号を偏向電流
供給手段へ送出して補正水平偏向電流を水平偏向コイル
に供給させ、管面に対し単位時間当りの走査距離が等し
くなる水平偏向ビームを発生させ水平リニアリティを補
正する。
【００１０】
【発明が解決しようとする課題】上述した前者の従来の
水平偏向回路では、Ｓ字コンデンサによる補正量はＳ字
コンデンサの容量に依存し、また、水平リニアリティコ
イルの特性は、変えることが出来ない為、対応する水平
周波数範囲の広いマルチスキャンタイプのディスプレイ
モニタでは全周波数帯について良好な補正を行うことが
出来ないという課題があった。一方、後者の従来の水平
偏向回路は偏向電流供給手段が複雑となる、また、制御
する電力が大きい為回路的損失が大きくなり発熱等の問
題がある。本発明の目的は、対応周波数範囲の全域で良
好な水平リニアリティの補正が行える水平リニアリティ
補正方式を提供することにある。
水平偏向回路では、Ｓ字コンデンサによる補正量はＳ字
コンデンサの容量に依存し、また、水平リニアリティコ
イルの特性は、変えることが出来ない為、対応する水平
周波数範囲の広いマルチスキャンタイプのディスプレイ
モニタでは全周波数帯について良好な補正を行うことが
出来ないという課題があった。一方、後者の従来の水平
偏向回路は偏向電流供給手段が複雑となる、また、制御
する電力が大きい為回路的損失が大きくなり発熱等の問
題がある。本発明の目的は、対応周波数範囲の全域で良
好な水平リニアリティの補正が行える水平リニアリティ
補正方式を提供することにある。
【００１１】
【課題を解決するための手段】表示画面を記憶するフレ
ームメモリと、水平リニアリティ歪によって発生する画
素間隔の差を補正する為のフレームメモリからの表示デ
ータ読出し速度を補正するデジタル制御データを記憶保
持する手段と、前記フレームメモリから表示データを読
出す速度を可変制御する手段を有し、前記制御データと
入力同期信号により前記フレームメモリから表示データ
を読出す速度を可変制御することにより管面全体にわた
って画素間隔を等しくするように制御する。
ームメモリと、水平リニアリティ歪によって発生する画
素間隔の差を補正する為のフレームメモリからの表示デ
ータ読出し速度を補正するデジタル制御データを記憶保
持する手段と、前記フレームメモリから表示データを読
出す速度を可変制御する手段を有し、前記制御データと
入力同期信号により前記フレームメモリから表示データ
を読出す速度を可変制御することにより管面全体にわた
って画素間隔を等しくするように制御する。
【００１２】
【作用】フレームメモリからの表示データの読出し速度
を表示データ読出し速度補正デジタル制御データと入力
同期信号から決定し可変制御することにより、水平リニ
アリティ歪によって発生する表示画素間隔の不均一を補
正し管面全体にわたって画素の間隔を等しくすることが
でき、対応する水平周波数範囲において良好な水平リニ
アリティ補正を行うことが出来る。
を表示データ読出し速度補正デジタル制御データと入力
同期信号から決定し可変制御することにより、水平リニ
アリティ歪によって発生する表示画素間隔の不均一を補
正し管面全体にわたって画素の間隔を等しくすることが
でき、対応する水平周波数範囲において良好な水平リニ
アリティ補正を行うことが出来る。
【００１３】
【実施例】以下、本発明の一実施例について説明する。
図１は本発明の一実施例の全体を示すブロック図であ
る。
図１は本発明の一実施例の全体を示すブロック図であ
る。
【００１４】図中、２は、入力された映像信号１をＡ／
Ｄ変換するＡ／Ｄ変換回路、３はＡ／Ｄ変換回路２から
出力されるデジタル信号、４は映像信号をＡ／Ｄ変換し
たデータを記憶するフレームメモリ、７はフレームメモ
リからの表示データの読出し速度を補正するデータを記
憶保持する読出し速度補正メモリ、８は入力同期信号に
対応した基準クロック２１を発生する基準クロック発生
回路であり、基準クロックは、それぞれ、フレームメモ
リ４と読出し速度補正メモリ７に入力される。
Ｄ変換するＡ／Ｄ変換回路、３はＡ／Ｄ変換回路２から
出力されるデジタル信号、４は映像信号をＡ／Ｄ変換し
たデータを記憶するフレームメモリ、７はフレームメモ
リからの表示データの読出し速度を補正するデータを記
憶保持する読出し速度補正メモリ、８は入力同期信号に
対応した基準クロック２１を発生する基準クロック発生
回路であり、基準クロックは、それぞれ、フレームメモ
リ４と読出し速度補正メモリ７に入力される。
【００１５】９は読出し速度補正メモリ７から読出させ
たデータをＤ／Ａ変換するＤ／Ａ変換回路、１０はフィ
ルタ、１１は入力電圧に比例してクロック周波数を可変
するオシレータであるＶＣＯ、１２はＶＣＯから出力さ
れるクロック信号、１３はフレームメモリ４から読出さ
れたデジタルデータをＤ／Ａ変換するＤ／Ａ変換回路、
２１は、基準クロックである。
たデータをＤ／Ａ変換するＤ／Ａ変換回路、１０はフィ
ルタ、１１は入力電圧に比例してクロック周波数を可変
するオシレータであるＶＣＯ、１２はＶＣＯから出力さ
れるクロック信号、１３はフレームメモリ４から読出さ
れたデジタルデータをＤ／Ａ変換するＤ／Ａ変換回路、
２１は、基準クロックである。
【００１６】以下、図１の回路動作について説明する。
【００１７】基準クロック発生回路は、入力同期信号に
対応した基準クロック２１を発生し、基準クロック２１
をそれぞれフレームメモリ４と読出し速度補正メモリ７
に出力する。フレームメモリ４は基準クロック２１に同
期して、入力された映像信号１がＡ／Ｄ変換回路２でＡ
／Ｄ変換されたデータを、逐次、記憶する。一方、読出
し速度補正メモリ７からは基準クロック２１に同期して
読出し速度補正データが読出され、Ｄ／Ａ変換回路９に
入力される。読出し速度補正メモリ７には、水平方向の
リニアリティ歪によって発生する画素間隔の差を補正す
る為の、フレームメモリ４からの表示データ読出し速度
補正データが、予め、記憶保持されている。Ｄ／Ａ変換
回路９では、受け取ったデータをＤ／Ａ変換し、フィル
タ１０でフィルタリングし、ＶＣＯ１１に入力される。
ＶＣＯ１１では、入力電圧に対応した周波数のクロック
１２を生成し、フレームメモリ４に入力する。このクロ
ック１２に同期してフレームメモリ４から表示データが
読出される。読み出されたデータはＤ／Ａ変換回路１３
でＤ／Ａ変換されビデオ出力回路１４に送出される。
対応した基準クロック２１を発生し、基準クロック２１
をそれぞれフレームメモリ４と読出し速度補正メモリ７
に出力する。フレームメモリ４は基準クロック２１に同
期して、入力された映像信号１がＡ／Ｄ変換回路２でＡ
／Ｄ変換されたデータを、逐次、記憶する。一方、読出
し速度補正メモリ７からは基準クロック２１に同期して
読出し速度補正データが読出され、Ｄ／Ａ変換回路９に
入力される。読出し速度補正メモリ７には、水平方向の
リニアリティ歪によって発生する画素間隔の差を補正す
る為の、フレームメモリ４からの表示データ読出し速度
補正データが、予め、記憶保持されている。Ｄ／Ａ変換
回路９では、受け取ったデータをＤ／Ａ変換し、フィル
タ１０でフィルタリングし、ＶＣＯ１１に入力される。
ＶＣＯ１１では、入力電圧に対応した周波数のクロック
１２を生成し、フレームメモリ４に入力する。このクロ
ック１２に同期してフレームメモリ４から表示データが
読出される。読み出されたデータはＤ／Ａ変換回路１３
でＤ／Ａ変換されビデオ出力回路１４に送出される。
【００１８】この結果、ＣＲＴの蛍光面の曲率の中心と
偏向中心が異なるために発生する、画面中央で縮み、左
右両端で伸びる歪と、出力回路内の直列抵抗によって偏
向電流の直線性が失われるために生じる、画面左側が伸
び、画面右側が縮む歪等による表示画素間隔の不均一
を、フレームメモリ４からの表示データの読出し速度を
表示データの読出し毎に変え、ビデオ出力回路に入力
し、出力表示画素間隔を調節することにより補正する。
偏向中心が異なるために発生する、画面中央で縮み、左
右両端で伸びる歪と、出力回路内の直列抵抗によって偏
向電流の直線性が失われるために生じる、画面左側が伸
び、画面右側が縮む歪等による表示画素間隔の不均一
を、フレームメモリ４からの表示データの読出し速度を
表示データの読出し毎に変え、ビデオ出力回路に入力
し、出力表示画素間隔を調節することにより補正する。
【００１９】
【発明の効果】本発明では、フレームメモリからの表示
データの読出し速度を水平リニアリティの補正デジタル
制御データと入力同期信号から決定、可変制御し管面全
体にわたって画素間隔を等しくすることにより、対応す
る水平周波数範囲について良好な水平リニアリティ補正
を行うことが出来る。
データの読出し速度を水平リニアリティの補正デジタル
制御データと入力同期信号から決定、可変制御し管面全
体にわたって画素間隔を等しくすることにより、対応す
る水平周波数範囲について良好な水平リニアリティ補正
を行うことが出来る。
【００２０】加えて、従来の水平偏向回路でのリニアリ
ティ補正の為に使用されていたＳ字コンデンサ、及び、
水平リニアリティコイルを削減出来、偏向回路の簡略化
が図れる。
ティ補正の為に使用されていたＳ字コンデンサ、及び、
水平リニアリティコイルを削減出来、偏向回路の簡略化
が図れる。
【図１】実施例の全体を示すブロック図。
【図２】従来のＣＲＴディスプレイモニタの全体を示す
ブロック図。
ブロック図。
【図３】従来の水平偏向の回路図。
１…映像信号、２…Ａ／Ｄ変換回路、３…デジタル信
号、４…フレームメモリ、５…水平同期信号、６…垂直
同期信号、７…読出し速度補正メモリ、８…メモリ読出
し制御回路、９…Ｄ／Ａ変換回路、１０…フィルタ、１
１…ＶＣＯ、１２…クロック信号、１３…Ｄ／Ａ変換回
路、１４…ビデオ出力回路、１５…垂直偏向回路、１６
…水平偏向回路、１７…高圧回路、１８…垂直偏向コイ
ル、１９…水平偏向コイル、２０…ＣＲＴ。
号、４…フレームメモリ、５…水平同期信号、６…垂直
同期信号、７…読出し速度補正メモリ、８…メモリ読出
し制御回路、９…Ｄ／Ａ変換回路、１０…フィルタ、１
１…ＶＣＯ、１２…クロック信号、１３…Ｄ／Ａ変換回
路、１４…ビデオ出力回路、１５…垂直偏向回路、１６
…水平偏向回路、１７…高圧回路、１８…垂直偏向コイ
ル、１９…水平偏向コイル、２０…ＣＲＴ。
Claims (1)
- 【請求項１】表示画面を記憶するフレームメモリと、水
平リニアリティの補正デジタル制御データを記憶保持す
る手段と、前記フレームメモリから表示データを読出す
速度を可変制御する手段を有し、前記制御データと入力
同期信号により前記フレームメモリからの表示データの
読出し速度を可変制御することにより管面全体にわたっ
て画素間隔を等しくすることを特徴とする水平リニアリ
ティ補正方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3331095A JPH08228302A (ja) | 1995-02-22 | 1995-02-22 | 水平リニアリティ補正方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3331095A JPH08228302A (ja) | 1995-02-22 | 1995-02-22 | 水平リニアリティ補正方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08228302A true JPH08228302A (ja) | 1996-09-03 |
Family
ID=12382996
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3331095A Pending JPH08228302A (ja) | 1995-02-22 | 1995-02-22 | 水平リニアリティ補正方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08228302A (ja) |
-
1995
- 1995-02-22 JP JP3331095A patent/JPH08228302A/ja active Pending
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