JPH08221293A - エミュレータ装置 - Google Patents
エミュレータ装置Info
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- JPH08221293A JPH08221293A JP7021581A JP2158195A JPH08221293A JP H08221293 A JPH08221293 A JP H08221293A JP 7021581 A JP7021581 A JP 7021581A JP 2158195 A JP2158195 A JP 2158195A JP H08221293 A JPH08221293 A JP H08221293A
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- Japan
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- microcomputer
- memory
- target
- control
- emulator
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/36—Preventing errors by testing or debugging software
- G06F11/362—Software debugging
- G06F11/3648—Software debugging using additional hardware
- G06F11/3652—Software debugging using additional hardware in-circuit-emulation [ICE] arrangements
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/44—Arrangements for executing specific programs
- G06F9/455—Emulation; Interpretation; Software simulation, e.g. virtualisation or emulation of application or operating system execution engines
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- Engineering & Computer Science (AREA)
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- General Physics & Mathematics (AREA)
- Quality & Reliability (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】
【目的】 ポッド部とエミュレータ部間を接続するバス
の信号線数を削減することができるエミュレータ装置を
得ることを目的とする。 【構成】 ターゲットマイコン４と制御マイコン５間、
ターゲットマイコン４とデバッグ回路６間または制御マ
イコン５とメモリ３間の何れかを共通バス２１を介して
接続する制御回路２６，２７を設けるとともに、制御マ
イコン５とメモリ３間をシリアル回線２８を介して接続
するようにしたものである。
の信号線数を削減することができるエミュレータ装置を
得ることを目的とする。 【構成】 ターゲットマイコン４と制御マイコン５間、
ターゲットマイコン４とデバッグ回路６間または制御マ
イコン５とメモリ３間の何れかを共通バス２１を介して
接続する制御回路２６，２７を設けるとともに、制御マ
イコン５とメモリ３間をシリアル回線２８を介して接続
するようにしたものである。
Description
【０００１】
【産業上の利用分野】この発明は、ポッド部とエミュレ
ータ部がそれぞれ別途の筐体に収納されている一方、ポ
ッド部とエミュレータ部がバスを介して接続されている
エミュレータ装置に関するものである。
ータ部がそれぞれ別途の筐体に収納されている一方、ポ
ッド部とエミュレータ部がバスを介して接続されている
エミュレータ装置に関するものである。
【０００２】
【従来の技術】図２は従来のエミュレータ装置を示す構
成図であり、図において、１はデバッグプログラムを実
行する際、開発する基板に実装されるＣＰＵ（図示せ
ず）の種類に応じてその基板に出力する信号を変換する
とともに、その基板から読み込んだ信号を標準化するポ
ッド部、２はポッド部１に対してデバッグプログラムの
実行指令を出力するとともに、ポッド部１により標準化
された信号に基づいてポッド部１の実行結果を評価する
エミュレータ部である。
成図であり、図において、１はデバッグプログラムを実
行する際、開発する基板に実装されるＣＰＵ（図示せ
ず）の種類に応じてその基板に出力する信号を変換する
とともに、その基板から読み込んだ信号を標準化するポ
ッド部、２はポッド部１に対してデバッグプログラムの
実行指令を出力するとともに、ポッド部１により標準化
された信号に基づいてポッド部１の実行結果を評価する
エミュレータ部である。
【０００３】また、３はデバッグプログラムを格納する
メモリ、４はデバッグプログラムの実行指令を受ける
と、メモリ３に格納されたデバッグプログラムを実行す
るターゲットマイコン、５はメモリ３に格納されたデバ
ッグプログラムの内容を管理（デバッグプログラムの読
み込み、書き込み、修正等）するとともに、ターゲット
マイコン４に対してデバッグプログラムの実行指令を出
力する制御マイコン、６はターゲットマイコン４の実行
結果を管理するデバッグ回路である。
メモリ、４はデバッグプログラムの実行指令を受ける
と、メモリ３に格納されたデバッグプログラムを実行す
るターゲットマイコン、５はメモリ３に格納されたデバ
ッグプログラムの内容を管理（デバッグプログラムの読
み込み、書き込み、修正等）するとともに、ターゲット
マイコン４に対してデバッグプログラムの実行指令を出
力する制御マイコン、６はターゲットマイコン４の実行
結果を管理するデバッグ回路である。
【０００４】また、７は制御マイコン５とメモリ３間を
接続する制御マイコンバス、８はターゲットマイコン４
とデバッグ回路６間を接続するターゲットマイコンバ
ス、９，１０はスリーステートバッファ、１１は制御マ
イコン５からメモリ３をアクセスする旨の排他制御信号
を受けると、スリーステートバッファ９をオン状態に制
御するとともに、スリーステートバッファ１０をオフ状
態に制御し、また、制御マイコン５からデバッグプログ
ラムの実行指令を受けると、その実行指令をターゲット
マイコン４に出力する制御回路、１２は排他制御信号及
び実行指令を送信する制御信号線である。
接続する制御マイコンバス、８はターゲットマイコン４
とデバッグ回路６間を接続するターゲットマイコンバ
ス、９，１０はスリーステートバッファ、１１は制御マ
イコン５からメモリ３をアクセスする旨の排他制御信号
を受けると、スリーステートバッファ９をオン状態に制
御するとともに、スリーステートバッファ１０をオフ状
態に制御し、また、制御マイコン５からデバッグプログ
ラムの実行指令を受けると、その実行指令をターゲット
マイコン４に出力する制御回路、１２は排他制御信号及
び実行指令を送信する制御信号線である。
【０００５】次に動作について説明する。まず、デバッ
グプログラムを実行する場合、制御マイコン５が制御回
路１１に対して実行指令を出力し、その実行指令を受け
た制御回路１１がターゲットマイコン４に対してその実
行指令を出力する。ターゲットマイコン４は、このよう
にして実行指令を受けると、スリーステートバッファ１
０を介して、メモリ３に格納されているデバッグプログ
ラムを読み込み、そのデバッグプログラムを実行する。
なお、制御回路１１は、制御マイコン５から実行指令を
受けると、ターゲットマイコン４がメモリ３に格納され
ているデバッグプログラムを読み込むことができるよう
にするため、スリーステートバッファ１０をオン状態に
制御するとともに、スリーステートバッファ９をオフ状
態に制御する。
グプログラムを実行する場合、制御マイコン５が制御回
路１１に対して実行指令を出力し、その実行指令を受け
た制御回路１１がターゲットマイコン４に対してその実
行指令を出力する。ターゲットマイコン４は、このよう
にして実行指令を受けると、スリーステートバッファ１
０を介して、メモリ３に格納されているデバッグプログ
ラムを読み込み、そのデバッグプログラムを実行する。
なお、制御回路１１は、制御マイコン５から実行指令を
受けると、ターゲットマイコン４がメモリ３に格納され
ているデバッグプログラムを読み込むことができるよう
にするため、スリーステートバッファ１０をオン状態に
制御するとともに、スリーステートバッファ９をオフ状
態に制御する。
【０００６】そして、ターゲットマイコン４がデバッグ
プログラムの実行を開始すると、その実行結果はターゲ
ットマイコンバス８を介してデバッグ回路６に逐次伝送
され、デバッグ回路６がその実行結果の履歴表示等を行
えるように、その実行結果を管理する。
プログラムの実行を開始すると、その実行結果はターゲ
ットマイコンバス８を介してデバッグ回路６に逐次伝送
され、デバッグ回路６がその実行結果の履歴表示等を行
えるように、その実行結果を管理する。
【０００７】そして、実行結果を把握したユーザがデバ
ッグプログラムの修正等が必要であると判断した場合、
制御マイコン５から制御回路１１に対して排他制御信号
を出力させる。これにより、制御回路１１は、スリース
テートバッファ９をオン状態に制御する一方、スリース
テートバッファ１０をオフ状態に制御し、制御マイコン
バス７を介して、制御マイコン５がメモリ３をアクセス
できるようにする。よって、ユーザは、メモリ３に格納
されているデバッグプログラムを自由に修正することが
できる。
ッグプログラムの修正等が必要であると判断した場合、
制御マイコン５から制御回路１１に対して排他制御信号
を出力させる。これにより、制御回路１１は、スリース
テートバッファ９をオン状態に制御する一方、スリース
テートバッファ１０をオフ状態に制御し、制御マイコン
バス７を介して、制御マイコン５がメモリ３をアクセス
できるようにする。よって、ユーザは、メモリ３に格納
されているデバッグプログラムを自由に修正することが
できる。
【０００８】以上より、作成したプログラムをデバッグ
することができるが、当該エミュレータ装置は、上述し
た通り、ポッド部１とエミュレータ部２がそれぞれ別途
の筐体に収納されている関係上、ポッド部１とエミュレ
ータ部２が制御マイコンバス７及びターゲットマイコン
バス８を介して接続されている。従って、各バスの信号
線数が少なければ別段問題ないが、ターゲットマイコン
４の多ビット化等に伴って信号線数が増大すると、各バ
スの芯数が増大してケーブルの剛性が上がる等種々の問
題がある。
することができるが、当該エミュレータ装置は、上述し
た通り、ポッド部１とエミュレータ部２がそれぞれ別途
の筐体に収納されている関係上、ポッド部１とエミュレ
ータ部２が制御マイコンバス７及びターゲットマイコン
バス８を介して接続されている。従って、各バスの信号
線数が少なければ別段問題ないが、ターゲットマイコン
４の多ビット化等に伴って信号線数が増大すると、各バ
スの芯数が増大してケーブルの剛性が上がる等種々の問
題がある。
【０００９】因に、ターゲットマイコン４及び制御マイ
コン５が共に１６ビットマイコン（アドレス線２４本、
データ線１６本）であると想定すると、各バスの信号線
数は合計で８０本になる。 アドレス線 ２４×２＝４８本 データ線 １６×２＝３２本 ただし、実際のエミュレータ装置には、ターゲットマイ
コン４及び制御マイコン５以外にも制御信号が存在して
いるが、信号線数が少ないので、ここでは省略してい
る。
コン５が共に１６ビットマイコン（アドレス線２４本、
データ線１６本）であると想定すると、各バスの信号線
数は合計で８０本になる。 アドレス線 ２４×２＝４８本 データ線 １６×２＝３２本 ただし、実際のエミュレータ装置には、ターゲットマイ
コン４及び制御マイコン５以外にも制御信号が存在して
いるが、信号線数が少ないので、ここでは省略してい
る。
【００１０】
【発明が解決しようとする課題】従来のエミュレータ装
置は以上のように構成されているので、プログラムをデ
バッグするためには制御マイコンバス７とターゲットマ
イコンバス８の双方が接続されている必要があり、その
ため、ターゲットマイコン４の多ビット化等に伴って信
号線数が増大すると各バスの芯数が増大し、その結果、
コネクタ等の部品コストやＥＭＩ対策費が増加するとと
もに、ケーブルの剛性が上がり、ポッド部１の設置場所
の自由度が減少するなどの問題点があった。
置は以上のように構成されているので、プログラムをデ
バッグするためには制御マイコンバス７とターゲットマ
イコンバス８の双方が接続されている必要があり、その
ため、ターゲットマイコン４の多ビット化等に伴って信
号線数が増大すると各バスの芯数が増大し、その結果、
コネクタ等の部品コストやＥＭＩ対策費が増加するとと
もに、ケーブルの剛性が上がり、ポッド部１の設置場所
の自由度が減少するなどの問題点があった。
【００１１】この発明は上記のような問題点を解消する
ためになされたもので、ポッド部とエミュレータ部間を
接続するバスの信号線数を削減することができるエミュ
レータ装置を得ることを目的とする。
ためになされたもので、ポッド部とエミュレータ部間を
接続するバスの信号線数を削減することができるエミュ
レータ装置を得ることを目的とする。
【００１２】
【課題を解決するための手段】この発明に係るエミュレ
ータ装置は、ターゲットマイコンと制御マイコン間、タ
ーゲットマイコンとデバッグ回路間または制御マイコン
とメモリ間の何れかを共通バスを介して接続する制御回
路を設けるとともに、制御マイコンとメモリ間をシリア
ル回線を介して接続するようにしたものである。
ータ装置は、ターゲットマイコンと制御マイコン間、タ
ーゲットマイコンとデバッグ回路間または制御マイコン
とメモリ間の何れかを共通バスを介して接続する制御回
路を設けるとともに、制御マイコンとメモリ間をシリア
ル回線を介して接続するようにしたものである。
【００１３】
【作用】この発明におけるエミュレータ装置は、ターゲ
ットマイコンと制御マイコン間、ターゲットマイコンと
デバッグ回路間または制御マイコンとメモリ間の何れか
を共通バスを介して接続する制御回路を設けたことによ
り、１つの共通バスを設けるだけでプログラムをデバッ
グできるようになる。また、制御マイコンとメモリ間を
シリアル回線を介して接続するようにしたことにより、
ターゲットマイコンが共通バスを専有している場合で
も、制御マイコンはメモリとアクセスすることができる
ようになる。
ットマイコンと制御マイコン間、ターゲットマイコンと
デバッグ回路間または制御マイコンとメモリ間の何れか
を共通バスを介して接続する制御回路を設けたことによ
り、１つの共通バスを設けるだけでプログラムをデバッ
グできるようになる。また、制御マイコンとメモリ間を
シリアル回線を介して接続するようにしたことにより、
ターゲットマイコンが共通バスを専有している場合で
も、制御マイコンはメモリとアクセスすることができる
ようになる。
【００１４】
実施例１．以下、この発明の一実施例を図について説明
する。図１はこの発明の実施例１によるエミュレータ装
置を示す構成図であり、図において従来のものと同一符
号は同一または相当部分を示すので説明を省略する。２
１はターゲットマイコン４と制御マイコン５間，ターゲ
ットマイコン４とデバッグ回路６間または制御マイコン
５とメモリ３間の何れかを接続する共通バスである。
する。図１はこの発明の実施例１によるエミュレータ装
置を示す構成図であり、図において従来のものと同一符
号は同一または相当部分を示すので説明を省略する。２
１はターゲットマイコン４と制御マイコン５間，ターゲ
ットマイコン４とデバッグ回路６間または制御マイコン
５とメモリ３間の何れかを接続する共通バスである。
【００１５】また、２２〜２５はスリーステートバッフ
ァ、２６は例えば制御マイコン５からメモリ３をアクセ
スする旨の排他制御信号を受けると、スリーステートバ
ッファ２２をオン状態に制御するとともに、スリーステ
ートバッファ２３をオフ状態に制御するエミュレータ側
制御回路、２７は例えば制御マイコン５からその排他制
御信号を受けると、スリーステートバッファ２４をオン
状態に制御するとともに、スリーステートバッファ２５
をオフ状態に制御するポッド側制御回路であり、スリー
ステートバッファ２２〜２５，エミュレータ側制御回路
２６及びポッド側制御回路２７から制御回路が構成され
ている。また、２８はエミュレータ側制御回路２６とポ
ッド側制御回路２７間を接続するシリアル回線である。
ァ、２６は例えば制御マイコン５からメモリ３をアクセ
スする旨の排他制御信号を受けると、スリーステートバ
ッファ２２をオン状態に制御するとともに、スリーステ
ートバッファ２３をオフ状態に制御するエミュレータ側
制御回路、２７は例えば制御マイコン５からその排他制
御信号を受けると、スリーステートバッファ２４をオン
状態に制御するとともに、スリーステートバッファ２５
をオフ状態に制御するポッド側制御回路であり、スリー
ステートバッファ２２〜２５，エミュレータ側制御回路
２６及びポッド側制御回路２７から制御回路が構成され
ている。また、２８はエミュレータ側制御回路２６とポ
ッド側制御回路２７間を接続するシリアル回線である。
【００１６】次に動作について説明する。まず、デバッ
グプログラムを実行する場合、制御マイコン５がエミュ
レータ側制御回路２６に対して実行指令を出力する。そ
して、その実行指令を受けたエミュレータ側制御回路２
６は、スリーステートバッファ２２をオン状態に制御す
るとともに、スリーステートバッファ２３をオフ状態に
制御することにより、制御マイコンバス７及び共通バス
２１を介して制御マイコン５が出力した実行指令をポッ
ド側制御回路２７に入力させる。
グプログラムを実行する場合、制御マイコン５がエミュ
レータ側制御回路２６に対して実行指令を出力する。そ
して、その実行指令を受けたエミュレータ側制御回路２
６は、スリーステートバッファ２２をオン状態に制御す
るとともに、スリーステートバッファ２３をオフ状態に
制御することにより、制御マイコンバス７及び共通バス
２１を介して制御マイコン５が出力した実行指令をポッ
ド側制御回路２７に入力させる。
【００１７】そして、その実行指令を受けたポッド側制
御回路２７は、ターゲットマイコン４がメモリ３に格納
されているデバッグプログラムを読み込むことができる
ようにすべく、スリーステートバッファ２４，２５をそ
れぞれオフ状態，オン状態に制御したのち、その実行指
令をターゲットマイコン４に対して出力する。これによ
り、ターゲットマイコン４は、メモリ３に格納されてい
るデバッグプログラムを読み込み、そのデバッグプログ
ラムを実行する。また、ポッド側制御回路２７は、実行
指令をターゲットマイコン４に対して出力すると、実行
指令の出力を完了した旨を示す完了信号を共通バス２１
を介してエミュレータ側制御回路２６に対して出力す
る。
御回路２７は、ターゲットマイコン４がメモリ３に格納
されているデバッグプログラムを読み込むことができる
ようにすべく、スリーステートバッファ２４，２５をそ
れぞれオフ状態，オン状態に制御したのち、その実行指
令をターゲットマイコン４に対して出力する。これによ
り、ターゲットマイコン４は、メモリ３に格納されてい
るデバッグプログラムを読み込み、そのデバッグプログ
ラムを実行する。また、ポッド側制御回路２７は、実行
指令をターゲットマイコン４に対して出力すると、実行
指令の出力を完了した旨を示す完了信号を共通バス２１
を介してエミュレータ側制御回路２６に対して出力す
る。
【００１８】そして、エミュレータ側制御回路２６は、
その完了信号を受けると、デバッグ回路６がターゲット
マイコン４の実行結果を読み込むことができるようにす
るため、スリーステートバッファ２２をオフ状態に制御
するとともに、スリーステートバッファ２３をオン状態
に制御する。これにより、ターゲットマイコン４の実行
結果は、ターゲットマイコンバス８及び共通バス２１を
介してデバッグ回路６に逐次伝送され、デバッグ回路６
がその実行結果の履歴表示等を行えるように、その実行
結果を管理する。
その完了信号を受けると、デバッグ回路６がターゲット
マイコン４の実行結果を読み込むことができるようにす
るため、スリーステートバッファ２２をオフ状態に制御
するとともに、スリーステートバッファ２３をオン状態
に制御する。これにより、ターゲットマイコン４の実行
結果は、ターゲットマイコンバス８及び共通バス２１を
介してデバッグ回路６に逐次伝送され、デバッグ回路６
がその実行結果の履歴表示等を行えるように、その実行
結果を管理する。
【００１９】そして、実行結果を把握したユーザがデバ
ッグプログラムの修正等が必要であると判断した場合、
制御マイコン５からエミュレータ側制御回路２６及びポ
ッド側制御回路２７に対して排他制御信号を出力させる
（ただし、ポッド側制御回路２７には、排他制御信号を
受けたエミュレータ側制御回路２６が制御信号線１２を
介して出力する）。これにより、エミュレータ側制御回
路２６が、スリーステートバッファ２２，２３をそれぞ
れオン状態，オフ状態に制御する一方、ポッド側制御回
路２７が、スリーステートバッファ２４，２５をそれぞ
れオン状態，オフ状態に制御し、制御マイコン５がメモ
リ３をアクセスできるようにする。因に、メモリ３に対
するアクセスは、制御マイコンバス７，共通バス２１，
ポッド側制御回路２７及びスリーステートバッファ２４
を介して行われる。よって、ユーザは、メモリ３に格納
されているデバッグプログラムを自由に修正することが
できる。
ッグプログラムの修正等が必要であると判断した場合、
制御マイコン５からエミュレータ側制御回路２６及びポ
ッド側制御回路２７に対して排他制御信号を出力させる
（ただし、ポッド側制御回路２７には、排他制御信号を
受けたエミュレータ側制御回路２６が制御信号線１２を
介して出力する）。これにより、エミュレータ側制御回
路２６が、スリーステートバッファ２２，２３をそれぞ
れオン状態，オフ状態に制御する一方、ポッド側制御回
路２７が、スリーステートバッファ２４，２５をそれぞ
れオン状態，オフ状態に制御し、制御マイコン５がメモ
リ３をアクセスできるようにする。因に、メモリ３に対
するアクセスは、制御マイコンバス７，共通バス２１，
ポッド側制御回路２７及びスリーステートバッファ２４
を介して行われる。よって、ユーザは、メモリ３に格納
されているデバッグプログラムを自由に修正することが
できる。
【００２０】なお、上述したメモリ３に対するアクセス
は、ターゲットマイコン４の実行が終了したことが前
提、即ち、ターゲットマイコン４とデバッグ回路６が共
通バス２１を専有していないことが前提となるので、タ
ーゲットマイコン４が実行中の場合には、制御マイコン
５はメモリ３に対してアクセスすることができない。そ
こで、この実施例では、ターゲットマイコン４が実行中
の場合でも、メモリ３に対するアクセスを可能にするた
め、共通バス２１に比べて信号線数が極めて少ないシリ
アル回線２８を設けている。具体的には、エミュレータ
側制御回路２６及びポッド側制御回路２７が、制御マイ
コン５とメモリ３間で入出力されるデータ等をシリアル
／ディジタル変換、または、ディジタル／シリアル変換
して伝送するようにしている。
は、ターゲットマイコン４の実行が終了したことが前
提、即ち、ターゲットマイコン４とデバッグ回路６が共
通バス２１を専有していないことが前提となるので、タ
ーゲットマイコン４が実行中の場合には、制御マイコン
５はメモリ３に対してアクセスすることができない。そ
こで、この実施例では、ターゲットマイコン４が実行中
の場合でも、メモリ３に対するアクセスを可能にするた
め、共通バス２１に比べて信号線数が極めて少ないシリ
アル回線２８を設けている。具体的には、エミュレータ
側制御回路２６及びポッド側制御回路２７が、制御マイ
コン５とメモリ３間で入出力されるデータ等をシリアル
／ディジタル変換、または、ディジタル／シリアル変換
して伝送するようにしている。
【００２１】以上より、この実施例１によれば、ポッド
部１とエミュレータ部２間に１つの共通バス２１を接続
するだけで、作成したプログラムをデバッグすることが
でき、従来のものに比べて、バスの信号線数を約半分に
抑えることができる。具体的には、ターゲットマイコン
４及び制御マイコン５が共に１６ビットマイコン（アド
レス線２４本、データ線１６本）であると想定すると、
共通バス２１の信号線数は合計で４０本になる。ただ
し、この実施例の場合、別途シリアル回線２８を用意し
ているので、そのシリアル回線２８に必要な信号線が２
〜４本必要となるが、それでも従来のものに比べて、３
６〜３８本程度の信号線を削除することができる。
部１とエミュレータ部２間に１つの共通バス２１を接続
するだけで、作成したプログラムをデバッグすることが
でき、従来のものに比べて、バスの信号線数を約半分に
抑えることができる。具体的には、ターゲットマイコン
４及び制御マイコン５が共に１６ビットマイコン（アド
レス線２４本、データ線１６本）であると想定すると、
共通バス２１の信号線数は合計で４０本になる。ただ
し、この実施例の場合、別途シリアル回線２８を用意し
ているので、そのシリアル回線２８に必要な信号線が２
〜４本必要となるが、それでも従来のものに比べて、３
６〜３８本程度の信号線を削除することができる。
【００２２】実施例２．上記実施例１では、シリアル回
線２８を介して、制御マイコン５がメモリ３に対してア
クセスするものについて示したが、シリアル回線２８を
介して、ターゲットマイコン４に対する制御データやタ
ーゲットマイコン４の実行結果を伝送するようにしても
よい。
線２８を介して、制御マイコン５がメモリ３に対してア
クセスするものについて示したが、シリアル回線２８を
介して、ターゲットマイコン４に対する制御データやタ
ーゲットマイコン４の実行結果を伝送するようにしても
よい。
【００２３】実施例３．上記実施例１では、共通バス２
１の接続切替をスリーステートバッファ２２〜２５を用
いて行うものについて示したが、他のスイッチング素子
を用いてもよいことは言うまでもない。
１の接続切替をスリーステートバッファ２２〜２５を用
いて行うものについて示したが、他のスイッチング素子
を用いてもよいことは言うまでもない。
【００２４】
【発明の効果】以上のように、この発明によれば、ター
ゲットマイコンと制御マイコン間、ターゲットマイコン
とデバッグ回路間または制御マイコンとメモリ間の何れ
かを共通バスを介して接続するように構成したので、１
つの共通バスを設けるだけでプログラムをデバッグでき
るようになり、その結果、従来のものに比べて、バスの
信号線数を約半分に抑えることができる効果がある。
ゲットマイコンと制御マイコン間、ターゲットマイコン
とデバッグ回路間または制御マイコンとメモリ間の何れ
かを共通バスを介して接続するように構成したので、１
つの共通バスを設けるだけでプログラムをデバッグでき
るようになり、その結果、従来のものに比べて、バスの
信号線数を約半分に抑えることができる効果がある。
【図１】 この発明の実施例１によるエミュレータ装置
を示す構成図である。
を示す構成図である。
【図２】 従来のエミュレータ装置を示す構成図であ
る。
る。
１ ポッド部、２ エミュレータ部、３ メモリ、４
ターゲットマイコン、５ 制御マイコン、６ デバッグ
回路、２１ 共通バス、２２〜２５ スリーステートバ
ッファ（制御回路）、２６ エミュレータ側制御回路
（制御回路）、２７ ポッド側制御回路（制御回路）、
２８ シリアル回線。
ターゲットマイコン、５ 制御マイコン、６ デバッグ
回路、２１ 共通バス、２２〜２５ スリーステートバ
ッファ（制御回路）、２６ エミュレータ側制御回路
（制御回路）、２７ ポッド側制御回路（制御回路）、
２８ シリアル回線。
Claims (1)
- 【請求項１】 デバッグプログラムを格納するメモリ、
及びデバッグプログラムの実行指令を受けると上記メモ
リに格納されたデバッグプログラムを実行するターゲッ
トマイコンを有するポッド部と、上記メモリに格納され
たデバッグプログラムの内容を管理するとともに、上記
ターゲットマイコンに対してデバッグプログラムの実行
指令を出力する制御マイコン、及び上記ターゲットマイ
コンの実行結果を管理するデバッグ回路を有するエミュ
レータ部とを備えたエミュレータ装置において、上記タ
ーゲットマイコンと制御マイコン間、上記ターゲットマ
イコンとデバッグ回路間または上記制御マイコンとメモ
リ間の何れかを共通バスを介して接続する制御回路を設
けるとともに、上記制御マイコンとメモリ間をシリアル
回線を介して接続したことを特徴とするエミュレータ装
置。
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|---|---|---|---|---|
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|---|---|---|---|---|
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| KR100434309B1 (ko) * | 1998-03-09 | 2005-05-24 | 주식회사 하이닉스반도체 | 에뮬레이터 회로 |
| US6587964B1 (en) * | 2000-02-18 | 2003-07-01 | Hewlett-Packard Development Company, L.P. | Transparent software emulation as an alternative to hardware bus lock |
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| JPS6356569A (ja) * | 1986-08-27 | 1988-03-11 | Fujitsu Ltd | 耐熱性樹脂塗料 |
| US5329470A (en) * | 1988-12-02 | 1994-07-12 | Quickturn Systems, Inc. | Reconfigurable hardware emulation system |
| US5053949A (en) * | 1989-04-03 | 1991-10-01 | Motorola, Inc. | No-chip debug peripheral which uses externally provided instructions to control a core processing unit |
| US5581695A (en) * | 1990-05-09 | 1996-12-03 | Applied Microsystems Corporation | Source-level run-time software code debugging instrument |
| IL100370A (en) * | 1990-12-24 | 1994-11-11 | Ball Corp | Method for analyzing integrated computer systems |
| US5375228A (en) * | 1991-02-04 | 1994-12-20 | Analog Devices, Inc. | Real-time signal analysis apparatus and method for digital signal processor emulation |
| US5321828A (en) * | 1991-06-07 | 1994-06-14 | Step Engineering | High speed microcomputer in-circuit emulator |
| US5313618A (en) * | 1992-09-03 | 1994-05-17 | Metalink Corp. | Shared bus in-circuit emulator system and method |
| US5497456A (en) * | 1992-12-31 | 1996-03-05 | Intel Corporation | Apparatus for transferring information between an interrupt producer and an interrupt service environment |
| US5539901A (en) * | 1993-09-30 | 1996-07-23 | Intel Corporation | Method and apparatus for system management mode support for in-circuit emulators |
| US5488688A (en) * | 1994-03-30 | 1996-01-30 | Motorola, Inc. | Data processor with real-time diagnostic capability |
| US5530804A (en) * | 1994-05-16 | 1996-06-25 | Motorola, Inc. | Superscalar processor with plural pipelined execution units each unit selectively having both normal and debug modes |
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Cited By (3)
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|---|---|---|---|---|
| WO2010087140A1 (ja) * | 2009-01-30 | 2010-08-05 | 三菱電機株式会社 | 状態表示装置 |
| CN102301341A (zh) * | 2009-01-30 | 2011-12-28 | 三菱电机株式会社 | 状态显示装置 |
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