JPH0796626A - 感熱ヘッドの通電パルス印加方法 - Google Patents
感熱ヘッドの通電パルス印加方法Info
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- JPH0796626A JPH0796626A JP11217094A JP11217094A JPH0796626A JP H0796626 A JPH0796626 A JP H0796626A JP 11217094 A JP11217094 A JP 11217094A JP 11217094 A JP11217094 A JP 11217094A JP H0796626 A JPH0796626 A JP H0796626A
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- bit
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Abstract
(57)【要約】
【目的】 印字ドットの位置ずれ等をなくした感熱ヘッ
ドの通電パルス印加方法を提供する。 【構成】 発熱抵抗体に通電パルスを印加して相対的に
移動される感熱紙に発色記録を行う感熱記録装置におけ
る感熱ヘッドの通電パルス印加方法であり、最上位桁の
通電パルスを他のビットに対応する通電パルスＰＤ1 を
挟んでパルスＰＤ2(1)，ＰＤ2(2)として分割して印加す
ると共に、各ビットに対応する通電パルスの発生周期
を、発熱抵抗体の温度を下げるための冷却期間を挟んで
一定にすることにより、通電時間の片寄りをなくし、同
一ライン上での印字ドットの位置ずれを少なくし、階調
特性の変更を容易にする。
ドの通電パルス印加方法を提供する。 【構成】 発熱抵抗体に通電パルスを印加して相対的に
移動される感熱紙に発色記録を行う感熱記録装置におけ
る感熱ヘッドの通電パルス印加方法であり、最上位桁の
通電パルスを他のビットに対応する通電パルスＰＤ1 を
挟んでパルスＰＤ2(1)，ＰＤ2(2)として分割して印加す
ると共に、各ビットに対応する通電パルスの発生周期
を、発熱抵抗体の温度を下げるための冷却期間を挟んで
一定にすることにより、通電時間の片寄りをなくし、同
一ライン上での印字ドットの位置ずれを少なくし、階調
特性の変更を容易にする。
Description
【０００１】
【産業上の利用分野】本発明は、ファクシミリ等の感熱
記録装置における感熱ヘッドの通電パルスの印加方法に
関する。
記録装置における感熱ヘッドの通電パルスの印加方法に
関する。
【０００２】
【従来の技術】図７は、感熱ヘッドを構成する発熱抵抗
体を駆動するための通電パルスの一例を示すもので、特
開昭６３−２５６４６４号に開示されているものであ
る。この例においては、３ビットにより記録濃度の階調
を表現するようにしており、２0 ビットに対応するデ−
タとしては４個の単位パルスを、２1 ビットに対応する
デ−タとしては６個の単位パルスを、２2 ビットデ−タ
に対応するデ−タとしては７個の単位パルスを夫々連続
的に供給することで、７段階の濃度階調を表わすように
しているものである。
体を駆動するための通電パルスの一例を示すもので、特
開昭６３−２５６４６４号に開示されているものであ
る。この例においては、３ビットにより記録濃度の階調
を表現するようにしており、２0 ビットに対応するデ−
タとしては４個の単位パルスを、２1 ビットに対応する
デ−タとしては６個の単位パルスを、２2 ビットデ−タ
に対応するデ−タとしては７個の単位パルスを夫々連続
的に供給することで、７段階の濃度階調を表わすように
しているものである。
【０００３】
【発明が解決しようとする課題】ところで、感熱ヘッド
と感熱紙とを相対的に移動させながら、前述のように通
電パルスを印加すると、同一ライン内に濃度階調３とこ
れより１階調だけ大きい濃度階調４とを表現する場合に
は、濃度階調３においては、通電期間が１ライン期間の
前側に片寄り、濃度階調４においては逆に後ろ側に片寄
っているため、記録ドットの並びが直線的に揃わず、ノ
イズ感を与え画質が低下するという問題点があった。
と感熱紙とを相対的に移動させながら、前述のように通
電パルスを印加すると、同一ライン内に濃度階調３とこ
れより１階調だけ大きい濃度階調４とを表現する場合に
は、濃度階調３においては、通電期間が１ライン期間の
前側に片寄り、濃度階調４においては逆に後ろ側に片寄
っているため、記録ドットの並びが直線的に揃わず、ノ
イズ感を与え画質が低下するという問題点があった。
【０００４】また、前述のような通電パルス印加方法で
は、装置の製造工程において、或いは、ユ−ザ−側にお
いて濃度階調特性を変更する際に、以下のような不都合
が生じる。例えば、前述の図７における濃度階調５に注
目すると、まず、２0 ビットに対応する期間には４個の
単位パルスが供給され、次の２1 ビットに対応する期間
には、なにも供給されず発熱抵抗体の冷却期間とされ、
そして、最上位桁の２2 ビットに対応する期間には７個
の単位パルスが供給されて濃度階調５が表現されてい
る。
は、装置の製造工程において、或いは、ユ−ザ−側にお
いて濃度階調特性を変更する際に、以下のような不都合
が生じる。例えば、前述の図７における濃度階調５に注
目すると、まず、２0 ビットに対応する期間には４個の
単位パルスが供給され、次の２1 ビットに対応する期間
には、なにも供給されず発熱抵抗体の冷却期間とされ、
そして、最上位桁の２2 ビットに対応する期間には７個
の単位パルスが供給されて濃度階調５が表現されてい
る。
【０００５】この場合、装置の製造工程時やユ−ザ−側
で、２1 ビットに対応する期間に印加するパルス数を変
更するような場合には、それに応じて通電パルス時間が
変更されることになり、必然的に、冷却期間も変わって
しまい、例え、その前後に供給される通電パルスのパル
ス数、つまり印加エネルギが同じであっても、記録濃度
が変化してしまう。そのため、階調特性を調整するため
の工数が増えてしまうという問題があった。そこで、本
発明の目的は、前述のような問題点を解決した感熱ヘッ
ドの通電パルス印加方法を提供しようというものであ
る。
で、２1 ビットに対応する期間に印加するパルス数を変
更するような場合には、それに応じて通電パルス時間が
変更されることになり、必然的に、冷却期間も変わって
しまい、例え、その前後に供給される通電パルスのパル
ス数、つまり印加エネルギが同じであっても、記録濃度
が変化してしまう。そのため、階調特性を調整するため
の工数が増えてしまうという問題があった。そこで、本
発明の目的は、前述のような問題点を解決した感熱ヘッ
ドの通電パルス印加方法を提供しようというものであ
る。
【０００６】
【課題を解決するための手段】本発明の感熱ヘッドの通
電パルス印加方法は、以下の１）乃至４）で示す手段に
よりその目的を達成するものである。 １）一列に配設された複数個の発熱抵抗体から構成され
る感熱ヘッドに、所定のビット数から成る記録濃度の階
調を示すディジタルデ−タの各ビットに応じた通電パル
スを印加することで、前記複数個の発熱抵抗体と対向し
て相対的に移動する感熱紙に記録を行う感熱記録装置に
おける感熱ヘッドの通電パルス印加方法において、所定
のビットに対応する通電パルスを分割し、その間に他の
ビットに対応する通電パルスを挟んで印加するようにし
たことを特徴とする感熱ヘッドの通電パルス印加方法。
電パルス印加方法は、以下の１）乃至４）で示す手段に
よりその目的を達成するものである。 １）一列に配設された複数個の発熱抵抗体から構成され
る感熱ヘッドに、所定のビット数から成る記録濃度の階
調を示すディジタルデ−タの各ビットに応じた通電パル
スを印加することで、前記複数個の発熱抵抗体と対向し
て相対的に移動する感熱紙に記録を行う感熱記録装置に
おける感熱ヘッドの通電パルス印加方法において、所定
のビットに対応する通電パルスを分割し、その間に他の
ビットに対応する通電パルスを挟んで印加するようにし
たことを特徴とする感熱ヘッドの通電パルス印加方法。
【０００７】２）分割する所定の通電パルスの内、少な
くとも１種類は最上位ビットに対応した通電パルスと
し、その間に挟まれる他のビットに対応するパルスの
内、少なくとも１つのパルスは階調デ−タ各ビット間の
論理和出力に対応したパルスであることを特徴とする請
求項１記載の感熱ヘッドの通電パルス印加方法。
くとも１種類は最上位ビットに対応した通電パルスと
し、その間に挟まれる他のビットに対応するパルスの
内、少なくとも１つのパルスは階調デ−タ各ビット間の
論理和出力に対応したパルスであることを特徴とする請
求項１記載の感熱ヘッドの通電パルス印加方法。
【０００８】３）分割する所定の通電パルスのパルス幅
を、階調特性に応じて互いに異ならせることを特徴とす
る請求項１記載の感熱ヘッドの通電パルス印加方法。
を、階調特性に応じて互いに異ならせることを特徴とす
る請求項１記載の感熱ヘッドの通電パルス印加方法。
【０００９】４）各ビットに対応する通電パルスの発生
周期を、発熱抵抗体の温度を冷却するための冷却期間を
挟んで一定にすることを特徴とする請求項１記載の感熱
ヘッドの通電パルス印加方法。
周期を、発熱抵抗体の温度を冷却するための冷却期間を
挟んで一定にすることを特徴とする請求項１記載の感熱
ヘッドの通電パルス印加方法。
【００１０】
【実施例】以下、図面を参照して、本発明の一実施例に
つき説明する。図１は本発明の方法が適用されるサ−マ
ルヘッドを制御するための概略ブロック図で、同図にお
いて、１０は濃度階調（以下、単に階調と記す）デ−タ
が入来するための端子、１１は階調デ−タを１ライン分
（或いは１画面分）記憶しておくためのメモリ（ＲＡ
Ｍ）、１２はメモリ１１から読み出された階調デ−タの
所定のビットをビットセレクト信号ＢＳにより選択し、
後述するサ−マルヘッドの発熱抵抗体にヘッドデ−タＳ
Ｄとして供給するためのデ−タセレクタである。
つき説明する。図１は本発明の方法が適用されるサ−マ
ルヘッドを制御するための概略ブロック図で、同図にお
いて、１０は濃度階調（以下、単に階調と記す）デ−タ
が入来するための端子、１１は階調デ−タを１ライン分
（或いは１画面分）記憶しておくためのメモリ（ＲＡ
Ｍ）、１２はメモリ１１から読み出された階調デ−タの
所定のビットをビットセレクト信号ＢＳにより選択し、
後述するサ−マルヘッドの発熱抵抗体にヘッドデ−タＳ
Ｄとして供給するためのデ−タセレクタである。
【００１１】このデ−タセレクタ１２は、図４に示すよ
うに、３ビットの階調デ−タがそれぞれ入力される端子
Ａ0 〜Ａ2 、ビットセレクト信号ＢＳ用の入力端子ＳＥ
Ｌ及びヘッドデ−タＳＤ出力用の端子Ｙが設けられてい
る。また、入力端子Ａ6 にはハイレベル（印字）信号
が、端子Ａ7 にはロ−レベル（非印字）信号が供給され
る。また、このデ−タセレクタ１２には、後述するよう
に、必要に応じて論理和回路１２ａと論理積回路１２ｂ
とが設けられ、端子Ａ4 ，Ａ5 がそれらの出力信号用と
して使用されるようになっている。
うに、３ビットの階調デ−タがそれぞれ入力される端子
Ａ0 〜Ａ2 、ビットセレクト信号ＢＳ用の入力端子ＳＥ
Ｌ及びヘッドデ−タＳＤ出力用の端子Ｙが設けられてい
る。また、入力端子Ａ6 にはハイレベル（印字）信号
が、端子Ａ7 にはロ−レベル（非印字）信号が供給され
る。また、このデ−タセレクタ１２には、後述するよう
に、必要に応じて論理和回路１２ａと論理積回路１２ｂ
とが設けられ、端子Ａ4 ，Ａ5 がそれらの出力信号用と
して使用されるようになっている。
【００１２】１３はカウンタ群であり、このカウンタ群
１３はメモリ１１への階調デ−タを読み出すためのメモ
リアドレスＡＡの供給、ＲＯＭ１４へのメモリ１１から
のデ−タ転送回数を示すＲＯＭアドレスＡＢの供給、ラ
ッチ１５へのラッチクロックの供給、及びコンパレ−タ
１６へのイネ−ブルパルスの時間軸を示すイネ−ブルア
ドレスＡＣの供給を夫々行うものである。コンパレ−タ
１６は、パルス幅デ−タＰＤとイネ−ブルアドレスＡＣ
とを比較して、サ−マルヘッドにイネ−ブルパルスＥＮ
1 ，ＥＮ2 を夫々出力するコンパレ−タである。以上に
より、サ−マヘッドの制御回路が概略構成されている。
１３はメモリ１１への階調デ−タを読み出すためのメモ
リアドレスＡＡの供給、ＲＯＭ１４へのメモリ１１から
のデ−タ転送回数を示すＲＯＭアドレスＡＢの供給、ラ
ッチ１５へのラッチクロックの供給、及びコンパレ−タ
１６へのイネ−ブルパルスの時間軸を示すイネ−ブルア
ドレスＡＣの供給を夫々行うものである。コンパレ−タ
１６は、パルス幅デ−タＰＤとイネ−ブルアドレスＡＣ
とを比較して、サ−マルヘッドにイネ−ブルパルスＥＮ
1 ，ＥＮ2 を夫々出力するコンパレ−タである。以上に
より、サ−マヘッドの制御回路が概略構成されている。
【００１３】図２は前述の制御回路により制御されるサ
−マルヘッドの概略ブロック図で、このサ−マルヘッド
は一列に配列された発熱体群２１と、この発熱体群２１
を駆動するためのトランジスタ群２２と、駆動すべき所
定の発熱体を示すヘッドデ−タＳＤをパラレルデ−タに
変換するためのシフトレジスタと、このシフトレジスタ
２３から出力されるパラレルデ−タを保持するためのラ
ッチ２４と、このラッチ２４から出力されたパラレルデ
−タに応じてイネ−ブルパルスＥＮ1 ，ＥＮ2の時間だ
け駆動すべき発熱体に電流を流すためのゲ−ト群２５と
から概略構成されている。
−マルヘッドの概略ブロック図で、このサ−マルヘッド
は一列に配列された発熱体群２１と、この発熱体群２１
を駆動するためのトランジスタ群２２と、駆動すべき所
定の発熱体を示すヘッドデ−タＳＤをパラレルデ−タに
変換するためのシフトレジスタと、このシフトレジスタ
２３から出力されるパラレルデ−タを保持するためのラ
ッチ２４と、このラッチ２４から出力されたパラレルデ
−タに応じてイネ−ブルパルスＥＮ1 ，ＥＮ2の時間だ
け駆動すべき発熱体に電流を流すためのゲ−ト群２５と
から概略構成されている。
【００１４】次に、以上のような構成による通電パルス
の印加方法につき、図３を参照して説明する。図３
（Ａ）〜（Ｐ）は図１、図２及び図４に示した各回路に
おける各信号のタイミングチャ−ト、図３（Ｌ）〜
（Ｐ）はイネ−ブルパルスＥＮ1 により接続される発熱
体の駆動パルスで、濃度階調２乃至６を表現させるため
のパルス列を示したものである。
の印加方法につき、図３を参照して説明する。図３
（Ａ）〜（Ｐ）は図１、図２及び図４に示した各回路に
おける各信号のタイミングチャ−ト、図３（Ｌ）〜
（Ｐ）はイネ−ブルパルスＥＮ1 により接続される発熱
体の駆動パルスで、濃度階調２乃至６を表現させるため
のパルス列を示したものである。
【００１５】今、ここで、説明を簡略化するために階調
デ−タを３ビット（Ｄ0 ，Ｄ1 ，Ｄ2 ＝２0 ，２1 ，２
2 ）とし、メモリ１１にはすでに１ライン（ｎ画素）分
の階調デ−タが書き込まれ、ＲＯＭ１４には各転送サイ
クル毎の転送ビットがビットセレクタ信号ＢＳとして書
き込まれていると共に、前記転送ビットに対する通電時
間がパルス幅デ−タＰＤとして予め書き込まれているも
のとする。また、各ラインの開始時点ではラッチ１５に
おいて“０”がラッチされているものとする。
デ−タを３ビット（Ｄ0 ，Ｄ1 ，Ｄ2 ＝２0 ，２1 ，２
2 ）とし、メモリ１１にはすでに１ライン（ｎ画素）分
の階調デ−タが書き込まれ、ＲＯＭ１４には各転送サイ
クル毎の転送ビットがビットセレクタ信号ＢＳとして書
き込まれていると共に、前記転送ビットに対する通電時
間がパルス幅デ−タＰＤとして予め書き込まれているも
のとする。また、各ラインの開始時点ではラッチ１５に
おいて“０”がラッチされているものとする。
【００１６】まず、１回目のデ−タ転送サイクルＴ1 で
はカウンタ１３からＲＯＭアドレスＡＢ＝０を出力し、
ＲＯＭ１４はビットセレクト信号ＢＳ＝０をデ−タセレ
クタ１２に出力し、デ−タセレクタ１２はヘッドデ−タ
ＳＤとしてデ−タＤ0 （２0）を選択するようにセット
される。これによって、メモリ１１からは、階調デ−タ
３ビットのうちデ−タＤ0 （２0 ）のみが、シフトレジ
スタ２３に供給される。 カウンタ１３はメモリ１１か
ら１ライン分のデ−タを読み出すと、つまり、メモリア
ドレスＡＡを０からｎまでカウントアップすると、ヘッ
ドラッチパルスＬＴ1 を出力し、これによりヘッド内の
ラッチ２４に１ライン分のデ−タＤ0 が保持される。ま
た、デ−タＤ0 に対する通電パルス幅デ−タＰＤ0 は、
ヘッドラッチパルスＬＴ1 とほぼ同時期に出力されるラ
ッチクロックＬＴ2 によってラッチ１５に保持される。
はカウンタ１３からＲＯＭアドレスＡＢ＝０を出力し、
ＲＯＭ１４はビットセレクト信号ＢＳ＝０をデ−タセレ
クタ１２に出力し、デ−タセレクタ１２はヘッドデ−タ
ＳＤとしてデ−タＤ0 （２0）を選択するようにセット
される。これによって、メモリ１１からは、階調デ−タ
３ビットのうちデ−タＤ0 （２0 ）のみが、シフトレジ
スタ２３に供給される。 カウンタ１３はメモリ１１か
ら１ライン分のデ−タを読み出すと、つまり、メモリア
ドレスＡＡを０からｎまでカウントアップすると、ヘッ
ドラッチパルスＬＴ1 を出力し、これによりヘッド内の
ラッチ２４に１ライン分のデ−タＤ0 が保持される。ま
た、デ−タＤ0 に対する通電パルス幅デ−タＰＤ0 は、
ヘッドラッチパルスＬＴ1 とほぼ同時期に出力されるラ
ッチクロックＬＴ2 によってラッチ１５に保持される。
【００１７】これらヘッドラッチパルスＬＴ1 ，ＬＴ2
を出力すると、カウンタ１３はＲＯＭアドレスＡＢを
“１”にカウントアップし、２回目のデ−タ転送サイク
ルＴ2を開始する。今度は、ＲＯＭ１４からはビットセ
レクト信号としてＢＳ＝２が出力され、デ−タセレクタ
１２はデ−タＤ2 （２2 ビット）をシフトレジスタ２３
に順次供給していく。同時にカウンタ１３ではコンパレ
−タ１６に対してイネ−ブルアドレスＡＣとイネ−ブル
切り換えフラグＥＦとを出力する。このイネ−ブル切り
換えフラグＥＦは一回のデ−タ転送サイクルを約１／２
に分ける切り換えフラグである。
を出力すると、カウンタ１３はＲＯＭアドレスＡＢを
“１”にカウントアップし、２回目のデ−タ転送サイク
ルＴ2を開始する。今度は、ＲＯＭ１４からはビットセ
レクト信号としてＢＳ＝２が出力され、デ−タセレクタ
１２はデ−タＤ2 （２2 ビット）をシフトレジスタ２３
に順次供給していく。同時にカウンタ１３ではコンパレ
−タ１６に対してイネ−ブルアドレスＡＣとイネ−ブル
切り換えフラグＥＦとを出力する。このイネ−ブル切り
換えフラグＥＦは一回のデ−タ転送サイクルを約１／２
に分ける切り換えフラグである。
【００１８】イネ−ブルアドレスＡＣは、フラグＥＦが
反転する毎にメモリアドレスＡＡと同期あるいは非同期
で０から順次カウントアップを繰り返す。コンパレ−タ
１６は、このイネ−ブルアドレスＡＣとラッチ１５の出
力ＰＤ0 とを比較し、この出力ＰＤ0 がイネ−ブルアド
レスＡＣより大である期間だけ“Ｈ”となるイネ−ブル
パルスＥＮ1 ，ＥＮ2 を夫々出力する。イネ−ブル切り
換えフラグＥＦが“Ｌ”のタイミング時にイネ−ブルパ
ルスＥＮ1 が出力され、イネ−ブル切り換えフラグＥＦ
が“Ｈ”のタイミング時にイネ−ブルパルスＥＮ2 が出
力される。このように、イネ−ブルパルスＥＮ1 ，ＥＮ
2 を２回に振り分けるのは、同時に通電する発熱体の数
を減らし、電源の負担を軽減するためである。
反転する毎にメモリアドレスＡＡと同期あるいは非同期
で０から順次カウントアップを繰り返す。コンパレ−タ
１６は、このイネ−ブルアドレスＡＣとラッチ１５の出
力ＰＤ0 とを比較し、この出力ＰＤ0 がイネ−ブルアド
レスＡＣより大である期間だけ“Ｈ”となるイネ−ブル
パルスＥＮ1 ，ＥＮ2 を夫々出力する。イネ−ブル切り
換えフラグＥＦが“Ｌ”のタイミング時にイネ−ブルパ
ルスＥＮ1 が出力され、イネ−ブル切り換えフラグＥＦ
が“Ｈ”のタイミング時にイネ−ブルパルスＥＮ2 が出
力される。このように、イネ−ブルパルスＥＮ1 ，ＥＮ
2 を２回に振り分けるのは、同時に通電する発熱体の数
を減らし、電源の負担を軽減するためである。
【００１９】これによって、サ−マルヘッドでは、ラッ
チ２４に保持されているデ−タＤ0が示す発熱体にＰＤ
0 の期間通電が行われる。同様にして、このサイクルも
メモリ１１のデ−タを１ライン分読み出すとヘッドラッ
チパルスＬＴ1 ，ＬＴ2 がそれぞれ出力され、デ−タＤ
2 とＰＤ2(1)がそれぞれラッチ２４とラッチ１５とに保
持される。
チ２４に保持されているデ−タＤ0が示す発熱体にＰＤ
0 の期間通電が行われる。同様にして、このサイクルも
メモリ１１のデ−タを１ライン分読み出すとヘッドラッ
チパルスＬＴ1 ，ＬＴ2 がそれぞれ出力され、デ−タＤ
2 とＰＤ2(1)がそれぞれラッチ２４とラッチ１５とに保
持される。
【００２０】以降同様にして、３回目のデ−タ転送サイ
クルＴ3 ではデ−タＤ1 の転送とデ−タＤ2 に対する通
電を、４回目のデ−タ転送サイクルＴ4 ではデ−タＤ2
の２度目の転送とデ−タＤ1 に対する通電を、５回目の
デ−タ転送サイクルＴ5 では非印字デ−タ（ＳＤ＝
“Ｌ”）の転送とデ−タＤ2 に対する２度目の通電を行
う。そして、デ−タ転送サイクルＴ6 以降は非印字デ−
タ転送と非通電状態とが続いて１ライン分の印字動作が
終了する。
クルＴ3 ではデ−タＤ1 の転送とデ−タＤ2 に対する通
電を、４回目のデ−タ転送サイクルＴ4 ではデ−タＤ2
の２度目の転送とデ−タＤ1 に対する通電を、５回目の
デ−タ転送サイクルＴ5 では非印字デ−タ（ＳＤ＝
“Ｌ”）の転送とデ−タＤ2 に対する２度目の通電を行
う。そして、デ−タ転送サイクルＴ6 以降は非印字デ−
タ転送と非通電状態とが続いて１ライン分の印字動作が
終了する。
【００２１】このように、本実施例では一つのビットに
対する通電を連続パルスで行うのではなく、他のビット
に対応する通電パルスを挿入するようにしているので、
通電時間の片寄りをなくし、従来例で示したような印字
ドットの位置ずれを少なくすることができる。図３
（Ｍ），（Ｎ）に示すように、デ−タＤ2 に対する通電
の１回目と２回目の間にデ−タＤ1 に対する通電パルス
が挿入されるようになっている為、濃度階調３と濃度階
調４とで、通電時間の片寄りが少ない。
対する通電を連続パルスで行うのではなく、他のビット
に対応する通電パルスを挿入するようにしているので、
通電時間の片寄りをなくし、従来例で示したような印字
ドットの位置ずれを少なくすることができる。図３
（Ｍ），（Ｎ）に示すように、デ−タＤ2 に対する通電
の１回目と２回目の間にデ−タＤ1 に対する通電パルス
が挿入されるようになっている為、濃度階調３と濃度階
調４とで、通電時間の片寄りが少ない。
【００２２】また、本実施例では最上位桁を分割するよ
うにしており、最上位ビットはデ−タ量が大きく、通電
時間が長くなることから、他のビットを分割する場合に
比べ、よりドットずれ防止の効果が得られる。
うにしており、最上位ビットはデ−タ量が大きく、通電
時間が長くなることから、他のビットを分割する場合に
比べ、よりドットずれ防止の効果が得られる。
【００２３】また、本実施例では、最上位桁に対する通
電だけを２回に分けて行っているが、階調デ−タのビッ
ト数が増え、分割されるビットの種類、及び分割される
連続パルスの回数が増えれば増えるほど、その効果が得
られるものとなる。
電だけを２回に分けて行っているが、階調デ−タのビッ
ト数が増え、分割されるビットの種類、及び分割される
連続パルスの回数が増えれば増えるほど、その効果が得
られるものとなる。
【００２４】更に、階調デ−タの各ビットに対応する通
電パルスを、パルス幅にかかわらず、冷却期間を挟んで
一定周期にしているので、どのビットのパルス幅を増減
させても他のビットの冷却期間には何ら影響を与えるこ
となく、階調特性を容易に変更できるものである。
電パルスを、パルス幅にかかわらず、冷却期間を挟んで
一定周期にしているので、どのビットのパルス幅を増減
させても他のビットの冷却期間には何ら影響を与えるこ
となく、階調特性を容易に変更できるものである。
【００２５】尚、本実施例において、実際に印字される
階調が感熱紙や転写紙のエネルギ−特性により所望の階
調濃度と異なるような場合には、これを補正する必要が
ある。例えば、図６のような階調特性の場合には図４に
示すような論理和回路１２ａを設け、その出力を低階調
補正用のパルスとして使用するようにすれば良い。その
タイミング信号は、図５のタイミングチャ−トに示すよ
うに、ビットセレクト信号ＢＳをＢＳ＝４とし、デ−タ
Ｄ2 に対する１回目の通電とデ−タＤ1 に対する通電の
間に、階調デ−タ各ビット間の論理和出力に対する通電
期間ＰＤL を設ける。このようにすることにより、低階
調部分の特性が補正されるだけでなく、図５（Ｆ）〜
（Ｍ）からも明らかなように、通電時間の片寄りも少な
くすることができ、記録ドットの位置ずれを更に小さく
することができる。
階調が感熱紙や転写紙のエネルギ−特性により所望の階
調濃度と異なるような場合には、これを補正する必要が
ある。例えば、図６のような階調特性の場合には図４に
示すような論理和回路１２ａを設け、その出力を低階調
補正用のパルスとして使用するようにすれば良い。その
タイミング信号は、図５のタイミングチャ−トに示すよ
うに、ビットセレクト信号ＢＳをＢＳ＝４とし、デ−タ
Ｄ2 に対する１回目の通電とデ−タＤ1 に対する通電の
間に、階調デ−タ各ビット間の論理和出力に対する通電
期間ＰＤL を設ける。このようにすることにより、低階
調部分の特性が補正されるだけでなく、図５（Ｆ）〜
（Ｍ）からも明らかなように、通電時間の片寄りも少な
くすることができ、記録ドットの位置ずれを更に小さく
することができる。
【００２６】また、図３の方式において、階調６及び階
調７を表現するためのパルス数の差は、ＰＤ0 が有るか
否かだけのため、実際には図６のように高階調部分での
濃度差がはっきりしない場合がある。このような場合に
は、図４に示すように論理積回路１２ｂを設け、その出
力を高階調補正用のパルスとして使用すれば良い。図５
のタイミングチャ−トに示すように、デ−タＤ2 に対す
る２回目の通電の後に、更に、階調デ−タ各ビット間の
論理積出力に対する通電期間ＰＤH を設け、階調６と階
調７との印加エネルギ−の差を大きくすることで階調特
性を改善することができる。
調７を表現するためのパルス数の差は、ＰＤ0 が有るか
否かだけのため、実際には図６のように高階調部分での
濃度差がはっきりしない場合がある。このような場合に
は、図４に示すように論理積回路１２ｂを設け、その出
力を高階調補正用のパルスとして使用すれば良い。図５
のタイミングチャ−トに示すように、デ−タＤ2 に対す
る２回目の通電の後に、更に、階調デ−タ各ビット間の
論理積出力に対する通電期間ＰＤH を設け、階調６と階
調７との印加エネルギ−の差を大きくすることで階調特
性を改善することができる。
【００２７】更に、例えば、図４（Ｐ）の階調４を表現
するパルスに注目すれば、パルスＰＤ2(1)とパルスＰＤ
2(2)とを同比率に分割しているが、この濃度階調４を維
持したままＰＤ2(1)とＰＤ2(2)との比率を変えれば、こ
の濃度階調には影響を与えず、濃度階調５と濃度階調６
との濃度差を大きくしたり、小さくしたりすることがで
きる。
するパルスに注目すれば、パルスＰＤ2(1)とパルスＰＤ
2(2)とを同比率に分割しているが、この濃度階調４を維
持したままＰＤ2(1)とＰＤ2(2)との比率を変えれば、こ
の濃度階調には影響を与えず、濃度階調５と濃度階調６
との濃度差を大きくしたり、小さくしたりすることがで
きる。
【００２８】また更に、本実施例では、感熱紙を用いた
記録装置について説明したが、記録ヘッドと記録紙とを
相対的に移動させながら熱記録を行う記録装置であれ
ば、ヘッドと記録紙との間に溶融性、或いは、昇華性の
転写紙を介在させた転写装置であっても同様の効果が得
られるものである。
記録装置について説明したが、記録ヘッドと記録紙とを
相対的に移動させながら熱記録を行う記録装置であれ
ば、ヘッドと記録紙との間に溶融性、或いは、昇華性の
転写紙を介在させた転写装置であっても同様の効果が得
られるものである。
【００２９】
【発明の効果】本発明の感熱ヘッドの通電パルス印加方
法によれば、一つのビットに対する通電を連続パルスで
行うのではなく、他のビットに対応する転送サイクルを
挿入するようにしたので、通電時間の片寄りをなくし、
従来例で示したような同一ライン上での印字ドットの位
置ずれを少なくすることができる。特に、請求項２記載
の発明によれば、より位置ずれを少なくできる。また、
請求項３記載の発明によれば、より微妙な階調特性が表
現できる。更に、請求項４記載の発明によれば、装置の
製造時やユ−ザ−側での使用時に階調特性を変更する場
合、どのビットのパルス幅を増減させても他のビットの
冷却期間には何ら影響を与えず容易に変更できる等の効
果を奏する。
法によれば、一つのビットに対する通電を連続パルスで
行うのではなく、他のビットに対応する転送サイクルを
挿入するようにしたので、通電時間の片寄りをなくし、
従来例で示したような同一ライン上での印字ドットの位
置ずれを少なくすることができる。特に、請求項２記載
の発明によれば、より位置ずれを少なくできる。また、
請求項３記載の発明によれば、より微妙な階調特性が表
現できる。更に、請求項４記載の発明によれば、装置の
製造時やユ−ザ−側での使用時に階調特性を変更する場
合、どのビットのパルス幅を増減させても他のビットの
冷却期間には何ら影響を与えず容易に変更できる等の効
果を奏する。
【図１】本発明の方法が適用されるサ−マヘッドを制御
するための概略ブロック図を示す。
するための概略ブロック図を示す。
【図２】サ−マルヘッドの概略ブロック図である。
【図３】図１、図２及び図４に示した回路における各信
号のタイミングチャ−トである。
号のタイミングチャ−トである。
【図４】デ−タセレクタ１２の概略構成図である。
【図５】濃度補正をする場合の図３に相当するタイミン
グチャ−トである。
グチャ−トである。
【図６】濃度補正を必要とする階調特性の例を示した図
である。
である。
【図７】従来の感熱ヘッドを構成する発熱抵抗体を駆動
するための通電パルスの一例を示す図である。
するための通電パルスの一例を示す図である。
１０ 端子 １１ メモリ（ＲＡＭ） １２ デ−タセレクタ １３ カウンタ群 １４ ＲＯＭ １５ ラッチ １６ コンパレ−タ ２１ 発熱体群 ２２ サ−マルヘッド ２３ シフトレジスタ ２４ ラッチ ２５ ゲ−ト群 ＥＮ1 ，ＥＮ2 イネ−ブルパルス ＳＤ ヘッドデ−タ
Claims (4)
- 【請求項１】一列に配設された複数個の発熱抵抗体から
構成される感熱ヘッドに、所定のビット数から成る記録
濃度の階調を示すディジタルデ−タの各ビットに応じた
通電パルスを印加することで、前記複数個の発熱抵抗体
と対向して相対的に移動する感熱紙に記録を行う感熱記
録装置における感熱ヘッドの通電パルス印加方法におい
て、 所定のビットに対応する通電パルスを分割し、その間に
他のビットに対応する通電パルスを挟んで印加するよう
にしたことを特徴とする感熱ヘッドの通電パルス印加方
法。 - 【請求項２】分割する所定の通電パルスの内、少なくと
も１種類は最上位ビットに対応した通電パルスとし、そ
の間に挟まれる他のビットに対応するパルスの内、少な
くとも１つのパルスは階調デ−タ各ビット間の論理和出
力に対応したパルスであることを特徴とする請求項１記
載の感熱ヘッドの通電パルス印加方法。 - 【請求項３】分割する所定の通電パルスのパルス幅を、
階調特性に応じて互いに異ならせることを特徴とする請
求項１記載の感熱ヘッドの通電パルス印加方法。 - 【請求項４】各ビットに対応する通電パルスの発生周期
を、発熱抵抗体の温度を冷却するための冷却期間を挟ん
で一定にすることを特徴とする請求項１記載の感熱ヘッ
ドの通電パルス印加方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11217094A JP2927395B2 (ja) | 1993-04-28 | 1994-04-27 | 感熱ヘッドの通電パルス印加方法 |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12514693 | 1993-04-28 | ||
| JP5-125146 | 1993-04-28 | ||
| JP11217094A JP2927395B2 (ja) | 1993-04-28 | 1994-04-27 | 感熱ヘッドの通電パルス印加方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0796626A true JPH0796626A (ja) | 1995-04-11 |
| JP2927395B2 JP2927395B2 (ja) | 1999-07-28 |
Family
ID=26451400
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11217094A Expired - Lifetime JP2927395B2 (ja) | 1993-04-28 | 1994-04-27 | 感熱ヘッドの通電パルス印加方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2927395B2 (ja) |
-
1994
- 1994-04-27 JP JP11217094A patent/JP2927395B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JP2927395B2 (ja) | 1999-07-28 |
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