JPH0774516A - Irreversible circuit element - Google Patents

Irreversible circuit element

Info

Publication number
JPH0774516A
JPH0774516A JP6144946A JP14494694A JPH0774516A JP H0774516 A JPH0774516 A JP H0774516A JP 6144946 A JP6144946 A JP 6144946A JP 14494694 A JP14494694 A JP 14494694A JP H0774516 A JPH0774516 A JP H0774516A
Authority
JP
Japan
Prior art keywords
center electrode
circuit device
multilayer substrate
nonreciprocal circuit
capacitance
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP6144946A
Other languages
Japanese (ja)
Other versions
JP3467840B2 (en
Inventor
Hiromoto Dejima
弘基 出嶌
Takashi Hasegawa
長谷川  隆
Yutaka Ishiura
豊 石浦
Giichi Kodo
義一 児堂
Hiroshi Matsui
博志 松井
Keiji Ogawa
圭二 小川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Murata Manufacturing Co Ltd
Original Assignee
Murata Manufacturing Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Murata Manufacturing Co Ltd filed Critical Murata Manufacturing Co Ltd
Priority to JP14494694A priority Critical patent/JP3467840B2/en
Publication of JPH0774516A publication Critical patent/JPH0774516A/en
Application granted granted Critical
Publication of JP3467840B2 publication Critical patent/JP3467840B2/en
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Non-Reversible Transmitting Devices (AREA)

Abstract

PURPOSE:To obtain a reversible circuit element which can be miniaturized regardless of the sizes of the values of matching capacitance. CONSTITUTION:A circulator 1 has a multilayer substrate 3 for forming a center electrode 16a and capacitance for matching. The multilayer substrate 3 is formed by laminating plural sheets of dielectric sheet where the center electrode or a capacitance electrode for matching is formed and integratedly firing,them. Capacitance for matching is composed by connecting a laminated type capacitance part composed by laminating many sheets of dielectric sheet held by a pair of capacitance electrodes in parallel. On the upper surface of the multilayer substrate 3, a first recessed part 26 for accepting a ferrite 21 and a second recessed part 25 for accepting a permanent magnet 5 are provided at the location confronting the center electrode 16, and at this inside, each ferrile 4 and permanent magnet 5 is mounted.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、VHF、UHF、SH
F帯域で採用される非可逆回路素子、例えばサーキュレ
ータやアイソレータに関し、特に、小型化、軽量化並び
に部品コストの低減が可能な構造に関する。
The present invention relates to VHF, UHF, SH
The present invention relates to a non-reciprocal circuit element used in the F band, for example, a circulator or an isolator, and particularly to a structure capable of downsizing, weight saving, and cost reduction of parts.

【0002】[0002]

【従来の技術】一般に、アイソレータやサーキュレータ
などの非可逆回路素子は、信号を伝送方向にのみ通過さ
せ、逆方向への伝送を阻止する機能を有しており、携帯
電話あるいは自動車電話などの移動通信機器の送信回路
部に不可欠な部品である。このような用途において、非
可逆回路素子は部品の小型化、軽量化が要求されてい
る。また、需要を喚起するために、部品の低価格化が要
求されている。このような要求に応えるために、誘電体
基板に中心電極、整合回路用電極などを集約配置した構
造を有する非可逆回路素子が提案されている。このよう
な構造を有するサーキュレータの一例が図8及び図9に
示されている。図9は、サーキュレータの断面構造を示
し、図8は主に誘電体基板の構成を示している。従来の
サーキュレータ100は、金属製ヨーク101内部に誘
電体基板107〜109、フェライト104及び磁石1
06を配置している。フェライト104は、接地板10
5を介在してヨーク104の底面に接続されている。誘
電体基板107〜109は、基板上に形成された中心電
極102がフェライト104に対面する位置に配置され
ている。さらに、磁石106は、中心電極102に対向
するようにヨーク101の内部上面に貼着されている。
そして、この磁石106は、フェライト104に直流磁
界を印加する。
2. Description of the Related Art Generally, non-reciprocal circuit elements such as isolators and circulators have a function of passing signals only in the transmission direction and blocking transmission in the opposite direction, and are used in mobile phones, car phones and the like. It is an indispensable component in the transmission circuit section of communication equipment. In such applications, the nonreciprocal circuit device is required to have smaller and lighter parts. Further, in order to stimulate demand, it is required to reduce the price of parts. In order to meet such a demand, a nonreciprocal circuit device having a structure in which a central electrode, a matching circuit electrode, and the like are collectively arranged on a dielectric substrate has been proposed. An example of a circulator having such a structure is shown in FIGS. 8 and 9. FIG. 9 shows the cross-sectional structure of the circulator, and FIG. 8 mainly shows the structure of the dielectric substrate. A conventional circulator 100 includes a dielectric substrate 107 to 109, a ferrite 104, and a magnet 1 inside a metal yoke 101.
06 is arranged. The ferrite 104 is the ground plate 10
5 is connected to the bottom surface of the yoke 104. The dielectric substrates 107 to 109 are arranged at positions where the center electrode 102 formed on the substrates faces the ferrite 104. Further, the magnet 106 is attached to the inner upper surface of the yoke 101 so as to face the center electrode 102.
Then, the magnet 106 applies a DC magnetic field to the ferrite 104.

【0003】図8に示すように、中心電極102、容量
電極110及びアース電極111は、3つの誘電体基板
107〜109の積層体中に形成されている。この積層
基板は次のような工程により製造されている。まず、セ
ラミックグリーンシートを焼成して各々の基板107〜
109を形成した後、各基板107〜109の一方の主
面に中心電極102、容量電極110及びアース電極1
11をパターン形成し、他方の主面にアース電極112
をパターン形成し焼き付け処理を行う。そして、電極が
形成された各誘電体基板107〜109を積層して圧着
する。さらに、各アース電極111、112同士をスル
ーホール電極113を用いて接続する。なお、各容量電
極110には入出力端子と接続される外部電極114が
形成されている。この積層構造において、容量電極11
0、各誘電体基板107〜109及びアース電極112
によって整合用容量が構成される。
As shown in FIG. 8, the center electrode 102, the capacitor electrode 110, and the ground electrode 111 are formed in a laminated body of three dielectric substrates 107 to 109. This laminated substrate is manufactured by the following steps. First, the ceramic green sheet is fired and each of the substrates 107-
After forming 109, the center electrode 102, the capacitor electrode 110, and the ground electrode 1 are formed on one main surface of each of the substrates 107 to 109.
11 is patterned, and the ground electrode 112 is formed on the other main surface.
Then, a pattern is formed and a baking process is performed. Then, the dielectric substrates 107 to 109 on which the electrodes are formed are stacked and pressure-bonded. Further, the ground electrodes 111 and 112 are connected to each other using the through hole electrode 113. An external electrode 114 connected to the input / output terminal is formed on each capacitance electrode 110. In this laminated structure, the capacitive electrode 11
0, each of the dielectric substrates 107 to 109 and the ground electrode 112
The matching capacitance is formed by.

【0004】この従来のサーキュレータは、互いに交差
する3つの中心電極102の周囲に整合用容量を構成す
ることにより、部品全体の小型化を図っている。
In this conventional circulator, a matching capacitor is formed around three center electrodes 102 intersecting with each other, whereby the size of the entire component is reduced.

【0005】[0005]

【発明が解決しようとする課題】しかしながら、上記の
ような構造は、整合用容量の容量値確保の面から小型化
が制約されるという問題がある。すなわち、整合用容量
の容量値は、容量電極110とアース電極112との対
向面積によって規定される。このため、必要とされる容
量値が大きくなれば、容量電極110の電極面積を大き
くしなければならない。従って、各誘電体基板107〜
109の基板面積が増大し、結果として部品全体が大型
化する。言い換えれば、要求される容量値によって部品
の大きさが制約される。
However, the structure as described above has a problem that miniaturization is restricted in terms of securing the capacitance value of the matching capacitor. That is, the capacitance value of the matching capacitance is defined by the facing area between the capacitance electrode 110 and the ground electrode 112. Therefore, if the required capacitance value increases, the electrode area of the capacitance electrode 110 must be increased. Therefore, each dielectric substrate 107-
The substrate area of 109 is increased, and as a result, the size of the entire component is increased. In other words, the size of the component is restricted by the required capacitance value.

【0006】また、従来の構造では、セラミックグリー
ンシートを焼成する工程と、パターン化された各電極を
基板上に焼き付ける工程の2回の焼成工程を必要とする
ため、製造コストが高くなるという問題もあった。また
製造コストの面からは、磁石106、フェライト104
などを個別にヨーク101内に位置決めし、固定するな
どの煩雑な組み立て作業も製造コスト増加の要因となっ
ていた。
Further, the conventional structure requires two firing steps of firing the ceramic green sheet and firing each patterned electrode on the substrate, resulting in a high manufacturing cost. There was also. In terms of manufacturing cost, the magnet 106 and the ferrite 104
The complicated assembly work of individually positioning and fixing the above in the yoke 101 has also been a factor of increasing the manufacturing cost.

【0007】本発明の目的は、部品の小型化が可能な非
可逆回路素子を提供することである。
An object of the present invention is to provide a non-reciprocal circuit device which can be downsized.

【0008】[0008]

【課題を解決するための手段及び作用】本発明の広い局
面によれば、非可逆回路素子は、複数の誘電体層を積層
した多層基板と、多層基板中に形成され、かつ互いに電
気的に絶縁された状態で交差するように形成された複数
の中心電極と、多層基板中に積層され、中心電極毎に接
続される複数の容量部を有する整合用容量と、中心電極
に対向して設けられた磁性体と、磁性体に直流磁界を印
加するための磁石とを用いて構成される。
According to a broad aspect of the present invention, a nonreciprocal circuit device includes a multilayer substrate in which a plurality of dielectric layers are laminated, and an electrically non-reciprocal circuit formed in the multilayer substrate. A matching capacitor having a plurality of center electrodes formed to intersect each other in an insulated state, a plurality of capacitor parts stacked in a multilayer substrate and connected to each center electrode, and a matching capacitor provided so as to face the center electrode. And a magnet for applying a DC magnetic field to the magnetic body.

【0009】このような構成によれば、整合用容量は、
多層基板中に積層される容量部の積層数を適宜設定する
ことによって必要な容量値を確保することができる。こ
のため、多層基板の平面領域内の面積を増大させること
なく整合用容量の容量値を増大することができる。この
結果、非可逆回路素子の平面的な大きさを縮小し、部品
の小型化を図ることができる。
According to this structure, the matching capacitance is
A necessary capacitance value can be ensured by appropriately setting the number of stacked capacitor portions stacked in the multilayer substrate. Therefore, the capacitance value of the matching capacitor can be increased without increasing the area in the plane area of the multilayer substrate. As a result, the planar size of the non-reciprocal circuit device can be reduced, and the size of the component can be reduced.

【0010】本発明の他の目的は、部品の小型化が可能
であり、かつ部品コストの低減を図ることが可能な非可
逆回路素子を提供することである。本発明の他の局面に
おける非可逆回路素子は、多層基板が積層された複数の
誘電体層を一体焼成して形成されている。
Another object of the present invention is to provide a non-reciprocal circuit device capable of reducing the size of parts and reducing the cost of parts. A nonreciprocal circuit device according to another aspect of the present invention is formed by integrally firing a plurality of dielectric layers on which a multilayer substrate is laminated.

【0011】このような構成により、多層基板は一度の
焼成工程により一体的に形成される。従って、前述した
従来の非可逆回路素子に比較して焼成工程が減少し、製
造コストが低下する。
With such a structure, the multilayer substrate is integrally formed by a single firing process. Therefore, as compared with the conventional non-reciprocal circuit device described above, the firing process is reduced and the manufacturing cost is reduced.

【0012】さらに、本発明の他の局面における非可逆
回路素子は、磁性体を中心電極に対向する位置に保持す
るための第1保持部を多層基板中に形成しており、磁性
体は、この第1保持部に保持される。
Further, in the nonreciprocal circuit device according to another aspect of the present invention, the first holding portion for holding the magnetic body at a position facing the center electrode is formed in the multilayer substrate, and the magnetic body is It is held by this first holding portion.

【0013】このような構成により、磁性体は、多層基
板の第1保持部に装着することにより中心電極との相対
位置が自動的に設定される。従って、煩雑な位置決め工
程が省略され、製造コストの低減を図ることができる。
With such a structure, the relative position of the magnetic body to the center electrode is automatically set by mounting the magnetic body on the first holding portion of the multilayer substrate. Therefore, a complicated positioning process can be omitted, and the manufacturing cost can be reduced.

【0014】さらに、本発明の他の局面における非可逆
回路素子は、磁石を中心電極に対向する位置に保持する
ための第2保持部を多層基板中に形成しており、磁石は
この第2保持部に保持される。
Furthermore, in the nonreciprocal circuit device according to another aspect of the present invention, a second holding portion for holding the magnet at a position facing the center electrode is formed in the multilayer substrate, and the magnet is the second holding portion. It is held by the holding unit.

【0015】このような構成により、磁石を第2保持部
に装着することにより、磁石と中心電極との位置関係が
自動的に設定される。従って、煩雑な位置決め工程が省
略され、製造コストの低減を図ることができる。
With this structure, the positional relationship between the magnet and the center electrode is automatically set by mounting the magnet on the second holding portion. Therefore, a complicated positioning process can be omitted, and the manufacturing cost can be reduced.

【0016】なお、本発明における上記複数の中心電極
は、多層基板内において、異なる高さ位置に形成されて
いてもよい。この場合には、一体焼成技術を用いて多層
基板を得るにあたり、異なる誘電体層表面に、前記複数
の中心電極を形成しておけばよい。
The plurality of center electrodes in the present invention may be formed at different height positions in the multilayer substrate. In this case, the plurality of center electrodes may be formed on the surfaces of different dielectric layers when the multilayer substrate is obtained by the integral firing technique.

【0017】また、前記中心電極は、基板内の1つの誘
電体層の一面に配置された第1中心電極部と、他面に配
置された第2中心電極部と、該誘電体層に形成されてお
り、かつ第1,第2中心電極部を電気的に接続するスル
ーホール導電部とを有するように構成してもよい。この
場合には、多層基板を一体焼成技術により得るにあた
り、1つの誘電体層に上記スルーホール導電部を形成
し、該誘電体層の上面及び下面に第1,第2の中心電極
部を形成してもよく、あるいは、スルーホール導電部が
形成された誘電体層の一面に第1中心電極部を形成し、
該誘電体層の他面に接触される他の誘電体層の一面に第
2中心電極部を形成してもよい。
Further, the center electrode is formed on the dielectric layer, and a first center electrode portion arranged on one surface of one dielectric layer in the substrate, a second center electrode portion arranged on the other surface of the dielectric layer. And a through-hole conductive portion that electrically connects the first and second center electrode portions to each other. In this case, when the multilayer substrate is obtained by the integral firing technique, the through hole conductive portion is formed on one dielectric layer, and the first and second center electrode portions are formed on the upper surface and the lower surface of the dielectric layer. Alternatively, the first center electrode portion may be formed on one surface of the dielectric layer on which the through-hole conductive portion is formed,
The second center electrode portion may be formed on one surface of another dielectric layer that is in contact with the other surface of the dielectric layer.

【0018】[0018]

【実施例の説明】以下、本発明の非可逆回路素子の実施
例を図面を参照しつつ説明することにより、本発明を明
らかにする。
DESCRIPTION OF THE PREFERRED EMBODIMENTS The present invention will be clarified by describing embodiments of the nonreciprocal circuit device of the present invention with reference to the drawings.

【0019】第1の実施例 本発明の第1の実施例による集中定数型のサーキュレー
タの構造が図1ないし図4に示されている。図1を参照
して、サーキュレータ1は、多層基板3と下ヨーク2及
び上ヨーク6とを有している。下ヨーク2及び上ヨーク
6は磁性体金属からなり、上下方向から多層基板3を包
み込むような箱型形状を有している。
First Embodiment The structure of a lumped constant type circulator according to the first embodiment of the present invention is shown in FIGS. Referring to FIG. 1, the circulator 1 has a multilayer substrate 3, a lower yoke 2 and an upper yoke 6. The lower yoke 2 and the upper yoke 6 are made of a magnetic metal and have a box shape so as to enclose the multilayer substrate 3 from above and below.

【0020】多層基板3は、上ヨーク6側の上部に、フ
ェライト4を挿入するための第1凹部26と永久磁石5
を受け入れるための第2凹部25とを有し、下ヨーク2
側の両端部には凸部7、7が形成されている。この凸部
7、7は、入出力端子及びアース端子となる外部電極8
a〜8c、9a〜9cを外部に露出させるように上ヨー
ク6と下ヨーク2との間から突出している。そして、サ
ーキュレータ1が基板上に実装された場合、この外部電
極8a〜8c、9a〜9cは回路基板の電極ラインに接
続される。
The multilayer substrate 3 has a first concave portion 26 for inserting the ferrite 4 and a permanent magnet 5 on the upper portion on the side of the upper yoke 6.
And a second recess 25 for receiving
Convex portions 7, 7 are formed at both ends on the side. The convex portions 7, 7 are external electrodes 8 serving as input / output terminals and ground terminals.
It projects from between the upper yoke 6 and the lower yoke 2 so that a to 8c and 9a to 9c are exposed to the outside. When the circulator 1 is mounted on the board, the external electrodes 8a to 8c and 9a to 9c are connected to the electrode lines on the circuit board.

【0021】フェライト4は、多層基板3中の第2凹部
26内に装着される。また、永久磁石5は、接地板27
を介在してフェライト4の上部の第2凹部25内に装着
される。
The ferrite 4 is mounted in the second recess 26 in the multilayer substrate 3. In addition, the permanent magnet 5 has a ground plate 27.
It is mounted in the second recess 25 in the upper part of the ferrite 4 with the interposition of.

【0022】多層基板3は、図3及び図4に示すよう
に、多数の誘電体層を一体焼成して形成された焼結体で
あり、この焼結体の内部に各電極が埋設されている。こ
こでは、説明の便宜上、焼結前の各誘電体層毎に参照番
号を付して各部の構成を説明する。まず、図4を参照し
て、多層基板3は主に6つの層L1〜L6に識別され
る。第1層L1は、永久磁石5を受け入れるための第2
凹部25を有しており、例えば2枚の第1誘電体シート
12から構成される。第1誘電体シート12の中央部に
は、永久磁石5を受け入れることができる大きさの孔1
2aが形成されている。
As shown in FIGS. 3 and 4, the multi-layer substrate 3 is a sintered body formed by integrally firing a large number of dielectric layers, and each electrode is embedded inside the sintered body. There is. Here, for convenience of description, reference numerals are given to each of the dielectric layers before sintering, and the configuration of each part will be described. First, referring to FIG. 4, the multilayer substrate 3 is mainly distinguished into six layers L1 to L6. The first layer L1 is a second layer for receiving the permanent magnet 5.
It has a recess 25 and is composed of, for example, two first dielectric sheets 12. A hole 1 sized to receive the permanent magnet 5 is formed in the center of the first dielectric sheet 12.
2a is formed.

【0023】第2層L2は、フェライト4を受け入れる
ための第1凹部26が形成されており、例えば2枚の第
2誘電体シート13によって構成されている。第2誘電
体シート13は、その中央部にフェライト4を挿入する
ことができる大きさの孔13aを有している。
The second layer L2 is formed with a first recess 26 for receiving the ferrite 4, and is composed of, for example, two second dielectric sheets 13. The second dielectric sheet 13 has a hole 13a having a size into which the ferrite 4 can be inserted, at the center thereof.

【0024】第3層L3は、主に整合用容量を形成する
ためのものであり、アース電極14aが形成された第3
誘電体シート14と容量電極15a〜15cが形成され
た第4誘電体シート15とが交互に複数組積層されてい
る。アース電極14aは、第3誘電体シート14の中央
部を除くほぼ全面に形成されており、第3誘電体シート
14の一方側側縁に外部導出部14bを、また他方側の
側縁に2つの外部導出部14bを有している。なお、こ
れらの外部導出14bは、それぞれ外部電極8b、9
a、9cに接続されるものである。
The third layer L3 is mainly for forming a matching capacitor, and is the third layer on which the ground electrode 14a is formed.
Plural sets of dielectric sheets 14 and fourth dielectric sheets 15 having the capacitance electrodes 15a to 15c are alternately laminated. The ground electrode 14a is formed on almost the entire surface of the third dielectric sheet 14 except for the central portion thereof, and the external lead-out portion 14b is provided on one side edge of the third dielectric sheet 14 and the external lead portion 2 is provided on the other side edge thereof. It has one external lead-out portion 14b. In addition, these external leads 14b are respectively connected to the external electrodes 8b and 9b.
a, 9c.

【0025】容量電極15a〜15cは、第4誘電体シ
ート15表面上に、互いに120度の間隔を持って均等
に配置されている。そして、1つの容量電極、例えば1
5aと、1つの誘電体シート14あるいは15と、1つ
のアース電極14aの組み合わせによって1つの容量部
が構成される。この第3層L3には、このような容量部
が多数積層されている。そして、この容量部の積層数
は、必要とされる整合用容量の容量値に応じて設定され
る。
The capacitive electrodes 15a to 15c are evenly arranged on the surface of the fourth dielectric sheet 15 with an interval of 120 degrees from each other. And one capacitive electrode, eg 1
5a, one dielectric sheet 14 or 15, and one earth electrode 14a are combined to form one capacitance section. A large number of such capacitance portions are stacked on the third layer L3. Then, the number of stacked layers of the capacitance section is set according to the required capacitance value of the matching capacitance.

【0026】また、第4層L4は、中心電極16aが形
成された3枚の第5誘電体シート16から構成される。
なお、この第5誘電体シート16は上記の容量部を構成
する誘電体シートを兼用している。各中心電極16a
は、第5誘電体シート16表面上の中央部に平行に延び
る2本の線路を有している。3枚の第5誘電体シート1
6〜16に形成された中心電極16aの各々は、互いに
120度の角度を持って互いに交差した状態で各誘電体
シート上に配置されている。また、各中心電極16aの
一端には、上記の1つの容量部を構成する1つの容量電
極16bが接続して形成されている。また、中心電極1
6aの他端はアース電極16cに接続されている。
The fourth layer L4 is composed of three fifth dielectric sheets 16 on which the center electrode 16a is formed.
The fifth dielectric sheet 16 also serves as the dielectric sheet that constitutes the above-mentioned capacitance section. Each center electrode 16a
Has two lines extending in parallel to the central portion on the surface of the fifth dielectric sheet 16. Three fifth dielectric sheets 1
The center electrodes 16a formed in 6 to 16 are arranged on the respective dielectric sheets in a state of intersecting each other at an angle of 120 degrees. Further, one capacitance electrode 16b forming the above-mentioned one capacitance portion is connected to one end of each center electrode 16a. Also, the center electrode 1
The other end of 6a is connected to the ground electrode 16c.

【0027】各容量電極16bには、各々外部導出電極
16dが形成されている。この各導出電極16dは、そ
れぞれ外部電極8a、8c、9bに接続される。また、
各アース電極16cに形成された外部導出部16eは、
それぞれ外部電極8b、9a、9cに接続される。
An external lead electrode 16d is formed on each capacitor electrode 16b. The lead electrodes 16d are connected to the outer electrodes 8a, 8c, 9b, respectively. Also,
The external lead-out portion 16e formed on each ground electrode 16c is
It is connected to the external electrodes 8b, 9a, 9c, respectively.

【0028】第5層L5は、アース電極14aが形成さ
れた第4誘電体シート14が複数枚積層されている。最
下部の第4誘電体シート14は、アース電極14aが下
方に向かうように積層されている。
The fifth layer L5 is formed by laminating a plurality of fourth dielectric sheets 14 having the ground electrode 14a formed thereon. The lowermost fourth dielectric sheet 14 is laminated so that the ground electrode 14a faces downward.

【0029】第6層L6は、2つの凸部7、7を構成す
る部分であり、複数の帯状セラミックシート23、24
が積層されている。各セラミックシート23、24の外
側面には、各々外部電極8a〜8c及び9a〜9cに対
応する電極8a´〜8c´、9a´〜9c´が形成され
ている。
The sixth layer L6 is a portion which constitutes the two convex portions 7, 7 and comprises a plurality of strip-shaped ceramic sheets 23, 24.
Are stacked. Electrodes 8a 'to 8c' and 9a 'to 9c' corresponding to the external electrodes 8a to 8c and 9a to 9c are formed on the outer surfaces of the ceramic sheets 23 and 24, respectively.

【0030】上記の構成において、第3層L3に形成さ
れた複数の容量電極15a、16bはスルーホール電極
20を介して積層方向に接続されている。また、同様に
容量電極15b、16b及び容量電極15c、16bは
それぞれスルーホール電極20、20を介して積層方向
に接続されている。さらに、複数のアース電極14aは
スルーホール電極21を介して積層方向に接続されてい
る。このような接続により、第3層L3に構成された各
容量部は各中心電極16a毎に並列に接続され、各整合
用容量を構成する。
In the above structure, the plurality of capacitance electrodes 15a and 16b formed on the third layer L3 are connected in the stacking direction via the through hole electrodes 20. Similarly, the capacitance electrodes 15b and 16b and the capacitance electrodes 15c and 16b are connected in the stacking direction via the through-hole electrodes 20 and 20, respectively. Further, the plurality of ground electrodes 14 a are connected in the stacking direction via the through hole electrodes 21. With such a connection, the respective capacitance portions formed in the third layer L3 are connected in parallel for each center electrode 16a, and form each matching capacitance.

【0031】また、第6層L6に形成された電極8a、
8c、9bは、それぞれ容量電極16d〜16dに接続
されている。上記のような構成を有する多層基板3は、
次のようにして製造される。まず、誘電体セラミック粉
末と有機バインダ等とを混合したスラリーから、例えば
押し出し成形によって可撓性を有するセラミックグリー
ンシートを形成し、所定の寸法に切断する。次に、厚さ
数十μm程度の矩形板状のセラミックグリーンシートの
表面に、Cu、Pd、Pt、Ag等の電極を印刷あるい
は蒸着法などを用いてパターン形成する。そして、各誘
電体シートを図3あるいは図4に示す順に積層して圧着
した後、積層体を高温焼成して形成する。なお、凸部
7、7を構成するセラミックシート23、24も同時に
焼成される。これにより、誘電体シートと各電極とが一
体焼成された多層基板3が形成される。
Further, the electrodes 8a formed on the sixth layer L6,
8c and 9b are connected to the capacitance electrodes 16d to 16d, respectively. The multilayer substrate 3 having the above structure is
It is manufactured as follows. First, a flexible ceramic green sheet is formed by, for example, extrusion molding from a slurry obtained by mixing dielectric ceramic powder and an organic binder, and cut into a predetermined size. Next, electrodes such as Cu, Pd, Pt, and Ag are patterned on the surface of a rectangular plate-shaped ceramic green sheet having a thickness of several tens of μm by printing or vapor deposition. Then, the respective dielectric sheets are laminated in the order shown in FIG. 3 or FIG. 4 and pressure-bonded, and then the laminated body is fired at a high temperature to be formed. The ceramic sheets 23 and 24 that form the convex portions 7 and 7 are also fired at the same time. As a result, the multilayer substrate 3 in which the dielectric sheet and each electrode are integrally fired is formed.

【0032】なお、永久磁石5及びフェライト4を挿入
するための第1及び第2凹部25、26は、セラミック
グリーンシートに予め形成した後焼成してもよく、また
一体焼成された多層基板3の上面を切削加工して形成し
てもよい。
The first and second recesses 25 and 26 into which the permanent magnet 5 and the ferrite 4 are inserted may be preformed on the ceramic green sheet and then fired, or the integrally fired multilayer substrate 3 may be formed. The upper surface may be formed by cutting.

【0033】このように構成されたサーキュレータ1
は、組立工程において、まず、多層基板3の第1及び第
2凹部25、26内にフェライト4、接地板27及び永
久磁石5を挿入した後、下ヨーク2及び上ヨーク6を組
み立てることにより完成する。そして、フェライト4及
び永久磁石5は、予め形成された第1及び第2凹部2
5、26によって中心電極16aに対面する所定の位置
に自動的に位置決めされる。そして、永久磁石5はフェ
ライト4に対して直流磁界を印加する。
The circulator 1 thus constructed
Is completed by first assembling the lower yoke 2 and the upper yoke 6 after inserting the ferrite 4, the ground plate 27 and the permanent magnet 5 into the first and second recesses 25 and 26 of the multilayer substrate 3 in the assembly process. To do. Then, the ferrite 4 and the permanent magnet 5 have the first and second recesses 2 formed in advance.
5, 26 is automatically positioned at a predetermined position facing the center electrode 16a. Then, the permanent magnet 5 applies a DC magnetic field to the ferrite 4.

【0034】本実施例のサーキュレータ1は、以下のよ
うな特徴を有する。 (1)整合用容量は、多層基板3の第3層L3中に積層
された複数の容量部を並列接続することによって構成さ
れる。従って、必要とされる容量値が増大した場合に
は、容量部の積層数を増大させることによって対応でき
る。この場合、容量部を構成する各誘電体シートは、そ
の厚さが数十μm程度であるため、積層数が増大しても
多層基板3全体の厚みが増大する割合は極めて小さい。
従って、容量部を構成する容量電極15a、16bの平
面面積を低減効果の方が部品の小型化に大きく寄与す
る。
The circulator 1 of this embodiment has the following features. (1) The matching capacitor is configured by connecting in parallel a plurality of capacitor units stacked in the third layer L3 of the multilayer substrate 3. Therefore, when the required capacitance value increases, it can be dealt with by increasing the number of stacked capacitor portions. In this case, since the thickness of each dielectric sheet that constitutes the capacitance portion is about several tens of μm, even if the number of laminated layers increases, the rate at which the total thickness of the multilayer substrate 3 increases is extremely small.
Therefore, the effect of reducing the planar area of the capacitance electrodes 15a and 16b forming the capacitance portion contributes more to the miniaturization of the component.

【0035】(2)多層基板3は複数のセラミックグリ
ーンシート表面上に所定の電極をパターン形成した後、
一体焼成して製造される。従って、前述した従来例にお
いて、2度の焼成工程を必要とするものに比べ、焼成工
程を減少することができ、製造コストを低減することが
可能となる。
(2) The multilayer substrate 3 is formed by patterning predetermined electrodes on the surfaces of a plurality of ceramic green sheets,
It is manufactured by integral firing. Therefore, in the above-described conventional example, the number of firing steps can be reduced and the manufacturing cost can be reduced as compared with the case where two firing steps are required.

【0036】(3)フェライト4及び永久磁石5は、多
層基板3の上面に予め形成された第1及び第2凹部2
5、26に挿入するだけで位置決めされる。このため
に、従来例において必要とされたフェライトあるいは永
久磁石の位置決め工程を実質上省略することができ、組
み立て工程が簡略化される。これによっても製造コスト
を低減することが可能となる。
(3) The ferrite 4 and the permanent magnet 5 are formed on the upper surface of the multilayer substrate 3 by the first and second recesses 2 formed in advance.
It is positioned simply by inserting it in 5, 26. Therefore, the ferrite or permanent magnet positioning step required in the conventional example can be substantially omitted, and the assembling step is simplified. This also makes it possible to reduce the manufacturing cost.

【0037】(4)フェライト4を受け入れる第1凹部
26と永久磁石5を受け入れる第2凹部25とが多層基
板3の上面に同軸上に連続して形成されている。このた
め、永久磁石5とフェライト4とが近接配置される。一
般に、永久磁石5の磁界は外側に向かって広がるような
形状を有するため、磁石とフェライトとの距離が離れる
程磁束が疎になり、近づけば近づくほど磁束は密にな
る。このため、永久磁石5とフェライト4との距離が近
接した本実施例の構成では磁束が密になり、従来例に比
べて磁力の弱い永久磁石5を用いても同等の作用を果た
すことができる。
(4) The first recess 26 for receiving the ferrite 4 and the second recess 25 for receiving the permanent magnet 5 are coaxially and continuously formed on the upper surface of the multilayer substrate 3. Therefore, the permanent magnet 5 and the ferrite 4 are arranged close to each other. In general, since the magnetic field of the permanent magnet 5 has a shape that spreads outward, the magnetic flux becomes sparse as the distance between the magnet and the ferrite increases, and the magnetic flux becomes denser as the distance approaches. Therefore, in the configuration of this embodiment in which the permanent magnet 5 and the ferrite 4 are close to each other, the magnetic flux is dense, and even if the permanent magnet 5 having a weaker magnetic force than that of the conventional example is used, the same effect can be achieved. .

【0038】第2の実施例 第2の実施例によるサーキュレータは、第1の実施例に
比べて、フェライト4及び永久磁石5の配置状態が異な
っている。すなわち、図5及び図6に示すように、この
サーキュレータ50は、多層基板53の中心電極(図示
せず)に対面する上面及び下面に各々永久磁石5を受け
入れるための第2凹部55、55とフェライト4を受け
入れるための第1凹部56、56とを形成している。そ
して、各第2凹部55内には永久磁石5、5が装着さ
れ、第1凹部56内には接地板27を介在してフェライ
ト4、4が装着されている。このような構成により、多
層基板53内の各中心電極は、一対のフェライト4によ
って上下方向から挟持され、かつ一対の永久磁石5によ
り上下両面からバイアス磁界が印加されるように構成さ
れている。このような構成によれば、特に第1の実施例
のサーキュレータと比較して、挿入損失をより低減でき
る効果が得られる。また、第1の実施例で説明した効果
も同様に得ることができる。
Second Embodiment The circulator according to the second embodiment is different from the first embodiment in the arrangement state of the ferrite 4 and the permanent magnet 5. That is, as shown in FIGS. 5 and 6, the circulator 50 has second recesses 55, 55 for receiving the permanent magnets 5 on the upper surface and the lower surface facing the center electrode (not shown) of the multilayer substrate 53, respectively. First recesses 56, 56 for receiving the ferrite 4 are formed. Then, the permanent magnets 5, 5 are mounted in the respective second recesses 55, and the ferrites 4, 4 are mounted in the first recesses 56 with the ground plate 27 interposed. With such a configuration, each center electrode in the multilayer substrate 53 is sandwiched by a pair of ferrites 4 from above and below, and a pair of permanent magnets 5 applies a bias magnetic field from above and below. According to such a configuration, an effect that the insertion loss can be further reduced is obtained as compared with the circulator of the first embodiment. Moreover, the effects described in the first embodiment can be obtained in the same manner.

【0039】なお、上記第1及び第2の実施例では、非
可逆回路素子としてサーキュレータを例に説明したが、
本発明の構成はアイソレータに適用することも可能であ
る。アイソレータに適用する場合には、3つの中心電極
16aの何れか1つの導出電極16dに終端抵抗を接続
することによって実現される。
In the first and second embodiments described above, the circulator has been described as an example of the nonreciprocal circuit element.
The configuration of the present invention can also be applied to an isolator. When it is applied to an isolator, it is realized by connecting a terminating resistor to any one lead electrode 16d of the three center electrodes 16a.

【0040】さらに、上記実施例においては、多層基板
3中に形成された各容量電極、アース電極同士はスルー
ホール電極を介して接続されたが、スルーホール電極の
代わりに、誘電体シートの側面に電極を形成して各電極
間を接続するように構成してもよい。
Further, in the above embodiment, the capacitance electrodes and the ground electrodes formed in the multilayer substrate 3 were connected to each other through the through hole electrodes, but instead of the through hole electrodes, the side surface of the dielectric sheet is used. An electrode may be formed on each of the electrodes and the electrodes may be connected to each other.

【0041】変形例 第2の実施例では、複数の中心電極は、異なる誘電体層
上に形成されていたが、本発明における複数の中心電極
は、同一の誘電体シートを用いて形成することも可能で
ある。このような変形例を、図7を参照して説明する。
Modified Example In the second embodiment, the plurality of center electrodes are formed on different dielectric layers, but the plurality of center electrodes in the present invention should be formed using the same dielectric sheet. Is also possible. Such a modified example will be described with reference to FIG. 7.

【0042】図7の誘電体シート61は、図3に示した
3枚の第5誘電体シート16に代えて用いられる構造に
相当する。誘電体シート61の上面中央領域には、第1
中心電極部62a〜67aが形成されている。この6本
の第1中心電極部62a〜67aは、互いに平行に延び
る一対の第1中心電極部を1つのグループとして、3つ
のグループに分類される。例えば、第1中心電極部62
aと第1中心電極部63aとが、1つのグループを構成
しており、1つのグループを構成している一方の第1中
心電極部62aが、他方の第1中心電極部63aに比べ
てその長さが長くされている。
The dielectric sheet 61 shown in FIG. 7 corresponds to a structure used in place of the three fifth dielectric sheets 16 shown in FIG. In the central area of the upper surface of the dielectric sheet 61, the first
Center electrode portions 62a to 67a are formed. The six first center electrode portions 62a to 67a are classified into three groups, with a pair of first center electrode portions extending parallel to each other as one group. For example, the first center electrode portion 62
a and the first center electrode portion 63a form one group, and one first center electrode portion 62a that forms one group is smaller than that of the other first center electrode portion 63a. The length has been lengthened.

【0043】また、各グループを構成している一対の第
1中心電極部は、中心側が欠落した扇型形状の電極部6
8〜70に電気的に接続されている。また、誘電体シー
ト61には、スルーホール導電部71〜73が形成され
ている。スルーホール導電部71〜73は、貫通孔に導
電性材料を充填することにより形成されている。電極部
68〜70は、スルーホール導電部71〜73により誘
電体シート61の下面に引出されている。
Further, the pair of first center electrode portions forming each group has a fan-shaped electrode portion 6 with the center side missing.
8 to 70 electrically connected. The dielectric sheet 61 has through-hole conductive portions 71 to 73 formed therein. The through hole conductive portions 71 to 73 are formed by filling the through holes with a conductive material. The electrode parts 68 to 70 are drawn out to the lower surface of the dielectric sheet 61 by the through hole conductive parts 71 to 73.

【0044】さらに、上記複数本の第1中心電極部62
a〜67aの先端には、それぞれ、スルーホール導電部
74が形成されている。他方、図7において、下面の電
極形状を明らかにするために、下方に投影して下面の電
極形状を示す。誘電体シート61の下面では、中央に、
第2中心電極部62b〜67bが形成されている。第2
中心電極部62b〜67bは、それぞれ、前述したスル
ーホール導電部74を介して、対応する第1中心電極部
に電気的に接続されている。例えば、第2中心電極部6
2bは、スルーホール導電部74を介して上面側の第1
中心電極部62aと電気的に接続され、それによって一
本の中心電極を構成している。他の第1,第2の中心電
極部も、同様に、スルーホール導電部を介して電気的に
接続され、それぞれ中心電極を構成している。
Further, the plurality of first center electrode portions 62 are provided.
Through-hole conductive portions 74 are formed at the tips of a to 67a, respectively. On the other hand, in FIG. 7, in order to clarify the electrode shape of the lower surface, the electrode shape of the lower surface is shown by projecting downward. On the lower surface of the dielectric sheet 61, in the center,
Second center electrode portions 62b to 67b are formed. Second
Each of the center electrode portions 62b to 67b is electrically connected to the corresponding first center electrode portion via the through hole conductive portion 74 described above. For example, the second center electrode portion 6
2b denotes the first upper surface side through the through-hole conductive portion 74.
It is electrically connected to the center electrode portion 62a, thereby forming one center electrode. Similarly, the other first and second center electrode portions are also electrically connected to each other through the through-hole conductive portions to form center electrodes.

【0045】従って、図7に示した変形例では、各中心
電極が、1つの誘電体シート61の上面及び下面を利用
して構成されており、かつ誘電体シート61の中央領域
で交差される複数の中心電極のいずれもが、単一の誘電
体シート61の上面及び下面を利用して構成されてい
る。すなわち、複数の中心電極間は、多層基板内の誘電
体層を介して隔てられていない。
Therefore, in the modification shown in FIG. 7, each center electrode is constructed by utilizing the upper surface and the lower surface of one dielectric sheet 61, and intersects in the central region of the dielectric sheet 61. Each of the plurality of center electrodes is configured by utilizing the upper surface and the lower surface of the single dielectric sheet 61. That is, the plurality of center electrodes are not separated by the dielectric layer in the multilayer substrate.

【0046】なお、図7において、第2中心電極部62
b〜67bのスルーホール導電部74に接続される先端
部分と反対側の部分は、周囲に形成されたアース電極7
7に電気的に接続されている。また、アース電極77で
は、中央領域に向かって開かれた複数の切欠部78が形
成されている。各切欠部78は、電極部68〜70に電
気的に接続されているスルーホール導電部71〜73
と、アース電極77との電気的接続を防止するために設
けられている。スルーホール導電部71〜73は、図3
に示したスルーホール導電部20に電気的に接続され
る。他方、アース電極77は、破線の円で示すように、
下方に配置されたスルーホール導電部21(図3参照)
に電気的に接続される。
In FIG. 7, the second center electrode portion 62
b-67b, the portion opposite to the tip portion connected to the through-hole conductive portion 74 is the ground electrode 7 formed in the periphery.
It is electrically connected to 7. Further, in the ground electrode 77, a plurality of cutouts 78 opened toward the central region are formed. Each notch 78 has a through hole conductive portion 71-73 electrically connected to the electrode portion 68-70.
And to prevent electrical connection with the ground electrode 77. The through-hole conductive parts 71 to 73 are shown in FIG.
Is electrically connected to the through-hole conductive portion 20 shown in FIG. On the other hand, the ground electrode 77, as shown by the dashed circle,
Through-hole conductive portion 21 arranged below (see FIG. 3)
Electrically connected to.

【0047】図7においては、1枚の誘電体シート61
の上面及び下面に上記電極構造が設けられていたが、誘
電体シート61の下面側の電極構造は、誘電体シート6
1の下面に配置される他の誘電体シートの上面に形成さ
れていてもよい。すなわち、本変形例における電極構造
は、スルーホール導電部で接続され得る限り、複数枚の
誘電体シートに分離して形成されてもよい。
In FIG. 7, one dielectric sheet 61 is used.
Although the above-mentioned electrode structure was provided on the upper and lower surfaces of the dielectric sheet 61, the electrode structure on the lower surface side of the dielectric sheet 61 was
It may be formed on the upper surface of another dielectric sheet disposed on the lower surface of 1. That is, the electrode structure according to the present modification may be separately formed into a plurality of dielectric sheets as long as they can be connected by the through-hole conductive portion.

【0048】[0048]

【発明の効果】以上のように、本発明によれば、整合容
量が、多層基板中に積層された容量部の積層数を適宜定
めることにより確保され得るため、多層基板の平面形状
を増大させることなく、整合容量の容量値を高めること
ができる。その結果、非可逆回路素子の小型化を促進す
ることが可能となる。また、多層基板を、複数の誘電体
を一体焼成して形成した構造の場合には、多層基板が一
度の焼成工程により得られるため、従来の非可逆回路素
子に比べて製造工程を簡略化することができ、コストを
低減することが可能となる。
As described above, according to the present invention, since the matching capacitance can be ensured by appropriately determining the number of laminated capacitor portions laminated in the multilayer substrate, the planar shape of the multilayer substrate is increased. Without increasing the capacitance value of the matching capacitance. As a result, it becomes possible to promote miniaturization of the non-reciprocal circuit device. Further, in the case of a structure in which a multi-layer substrate is formed by integrally firing a plurality of dielectrics, the multi-layer substrate can be obtained by a single firing process, so that the manufacturing process is simplified as compared with the conventional non-reciprocal circuit device. Therefore, the cost can be reduced.

【0049】また、磁性体を中心電極に対向する位置に
保持するために、第1保持部を多層基板に形成した場合
には、磁性体の中心電極に対する位置決めを容易に行う
ことができ、その点から製造コストの低減を図り得る。
Further, when the first holding portion is formed on the multilayer substrate to hold the magnetic body at a position facing the center electrode, the magnetic body can be easily positioned with respect to the center electrode. From this point, the manufacturing cost can be reduced.

【0050】同様に、磁石を保持するために、多層基板
に第2保持部を形成した場合には、磁石と中心電極との
位置決めを容易に果たすことができるため、製造コスト
の低減を図ることができる。
Similarly, when the second holding portion is formed on the multilayer substrate to hold the magnet, the magnet and the center electrode can be easily positioned, so that the manufacturing cost can be reduced. You can

【0051】さらに、上記第1,第2の保持部を、多層
基板に形成された凹部により構成した場合には、多層基
板の厚みを増大させることなく、上記磁性体及び磁石を
収納することができるため、非可逆回路素子の厚み方向
寸法を小さくすることができ、非可逆回路素子の小型化
をより一層促進することができる。
Further, when the first and second holding portions are formed by the recesses formed in the multilayer substrate, the magnetic body and the magnet can be housed without increasing the thickness of the multilayer substrate. Therefore, the dimension of the nonreciprocal circuit element in the thickness direction can be reduced, and the miniaturization of the nonreciprocal circuit element can be further promoted.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の実施例によるサーキュレータの構成を
示す分解斜視図である。
FIG. 1 is an exploded perspective view showing a configuration of a circulator according to an embodiment of the present invention.

【図2】図1に示すサーキュレータの構造を示す断面図
である。
FIG. 2 is a cross-sectional view showing the structure of the circulator shown in FIG.

【図3】第1実施例のサーキュレータの多層基板の構成
を示す分解斜視図である。
FIG. 3 is an exploded perspective view showing a configuration of a multilayer substrate of the circulator of the first embodiment.

【図4】図3に示す多層基板の構成を説明するための説
明図である。
FIG. 4 is an explanatory diagram for explaining the configuration of the multilayer substrate shown in FIG.

【図5】本発明の第2実施例によるサーキュレータの構
成を示す分解斜視図である。
FIG. 5 is an exploded perspective view showing a structure of a circulator according to a second embodiment of the present invention.

【図6】第2実施例のサーキュレータの構造を示す断面
図である。
FIG. 6 is a sectional view showing a structure of a circulator of a second embodiment.

【図7】本発明の変形例のサーキュレータの要部を説明
するための斜視図である。
FIG. 7 is a perspective view for explaining a main part of a circulator of a modified example of the invention.

【図8】従来のサーキュレータの積層基板の構成を示す
分解斜視図である。
FIG. 8 is an exploded perspective view showing a configuration of a laminated substrate of a conventional circulator.

【図9】従来のサーキュレータの構造を示す断面図であ
る。
FIG. 9 is a sectional view showing a structure of a conventional circulator.

【符号の説明】[Explanation of symbols]

1,50…サーキュレータ(非可逆回路素子) 2,53…多層基板 4…フェライト 5…永久磁石 12〜16…誘電体シート 16a…中心電極 15a〜15c,16b…容量電極(整合回路用電極) 25,55…第1保持部 26,56…第2保持部 61…誘電体シート 62a〜67a…第1中心電極部 62b〜67b…第2中心電極部 74…スルーホール導電部 1, 50 ... Circulator (non-reciprocal circuit element) 2, 53 ... Multilayer substrate 4 ... Ferrite 5 ... Permanent magnet 12-16 ... Dielectric sheet 16a ... Center electrode 15a-15c, 16b ... Capacitance electrode (matching circuit electrode) 25 , 55 ... 1st holding part 26, 56 ... 2nd holding part 61 ... Dielectric sheet 62a-67a ... 1st center electrode part 62b-67b ... 2nd center electrode part 74 ... Through-hole conductive part

───────────────────────────────────────────────────── フロントページの続き (72)発明者 児堂 義一 京都府長岡京市天神二丁目26番10号 株式 会社村田製作所内 (72)発明者 松井 博志 京都府長岡京市天神二丁目26番10号 株式 会社村田製作所内 (72)発明者 小川 圭二 京都府長岡京市天神二丁目26番10号 株式 会社村田製作所内 ─────────────────────────────────────────────────── ─── Continuation of the front page (72) Inventor Yoshikazu Kodo 2-26-10 Tenjin, Nagaokakyo, Kyoto Prefecture Murata Manufacturing Co., Ltd. (72) Hiroshi Matsui 2-26-10 Tenjin, Nagaokakyo, Kyoto Stock Murata Manufacturing Co., Ltd. (72) Inventor Keiji Ogawa 2-10-10 Tenjin, Tenjin, Nagaokakyo, Kyoto Prefecture Murata Manufacturing Co., Ltd.

Claims (18)

【特許請求の範囲】[Claims] 【請求項1】 複数の誘電体層を積層した多層基板と、 前記多層基板中に形成され、かつ互いに電気的に絶縁さ
れており、さらに交差するように形成された複数の中心
電極と、 前記多層基板中に積層され、かつ前記中心電極毎に接続
される複数の容量部を有する整合用容量と、 前記中心電極に対向して設けられた磁性体と、 前記磁性体に直流磁界を印加するための磁石と、を備え
た、非可逆回路素子。
1. A multi-layer substrate in which a plurality of dielectric layers are laminated, a plurality of center electrodes formed in the multi-layer substrate, electrically insulated from each other, and further intersecting each other, A matching capacitor having a plurality of capacitor parts stacked in a multilayer substrate and connected to each of the center electrodes, a magnetic body provided so as to face the center electrode, and a DC magnetic field is applied to the magnetic body. And a magnet for the non-reciprocal circuit device.
【請求項2】 前記整合用容量は、前記多層基板の厚み
方向において前記中心電極と重ならない位置に形成され
ている、請求項1に記載の非可逆回路素子。
2. The nonreciprocal circuit device according to claim 1, wherein the matching capacitor is formed at a position that does not overlap the center electrode in the thickness direction of the multilayer substrate.
【請求項3】 前記整合用容量の容量部は、前記誘電体
層と前記誘電体層の上下主表面に互いに対向して形成さ
れた一対の容量用電極とから構成され、 一つの前記中心電極に接続された複数の前記容量部は、
互いに並列に接続されている、請求項2に記載の非可逆
回路素子。
3. The matching capacitance portion is composed of the dielectric layer and a pair of capacitance electrodes formed on the upper and lower main surfaces of the dielectric layer so as to face each other. The plurality of capacitance units connected to
The nonreciprocal circuit device according to claim 2, which are connected in parallel with each other.
【請求項4】 前記整合用容量は、前記中心電極が形成
された前記誘電体層の前記中心電極と異なる位置に構成
された前記容量部を有する、請求項3に記載の非可逆回
路素子。
4. The nonreciprocal circuit device according to claim 3, wherein the matching capacitance has the capacitance portion configured at a position different from the center electrode of the dielectric layer on which the center electrode is formed.
【請求項5】 前記整合用容量は、前記多層基板中の前
記中心電極が形成された前記誘電体層と異なる前記誘電
体層に構成された前記容量部を有する、請求項4に記載
の非可逆回路素子。
5. The non-matching capacitor according to claim 4, wherein the matching capacitor has the capacitor portion configured in the dielectric layer different from the dielectric layer in which the center electrode is formed in the multilayer substrate. Reversible circuit element.
【請求項6】 前記整合用容量は、前記中心電極が形成
された前記誘電体層より、積層方向の上方及び/または
下方に位置する前記誘電体層に構成された前記容量部を
有する、請求項5に記載の非可逆回路素子。
6. The matching capacitance has the capacitance portion formed in the dielectric layer located above and / or below the dielectric layer in which the center electrode is formed in the stacking direction. Item 5. The nonreciprocal circuit device according to item 5.
【請求項7】 前記多層基板は、積層された前記複数の
誘電体層を一体焼成して形成されている、請求項3に記
載の非可逆回路素子。
7. The nonreciprocal circuit device according to claim 3, wherein the multilayer substrate is formed by integrally firing the plurality of stacked dielectric layers.
【請求項8】 前記多層基板は、前記磁性体を前記中心
電極に対向する位置に保持するための第1保持部を有
し、 前記磁性体が、前記第1保持部に保持される、請求項7
に記載の非可逆回路素子。
8. The multi-layer substrate has a first holding part for holding the magnetic body at a position facing the center electrode, and the magnetic body is held by the first holding part. Item 7
The nonreciprocal circuit device described in 1.
【請求項9】 前記第1保持部が前記多層基板に形成さ
れた凹部である、請求項8に記載の非可逆回路素子。
9. The nonreciprocal circuit device according to claim 8, wherein the first holding unit is a recess formed in the multilayer substrate.
【請求項10】 前記多層基板は、さらに、前記磁石を
前記中心電極に対向する位置に保持するための第2保持
部を有し、 前記磁石は、前記第2保持部に保持される、請求項8に
記載の非可逆回路素子。
10. The multilayer substrate further has a second holding portion for holding the magnet at a position facing the center electrode, and the magnet is held by the second holding portion. Item 9. The nonreciprocal circuit device according to item 8.
【請求項11】 前記第2保持部が、前記多層基板に形
成された凹部である、請求項10に記載の非可逆回路素
子。
11. The nonreciprocal circuit device according to claim 10, wherein the second holding portion is a recess formed in the multilayer substrate.
【請求項12】 前記多層基板は、前記磁性体を前記中
心電極に対向する位置に保持するための第1保持部を有
し、 前記磁性体は前記第1保持部に保持される、請求項1に
記載の非可逆回路素子。
12. The multi-layer substrate has a first holding part for holding the magnetic body at a position facing the center electrode, and the magnetic body is held by the first holding part. The nonreciprocal circuit device according to 1.
【請求項13】 前記多層基板は、さらに前記磁石を前
記中心電極に対向する位置に保持するための第2保持部
を有し、 前記磁石は前記第2保持部に保持される、請求項10に
記載の非可逆回路素子。
13. The multilayer substrate further has a second holding portion for holding the magnet at a position facing the center electrode, and the magnet is held by the second holding portion. The nonreciprocal circuit device described in 1.
【請求項14】 前記第1及び前記第2保持部は、前記
多層基板の互いに対向する主表面の少なくとも何れか一
方に形成されている、請求項11に記載の非可逆回路素
子。
14. The nonreciprocal circuit device according to claim 11, wherein the first and second holding portions are formed on at least one of main surfaces of the multilayer substrate which face each other.
【請求項15】 前記第1及び前記第2保持部は、前記
多層基板の前記主表面の両方に形成されている、請求項
12に記載の非可逆回路素子。
15. The nonreciprocal circuit device according to claim 12, wherein the first and second holding portions are formed on both of the main surfaces of the multilayer substrate.
【請求項16】 前記多層基板は、前記複数の誘電体層
を一体焼成して形成されている、請求項1に記載の非可
逆回路素子。
16. The nonreciprocal circuit device according to claim 1, wherein the multilayer substrate is formed by integrally firing the plurality of dielectric layers.
【請求項17】 前記複数の中心電極が、多層基板内に
おいて異なる高さ位置に形成されている、請求項1に記
載の非可逆回路素子。
17. The nonreciprocal circuit device according to claim 1, wherein the plurality of center electrodes are formed at different height positions in the multilayer substrate.
【請求項18】 前記中心電極が、一つの誘電体層の一
面に配置された第1中心電極部と、他面に配置された第
2中心電極部と、前記一つの誘電体層に形成されてお
り、かつ第1,第2中心電極部を電気的に接続するスル
ーホール導電部とを有する、請求項1に記載の非可逆回
路素子。
18. The center electrode is formed on one dielectric layer, a first center electrode portion disposed on one surface of the dielectric layer, a second center electrode portion disposed on the other surface, and the center electrode formed on the one dielectric layer. The nonreciprocal circuit device according to claim 1, further comprising a through-hole conductive portion that electrically connects the first and second center electrode portions.
JP14494694A 1993-06-30 1994-06-27 Non-reciprocal circuit device Expired - Fee Related JP3467840B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP14494694A JP3467840B2 (en) 1993-06-30 1994-06-27 Non-reciprocal circuit device

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP5-161736 1993-06-30
JP16173693 1993-06-30
JP14494694A JP3467840B2 (en) 1993-06-30 1994-06-27 Non-reciprocal circuit device

Publications (2)

Publication Number Publication Date
JPH0774516A true JPH0774516A (en) 1995-03-17
JP3467840B2 JP3467840B2 (en) 2003-11-17

Family

ID=26476216

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14494694A Expired - Fee Related JP3467840B2 (en) 1993-06-30 1994-06-27 Non-reciprocal circuit device

Country Status (1)

Country Link
JP (1) JP3467840B2 (en)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100311810B1 (en) * 1998-12-15 2001-11-15 이형도 Layer type lower case of isolator
JP2001345604A (en) * 2000-03-27 2001-12-14 Hitachi Metals Ltd Nonreversible circuit element and radio communications equipment using the same
JP2015050689A (en) * 2013-09-03 2015-03-16 Tdk株式会社 Non-reciprocal circuit element and communication device using the same
CN114865256A (en) * 2022-07-11 2022-08-05 西南应用磁学研究所(中国电子科技集团公司第九研究所) Ultra-wideband lumped parameter circulator/isolator with multi-layer dielectric strip line structure

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100311810B1 (en) * 1998-12-15 2001-11-15 이형도 Layer type lower case of isolator
JP2001345604A (en) * 2000-03-27 2001-12-14 Hitachi Metals Ltd Nonreversible circuit element and radio communications equipment using the same
JP2015050689A (en) * 2013-09-03 2015-03-16 Tdk株式会社 Non-reciprocal circuit element and communication device using the same
CN114865256A (en) * 2022-07-11 2022-08-05 西南应用磁学研究所(中国电子科技集团公司第九研究所) Ultra-wideband lumped parameter circulator/isolator with multi-layer dielectric strip line structure
CN114865256B (en) * 2022-07-11 2022-11-01 西南应用磁学研究所(中国电子科技集团公司第九研究所) Ultra-wideband lumped parameter circulator/isolator with multi-layer dielectric strip line structure

Also Published As

Publication number Publication date
JP3467840B2 (en) 2003-11-17

Similar Documents

Publication Publication Date Title
KR19980046940A (en) Irreversible circuit elements
JP3147615B2 (en) Non-reciprocal circuit element for high frequency
JP3467840B2 (en) Non-reciprocal circuit device
KR0174636B1 (en) Non-reciprocal circuit element
US5774024A (en) Microwave non-reciprocal circuit element
KR100335877B1 (en) Nonreciprocal Circuit Device and Method of Fabricating the same
US5786736A (en) Non-reciprocal circuit element
EP1309031B1 (en) Nonreciprocal circuit device and communication apparatus
JP3196491B2 (en) Non-reciprocal circuit device
KR100310729B1 (en) Microwave non-reciprocal circuit element
JP3211841B2 (en) Non-reciprocal circuit device and method of manufacturing the same
CN108010722A (en) Composite electronic component
JPH10270911A (en) Irreversible circuit element and its mounting structure
JPH06291514A (en) Irreversible circuit element for microwave
JPH05304404A (en) Nonreversible circuit element
JP3178153B2 (en) Non-reciprocal circuit element for microwave
JP3365057B2 (en) Non-reciprocal circuit device
JP3265831B2 (en) Non-reciprocal circuit device and manufacturing method thereof
JPH07122910A (en) Irreversible circuit element
JPH08307111A (en) Irreversible circuit element
JPH09294006A (en) Irreversible circuit element and irreversible circuit device
JPH08102603A (en) Non-reciprocal circuit element
JPH1127006A (en) Dielectric filter
JPH07111406A (en) Microwave irreversible circuit element and its manufacture
JPH07273506A (en) Non-reciprocal circuit element

Legal Events

Date Code Title Description
FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080905

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080905

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090905

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090905

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100905

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100905

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110905

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120905

Year of fee payment: 9

LAPS Cancellation because of no payment of annual fees