JPH077382A - スイッチングレギュレータ集積回路の内部周波数補償のための容量乗算回路 - Google Patents
スイッチングレギュレータ集積回路の内部周波数補償のための容量乗算回路Info
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- JPH077382A JPH077382A JP6012344A JP1234494A JPH077382A JP H077382 A JPH077382 A JP H077382A JP 6012344 A JP6012344 A JP 6012344A JP 1234494 A JP1234494 A JP 1234494A JP H077382 A JPH077382 A JP H077382A
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Abstract
ープ補償モノリシック回路が提供される。オペアンプ22
は従来の小さな周波数補償用コンデンサ34を有し、これ
がその単一利得周波数と入力抵抗を規定する。このオペ
アンプは100%の負帰還を取り入れている。単一利得周
波数未満の周波数で駆動されると、オペアンプの非反転
入力はナノファラドのオーダの値を有する静電容量2
0′を示すが、この値は通常は、実際のコンデンサ素子
として製造された場合には過剰なチップ面積を必要とす
る。 【効果】 オペアンプにより示される静電容量値は、ス
イッチング周波数が約150kHzで動作されるスイッチング
レギュレータのオンチップループ補償に有用である。
Description
タに関し、より詳しくはスイッチングレギュレータのル
ープ周波数補償に必要な静電容量を集積回路チップ上に
取り入れることに関する。
ュレータは、その高性能、融通性及び経済性の故に広く
用いられている。そのような電圧レギュレータの典型的
なものとして、LM1577という製品がある。このレギュレ
ータは、5ボルトの入力で動作し、また約52kHzでスイ
ッチングするように設計されている。またこれは、ユー
ザが出力電圧を制御することを可能にする調整能力を備
えている。図1は、800mAまでで12ボルトの出力を生成
する、LM1577の適用例を示している。この回路は、負荷
インピーダンス及び入力電圧の変動とは無関係に、12ボ
ルトの出力を維持するように機能する。
77を表している。この矩形の内側にある番号は、5ピン
のTO-220 ICパッケージのピン番号を表している。端
子11(ピン5)には+5ボルトの入力が印加され、端子
12(ピン3)は大地帰路となっている。比較的低い値
(0.1μf)のコンデンサ13が入力電力ラインに接続され
ており、入力の減結合をもたらしている。典型的には約
100μHの値を有するインダクタ14が、ICピン5と4の
間に結合されている。インダクタ14と、調整された出力
電圧が現れる出力端子との間には、ショットキー電力ダ
イオード15が結合されている。値の大きなフィルタコン
デンサ(数百μf)19が、出力端子16と接地の間に結合
されている。抵抗17及び18は、端子16における調整出力
の両端の分圧器として機能し、ICピン2に印加される
帰還を生成している。抵抗21とコンデンサ20がICピン
1と接地との間に結合され、レギュレータに周波数補償
をもたらしている。
4を接地へと周期的にスイッチングするスイッチを含ん
でいる。このスイッチが閉じた場合には、インダクタ14
を流れる電流は一定比で増大する。このスイッチが開く
と、スイッチング電流はゼロに降下し、インダクタは端
子11の電位に付加される極性でもって、誘導性キックバ
ックを発生する。整流素子であるダイオード15は、この
誘導性キックバックを通過させて、端子5の電位よりも
高い電位へとコンデンサ19を充電する。コンデンサ19に
蓄電される電圧は、ピン4における平均電圧の関数とな
る。従って、コンデンサ19上の電荷は、レギュレータの
デューティサイクルの関数となる。コンデンサ19の両端
の電圧が、ピン2において約1.3ボルトを生成する値を
越えた場合には、レギュレータのスイッチングパルス幅
は減少される。抵抗18が2kΩで抵抗17が17.4kΩの場
合、端子16において12ボルトの出力が維持される。この
ように、ピン2に対する帰還がスイッチングパルス幅を
制御し、それによって、入力電圧又はレギュレータに接
続された負荷が変動した場合であっても、出力電圧が調
整されることになる。
の構成素子としては比較的大きなものである。これは典
型的にはナノファラドのオーダの値を有し、従ってオフ
チップの構成要素としなければならない。しかしなが
ら、このレギュレータのループ補償素子をICチップ内
に完全に取り込むことが望ましい。
タICの周波数補償構成要素を、ICチップ上に取り込
むことである。
ンデンサを生成することであり、そこにおいて容量乗算
器が、スイッチングレギュレータの周波数補償構成要素
として役立つことのできる大きな実効静電容量を生成す
るものを提供することである。
さな内部補償コンデンサを有する容量乗算演算増幅器
(オペアンプ)を用い、また非反転入力と反転入力の間
に低い値の抵抗を接続してこの増幅器を単一利得電圧フ
ォロワとして動作させて、この増幅器の小さな帰還コン
デンサの倍数を入力コンデンサに等価なものとすること
である。
課題は、以下のようにして解決される。スイッチングレ
ギュレータは例えば約150kHzと比較的高いスイッチング
周波数で動作させ、比較的大きな補償コンデンサを必要
とするエラー増幅器を取り入れる。小さな内部補償コン
デンサを有するオペアンプの出力をその反転入力に接続
し、反転及び非反転入力端子の間には第1の抵抗を接続
する。この容量乗算オペアンプの非反転入力は、第2の
抵抗によってレギュレータのエラー増幅器の出力に結合
し、ある抵抗値と、等価な容量周波数補償をそれに付加
する。容量乗算オペアンプの非反転入力は、第1の抵抗
の値にそのオペアンプの単一利得周波数を掛けたものに
反比例する、等価な静電容量を示す。このことはオンチ
ップ構成要素としての実質的な静電容量を生成し、第2
の抵抗は直列抵抗ループ補償構成要素をもたらす。直列
になったこの等価コンデンサと第2の抵抗は、相互コン
ダクタンス型式のエラー増幅器の出力上で、スイッチン
グレギュレータ全体の周波数補償素子を表すことにな
る。
ペアンプ22の出力はその反転入力に戻して結合され、抵
抗23が反転及び非反転入力の間に接続されている。この
ような回路が端子24において、開ループ利得の傾斜が−
20dB/ディケードの周波数で動作する信号により駆動さ
れると、このオペアンプはその非反転入力において等価
なコンデンサ20′を示すことになる。このコンデンサ2
0′は点線の輪郭で示しているが、これはこのコンデン
サが実効静電容量であり、実際の素子ではないからであ
る。コンデンサ20′は、C20'=0.159/(R23×FO)の値
を有し、式中FOはオペアンプの単一利得周波数である。
かくして、図2の回路は数百ナノファラドのオーダの値
を有するコンデンサを容易にシミュレートすることがで
きる。他の場合にはこのような値は、オンチップコンデ
ンサとして製造された場合には過度のチップ面積を占め
る。
レータのエラー増幅器26に対するループ補償の一部とし
てどのように適用されるかを示す回路を示している。回
路素子が図2の素子と同じ場合には、同じ番号を用いて
いる。
ンス増幅器を表しており、これは図1の10で示す素子の
如きスイッチングレギュレータの一部である。この増幅
器は、ピン2に対する帰還を内部基準と比較し、スイッ
チングのデューティサイクルを制御する回路を駆動する
回路素子である。このエラー増幅器26は端子27において
出力を有するが、これは別個の抵抗及びコンデンサ、或
いはIC抵抗と比較的大きな等価コンデンサとを用いる
本発明の何れかによって周波数補償が可能なものである
ことが理解されよう。上述したように、コンデンサ20′
が端子24に示されている。これにより、図1のナノファ
ラドのオーダのコンデンサ20が生成される。次いで抵抗
21により、エラー増幅器26の出力におけるループ補償回
路が完成される。本発明の回路は面積の小さなIC素子
を用いて実現可能であるから、図3の回路は完全にオン
チップの構造として形成することができる。これによ
り、オフチップの補償用素子を用いる必要性は排除され
る。
してICチップに具現化されるかを示す概略図である。
この回路は、本発明の好ましい実施例を構成する。この
回路の中心は、オペアンプ22の非反転入力及び反転入力
のそれぞれを形成する、一対のPNPトランジスタ29及
び30である。
差動入力段についての在来のカレントミラー負荷の入力
及び出力トランジスタを形成している。この入力段の単
一終端出力はトランジスタ32のコレクタに現れ、これは
エミッタ接地トランジスタ増幅器33のベースに直接に接
続されている。トランジスタ35はエミッタフォロワ分離
バッファとして動作し、トランジスタ33のコレクタをエ
ミッタフォロワ出力トランジスタ36のベースに結合して
いる。この分離により、トランジスタ33における非常に
高い電圧利得が確保される。オペアンプ自体の小さな周
波数補償コンデンサ34は、トランジスタ33のベースとコ
レクタの間に接続されている。このコンデンサがオペア
ンプに必要なのは、増幅器の単一利得の安定化を確保す
るためである。その典型的な値は約20pfである。
スタ36のエミッタ負荷として機能する。これらの抵抗は
分圧器を形成し、ノード39がオペアンプ22の出力を形成
する。このノードは反転入力へと直接に接続されてお
り、図2及び図3の回路図に示した如き100%の負帰還
が存在するようにされる。
ている。そのエミッタは抵抗41によって+VCCレールに
戻されている。トランジスタ40のベースは、所望とする
電流出力を生成する電位において動作される、VBIAS端
子に戻されている。トランジスタ40は4コレクタのデバ
イスとして示されているが、これは典型的には4つの等
価な4分円コレクタを有するラテラルPNPトランジス
タである。典型的には、VBIASの値は、コレクタ毎に1
μアンペアを生ずるように選ばれる。かくしてトランジ
スタ35は2μアンペアを受け取り、トランジスタ33は1
μアンペアを受け取り、差動入力段は1μアンペアのテ
ール電流で動作する。
合分離モノリシック集積回路の構成要素の形で構成し
た。以下の値を用いた。
ノード27は0.8ボルトであった。VBIASはトランジスタ40
のコレクタの各々において1μアンペアにセットした。
このオペアンプは100kHzの単一利得周波数を有してい
た。1kHzで駆動すると、ノード24は約5.3nfの等価な分
路コンデンサ20′を示した。これは抵抗19と相俟って、
ICスイッチングレギュレータについての有効なループ
周波数補償をもたらすことができる。回路全体は、2.5
ボルトの電源電圧において、0.1μワットよりも低い消
費電力であった。
実施例の詳細を述べた。当業者が以上の記載を読めば、
本発明の思想及び意図の範囲内にある代替物及び均等物
が自明となるところである。従って、本発明の範囲は特
許請求の範囲によってのみ限定されるものである。
ペアンプを用いることによって仮想補償コンデンサが生
成され、これをスイッチングレギュレータのオンチップ
周波数補償構成要素として用いることができる。
略的な回路図である。
器とどのように関わるかを示すブロック図である。
Claims (4)
- 【請求項1】 ループ周波数補償機能に有用な比較的大
きなオンチップ静電容量をもたらすべく集積回路チップ
上で用いる容量乗算回路であって、 反転及び非反転入力と、単一終端出力と、単一利得周波
数とを有するオペアンプと、 前記反転及び非反転入力の間に接続された第1の抵抗
と、 前記オペアンプの出力をその反転入力に結合する手段
と、及び前記オペアンプの非反転入力をオペアンプの単
一利得周波数未満の周波数で駆動する手段とからなり、
前記非反転入力において比較的大きな等価分路静電容量
をもたらす回路。 - 【請求項2】 前記オペアンプがさらに、前記オペアン
プの単一利得周波数を決定する小さな内部周波数補償コ
ンデンサを含む、請求項1の容量乗算回路。 - 【請求項3】 前記等価分路静電容量が、前記第1の抵
抗の値に前記単一利得周波数を乗算したものの逆数に比
例する、請求項2の容量乗算回路。 - 【請求項4】 第2の抵抗が前記オペアンプの非反転入
力に結合し、前記オンチップループ周波数補償機能が完
成される、請求項2の容量乗算回路。
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