JPH0764665A - 表示制御装置 - Google Patents
表示制御装置Info
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- JPH0764665A JPH0764665A JP5214174A JP21417493A JPH0764665A JP H0764665 A JPH0764665 A JP H0764665A JP 5214174 A JP5214174 A JP 5214174A JP 21417493 A JP21417493 A JP 21417493A JP H0764665 A JPH0764665 A JP H0764665A
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Abstract
(57)【要約】 （修正有）
【目的】 消費電力を低減できる表示制御装置を得る。
【構成】 表示用メモリ８に対し、所定時間内に各種情
報データの書き込みが行われず、記憶内容が変更されな
い場合には、表示タイミングを遅くする。例えば、検出
部８内部のフラグが設定されないことにより、マルチプ
レクサ１０が１／２周波数のクロック信号を選択し、Ｌ
ＣＤ１への表示タイミングを遅くする。 【効果】 装置の発熱を抑え、バッテリー等の寿命を延
ばし、装置の小型化が得られる。
報データの書き込みが行われず、記憶内容が変更されな
い場合には、表示タイミングを遅くする。例えば、検出
部８内部のフラグが設定されないことにより、マルチプ
レクサ１０が１／２周波数のクロック信号を選択し、Ｌ
ＣＤ１への表示タイミングを遅くする。 【効果】 装置の発熱を抑え、バッテリー等の寿命を延
ばし、装置の小型化が得られる。
Description
【０００１】
【産業上の利用分野】この発明は、電子機器の液晶ディ
スプレイ等の表示機器を制御する表示制御装置に関する
ものである。
スプレイ等の表示機器を制御する表示制御装置に関する
ものである。
【０００２】
【従来の技術】図５は従来の表示制御装置の要部ブロッ
ク図であり、図において、１は液晶ディスプレイ（以
下、ＬＣＤという）本体、２はＬＣＤ制御用ドライバ、
３はＬＣＤ表示用の制御信号を生成する表示制御部であ
り、クロック信号（ＣＬＫ）が入力される。４はＬＣＤ
１に表示する文字，図形等の各種情報データを一時記憶
するための表示用メモリであり、シングルポートＲＡＭ
より成る。５はＬＣＤ１での表示内容を生成するための
プログラムを実行するＣＰＵ、６はそのプログラムを格
納するＲＯＭ、７は上記プログラムで使用されるＲＡＭ
である。
ク図であり、図において、１は液晶ディスプレイ（以
下、ＬＣＤという）本体、２はＬＣＤ制御用ドライバ、
３はＬＣＤ表示用の制御信号を生成する表示制御部であ
り、クロック信号（ＣＬＫ）が入力される。４はＬＣＤ
１に表示する文字，図形等の各種情報データを一時記憶
するための表示用メモリであり、シングルポートＲＡＭ
より成る。５はＬＣＤ１での表示内容を生成するための
プログラムを実行するＣＰＵ、６はそのプログラムを格
納するＲＯＭ、７は上記プログラムで使用されるＲＡＭ
である。
【０００３】次に、動作について説明する。ＣＰＵ５は
ＲＯＭ６のプログラムをＲＡＭ７を使用して実行する。
これにより、ＬＣＤ１の画面上に表示する文字，図形等
の各種情報データが生成され、表示用メモリ４に一時記
憶される。表示制御部３はＬＣＤ１の表示タイミングに
同期させて表示用メモリ４の内容を読み出し、ドライバ
２に出力する。ＬＣＤ１は表示制御部３の出力する表示
用データとＬＣＤ１の表示タイミングに同期したドライ
バ２のための制御信号により表示を行う。
ＲＯＭ６のプログラムをＲＡＭ７を使用して実行する。
これにより、ＬＣＤ１の画面上に表示する文字，図形等
の各種情報データが生成され、表示用メモリ４に一時記
憶される。表示制御部３はＬＣＤ１の表示タイミングに
同期させて表示用メモリ４の内容を読み出し、ドライバ
２に出力する。ＬＣＤ１は表示制御部３の出力する表示
用データとＬＣＤ１の表示タイミングに同期したドライ
バ２のための制御信号により表示を行う。
【０００４】
【発明が解決しようとする課題】従来の表示制御装置
は、以上のように構成されており、表示に際しては表示
される各種情報データが表示タイミングの１フレーム間
の更新の有無に拘らず、表示用メモリ４が表示制御部３
によってアクセスされるため、更新されていない場合で
もアクセスされ、余分な電力を消費してしまうという問
題点があった。
は、以上のように構成されており、表示に際しては表示
される各種情報データが表示タイミングの１フレーム間
の更新の有無に拘らず、表示用メモリ４が表示制御部３
によってアクセスされるため、更新されていない場合で
もアクセスされ、余分な電力を消費してしまうという問
題点があった。
【０００５】この発明は、上記のような問題点を解消す
るためのなされたもので、消費電力を低減できる表示制
御装置を得ることを目的とする。
るためのなされたもので、消費電力を低減できる表示制
御装置を得ることを目的とする。
【０００６】
【課題を解決するための手段】この発明にかかる表示制
御装置は、各種情報を表示する表示画面部と、この表示
画面部に表示される各種情報が記憶されるメモリ部と、
このメモリ部内の各種情報を読み出し、表示画面上に表
示する表示制御部と、メモリ部への各種情報の記憶の有
無を検出する検出部とを備え、この検出部によりメモリ
部に所定時間、各種情報の記憶の無いことが検出された
場合、表示制御部による表示画面部への表示タイミング
を遅くするものである。
御装置は、各種情報を表示する表示画面部と、この表示
画面部に表示される各種情報が記憶されるメモリ部と、
このメモリ部内の各種情報を読み出し、表示画面上に表
示する表示制御部と、メモリ部への各種情報の記憶の有
無を検出する検出部とを備え、この検出部によりメモリ
部に所定時間、各種情報の記憶の無いことが検出された
場合、表示制御部による表示画面部への表示タイミング
を遅くするものである。
【０００７】また、各種情報を表示する表示画面部と、
この表示画面部を制御する表示制御部と、電流を供給す
る電源部と、この電源部の電圧容量を監視する電圧監視
部とを備え、この電圧監視部により電源部が所定の電圧
容量より低下したことが検出された場合、表示制御部に
よる表示画面部への表示タイミングを遅くするものであ
る。
この表示画面部を制御する表示制御部と、電流を供給す
る電源部と、この電源部の電圧容量を監視する電圧監視
部とを備え、この電圧監視部により電源部が所定の電圧
容量より低下したことが検出された場合、表示制御部に
よる表示画面部への表示タイミングを遅くするものであ
る。
【０００８】さらに、各種情報を表示する表示画面部
と、この表示画面部を制御する表示制御部と、外部より
各種表示命令が入力される外部入力部と、この外部入力
部に所定時間各種表示命令が入力されないスリープ状態
を検出する検出部とを備え、この検出部によりスリープ
状態が検出された場合、表示制御部による表示画面への
表示タイミングを遅くするものである。
と、この表示画面部を制御する表示制御部と、外部より
各種表示命令が入力される外部入力部と、この外部入力
部に所定時間各種表示命令が入力されないスリープ状態
を検出する検出部とを備え、この検出部によりスリープ
状態が検出された場合、表示制御部による表示画面への
表示タイミングを遅くするものである。
【０００９】
【作用】この発明における表示制御装置は、メモリ部に
所定時間、各種情報が書き込まれない場合、表示画面部
への表示タイミングを遅くすることにより、各部の動作
周波数が遅くなり、消費電力が低減される。
所定時間、各種情報が書き込まれない場合、表示画面部
への表示タイミングを遅くすることにより、各部の動作
周波数が遅くなり、消費電力が低減される。
【００１０】また、電圧監視部により電源部が所定の電
圧容量より低下したことが検出された場合、表示画面部
への表示タイミングを遅くすることにより、各部の動作
周波数が遅くなり消費電力が低減される。
圧容量より低下したことが検出された場合、表示画面部
への表示タイミングを遅くすることにより、各部の動作
周波数が遅くなり消費電力が低減される。
【００１１】さらに、検出部によりスリープ状態が検出
された場合、表示画面部への表示タイミングを遅くする
ことにより、各部の動作周波数が遅くなり、消費電力が
低減される。
された場合、表示画面部への表示タイミングを遅くする
ことにより、各部の動作周波数が遅くなり、消費電力が
低減される。
【００１２】
【実施例】 実施例１．図１はこの発明の一実施例を示す表示制御装
置の要部ブロック図、図２は表示制御部装置の一動作タ
イミングを示す図である。図において、従来例と同一ま
たは相当部分には同一符号を付し、説明を省略する。８
はＬＣＤ１に表示する各種情報データを保持するための
表示用メモリで、デュアル・ポートＲＡＭより成る。９
はＬＣＤ１の表示タイミングの１フレーム内に、ＣＰＵ
５から表示用メモリ８にデータの書き込みが行われたか
どうかを検出する検出部、１０はこの検出部９の制御信
号（ＣＬＫＣＥＬ）により、表示制御部３で使用するク
ロック信号（ＣＬＫ）に通常のクロック信号と１／２の
周波数のクロック信号（１／２ＣＬＫ）のいずれかを選
択するマルチプレクサである。なお、ＬＣＤ１は表示画
面部、表示用メモリ８はメモリ部を示す。
置の要部ブロック図、図２は表示制御部装置の一動作タ
イミングを示す図である。図において、従来例と同一ま
たは相当部分には同一符号を付し、説明を省略する。８
はＬＣＤ１に表示する各種情報データを保持するための
表示用メモリで、デュアル・ポートＲＡＭより成る。９
はＬＣＤ１の表示タイミングの１フレーム内に、ＣＰＵ
５から表示用メモリ８にデータの書き込みが行われたか
どうかを検出する検出部、１０はこの検出部９の制御信
号（ＣＬＫＣＥＬ）により、表示制御部３で使用するク
ロック信号（ＣＬＫ）に通常のクロック信号と１／２の
周波数のクロック信号（１／２ＣＬＫ）のいずれかを選
択するマルチプレクサである。なお、ＬＣＤ１は表示画
面部、表示用メモリ８はメモリ部を示す。
【００１３】次に、動作について説明する。まず、ＣＰ
Ｕ５はＲＯＭ６のプログラムをＲＡＭ７を使用して実行
し、これにより、ＬＣＤ１画面上に表示する各種情報デ
ータが生成され、表示用メモリ８に一時記憶される。こ
こで、検出部９は表示用メモリ８に各種情報データが記
憶されることを検知した場合、内部のフラグが設定され
る。（図２のＡ点）。その後、このフラグはＨＳＹＮＣ
信号でクリアされる。（図２のＣ点）。このフラグ設定
によりマルチプレクサ１０では通常の動作周波数（クロ
ック信号）が選択され、表示制御部３はこの動作周波数
を使用して制御信号を生成し、表示用メモリ８の各種情
報データを読み出す。そこで、この各種情報データは制
御信号と共にドライバ２へ送られ、ＬＣＤ１により表示
される。
Ｕ５はＲＯＭ６のプログラムをＲＡＭ７を使用して実行
し、これにより、ＬＣＤ１画面上に表示する各種情報デ
ータが生成され、表示用メモリ８に一時記憶される。こ
こで、検出部９は表示用メモリ８に各種情報データが記
憶されることを検知した場合、内部のフラグが設定され
る。（図２のＡ点）。その後、このフラグはＨＳＹＮＣ
信号でクリアされる。（図２のＣ点）。このフラグ設定
によりマルチプレクサ１０では通常の動作周波数（クロ
ック信号）が選択され、表示制御部３はこの動作周波数
を使用して制御信号を生成し、表示用メモリ８の各種情
報データを読み出す。そこで、この各種情報データは制
御信号と共にドライバ２へ送られ、ＬＣＤ１により表示
される。
【００１４】次に、ＨＳＹＮＣ信号の一周期間、すなわ
ち、ＬＣＤ１の表示タイミングの１フレーム間（図２の
Ｂ点からＤ点まで）に表示用メモリ８に各種情報データ
が記憶されない場合は、検出部９の内部フラグはクリア
状態である。よって、次のフレーム（図３のＤ点）から
マルチプレクサ１０では、１／２周波数のクロック信号
が選択され、再びＣＰＵ５により表示用メモリ８に各種
情報データが記憶されるまで、この状態を維持する。こ
れにより、表示タイミングが遅くなり、消費電力が低減
される。その後、表示用メモリ８に各種情報データが書
き込まれ、フラグが設定された場合は、（図２のＦ点）
は次のフレーム（図２のＧ点）から通常のクロック信号
が選択され、通常の表示タイミング及び消費電力に戻
る。
ち、ＬＣＤ１の表示タイミングの１フレーム間（図２の
Ｂ点からＤ点まで）に表示用メモリ８に各種情報データ
が記憶されない場合は、検出部９の内部フラグはクリア
状態である。よって、次のフレーム（図３のＤ点）から
マルチプレクサ１０では、１／２周波数のクロック信号
が選択され、再びＣＰＵ５により表示用メモリ８に各種
情報データが記憶されるまで、この状態を維持する。こ
れにより、表示タイミングが遅くなり、消費電力が低減
される。その後、表示用メモリ８に各種情報データが書
き込まれ、フラグが設定された場合は、（図２のＦ点）
は次のフレーム（図２のＧ点）から通常のクロック信号
が選択され、通常の表示タイミング及び消費電力に戻
る。
【００１５】実施例２．図３はこの発明の他の実施例を
示す表示制御装置の要部ブロック図であり、図におい
て、従来例および実施例１と同一または相当部分には同
一符号を付し、説明を省略する。上記実施例１では、表
示用メモリ８はディアル・ポートＲＡＭであったが、本
実施例では、表示用メモリ４にシングル・ポートＲＡＭ
を使用している。また、表示制御部３は、上記実施例１
の機能に加えて、ＣＰＵ５からの読み書きを行えるよう
にデータバスの制御を行っており、表示制御部３が表示
用メモリ４の読み出しを行っている場合は、ＣＰＵ５の
表示用メモリ４への記憶は禁止されており、読み出しが
終了するまでＣＰＵ５を待機状態とし、読み出し終了後
にＣＰＵ５からの記憶を行う。
示す表示制御装置の要部ブロック図であり、図におい
て、従来例および実施例１と同一または相当部分には同
一符号を付し、説明を省略する。上記実施例１では、表
示用メモリ８はディアル・ポートＲＡＭであったが、本
実施例では、表示用メモリ４にシングル・ポートＲＡＭ
を使用している。また、表示制御部３は、上記実施例１
の機能に加えて、ＣＰＵ５からの読み書きを行えるよう
にデータバスの制御を行っており、表示制御部３が表示
用メモリ４の読み出しを行っている場合は、ＣＰＵ５の
表示用メモリ４への記憶は禁止されており、読み出しが
終了するまでＣＰＵ５を待機状態とし、読み出し終了後
にＣＰＵ５からの記憶を行う。
【００１６】次に、動作について説明する。表示制御部
３と表示用メモリ４以外の動作は、上記実施例１と同様
である。そこで、表示用メモリ４がシングル・ポートＲ
ＡＭであるために、同時にＣＰＵ５と表示制御部３から
アクセスすることはできない。そこで、同時にアクセス
する場合に、表示用制御部３が優先され、ＣＰＵ５は表
示制御部３の処理が終了するまで待機状態で、終了後に
表示用メモリ４をアクセスする。このため、ＣＰＵ５へ
の待機回数については減少するため、ＣＰＵ５の処理能
力を向上できる。
３と表示用メモリ４以外の動作は、上記実施例１と同様
である。そこで、表示用メモリ４がシングル・ポートＲ
ＡＭであるために、同時にＣＰＵ５と表示制御部３から
アクセスすることはできない。そこで、同時にアクセス
する場合に、表示用制御部３が優先され、ＣＰＵ５は表
示制御部３の処理が終了するまで待機状態で、終了後に
表示用メモリ４をアクセスする。このため、ＣＰＵ５へ
の待機回数については減少するため、ＣＰＵ５の処理能
力を向上できる。
【００１７】また、ＨＳＹＮＣ信号の一周期間に表示用
メモリ４に各種情報データが記憶されない場合は、検出
部９の内部フラグはクリア状態で、次のフレームから表
示制御部３による表示用メモリ４へのアクセス回数が１
／２になり、この状態は再びＣＰＵ５により表示用メモ
リ４にデータが書き込まれるまで維持され、各種情報デ
ータが記憶された場合は、次のフレームから通常アクセ
ス回数で表示用メモリ４をアクセスする。
メモリ４に各種情報データが記憶されない場合は、検出
部９の内部フラグはクリア状態で、次のフレームから表
示制御部３による表示用メモリ４へのアクセス回数が１
／２になり、この状態は再びＣＰＵ５により表示用メモ
リ４にデータが書き込まれるまで維持され、各種情報デ
ータが記憶された場合は、次のフレームから通常アクセ
ス回数で表示用メモリ４をアクセスする。
【００１８】実施例３．図４はこの発明の他の実施例を
示す表示制御装置のブロック図であり、図において、実
施例１並びに実施例２と同一または相当部分には同一符
号を付し、説明を省略する。１１はキーボード，マウス
等の外部入力装置から所定時間入力がない状態（スリー
プ状態）を検出するスリープ検出回路、１２は本装置の
電源として使用するバッテリー、１３はバッテリー１２
の電源を監視する電圧監視回路である。また、表示制御
部３の入力にスリープ回路１１，電圧監視回路１３から
の出力が追加されている。なお、電圧監視回路１３は電
圧監視部，スリープ検出回路１１は検出部を示し、表示
制御部３に外部入力部を有している。
示す表示制御装置のブロック図であり、図において、実
施例１並びに実施例２と同一または相当部分には同一符
号を付し、説明を省略する。１１はキーボード，マウス
等の外部入力装置から所定時間入力がない状態（スリー
プ状態）を検出するスリープ検出回路、１２は本装置の
電源として使用するバッテリー、１３はバッテリー１２
の電源を監視する電圧監視回路である。また、表示制御
部３の入力にスリープ回路１１，電圧監視回路１３から
の出力が追加されている。なお、電圧監視回路１３は電
圧監視部，スリープ検出回路１１は検出部を示し、表示
制御部３に外部入力部を有している。
【００１９】次に、動作について説明する。表示制御部
３の動作は検出部９以外に対しては上記実施例１と同様
である。そこで、バッテリー１２の電圧が降下した場合
に、電圧監視回路１３は電圧降下を示す信号をアクティ
ブにし、表示制御部３に入力する。これにより、表示制
御部３はＬＣＤ１の表示制御サイクルを１／２とし、消
費電力を低減させる。また、キーボード，マウス等の外
部入力端子から所定時間内に入力がない場合には、スリ
ープ検出回路１１が本装置の機能を停止状態にするため
に、表示制御部３へ所定の信号を出力し、表示制御部３
がこの信号を受信する。そこで、表示制御部３はスリー
プ期間であることを認知し、ＬＣＤ１の表示制御サイク
ルを１／２にし、消費電力の低減を行い、装置各部の発
熱を抑制する。
３の動作は検出部９以外に対しては上記実施例１と同様
である。そこで、バッテリー１２の電圧が降下した場合
に、電圧監視回路１３は電圧降下を示す信号をアクティ
ブにし、表示制御部３に入力する。これにより、表示制
御部３はＬＣＤ１の表示制御サイクルを１／２とし、消
費電力を低減させる。また、キーボード，マウス等の外
部入力端子から所定時間内に入力がない場合には、スリ
ープ検出回路１１が本装置の機能を停止状態にするため
に、表示制御部３へ所定の信号を出力し、表示制御部３
がこの信号を受信する。そこで、表示制御部３はスリー
プ期間であることを認知し、ＬＣＤ１の表示制御サイク
ルを１／２にし、消費電力の低減を行い、装置各部の発
熱を抑制する。
【００２０】
【発明の効果】以上のように、この発明によれば、メモ
リ部に所定時間、各種情報が書き込まれない場合、表示
画面部への表示タイミングを遅くすることにより、消費
電力が低減されるので、装置の発熱を抑え、バッテリー
等の寿命を上げるとともに、装置の小型化が得られると
いう効果がある。
リ部に所定時間、各種情報が書き込まれない場合、表示
画面部への表示タイミングを遅くすることにより、消費
電力が低減されるので、装置の発熱を抑え、バッテリー
等の寿命を上げるとともに、装置の小型化が得られると
いう効果がある。
【００２１】また、電圧監視部により電源部が所定の電
圧容量より低下したことが検出された場合、表示画面部
への表示タイミングを遅くすることにより、消費電力が
低減されるので、バッテリー容量低下時に装置の消費電
力を抑え、バッテリー寿命を延ばすことができるという
効果がある。
圧容量より低下したことが検出された場合、表示画面部
への表示タイミングを遅くすることにより、消費電力が
低減されるので、バッテリー容量低下時に装置の消費電
力を抑え、バッテリー寿命を延ばすことができるという
効果がある。
【００２２】さらに、検出部によりスリープ状態が検出
された場合、表示画面部への表示タイミングを遅くする
ことにより、消費電力が低減されるので、スリープ期間
中に無駄な電力消費と装置の発熱を抑えることができる
という効果がある。
された場合、表示画面部への表示タイミングを遅くする
ことにより、消費電力が低減されるので、スリープ期間
中に無駄な電力消費と装置の発熱を抑えることができる
という効果がある。
【図１】この発明の一実施例を示す表示制御装置の要部
ブロック図である。
ブロック図である。
【図２】この発明の一実施例を示す動作のタイミング図
である。
である。
【図３】この発明の他の実施例を示す表示制御装置の要
部ブロック図である。
部ブロック図である。
【図４】この発明の他の実施例を示す表示制御装置の要
部ブロック図である。
部ブロック図である。
【図５】従来の表示制御装置を示す要部ブロック図であ
る。
る。
１ 液晶ディスプレイ本体 ２ 液晶ディスプレイ制御用ドライバ ３ 表示制御部 ５ ＣＰＵ ６ ＲＯＭ ７ ＲＡＭ ８ 表示用メモリ ９ 検出部 １０ マルチプレクサ １１ スリープ検出回路 １３ 電圧監視回路
【手続補正書】
【提出日】平成５年１１月１７日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】請求項１
【補正方法】変更
【補正内容】
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】０００２
【補正方法】変更
【補正内容】
【０００２】
【従来の技術】図５は従来の表示制御装置の要部ブロッ
ク図であり、図において、１は液晶ディスプレイ（以
下、ＬＣＤという）本体、２はＬＣＤ制御用ドライバ、
３はＬＣＤ表示用の制御信号を生成する表示制御部であ
り、クロック信号（ＣＬＫ）が入力される。４はＬＣＤ
１に表示する文字，図形等の各種情報データを一時記憶
するための表示用メモリである。５はＬＣＤ１での表示
内容を生成するためのプログラムを実行するＣＰＵ、６
はそのプログラムを格納するＲＯＭ、７は上記プログラ
ムで使用されるＲＡＭである。
ク図であり、図において、１は液晶ディスプレイ（以
下、ＬＣＤという）本体、２はＬＣＤ制御用ドライバ、
３はＬＣＤ表示用の制御信号を生成する表示制御部であ
り、クロック信号（ＣＬＫ）が入力される。４はＬＣＤ
１に表示する文字，図形等の各種情報データを一時記憶
するための表示用メモリである。５はＬＣＤ１での表示
内容を生成するためのプログラムを実行するＣＰＵ、６
はそのプログラムを格納するＲＯＭ、７は上記プログラ
ムで使用されるＲＡＭである。
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】０００６
【補正方法】変更
【補正内容】
【０００６】
【課題を解決するための手段】この発明にかかる表示制
御装置は、各種情報を表示する表示画面部と、この表示
画面部に表示される各種情報が記憶されるメモリ部と、
このメモリ部内の各種情報を読み出し、表示画面上に表
示する表示制御部と、メモリ部への各種情報の記憶内容
の変更の有無を検出する検出部とを備え、この検出部に
よりメモリ部に所定時間内に、各種情報の記憶内容の変
更が無いことが検出された場合、表示制御部による表示
画面部への表示タイミングを遅くするものである。
御装置は、各種情報を表示する表示画面部と、この表示
画面部に表示される各種情報が記憶されるメモリ部と、
このメモリ部内の各種情報を読み出し、表示画面上に表
示する表示制御部と、メモリ部への各種情報の記憶内容
の変更の有無を検出する検出部とを備え、この検出部に
よりメモリ部に所定時間内に、各種情報の記憶内容の変
更が無いことが検出された場合、表示制御部による表示
画面部への表示タイミングを遅くするものである。
【手続補正４】
【補正対象書類名】明細書
【補正対象項目名】００１２
【補正方法】変更
【補正内容】
【００１２】
【実施例】 実施例１．図１はこの発明の一実施例を示す表示制御装
置の要部ブロック図、図２は表示制御部装置の一動作タ
イミングを示す図である。図において、従来例と同一ま
たは相当部分には同一符号を付し、説明を省略する。８
はＬＣＤ１に表示する各種情報データを保持するための
表示用メモリで、デュアル・ポートＲＡＭより成る。９
はＬＣＤ１の表示タイミングの１フレーム内に、ＣＰＵ
５から表示用メモリ８にデータの書き込みが行われたか
どうかを検出する検出部、１０はこの検出部９の制御信
号（ＣＬＫＳＥＬ）により、表示制御部３で使用するク
ロック信号（ＣＬＫ）に通常のクロック信号と１／２の
周波数のクロック信号（１／２ＣＬＫ）のいずれかを選
択するマルチプレクサである。なお、ＬＣＤ１は表示画
面部、表示用メモリ８はメモリ部を示す。
置の要部ブロック図、図２は表示制御部装置の一動作タ
イミングを示す図である。図において、従来例と同一ま
たは相当部分には同一符号を付し、説明を省略する。８
はＬＣＤ１に表示する各種情報データを保持するための
表示用メモリで、デュアル・ポートＲＡＭより成る。９
はＬＣＤ１の表示タイミングの１フレーム内に、ＣＰＵ
５から表示用メモリ８にデータの書き込みが行われたか
どうかを検出する検出部、１０はこの検出部９の制御信
号（ＣＬＫＳＥＬ）により、表示制御部３で使用するク
ロック信号（ＣＬＫ）に通常のクロック信号と１／２の
周波数のクロック信号（１／２ＣＬＫ）のいずれかを選
択するマルチプレクサである。なお、ＬＣＤ１は表示画
面部、表示用メモリ８はメモリ部を示す。
【手続補正５】
【補正対象書類名】明細書
【補正対象項目名】００１４
【補正方法】変更
【補正内容】
【００１４】次に、ＨＳＹＮＣ信号の一周期間、すなわ
ち、ＬＣＤ１の表示タイミングの１フレーム間（図２の
Ｂ点からＤ点まで）に表示用メモリ８に各種情報データ
の記憶内容が変更されない場合は、検出部９の内部フラ
グはクリア状態である。よって、次のフレーム（図３の
Ｄ点）からマルチプレクサ１０では、１／２周波数のク
ロック信号が選択され、再びＣＰＵ５により表示用メモ
リ８に各種情報データの記憶内容が変更されるまで、こ
の状態を維持する。これにより、表示タイミングが遅く
なり、消費電力が低減される。その後、表示用メモリ８
に各種情報データが書き込まれ、記憶内容が変更され、
フラグが設定された場合は、（図２のＦ点）は次のフレ
ーム（図２のＧ点）から通常のクロック信号が選択さ
れ、通常の表示タイミング及び消費電力に戻る。
ち、ＬＣＤ１の表示タイミングの１フレーム間（図２の
Ｂ点からＤ点まで）に表示用メモリ８に各種情報データ
の記憶内容が変更されない場合は、検出部９の内部フラ
グはクリア状態である。よって、次のフレーム（図３の
Ｄ点）からマルチプレクサ１０では、１／２周波数のク
ロック信号が選択され、再びＣＰＵ５により表示用メモ
リ８に各種情報データの記憶内容が変更されるまで、こ
の状態を維持する。これにより、表示タイミングが遅く
なり、消費電力が低減される。その後、表示用メモリ８
に各種情報データが書き込まれ、記憶内容が変更され、
フラグが設定された場合は、（図２のＦ点）は次のフレ
ーム（図２のＧ点）から通常のクロック信号が選択さ
れ、通常の表示タイミング及び消費電力に戻る。
【手続補正６】
【補正対象書類名】明細書
【補正対象項目名】００１５
【補正方法】変更
【補正内容】
【００１５】実施例２．図３はこの発明の他の実施例を
示す表示制御装置の要部ブロック図であり、図におい
て、従来例および実施例１と同一または相当部分には同
一符号を付し、説明を省略する。上記実施例１では、表
示用メモリ８はデュアル・ポートＲＡＭであったが、本
実施例では、表示用メモリ４にシングル・ポートＲＡＭ
を使用している。また、表示制御部３は、上記実施例１
の機能に加えて、ＣＰＵ５からの読み書きを行えるよう
にデータバスの制御を行っており、表示制御部３が表示
用メモリ４の読み出しを行っている場合は、ＣＰＵ５の
表示用メモリ４への記憶は禁止されており、読み出しが
終了するまでＣＰＵ５を待機状態とし、読み出し終了後
にＣＰＵ５からの記憶を行う。
示す表示制御装置の要部ブロック図であり、図におい
て、従来例および実施例１と同一または相当部分には同
一符号を付し、説明を省略する。上記実施例１では、表
示用メモリ８はデュアル・ポートＲＡＭであったが、本
実施例では、表示用メモリ４にシングル・ポートＲＡＭ
を使用している。また、表示制御部３は、上記実施例１
の機能に加えて、ＣＰＵ５からの読み書きを行えるよう
にデータバスの制御を行っており、表示制御部３が表示
用メモリ４の読み出しを行っている場合は、ＣＰＵ５の
表示用メモリ４への記憶は禁止されており、読み出しが
終了するまでＣＰＵ５を待機状態とし、読み出し終了後
にＣＰＵ５からの記憶を行う。
【手続補正７】
【補正対象書類名】明細書
【補正対象項目名】００２０
【補正方法】変更
【補正内容】
【００２０】
【発明の効果】以上のように、この発明によれば、メモ
リ部に所定時間内に、各種情報が書き込まれず、記憶内
容が変更されない場合、表示画面部への表示タイミング
を遅くすることにより、消費電力が低減されるので、装
置の発熱を抑え、バッテリー等の寿命を上げるととも
に、装置の小型化が得られるという効果がある。
リ部に所定時間内に、各種情報が書き込まれず、記憶内
容が変更されない場合、表示画面部への表示タイミング
を遅くすることにより、消費電力が低減されるので、装
置の発熱を抑え、バッテリー等の寿命を上げるととも
に、装置の小型化が得られるという効果がある。
Claims (3)
- 【請求項１】 各種情報を表示する表示画面部と、この
表示画面部に表示される各種情報が記憶されるメモリ部
と、このメモリ部内の各種情報を読み出し、前記表示画
面上に表示する表示手段と、前記メモリ部への各種情報
の記憶の有無を検出する検出部とを備え、この検出部に
より前記メモリ部に所定時間、各種情報の記憶の無いこ
とが検出された場合、前記表示制御部による表示画面部
への表示タイミングを遅くすることを特徴とする表示制
御装置。 - 【請求項２】 各種情報を表示する表示画面部と、この
表示画面部を制御する表示制御部と、電流を供給する電
源部と、この電源部の電圧容量を監視する電圧監視部と
を備え、この電圧監視部により前記電源部が所定の電圧
容量より低下したことが検出された場合、前記表示制御
部による表示画面部への表示タイミングを遅くすること
を特徴とする表示制御装置。 - 【請求項３】 各種情報を表示する表示画面部と、この
表示画面部を制御する表示制御部と、外部より各種表示
命令が入力される外部入力部と、この外部入力部に所定
時間各種表示命令が入力されないスリープ状態を検出す
る検出部とを備え、前記検出部によりスリープ状態が検
出された場合、前記表示制御部による表示画面への表示
タイミングを遅くすることを特徴とする表示制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5214174A JPH0764665A (ja) | 1993-08-30 | 1993-08-30 | 表示制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5214174A JPH0764665A (ja) | 1993-08-30 | 1993-08-30 | 表示制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0764665A true JPH0764665A (ja) | 1995-03-10 |
Family
ID=16651466
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5214174A Pending JPH0764665A (ja) | 1993-08-30 | 1993-08-30 | 表示制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0764665A (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002062838A (ja) * | 2000-08-14 | 2002-02-28 | Internatl Business Mach Corp <Ibm> | 表示装置、コンピュータ装置、記憶媒体 |
| KR100369335B1 (ko) * | 2000-12-14 | 2003-01-24 | 주식회사 하이닉스반도체 | 평판표시소자의 소오스 드라이버 |
| WO2003009272A1 (fr) * | 2001-07-12 | 2003-01-30 | International Business Machines Corporation | Appareil d'affichage, appareil d'informatique et procede de commande d'affichage |
| JP2003177729A (ja) * | 2001-09-25 | 2003-06-27 | Samsung Electronics Co Ltd | Ｌｃｄフレーム比率制御回路及び方法とｌｃｄシステム |
| US6678834B1 (en) | 1998-03-20 | 2004-01-13 | International Business Machines Corporation | Apparatus and method for a personal computer system providing non-distracting video power management |
| KR100429970B1 (ko) * | 2001-08-10 | 2004-05-04 | 엘지전자 주식회사 | 영상기기의 화면재생 주파수 제어 장치 및 방법 |
| KR100408581B1 (ko) * | 1995-04-03 | 2004-07-23 | 모토로라 인코포레이티드 | 디스플레이제어방법 |
| WO2004109484A1 (ja) * | 2003-05-30 | 2004-12-16 | Fujitsu Limited | 表示装置の制御装置、制御方法、及び電子機器 |
-
1993
- 1993-08-30 JP JP5214174A patent/JPH0764665A/ja active Pending
Cited By (8)
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|---|---|---|---|---|
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