JPH07250288A - Ｃｃｄ駆動方法およびｃｃｄ駆動装置 - Google Patents
Ｃｃｄ駆動方法およびｃｃｄ駆動装置Info
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- JPH07250288A JPH07250288A JP6039401A JP3940194A JPH07250288A JP H07250288 A JPH07250288 A JP H07250288A JP 6039401 A JP6039401 A JP 6039401A JP 3940194 A JP3940194 A JP 3940194A JP H07250288 A JPH07250288 A JP H07250288A
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Abstract
(57)【要約】
【目的】 ＣＣＤ駆動パルスのタイミング調整を自動的
にかつ最適に行うことのできる手段を提供することを目
的としている。 【構成】 ＣＣＤ駆動パルス中のリセットパルスとサン
プルホールドパルスのタイミング位置を可変とし、クロ
ックに対するリセットパルスとサンプルホールドパルス
のタイミング位置を種々変更して、変更した各パルスの
タイミング位置ごとにＣＣＤ出力の多値データを記憶
し、その後、記憶されている多値データを解析して、最
もよいセンサ動作特性を与えるタイミング位置を求め、
そのタイミング位置でＣＣＤ駆動パルスを発生して、Ｃ
ＣＤの駆動を行うようにするものである。
にかつ最適に行うことのできる手段を提供することを目
的としている。 【構成】 ＣＣＤ駆動パルス中のリセットパルスとサン
プルホールドパルスのタイミング位置を可変とし、クロ
ックに対するリセットパルスとサンプルホールドパルス
のタイミング位置を種々変更して、変更した各パルスの
タイミング位置ごとにＣＣＤ出力の多値データを記憶
し、その後、記憶されている多値データを解析して、最
もよいセンサ動作特性を与えるタイミング位置を求め、
そのタイミング位置でＣＣＤ駆動パルスを発生して、Ｃ
ＣＤの駆動を行うようにするものである。
Description
【０００１】
【産業上の利用分野】本発明は、イメージスキャナなど
のＣＣＤを用いた画像読取装置におけるＣＣＤの駆動方
法および駆動装置に関する。
のＣＣＤを用いた画像読取装置におけるＣＣＤの駆動方
法および駆動装置に関する。
【０００２】ＣＣＤの駆動周波数が高くなると、ＣＣＤ
駆動パルスのクロック、リセットパルス、サンプルホー
ルドパルス間のタイミングマージンが小さくなり、ＣＣ
Ｄのばらつきもあって、ＣＣＤのセンサとしての動作特
性が著しく低下することがある。本発明は、ＣＣＤごと
に、クロックに対するリセットパルスおよびサンプルホ
ールドパルスの最適なタイミング位置を自動的に決定し
て動作させるものである。
駆動パルスのクロック、リセットパルス、サンプルホー
ルドパルス間のタイミングマージンが小さくなり、ＣＣ
Ｄのばらつきもあって、ＣＣＤのセンサとしての動作特
性が著しく低下することがある。本発明は、ＣＣＤごと
に、クロックに対するリセットパルスおよびサンプルホ
ールドパルスの最適なタイミング位置を自動的に決定し
て動作させるものである。
【０００３】
【従来の技術】図５は、従来のイメージスキャナにおけ
るＣＣＤ駆動装置の構成を示したものであり、図中、１
はシステムクロック源、２は多段遅延回路、３はＣＣＤ
駆動クロック制御信号、４はタイミングジェネレータ、
５はＣＣＤ、６はアナログ処理回路、７はＡ／Ｄ変換器
である。
るＣＣＤ駆動装置の構成を示したものであり、図中、１
はシステムクロック源、２は多段遅延回路、３はＣＣＤ
駆動クロック制御信号、４はタイミングジェネレータ、
５はＣＣＤ、６はアナログ処理回路、７はＡ／Ｄ変換器
である。
【０００４】システムクロック源１は、画素クロック
（あるいはビットクロック）として用いられるシステム
クロックを発生し、多段遅延回路２とタイミングジェネ
レータ４とに印加する。タイミングジェネレータ４はＰ
ＲＯＭにより構成され、ＣＣＤ駆動用のクロックφＣ
Ｋ、リセットパルスφＲＳと、サンプルホールドパルス
φＳＰの各タイミング信号のパターンが格納されてい
る。これらのタイミング信号は、たとえば図６に例示さ
れている。多段遅延回路２は、システムクロックを複数
段に遅延して出力する。その各遅延されたシステムクロ
ックと元のシステムクロックは、ともにタイミングジェ
ネレータ４のＰＲＯＭにスキャンアドレスとして印加さ
れ、ＣＣＤ駆動クロック制御信号３による制御のもと
で、格納されている各タイミング信号のパターンφＣ
Ｋ，φＲＳ，φＳＰを並行してかつ時系列上で連続的に
読み出し、ＣＣＤ５に印加する。これによりＣＣＤ５は
動作し、画像信号が出力されてアナログ処理回路６に入
力される。
（あるいはビットクロック）として用いられるシステム
クロックを発生し、多段遅延回路２とタイミングジェネ
レータ４とに印加する。タイミングジェネレータ４はＰ
ＲＯＭにより構成され、ＣＣＤ駆動用のクロックφＣ
Ｋ、リセットパルスφＲＳと、サンプルホールドパルス
φＳＰの各タイミング信号のパターンが格納されてい
る。これらのタイミング信号は、たとえば図６に例示さ
れている。多段遅延回路２は、システムクロックを複数
段に遅延して出力する。その各遅延されたシステムクロ
ックと元のシステムクロックは、ともにタイミングジェ
ネレータ４のＰＲＯＭにスキャンアドレスとして印加さ
れ、ＣＣＤ駆動クロック制御信号３による制御のもと
で、格納されている各タイミング信号のパターンφＣ
Ｋ，φＲＳ，φＳＰを並行してかつ時系列上で連続的に
読み出し、ＣＣＤ５に印加する。これによりＣＣＤ５は
動作し、画像信号が出力されてアナログ処理回路６に入
力される。
【０００５】アナログ処理回路６は、入力画像信号を比
較的長い期間で平滑化し、そのレベルに基づいて増幅器
の利得を自動制御するＡＧＣ機能をもち、画像信号のレ
ベル補正を行う。レベル補正された画像信号はＡ／Ｄ変
換器７に入力され、ディジタル信号形式の多値データに
変換されて出力される。
較的長い期間で平滑化し、そのレベルに基づいて増幅器
の利得を自動制御するＡＧＣ機能をもち、画像信号のレ
ベル補正を行う。レベル補正された画像信号はＡ／Ｄ変
換器７に入力され、ディジタル信号形式の多値データに
変換されて出力される。
【０００６】図５に示された従来装置では、タイミング
ジェネレータ４に格納されている各タイミング信号のパ
ターンは固定されており、信号相互間のタイミング関係
も固定されている。図６の（ａ）はＣＣＤ駆動周波数が
低い場合の信号波形図であり、図中にＡ，Ｂ，Ｃで示さ
れる信号間のマージンは全ての装置について変わらな
い。図６の（ｂ）は、同じタイミングジェネレータ４を
用いてＣＣＤ駆動周波数を２倍に上げた場合の信号波形
図である。図６の（ａ）にくらべて時間軸が１／２に圧
縮され、マージンＡ′，Ｂ′，Ｃ′は１／２に縮小して
いる。
ジェネレータ４に格納されている各タイミング信号のパ
ターンは固定されており、信号相互間のタイミング関係
も固定されている。図６の（ａ）はＣＣＤ駆動周波数が
低い場合の信号波形図であり、図中にＡ，Ｂ，Ｃで示さ
れる信号間のマージンは全ての装置について変わらな
い。図６の（ｂ）は、同じタイミングジェネレータ４を
用いてＣＣＤ駆動周波数を２倍に上げた場合の信号波形
図である。図６の（ａ）にくらべて時間軸が１／２に圧
縮され、マージンＡ′，Ｂ′，Ｃ′は１／２に縮小して
いる。
【０００７】ところでタイミング信号は、素子の製造ロ
ットや温度などの環境条件によって遅延量にばらつきが
生じるので、図６の（ｂ）に示すようにＣＣＤ駆動周波
数が高くなると、ＣＣＤの駆動タイミング条件が一層厳
しくなり、十分なＣＣＤ出力レベルが得にくくなる。
ットや温度などの環境条件によって遅延量にばらつきが
生じるので、図６の（ｂ）に示すようにＣＣＤ駆動周波
数が高くなると、ＣＣＤの駆動タイミング条件が一層厳
しくなり、十分なＣＣＤ出力レベルが得にくくなる。
【０００８】図７の（ａ），（ｂ），（ｃ），（ｄ）
は、異なる信号間タイミングにおけるＣＣＤのサンプル
ホールド出力の例を示したものである。図７の（ａ）
は、信号間のタイミングが適切に設定されている標準状
態の信号波形を示す。のクロックφＣＫに基づきの
ＣＣＤ出力は入射光レベルに応じて定まる電位へ向かっ
てややゆるやかに立下がる。のサンプルホールドパル
スφＳＰはＣＣＤ出力がほぼ最終レベルに達した後で終
了し、さらにのリセットパルスφＲＳはその後に生じ
るので、のサンプルホールド出力として十分なレベル
のものが得られる。
は、異なる信号間タイミングにおけるＣＣＤのサンプル
ホールド出力の例を示したものである。図７の（ａ）
は、信号間のタイミングが適切に設定されている標準状
態の信号波形を示す。のクロックφＣＫに基づきの
ＣＣＤ出力は入射光レベルに応じて定まる電位へ向かっ
てややゆるやかに立下がる。のサンプルホールドパル
スφＳＰはＣＣＤ出力がほぼ最終レベルに達した後で終
了し、さらにのリセットパルスφＲＳはその後に生じ
るので、のサンプルホールド出力として十分なレベル
のものが得られる。
【０００９】図７の（ｂ）は、図７の（ａ）の標準状態
よりもφＲＳとφＳＰが前方にずれている状態の信号波
形を示す。この場合、φＳＰはＣＣＤ出力が下がり切る
前に生じるため、実際よりも低いＣＣＤ出力レベルをサ
ンプルホールドすることになる。またφＲＳもＣＣＤ出
力が最終レベルに達する途中で生じ、ＣＣＤ出力をリセ
ットするので、φＳＰがもう少し後方で生じたとして
も、十分なＣＣＤ出力レベルをサンプルホールドするこ
とはできない。
よりもφＲＳとφＳＰが前方にずれている状態の信号波
形を示す。この場合、φＳＰはＣＣＤ出力が下がり切る
前に生じるため、実際よりも低いＣＣＤ出力レベルをサ
ンプルホールドすることになる。またφＲＳもＣＣＤ出
力が最終レベルに達する途中で生じ、ＣＣＤ出力をリセ
ットするので、φＳＰがもう少し後方で生じたとして
も、十分なＣＣＤ出力レベルをサンプルホールドするこ
とはできない。
【００１０】図７の（ｃ）は、φＲＳがφＣＫの周期を
越えて後方にずれた状態の信号波形を示す。この場合、
ＣＣＤ出力が完全にリセットされる前に次の周期に移
り、その始めの部分をリセットするため、ＣＣＤ出力レ
ベルは正しい入射光のレベルを反映せず不定となる。
越えて後方にずれた状態の信号波形を示す。この場合、
ＣＣＤ出力が完全にリセットされる前に次の周期に移
り、その始めの部分をリセットするため、ＣＣＤ出力レ
ベルは正しい入射光のレベルを反映せず不定となる。
【００１１】図７の（ｄ）は、φＲＳとφＳＰが重なっ
ている状態の信号波形であり、サンプルホールド期間の
ごく一部分の間しかＣＣＤ出力は存在しないので、サン
プルホールド出力は殆ど得られない。さらに図には示さ
ないが、φＳＰのパルス幅が細かすぎる場合には、リセ
ットが十分にできず、ＣＣＤ出力レベルは飽和してしま
う。またφＳＰのパルス幅が細かすぎる場合には、サン
プルホールド動作に必要な時間が不足し、ホールド用コ
ンデンサをＣＣＤ出力レベルまでチャージできないた
め、サンプルホールド出力は殆ど得られなくなる。
ている状態の信号波形であり、サンプルホールド期間の
ごく一部分の間しかＣＣＤ出力は存在しないので、サン
プルホールド出力は殆ど得られない。さらに図には示さ
ないが、φＳＰのパルス幅が細かすぎる場合には、リセ
ットが十分にできず、ＣＣＤ出力レベルは飽和してしま
う。またφＳＰのパルス幅が細かすぎる場合には、サン
プルホールド動作に必要な時間が不足し、ホールド用コ
ンデンサをＣＣＤ出力レベルまでチャージできないた
め、サンプルホールド出力は殆ど得られなくなる。
【００１２】このように従来装置のＣＣＤ駆動方法で
は、駆動周波数が高くなるとセンサとしての動作特性が
悪くなりやすいため、タイミング調整が必要となる場合
が少なくなかったが、個別的、ハード的に対応しなけれ
ばならず、調整の作業負担が大きいという問題があっ
た。
は、駆動周波数が高くなるとセンサとしての動作特性が
悪くなりやすいため、タイミング調整が必要となる場合
が少なくなかったが、個別的、ハード的に対応しなけれ
ばならず、調整の作業負担が大きいという問題があっ
た。
【００１３】
【発明が解決しようとする課題】本発明は、ＣＣＤ駆動
パルスのタイミング調整を自動的にかつ最適に行うこと
ができる手段を提供することを目的としている。
パルスのタイミング調整を自動的にかつ最適に行うこと
ができる手段を提供することを目的としている。
【００１４】
【課題を解決するための手段】本発明は、ＣＣＤ駆動パ
ルス中のリセットパルスとサンプルホールドパルスのタ
イミング位置を可変とし、クロックに対するリセットパ
ルスとサンプルホールドパルスのタイミング位置を種々
変更して、変更した各パルスのタイミング位置ごとにＣ
ＣＤ出力の多値データを記憶し、その後、記憶されてい
る多値データを解析して、最もよいセンサ動作特性を与
えるタイミング位置を求め、そのタイミング位置でＣＣ
Ｄ駆動パルスを発生して、ＣＣＤの駆動を行うようにす
るものである。
ルス中のリセットパルスとサンプルホールドパルスのタ
イミング位置を可変とし、クロックに対するリセットパ
ルスとサンプルホールドパルスのタイミング位置を種々
変更して、変更した各パルスのタイミング位置ごとにＣ
ＣＤ出力の多値データを記憶し、その後、記憶されてい
る多値データを解析して、最もよいセンサ動作特性を与
えるタイミング位置を求め、そのタイミング位置でＣＣ
Ｄ駆動パルスを発生して、ＣＣＤの駆動を行うようにす
るものである。
【００１５】図１は、本発明の原理図であり、（ａ）は
本発明によるＣＣＤ駆動方法の概要を示し、（ｂ）は本
発明によるＣＣＤ駆動装置の構成を示す。図１の（ａ）
に示される本発明のＣＣＤ駆動方法において、１０は、
装置調整時に実行される最適タイミング位置検出段階で
あり、ＣＣＤ駆動パルスのクロック、リセットパルス、
サンプルホールドパルスについて、クロックに対するリ
セットパルスとサンプルホールドパルスの各タイミング
位置を所定範囲内の複数位置で変更し、各変更したタイ
ミング位置ごとにＣＣＤ出力の多値データを記憶し、全
てのタイミング変更位置についてＣＣＤ出力の多値デー
タが記憶されたとき、各タイミング変更位置ごとの多値
データをそれぞれ解析し、ＣＣＤ出力レベル、出力リニ
アリティ、コントラスト伝達関数ＣＴＦなどのセンサ動
作特性を求めて比較し、最良のセンサ動作特性を与える
ＣＣＤ駆動パルスのタイミング変更位置を最適タイミン
グ位置として決定する。
本発明によるＣＣＤ駆動方法の概要を示し、（ｂ）は本
発明によるＣＣＤ駆動装置の構成を示す。図１の（ａ）
に示される本発明のＣＣＤ駆動方法において、１０は、
装置調整時に実行される最適タイミング位置検出段階で
あり、ＣＣＤ駆動パルスのクロック、リセットパルス、
サンプルホールドパルスについて、クロックに対するリ
セットパルスとサンプルホールドパルスの各タイミング
位置を所定範囲内の複数位置で変更し、各変更したタイ
ミング位置ごとにＣＣＤ出力の多値データを記憶し、全
てのタイミング変更位置についてＣＣＤ出力の多値デー
タが記憶されたとき、各タイミング変更位置ごとの多値
データをそれぞれ解析し、ＣＣＤ出力レベル、出力リニ
アリティ、コントラスト伝達関数ＣＴＦなどのセンサ動
作特性を求めて比較し、最良のセンサ動作特性を与える
ＣＣＤ駆動パルスのタイミング変更位置を最適タイミン
グ位置として決定する。
【００１６】１１は、決定された最適タイミング位置の
データであり、クロックに対するリセットパルスとサン
プルホールドパルスの最適タイミング位置を示すデータ
からなり、不揮発性メモリ等に記憶される。
データであり、クロックに対するリセットパルスとサン
プルホールドパルスの最適タイミング位置を示すデータ
からなり、不揮発性メモリ等に記憶される。
【００１７】１２は、装置の通常動作時に実行されるＣ
ＣＤ駆動制御段階であり、最適タイミング位置検出段階
１０が決定した最適タイミング位置のデータ１１を用い
てクロック、リセットパルス、サンプルホールドパルス
の各タイミング位置を制御し、ＣＣＤを駆動する。
ＣＤ駆動制御段階であり、最適タイミング位置検出段階
１０が決定した最適タイミング位置のデータ１１を用い
てクロック、リセットパルス、サンプルホールドパルス
の各タイミング位置を制御し、ＣＣＤを駆動する。
【００１８】次に、図１の（ｂ）に示される本発明のＣ
ＣＤ駆動装置において、１３は、システムクロック源で
あり、ＣＣＤ駆動周波数と所定のパルス幅とで、クロッ
クφＣＫ、リセットパルスφＲＳ、サンプルホールドパ
ルスφＳＰの元になるパルスφＣＫ′，φＲＳ′，φＳ
Ｐ′をそれぞれ発生する。
ＣＤ駆動装置において、１３は、システムクロック源で
あり、ＣＣＤ駆動周波数と所定のパルス幅とで、クロッ
クφＣＫ、リセットパルスφＲＳ、サンプルホールドパ
ルスφＳＰの元になるパルスφＣＫ′，φＲＳ′，φＳ
Ｐ′をそれぞれ発生する。
【００１９】１４は、多段のディレィライン等で構成さ
れる遅延量を複数段に切り換え可能なタイミング変更手
段であり、入力されたパルスφＣＫ′，φＲＳ′，φＳ
Ｐ′に対して、それぞれ指示された遅延を与え、φＣ
Ｋ，φＲＳ，φＳＰを発生する。たとえばφＣＫ′＝φ
ＣＫとし、φＲＳ，φＳＰは、図６に示されるタイミン
グ位置を中心にしてマージンＡ，Ｂ，Ｃ（Ａ′，Ｂ′，
Ｃ′）が種々な値をとるように、φＲＳ′，φＳＰ′に
対してそれぞれ種々な遅延量を設定して、タイミング位
置を前後に変更できるようにする。
れる遅延量を複数段に切り換え可能なタイミング変更手
段であり、入力されたパルスφＣＫ′，φＲＳ′，φＳ
Ｐ′に対して、それぞれ指示された遅延を与え、φＣ
Ｋ，φＲＳ，φＳＰを発生する。たとえばφＣＫ′＝φ
ＣＫとし、φＲＳ，φＳＰは、図６に示されるタイミン
グ位置を中心にしてマージンＡ，Ｂ，Ｃ（Ａ′，Ｂ′，
Ｃ′）が種々な値をとるように、φＲＳ′，φＳＰ′に
対してそれぞれ種々な遅延量を設定して、タイミング位
置を前後に変更できるようにする。
【００２０】１５は、駆動対象のＣＣＤであり、素子特
性にばらつきがある。１６は、Ａ／Ｄ変換器であり、Ｃ
ＣＤ出力のアナログ形式の画像信号をディジタル形式の
多値データに変換する。
性にばらつきがある。１６は、Ａ／Ｄ変換器であり、Ｃ
ＣＤ出力のアナログ形式の画像信号をディジタル形式の
多値データに変換する。
【００２１】１７は、多値データ記憶手段であり、ＣＣ
Ｄ駆動パルスの最適タイミング位置検出段階のために収
集されるＣＣＤ出力の多値データが、そのとき設定され
ているタイミング位置対応で記憶される。
Ｄ駆動パルスの最適タイミング位置検出段階のために収
集されるＣＣＤ出力の多値データが、そのとき設定され
ているタイミング位置対応で記憶される。
【００２２】１８は、特性解析手段であり、装置調整時
にタイミング変更手段１４に対してＣＣＤ駆動パルスの
タイミング位置変更指示を出し、φＣＫに対してφＲ
Ｓ，φＳＰの種々なタイミング位置を順次設定してＣＣ
Ｄ１５を駆動させ、そのとき出力される多値データを、
設定したタイミング位置と対応づけて多値データ記憶手
段１７に収集する。次に収集した各タイミング位置対応
の多値データを順次取り出して、タイミング位置ごとの
センサ動作特性を解析し、最良のセンサ動作特性を与え
るタイミング位置を検出し、最適タイミング位置として
決定する。
にタイミング変更手段１４に対してＣＣＤ駆動パルスの
タイミング位置変更指示を出し、φＣＫに対してφＲ
Ｓ，φＳＰの種々なタイミング位置を順次設定してＣＣ
Ｄ１５を駆動させ、そのとき出力される多値データを、
設定したタイミング位置と対応づけて多値データ記憶手
段１７に収集する。次に収集した各タイミング位置対応
の多値データを順次取り出して、タイミング位置ごとの
センサ動作特性を解析し、最良のセンサ動作特性を与え
るタイミング位置を検出し、最適タイミング位置として
決定する。
【００２３】１９は、決定された最適タイミング位置デ
ータである。２０は、ＣＣＤ駆動制御手段であり、装置
の通常動作時に、先に決定された最適タイミング位置デ
ータ１９を用いてタイミング変更手段１４にφＲＳ，φ
ＳＰのタイミング位置を指示し、最適なφＣＫ，φＲ
Ｓ，φＳＰを発生させてＣＣＤ１５に供給し、ＣＣＤ１
５を最良の特性で動作させる。
ータである。２０は、ＣＣＤ駆動制御手段であり、装置
の通常動作時に、先に決定された最適タイミング位置デ
ータ１９を用いてタイミング変更手段１４にφＲＳ，φ
ＳＰのタイミング位置を指示し、最適なφＣＫ，φＲ
Ｓ，φＳＰを発生させてＣＣＤ１５に供給し、ＣＣＤ１
５を最良の特性で動作させる。
【００２４】
【作用】本発明のＣＣＤ駆動方法あるいはＣＣＤ駆動装
置を採用することにより、画像読取装置の出荷調整時あ
るいは保守調整時に、個別にＣＣＤ駆動パルスの最適タ
イミング位置を求めて装置に設定し、実際の動作状態で
はその最適タイミング位置のＣＣＤ駆動パルスを用いて
ＣＣＤが駆動されるので、ＣＣＤの素子ごとの特性にば
らつきがあってもそれぞれに適応した最適な動作が可能
となる。またこれらは全て自動的に処理される。
置を採用することにより、画像読取装置の出荷調整時あ
るいは保守調整時に、個別にＣＣＤ駆動パルスの最適タ
イミング位置を求めて装置に設定し、実際の動作状態で
はその最適タイミング位置のＣＣＤ駆動パルスを用いて
ＣＣＤが駆動されるので、ＣＣＤの素子ごとの特性にば
らつきがあってもそれぞれに適応した最適な動作が可能
となる。またこれらは全て自動的に処理される。
【００２５】
【実施例】図２は、本発明の１実施例によるＣＣＤ駆動
装置の構成図である。なお図２の構成と図５の従来装置
の構成との対応を容易に理解できるようにするため、共
通の要素には同じ参照番号を付して示す。
装置の構成図である。なお図２の構成と図５の従来装置
の構成との対応を容易に理解できるようにするため、共
通の要素には同じ参照番号を付して示す。
【００２６】図２において、１はシステムクロック源、
５はＣＣＤ、６はアナログ処理回路、７はＡ／Ｄ変換
器、２１および２２はそれぞれディレィラインを用いた
多段の遅延回路、２３および２４はセレクタ、２５はＭ
ＰＵ、２６はＰＲＯＭ、２７はＳＲＡＭ、２８はＥ2 Ｐ
ＲＯＭ、２９は特性解析プログラム、３０はφＲＳ用タ
イミング位置テーブル、３１はφＳＰ用タイミング位置
テーブル、３３は多値データファイル、３４は最適タイ
ミング位置データである。なおＰＲＯＭ２６には、ほか
にもＣＣＤ駆動制御プログラムなどが格納されているが
図示省略されている。
５はＣＣＤ、６はアナログ処理回路、７はＡ／Ｄ変換
器、２１および２２はそれぞれディレィラインを用いた
多段の遅延回路、２３および２４はセレクタ、２５はＭ
ＰＵ、２６はＰＲＯＭ、２７はＳＲＡＭ、２８はＥ2 Ｐ
ＲＯＭ、２９は特性解析プログラム、３０はφＲＳ用タ
イミング位置テーブル、３１はφＳＰ用タイミング位置
テーブル、３３は多値データファイル、３４は最適タイ
ミング位置データである。なおＰＲＯＭ２６には、ほか
にもＣＣＤ駆動制御プログラムなどが格納されているが
図示省略されている。
【００２７】システムクロック源１は、同じＣＣＤ駆動
周波数で所定のパルス幅をもつパルスφＣＫ′，φＲ
Ｓ′，φＳＰ′を発生する。φＣＫ′，φＲＳ′，φＳ
Ｐ′は同じタイミング位置で生じてよい。φＣＫ′は遅
延せずにそのままφＣＫとしてＣＣＤ５に与えられ、φ
ＲＳ′とφＳＰ′はそれぞれ多段の遅延回路２１と２２
に入力される。
周波数で所定のパルス幅をもつパルスφＣＫ′，φＲ
Ｓ′，φＳＰ′を発生する。φＣＫ′，φＲＳ′，φＳ
Ｐ′は同じタイミング位置で生じてよい。φＣＫ′は遅
延せずにそのままφＣＫとしてＣＣＤ５に与えられ、φ
ＲＳ′とφＳＰ′はそれぞれ多段の遅延回路２１と２２
に入力される。
【００２８】遅延回路２１は、図３の（ａ）に示すよう
に、入力されたφＲＳ′のタイミング位置ｔ0 を複数段
階に遅延させ、ｔi を中心にΔｔ間隔でｔi-M からｔ
i+M まで２Ｍ＋１個の異なるタイミング位置のφＲＳを
並列に生成する。同様に遅延回路２２は、図３の（ｂ）
に示すように、入力されたφＳＰ′のタイミング位置ｔ
0 を複数段階に遅延させ、ｔj を中心にΔｔ間隔でｔ
j-N からｔj+N までの２Ｎ＋１個の異なるタイミング位
置のφＳＰ′を並列に生成する。Δｔ，Ｍ，Ｎの値は適
当に設定される。
に、入力されたφＲＳ′のタイミング位置ｔ0 を複数段
階に遅延させ、ｔi を中心にΔｔ間隔でｔi-M からｔ
i+M まで２Ｍ＋１個の異なるタイミング位置のφＲＳを
並列に生成する。同様に遅延回路２２は、図３の（ｂ）
に示すように、入力されたφＳＰ′のタイミング位置ｔ
0 を複数段階に遅延させ、ｔj を中心にΔｔ間隔でｔ
j-N からｔj+N までの２Ｎ＋１個の異なるタイミング位
置のφＳＰ′を並列に生成する。Δｔ，Ｍ，Ｎの値は適
当に設定される。
【００２９】セレクタ２３，２４は、それぞれＭＰＵ２
５からの指示によりこれらの複数の異なるタイミング位
置のφＲＳ，φＳＰの任意のものを選択し、ＣＣＤ５に
印加する。この結果、φＲＳ，φＳＰは、図３の（ｃ）
に示されるように、φＣＫのタイミング位置ｔ0 に対し
て、それぞれタイミング位置ｔi ，ｔj を中心に、前後
に任意にずらして設定されることができる。
５からの指示によりこれらの複数の異なるタイミング位
置のφＲＳ，φＳＰの任意のものを選択し、ＣＣＤ５に
印加する。この結果、φＲＳ，φＳＰは、図３の（ｃ）
に示されるように、φＣＫのタイミング位置ｔ0 に対し
て、それぞれタイミング位置ｔi ，ｔj を中心に、前後
に任意にずらして設定されることができる。
【００３０】ＭＰＵ２５は、制御メモリとして用いられ
るＰＲＯＭ２６に格納されている特性解析プログラム２
９を実行して、φＲＳ、φＳＰの種々のタイミング位置
をセレクタ２３，２４に設定し、ＣＣＤ５を駆動させ
る。φＲＳ用とφＳＰ用のタイミング位置テーブル３
０，３１は、φＲＳとφＳＰに異なるタイミング位置を
設定するための組み合わせの展開に用いられる。なお最
適タイミング位置の検出時には、ＣＣＤ５に白基準の読
み取りを行わせる。
るＰＲＯＭ２６に格納されている特性解析プログラム２
９を実行して、φＲＳ、φＳＰの種々のタイミング位置
をセレクタ２３，２４に設定し、ＣＣＤ５を駆動させ
る。φＲＳ用とφＳＰ用のタイミング位置テーブル３
０，３１は、φＲＳとφＳＰに異なるタイミング位置を
設定するための組み合わせの展開に用いられる。なお最
適タイミング位置の検出時には、ＣＣＤ５に白基準の読
み取りを行わせる。
【００３１】ＣＣＤ５の出力は、アナログ処理回路６で
信号レベルのＡＧＣによる補正が行われ、Ａ／Ｄ変換器
７でディジタル形式の多値データに変換される。ＳＲＡ
Ｍ２７の多値データファイル３３は、φＲＳ，φＳＰの
異なるタイミング位置ごとのＣＣＤ出力のうち、有効レ
ベルに達しているものの多値データをたとえば主走査の
ライン中央の１００ドット分だけ集めて作成したもので
ある。
信号レベルのＡＧＣによる補正が行われ、Ａ／Ｄ変換器
７でディジタル形式の多値データに変換される。ＳＲＡ
Ｍ２７の多値データファイル３３は、φＲＳ，φＳＰの
異なるタイミング位置ごとのＣＣＤ出力のうち、有効レ
ベルに達しているものの多値データをたとえば主走査の
ライン中央の１００ドット分だけ集めて作成したもので
ある。
【００３２】特性解析プログラム２９を実行しているＭ
ＰＵ２５は、多値データファイル３３を作成した後、特
性解析を行い、最適タイミング位置を決定して最適タイ
ミング位置データ３４をＥ2 ＰＲＯＭ２８に書き込む。
ＰＵ２５は、多値データファイル３３を作成した後、特
性解析を行い、最適タイミング位置を決定して最適タイ
ミング位置データ３４をＥ2 ＰＲＯＭ２８に書き込む。
【００３３】実動作時にＭＰＵ２５は、ＣＣＤ駆動制御
プログラム（図示省略）を実行し、Ｅ2 ＰＲＯＭ２８の
最適タイミング位置データ３４を読み出し、セレクタ２
３，２４にφＲＳ，φＳＰのタイミング位置を設定す
る。ＣＣＤ５には、この設定された最適なタイミング位
置に基づくＣＣＤ駆動パルスφＣＫ，φＲＳ，φＳＰが
供給され、駆動される。
プログラム（図示省略）を実行し、Ｅ2 ＰＲＯＭ２８の
最適タイミング位置データ３４を読み出し、セレクタ２
３，２４にφＲＳ，φＳＰのタイミング位置を設定す
る。ＣＣＤ５には、この設定された最適なタイミング位
置に基づくＣＣＤ駆動パルスφＣＫ，φＲＳ，φＳＰが
供給され、駆動される。
【００３４】図４は、本発明実施例における特性解析プ
ログラムの詳細フローである。ステップ（１）では、新
しいタイミング位置を設定し、ＣＣＤを駆動する。ステ
ップ（２）では、アナログ処理回路にＡＧＣ動作による
ＣＣＤ出力レベルの補正を行わせ、そのときのＡＧＣ制
御電圧、つまりＣＣＤ出力レベルを補正するために必要
とした増幅器の利得制御電圧を取り出す。
ログラムの詳細フローである。ステップ（１）では、新
しいタイミング位置を設定し、ＣＣＤを駆動する。ステ
ップ（２）では、アナログ処理回路にＡＧＣ動作による
ＣＣＤ出力レベルの補正を行わせ、そのときのＡＧＣ制
御電圧、つまりＣＣＤ出力レベルを補正するために必要
とした増幅器の利得制御電圧を取り出す。
【００３５】ステップ（３）では、ＡＧＣ制御電圧の値
からＣＣＤ出力レベルが十分なレベルに達しているかど
うかを判定する。ＣＣＤ出力レベルが不十分なものであ
ればステップ（１）に戻り、他のタイミング位置を設定
し直す。ＣＣＤ出力レベルが十分なものであればステッ
プ（４）に進む。
からＣＣＤ出力レベルが十分なレベルに達しているかど
うかを判定する。ＣＣＤ出力レベルが不十分なものであ
ればステップ（１）に戻り、他のタイミング位置を設定
し直す。ＣＣＤ出力レベルが十分なものであればステッ
プ（４）に進む。
【００３６】ステップ（４）では、電源電圧の変動に対
する特性のマージンをチェックするため、電源電圧を５
Ｖ±０．５Ｖに変動させる。ステップ（５）では、電源
電圧を変動させた状態でＣＣＤ出力レベルのＡＧＣ動作
を行わせ、そのときのＡＧＣ制御電圧を取り出す。
する特性のマージンをチェックするため、電源電圧を５
Ｖ±０．５Ｖに変動させる。ステップ（５）では、電源
電圧を変動させた状態でＣＣＤ出力レベルのＡＧＣ動作
を行わせ、そのときのＡＧＣ制御電圧を取り出す。
【００３７】ステップ（６）では、ＡＧＣ制御電圧から
ＣＣＤ出力レベルをチェックし、レベルが不十分なもの
であれば、ステップ（１）に戻りタイミング位置を変更
する。レベルが十分なものであればステップ（７）に進
む。
ＣＣＤ出力レベルをチェックし、レベルが不十分なもの
であれば、ステップ（１）に戻りタイミング位置を変更
する。レベルが十分なものであればステップ（７）に進
む。
【００３８】ステップ（７）では、図６に示されるφＣ
Ｋ，φＲＳ，ＣＣＤ出力，φＳＰ，間のマージンＡ，
Ｂ，Ｃが小さくなる方向にφＲＳ，φＳＰのタイミング
位置を変更する。
Ｋ，φＲＳ，ＣＣＤ出力，φＳＰ，間のマージンＡ，
Ｂ，Ｃが小さくなる方向にφＲＳ，φＳＰのタイミング
位置を変更する。
【００３９】ステップ（８）では、ＣＣＤ出力レベルに
対するＡＧＣ動作を行わせ、そのときのＡＧＣ制御電圧
を取り出す。ステップ（９）では、マージンＡ，Ｂ，Ｃ
が小さくなるようにタイミング位置を変更した結果のＣ
ＣＤ出力レベルが十分なものであるかどうかを判定し、
不十分なものであればステップ（１）に戻り、タイミン
グ位置を設定する。レベルが十分なものであればステッ
プ（１０）に進む。
対するＡＧＣ動作を行わせ、そのときのＡＧＣ制御電圧
を取り出す。ステップ（９）では、マージンＡ，Ｂ，Ｃ
が小さくなるようにタイミング位置を変更した結果のＣ
ＣＤ出力レベルが十分なものであるかどうかを判定し、
不十分なものであればステップ（１）に戻り、タイミン
グ位置を設定する。レベルが十分なものであればステッ
プ（１０）に進む。
【００４０】ステップ（１０）では、ＣＣＤ出力の多値
データをメモリの多値データファイルに格納する。ステ
ップ（１１）では、変更可能なタイミング位置の全てに
ついてＣＣＤ出力レベルのチェックが完了するまでステ
ップ（１）に戻り、完了すればステップ（１２）に進
む。
データをメモリの多値データファイルに格納する。ステ
ップ（１１）では、変更可能なタイミング位置の全てに
ついてＣＣＤ出力レベルのチェックが完了するまでステ
ップ（１）に戻り、完了すればステップ（１２）に進
む。
【００４１】ステップ（１２）では、多値データを解析
する。解析手法としては、分散値、ＣＴＦ値、奇偶ビッ
ト間のレベル差などを求めて、ＣＣＤのセンサ動作特性
の評価をする。ここでＣＴＦは、光学レンズの特性評価
に用いられるＭＴＦ（変調伝達関数）に相当するもので
あり、ＣＣＤのセル出力電圧の最大値をＶmax 、最小値
をＶmin としたとき、 ＣＴＦ＝（Ｖmax −Ｖmin ）／（Ｖmax −Ｖmin ） で与えられ、画像のコトラストの低下度、つまりぼけ具
合を示す尺度として用いられる。
する。解析手法としては、分散値、ＣＴＦ値、奇偶ビッ
ト間のレベル差などを求めて、ＣＣＤのセンサ動作特性
の評価をする。ここでＣＴＦは、光学レンズの特性評価
に用いられるＭＴＦ（変調伝達関数）に相当するもので
あり、ＣＣＤのセル出力電圧の最大値をＶmax 、最小値
をＶmin としたとき、 ＣＴＦ＝（Ｖmax −Ｖmin ）／（Ｖmax −Ｖmin ） で与えられ、画像のコトラストの低下度、つまりぼけ具
合を示す尺度として用いられる。
【００４２】ステップ（１３）では、多値データの解析
結果の比較を行い、最適なタイミング位置を求める。ス
テップ（１４）では、求めた最適タイミング位置のデー
タをＥ2 ＰＲＯＭに書き込む。
結果の比較を行い、最適なタイミング位置を求める。ス
テップ（１４）では、求めた最適タイミング位置のデー
タをＥ2 ＰＲＯＭに書き込む。
【００４３】
【発明の効果】本発明により、ＣＣＤを用いる画像読取
装置において、装置ごとのＣＣＤ駆動パルスのタイミン
グ調整を自動的に行うことが可能となり、特にＣＣＤ駆
動周波数が高い場合に微妙なタイミングマージン調整を
人手を使わず迅速正確に行うことができ、画質の向上と
工数の削減、コストの低減などの効果が得られる。
装置において、装置ごとのＣＣＤ駆動パルスのタイミン
グ調整を自動的に行うことが可能となり、特にＣＣＤ駆
動周波数が高い場合に微妙なタイミングマージン調整を
人手を使わず迅速正確に行うことができ、画質の向上と
工数の削減、コストの低減などの効果が得られる。
【図１】本発明の原理図である。
【図２】本発明の１実施例によるＣＣＤ駆動装置の構成
図である。
図である。
【図３】本発明実施例における遅延回路を用いたタイミ
ング位置変更の説明図である。
ング位置変更の説明図である。
【図４】本発明実施例プログラムにおける特性解析プロ
グラムの詳細フロー図である。
グラムの詳細フロー図である。
【図５】従来のＣＣＤ駆動装置の構成図である。
【図６】ＣＣＤ駆動パルスの信号波形図である。
【図７】ＣＣＤ駆動パルスのタイミングが不適当である
例の信号波形図である。
例の信号波形図である。
１０ 最適タイミング位置検出段階 １１ 最適タイミング位置のデータ １２ ＣＣＤ駆動制御段階 １３ システムクロック源 １４ タイミング変更手段 １５ ＣＣＤ １６ Ａ／Ｄ変換器 １７ 多値データ記憶手段 １８ 特性解析手段 １９ 最適タイミング位置データ ２０ ＣＣＤ駆動制御手段
Claims (2)
- 【請求項１】 クロック、リセットパルス、サンプルホ
ールドパルスからなるＣＣＤ駆動パルスを発生しＣＣＤ
に供給するＣＣＤ駆動方法において、 リセットパルスおよびサンプルホールドパルスの各タイ
ミング位置をクロックに対して所定の範囲内で変更し、 変更されたリセットパルスおよびサンプルホールドパル
スのタイミング位置ごとにＣＣＤ出力の多値データをメ
モリに記憶し、 メモリに記憶されているリセットパルスおよびサンプル
ホールドパルスの各タイミング位置ごとの多値データを
解析してそれぞれのタイミング位置におけるＣＣＤのセ
ンサ動作特性を求め、さらに求めたセンサ動作特性を比
較して最適のリセットパルスおよびサンプルホールドパ
ルスのタイミング位置を決定し、 決定した最適のリセットパルスおよびサンプルホールド
パルスのタイミング位置に基づいてリセットパルスおよ
びサンプルホールドパルスを発生し、ＣＣＤを駆動して
動作させることを特徴とするＣＣＤ駆動方法。 - 【請求項２】 クロック、リセットパルス、サンプルホ
ールドパルスからなるＣＣＤ駆動パルスを発生しＣＣＤ
に供給するＣＣＤ駆動装置において、 リセットパルスおよびサンプルホールドパルスの各タイ
ミング位置をそれぞれクロックに対して所定の範囲内で
変更するタイミング変更手段と、 タイミング変更手段により変更されたリセットパルスお
よびサンプルホールドパルスの種々のタイミング位置で
のＣＣＤ出力の多値データを記憶する多値データ記憶手
段と、 タイミング変更手段に指示してリセットパルスおよびサ
ンプルホールドの各タイミング位置を所定の範囲内で変
更させ、リセットパルスおよびサンプルホールドパルス
の種々のタイミング位置でのＣＣＤ出力の多値データに
ついてそれぞれのセンサ動作特性を解析し、リセットパ
ルスおよびサンプルホールドパルスの最適なタイミング
位置を求めてそのデータを記憶する特性解析手段と、 記憶されたリセットパルスおよびサンプルホールドパル
スの最適なタイミング位置のデータに基づいてタイミン
グ変更手段に指示し、当該最適なタイミング位置でリセ
ットパルスおよびサンプルホールドパルスを発生し、Ｃ
ＣＤに供給させるＣＣＤ駆動制御手段と、 を備えていることを特徴とするＣＣＤ駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6039401A JP2916365B2 (ja) | 1994-03-10 | 1994-03-10 | Ｃｃｄ駆動方法およびｃｃｄ駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6039401A JP2916365B2 (ja) | 1994-03-10 | 1994-03-10 | Ｃｃｄ駆動方法およびｃｃｄ駆動装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07250288A true JPH07250288A (ja) | 1995-09-26 |
| JP2916365B2 JP2916365B2 (ja) | 1999-07-05 |
Family
ID=12551977
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6039401A Expired - Lifetime JP2916365B2 (ja) | 1994-03-10 | 1994-03-10 | Ｃｃｄ駆動方法およびｃｃｄ駆動装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2916365B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008135908A (ja) * | 2006-11-28 | 2008-06-12 | Matsushita Electric Ind Co Ltd | 位相調整装置、デジタルカメラおよび位相調整方法 |
| JP2008182314A (ja) * | 2007-01-23 | 2008-08-07 | Matsushita Electric Ind Co Ltd | 位相調整装置およびその関連技術 |
| US7791658B2 (en) | 2004-10-11 | 2010-09-07 | Media Tek Singapore Pte Ltd. | Analog front end timing generator (AFE/TG) having a bit slice output mode |
-
1994
- 1994-03-10 JP JP6039401A patent/JP2916365B2/ja not_active Expired - Lifetime
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7791658B2 (en) | 2004-10-11 | 2010-09-07 | Media Tek Singapore Pte Ltd. | Analog front end timing generator (AFE/TG) having a bit slice output mode |
| JP2008135908A (ja) * | 2006-11-28 | 2008-06-12 | Matsushita Electric Ind Co Ltd | 位相調整装置、デジタルカメラおよび位相調整方法 |
| JP2008182314A (ja) * | 2007-01-23 | 2008-08-07 | Matsushita Electric Ind Co Ltd | 位相調整装置およびその関連技術 |
| US8089539B2 (en) | 2007-01-23 | 2012-01-03 | Panasonic Corporation | Phase adjusting device and related art thereof |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2916365B2 (ja) | 1999-07-05 |
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