JPH07209032A - 素子およびその作製方法 - Google Patents

素子およびその作製方法

Info

Publication number
JPH07209032A
JPH07209032A JP1220194A JP1220194A JPH07209032A JP H07209032 A JPH07209032 A JP H07209032A JP 1220194 A JP1220194 A JP 1220194A JP 1220194 A JP1220194 A JP 1220194A JP H07209032 A JPH07209032 A JP H07209032A
Authority
JP
Japan
Prior art keywords
thin film
substrate
base
diamond thin
diamond
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP1220194A
Other languages
English (en)
Other versions
JP3353987B2 (ja
Inventor
Baitokusu Rimantasu
バイトクス リマンタス
Takashi Inushima
喬 犬島
Shinya Sumino
真也 角野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Priority to JP01220194A priority Critical patent/JP3353987B2/ja
Priority to US08/366,573 priority patent/US5622586A/en
Publication of JPH07209032A publication Critical patent/JPH07209032A/ja
Application granted granted Critical
Publication of JP3353987B2 publication Critical patent/JP3353987B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/683Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping
    • H01L21/6835Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
    • GPHYSICS
    • G01MEASURING; TESTING
    • G01FMEASURING VOLUME, VOLUME FLOW, MASS FLOW OR LIQUID LEVEL; METERING BY VOLUME
    • G01F1/00Measuring the volume flow or mass flow of fluid or fluent solid material wherein the fluid passes through a meter in a continuous flow
    • G01F1/68Measuring the volume flow or mass flow of fluid or fluent solid material wherein the fluid passes through a meter in a continuous flow by using thermal effects
    • G01F1/684Structural arrangements; Mounting of elements, e.g. in relation to fluid flow
    • G01F1/6845Micromachined devices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/48Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
    • H01L21/4814Conductive parts
    • H01L21/4871Bases, plates or heatsinks
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/373Cooling facilitated by selection of materials for the device or materials for thermal expansion adaptation, e.g. carbon
    • H01L23/3732Diamonds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/93Batch processes
    • H01L24/95Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips
    • H01L24/97Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips the devices being connected to a common substrate, e.g. interposer, said common substrate being separable into individual assemblies after connecting
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2221/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof covered by H01L21/00
    • H01L2221/67Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere
    • H01L2221/683Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping
    • H01L2221/68304Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
    • H01L2221/68345Apparatus for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support used as a support during the manufacture of self supporting substrates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/4501Shape
    • H01L2224/45012Cross-sectional shape
    • H01L2224/45015Cross-sectional shape being circular
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45144Gold (Au) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/4911Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/93Batch processes
    • H01L2224/95Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips
    • H01L2224/97Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips the devices being connected to a common substrate, e.g. interposer, said common substrate being separable into individual assemblies after connecting
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L24/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01005Boron [B]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01006Carbon [C]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01007Nitrogen [N]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01013Aluminum [Al]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01014Silicon [Si]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01015Phosphorus [P]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01019Potassium [K]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01023Vanadium [V]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01047Silver [Ag]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01072Hafnium [Hf]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01074Tungsten [W]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/10251Elemental semiconductors, i.e. Group IV
    • H01L2924/10253Silicon [Si]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/12Passive devices, e.g. 2 terminal devices
    • H01L2924/1204Optical Diode
    • H01L2924/12042LASER
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15153Shape the die mounting substrate comprising a recess for hosting the device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1517Multilayer substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/1901Structure
    • H01L2924/1904Component type
    • H01L2924/19043Component type being a resistor
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19107Disposition of discrete passive components off-chip wires
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/301Electrical effects
    • H01L2924/3025Electromagnetic shielding
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10STECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10S148/00Metal treatment
    • Y10S148/135Removal of substrate
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10STECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10S156/00Adhesive bonding and miscellaneous chemical manufacture
    • Y10S156/918Delaminating processes adapted for specified product, e.g. delaminating medical specimen slide
    • Y10S156/919Delaminating in preparation for post processing recycling step
    • Y10S156/922Specified electronic component delaminating in preparation for recycling
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T156/00Adhesive bonding and miscellaneous chemical manufacture
    • Y10T156/11Methods of delaminating, per se; i.e., separating at bonding face

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Manufacturing & Machinery (AREA)
  • Materials Engineering (AREA)
  • Chemical & Material Sciences (AREA)
  • Fluid Mechanics (AREA)
  • Measuring Volume Flow (AREA)
  • Testing Or Calibration Of Command Recording Devices (AREA)

Abstract

(57)【要約】 【目的】 取扱が難し10μm以下のダイヤモンド薄膜
を用いた素子の作製を容易にする。 【構成】 シリコン基板102上に気相合成法によりダ
イヤモンド薄膜101を5μm程度の厚さに成膜する。
そしてパラフィン104を塗布し、しかる後に基板10
2を弗酸等によって除去する。こうしてパラフィン10
4を基体としてダイヤモンド薄膜101が保持される。
その後ダイヤモンド薄膜表面に必要とする回路を形成
し、最後にパラフィン104を除去することにより、ダ
イヤモンド薄膜101を用いた素子が完成する。このよ
うな構成は、ダイヤモンド薄膜を用いて熱的な影響を計
測する素子、例えば流量計測素子の作製に利用すること
ができる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、薄膜材料を用いた素子
(デバイス)の構成、およびその作製方法に関する。例
えば、流体の流量を計測する流体計測センサーの構成お
よびその作製方法に関する。
【0002】
【従来の技術】流量を計測する装置(一般にフローセン
サーと呼ばれる)として、サーミスタを利用したものが
知られている。これは、流体によって熱量が奪われるこ
とによって、サーミスタ部分の温度が低下することを利
用したものである。一般にサーミスタ部分が流体に接し
ていると、サーミスタ部分から奪われる熱量は、流量
(または流速)に依存する。従って、サーミスタからの
出力と流量とはある相関関係を持つ。このことを利用し
て、サーミスタの出力より、流量を算出することができ
る。
【0003】流量は流体の断面積と流速との積であり、
例えば、内径rの円形パイプ内を流速vの流体が流れて
いるとするならば、vπr2 (単位は例えばリッル/分
となる)が流量になる。従って、流体の断面積が分かっ
ているのならば、流量と流速は同時に求めることができ
る。
【0004】一般にサーミスタは、大きな負の温度係数
を有する半導体のことをいう。しかし、本来サーミスタ
とは、熱に敏感な抵抗体(Thermally Sensitive Resist
or)のことであり、特に温度係数の正負や材料によって
限定されるものではない。従って、正の温度係数を有す
る白金等の金属をサーミスタと称してもよい。
【0005】サーミスタのように、温度によって抵抗が
変化する材料を用いた素子を総称して、測温抵抗体や温
度感知素子、さらには感温素子や抵抗温度計という。ま
た、温度によって抵抗が変化する材料のことをサーミス
タ機能を有する材料ということもできる。以下において
は、温度によって抵抗が変化する材料のことを測温抵抗
体という。
【0006】また流量計測の方法としては、上記のよう
にサーミスタを用いる構成以外に、ジュール熱によって
発熱させた抵抗発熱体を流体に曝し、流量に依存して、
当該抵抗発熱体から熱量が奪われることを利用する方式
もある。この方式では、抵抗発熱体に流れる電流を計測
することによって、流量を算出することができる。
【0007】また、流体に接した発熱体から熱量を流体
に奪わせ、流体によって運ばれる熱量を別個に設けられ
た測温抵抗体(例えば白金センサー)によって計測し、
流量を算出する方式もある。
【0008】これら従来より公知の流量センサーは、計
測範囲が1桁〜2桁と小さいという問題がある。
【0009】〔発明の背景〕本発明者らは、高熱伝導率
を有するダイヤモンド薄膜を用いた流量センサーを作製
し、窒素ガスを用いた流量計測を行った。このダイヤモ
ンド流量センサーは、数μ厚、数mm角のダイヤモンド
薄膜に白金薄膜よりなる発熱体と測温抵抗体とを設けた
構成を有する。
【0010】計測に当たっては、ダイヤモンド薄膜を極
力熱的に浮かした状態に保持し、ダイヤモンド薄膜を流
体に接触させ、ダイヤモンド薄膜に対し発熱体よりパル
ス状の加熱を行う。そしてこの際のダイヤモンド薄膜の
温度変化を測温抵抗体で計測する。
【0011】この際、ダイヤモンド薄膜がパルス状の加
熱によって急速に加熱され、そして冷却される。これに
対応して測温抵抗体からの出力は、急速に変化し、そし
て元の値に戻る。即ち、測温抵抗体からはある応答波形
が出力される。この波形の面積は、正確に流量に対応す
るので、パルス状の加熱を行う毎に測温抵抗体から出力
される応答波形の面積を計算することで、流量計測を行
うことができる。
【0012】具体的には、4秒毎に0.18秒のパルス
加熱を行い、その際に応答波形の面積を計算すること
で、4秒毎の流量計測を行うことができる。実際の流量
計測は、数十sccm〜数十万sccmまでの広い範囲
に渡って流量計測を行うことができた。これは従来より
の流量計測装置、例えばマスフローメータに比較して極
めて高ダイナミックレンジを有するものといえる。
【0013】上記のような構成は、パルス状の加熱に対
するダイヤモンド薄膜の応答特性より流量を算出するも
のであるといえる。パルス状の加熱に対するダイヤモン
ド薄膜の応答特性は、ダイヤモンド薄膜が周囲から受け
る熱的な影響を反映したものであると理解することがで
きる。
【0014】上記の流量計測の原理は以下のようにして
理解することができる。流体(フロー)がダイヤモンド
薄膜に接すると、ダイヤモンド薄膜から流体の流量に対
応した所定の熱量が奪われる。言い換えれば、ダイヤモ
ンド薄膜は、流体の流量に対応した熱的な影響を流体よ
り受けることとなる。この熱的な影響は、パルス状の加
熱に際する熱的な応答特性に反映される。この応答特性
は、パルス状の加熱に対するダイヤモンド薄膜の加熱の
され方と冷却のされ方として観察される。
【0015】この応答特性はダイヤモンド薄膜が周囲か
ら受ける熱的な影響を反映したものであり、またこの熱
的な影響はダイヤモンド薄膜に接して流れる流体の流量
に対応したものであるから、結果として上記応答特性は
ダイヤモンド薄膜に接して流れる流体の流量に対応した
ものとなる。
【0016】上記の議論は、ダイヤモンド薄膜が受ける
熱的な影響が当該ダイヤモンド薄膜に接して流れる流体
の流量によるものであるとした理想的な仮定を前提とし
た場合のものである。
【0017】しかしながら、薄膜材料を流体に接しさ
せ、その流量を計測する場合、薄膜材料が受ける熱的な
影響は、 (1)薄膜材料と流体との間に行われる熱的な作用によ
るもの。 (2)薄膜材料から該薄膜材料を保持する基体に流出す
る熱量によるもの。 (3)薄膜材料からリード(配線)を経て流出する熱量
によるもの。 に分けることができる。
【0018】流量センサーに必要なのは、(1)による
影響のみである。(2)、(3)による影響は極力排除
する必要がある。従って、薄膜材料から、流体以外に熱
量が流出しない構成を実現する必要がある。即ち、当該
薄膜材料を熱的に絶縁して保持し、当該薄膜材料が受け
る熱的な影響を主に当該薄膜に接して流れる流体による
ものとすることが重要となる。
【0019】また薄膜材料としては、ダイヤモンド薄膜
を用いることが極めて有用であるが、ダイヤモンド薄膜
を所定の素子形状に加工することは困難である。例えば
厚さ5μm以下のダイヤモンド薄膜は、ピンセットで摘
むことも困難である。
【0020】薄膜ダイヤモンドを加工する方法として、
レーザー光の照射による方法が知られている。例えば
「NEW DAIMOND,Vol6 No2 p36」、「精密工学会誌 56/1
2/1990」にYAGレーザー光によるCVDダイヤモンド
薄膜の切断について報告されている。
【0021】しかしながら気相法によりダイヤモンド薄
膜をシリコンウエハー上に形成し、しかる後にYAGレ
ーザー光の照射による加工した場合、ダイヤモンド薄膜
が剥離したり割れたりしてしまうという問題がある。こ
れは、シリコンウエハーとダイヤモンド薄膜との間にお
いて応力が働くためである。
【0022】またダイヤモンド薄膜を利用した素子を作
製せんとする場合、ダイヤモンド薄膜表面に電子装置や
回路を形成する必要があるが、機械的に不安定な状態に
あるダイヤモンド薄膜に対してその表面に電子装置や回
路を形成することは困難である。即ち、シリコンウエハ
ー上に形成されたダイヤモンド薄膜の表面に電子装置や
回路を形成することは困難である。
【0023】この問題は、シリコンウエハー以外の種類
の基板やダイヤモンド薄膜の作製条件を選択することに
より、改善することは可能であるが、基本的には解決す
ることができない。またダイヤモンド薄膜の厚さを10
0μm以上の厚さとし、膜単体の強度を高くすることも
考えられるが、膜厚を厚くすることはコスト的に好まし
くない。
【0024】〔発明が解決しようとする課題〕本発明
は、その強度が問題となる薄膜材料を用いた素子および
その作製方法を提供することを目的とする。特に薄膜材
料としてダイヤモンド薄膜を用いた素子の構成およびそ
の作製方法を提供することを目的とする。
【0025】〔課題を解決するための手段〕本発明の主
要な発明は、第1の基体上に薄膜を形成する工程と、前
記薄膜上に第2の基体を接着する工程と、前記第1の基
体を除去する工程と、露呈した前記薄膜の表面に電子装
置を形成する工程と、前記薄膜を所定の形状に切断する
工程と、前記第2の基体を所定の形状に切断する工程
と、を有することを特徴とする。
【0026】上記構成において、第1の基体としては、
例えばシリコンウエハーを挙げることができる。この第
1の基体は、薄膜が形成される被形成材料となる。薄膜
としては、ダイヤモンド薄膜を挙げることができる。
【0027】ダイヤモンド薄膜はその膜厚方向であれ
ば、1000Wm-1-1(300K)以上の熱伝導率を
期待することができ、熱的な影響を計測する素子(例え
ば流量計測センサー)に利用するには最適な材料であ
る。熱的な影響を計測する素子において、ダイヤモンド
以外の材料を用いる場合は、その熱伝導率がなるべく高
いのを用いる必要がある。例えば、炭化珪素、窒化ホウ
素、窒化アルミ、珪素等を利用することができる。この
薄膜材料としては、単結晶珪素(148Wm-1-1(3
00K))以上の熱伝導率を有する材料を用いること
が、高速動作を行なう観点からは好ましい。一方、高速
応答が必要とされないなら、熱伝導率の低いセラミック
ス材料や酸化物、さらには窒化物をこの薄膜材料として
用いてもよい。
【0028】薄膜の形成方法としては、CVD法(気相
法)による方法を挙げることができる。薄膜としてダイ
ヤモンド薄膜を用いる場合、その成膜速度が遅いので、
その厚さを厚くすることは不利である。機械的な強度や
熱容量を考慮した場合、5μm程度の厚さが確保できれ
ばよい。機械的な強度が確保できるならば、1μm程度
の薄さとしてもよい。もちろんコストを問題としなけれ
ば、その膜厚を10μm以上の厚さとしてもよい。
【0029】第2の基体は、薄膜の加工工程において、
薄膜を仮に保持する基体として機能する。この薄膜を第
2の基体に接着するのは、後に薄膜と第2の基体とを分
離する必要があるからである。またこのようにすると、
薄膜と第2の基体との間に応力が働かない構成とするこ
とができる。この第2の基体上において少なくとも1つ
のユニットを形成することができる。
【0030】本発明の主要な他の構成は、第1の基体上
に薄膜を形成する工程と、前記薄膜上に第2の基体を接
着する工程と、前記第1の基体を除去する工程と、露呈
した前記薄膜の表面に回路を形成する工程と、前記第2
の基体と該基体上の薄膜とを所定の形状に切断し、前記
第2の基板上に少なくとも1つのユニットを形成する工
程と、第3の基体に前記ユニットを保持させる工程と、
前記第2の基体を除去する工程と、により前記第3の基
体に保持された少なくとも1つのユニットを形成するこ
とを特徴とする。
【0031】上記構成において、第1の基体と第2の基
体とについては前述の通りである。この構成を用いて流
量計測センサーを作製する場合には、第3の基体とし
て、熱伝導率の低い熱的に絶縁物と見なせる材料を用い
ることが重要である。この第3の基体は実際に薄膜材料
を保持するためのものである。熱的な影響を計測するセ
ンサーを構成する場合いには、この第3の基体の熱伝導
率をK2 、薄膜材料の熱伝導率をK1 として、少なくと
もK2 ≧100K1 であることが必要である。また薄膜
材料が受ける熱的な影響をさらに正確に評価するために
は、K2 ≧1000K1 であることが必要とされる。
【0032】例えば薄膜として熱伝導率が1000Wm
-1/K(300K)近くあるいはそれ以上であるダイヤ
モンド薄膜を用い、第3の基体として熱伝導率が1Wm
-1/K(300K)以下であるテフロンを用い、当該ダ
イヤモンド薄膜に接して流れる流体の流量を計測する場
合、極めて高精度に3桁以上のダイナミックレンジで窒
素流量の計測が行なえることが確認されている。このよ
うな特性は、基体の熱伝導率がダイヤモンド薄膜の熱伝
導率に比較して1/1000以下であり、ダイヤモンド
薄膜が流体から受ける熱的な影響を正確に評価できるた
めであると考えられる。テフロン以外の材料としては、
ポリカーボネイトやアクリルさらには各種セラミックス
や各主プスチック材料や樹脂材料を用いることができ
る。何れの場合に、固い、熱に強い、その熱伝導率が小
さい、といった条件を満たす材料を用いることが好まし
い。
【0033】また本発明の他の主要な構成は、発熱体と
測温抵抗体とがその表面に設けられた薄膜と、電極およ
び配線とが設けられた熱の絶縁物からなる基体と、を有
し、前記発熱体と前記測温抵抗体とは前記基体に設けら
れた電極に導電性の接着剤でもって接続されており、前
記接続部分によって前記薄膜が基体に保持されている構
成を基本的な特徴とする。
【0034】上記構成は、薄膜材料が周囲から受ける熱
的な影響を評価する素子、例えば流量計測装置に関する
構成に関するものである。上記構成において、基体は薄
膜材料に対して熱的な絶縁物と見なせる低熱伝導率を有
する材料であることが必要とされる。この薄膜材料が周
囲から受ける熱的な影響を評価する素子の場合、基体の
熱伝導率K2 は薄膜材料の熱伝導率K1 に比較してK1
≧100K2 、さらに好ましくはK1 ≧1000K2
関係を満たすことが必要とされる。即ち、基体は薄膜材
料に比較して熱的に絶縁物と見なせることが必要とされ
る。
【0035】ここで基体の材料となる熱の絶縁物として
は、テフロン等の樹脂材料を用いることが好ましい。ま
た薄膜材料としては、ダイヤモンドに代表される高熱伝
導率を有する材料を用いることが好ましい。
【0036】また上記構成においては、薄膜と基体と
は、基体表面の電極と薄膜の表面に設けられた発熱体や
測温抵抗体(あるいはその電極)とが接触している構成
を特徴としている。薄膜は熱的な影響を計測するための
ものであり、基体との熱的な影響は極力小さくしなけれ
ばならない。従って上記構成のように、薄膜と基体との
接触点を極力少なくする構成は重要である。
【0037】
【実施例】以下の実施例においては、デバイスとして流
量計測センサーの例を、またそのデバイスを構成する薄
膜材料としてダイヤモンド薄膜を用いた例を示すが、ダ
イヤモンド薄膜を用いた他の形式のデバイス作製におい
ても本発明は有効である。またダイヤモンド薄膜以外の
薄膜材料を用いる場合においても有効である。
【0038】「実施例1」本実施例においては、ダイヤ
モンド薄膜を用いた流量センサーを量産するための作製
方法の一例を示す。
【0039】図1に本実施例における作製工程を示す。
まず、図1(A)において、酸化珪素膜103が形成さ
れたシリコン基板102上にダイヤモンド薄膜101を
有磁場マイクロ波プラズマCVD法によって形成する。
成膜条件は以下の通りである。
【0040】基板温度 800℃ 反応圧力 0.25Torr マイクロ波電力 4KW 反応ガス CH3 OH:H2 =1:4 成膜時間 10時間 膜厚 5μm
【0041】プラズマCVD法で形成されたダイヤモン
ド薄膜101の表面は凹凸形状を有している。これは、
被形成面との界面から柱状に結晶成長が行なわれるため
と考えられる。
【0042】上記の成膜条件は、以下の実施例において
共通なものである。また、成膜方法としては、上記の方
法以外の気相合成法を採用することもできる。また、シ
リコン基板102は、酸化珪素被膜103を形成してい
ないものであってもよい。また基板として酸化珪素基板
や他の種類のものを用いてもよい。
【0043】次に図1(B)に示すようにダイヤモンド
薄膜101上にパラフィン104を約1cmの厚さに塗
布する。パラフィン以外の材料としては、エボキシ樹
脂、銀ロウやハンダのような低融点金属を用いることが
できる。
【0044】次にシリコン基板102をHFとHNO3
の溶液によりエッチングして除去する。こうして、図1
(C)(図1(B)と上下が反転している)に示すよう
に、パラフィン104の上にダイヤモンド薄膜101が
存在する状態を得る。この状態においては、パラフィン
104がダイヤモンド薄膜101を保持する基体として
機能している。なおこの状態において、中性洗剤あるい
はアルカリ洗剤による超音波洗を行い、ダイヤモンド薄
膜の表面をクリーニングする。
【0045】この工程において、パラフィン104がシ
リコン基板102の除去と同時に除去されないようなエ
ッチャントを選択する必要がある。即ち、シリコン基板
102のみが除去されるエッチャントを用いる必要があ
る。
【0046】図1(C)に示す状態において、ダイヤモ
ンド薄膜の平滑な面が露呈する。
【0047】次にダイヤモンド薄膜101上にサーミス
タおよびヒータとなる白金(Pt)の薄膜105を、マ
スクによる選択コーティングによって約2000Åの厚
さに形成する。この工程は、スパッタリング法によって
行なう。こうして図1(D)に示す状態を得る。
【0048】次にリードフレームを形成するPCボード
を接着するための接着剤106を印刷法により塗布す
る。(図1(E))
【0049】この接着剤106を用いて、リードフレー
ムとなる電極107が形成されたテフロンボード108
を接着する。(図1(F))
【0050】このテフロンボード108はその厚さが約
100μm厚であり、白金薄膜105を囲うように格子
状の形状を有している。そしてその上にはリードフレー
ムとなる電極107が形成されている。この電極107
はステンレス膜で形成されている。なお、テフロンボー
ドのみを先にダイヤモンド薄膜101上に形成し、その
後電極107を形成してもよい。
【0051】このテフロンボード108は、ダイヤモン
ド薄膜101と電極107との間の熱的な絶縁を行うた
めに必要とされる。従って、ここには十分に熱抵抗が大
きい材料を用いる必要がある。テフロンボード以外の材
料としては、エポキシ材料等の樹脂材料を用いることが
できる。
【0052】次に直径10μmの金線により白金薄膜1
05と電極107とにワイヤボンディング109を行
い、図1(G)に示す状態を得る。ワイヤボンディング
109を行うためのワイヤとしては、なるべく細いもの
を用い、白金薄膜105から熱が伝導しにくくする必要
がある。
【0053】この時点で、ダイヤモンド薄膜101の表
面に流量センサーのユニットが複数形成された状態を得
る。図1(G)に示す状態をダイヤモンド薄膜上面から
みた図を図2に示す。なお符号は図1と同じである。図
1(G)は、図2のA−A’で切断される断面を示して
いる。図2に示されるように、図1(G)に示す状態に
おいて、ダイヤモンド薄膜101を用いてユニットが複
数(図2において点線で区切られた4つ)構成されてい
る。1ユニット内において2つある白金薄膜105の一
方はヒーター、一方はサーミスタ(測温抵抗体)として
動作する。
【0054】図1(G)に示す状態を得た後、図1
(H)に示すように、YAGレーザーの照射による切断
工程によって、流量センサーをユニット毎に切り離す。
(図1(I))
【0055】次にパラフィン104を剥離し、図1
(J)の如く、ダイヤモンド薄膜を用いた1つの流量セ
ンサーユニットが得られる。このパラフィン104の剥
離は、溶剤を用いて容易に行うことができる。このセン
サーユニットは、必要とされる回路がその表面に形成さ
れたダイヤモンド薄膜101をテフロンの基体108で
もって保持した構成を有している。
【0056】〔実施例2〕本実施例は、実施例1で作製
した流量センサーユニットを保持基体に保持させ、この
保持基体を流量を測定する気体や液体等の流体が流れる
パイプ(管)やダクトに設置する構成について説明す
る。なお図3に示されている図1や図2と同じ符号は図
1や図2で示されるのと同じ箇所を示す。
【0057】一つのセンサーユニットの保持の形態を図
3に示す。図3(A)〜(C)は、図1(J)に示す流
量センサーユニットを保持基体に設置した状態を示す。
図において、201はテフロンで構成された保持基体で
あり、この基体201がパイプやダクトに嵌め込まれた
り、その内部に配置されることになる。
【0058】基体201上には電極202が設けられて
おり、センサーからの配線が203で示されるワイヤボ
ンディングによって行なわれる。電極202からは周辺
回路へとさらに配線が接続される。また流体の流れは2
00で示されるようにダイヤモンド薄膜101の凹凸を
有した面、即ち回路が形成されていない面側を流れるこ
とになる。
【0059】ここで、基体201をテフロンで構成する
のは、ダイヤモンド薄膜101からの熱量の流出を極力
抑えるためである。従って、基体201をテフロン以外
の材料で構成しようとする場合には、極力熱伝導率の小
さい材料を用いる必要がある。
【0060】以下に図3(A)〜(C)に示す実施態様
について説明する。まず(A)は、基体201の外側に
流量センサーユニットを設置した例である。この場合、
ダイヤモンド薄膜101と基体201との接触面積は極
力小さくする必要がある。これは、ダイヤモンド薄膜1
01から基体201への熱の流出、言い換えるならばダ
イヤモンド薄膜101と基体201との熱的な相互作用
を極力小さくする必要があるためでる。こうすることに
よって、ダイヤモンド薄膜が流体の流れ200から受け
る熱的な影響を正確に評価することができる。本実施例
においては、ダイヤモンド薄膜101と基体201とは
樹脂系の接着剤によって接着される。
【0061】図3(A)に示す構成は、作製が容易に行
なえるという有用性がある。しかし、センサーが凹部の
窪んだ底の部分に設けられることになるため、センサー
ユニットを構成するダイヤモンド薄膜101の表面に接
する流体の流れ200が変化しやすく、精密な測定には
向かないという不利な点がある。
【0062】図3(B)に示す構成は、基体201とダ
イヤモンド薄膜101とがほぼ同一平面を形成する構成
とした例である。この場合、流体の流れを乱す要因が無
いので、精密な流量計測を行うことができる。しかし、
センサーユニットを基体201に嵌め込む必要があるの
で、正確な寸法合わせが要求されるという問題がある。
【0063】図3(C)の構成は、基体201の流体に
接する面にセンサーユニットを張りつけた例である。こ
の構成は、精密な測定が可能で、また設置も容易であ
る。
【0064】図3(B)および(C)では、ワイヤボン
ディングにより電極107と電極202とを接続してい
るが、図4(A)、(B)の点線400で示すように基
体201の中に配線を形成してもよい。
【0065】例えば図4(A)に示す構成を立体的に見
ると、図5に示すような構成となる。なお図5において
は、電極202を設けずに直接配線500を引き出す構
成が示されている。
【0066】〔実施例3〕本実施例は、ワイヤボンディ
ングを行わずに流量センサーを作製する例である。まず
図6(A)に示すように、シリコン基板601上に5μ
m厚のダイヤモンド薄膜を実施例1で示した有磁場マイ
クロ波プラズマCVD法で形成する。
【0067】次に仮止め接着剤によって0.5μm厚の
ガラス基板603を張り合わせる。この接着剤は、加熱
や溶剤によって除去できるタイプを用いる。(図6
(B))ここでは、仮止め接着剤としてアレムコの仮止
め接着剤(クリスタルボンド509)を用いた。この接
着剤は、アセトンに溶解するので、仮止め接着の後に容
易に取り除くことができる。その他、接着後に加熱によ
り溶解するタイプのものやメタノール等に溶解するタイ
プのものを用いることができる。
【0068】ガラス基板は後の工程において、2mm角
に切断する必要があるので、60で示されるように予め
スクライブ(罫書)し、2mm各の格子状に溝を形成し
ておく。
【0069】ガラス基板を用いるのは以下の条件を満た
すからである。 (1)後の工程において、シリコン基板601をフッ硝
酸により除去する必要があるが、この際に603で示さ
れる基板が残存する必要がる。そのため、耐フッ酸性を
有した材料が必要とされる。 (2)基板603は、ダイヤモンド薄膜を仮に保持する
基体として用いられる。そのため、機械的強度が必要と
される。 もちろん、上記(1)、(2)の条件を満たすならばガ
ラス基板以外の材料を用いてもよい。
【0070】次に、シリコン基板601をフッ硝酸によ
って除去することにより、図6(C)に示す状態を得
る。図6(C)は、図6(A)、(B)とは上下が逆に
なった状態を示している。
【0071】そして、所定のパターンを有したマスクを
配置してスパッタリングを行い、白金で構成される回路
を形成する。その結果、図7に示すような回路パターン
がダイヤモンド薄膜602上に形成される。
【0072】この回路パターンは、71で示す2mm角
の中に一対の電極605を結ぶ白金パターン600と、
一対の電極606を結ぶ白金パターン604とで構成さ
れている。ここで、電極605と606とは白金で構成
されている。電極605、606は200μm角を大き
さを有する。この2mm各のダイヤモンド薄膜が1つの
流量センサーユニットとなる。
【0073】図7において、600が発熱体であり、6
04がサーミスタとして機能する測温抵抗体である。両
者は、その抵抗値を制御することで必要とする機能が与
えられる。抵抗値の制御は、その面積を制御することで
行われる。また抵抗値の制御は、白金薄膜の厚さを変え
ることでも制御することができる。
【0074】回路パターンの形成の後、図6(C)の6
2で示すレーザー光の照射による切断を行う。この工程
で、ダイヤモンド薄膜602を2mm角の形状にカット
する。この工程は、YAGレーザーを用いて行う。YA
Gレーザーはガラス基板を透過するので、ダイヤモンド
薄膜602、ダイヤモンド薄膜602とガラス基板60
3とを接着している仮止め接着剤、さらにはダイヤモン
ド薄膜602上に形成された回路パターンが同時に切断
される。この工程で発熱体600と測温抵抗体604、
さらにはそれらの電極がその表面に形成された2mm角
のダイヤモンド薄膜が得られる。この段階で、同一ガラ
ス基板上に2mm各に分離された複数のダイヤモンド薄
膜が仮止め接着剤によって接着されている状態を得る。
【0075】上記工程において、予めガラス基板603
に対して行ったスクライブライン60とレーザー光60
0による切断部分61とが一致するようにしなければな
らない。
【0076】なお、ダイヤモンド薄膜602が波長約1
μmのYAGレーザーで切断できるのは、ダイヤモンド
薄膜602が多結晶膜であり、粒界中の不純物が1μm
の光を吸収して発熱するためである。またYAGレーザ
ー以外のレーザー光を用いるのでもよい。
【0077】YAGレーザーの照射による分離工程が終
了した後、ガラス基板603をダイヤモンド薄膜の切断
されたパターンに沿って機械的に切断する。こうして図
7の73で示される状態を得る。即ち、0.5mm厚で
2mm角のガラス基板上に1つのセンサーユニットであ
る5μm厚でその表面に600で示される発熱体と60
4で示される測温抵抗体とそれらの電極とを有したダイ
ヤモンド薄膜が仮止め接着剤で接着されている状態が得
られる。
【0078】ここで、上記2mm角のセンサーユニット
を保持する基体について図8を用いて説明する。図8に
おいて、607が1mm厚のテフロンで構成された基体
である。この基体は615で示される中央部がくり抜か
れている。そして、一対の電極608、609と61
0、611とが設けられている。そして、電極608と
610、さらには電極609と611とは配線パターン
612、613とによって接続されている。電極610
と611とは、基体607の裏面側に形成されている。
即ち、電極608と609とが形成されている面とは反
対側の面に形成されている。なお基体607を構成する
材料としてテフロン以外の材料を用いる場合には、その
熱伝導率が極力小さいものを用いることが必要である。
【0079】電極608と609の寸法は100μm角
である。また電極610と611との寸法は300μm
角である。また配線パターン613の幅は100μmで
ある。また配線613の厚さは5000Åである。
【0080】この配線パターン613、特に電極60
8、609と同じ面に形成された配線パターンは、必要
な限り細く、またその厚さを薄くする必要がある。これ
は、この部分での熱伝導を極力少なくするためである。
【0081】図7の73で示される状態を得た後、図9
に示すように、図8に示す基体607と1つのセンサー
ユニットとを結合させる。この段階においては、仮接着
されたガラス基板603が1つのセンサーユニットであ
る2mm角に切断されたダイヤモンド薄膜602を保持
する基体の機能を果たしている。
【0082】基体とセンサーユニットとの結合は、UV
硬化型の導電性樹脂によってセンサーユニット側の電極
606と基体側の電極608とを、またセンサーユニッ
ト側の電極605と基体側の電極609とを接続するこ
とによって行われる。センサーユニットと基体607と
の接触点は、605と606、608と609で示され
る電極の部分のみとなる。
【0083】その後、ダイヤモンド薄膜602とガラス
基板603とを仮接着している仮止め接着剤を加熱ある
いは溶剤によって除去、あるいは接着能力を失わせるこ
とによって、ガラス基板603を取り除く。こうして図
10〜図12に示す流量計測センサーを完成させる。こ
の流量計測センサーは、テフロンの基体607に保持さ
れており、電極610、611に配線を行うことで、流
量計測センサーとして機能させることができる。
【0084】図10と図11は同じ角度から見た図であ
るが、図10は影になる部分を点線によって示してあ
る。また図12は図10を裏表逆に示したものである。
【0085】図10〜図12に示す構成においては、6
14で示される間隙(空隙)を有している。この間隙は
幅は約500μmである。この間隙はダイヤモンド薄膜
602に圧力が加わることを防ぐためのものである。即
ち、ダイヤモンド薄膜の両面に均等に圧力が加わるよう
機能する。
【0086】図10〜図12に示す構成は、ダイヤモン
ド薄膜602と基体607との接触部分が電極同士の接
触部分のみとなるので、ダイヤモンド薄膜602から基
体607に流出する熱量、およびダイヤモンド薄膜60
2からリード(配線)を介して流出する熱量を最小にす
ることができる。
【0087】前述のように、薄膜材料を用いた流量計測
センサーにおいて、薄膜材料が受ける熱的な影響は、 (1)流体に関係するもの (2)基体に関係するもの (3)リード(配線)に関係するもの に分けることができる。
【0088】流量計測において必要とされるのは、
(1)による影響のみである。従って(2)、(3)に
よる影響は極力排除する必要がある。本実施例の構成を
採った場合、この(2)、(3)の影響を最小限に抑え
ることができるので、極めて高性能な流量センサーを得
ることができる。また、ワイヤボンディングを行わない
で作製することができるので、その生産性を高くするこ
とができる。さらにデバイスとしての信頼性を高くする
ことができる。特に本実施例で示した素子の作製方法
は、その強度が問題となるダイヤモンド薄膜の厚さが1
0μm以下である場合に有効である。
【0089】〔実施例4〕本実施例は、実施例3に示す
流量計測センサーの作製方法において、ダイヤモンド薄
膜602を仮に保持する基板603として、ダイヤモン
ド薄膜を切断するためのレーザー光を吸収する基板を用
いる例である。レーザー光を吸収できる基板を用いた場
合、基板をレーザー光で切断することができる。従っ
て、図6(C)の段階において、仮の基体である基板6
03とその上に接着剤によって保持されたダイヤモンド
薄膜602もろともレーザー光の照射によって切断する
ことができる。レーザー光としては、例えばYAGレー
ザーを用いることができる。
【0090】本実施例において基板603として用いる
ことのできる材料は、 (1)耐酸性 (2)機械的な強度 (3)使用されるレーザー光を吸収し、レーザー光によ
り切断可能なこと といった性質を有していることが必要とされる。
【0091】上記(1)〜(3)の条件を満たす材料で
あれば、基板603の種類として特に限定されるもので
はない。この(1)〜(3)の条件を満たす材料として
は、遮光用の用途や熱線を吸収する用途に用いられるリ
ン酸塩ガラスを用いることができる。
【0092】
【発明の効果】本発明の構成を採用することで、薄膜材
料を用いた素子の生産性や信頼性を高くすることができ
る。特にその強度に大きな問題のあったダイヤモンド薄
膜を用いた素子の作製を実用的に行うことができ、ダイ
ヤモンドデバイスの生産性や信頼性を大きく高めること
ができる。
【図面の簡単な説明】
【図1】 実施例の作製工程を示す。
【図2】 図1(F)の上面図を示す。
【図3】 実施例の構成を示す。
【図4】 実施例の構成を示す。
【図5】 実施例の構成を示す。
【図6】 実施例の作製工程を示す。
【図7】 実施例の構成を示す。
【図8】 センサーユニットを保持する基体の構成を
示す。
【図9】 センサーユニットと基体との結合の状態を
示す。
【図10】 実施例の構成を示す。
【図11】 実施例の構成を示す。
【図12】 実施例の構成を示す。
【符号の説明】
101・・・・・ダイヤモンド薄膜 102・・・・・シリコン基板 103・・・・・酸化珪素膜 104・・・・・パラフィン 105・・・・・白金薄膜 106・・・・・接着剤 107・・・・・電極 108・・・・・テフロンボード 109・・・・・ワイヤボンディング 201・・・・・基体 202・・・・・電極 203・・・・・ワイヤボンディング 200・・・・・流体の流れ 400・・・・・配線 500・・・・・配線 601・・・・・シリコン基板 602・・・・・ダイヤモンド薄膜 603・・・・・ガラス基板 60・・・・・・スクライブライン 605・・・・・電極 600・・・・・発熱体を構成する白金パターン 604・・・・・測温抵抗体を構成する白金パターン 62・・・・・・レーザー光 607・・・・・テフロン製の基体 615・・・・・くりぬかれた部分 608・・・・・電極 609・・・・・電極 610・・・・・電極 611・・・・・電極 612・・・・・配線パターン 613・・・・・配線パターン 614・・・・・間隙

Claims (13)

    【特許請求の範囲】
  1. 【請求項1】 第1の基体上に薄膜を形成する工程と、 前記薄膜上に第2の基体を接着する工程と、 前記第1の基体を除去する工程と、 露呈した前記薄膜の表面に回路を形成する工程と、 前記薄膜を所定の形状に切断する工程と、 前記第2の基体を所定の形状に切断する工程と、 前記第2の基体を除去する工程と、 を有する素子作製方法。
  2. 【請求項2】 第1の基体上に薄膜を形成する工程と、 前記薄膜上に第2の基体を接着する工程と、 前記第1の基体を除去する工程と、 露呈した前記薄膜の表面に回路を形成する工程と、 前記第2の基体と該基体上の薄膜とを同時に所定の形状
    に切断する工程と、 前記第2の基体を除去する工程と、 を有する素子作製方法。
  3. 【請求項3】 請求項1または請求項2において、 薄膜はダイヤモンド薄膜であることを特徴とする素子作
    製方法。
  4. 【請求項4】 請求項1または請求項2において、 薄膜はダイヤモンド薄膜であり、その厚さが10μm以
    下であることを特徴とする素子作製方法。
  5. 【請求項5】 請求項1または請求項2において、 薄膜はダイヤモンド薄膜であり、切断はレーザー光の照
    射によって行われることを特徴とする素子作製方法。
  6. 【請求項6】 第1の基体上に薄膜を形成する工程と、 前記薄膜上に第2の基体を接着する工程と、 前記第1の基体を除去する工程と、 露呈した前記薄膜の表面に回路を形成する工程と、 前記第2の基体と該基体上の薄膜とを所定の形状に切断
    し、前記第2の基体上に少なくとも1つのユニットを形
    成する工程と、 第3の基体に前記ユニットを保持させる工程と、 前記第2の基体を除去する工程と、 により前記第3の基体に保持された少なくとも1つのユ
    ニットを形成することを特徴とする素子作製方法。
  7. 【請求項7】 少なくとも一方の表面に複数の電極が形
    成されたダイヤモンド薄膜と、 少なくとも一方の表面に複数の電極が形成された基体
    と、 を有する素子であって、 前記ダイヤモンド薄膜表面に形成された少なくとも一つ
    の電極と前記基体表面に形成された少なくとも一つの電
    極とが導電性の接着剤によって接続されており、 前記接続部分によって、前記ダイヤモンド薄膜は前記基
    体に保持されていることを特徴とする素子。
  8. 【請求項8】 発熱体と測温抵抗体とがその表面に設け
    られたダイヤモンド薄膜と、 電極および配線とが設けられた熱の絶縁物からなる基体
    と、 を有し、 前記発熱体と前記測温抵抗体とは前記基体に設けられた
    電極に導電性の接着剤でもって接続されており、 前記接続部分によって前記ダイヤモンド薄膜が基体に保
    持されていることを特徴とする素子。
  9. 【請求項9】 発熱体と測温抵抗体とがその表面に設け
    られた薄膜と、 電極および配線とが設けられた熱の絶縁物からなる基体
    と、 を有し、 前記発熱体と前記測温抵抗体とは前記基体に設けられた
    電極に導電性の接着剤でもって接続されており、 前記接続部分によって前記薄膜が基体に保持されている
    ことを特徴とする素子。
  10. 【請求項10】請求項8または請求項9において、熱の
    絶縁物として樹脂材料が用いられることを特徴とする素
    子。
  11. 【請求項11】請求項8または請求項9において、熱の
    絶縁物としてテフロンが用いられることを特徴とする素
    子。
  12. 【請求項12】請求項8または請求項9において、薄膜
    の熱伝導率K1 と熱の絶縁物の熱伝導率K2 とが、K1
    ≧100K2 の関係を満たすことを特徴とする素子。
  13. 【請求項13】請求項8または請求項9において、薄膜
    の熱伝導率K1 と熱の絶縁物の熱伝導率K2 とが、K1
    ≧1000K2 の関係を満たすことを特徴とする素子。
JP01220194A 1994-01-10 1994-01-10 素子作製方法 Expired - Fee Related JP3353987B2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP01220194A JP3353987B2 (ja) 1994-01-10 1994-01-10 素子作製方法
US08/366,573 US5622586A (en) 1994-01-10 1994-12-30 Method of fabricating device made of thin diamond foil

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP01220194A JP3353987B2 (ja) 1994-01-10 1994-01-10 素子作製方法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2002228396A Division JP4034142B2 (ja) 2002-08-06 2002-08-06 流量センサー

Publications (2)

Publication Number Publication Date
JPH07209032A true JPH07209032A (ja) 1995-08-11
JP3353987B2 JP3353987B2 (ja) 2002-12-09

Family

ID=11798797

Family Applications (1)

Application Number Title Priority Date Filing Date
JP01220194A Expired - Fee Related JP3353987B2 (ja) 1994-01-10 1994-01-10 素子作製方法

Country Status (2)

Country Link
US (1) US5622586A (ja)
JP (1) JP3353987B2 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08102511A (ja) * 1994-08-03 1996-04-16 Sumitomo Electric Ind Ltd ダイヤモンド・ヒートシンクおよびその製造方法

Families Citing this family (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0697726B1 (en) * 1994-08-03 2003-02-26 Sumitomo Electric Industries, Ltd. Heat sink comprising synthetic diamond film
US6032527A (en) * 1998-07-01 2000-03-07 Memsys, Inc. Solid state microanemometer
US6770503B1 (en) * 1999-10-21 2004-08-03 The Charles Stark Draper Laboratory, Inc. Integrated packaging of micromechanical sensors and associated control circuits
US7147810B2 (en) * 2003-10-31 2006-12-12 Fraunhofer Usa, Inc. Drapable diamond thin films and method for the preparation thereof
US7012011B2 (en) * 2004-06-24 2006-03-14 Intel Corporation Wafer-level diamond spreader
US20080200408A1 (en) * 2005-09-30 2008-08-21 Mccormack Kenneth Deletion mutants of tetrodotoxin-resistant sodium channel alpha subunit
US7261003B2 (en) * 2006-01-03 2007-08-28 Freescale Semiconductor, Inc. Flowmeter and method for the making thereof
WO2007084501A2 (en) * 2006-01-13 2007-07-26 Group4 Labs, Llc Method for manufacturing smooth diamond heat sinks
FR2909447B1 (fr) * 2006-12-01 2009-07-31 Millipore Corp Dispositif de mesure de conductivite, sa fabrication et son utilisation
US7500392B1 (en) * 2007-10-11 2009-03-10 Memsys, Inc. Solid state microanemometer device and method of fabrication

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CA516671A (en) * 1955-09-20 Pritikin Nathan Method of making inlaid circuits
US3181986A (en) * 1961-03-31 1965-05-04 Intellux Inc Method of making inlaid circuits
US3350250A (en) * 1962-03-21 1967-10-31 North American Aviation Inc Method of making printed wire circuitry
US4159222A (en) * 1977-01-11 1979-06-26 Pactel Corporation Method of manufacturing high density fine line printed circuitry
DE3322382A1 (de) * 1983-06-22 1985-01-10 Preh, Elektrofeinmechanische Werke Jakob Preh Nachf. Gmbh & Co, 8740 Bad Neustadt Verfahren zur herstellung von gedruckten schaltungen
US5131963A (en) * 1987-11-16 1992-07-21 Crystallume Silicon on insulator semiconductor composition containing thin synthetic diamone films
JP2642663B2 (ja) * 1988-03-10 1997-08-20 ヤマハ発動機株式会社 めっき型熱電対
JPH02107923A (ja) * 1988-10-17 1990-04-19 Yamatake Honeywell Co Ltd マイクロブリツジフローセンサ
US4995941A (en) * 1989-05-15 1991-02-26 Rogers Corporation Method of manufacture interconnect device
US5074035A (en) * 1989-07-19 1991-12-24 Excello Circuits Method of making thin film laminate printed circuit
JPH04343023A (ja) * 1991-05-20 1992-11-30 Tokico Ltd 流量センサ
US5406841A (en) * 1992-03-17 1995-04-18 Ricoh Seiki Company, Ltd. Flow sensor
US5272104A (en) * 1993-03-11 1993-12-21 Harris Corporation Bonded wafer process incorporating diamond insulator
US5376579A (en) * 1993-07-02 1994-12-27 The United States Of America As Represented By The Secretary Of The Air Force Schemes to form silicon-on-diamond structure
US5391250A (en) * 1994-03-15 1995-02-21 Minimed Inc. Method of fabricating thin film sensors

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08102511A (ja) * 1994-08-03 1996-04-16 Sumitomo Electric Ind Ltd ダイヤモンド・ヒートシンクおよびその製造方法

Also Published As

Publication number Publication date
JP3353987B2 (ja) 2002-12-09
US5622586A (en) 1997-04-22

Similar Documents

Publication Publication Date Title
EP2976610B1 (en) Thermopile differential scanning calorimeter sensor
JP4814429B2 (ja) 集積回路製造ツール基板上で温度を検出する装置
JP3494747B2 (ja) 薄膜温度センサ及びその製造方法
JP3353987B2 (ja) 素子作製方法
JPH0810231B2 (ja) フローセンサ
JPH0429014B2 (ja)
JPS63500278A (ja) 半導体集積回路、その製造方法、および流速計を提供するためのそのような回路の使用
JP4034142B2 (ja) 流量センサー
CN112034017A (zh) 一种基于晶圆级封装的微型热导检测器及其制备方法
KR100300285B1 (ko) 미세 열유속센서 및 그 제조 방법
JPH10332455A (ja) フローセンサ及びその製造方法
JPH0146011B2 (ja)
JPH0584867B2 (ja)
JPH0535366B2 (ja)
JPH0593732A (ja) フローセンサ
CN116147793A (zh) 一种测温芯片、芯片结构及制造方法
JPH04218777A (ja) マイクロフローセンサおよびその製造方法
JPS6116487A (ja) 電気抵抗体
JP3246131B2 (ja) 赤外線検出素子の製造方法
JPS6243522A (ja) 流量センサ
JPH06273208A (ja) 流量センサ
JPH05215760A (ja) フローセンサの製造方法
JPH0228525A (ja) 薄膜熱電対
JPS62203019A (ja) フロ−センサ
JPH0298954A (ja) 半導体ウェハー温度検出方法

Legal Events

Date Code Title Description
R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080927

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080927

Year of fee payment: 6

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090927

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090927

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090927

Year of fee payment: 7

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100927

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100927

Year of fee payment: 8

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110927

Year of fee payment: 9

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110927

Year of fee payment: 9

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120927

Year of fee payment: 10

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120927

Year of fee payment: 10

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130927

Year of fee payment: 11

LAPS Cancellation because of no payment of annual fees