JPH07191634A - アクティブマトリクス型液晶表示装置 - Google Patents
アクティブマトリクス型液晶表示装置Info
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- JPH07191634A JPH07191634A JP33117493A JP33117493A JPH07191634A JP H07191634 A JPH07191634 A JP H07191634A JP 33117493 A JP33117493 A JP 33117493A JP 33117493 A JP33117493 A JP 33117493A JP H07191634 A JPH07191634 A JP H07191634A
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- liquid crystal
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- generating circuit
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Abstract
(57)【要約】
【目的】 液晶への印加電圧の上昇による消費電力の増
加をまねくこと無く、従来コントラストの低下や画像の
反転現象の原因となっていた視角特性の劣化を改善す
る。また補正電圧発生回路の電圧を変えることにより任
意の視角特性を有するパネルを作成し、視角特性の変化
に伴いプロセスも変える煩雑さを無くす。 【構成】 １画素を複数の液晶画素電極とその画素電極
に接続されたＴＦＴの組で構成し、各画素電極には見る
角度により屈折率異方性が無い液晶分子がなるべく立っ
た状態または寝た状態になるように電圧を印加する。ま
た、パネルをどの角度から見て最も頻繁に使用するかに
応じて、各画素の位置に対応した補正電圧を画素電圧に
重畳して印加することにより、パネル面内での視角特性
をより改善する。
加をまねくこと無く、従来コントラストの低下や画像の
反転現象の原因となっていた視角特性の劣化を改善す
る。また補正電圧発生回路の電圧を変えることにより任
意の視角特性を有するパネルを作成し、視角特性の変化
に伴いプロセスも変える煩雑さを無くす。 【構成】 １画素を複数の液晶画素電極とその画素電極
に接続されたＴＦＴの組で構成し、各画素電極には見る
角度により屈折率異方性が無い液晶分子がなるべく立っ
た状態または寝た状態になるように電圧を印加する。ま
た、パネルをどの角度から見て最も頻繁に使用するかに
応じて、各画素の位置に対応した補正電圧を画素電圧に
重畳して印加することにより、パネル面内での視角特性
をより改善する。
Description
【０００１】
【産業上の利用分野】本発明は、アクティブマトリクス
型液晶表示装置に関するものである。
型液晶表示装置に関するものである。
【０００２】
【従来の技術】現在パソコン、ワークステーション、テ
レビジョン等の画像表示の目的のために使用されている
液晶ディスプレイは、そのほとんどがＴＮ型の液晶を使
用している。ＴＮ型液晶を使用した液晶ディスプレイの
画質を劣化させる要因の１つとして、中間調表示におけ
る視角特性の非対称性がある。これは中間調においては
ＴＮ型液晶の液晶分子が斜めに立っているため、見る角
度により屈折率異方性が異なることに起因している現象
である。実際に視覚に感じられる現象としては、コント
ラストの低下、明るい部分と暗い部分の表示が逆転する
画像の反転現象等が挙げられる。
レビジョン等の画像表示の目的のために使用されている
液晶ディスプレイは、そのほとんどがＴＮ型の液晶を使
用している。ＴＮ型液晶を使用した液晶ディスプレイの
画質を劣化させる要因の１つとして、中間調表示におけ
る視角特性の非対称性がある。これは中間調においては
ＴＮ型液晶の液晶分子が斜めに立っているため、見る角
度により屈折率異方性が異なることに起因している現象
である。実際に視覚に感じられる現象としては、コント
ラストの低下、明るい部分と暗い部分の表示が逆転する
画像の反転現象等が挙げられる。
【０００３】一般的に、白または黒表示時における液晶
の透過率の視角依存性は中間調表示時における視角依存
性よりもはるかに良好である。そこで、画素電極を第１
の画素電極及び第２の画素電極のように分割し、一方の
画素に中間調表示もう一方の画素には白レベルの電圧を
印加して、画素全体では中間調表示を行うように電圧設
定すれば、現状のＴＮ液晶セルに比べて視角特性が改善
できるとの報告がなされている。（ケイ・アール・サー
マ他（Ｋ．Ｒ．Ｓａｒｍａ ｅｔ．ａｌ．）エスアイデ
ィー’９１ダイジェスト：ＳＩＤ’９１ ＤＩＧＥＳ
Ｔ）（１９９１）ｐ．５５５）以下に図８を用いて本方
法の説明を行う。第１の液晶容量１９は第１の画素電極
により形成される液晶容量、第２の液晶容量２０は第２
の画素電極により形成される液晶容量、制御容量２１は
第２の画素電極の上または下に、例えばＳｉＯx やＳｉ
Ｎx 等の絶縁膜を形成してなる補助容量である。このよ
うな構造を持つ画素に電圧を印加すると、第２の液晶容
量２０への印加電圧は第１の液晶容量１９への印加画素
を制御容量２１とで容量分割される分だけ小さい値が印
加されることになり、前述の印加電圧条件を設定できる
ことになる。
の透過率の視角依存性は中間調表示時における視角依存
性よりもはるかに良好である。そこで、画素電極を第１
の画素電極及び第２の画素電極のように分割し、一方の
画素に中間調表示もう一方の画素には白レベルの電圧を
印加して、画素全体では中間調表示を行うように電圧設
定すれば、現状のＴＮ液晶セルに比べて視角特性が改善
できるとの報告がなされている。（ケイ・アール・サー
マ他（Ｋ．Ｒ．Ｓａｒｍａ ｅｔ．ａｌ．）エスアイデ
ィー’９１ダイジェスト：ＳＩＤ’９１ ＤＩＧＥＳ
Ｔ）（１９９１）ｐ．５５５）以下に図８を用いて本方
法の説明を行う。第１の液晶容量１９は第１の画素電極
により形成される液晶容量、第２の液晶容量２０は第２
の画素電極により形成される液晶容量、制御容量２１は
第２の画素電極の上または下に、例えばＳｉＯx やＳｉ
Ｎx 等の絶縁膜を形成してなる補助容量である。このよ
うな構造を持つ画素に電圧を印加すると、第２の液晶容
量２０への印加電圧は第１の液晶容量１９への印加画素
を制御容量２１とで容量分割される分だけ小さい値が印
加されることになり、前述の印加電圧条件を設定できる
ことになる。
【０００４】
【発明が解決しようとする課題】しかし、従来の方法は
ＴＦＴ基板の作成行程で視角特性の改善処理を行うた
め、同じドット数及びドットピッチのパネルでも、視角
特性を変更する場合にはプロセスを変更する必要があ
る。このため多品種のＴＦＴ−ＬＣＤを作成しようとす
る場合はプロセスの煩雑化が避けられない。
ＴＦＴ基板の作成行程で視角特性の改善処理を行うた
め、同じドット数及びドットピッチのパネルでも、視角
特性を変更する場合にはプロセスを変更する必要があ
る。このため多品種のＴＦＴ−ＬＣＤを作成しようとす
る場合はプロセスの煩雑化が避けられない。
【０００５】更に、第２の液晶容量２０に印加される電
圧は、常に第１の液晶容量１９に印加される電圧よりも
低いため、黒表示を行う場合は従来よりも高い電圧を印
加しなくてはならないため、消費電力の増加をまねくと
いう問題があった。
圧は、常に第１の液晶容量１９に印加される電圧よりも
低いため、黒表示を行う場合は従来よりも高い電圧を印
加しなくてはならないため、消費電力の増加をまねくと
いう問題があった。
【０００６】また大画面パネルの様に、１つのパネルの
中で使用者の視線の角度が異なる場合は中心部では広い
視野角が得られるが、周辺の部分では中心部ほど広い視
野角が得られないという問題が発生する。
中で使用者の視線の角度が異なる場合は中心部では広い
視野角が得られるが、周辺の部分では中心部ほど広い視
野角が得られないという問題が発生する。
【０００７】本発明の目的は、消費電力の増加をまねく
ことなく、視角特性を改善したアクティブマトリクス型
液晶表示装置を提供することにある。
ことなく、視角特性を改善したアクティブマトリクス型
液晶表示装置を提供することにある。
【０００８】
【課題点を解決するための手段】本発明のアクティブマ
トリクス型液晶表示装置によれば、２枚の透光性絶縁基
板間にＴＮ型液晶が充填され、前記基板の少なくとも一
方の内面に液晶画素を選択するための走査線と前記液晶
画素へ駆動電圧を印加するための信号線とがマトリクス
状に配設され、前記走査線と前記信号線との交差部付近
に、走査線の信号により液晶画素に信号線の信号を供給
する薄膜電界効果型をトランジスタが形成されたアクテ
ィブマトリクス型液晶表示装置において、１画素が複数
の薄膜電界効果型トランジスタと液晶画素の組により構
成され、画像信号をもとに前記液晶画素の組に電圧を印
加する際に、前記液晶画素の組の輝度が前記画像信号を
１つの画素に印加して一定の角度から測定した場合と同
じ輝度になり、かつ個々の前記液晶画素に印加される電
圧は液晶分子がなるべく立った状態または寝た状態にな
るように前記液晶画素の組に印加する各電圧のデータを
生成する画素データ発生回路と、前記画素データ発生回
路の出力データから生成される画素電圧を時分割で前記
液晶画素の組に印加するためにデータを並べ変えるため
のメモリ回路と、前記メモリ回路から出力されたデータ
をもとに前記画素電極の組に印加する画素電圧を生成す
る画素電圧発生回路と、前記画素電圧が表示部のどの位
置の画素に印加されるのかを同期信号より検出し、その
位置に応じた補正電圧を発生する補正電圧発生回路と前
記画素電圧発生回路と前記補正電圧発生回路の各出力電
圧を加算するための加算回路とを備えることを特徴とす
る。
トリクス型液晶表示装置によれば、２枚の透光性絶縁基
板間にＴＮ型液晶が充填され、前記基板の少なくとも一
方の内面に液晶画素を選択するための走査線と前記液晶
画素へ駆動電圧を印加するための信号線とがマトリクス
状に配設され、前記走査線と前記信号線との交差部付近
に、走査線の信号により液晶画素に信号線の信号を供給
する薄膜電界効果型をトランジスタが形成されたアクテ
ィブマトリクス型液晶表示装置において、１画素が複数
の薄膜電界効果型トランジスタと液晶画素の組により構
成され、画像信号をもとに前記液晶画素の組に電圧を印
加する際に、前記液晶画素の組の輝度が前記画像信号を
１つの画素に印加して一定の角度から測定した場合と同
じ輝度になり、かつ個々の前記液晶画素に印加される電
圧は液晶分子がなるべく立った状態または寝た状態にな
るように前記液晶画素の組に印加する各電圧のデータを
生成する画素データ発生回路と、前記画素データ発生回
路の出力データから生成される画素電圧を時分割で前記
液晶画素の組に印加するためにデータを並べ変えるため
のメモリ回路と、前記メモリ回路から出力されたデータ
をもとに前記画素電極の組に印加する画素電圧を生成す
る画素電圧発生回路と、前記画素電圧が表示部のどの位
置の画素に印加されるのかを同期信号より検出し、その
位置に応じた補正電圧を発生する補正電圧発生回路と前
記画素電圧発生回路と前記補正電圧発生回路の各出力電
圧を加算するための加算回路とを備えることを特徴とす
る。
【０００９】
【作用】本発明の液晶表示装置は、１画素を複数の液晶
画素電極とその画素電極に接続されたＴＦＴの組で構成
し、各画素電極には見る角度により屈折率異方性が無い
液晶分子がなるべく立った状態または寝た状態になるよ
うに電圧を印加する。また、パネルをどの角度から見て
最も頻繁に使用するかに応じて、各画素の位置に対応し
た補正電圧を画素電圧に重畳して印加することにより、
パネル面内での視角特性をより改善することを特徴とす
る。
画素電極とその画素電極に接続されたＴＦＴの組で構成
し、各画素電極には見る角度により屈折率異方性が無い
液晶分子がなるべく立った状態または寝た状態になるよ
うに電圧を印加する。また、パネルをどの角度から見て
最も頻繁に使用するかに応じて、各画素の位置に対応し
た補正電圧を画素電圧に重畳して印加することにより、
パネル面内での視角特性をより改善することを特徴とす
る。
【００１０】
【実施例】以下に本発明を階調数１６のモノクローム表
示の縦４８０ドット、横６４０ドット対角サイズ９. ４
インチのパーソナルコンピュータ用のディスプレイに用
いた場合の１実施例を示す。図１は上記ディスプレイの
１画素の構成を示す平面図である。図１において１はゲ
ートバスライン、２はソースバスライン、３はＴＦＴ、
４は画素電極である。本実施例では１画素は上下２つで
１組となる画素電極とＴＦＴの組により構成されてい
る。１画素のピッチは縦横各３００μｍである。
示の縦４８０ドット、横６４０ドット対角サイズ９. ４
インチのパーソナルコンピュータ用のディスプレイに用
いた場合の１実施例を示す。図１は上記ディスプレイの
１画素の構成を示す平面図である。図１において１はゲ
ートバスライン、２はソースバスライン、３はＴＦＴ、
４は画素電極である。本実施例では１画素は上下２つで
１組となる画素電極とＴＦＴの組により構成されてい
る。１画素のピッチは縦横各３００μｍである。
【００１１】図２は本発明の信号処理部のブロックダイ
アグラムの１実施例である。図２において５は画像信号
から分割された各画素電極に印加する電圧データを出力
する画素データ発生回路、６は画素データ発生回路５か
ら出力された電圧データを画素に書き込むために順番に
並べ変えるメモリ回路、７はメモリ回路６から出力され
た電圧データを電圧に変換する画素電圧発生回路、８は
各回路を同期させて動作するための同期信号発生回路、
９は同期信号発生回路からの出力をもとに画素電圧発生
回路７の出力が画面のどの位置の画素であるかを判別
し、その位置に応じた補正電圧を出力するための補正電
圧発生回路、１０は画素電圧発生回路７と補正電圧発生
回路９の出力を加算してソースドライバ１１に出力する
加算回路である。
アグラムの１実施例である。図２において５は画像信号
から分割された各画素電極に印加する電圧データを出力
する画素データ発生回路、６は画素データ発生回路５か
ら出力された電圧データを画素に書き込むために順番に
並べ変えるメモリ回路、７はメモリ回路６から出力され
た電圧データを電圧に変換する画素電圧発生回路、８は
各回路を同期させて動作するための同期信号発生回路、
９は同期信号発生回路からの出力をもとに画素電圧発生
回路７の出力が画面のどの位置の画素であるかを判別
し、その位置に応じた補正電圧を出力するための補正電
圧発生回路、１０は画素電圧発生回路７と補正電圧発生
回路９の出力を加算してソースドライバ１１に出力する
加算回路である。
【００１２】図３は上記信号処理部内の画素データ発生
回路５の１実施例を示すブロックダイアグラムである。
図３において１３は同期信号に同期して、４ビットで示
される画素の階調数を入力として、出力に３ビットの２
個１組のデータを送出するＲＯＭ、１４はＲＯＭ１３の
出力を同期信号に同期させ保持するラッチ回路である。
回路５の１実施例を示すブロックダイアグラムである。
図３において１３は同期信号に同期して、４ビットで示
される画素の階調数を入力として、出力に３ビットの２
個１組のデータを送出するＲＯＭ、１４はＲＯＭ１３の
出力を同期信号に同期させ保持するラッチ回路である。
【００１３】図４は上記信号処理部内の補正電圧発生回
路９の１実施例を示すブロックダイアグラムである。図
４において１５は同期信号発生回路の信号をカウントし
て、現在メモリ回路６から送出されているデータがパネ
ルのどの位置のものであるかを検出するカウンタ、１６
はカウンタ１５とメモリ回路の出力をもとに補正電圧デ
ータを出力するＲＯＭ、１７はＲＯＭ回路の出力を電圧
に変換するＤ／Ａコンバータである。
路９の１実施例を示すブロックダイアグラムである。図
４において１５は同期信号発生回路の信号をカウントし
て、現在メモリ回路６から送出されているデータがパネ
ルのどの位置のものであるかを検出するカウンタ、１６
はカウンタ１５とメモリ回路の出力をもとに補正電圧デ
ータを出力するＲＯＭ、１７はＲＯＭ回路の出力を電圧
に変換するＤ／Ａコンバータである。
【００１４】図５は上記信号処理部内の加算回路１０の
１実施例を示す回路である。図５においてオペアンプ１
８により非反転の加算回路を構成している。この回路に
より２つの入力端子から入力された信号Ｖ１とＶ２は、
出力に（Ｖ１＋Ｖ２）の信号として取り出すことができ
る。
１実施例を示す回路である。図５においてオペアンプ１
８により非反転の加算回路を構成している。この回路に
より２つの入力端子から入力された信号Ｖ１とＶ２は、
出力に（Ｖ１＋Ｖ２）の信号として取り出すことができ
る。
【００１５】また図面での説明は行っていないが、メモ
リ回路６は同期信号に同期したラッチ回路により、画素
電圧発生回路７はＤ／Ａコンバータによりそれぞれ容易
に構成することが出来る。
リ回路６は同期信号に同期したラッチ回路により、画素
電圧発生回路７はＤ／Ａコンバータによりそれぞれ容易
に構成することが出来る。
【００１６】図６はソースドライバ１１の出力とゲート
ドライバ１２の信号と、ゲート信号がオンになり選択さ
れた画素電極の電圧の関係を示したものである。１画素
は縦方向に２分割されているので、走査線の本数は従来
の２倍の９６０本になっている。今従来の場合のｎ本目
の走査線が選択されｍ本目の信号線に接続された画素電
極に電圧が印加される場合を例にして、本発明の電圧書
き込みの様子を示す。従来ｎ本目の走査線とｍ本目の信
号線に接続される画素は、本発明では２ｎ及び２ｎ＋１
本目の２本の走査線とｍ本目の信号線に接続された２つ
の画素で構成される。従来の場合電圧の書き込み時間が
図６で示すｔで示されるとすると、まずｔのうちの前半
の１／２の時間ｔａで２ｎ本目の信号線に接続された画
素に電圧が書き込まれる。次に後半の１／２の時間ｔｂ
で２ｎ＋１本目の走査線に接続された画素に電圧が書き
込まれ、時間ｔの間に１画素分の電圧の書き込みが終了
する。今回の実施例に用いたディスプレイでは、走査線
１本当たりの走査時間は約１７μｓになる。 図７に階
調と液晶画素の組のそれぞれの透過率の組み合わせの１
実施例を示す。一般に液晶は、透過率が５０％付近では
視野角が狭く、０及び１００％付近では広いことが知ら
れている。そこで、各画素の透過率がなるべく０または
１００％に近くなるように各液晶画素の透過率を設定
し、この組み合わせにより５０％付近の透過率と等しい
光量が得られるように液晶画素に印加する電圧を設定し
た。
ドライバ１２の信号と、ゲート信号がオンになり選択さ
れた画素電極の電圧の関係を示したものである。１画素
は縦方向に２分割されているので、走査線の本数は従来
の２倍の９６０本になっている。今従来の場合のｎ本目
の走査線が選択されｍ本目の信号線に接続された画素電
極に電圧が印加される場合を例にして、本発明の電圧書
き込みの様子を示す。従来ｎ本目の走査線とｍ本目の信
号線に接続される画素は、本発明では２ｎ及び２ｎ＋１
本目の２本の走査線とｍ本目の信号線に接続された２つ
の画素で構成される。従来の場合電圧の書き込み時間が
図６で示すｔで示されるとすると、まずｔのうちの前半
の１／２の時間ｔａで２ｎ本目の信号線に接続された画
素に電圧が書き込まれる。次に後半の１／２の時間ｔｂ
で２ｎ＋１本目の走査線に接続された画素に電圧が書き
込まれ、時間ｔの間に１画素分の電圧の書き込みが終了
する。今回の実施例に用いたディスプレイでは、走査線
１本当たりの走査時間は約１７μｓになる。 図７に階
調と液晶画素の組のそれぞれの透過率の組み合わせの１
実施例を示す。一般に液晶は、透過率が５０％付近では
視野角が狭く、０及び１００％付近では広いことが知ら
れている。そこで、各画素の透過率がなるべく０または
１００％に近くなるように各液晶画素の透過率を設定
し、この組み合わせにより５０％付近の透過率と等しい
光量が得られるように液晶画素に印加する電圧を設定し
た。
【００１７】本実施例では、階調数１６のモノクローム
表示の縦４８０ドット、横６４０ドット対角サイズ９.
４インチのパーソナルコンピュータ用のディスプレイに
用いた場合の例を用いて説明を行ったが、本発明はこれ
に限らず縦及び横方向のドット数、画面サイズは任意の
値を取ることが可能である。また画素が赤、緑、青の３
色に分割されたカラー表示用ディスプレイに本発明を用
いても、赤、緑、青の各ドットにおいて画素を複数に分
割することにより上記と同様の効果を得ることが可能で
ある。１画素の分割数に関しても２分割の場合を用いて
説明を行ったが、２分割以上でも同様の効果を得ること
ができる。更に階調数に関しても１６に限らず、分割さ
れた画素に印加する電圧の組み合わせを変更することに
より、これ以外の階調数の表示にも対応が可能である。
表示の縦４８０ドット、横６４０ドット対角サイズ９.
４インチのパーソナルコンピュータ用のディスプレイに
用いた場合の例を用いて説明を行ったが、本発明はこれ
に限らず縦及び横方向のドット数、画面サイズは任意の
値を取ることが可能である。また画素が赤、緑、青の３
色に分割されたカラー表示用ディスプレイに本発明を用
いても、赤、緑、青の各ドットにおいて画素を複数に分
割することにより上記と同様の効果を得ることが可能で
ある。１画素の分割数に関しても２分割の場合を用いて
説明を行ったが、２分割以上でも同様の効果を得ること
ができる。更に階調数に関しても１６に限らず、分割さ
れた画素に印加する電圧の組み合わせを変更することに
より、これ以外の階調数の表示にも対応が可能である。
【００１８】本発明を上記のディスプレイに適用した結
果、コントラストが１０以上とれる視野が従来は上下方
向で各１０度程度であったのに対し、今回の発明を使用
することにより上下各２５度以上と広がった。
果、コントラストが１０以上とれる視野が従来は上下方
向で各１０度程度であったのに対し、今回の発明を使用
することにより上下各２５度以上と広がった。
【００１９】
【発明の効果】以上述べてきたように、本発明のアクテ
ィブマトリクス型液晶表示装置によれば、液晶への印加
電圧の上昇による消費電力の増加をまねくこと無く、従
来コントラストの低下や画像の反転現象の原因となって
いた視角特性の劣化を改善することが可能である。また
補正電圧発生回路の電圧を変えることにより任意の視角
特性を有するパネルを作成できるため、視角特性の変化
に伴いプロセスも変えなければならないという煩雑さが
無い。
ィブマトリクス型液晶表示装置によれば、液晶への印加
電圧の上昇による消費電力の増加をまねくこと無く、従
来コントラストの低下や画像の反転現象の原因となって
いた視角特性の劣化を改善することが可能である。また
補正電圧発生回路の電圧を変えることにより任意の視角
特性を有するパネルを作成できるため、視角特性の変化
に伴いプロセスも変えなければならないという煩雑さが
無い。
【図１】本発明の画素部の構造の１実施例を示す図
【図２】本発明の信号処理部のブロックダイアグラムの
１実施例を示す図を示す図
１実施例を示す図を示す図
【図３】本発明の画像データ発生回路のブロックダイア
グラムの１実施例を示す図
グラムの１実施例を示す図
【図４】本発明の補正電圧発生回路のブロックダイアグ
ラムの１実施例を示す図
ラムの１実施例を示す図
【図５】本発明の加算回路のブロックダイアグラムの１
実施例を示す図
実施例を示す図
【図６】本発明のＴＦＴへの印加電圧の１実施例を示す
図
図
【図７】本発明の階調と各液晶画素の透過率の１実施例
を示す図
を示す図
【図８】従来の発明の等価回路図
１ ゲートバスライン ２ ソースバスライン ３ ＴＦＴ ４ 画素電極 ５ 画素データ発生回路 ６ メモリ回路 ７ 画素電圧発生回路 ８ 同期信号発生回路 ９ 補正電圧発生回路 １０ 加算回路
Claims (1)
- 【請求項１】 ２枚の透光性絶縁基板間にＴＮ型液晶が
充填され、前記基板の少なくとも一方の内面に液晶画素
を選択するための走査線と前記液晶画素へ駆動電圧を印
加するための信号線とがマトリクス状に配設され、前記
走査線と前記信号線との交差部付近に、走査線の信号に
より液晶画素に信号線の信号を供給する薄膜電界効果型
トランジスタが形成されたアクティブマトリクス型液晶
表示装置において、１画素が複数の薄膜電界効果型トラ
ンジスタと液晶画素の組により構成され、画像信号をも
とに前記液晶画素の組に電圧を印加する際に、前記液晶
画素の組の輝度が前記画像信号を１つの画素に印加して
一定の角度から測定した場合と同じ輝度になり、かつ個
々の前記液晶画素に印加される電圧は液晶分子がなるべ
く立った状態または寝た状態になるように前記液晶画素
の組に印加する各電圧のデータを生成する画素データ発
生回路と、前記画素データ発生回路の出力データから生
成される画素電圧を時分割で前記液晶画素の組に印加す
るためにデータを並べ変えるためのメモリ回路と、前記
メモリ回路から出力されたデータをもとに前記画素電極
の組に印加する画素電圧を生成する画素電圧発生回路
と、前記画素電圧が表示部のどの位置の画素に印加され
るのかを同期信号より検出し、その位置に応じた補正電
圧を発生する補正電圧発生回路と前記画素電圧発生回路
と前記補正電圧発生回路の各出力電圧を加算するための
加算回路とを備えることを特徴とするアクティブマトリ
クス型液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33117493A JPH07191634A (ja) | 1993-12-27 | 1993-12-27 | アクティブマトリクス型液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33117493A JPH07191634A (ja) | 1993-12-27 | 1993-12-27 | アクティブマトリクス型液晶表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
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|---|---|---|---|
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