JPH0650811Y2 - Ｄａｔ用のエンベロープアナライザ - Google Patents
Ｄａｔ用のエンベロープアナライザInfo
- Publication number
- JPH0650811Y2 JPH0650811Y2 JP7496389U JP7496389U JPH0650811Y2 JP H0650811 Y2 JPH0650811 Y2 JP H0650811Y2 JP 7496389 U JP7496389 U JP 7496389U JP 7496389 U JP7496389 U JP 7496389U JP H0650811 Y2 JPH0650811 Y2 JP H0650811Y2
- Authority
- JP
- Japan
- Prior art keywords
- envelope
- dat
- signal
- maximum value
- converter
- Prior art date
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- Expired - Lifetime
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- Measurement Of Current Or Voltage (AREA)
- Digital Magnetic Recording (AREA)
Description
【考案の詳細な説明】 （イ）産業上の利用分野 この考案はDATのテープパスの評価、または、調整に好
適なDAT用のエンベロープアナライザに関する。
適なDAT用のエンベロープアナライザに関する。
（ロ）従来技術・考案が解決しようとする問題点 従来より、DATのテープパスの調整は、DATヘッドより得
られるRF信号を直接オシロスコープで観測し、その波形
の変動を目視で確認することによりトラック上のヘッド
のトレース状態を判断しこの判断結果に基づき調整を行
っていた。
られるRF信号を直接オシロスコープで観測し、その波形
の変動を目視で確認することによりトラック上のヘッド
のトレース状態を判断しこの判断結果に基づき調整を行
っていた。
しかし、上記した従来の調整作業は調整者の感と熟練度
にたよっていたため調整者により調整誤差が生じ、また
調整に時間がかかるという欠点があった。
にたよっていたため調整者により調整誤差が生じ、また
調整に時間がかかるという欠点があった。
この考案は上記した点に鑑みてなされたものであり、そ
の目的とするところは、テープパスの状態を定量的に把
握することのできるDAT用のエンベロープアナライザを
提供することにある。
の目的とするところは、テープパスの状態を定量的に把
握することのできるDAT用のエンベロープアナライザを
提供することにある。
（ハ）問題を解決するための手段 第１図はこの考案の機能ブロック図であり、この考案の
DAT用のエンベロープアナライザは、DATのヘッドがテー
プ上のトラックをトレースすることにより得られるRF信
号を増幅するRFアンプと、このRFアンプの出力を検波す
る包絡線検波回路と、この包絡線検波回路の出力電圧を
サンプリングしホールドするサンプリングホールド回路
と、このサンプリングホールド回路の出力電圧をディジ
タル電圧に変換するA/Dコンバータと、サンプリングホ
ールド回路とA/Dコンバータとを制御するマイクロコン
ピュータと、このマイクロコンピュータの演算結果を表
示する表示器とで構成したDAT用のエンベロープアナラ
イザにおいて、RF信号のエンベロープを複数回計測する
エンベロープ計測手段と、このエンベロープ計測手段が
複数回計測した計測値の平均値を演算する第１の演算手
段と、既に演算した複数の平均値から最大値を探索する
最大値探索手段と、最小値を探索する最小値探索手段
と、最大値探索手段で得られた最大値と最小値探索手段
で得られた最小値との比率を演算する第２の演算手段と
を設け、第２の演算手段の演算結果を前記表示器に表示
するように構成したものである。
DAT用のエンベロープアナライザは、DATのヘッドがテー
プ上のトラックをトレースすることにより得られるRF信
号を増幅するRFアンプと、このRFアンプの出力を検波す
る包絡線検波回路と、この包絡線検波回路の出力電圧を
サンプリングしホールドするサンプリングホールド回路
と、このサンプリングホールド回路の出力電圧をディジ
タル電圧に変換するA/Dコンバータと、サンプリングホ
ールド回路とA/Dコンバータとを制御するマイクロコン
ピュータと、このマイクロコンピュータの演算結果を表
示する表示器とで構成したDAT用のエンベロープアナラ
イザにおいて、RF信号のエンベロープを複数回計測する
エンベロープ計測手段と、このエンベロープ計測手段が
複数回計測した計測値の平均値を演算する第１の演算手
段と、既に演算した複数の平均値から最大値を探索する
最大値探索手段と、最小値を探索する最小値探索手段
と、最大値探索手段で得られた最大値と最小値探索手段
で得られた最小値との比率を演算する第２の演算手段と
を設け、第２の演算手段の演算結果を前記表示器に表示
するように構成したものである。
（ニ）作用 この考案の作用を第１図を用いて説明する。
この考案によれば、DATのヘッドがテープ上のトラック
をトレースすることにより得られるRF信号を増幅するRF
アンプと、このRFアンプの出力を検波する包絡線検波回
路と、この包絡線検波回路の出力電圧をサンプリングし
ホールドするサンプリングホールド回路と、このサンプ
リングホールド回路の出力電圧をディジタル電圧に変換
するA/Dコンバータと、サンプリングホールド回路とA/D
コンバータとを制御するマイクロコンピュータと、この
マイクロコンピュータの演算結果を表示する表示器とで
構成したDAT用のエンベロープアナライザにおいて、RF
信号のエンベロープを複数回計測するエンベロープ計測
手段と、このエンベロープ計測手段が複数回計測した計
測値の平均値を演算する第１の演算手段と、既に演算し
た複数の平均値から最大値を探索する最大値探索手段
と、最小値を探索する最小値探索手段と、最大値探索手
段で得られた最大値と最小値探索手段で得られた最小値
との比率を演算する第２の演算手段とを設け、第２の演
算手段の演算結果を前記表示器に表示するように構成し
たもので、RF信号の波形変動の大小が時間と共に表示さ
れる。このため、テープパスの状態を定量的に把握する
ことができる。
をトレースすることにより得られるRF信号を増幅するRF
アンプと、このRFアンプの出力を検波する包絡線検波回
路と、この包絡線検波回路の出力電圧をサンプリングし
ホールドするサンプリングホールド回路と、このサンプ
リングホールド回路の出力電圧をディジタル電圧に変換
するA/Dコンバータと、サンプリングホールド回路とA/D
コンバータとを制御するマイクロコンピュータと、この
マイクロコンピュータの演算結果を表示する表示器とで
構成したDAT用のエンベロープアナライザにおいて、RF
信号のエンベロープを複数回計測するエンベロープ計測
手段と、このエンベロープ計測手段が複数回計測した計
測値の平均値を演算する第１の演算手段と、既に演算し
た複数の平均値から最大値を探索する最大値探索手段
と、最小値を探索する最小値探索手段と、最大値探索手
段で得られた最大値と最小値探索手段で得られた最小値
との比率を演算する第２の演算手段とを設け、第２の演
算手段の演算結果を前記表示器に表示するように構成し
たもので、RF信号の波形変動の大小が時間と共に表示さ
れる。このため、テープパスの状態を定量的に把握する
ことができる。
（ホ）実施例 この考案に係るDAT用のエンベロープアナライザの実施
例を第１図乃至第５図に基づき説明する。
例を第１図乃至第５図に基づき説明する。
第１図は機能ブロック図、第２図はハードウェアのブロ
ック図、第３図はタイミング図であって、第３図（Ａ）
はヘッド切換信号の波形図、第３図（Ｂ）はRF信号の波
形図、第４図（Ａ）はテープ上のトラックをヘッドがト
レースする状態を模式的に示した図、第４図（Ｂ）はト
レース状態に応じたRF信号の波形図、第５図（Ａ）及び
第５図（Ｂ）はフローチャートである。
ック図、第３図はタイミング図であって、第３図（Ａ）
はヘッド切換信号の波形図、第３図（Ｂ）はRF信号の波
形図、第４図（Ａ）はテープ上のトラックをヘッドがト
レースする状態を模式的に示した図、第４図（Ｂ）はト
レース状態に応じたRF信号の波形図、第５図（Ａ）及び
第５図（Ｂ）はフローチャートである。
図中、１はDATのヘッドがテープ上のトラックをトレー
スすることにより得られるRF信号をこのエンベロープア
ナライザに入力するための入力端子、1aはRF信号、２は
RF信号1aを増幅するRFアンプ、３はRFアンプ２の出力を
検波する包絡線検波回路、４は包絡線波回路３の出力電
圧をサンプリングしホーールドするサンプリングホール
ド回路、５はサンプリングホールド回路４の出力電圧を
ディジタル電圧に変換するA/Dコンバータ、６はサンプ
リングホールド回路４とA/Dコンバータ５とを制御する
と共にA/Dコンバータ５の出力を取りこみ、更に、演算
処理をするマイクロコンピュータ、７はDATのA,Bヘッド
のヘッド切換信号をマイクロコンピュータ６に入力する
ための入力端子、7aはヘッド切換信号、８はマイクロコ
ンピュータ６の演算結果を表示するための表示器、９は
表示器８をドライブするための表示回路、10は表示器８
の表示状態（例えば、Ａヘッドのデータ,Bヘッドのデー
タなど）を切換えるための操作スイッチである。
スすることにより得られるRF信号をこのエンベロープア
ナライザに入力するための入力端子、1aはRF信号、２は
RF信号1aを増幅するRFアンプ、３はRFアンプ２の出力を
検波する包絡線検波回路、４は包絡線波回路３の出力電
圧をサンプリングしホーールドするサンプリングホール
ド回路、５はサンプリングホールド回路４の出力電圧を
ディジタル電圧に変換するA/Dコンバータ、６はサンプ
リングホールド回路４とA/Dコンバータ５とを制御する
と共にA/Dコンバータ５の出力を取りこみ、更に、演算
処理をするマイクロコンピュータ、７はDATのA,Bヘッド
のヘッド切換信号をマイクロコンピュータ６に入力する
ための入力端子、7aはヘッド切換信号、８はマイクロコ
ンピュータ６の演算結果を表示するための表示器、９は
表示器８をドライブするための表示回路、10は表示器８
の表示状態（例えば、Ａヘッドのデータ,Bヘッドのデー
タなど）を切換えるための操作スイッチである。
そして、サンプリングホールド回路４とA/Dコンバータ
５と入力端子７と操作スイッチ10とはマイクロコンピュ
ータ６の入出力ポートを介して接続していて、このマイ
クロコンピュータ６は、このエンベロープアナライザの
プログラムを格納するROMと演算結果をメモリさせるRAM
と測定タイミングを計時するためのタイマーとから構成
されている。
５と入力端子７と操作スイッチ10とはマイクロコンピュ
ータ６の入出力ポートを介して接続していて、このマイ
クロコンピュータ６は、このエンベロープアナライザの
プログラムを格納するROMと演算結果をメモリさせるRAM
と測定タイミングを計時するためのタイマーとから構成
されている。
このように構成されたエンベロープアナライザにおい
て、入力端子７にはヘッド切換信号7aが入力されるよう
になっていて、第３図に示すように、ヘッド切換信号7a
はＡヘッドからRF信号1a1が得られる時には“L"レベ
ル、ＢヘッドからRF信号1a2が得られるときには“H"レ
ベルのパルス信号がマイクロコンピュータ６に入力され
るようになっている。
て、入力端子７にはヘッド切換信号7aが入力されるよう
になっていて、第３図に示すように、ヘッド切換信号7a
はＡヘッドからRF信号1a1が得られる時には“L"レベ
ル、ＢヘッドからRF信号1a2が得られるときには“H"レ
ベルのパルス信号がマイクロコンピュータ６に入力され
るようになっている。
なお、第３図に示した１乃至８の番号は、Ａヘッドまた
はＢヘッドから得られたRF信号1a1,1a2のエンベロープ
の電圧レベルが測定されるポイントを示しており、この
実施例では図示した通り８回計測される。
はＢヘッドから得られたRF信号1a1,1a2のエンベロープ
の電圧レベルが測定されるポイントを示しており、この
実施例では図示した通り８回計測される。
第４図（Ａ）はテープ上のトラックをヘッドがトレース
する状態を模式的に示した図、第４図（Ｂ）はトレース
の結果得られたRF信号の波形図である。
する状態を模式的に示した図、第４図（Ｂ）はトレース
の結果得られたRF信号の波形図である。
図において、TAはテープ、trはテープTA上に記録された
トラック、ＴはテープTAの走行方向、，，はヘッ
ドＨのトレース方向である。
トラック、ＴはテープTAの走行方向、，，はヘッ
ドＨのトレース方向である。
そしてヘッドＨが矢印のようにトラックtrの略中央部
をトレースする時には第４図（Ｂ）に示すような所定の
レベルh1のRF信号1a3が得られ、ヘッドＨが矢印，
のようにトラックtrの中央部をトレースしないときには
低いレベルh2のRF信号1a4が得られる。
をトレースする時には第４図（Ｂ）に示すような所定の
レベルh1のRF信号1a3が得られ、ヘッドＨが矢印，
のようにトラックtrの中央部をトレースしないときには
低いレベルh2のRF信号1a4が得られる。
そして、この考案は上記した波形変動の状態を定量的に
把握することができるように構成したものである。
把握することができるように構成したものである。
次に、上記した実施例の動作を第５図（Ａ）（Ｂ）に示
すフローチャートに基づいて説明する。
すフローチャートに基づいて説明する。
計測を開始するとヘッド切換信号7aのエッジの検出を行
う（ステップS1）。エッジを検出し立ち下がりエッジ
を検出すれば、Ａヘッドで得られたRF信号1a1を計測
し、立ち上がりエッジを検出すれば、Ｂヘッドで得ら
れたRF信号1a2を計測するためのエッジの判定（ステッ
プS2）を行った後、タイマーをスタートさせる（ステッ
プS3）。タイマーのスタート後一定時間経過すると（ス
テップS4）、マイクロコンピュータ６は包絡線検波回路
３の出力をサンプルホールドするように命令し（ステッ
プS5）、更に、A/Dコンバータ５はサンプリングホール
ド回路４の出力電圧をディジタル電圧に変換するための
A/D変動動作を開始する（ステップS6）。A/D変換が完了
すると（ステップS7）、マイクロコンピュータ６はA/D
コンバータ５の出力データを読み込み（ステップS8）、
このデータをRAMに格納する。
う（ステップS1）。エッジを検出し立ち下がりエッジ
を検出すれば、Ａヘッドで得られたRF信号1a1を計測
し、立ち上がりエッジを検出すれば、Ｂヘッドで得ら
れたRF信号1a2を計測するためのエッジの判定（ステッ
プS2）を行った後、タイマーをスタートさせる（ステッ
プS3）。タイマーのスタート後一定時間経過すると（ス
テップS4）、マイクロコンピュータ６は包絡線検波回路
３の出力をサンプルホールドするように命令し（ステッ
プS5）、更に、A/Dコンバータ５はサンプリングホール
ド回路４の出力電圧をディジタル電圧に変換するための
A/D変動動作を開始する（ステップS6）。A/D変換が完了
すると（ステップS7）、マイクロコンピュータ６はA/D
コンバータ５の出力データを読み込み（ステップS8）、
このデータをRAMに格納する。
今、Ａヘッドの測定中であるとすれば、上記した状態に
おいては第３図のRF信号1a1の１のポイントのエンベロ
ープの電圧を測定したことになる。
おいては第３図のRF信号1a1の１のポイントのエンベロ
ープの電圧を測定したことになる。
この実施例では上記したエンベロープの測定を８回繰り
返すことになっているので、再び、ステップS3からステ
ップS9までの実行を繰り返し行う。そして、RF信号1a1
のポイント2,3,4,5,6,7,8のエンベロープの電圧を順に
測定する。
返すことになっているので、再び、ステップS3からステ
ップS9までの実行を繰り返し行う。そして、RF信号1a1
のポイント2,3,4,5,6,7,8のエンベロープの電圧を順に
測定する。
RF信号1a1の８回の測定を終了すると、今測定した８つ
のデータの平均値を演算して、この平均値をRAMに格納
する（ステップS10,S11）。
のデータの平均値を演算して、この平均値をRAMに格納
する（ステップS10,S11）。
そして、次に、既に計測した32回前までの平均値データ
を読み出して、これらの平均値データの最大値と最小値
を求める（ステップS12,S13）。
を読み出して、これらの平均値データの最大値と最小値
を求める（ステップS12,S13）。
次に、得られた最大値と最小値の比（最小値／最大値）
を演算して、この演算結果を表示器８に表示する（ステ
ップS14,S15）。
を演算して、この演算結果を表示器８に表示する（ステ
ップS14,S15）。
このように、この考案のDAT用のエンベロープアナライ
ザは、DATのヘッドがテープ上のトラックをトレースす
ることにより得られるRF信号を増幅するRFアンプと、こ
のRFアンプの出力を検波する包絡線検波回路と、この包
絡線検波回路の出力電圧をサンプリングしホールドする
サンプリングホールド回路と、このサンプリングホール
ド回路の出力電圧をディジタル電圧に変換するA/Dコン
バータと、サンプリングホールド回路とA/Dコンバータ
とを制御するマイクロコンピュータと、このマイクロコ
ンピュータの演算結果を表示する表示器とで構成したDA
T用のエンベロープアナライザにおいて、 RF信号のエンベロープを複数回計測するエンベロープ計
測手段と、このエンベロープ計測手段が複数回計測した
計測値の平均値を演算する第１の演算手段と、既に演算
した複数の平均値から最大値を探索する最大値探索手段
と、最小値を探索する最小値探索手段と、最大値探索手
段で得られた最大値と最小値探索手段で得られた最小値
との比率を演算する第２の演算手段とを設け、第２の演
算手段の演算結果を前記表示器に表示するように構成し
たものである。
ザは、DATのヘッドがテープ上のトラックをトレースす
ることにより得られるRF信号を増幅するRFアンプと、こ
のRFアンプの出力を検波する包絡線検波回路と、この包
絡線検波回路の出力電圧をサンプリングしホールドする
サンプリングホールド回路と、このサンプリングホール
ド回路の出力電圧をディジタル電圧に変換するA/Dコン
バータと、サンプリングホールド回路とA/Dコンバータ
とを制御するマイクロコンピュータと、このマイクロコ
ンピュータの演算結果を表示する表示器とで構成したDA
T用のエンベロープアナライザにおいて、 RF信号のエンベロープを複数回計測するエンベロープ計
測手段と、このエンベロープ計測手段が複数回計測した
計測値の平均値を演算する第１の演算手段と、既に演算
した複数の平均値から最大値を探索する最大値探索手段
と、最小値を探索する最小値探索手段と、最大値探索手
段で得られた最大値と最小値探索手段で得られた最小値
との比率を演算する第２の演算手段とを設け、第２の演
算手段の演算結果を前記表示器に表示するように構成し
たものである。
（ヘ）考案の効果 この考案に係るDAT用のエンベロープアナライザによれ
ば、前述のように構成したので、DATのテープパスの状
態を定量的に把握できる。
ば、前述のように構成したので、DATのテープパスの状
態を定量的に把握できる。
従って、この考案によるDAT用のエンベロープアナライ
ザでDATデッキのテープ走行系のメカニズム部分の調整
を行えば、調整者による個人誤差がなく、且つ、短時間
で調整を行うことができる。
ザでDATデッキのテープ走行系のメカニズム部分の調整
を行えば、調整者による個人誤差がなく、且つ、短時間
で調整を行うことができる。
しかも、構造が簡単であって、また安価に構成すること
ができるため実施も容易であるなどの優れた特長を有し
ている。
ができるため実施も容易であるなどの優れた特長を有し
ている。
第１図乃至第５図はこの考案に係るDAT用のエンベロー
プアナライザの実施例を示し、第１図は機能ブロック
図、第２図はハードウェアのブロック図、第３図はタイ
ミング図であって、第３図（Ａ）はヘッド切換信号の波
形図、第３図（Ｂ）はRF信号の波形図、第４図（Ａ）は
テープ上のトラックをヘッドがトレースする状態を模式
的に示した図、第４図（Ｂ）はトレース状態に応じたRF
信号の波形図、第５図（Ａ）及び第５図（Ｂ）はフロー
チャートである。 主な符号の説明 1,7:入力端子 1a,1a1，1a2，1a3，1a4:RF信号 2:RFアンプ 3:包絡線検波回路 4:サンプリングホールド回路 5:A/Dコンバータ 6:マイクロコンピュータ 7a:ヘッド切換信号 8:表示器 9:表示回路 10:操作スイッチ TA:テープ tr:トラック H:ヘッド
プアナライザの実施例を示し、第１図は機能ブロック
図、第２図はハードウェアのブロック図、第３図はタイ
ミング図であって、第３図（Ａ）はヘッド切換信号の波
形図、第３図（Ｂ）はRF信号の波形図、第４図（Ａ）は
テープ上のトラックをヘッドがトレースする状態を模式
的に示した図、第４図（Ｂ）はトレース状態に応じたRF
信号の波形図、第５図（Ａ）及び第５図（Ｂ）はフロー
チャートである。 主な符号の説明 1,7:入力端子 1a,1a1，1a2，1a3，1a4:RF信号 2:RFアンプ 3:包絡線検波回路 4:サンプリングホールド回路 5:A/Dコンバータ 6:マイクロコンピュータ 7a:ヘッド切換信号 8:表示器 9:表示回路 10:操作スイッチ TA:テープ tr:トラック H:ヘッド
Claims (1)
- 【請求項１】DATのヘッドがテープ上のトラックをトレ
ースすることにより得られるRF信号を増幅するRFアンプ
と、このRFアンプの出力を検波する包絡線検波回路と、
この包絡線検波回路の出力電圧をサンプリングしホール
ドするサンプリングホールド回路と、このサンプリング
ホールド回路の出力電圧をディジタル電圧に変換するA/
Dコンバータと、サンプリングホールド回路とA/Dコンバ
ータとを制御するマイクロコンピュータと、このマイク
ロコンピュータの演算結果を表示する表示器とで構成し
たDAT用のエンベロープアナライザにおいて、 RF信号のエンベロープを複数回計測するエンベロープ計
測手段と、このエンベロープ計測手段が複数回計測した
計測値の平均値を演算する第１の演算手段と、既に演算
した複数の平均値から最大値を探索する最大値探索手段
と、最小値を探索する最小値探索手段と、最大値探索手
段で得られた最大値と最小値探索手段で得られた最小値
との比率を演算する第２の演算手段とを設け、第２の演
算手段の演算結果を前記表示器に表示するように構成し
たことを特徴とするDAT用のエンベロープアナライザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7496389U JPH0650811Y2 (ja) | 1989-06-28 | 1989-06-28 | Ｄａｔ用のエンベロープアナライザ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7496389U JPH0650811Y2 (ja) | 1989-06-28 | 1989-06-28 | Ｄａｔ用のエンベロープアナライザ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0314707U JPH0314707U (ja) | 1991-02-14 |
| JPH0650811Y2 true JPH0650811Y2 (ja) | 1994-12-21 |
Family
ID=31615122
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7496389U Expired - Lifetime JPH0650811Y2 (ja) | 1989-06-28 | 1989-06-28 | Ｄａｔ用のエンベロープアナライザ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0650811Y2 (ja) |
-
1989
- 1989-06-28 JP JP7496389U patent/JPH0650811Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0314707U (ja) | 1991-02-14 |
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