JPH06178339A - 回線インタフェース保護回路 - Google Patents
回線インタフェース保護回路Info
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- JPH06178339A JPH06178339A JP4326954A JP32695492A JPH06178339A JP H06178339 A JPH06178339 A JP H06178339A JP 4326954 A JP4326954 A JP 4326954A JP 32695492 A JP32695492 A JP 32695492A JP H06178339 A JPH06178339 A JP H06178339A
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- circuit
- switch
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Abstract
(57)【要約】 （修正有）
【目的】サージ電流の流れ込みを低減し、小型化，ＩＣ
化に適した回線インタフェース保護回路を提供する。 【構成】回線端子１１，１２を回線インタフェース回路
７０または高電圧供給回路６１側に切換接続する経路切
換用スイッチ２５，２６と、回線端子と対アース間に接
続されたサイリスタ１〜４からなる１次保護回路１０
と、経路切換用スイッチの後段に設けられた２次保護回
路４０とを有し、サージ電流侵入時は、２次保護回路で
これを検出し、サイリスタからなる１次保護回路を動作
させる。
化に適した回線インタフェース保護回路を提供する。 【構成】回線端子１１，１２を回線インタフェース回路
７０または高電圧供給回路６１側に切換接続する経路切
換用スイッチ２５，２６と、回線端子と対アース間に接
続されたサイリスタ１〜４からなる１次保護回路１０
と、経路切換用スイッチの後段に設けられた２次保護回
路４０とを有し、サージ電流侵入時は、２次保護回路で
これを検出し、サイリスタからなる１次保護回路を動作
させる。
Description
【０００１】
【産業上の利用分野】本発明はディジタル交換機等の回
線インタフェース回路を外雷サージから保護するための
回線インタフェース保護回路に関する。
線インタフェース回路を外雷サージから保護するための
回線インタフェース保護回路に関する。
【０００２】
【従来の技術】従来のこの種の装置としては、図７に示
すものが知られている。
すものが知られている。
【０００３】図７において、１１および１２は電話機等
が接続されるアナログ回線の回線端子で、１１はＴＩＰ
回線端子，１２はＲＩＮＧ回線端子である。
が接続されるアナログ回線の回線端子で、１１はＴＩＰ
回線端子，１２はＲＩＮＧ回線端子である。
【０００４】また、７０は給電，監視，ハイブリッド等
のＢＳＨ機能を有するインタフェース回路で、負の電流
を供給されるＶＢＮ端子８０と、ＶＢＮ−ＧＮＤの電源
で動作するオペアンプ７１，７２が設けられている。
のＢＳＨ機能を有するインタフェース回路で、負の電流
を供給されるＶＢＮ端子８０と、ＶＢＮ−ＧＮＤの電源
で動作するオペアンプ７１，７２が設けられている。
【０００５】また、スイッチ２５，２６はＴＩＰ回線端
子１１，ＲＩＮＧ回線端子１２とインターフェース回路
７０との接続、切断を行うもので、これらのスイッチ２
５、２６は制御回路６２によってＡ接点側またはＢ接点
側に切り換えられる。
子１１，ＲＩＮＧ回線端子１２とインターフェース回路
７０との接続、切断を行うもので、これらのスイッチ２
５、２６は制御回路６２によってＡ接点側またはＢ接点
側に切り換えられる。
【０００６】なお、バリスタ３１、３２は外雷サージを
吸収する低電圧クランプ型バリスタで、共に接地されて
いる。また、４１，４２は抵抗、４３〜４６はダイオー
ドである。
吸収する低電圧クランプ型バリスタで、共に接地されて
いる。また、４１，４２は抵抗、４３〜４６はダイオー
ドである。
【０００７】図７で、例えば電話回線のＴＩＰ線が接続
されたＴＩＰ回線端子１１から正のサージが侵入した場
合、バリスタ３１により吸収され、ＴＩＰ回線端子１１
のＧＮＤに対する電圧はある所定値ＶC1にクランプされ
る。
されたＴＩＰ回線端子１１から正のサージが侵入した場
合、バリスタ３１により吸収され、ＴＩＰ回線端子１１
のＧＮＤに対する電圧はある所定値ＶC1にクランプされ
る。
【０００８】このとき、経路切換用スイッチ２５が同図
に示す如く接点Ａ側に接続されていると、スイッチ２
５，抵抗４１，ダイオード４３を経てサージ電流ＩC1が
ＧＮＤ側に流れる。
に示す如く接点Ａ側に接続されていると、スイッチ２
５，抵抗４１，ダイオード４３を経てサージ電流ＩC1が
ＧＮＤ側に流れる。
【０００９】そして、ダイオード４３の順方向電圧は上
記所定値ＶC1に比べて非常に小さく、またスイッチ２５
のＯＮ抵抗は抵抗４１の抵抗値に比して非常に小さいの
で、この場合、サージ電流ＩC1は抵抗４１の抵抗値をＲ
1 とすると次式で示されることになる。
記所定値ＶC1に比べて非常に小さく、またスイッチ２５
のＯＮ抵抗は抵抗４１の抵抗値に比して非常に小さいの
で、この場合、サージ電流ＩC1は抵抗４１の抵抗値をＲ
1 とすると次式で示されることになる。
【００１０】ＩC1＝ＶC1／Ｒ1 …
【００１１】
【発明が解決しようとする課題】ところで、従来の回線
インターフェース保護回路では、経路切換用スイッチ２
５が接点Ｂ側に接続されて、リンガー，メッセージウェ
イティング等の際に、高電圧供給回路（ＨＶＳ）６１か
ら高電圧が印加される場合、バリスタ３１がＯＮするこ
とがないように上記電圧値ＶC1は非常に高い値に設定し
なければならなかった。従って、サージ電流ＩC1も前記
式から分かるように非常に大きな値になってしまい、
スイッチ２５や抵抗４１、またダイオード４３に、非常
に大きな電力容量のものを使用する必要があった。
インターフェース保護回路では、経路切換用スイッチ２
５が接点Ｂ側に接続されて、リンガー，メッセージウェ
イティング等の際に、高電圧供給回路（ＨＶＳ）６１か
ら高電圧が印加される場合、バリスタ３１がＯＮするこ
とがないように上記電圧値ＶC1は非常に高い値に設定し
なければならなかった。従って、サージ電流ＩC1も前記
式から分かるように非常に大きな値になってしまい、
スイッチ２５や抵抗４１、またダイオード４３に、非常
に大きな電力容量のものを使用する必要があった。
【００１２】このことは、結果としてコスト高を招くだ
けでなく、回路部品をＩＣ化しようとした場合に実際上
困難となり、このため回路の小型化も実現しずらいとい
う不具合があった。
けでなく、回路部品をＩＣ化しようとした場合に実際上
困難となり、このため回路の小型化も実現しずらいとい
う不具合があった。
【００１３】なお、以上の説明ではＴＩＰ回線端子１１
に正のサージが侵入した場合について説明したが、ＴＩ
Ｐ回線端子１１に負のサージが侵入した場合やＲＩＮＧ
回線端子１２に正や負のサージが侵入した場合も同様の
不具合が生じた。
に正のサージが侵入した場合について説明したが、ＴＩ
Ｐ回線端子１１に負のサージが侵入した場合やＲＩＮＧ
回線端子１２に正や負のサージが侵入した場合も同様の
不具合が生じた。
【００１４】本発明は、上記の如き課題に鑑みてなされ
たもので、回線インターフェース保護回路に流れるサー
ジ電流を低レベルに抑えることができ、かつ小型化，Ｉ
Ｃ化に適した回線インタフェース保護回路を提供するこ
とを目的とする。
たもので、回線インターフェース保護回路に流れるサー
ジ電流を低レベルに抑えることができ、かつ小型化，Ｉ
Ｃ化に適した回線インタフェース保護回路を提供するこ
とを目的とする。
【００１５】
【課題を解決するための手段】本発明は上記目的を達成
するために、回線端子と回線インタフェース回路間に介
挿されて、サージ電流から上記回線インタフェース回路
を保護する回線インタフェース保護回路において、上記
回線端子を上記回線インタフェース回路または内部の高
電圧供給回路側に切換接続する経路切換用スイッチと、
上記回線端子と対アース間に接続されたサイリスタから
なる１次保護回路と、上記経路切換用スイッチの後段に
設けられた２次保護回路と、を有し、サージ電流侵入時
は、上記２次保護回路でこれを検出し、上記サイリスタ
からなる１次保護回路を動作させることを特徴とする。
するために、回線端子と回線インタフェース回路間に介
挿されて、サージ電流から上記回線インタフェース回路
を保護する回線インタフェース保護回路において、上記
回線端子を上記回線インタフェース回路または内部の高
電圧供給回路側に切換接続する経路切換用スイッチと、
上記回線端子と対アース間に接続されたサイリスタから
なる１次保護回路と、上記経路切換用スイッチの後段に
設けられた２次保護回路と、を有し、サージ電流侵入時
は、上記２次保護回路でこれを検出し、上記サイリスタ
からなる１次保護回路を動作させることを特徴とする。
【００１６】本発明は上記目的を達成するために、回線
端子と回線インタフェース回路間に介挿されて、サージ
電流から上記回線インタフェース回路を保護する回線イ
ンタフェース保護回路において、上記回線端子と対アー
ス間に接続された低電圧クランプ型のバリスタと、上記
回線端子を上記回線インターフェース回路側または内部
の高電圧供給回路側に切換接続する第１のスイッチと、
上記回線端子と上記バリスタ間に挿入された第２のスイ
ッチを有し、上記第１のスイッチが高電圧供給回路側に
接続されているときには上記第２のスイッチをオフ状態
にし、高電圧が上記バリスタ側に供給されないようにし
たことを特徴とする。
端子と回線インタフェース回路間に介挿されて、サージ
電流から上記回線インタフェース回路を保護する回線イ
ンタフェース保護回路において、上記回線端子と対アー
ス間に接続された低電圧クランプ型のバリスタと、上記
回線端子を上記回線インターフェース回路側または内部
の高電圧供給回路側に切換接続する第１のスイッチと、
上記回線端子と上記バリスタ間に挿入された第２のスイ
ッチを有し、上記第１のスイッチが高電圧供給回路側に
接続されているときには上記第２のスイッチをオフ状態
にし、高電圧が上記バリスタ側に供給されないようにし
たことを特徴とする。
【００１７】
【作用】本発明では、経路切換用スイッチの後段に設け
た２次保護回路に流れるサージ電流を検出して経路切換
用スイッチの前段にある１次保護回路が動作するように
なっているので、自回路からの高電圧によって１次保護
回路が誤動作することはなく、しかも外部からのサージ
電流が経路切換用スイッチや２次保護回路に流れ込む量
を最小限に抑えることができる。
た２次保護回路に流れるサージ電流を検出して経路切換
用スイッチの前段にある１次保護回路が動作するように
なっているので、自回路からの高電圧によって１次保護
回路が誤動作することはなく、しかも外部からのサージ
電流が経路切換用スイッチや２次保護回路に流れ込む量
を最小限に抑えることができる。
【００１８】本発明では、回線端子と高電圧供給回路が
接続されているときには第２のスイッチをオフにするの
で、バリスタ側に高電圧が供給されることを完全に防止
でき、これによってサージ電流のレベルを低レベルに抑
えることができる。
接続されているときには第２のスイッチをオフにするの
で、バリスタ側に高電圧が供給されることを完全に防止
でき、これによってサージ電流のレベルを低レベルに抑
えることができる。
【００１９】従って、従来に比して小容量の回路部品で
保護回路を構成でき、小型化、ＩＣ化に適した保護回路
とすることができる。
保護回路を構成でき、小型化、ＩＣ化に適した保護回路
とすることができる。
【００２０】
【実施例】以下、本発明を図面に基づいて説明する。
【００２１】なお、以下の説明では、上記図７に示した
従来例と同一構成部分には同一符号を付して説明する。
図１は本発明が適用された一実施例の回路図である。ま
ず、構成を説明すると、１１および１２は電話機等が接
続されるアナログ回線の回線端子で、１１はＴＩＰ回線
端子，１２はＲＩＮＧ回線端子である。
従来例と同一構成部分には同一符号を付して説明する。
図１は本発明が適用された一実施例の回路図である。ま
ず、構成を説明すると、１１および１２は電話機等が接
続されるアナログ回線の回線端子で、１１はＴＩＰ回線
端子，１２はＲＩＮＧ回線端子である。
【００２２】一方、７０は給電，監視，ハイブリッド等
のＢＳＨ機能を有するインタフェース回路で、負の電源
を供給するＶＢＮ端子８０と、ＶＢＮ−ＧＮＤの電源で
動作するオペアンプ７１，７２が設けられている。
のＢＳＨ機能を有するインタフェース回路で、負の電源
を供給するＶＢＮ端子８０と、ＶＢＮ−ＧＮＤの電源で
動作するオペアンプ７１，７２が設けられている。
【００２３】また、スイッチ２５，２６はＴＩＰ回線端
子１１，ＲＩＮＧ回線端子１２とインターフェース回路
７０との接続、切断を行うもので、これらのスイッチ２
５、２６は制御回路６２によってＡ接点側またはＢ接点
側に切り換えられる。
子１１，ＲＩＮＧ回線端子１２とインターフェース回路
７０との接続、切断を行うもので、これらのスイッチ２
５、２６は制御回路６２によってＡ接点側またはＢ接点
側に切り換えられる。
【００２４】また、この経路切換用スイッチ２５，２６
の前段には、１〜４のサイリスタで構成される第１の保
護回路１０が設けられているとともに、後段には抵抗４
１，４２およびダイオード４３〜４６より構成される第
２の保護回路４０が設けられている。
の前段には、１〜４のサイリスタで構成される第１の保
護回路１０が設けられているとともに、後段には抵抗４
１，４２およびダイオード４３〜４６より構成される第
２の保護回路４０が設けられている。
【００２５】なお、６１は高電圧供給回路（ＨＶＳ）で
ある。
ある。
【００２６】ところで、回線インタフェース回路７０側
では、ＧＮＤ−ＶＢＮの電源で動作するオペアンプ７
１，７２の出力に、外雷サージに起因してＧＮＤレベル
より過度に高い電圧や、ＢＶＮレベルより過度に低い電
圧が印加されるとオペアンプ７１，７２は破壊されてし
まう。このため、回線インタフェース回路７０を保護す
る保護回路を設けなければならない。以下、本実施例に
おけるこの場合の保護動作を説明する。
では、ＧＮＤ−ＶＢＮの電源で動作するオペアンプ７
１，７２の出力に、外雷サージに起因してＧＮＤレベル
より過度に高い電圧や、ＢＶＮレベルより過度に低い電
圧が印加されるとオペアンプ７１，７２は破壊されてし
まう。このため、回線インタフェース回路７０を保護す
る保護回路を設けなければならない。以下、本実施例に
おけるこの場合の保護動作を説明する。
【００２７】いま、１１１例えば、経路切換用スイッチ
２５が図１に示す如く接点Ａ側にある場合に、ＴＩＰ回
線端子１１に正のサージが侵入してきたとすると、その
時点ではサイリスタ１のゲート電位はカソードよりも低
く、サイリスタ１はＯＦＦ状態であるので、サージ電流
ＩC2はスイッチ２５，抵抗４１，ダイオード４３を経て
ＧＮＤに流れる。そして、この場合は、サイリスタ１の
ゲートには、抵抗４１の電圧降下分と、ダイオード４３
の順方向電圧が加算された電圧が印加される。次に、サ
ージ電流ＩC2が増加して所定値ＩP1に達し、これに対応
してサイリスタ１のゲートにＶP1が印加されると、サイ
リスタ１がＯＮし、サージ電流ＩC2の大部分はサイリス
タ１を介してＧＮＤに流れる。従って、ＴＩＰ回線端子
１１は低電位にクランプされ、２次保護回路４０側へ流
れるサージ電流ＩC2は低レベルに抑えられる。そして、
サイリスタ１はサージ電流がなくなるまではＯＮ状態を
保ち、サージ電流がなくなるとＯＦＦとなり、通常モー
ドに戻る。
２５が図１に示す如く接点Ａ側にある場合に、ＴＩＰ回
線端子１１に正のサージが侵入してきたとすると、その
時点ではサイリスタ１のゲート電位はカソードよりも低
く、サイリスタ１はＯＦＦ状態であるので、サージ電流
ＩC2はスイッチ２５，抵抗４１，ダイオード４３を経て
ＧＮＤに流れる。そして、この場合は、サイリスタ１の
ゲートには、抵抗４１の電圧降下分と、ダイオード４３
の順方向電圧が加算された電圧が印加される。次に、サ
ージ電流ＩC2が増加して所定値ＩP1に達し、これに対応
してサイリスタ１のゲートにＶP1が印加されると、サイ
リスタ１がＯＮし、サージ電流ＩC2の大部分はサイリス
タ１を介してＧＮＤに流れる。従って、ＴＩＰ回線端子
１１は低電位にクランプされ、２次保護回路４０側へ流
れるサージ電流ＩC2は低レベルに抑えられる。そして、
サイリスタ１はサージ電流がなくなるまではＯＮ状態を
保ち、サージ電流がなくなるとＯＦＦとなり、通常モー
ドに戻る。
【００２８】図２および図３は、上記内容における、従
来例との比較を示す作用説明図であり、図２にはＴＩＰ
回線端子１１に印加される電圧値が、また図３には経路
切換用スイッチ２５を流れるサージ電流が示されてい
る。 １図２において、ＶC1は従
来例、ＶC2は本実施例の場合を示し、図３において、Ｉ
C1は従来例、ＩC2は本実施例の場合を示しているが、本
実施例の場合、従来例に比してＴＩＰ回路端子１１に印
加される電圧値や経路切換用スイッチ２５を流れるサー
ジ電流は大幅に低レベルになっていることがわかる。
来例との比較を示す作用説明図であり、図２にはＴＩＰ
回線端子１１に印加される電圧値が、また図３には経路
切換用スイッチ２５を流れるサージ電流が示されてい
る。 １図２において、ＶC1は従
来例、ＶC2は本実施例の場合を示し、図３において、Ｉ
C1は従来例、ＩC2は本実施例の場合を示しているが、本
実施例の場合、従来例に比してＴＩＰ回路端子１１に印
加される電圧値や経路切換用スイッチ２５を流れるサー
ジ電流は大幅に低レベルになっていることがわかる。
【００２９】一方、経路切換用スイッチ２５が接点Ｂと
接続されて高電圧供給回路６１からＴＩＰ回線端子１１
に高電圧を供給しているときには、サイリスタ１のゲー
ト電位はカソードより低いレベルのままなのでサイリス
タ１はＯＦＦ状態のままである。従って、高電圧供給回
路（ＨＶＳ）６１からの高電圧出力により誤動作するこ
とはない。
接続されて高電圧供給回路６１からＴＩＰ回線端子１１
に高電圧を供給しているときには、サイリスタ１のゲー
ト電位はカソードより低いレベルのままなのでサイリス
タ１はＯＦＦ状態のままである。従って、高電圧供給回
路（ＨＶＳ）６１からの高電圧出力により誤動作するこ
とはない。
【００３０】なお、以上の説明では、ＴＩＰ回線端子１
１に正のサージが侵入した場合について説明したが、Ｔ
ＩＰ回線に負のサージが侵入した場合や、ＲＩＮＧ回線
端子１２に正や負のサージが侵入した場合も同様の効果
を有することは勿論である。以上説明したように、本実
施例では、経路切換用スイッチ２５，２６の後段に設け
た２次保護回路４０に流れるサージ電流ＩC2を検出して
経路切換用スイッチ２５，２６の前段にある１次保護回
路が動作するようになっているので、自回路の高電圧供
給回路（ＨＶＳ）６１からの高電圧出力により１次保護
回路１０が誤動作することもなく、しかも外部からのサ
ージ経路切換用スイッチ２５，２６や２次保護回路４０
側に流れ込むサージ電流を最小限に抑えることができ
る。このため、保護回路を構成する各回路部品も小容量
のもので済み、小型化，ＩＣ化に適した回線インタフェ
ース保護回路とすることができる。
１に正のサージが侵入した場合について説明したが、Ｔ
ＩＰ回線に負のサージが侵入した場合や、ＲＩＮＧ回線
端子１２に正や負のサージが侵入した場合も同様の効果
を有することは勿論である。以上説明したように、本実
施例では、経路切換用スイッチ２５，２６の後段に設け
た２次保護回路４０に流れるサージ電流ＩC2を検出して
経路切換用スイッチ２５，２６の前段にある１次保護回
路が動作するようになっているので、自回路の高電圧供
給回路（ＨＶＳ）６１からの高電圧出力により１次保護
回路１０が誤動作することもなく、しかも外部からのサ
ージ経路切換用スイッチ２５，２６や２次保護回路４０
側に流れ込むサージ電流を最小限に抑えることができ
る。このため、保護回路を構成する各回路部品も小容量
のもので済み、小型化，ＩＣ化に適した回線インタフェ
ース保護回路とすることができる。
【００３１】次に、本発明の第２の実施例を図４に基づ
いて説明する。なお、図１に示した第１の実施例と同一
構成部分には同一符号を付して、重複した説明は省略す
る。この図４に示す実施例では、２次保護回路４０側に
抵抗４７〜５０を新たに設け、サイリスタ１〜４のゲー
ト電流を制御している。このような構成によれば、抵抗
４７〜５０の抵抗値を可変設定することにより、サイリ
スタ１〜４がＯＮする感度を容易に調整できる。次に、
本発明の第３の実施例を図５に基づいて説明する。な
お、図４に示した第２の実施例と同一構成部分には同一
符号を付し、重複した説明は省略する。
いて説明する。なお、図１に示した第１の実施例と同一
構成部分には同一符号を付して、重複した説明は省略す
る。この図４に示す実施例では、２次保護回路４０側に
抵抗４７〜５０を新たに設け、サイリスタ１〜４のゲー
ト電流を制御している。このような構成によれば、抵抗
４７〜５０の抵抗値を可変設定することにより、サイリ
スタ１〜４がＯＮする感度を容易に調整できる。次に、
本発明の第３の実施例を図５に基づいて説明する。な
お、図４に示した第２の実施例と同一構成部分には同一
符号を付し、重複した説明は省略する。
【００３２】ところで、この第３の実施例では、第２の
実施例の構成に加えて、コンデンサ５１〜５４を設け、
サイリスタ１〜４のゲート電流制限用フィルタとしてい
る。このような構成によると、例えば抵抗４７とコンデ
ンサ５１によって１つのローパスフィルタが構成され、
経路切換用スイッチ２５，２６の開閉によるノイズを吸
収して、さらに安定した動作を有する回線インタフェー
ス保護回路とすることができる。
実施例の構成に加えて、コンデンサ５１〜５４を設け、
サイリスタ１〜４のゲート電流制限用フィルタとしてい
る。このような構成によると、例えば抵抗４７とコンデ
ンサ５１によって１つのローパスフィルタが構成され、
経路切換用スイッチ２５，２６の開閉によるノイズを吸
収して、さらに安定した動作を有する回線インタフェー
ス保護回路とすることができる。
【００３３】以上、図１、図２、図３、図４、図５を用
いて説明したように、上記実施例においては、経路切換
用スイッチの後段に設けた２次保護回路に流れるサージ
電流を検出して経路切換用スイッチの前段に設けた１次
保護回路が動作するようにしているので、自回路からの
高電圧出力により一次保護回路が誤動作することがない
とともに外部からのサージ電流が経路切換用スイッチお
よび２次保護回路に流れ込む量を最小限に抑えることが
できる。
いて説明したように、上記実施例においては、経路切換
用スイッチの後段に設けた２次保護回路に流れるサージ
電流を検出して経路切換用スイッチの前段に設けた１次
保護回路が動作するようにしているので、自回路からの
高電圧出力により一次保護回路が誤動作することがない
とともに外部からのサージ電流が経路切換用スイッチお
よび２次保護回路に流れ込む量を最小限に抑えることが
できる。
【００３４】図６は他の一実施例を示す回路図である。
【００３５】なお、以下の説明では前記図７に示したも
のと同一構成部分には同一符号を付して説明する。
のと同一構成部分には同一符号を付して説明する。
【００３６】まず、構成を説明すると、１１および１２
は電話機等が接続されるアナログ回線の回線端子で、１
１はＴＩＰ回線端子，１２はＲＩＮＧ回線端子である。
は電話機等が接続されるアナログ回線の回線端子で、１
１はＴＩＰ回線端子，１２はＲＩＮＧ回線端子である。
【００３７】一方、７０は給電，監視，ハイブリッド等
のＢＳＨ機能を有するインタフェース回路で、負の電流
を供給されるＶＢＮ端子８０と、ＶＢＮ−ＧＮＤの電源
で動作するオペアンプ７１，７２が設けられている。
のＢＳＨ機能を有するインタフェース回路で、負の電流
を供給されるＶＢＮ端子８０と、ＶＢＮ−ＧＮＤの電源
で動作するオペアンプ７１，７２が設けられている。
【００３８】また、スイッチ２５，２６（第１のスイッ
チ）はＴＩＰ回線端子１１，ＲＩＮＧ回線端子１２とイ
ンターフェース回路７０との接続、切断を行うもので、
これらのスイッチ２５、２６は制御回路６２によってＡ
接点側またはＢ接点側に切り換えられる。
チ）はＴＩＰ回線端子１１，ＲＩＮＧ回線端子１２とイ
ンターフェース回路７０との接続、切断を行うもので、
これらのスイッチ２５、２６は制御回路６２によってＡ
接点側またはＢ接点側に切り換えられる。
【００３９】また、スイッチ２１、２２（第２のスイッ
チ）は前記図６に示す回路に新たにもうけられたもの
で、このスイッチ２１、２２はバリスタ３１、３２と高
電圧供給回路（ＨＶＳ）６１との接続をオン、オフする
第２のスイッチで、同じく制御回路６２によって制御さ
れる。
チ）は前記図６に示す回路に新たにもうけられたもの
で、このスイッチ２１、２２はバリスタ３１、３２と高
電圧供給回路（ＨＶＳ）６１との接続をオン、オフする
第２のスイッチで、同じく制御回路６２によって制御さ
れる。
【００４０】なお、バリスタ３１、３２は外雷サージを
吸収する低電圧クランプ型バリスタで、共に接地されて
いる。また、４１，４２は抵抗、４３〜４６はダイオー
ドである。
吸収する低電圧クランプ型バリスタで、共に接地されて
いる。また、４１，４２は抵抗、４３〜４６はダイオー
ドである。
【００４１】以上が本実施例の構成であるが、次にその
動作を説明する。
動作を説明する。
【００４２】まず、ＴＩＰ回線端子１１およびＲＩＮＧ
回線端子１２に接続された図示しない電話機がオンフッ
ク状態または通話状態のときは、制御回路６２は第１の
スイッチ２５、２６を接点Ａ側に接続し、第２のスイッ
チ２１、２２をオン状態にする。
回線端子１２に接続された図示しない電話機がオンフッ
ク状態または通話状態のときは、制御回路６２は第１の
スイッチ２５、２６を接点Ａ側に接続し、第２のスイッ
チ２１、２２をオン状態にする。
【００４３】一方、高電圧供給回路６１から、ＴＩＰ回
線端子１１やＲＩＮＧ回線端子１２にリンガーやメッセ
ージウェイティング等の高電圧を供給する場合、制御回
路６２は第１のスイッチ２５、２６を接点Ｂ側に接続
し、かつ第２のスイッチ２１、２２をオフ状態にする。
これにより高電圧供給回路６１から高電圧がＴＩＰ回線
端子１１およびＲＩＮＧ回線端子１２側に供給されてい
る場合において、バリスタ３１や３２がオンすることを
確実に防止でき、これによって、バリスタ３１、３２は
低電圧型のものを使用できるので、内部回路へのサージ
電流の流れ込みを防止できるとともに、スイッチのＩＣ
化も可能となり、低コスト、小型化された回線インター
フェース保護回路を得ることができることになる。
線端子１１やＲＩＮＧ回線端子１２にリンガーやメッセ
ージウェイティング等の高電圧を供給する場合、制御回
路６２は第１のスイッチ２５、２６を接点Ｂ側に接続
し、かつ第２のスイッチ２１、２２をオフ状態にする。
これにより高電圧供給回路６１から高電圧がＴＩＰ回線
端子１１およびＲＩＮＧ回線端子１２側に供給されてい
る場合において、バリスタ３１や３２がオンすることを
確実に防止でき、これによって、バリスタ３１、３２は
低電圧型のものを使用できるので、内部回路へのサージ
電流の流れ込みを防止できるとともに、スイッチのＩＣ
化も可能となり、低コスト、小型化された回線インター
フェース保護回路を得ることができることになる。
【００４４】
【発明の効果】以上説明したように、本発明の回線イン
ターフェース保護回路によれば、この回線インターフェ
ース保護回路に流れるサージ電流を低レベルに抑えるこ
とができる。
ターフェース保護回路によれば、この回線インターフェ
ース保護回路に流れるサージ電流を低レベルに抑えるこ
とができる。
【００４５】従って回線インターフェース保護回路を構
成する各回路部品も小容量のものが使用できるため、小
型化、ＩＣ化に適した回線インターフェース保護回路を
得ることができる。
成する各回路部品も小容量のものが使用できるため、小
型化、ＩＣ化に適した回線インターフェース保護回路を
得ることができる。
【図面の簡単な説明】
【図１】第１の実施例を示す回路図。
【図２】図１に示した実施例と従来例の作用比較図で、
ＴＩＰ回線端子に印加される電圧値を示す図。
ＴＩＰ回線端子に印加される電圧値を示す図。
【図３】図１に示した実施例と従来例の作用比較図で、
経路切換用スイッチを流れるサージ電流を示す図。
経路切換用スイッチを流れるサージ電流を示す図。
【図４】第２の実施例を示す回路図。
【図５】第３の実施例を示す回路図。
【図６】他の実施例を示す回路図。
【図７】従来例を示す回路図。
１〜４ サイリスタ １０ １次保護回路 １１ ＴＩＰ回線端子 １２ ＲＩＮＧ回線端子 ２５，２６ 経路切換用スイッチ（第１のスイッチ） ４０ ２次保護回路 ４１，４２，４７，４８，４９，５０ 抵抗 ４３〜４６ ダイオード ５１〜５４ コンデンサ ６１ 高電圧供給回路 ７０ 回線インタフェース回路 ７１，７２ オペアンプ ８０ ＶＢＮ端子 ２１、２２ スイッチ（第２のスイッチ） ６２ 制御回路
Claims (2)
- 【請求項１】 回線端子と回線インタフェース回路
間に介挿されて、サージ電流から上記回線インタフェー
ス回路を保護する回線インタフェース保護回路におい
て、 上記回線端子を上記回線インタフェース回路側または内
部の高電圧供給回路側に切換接続する経路切換用スイッ
チと、 上記回線端子と対アース間に接続されたサイリスタから
なる１次保護回路と、 上記経路切換用スイッチの後段に設けられた２次保護回
路と、を有し、 サージ電流浸入時は、上記２次保護回路でこれを検出
し、上記サイリスタからなる１次保護回路を動作させる
ことを特徴とする回線インタフェース保護回路。 - 【請求項２】 回線端子と回線インタフェース回路
間に介挿されて、サージ電流から上記回線インタフェー
ス回路を保護する回線インタフェース保護回路におい
て、 上記回線端子と対アース間に接続された低電圧クランプ
型のバリスタと、 上記回線端子を上記回線インターフェース回路側または
内部の高電圧供給回路側に切換接続する第１のスイッチ
と、 上記回線端子と上記バリスタ間に挿入された第２のスイ
ッチを有し、 上記第１のスイッチが高電圧供給回路側に接続されてい
るときには上記第２のスイッチをオフ状態にし、高電圧
が上記バリスタ側に供給されないようにしたことを特徴
とする回線インタフェース保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4326954A JPH06178339A (ja) | 1992-12-07 | 1992-12-07 | 回線インタフェース保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4326954A JPH06178339A (ja) | 1992-12-07 | 1992-12-07 | 回線インタフェース保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06178339A true JPH06178339A (ja) | 1994-06-24 |
Family
ID=18193638
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4326954A Pending JPH06178339A (ja) | 1992-12-07 | 1992-12-07 | 回線インタフェース保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06178339A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009515324A (ja) * | 2005-10-19 | 2009-04-09 | リトルフューズ、インク | スタック化集積回路チップ・アセンブリ |
| JP2011055492A (ja) * | 2009-08-31 | 2011-03-17 | Zarlink Semiconductor (Us) Inc | 共有の正の保護を制御するための方法および装置 |
-
1992
- 1992-12-07 JP JP4326954A patent/JPH06178339A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009515324A (ja) * | 2005-10-19 | 2009-04-09 | リトルフューズ、インク | スタック化集積回路チップ・アセンブリ |
| JP2011055492A (ja) * | 2009-08-31 | 2011-03-17 | Zarlink Semiconductor (Us) Inc | 共有の正の保護を制御するための方法および装置 |
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