JPH0576165A - ゲートパルスの伝送方式 - Google Patents
ゲートパルスの伝送方式Info
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- JPH0576165A JPH0576165A JP25978591A JP25978591A JPH0576165A JP H0576165 A JPH0576165 A JP H0576165A JP 25978591 A JP25978591 A JP 25978591A JP 25978591 A JP25978591 A JP 25978591A JP H0576165 A JPH0576165 A JP H0576165A
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Abstract
(57)【要約】
【目的】 サイリスタを用いた電力変換装置のゲートパ
ルス伝送方式において、配線本数を低減し、さらに、ゲ
ートパルス伝送の信頼性向上を図ることにある。 【構成】 多相の電力に変換する電力変換装置におい
て、各相パルスを１つのパルス列に変換するシリアル変
換回路と、前記パルス列のパルスの基準を判別するため
のデータを作成する基準データ発生回路と、前記シリア
ル変換回路と前記基準データ発生回路の出力の論理和を
とり、１つのシリアル信号として信号を送信する送信回
路とからなるゲートパルス発生器、および、前記ゲート
パルス発生器の出力を受信し、パルスの基準データより
パルス列の信号の基準を判別するデコード回路と、パル
ス列の立上りを検出するパルスエッヂ検出回路と、前記
デコード回路と前記パルスエッヂ検出回路の出力とから
多相のパルスに分配する分配回路とかせなるパルス増幅
器を有し、両者間のパルス伝送を１つのシリアル信号に
より行う。
ルス伝送方式において、配線本数を低減し、さらに、ゲ
ートパルス伝送の信頼性向上を図ることにある。 【構成】 多相の電力に変換する電力変換装置におい
て、各相パルスを１つのパルス列に変換するシリアル変
換回路と、前記パルス列のパルスの基準を判別するため
のデータを作成する基準データ発生回路と、前記シリア
ル変換回路と前記基準データ発生回路の出力の論理和を
とり、１つのシリアル信号として信号を送信する送信回
路とからなるゲートパルス発生器、および、前記ゲート
パルス発生器の出力を受信し、パルスの基準データより
パルス列の信号の基準を判別するデコード回路と、パル
ス列の立上りを検出するパルスエッヂ検出回路と、前記
デコード回路と前記パルスエッヂ検出回路の出力とから
多相のパルスに分配する分配回路とかせなるパルス増幅
器を有し、両者間のパルス伝送を１つのシリアル信号に
より行う。
Description
【０００１】
【産業上の利用分野】本発明は、ゲートパルス伝送方
式、特に、サイリスタを用いた電力変換装置において、
ゲートパルス発生器からパルス増幅器に伝送するゲート
パルス伝送方式に関する。
式、特に、サイリスタを用いた電力変換装置において、
ゲートパルス発生器からパルス増幅器に伝送するゲート
パルス伝送方式に関する。
【０００２】
【従来の技術】従来のゲートパルスの伝送においては、
サイリスタ１個に１対の信号線が必要であり、サイクロ
コンバータ等サイリスタ数の多いシステムにおいては信
号線が多くなり、価格、工数共に増大するという問題が
ある。例えば、ゲートパルス発生器とパルス増幅器との
伝送が１相のサイリスタに対し、１対の信号ケーブルを
用いるため、三相全波整流回路１回路に対し、６対の信
号線が必要である。また、大容量システムにおいては、
主回路電圧が高く、ノイズ耐量アップのため、パルスア
ンプ、パルストランスによりパルス電圧を上げて送信し
ており、このため盤面数の増大、コストアップ等の問題
がある。また、信号線が長くなると、信号間クロストー
クの影響を受けないように、布線の仕方を考慮しなけれ
ばならない等の問題があり、この問題解決のため、電気
を光に変え、光にて伝送する手段もあるが、１対１イン
ターフェイスの場合、光ケーブルの本数が多いため、価
格的に採用しずらいという問題がある。
サイリスタ１個に１対の信号線が必要であり、サイクロ
コンバータ等サイリスタ数の多いシステムにおいては信
号線が多くなり、価格、工数共に増大するという問題が
ある。例えば、ゲートパルス発生器とパルス増幅器との
伝送が１相のサイリスタに対し、１対の信号ケーブルを
用いるため、三相全波整流回路１回路に対し、６対の信
号線が必要である。また、大容量システムにおいては、
主回路電圧が高く、ノイズ耐量アップのため、パルスア
ンプ、パルストランスによりパルス電圧を上げて送信し
ており、このため盤面数の増大、コストアップ等の問題
がある。また、信号線が長くなると、信号間クロストー
クの影響を受けないように、布線の仕方を考慮しなけれ
ばならない等の問題があり、この問題解決のため、電気
を光に変え、光にて伝送する手段もあるが、１対１イン
ターフェイスの場合、光ケーブルの本数が多いため、価
格的に採用しずらいという問題がある。
【０００３】
【発明が解決しようとする課題】本発明の目的は、上記
事情に鑑み、配線本数を低減し、さらに、ゲートパルス
伝送の信頼性向上を図ることにある。
事情に鑑み、配線本数を低減し、さらに、ゲートパルス
伝送の信頼性向上を図ることにある。
【０００４】
【課題を解決するための手段】前記目的を達成するため
に、ゲートパルス発生器に多相のパルス信号を１つのパ
ルス列に変換するシリアル変換回路とそのパルス列の基
準を判別するための基準信号発生回路とを設け、この両
者の信号を１つ又は２つの信号として伝送する。受信側
のパルス増幅器では、送信データ中の基準データをデコ
ード回路により検出し、多相パルスの立上りのタイミン
グと位相との関係を解読し、多相のパルスに分配する。
に、ゲートパルス発生器に多相のパルス信号を１つのパ
ルス列に変換するシリアル変換回路とそのパルス列の基
準を判別するための基準信号発生回路とを設け、この両
者の信号を１つ又は２つの信号として伝送する。受信側
のパルス増幅器では、送信データ中の基準データをデコ
ード回路により検出し、多相パルスの立上りのタイミン
グと位相との関係を解読し、多相のパルスに分配する。
【０００５】
【作用】ゲートパルス発生器内のシリアル変換回路は、
多相のパルス信号を１つのパルス列に変換する。しかし
ながら、単なるパルス列では、どの相のパルスであるか
判別できない。そこで、パルス列中で次に来るパルスが
どの相のパルスであるかを区別するため、基準データ発
生回路によりパルス列の基準を作成する。受信側のパル
ス増幅器では、送信データ中の基準信号を検出し、次に
来るパルスが基準となるパルスであることを知り、以
下、パルス列の立上りによりパルスを分配することがで
きる。ゲートパルスの場合は、１相わかれば残り５相の
相順がわかるため、分配可能である。
多相のパルス信号を１つのパルス列に変換する。しかし
ながら、単なるパルス列では、どの相のパルスであるか
判別できない。そこで、パルス列中で次に来るパルスが
どの相のパルスであるかを区別するため、基準データ発
生回路によりパルス列の基準を作成する。受信側のパル
ス増幅器では、送信データ中の基準信号を検出し、次に
来るパルスが基準となるパルスであることを知り、以
下、パルス列の立上りによりパルスを分配することがで
きる。ゲートパルスの場合は、１相わかれば残り５相の
相順がわかるため、分配可能である。
【０００６】
【実施例】本発明の一実施例を図１により説明する。図
１において、１は三相交流電源、２はサイレスタ６個よ
り構成されるサイリスタ変換器、３は負荷、４はサイリ
スタのゲート回路、５はパルス増幅器、６はゲートパル
ス発生器である。パルス増幅器５とゲートパルス発生器
６とは１つの信号線により接続されている。また、各サ
イリスタのゲートには、図示のように、ゲートパルスＵ
P、ＵN、ＶP、ＶN、ＷP、ＷNが印加される。
１において、１は三相交流電源、２はサイレスタ６個よ
り構成されるサイリスタ変換器、３は負荷、４はサイリ
スタのゲート回路、５はパルス増幅器、６はゲートパル
ス発生器である。パルス増幅器５とゲートパルス発生器
６とは１つの信号線により接続されている。また、各サ
イリスタのゲートには、図示のように、ゲートパルスＵ
P、ＵN、ＶP、ＶN、ＷP、ＷNが印加される。
【０００７】パルス増幅器５とゲートパルス発生器６の
詳細を図２により説明する。ゲートパルス発生器６は、
制御入力に応じて出力パルスの位相を制御するゲートパ
ルス発生回路６１、６相パルスを１つのパルス列に変換
するシリアル変換回路６２、６相パルスの内、基準パル
スのタイミングを作成する基準データ発生回路６３、シ
リアル変換回路６２と基準データ発生回路６３の出力を
１つの信号として送信する送信回路６４とにより、構成
されている。パルス増幅器５は、ゲートパルス発生器６
の出力を受信し、パルス列中の信号から基準データを検
出し、パルスの基準タイミングを作成するデコード回路
５１と、パルス列の立上りよりパルスの切り替わりタイ
ミングを検出するパルスエッヂ検出回路５２、および、
デコード回路５１とパルスエッヂ検出回路５２の出力を
もとに６相のパルスに分配する分配回路５３とにより、
構成されている。一般にゲートパルス発生器６は制御装
置と同一の盤に実装され、パルス増幅器５はサイリスタ
変換器と同一の盤に実装されている。
詳細を図２により説明する。ゲートパルス発生器６は、
制御入力に応じて出力パルスの位相を制御するゲートパ
ルス発生回路６１、６相パルスを１つのパルス列に変換
するシリアル変換回路６２、６相パルスの内、基準パル
スのタイミングを作成する基準データ発生回路６３、シ
リアル変換回路６２と基準データ発生回路６３の出力を
１つの信号として送信する送信回路６４とにより、構成
されている。パルス増幅器５は、ゲートパルス発生器６
の出力を受信し、パルス列中の信号から基準データを検
出し、パルスの基準タイミングを作成するデコード回路
５１と、パルス列の立上りよりパルスの切り替わりタイ
ミングを検出するパルスエッヂ検出回路５２、および、
デコード回路５１とパルスエッヂ検出回路５２の出力を
もとに６相のパルスに分配する分配回路５３とにより、
構成されている。一般にゲートパルス発生器６は制御装
置と同一の盤に実装され、パルス増幅器５はサイリスタ
変換器と同一の盤に実装されている。
【０００８】図２に示すゲートパルス発生器とパルス増
幅器とのパルス伝送方式を図３および４により説明す
る。ゲートパルス発生回路６１より出力されるゲートパ
ルスＵP、ＵN、ＶP、ＶN、ＷP、ＷNは、シリアル変換回
路６２に入力され、各相パルスの立上りエッヂを検出
し、図３の６相パルスに示すようなパルス列ＵP、ＷN、
ＶP、ＵN、ＷP、ＶNに変換される。基準データ発生回路
６３は、図３に示す如く、ＶN相パルスの出力直後、１
バイトの基準データを発生する。基準データ（拡大）は
１バイトのＳＴＡＲＴとＥＮＤを示した基準データの拡
大図である。なお、この基準データは、ゲートパルス列
の信号と区別できる信号であればよい。送信回路６４
は、図３の６相パルス列と基準データの論理和をとり、
図３の送信回路出力に示す如く出力する。
幅器とのパルス伝送方式を図３および４により説明す
る。ゲートパルス発生回路６１より出力されるゲートパ
ルスＵP、ＵN、ＶP、ＶN、ＷP、ＷNは、シリアル変換回
路６２に入力され、各相パルスの立上りエッヂを検出
し、図３の６相パルスに示すようなパルス列ＵP、ＷN、
ＶP、ＵN、ＷP、ＶNに変換される。基準データ発生回路
６３は、図３に示す如く、ＶN相パルスの出力直後、１
バイトの基準データを発生する。基準データ（拡大）は
１バイトのＳＴＡＲＴとＥＮＤを示した基準データの拡
大図である。なお、この基準データは、ゲートパルス列
の信号と区別できる信号であればよい。送信回路６４
は、図３の６相パルス列と基準データの論理和をとり、
図３の送信回路出力に示す如く出力する。
【０００９】パルス増幅器５では、送信回路６４からの
信号を受信し、パルス列内より基準データが送られてく
るタイミングをデコード回路５１により検出し、図４に
示す如く、これにより基準タイミング信号をセットし、
次に来るパルス列のパルスがＵP相のパルスであること
を判別する。一方、パルスエッヂ検出回路５２によりパ
ルス列の立上り毎にタイミングを検出し、分配回路５３
により６相のパルスＵP、ＵN、ＶP、ＶN、ＷP、ＷNに分
配する。なお、基準データをＶN相パルスの出力直後に
発生するようにしたが、他の相パルスの出力直後に発生
するようにしてもよい。以上の如く、パルスをシリアル
信号として、信号線１本による送信が可能である。
信号を受信し、パルス列内より基準データが送られてく
るタイミングをデコード回路５１により検出し、図４に
示す如く、これにより基準タイミング信号をセットし、
次に来るパルス列のパルスがＵP相のパルスであること
を判別する。一方、パルスエッヂ検出回路５２によりパ
ルス列の立上り毎にタイミングを検出し、分配回路５３
により６相のパルスＵP、ＵN、ＶP、ＶN、ＷP、ＷNに分
配する。なお、基準データをＶN相パルスの出力直後に
発生するようにしたが、他の相パルスの出力直後に発生
するようにしてもよい。以上の如く、パルスをシリアル
信号として、信号線１本による送信が可能である。
【００１０】図５および図６に本発明の他の実施例を示
す。図５のゲートパルス発生器６は、ゲートパルス発生
回路６１、６相パルスを１つのパルス列に変換するシリ
アル変換回路６２、６相パルスの内ＵP相を基準信号と
して取り出す基準パルス発生回路６５、これらのシリア
ル変換回路６２と基準パルス発生回路６５のそれぞれの
出力を送信する送信回路６６と６７とにより、構成され
る。また、パルス増幅器５は、送信回路６６と６７から
送信される６相パルス列と基準パルスをそれぞれ受信す
る受信回路７１、７２と、パルス列のエッヂ信号と基準
パルスによりパルス列を６相のパルスに分配するパルス
分配回路７３とにより、構成される。本構成によるゲー
トパルスの伝送方式を図６により説明する。ゲートパル
ス発生器６内のシリアル変換回路６２は、６相パルスＵ
P、ＵN、ＶP、ＶN、ＷP、ＷNの立上りエッヂを検出し、
図６に示す６相パルス列を作成する。また、基準パルス
発生回路６５はＵPパルスの立上りエッヂを検出し基準
パルスを作成する。この６相パルス列と基準パルスをも
とに、パルス増幅器５内のパルス配分回路７３により６
相のパラレル信号に分配することが可能である。なお、
６相パルスの内ＵP相を基準信号として取り出すことと
したが、他の相を基準信号として取り出してもよい。以
上の如く、６相パルスをシリアル信号として送信する信
号線１本、基準パルスを送信する信号線１本、合計２本
による送信が可能である。
す。図５のゲートパルス発生器６は、ゲートパルス発生
回路６１、６相パルスを１つのパルス列に変換するシリ
アル変換回路６２、６相パルスの内ＵP相を基準信号と
して取り出す基準パルス発生回路６５、これらのシリア
ル変換回路６２と基準パルス発生回路６５のそれぞれの
出力を送信する送信回路６６と６７とにより、構成され
る。また、パルス増幅器５は、送信回路６６と６７から
送信される６相パルス列と基準パルスをそれぞれ受信す
る受信回路７１、７２と、パルス列のエッヂ信号と基準
パルスによりパルス列を６相のパルスに分配するパルス
分配回路７３とにより、構成される。本構成によるゲー
トパルスの伝送方式を図６により説明する。ゲートパル
ス発生器６内のシリアル変換回路６２は、６相パルスＵ
P、ＵN、ＶP、ＶN、ＷP、ＷNの立上りエッヂを検出し、
図６に示す６相パルス列を作成する。また、基準パルス
発生回路６５はＵPパルスの立上りエッヂを検出し基準
パルスを作成する。この６相パルス列と基準パルスをも
とに、パルス増幅器５内のパルス配分回路７３により６
相のパラレル信号に分配することが可能である。なお、
６相パルスの内ＵP相を基準信号として取り出すことと
したが、他の相を基準信号として取り出してもよい。以
上の如く、６相パルスをシリアル信号として送信する信
号線１本、基準パルスを送信する信号線１本、合計２本
による送信が可能である。
【００１１】
【発明の効果】本発明によれば、ゲートパルス発生器と
パルス増幅器との信号線本数を６本から１本又は２本に
低減できるため、システムの価格を低減することが可能
である。特に、ゲートパルス発生器とパルス増幅器との
実装が別盤であり、両者間の伝送距離が長い場合に有効
である。また、信号線本数を低減できることにより、高
価な光ケーブルを採用しても大幅なコスト増にはなら
ず、ノイズ耐量向上によるシステムの誤動作を防止で
き、ひいては、２重系システムの採用等により信頼性の
向上を図ることができる。
パルス増幅器との信号線本数を６本から１本又は２本に
低減できるため、システムの価格を低減することが可能
である。特に、ゲートパルス発生器とパルス増幅器との
実装が別盤であり、両者間の伝送距離が長い場合に有効
である。また、信号線本数を低減できることにより、高
価な光ケーブルを採用しても大幅なコスト増にはなら
ず、ノイズ耐量向上によるシステムの誤動作を防止で
き、ひいては、２重系システムの採用等により信頼性の
向上を図ることができる。
【図１】サイリスタ変換回路とゲートパルス発生器との
関連を表した図
関連を表した図
【図２】本発明の一実施例
【図３】ゲートパルス送信のタイミングを説明した図
【図４】ゲートパルス受信のタイミングを説明した図
【図５】本発明の他の実施例
【図６】図５の動作タイミングを説明した図
１ 三相交流電源 ２ サイリスタ変換器 ３ 負荷 ４ ゲート回路 ５ パルス増幅器 ６ ゲートパルス発生器 ５１ デコード回路 ５２ パルスエッヂ検出回路 ５３ 分配回路 ６１ ゲートパルス発生回路 ６２ シリアル変換回路 ６３ 基準データ発生回路 ６４ 送信回路 ６５ 基準タイミング作成回路 ６６、６７ 送信回路 ７１、７２ 受信回路 ７３ 分配回路
Claims (2)
- 【請求項１】 多相の電力に変換する電力変換装置にお
いて、各相パルスを１つのパルス列に変換するシリアル
変換回路と、前記パルス列のパルスの基準を判別するた
めのデータを作成する基準データ発生回路と、前記シリ
アル変換回路と前記基準データ発生回路の出力の論理和
をとり、１つのシリアル信号として信号を送信する送信
回路とからなるゲートパルス発生器、および、前記ゲー
トパルス発生器の出力を受信し、パルスの基準データよ
りパルス列の信号の基準を判別するデコード回路と、パ
ルス列の立上りを検出するパルスエッヂ検出回路と、前
記デコード回路と前記パルスエッヂ検出回路の出力とか
ら多相のパルスに分配する分配回路とからなるパルス増
幅器を有し、両者間のパルス伝送を１つのシリアル信号
により行うことを特徴とするゲートパルスの伝送方式。 - 【請求項２】 多相の電力に変換する電力変換装置にお
いて、各相パルスを１つのパルス列に変換するシリアル
変換回路と、前記パルス列中のパルスの基準を判別する
ための基準パルスを作成する基準パルス発生回路と、前
記シリアル変換回路と前記基準パルス発生回路の出力を
各々送信する送信回路とからなるゲートパルス発生器、
および、前記ゲートパルス発生器の出力を受信する受信
回路と、受信したパルス列の立上りタイミングと基準パ
ルスをもとに多相のパルスに分配する分配回路とからな
るパルス増幅器を有し、両者間のパルス伝送を１つのシ
リアル信号と１つの基準信号により行うことを特徴とす
るゲートパルスの伝送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3259785A JP2747749B2 (ja) | 1991-09-11 | 1991-09-11 | ゲートパルスの伝送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3259785A JP2747749B2 (ja) | 1991-09-11 | 1991-09-11 | ゲートパルスの伝送方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0576165A true JPH0576165A (ja) | 1993-03-26 |
| JP2747749B2 JP2747749B2 (ja) | 1998-05-06 |
Family
ID=17338951
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3259785A Expired - Lifetime JP2747749B2 (ja) | 1991-09-11 | 1991-09-11 | ゲートパルスの伝送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2747749B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7379217B2 (en) | 2002-04-26 | 2008-05-27 | Canon Kabushiki Kaisha | Image reading apparatus |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57138861A (en) * | 1981-02-18 | 1982-08-27 | Hitachi Ltd | Converter |
| JPH02260932A (ja) * | 1989-03-31 | 1990-10-23 | Sharp Corp | 音声多重方式 |
-
1991
- 1991-09-11 JP JP3259785A patent/JP2747749B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57138861A (en) * | 1981-02-18 | 1982-08-27 | Hitachi Ltd | Converter |
| JPH02260932A (ja) * | 1989-03-31 | 1990-10-23 | Sharp Corp | 音声多重方式 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7379217B2 (en) | 2002-04-26 | 2008-05-27 | Canon Kabushiki Kaisha | Image reading apparatus |
| US7557967B2 (en) | 2002-04-26 | 2009-07-07 | Canon Kabushiki Kaisha | Image reading apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2747749B2 (ja) | 1998-05-06 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20040329 |
|
| A072 | Dismissal of procedure |
Effective date: 20040803 Free format text: JAPANESE INTERMEDIATE CODE: A072 |