JPH0566727A - 液晶表示装置の駆動装置 - Google Patents
液晶表示装置の駆動装置Info
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- JPH0566727A JPH0566727A JP22618491A JP22618491A JPH0566727A JP H0566727 A JPH0566727 A JP H0566727A JP 22618491 A JP22618491 A JP 22618491A JP 22618491 A JP22618491 A JP 22618491A JP H0566727 A JPH0566727 A JP H0566727A
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- data
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- Liquid Crystal Display Device Control (AREA)
Abstract
(57)【要約】 （修正有）
【目的】 簡単な構成で映像データを補正することがで
きるＴＦＴ−ＬＣＤ駆動装置を提供する。 【構成】 ＴＦＴ−ＬＣＤパネル５０と、パネル５０を
駆動するデータドライバ回路５２及びスキャンドライバ
回路５４とを含む液晶表示装置の駆動装置において、映
像データ信号５６の大きさを判定する信号判定回路５８
と、補正データ作成回路６０と、信号判定回路５８及び
補正データ作成回路６０での処理に要する第１の時間ｔ
1 だけ映像データ信号５６を遅延させる信号遅延回路６
６と、補正データ信号６２及び信号遅延回路６６からの
遅延映像データ信号６８を合成し、映像データ信号５６
に対応する合成信号７０を発生するデータ合成回路６４
と、駆動信号７４を前記データドライバ回路５２に供給
する駆動信号作成回路７２と、同期信号７８に基づいて
タイミング信号８２を作成するタイミング作成回路７６
と、合成信号７０の遅延時間に等しい第２の時間ｔ2 だ
け遅延させて、スキャン信号８６をスキャンドライバ回
路５４に供給するスキャン信号発生回路８４とを含む。
きるＴＦＴ−ＬＣＤ駆動装置を提供する。 【構成】 ＴＦＴ−ＬＣＤパネル５０と、パネル５０を
駆動するデータドライバ回路５２及びスキャンドライバ
回路５４とを含む液晶表示装置の駆動装置において、映
像データ信号５６の大きさを判定する信号判定回路５８
と、補正データ作成回路６０と、信号判定回路５８及び
補正データ作成回路６０での処理に要する第１の時間ｔ
1 だけ映像データ信号５６を遅延させる信号遅延回路６
６と、補正データ信号６２及び信号遅延回路６６からの
遅延映像データ信号６８を合成し、映像データ信号５６
に対応する合成信号７０を発生するデータ合成回路６４
と、駆動信号７４を前記データドライバ回路５２に供給
する駆動信号作成回路７２と、同期信号７８に基づいて
タイミング信号８２を作成するタイミング作成回路７６
と、合成信号７０の遅延時間に等しい第２の時間ｔ2 だ
け遅延させて、スキャン信号８６をスキャンドライバ回
路５４に供給するスキャン信号発生回路８４とを含む。
Description
【０００１】
【産業上の利用分野】本発明は、液晶表示装置、特に薄
膜トランジスタ（ＴＦＴ）を用いた液晶表示装置（ＬＣ
Ｄ）の駆動装置に関する。
膜トランジスタ（ＴＦＴ）を用いた液晶表示装置（ＬＣ
Ｄ）の駆動装置に関する。
【０００２】ＴＦＴ−ＬＣＤ駆動装置は、ＴＦＴ−ＬＣ
Ｄパネルを駆動して該パネルに映像を表示させるもので
ある。このＴＦＴ−ＬＣＤ駆動装置においては、ＴＦＴ
−ＬＣＤパネルの特性により鮮明な表示が得られない場
合がある。また、投写型の表示装置に使用する際には、
レンズの特性によりスクリーンの中心部と周辺部とでは
明るさが異なり、均一な表示が得られない場合がある。
これらの問題を解決するために、映像データを補正した
後、該補正映像データをＴＦＴ−ＬＣＤパネルに送る必
要がある。この映像データの補正のために、従来は、フ
レームメモリ、ラインメモリ等を使用していたが、本発
明は、これらのメモリを使用することなく、簡単な構成
で映像データを補正できるＴＦＴ−ＬＣＤ駆動装置を提
供する。
Ｄパネルを駆動して該パネルに映像を表示させるもので
ある。このＴＦＴ−ＬＣＤ駆動装置においては、ＴＦＴ
−ＬＣＤパネルの特性により鮮明な表示が得られない場
合がある。また、投写型の表示装置に使用する際には、
レンズの特性によりスクリーンの中心部と周辺部とでは
明るさが異なり、均一な表示が得られない場合がある。
これらの問題を解決するために、映像データを補正した
後、該補正映像データをＴＦＴ−ＬＣＤパネルに送る必
要がある。この映像データの補正のために、従来は、フ
レームメモリ、ラインメモリ等を使用していたが、本発
明は、これらのメモリを使用することなく、簡単な構成
で映像データを補正できるＴＦＴ−ＬＣＤ駆動装置を提
供する。
【０００３】
【従来の技術】図３には、従来のＴＦＴ−ＬＣＤ駆動装
置のメモリによる補正回路が示されている。
置のメモリによる補正回路が示されている。
【０００４】図３において、符号１０は、ＴＦＴ−ＬＣ
Ｄパネルを示し、このパネル１０は、６４０（ドット）
×４８０（ドット）の大きさである。なお、実際の投写
型パネルは、Ｒ（赤）、Ｇ（緑）及びＢ（青）用の３個
のパネルから構成されるが図３では、そのうちの１つの
パネル１０が示されている。また、ＴＦＴ−ＬＣＤパネ
ル１０は、データドライバ回路１２及びスキャンドライ
バ回路１４により駆動される。
Ｄパネルを示し、このパネル１０は、６４０（ドット）
×４８０（ドット）の大きさである。なお、実際の投写
型パネルは、Ｒ（赤）、Ｇ（緑）及びＢ（青）用の３個
のパネルから構成されるが図３では、そのうちの１つの
パネル１０が示されている。また、ＴＦＴ−ＬＣＤパネ
ル１０は、データドライバ回路１２及びスキャンドライ
バ回路１４により駆動される。
【０００５】符号１６は、Ｒ（Ｇ、Ｂ）用の映像データ
信号を示し、駆動信号作成回路１８は、該映像データ信
号１６に基づいてラインメモリ１１で映像信号をバッフ
ァし、補正回路１３で補正し、駆動信号２０を作成し、
該駆動信号２０をデータドライバ回路１２に供給する。
また、符号２２は、同期信号｛ＶSYNC（垂直同期）、Ｈ
SYNC（水平同期）、ＤＣＬＫ（ドットクロック）｝を示
し、タイミング作成回路２４は、該同期信号に基づいて
タイミング信号２６を作成し、スキャン信号発生回路２
８に供給する。スキャン信号発生回路２８は、タイミン
グ信号２６に基づいてスキャン信号３０を発生し、該ス
キャン信号３０をスキャンドライバ回路１４に供給す
る。ここで、補正を行なうため、スキャン信号は１ライ
ン遅延したものとなる。
信号を示し、駆動信号作成回路１８は、該映像データ信
号１６に基づいてラインメモリ１１で映像信号をバッフ
ァし、補正回路１３で補正し、駆動信号２０を作成し、
該駆動信号２０をデータドライバ回路１２に供給する。
また、符号２２は、同期信号｛ＶSYNC（垂直同期）、Ｈ
SYNC（水平同期）、ＤＣＬＫ（ドットクロック）｝を示
し、タイミング作成回路２４は、該同期信号に基づいて
タイミング信号２６を作成し、スキャン信号発生回路２
８に供給する。スキャン信号発生回路２８は、タイミン
グ信号２６に基づいてスキャン信号３０を発生し、該ス
キャン信号３０をスキャンドライバ回路１４に供給す
る。ここで、補正を行なうため、スキャン信号は１ライ
ン遅延したものとなる。
【０００６】そして、データドライバ回路１２及びスキ
ャンドライバ回路１４は、それぞれ、駆動信号２０及び
スキャン信号３０に基づいてＴＦＴ−ＬＣＤパネル１０
を駆動し、該パネル１０上に映像を表示させる。
ャンドライバ回路１４は、それぞれ、駆動信号２０及び
スキャン信号３０に基づいてＴＦＴ−ＬＣＤパネル１０
を駆動し、該パネル１０上に映像を表示させる。
【０００７】次に、図４には、上記従来のＴＦＴ−ＬＣ
Ｄ駆動装置のタイミングチャートが示されている。図４
を参照しながら説明すると、同期信号２２において、２
つの垂直同期パルスＶSYNCの間には５２５個の水平同期
パルスＨSYNCが設定され、１番目の水平同期パルスＨ
SYNCから４８０番目の水平同期パルスＨSYNC４８０の
間に映像データ信号１６が入っている。同期信号２２の
２つの水平同期パルスＶSYNCから２番目の水平同期パ
ルスの間には８００個のドットクロックＤＣＬＫが設
定され、１番目のドットクロックＤＣＬＫから６４０
番目のドットクロックＤＣＬＫ６４０の間に映像データ
信号１６のＲ１〜Ｒ６４０が入っている。なお、１番目
のドットクロックＤＣＬＫに対応してＳＴＡＲＴパル
スを発生している。
Ｄ駆動装置のタイミングチャートが示されている。図４
を参照しながら説明すると、同期信号２２において、２
つの垂直同期パルスＶSYNCの間には５２５個の水平同期
パルスＨSYNCが設定され、１番目の水平同期パルスＨ
SYNCから４８０番目の水平同期パルスＨSYNC４８０の
間に映像データ信号１６が入っている。同期信号２２の
２つの水平同期パルスＶSYNCから２番目の水平同期パ
ルスの間には８００個のドットクロックＤＣＬＫが設
定され、１番目のドットクロックＤＣＬＫから６４０
番目のドットクロックＤＣＬＫ６４０の間に映像データ
信号１６のＲ１〜Ｒ６４０が入っている。なお、１番目
のドットクロックＤＣＬＫに対応してＳＴＡＲＴパル
スを発生している。
【０００８】以上のように、映像データ信号１６は、同
期信号（垂直同期信号ＶSYNC、水平同期信号ＨSYNC、ド
ットクロックＤＣＬＫにより同期をとられながら、ＴＦ
Ｔ−ＬＣＤパネル１０に表示されることとなる。
期信号（垂直同期信号ＶSYNC、水平同期信号ＨSYNC、ド
ットクロックＤＣＬＫにより同期をとられながら、ＴＦ
Ｔ−ＬＣＤパネル１０に表示されることとなる。
【０００９】
【発明が解決しようとする課題】上記ＴＦＴ−ＬＣＤ駆
動装置においては、ＴＦＴ−ＬＣＤパネルの特性のため
（パネル自体の有する寄生容量による電圧効果のた
め）、映像データ信号を補正しないと、鮮明な表示が得
られないことがある。また、投写型の表示装置に使用す
る場合には、レンズの特性により、スクリーンの中心部
と周辺部とで明るさが異なり、均一な表示を行うために
映像データ信号の補正が必要である。
動装置においては、ＴＦＴ−ＬＣＤパネルの特性のため
（パネル自体の有する寄生容量による電圧効果のた
め）、映像データ信号を補正しないと、鮮明な表示が得
られないことがある。また、投写型の表示装置に使用す
る場合には、レンズの特性により、スクリーンの中心部
と周辺部とで明るさが異なり、均一な表示を行うために
映像データ信号の補正が必要である。
【００１０】上記映像データ信号を補正するために、従
来は、フレームメモリ、ラインメモリ等で映像データを
一時保存して、補正データの作成時間を確保して補正を
行なっていた。設けて補正データを作成していた。この
ようにフレームメモリ、ラインメモリ等を設けていたの
で、従来のＴＦＴ−ＬＣＤ駆動装置は、その構成が複雑
であった。
来は、フレームメモリ、ラインメモリ等で映像データを
一時保存して、補正データの作成時間を確保して補正を
行なっていた。設けて補正データを作成していた。この
ようにフレームメモリ、ラインメモリ等を設けていたの
で、従来のＴＦＴ−ＬＣＤ駆動装置は、その構成が複雑
であった。
【００１１】そこで、本発明の目的は、簡単な構成で映
像データを補正することができるＴＦＴ−ＬＣＤ駆動装
置を提供することにある。
像データを補正することができるＴＦＴ−ＬＣＤ駆動装
置を提供することにある。
【００１２】
【課題を解決するための手段】本発明は、ＴＦＴ−ＬＣ
Ｄパネル（５０）と、該ＴＦＴ−ＬＣＤパネル（５０）
を駆動するデータドライバ回路（５２）及びスキャンド
ライバ回路（５４）と、を含む液晶表示装置の駆動装置
において、映像データ信号（５６）の大きさを判定する
信号判定回路（５８）と、該信号判定回路（５８）から
の判定結果に基づき、補正データ信号（６２）を作成す
る補正データ作成回路（６０）と、前記信号判定回路
（５８）及び補正データ作成回路（６０）での処理に要
する第１の時間（ｔ1 ）だけ映像データ信号（５６）を
遅延させる信号遅延回路（６６）と、前記補正データ作
成回路（６０）からの補正データ信号（６２）及び前記
信号遅延回路（６６）からの遅延映像データ信号（６
８）を合成し、映像データ信号（５６）に対応する合成
信号（７０）を発生するデータ合成回路（６４）と、該
データ合成回路（６４）からの合成信号（７０）に基づ
き、駆動信号（７４）を前記データドライバ回路（５
２）に供給する駆動信号作成回路（７２）と、同期信号
（７８）に基づいてタイミング信号（８２）を作成する
タイミング作成回路（７６）と、該タイミング作成回路
（７６）からのタイミング信号（８２）に基づき、前記
合成信号（７０）の遅延時間に等しい第２の時間
（ｔ2 ）だけ遅延させて、スキャン信号（８６）をスキ
ャンドライバ回路（５４）に供給するスキャン信号発生
回路（８４）と、を含むことを特徴とする。
Ｄパネル（５０）と、該ＴＦＴ−ＬＣＤパネル（５０）
を駆動するデータドライバ回路（５２）及びスキャンド
ライバ回路（５４）と、を含む液晶表示装置の駆動装置
において、映像データ信号（５６）の大きさを判定する
信号判定回路（５８）と、該信号判定回路（５８）から
の判定結果に基づき、補正データ信号（６２）を作成す
る補正データ作成回路（６０）と、前記信号判定回路
（５８）及び補正データ作成回路（６０）での処理に要
する第１の時間（ｔ1 ）だけ映像データ信号（５６）を
遅延させる信号遅延回路（６６）と、前記補正データ作
成回路（６０）からの補正データ信号（６２）及び前記
信号遅延回路（６６）からの遅延映像データ信号（６
８）を合成し、映像データ信号（５６）に対応する合成
信号（７０）を発生するデータ合成回路（６４）と、該
データ合成回路（６４）からの合成信号（７０）に基づ
き、駆動信号（７４）を前記データドライバ回路（５
２）に供給する駆動信号作成回路（７２）と、同期信号
（７８）に基づいてタイミング信号（８２）を作成する
タイミング作成回路（７６）と、該タイミング作成回路
（７６）からのタイミング信号（８２）に基づき、前記
合成信号（７０）の遅延時間に等しい第２の時間
（ｔ2 ）だけ遅延させて、スキャン信号（８６）をスキ
ャンドライバ回路（５４）に供給するスキャン信号発生
回路（８４）と、を含むことを特徴とする。
【００１３】
【作用】本発明において、映像データ信号（５６）は、
信号判定回路（５８）でその大きさが判定され、該判定
結果に基づき、補正データ作成回路（６０）は、補正デ
ータ信号（６２）を発生する。一方、補正データ信号
（６２）を作成するまでの第１の時間（ｔ1 ）だけ、信
号遅延回路（６６）は、映像データ信号（５６）を遅延
させ、遅延映像データ信号（６８）を発生する。データ
合成回路（６４）は、これらの補正データ信号（６２）
及び遅延映像データ信号（６８）を合成して、合成信号
（７０）を発生し、駆動信号作成回路（７２）は、該合
成信号（７０）に基づいて駆動信号（７４）をデータド
ライバ回路（５２）に供給する。
信号判定回路（５８）でその大きさが判定され、該判定
結果に基づき、補正データ作成回路（６０）は、補正デ
ータ信号（６２）を発生する。一方、補正データ信号
（６２）を作成するまでの第１の時間（ｔ1 ）だけ、信
号遅延回路（６６）は、映像データ信号（５６）を遅延
させ、遅延映像データ信号（６８）を発生する。データ
合成回路（６４）は、これらの補正データ信号（６２）
及び遅延映像データ信号（６８）を合成して、合成信号
（７０）を発生し、駆動信号作成回路（７２）は、該合
成信号（７０）に基づいて駆動信号（７４）をデータド
ライバ回路（５２）に供給する。
【００１４】一方、タイミング作成回路（７６）は、同
期信号（７８）に基づいてタイミング信号（８２）を発
生し、スキャン信号発生回路（８４）は、該タイミング
信号（８２）に基づき、前記合成信号（７０）の遅延時
間と同じ第２の時間（ｔ2 ）だけ遅延させて、スキャン
信号（８６）をスキャンドライバ回路（５４）に供給す
る。
期信号（７８）に基づいてタイミング信号（８２）を発
生し、スキャン信号発生回路（８４）は、該タイミング
信号（８２）に基づき、前記合成信号（７０）の遅延時
間と同じ第２の時間（ｔ2 ）だけ遅延させて、スキャン
信号（８６）をスキャンドライバ回路（５４）に供給す
る。
【００１５】以上のように、データドライバ回路（５
２）には、補正された駆動信号（７４）が供給され、こ
のとき、スキャンドライバ回路（５４）には、合成信号
（７０）の作成に要する第２の時間（ｔ2 ）だけ遅延し
たスキャン信号（８６）が供給されるのでＴＦＴ−ＬＣ
Ｄパネル（５０）には、補正された良好な映像が表示さ
れることとなる。
２）には、補正された駆動信号（７４）が供給され、こ
のとき、スキャンドライバ回路（５４）には、合成信号
（７０）の作成に要する第２の時間（ｔ2 ）だけ遅延し
たスキャン信号（８６）が供給されるのでＴＦＴ−ＬＣ
Ｄパネル（５０）には、補正された良好な映像が表示さ
れることとなる。
【００１６】
【実施例】以下、図面に基づいて本発明に好適な実施例
を説明する。図１には、本発明の実施例によるＴＦＴ−
ＬＣＤ駆動装置の回路が示されている。
を説明する。図１には、本発明の実施例によるＴＦＴ−
ＬＣＤ駆動装置の回路が示されている。
【００１７】図１において、符号５０は、ＴＦＴ−ＬＣ
Ｄパネルを示し、このパネル５０は、６４０（ドット）
×４８０（ドット）の大きさである。なお、実際のパネ
ルは、Ｒ（赤）、Ｇ（緑）及びＢ（青）用の３個のパネ
ルから構成されるが、図１では、そのうちの１つのパネ
ル５０が示されている。また、ＴＦＴ−ＬＣＤパネル５
０は、データドライバ回路５２及びスキャンドライバ回
路５４により駆動される。
Ｄパネルを示し、このパネル５０は、６４０（ドット）
×４８０（ドット）の大きさである。なお、実際のパネ
ルは、Ｒ（赤）、Ｇ（緑）及びＢ（青）用の３個のパネ
ルから構成されるが、図１では、そのうちの１つのパネ
ル５０が示されている。また、ＴＦＴ−ＬＣＤパネル５
０は、データドライバ回路５２及びスキャンドライバ回
路５４により駆動される。
【００１８】符号５６は、Ｒ（Ｇ、Ｂ）用の映像データ
信号を示し、該映像データ信号５６は、信号判定回路５
８に供給される。信号判定回路５８は、映像データ信号
５６の大きさを判定し、例えば、映像データ信号５６の
大きさがＮ段階のうちのいずれに該当するかを判定す
る。補正データ作成回路６０は、信号判定回路５８での
判定結果に基づき、補正データ信号６２を作成してデー
タ合成回路６４の一方の入力端に供給する。
信号を示し、該映像データ信号５６は、信号判定回路５
８に供給される。信号判定回路５８は、映像データ信号
５６の大きさを判定し、例えば、映像データ信号５６の
大きさがＮ段階のうちのいずれに該当するかを判定す
る。補正データ作成回路６０は、信号判定回路５８での
判定結果に基づき、補正データ信号６２を作成してデー
タ合成回路６４の一方の入力端に供給する。
【００１９】また、映像データ信号５６は、信号遅延回
路６６に供給され、該信号遅延回路６６は、前記信号判
定回路５８及び補正データ作成回路６０での処理に要す
る時間ｔ1 だけ映像データ信号５６を遅延させ、遅延映
像データ信号６８をデータ合成回路６４の他方の入力端
に供給する。
路６６に供給され、該信号遅延回路６６は、前記信号判
定回路５８及び補正データ作成回路６０での処理に要す
る時間ｔ1 だけ映像データ信号５６を遅延させ、遅延映
像データ信号６８をデータ合成回路６４の他方の入力端
に供給する。
【００２０】データ合成回路６４は、補正データ信号６
２及び遅延映像データ信号６８を合成（加減算等）し、
映像データ信号５６に対応する合成信号７０を発生す
る。この合成信号７０は、駆動信号発生回路７２に供給
され、該発生回路７２は、駆動信号７４をデータドライ
バ回路５２に供給する。
２及び遅延映像データ信号６８を合成（加減算等）し、
映像データ信号５６に対応する合成信号７０を発生す
る。この合成信号７０は、駆動信号発生回路７２に供給
され、該発生回路７２は、駆動信号７４をデータドライ
バ回路５２に供給する。
【００２１】また、符号７６は、タイミング作成回路を
示し、該タイミング作成回路７６は、同期信号７８｛Ｖ
SYNC（垂直同期）、ＨSYNC（水平同期）、ＤＣＬＫ（ド
ットクロック）｝に基づいてタイミング信号８０を発生
する。このタイミング信号８０は、前記補正データ作成
回路６０、データ合成回路６４及び信号遅延回路６６の
タイミングをとるために使用される。
示し、該タイミング作成回路７６は、同期信号７８｛Ｖ
SYNC（垂直同期）、ＨSYNC（水平同期）、ＤＣＬＫ（ド
ットクロック）｝に基づいてタイミング信号８０を発生
する。このタイミング信号８０は、前記補正データ作成
回路６０、データ合成回路６４及び信号遅延回路６６の
タイミングをとるために使用される。
【００２２】また、タイミング作成回路７６からのタイ
ミング信号８２は、スキャン信号発生回路８４に供給さ
れる。このスキャン信号発生回路８４は、前記合成信号
７０の遅延時間（例えばドットクロック２つ分）に等し
い時間ｔ2 だけ遅延させて、スキャン信号８６をスキャ
ンドライバ回路５４に供給する。
ミング信号８２は、スキャン信号発生回路８４に供給さ
れる。このスキャン信号発生回路８４は、前記合成信号
７０の遅延時間（例えばドットクロック２つ分）に等し
い時間ｔ2 だけ遅延させて、スキャン信号８６をスキャ
ンドライバ回路５４に供給する。
【００２３】以上のように、データドライバ回路５２に
は、補正された駆動信号７４が供給され、このとき、ス
キャンドライバ回路５４には、合成信号７０の作成に要
するる時間ｔ2 だけ遅延したスキャン信号８６が供給さ
れるので、ＴＦＴ−ＬＣＤパネル１０には、補正された
良好な映像が表示されることとなる。
は、補正された駆動信号７４が供給され、このとき、ス
キャンドライバ回路５４には、合成信号７０の作成に要
するる時間ｔ2 だけ遅延したスキャン信号８６が供給さ
れるので、ＴＦＴ−ＬＣＤパネル１０には、補正された
良好な映像が表示されることとなる。
【００２４】次に、図２には、上記本発明の実施例によ
るＴＦＴ−ＬＣＤ駆動装置のタイミングチャートが示さ
れている。図２を参照しながら説明すると、同期信号７
８において、２つの垂直同期パルスＶSYNCとの間には、
５２５個の水平同期パルスＨSYNCが設定され、１番目の
水平同期パルスＨSYNCから４８０番目の水平同期パル
スＨSYNC４８０の間に映像データ信号５６が入ってい
る。同期信号７８の２つの水平同期パルスＶSYNCから
２番目の水平同期パルスの間には、８００個のドット
クロックＤＣＬＫが設定され、１番目のドットクロック
ＤＣＬＫから６４０番目のドットクロックＤＣＬＫ６
４０の間に映像データ信号５６のＲ１〜Ｒ６４０が入っ
ている。
るＴＦＴ−ＬＣＤ駆動装置のタイミングチャートが示さ
れている。図２を参照しながら説明すると、同期信号７
８において、２つの垂直同期パルスＶSYNCとの間には、
５２５個の水平同期パルスＨSYNCが設定され、１番目の
水平同期パルスＨSYNCから４８０番目の水平同期パル
スＨSYNC４８０の間に映像データ信号５６が入ってい
る。同期信号７８の２つの水平同期パルスＶSYNCから
２番目の水平同期パルスの間には、８００個のドット
クロックＤＣＬＫが設定され、１番目のドットクロック
ＤＣＬＫから６４０番目のドットクロックＤＣＬＫ６
４０の間に映像データ信号５６のＲ１〜Ｒ６４０が入っ
ている。
【００２５】そして、合成信号７０の作成に要する時間
ｔ2 がドットクロックＤＣＬＫ２つ分であったとする
と、合成信号７０は、映像データ信号５６より２ドット
クロック分遅延しているので、タイミング信号８０、８
２の水平同期パルスＨSYNC´、ドットクロックパルスＤ
ＣＬＫ´を２ドットクロックパルス分遅延させる。な
お、ＳＴＡＲＴ´パルスも２ドットクロック分遅延させ
る。このように、タイミング信号８０、８２により同期
をとられるので、補正された良好な映像がＴＦＴ−ＬＣ
Ｄパネル５０に表示されることとなる。
ｔ2 がドットクロックＤＣＬＫ２つ分であったとする
と、合成信号７０は、映像データ信号５６より２ドット
クロック分遅延しているので、タイミング信号８０、８
２の水平同期パルスＨSYNC´、ドットクロックパルスＤ
ＣＬＫ´を２ドットクロックパルス分遅延させる。な
お、ＳＴＡＲＴ´パルスも２ドットクロック分遅延させ
る。このように、タイミング信号８０、８２により同期
をとられるので、補正された良好な映像がＴＦＴ−ＬＣ
Ｄパネル５０に表示されることとなる。
【００２６】
【発明の効果】以上説明したように、本発明によれば、
フレームメモリ、ラインメモリ等を設けることなく、簡
単な構成にて映像データを補正することができる。
フレームメモリ、ラインメモリ等を設けることなく、簡
単な構成にて映像データを補正することができる。
【００２７】また、メモリによって映像データを一時保
存し、全体のタイミング遅延をライン、フレームで行う
ことがないので、データ補正遅延を数ドットクロック分
に押えることができ、元の映像表示に対して遅延が少な
い。
存し、全体のタイミング遅延をライン、フレームで行う
ことがないので、データ補正遅延を数ドットクロック分
に押えることができ、元の映像表示に対して遅延が少な
い。
【００２８】また、同期信号によるタイミング作成回路
７６で、制御しているため、表示画面の位置が演算可能
であり、投写型のスクリーン補正が容易に行える。
７６で、制御しているため、表示画面の位置が演算可能
であり、投写型のスクリーン補正が容易に行える。
【図１】本発明の実施例によるＴＦＴ−ＬＣＤ駆動装置
の回路図である。
の回路図である。
【図２】本発明の実施例によるＴＦＴ−ＬＣＤ駆動装置
のタイミングチャート図である。
のタイミングチャート図である。
【図３】従来のＴＦＴ−ＬＣＤ駆動装置のメモリによる
補正回路の回路図である。
補正回路の回路図である。
【図４】従来のＴＦＴ−ＬＣＤ駆動装置のメモリによる
補正回路のタイミングチャート図である。
補正回路のタイミングチャート図である。
５０…ＴＦＴ−ＬＣＤパネル ５２…データドライバ回路 ５４…スキャンドライバ回路 ５８…信号判定回路 ６０…補正データ作成回路 ６４…データ合成回路 ６６…信号遅延回路 ７２…駆動信号作成回路 ７６…タイミング作成回路 ８４…スキャン信号発生回路
Claims (1)
- 【請求項１】 ＴＦＴ−ＬＣＤパネル（５０）と、該Ｔ
ＦＴ−ＬＣＤパネル（５０）を駆動するデータドライバ
回路（５２）及びスキャンドライバ回路（５４）と、を
含む液晶表示装置の駆動装置において、 映像データ信号（５６）の大きさを判定する信号判定回
路（５８）と、 該信号判定回路（５８）からの判定結果に基づき、補正
データ信号（６２）を作成する補正データ作成回路（６
０）と、 前記信号判定回路（５８）及び補正データ作成回路（６
０）での処理に要する第１の時間（ｔ1 ）だけ映像デー
タ信号（５６）を遅延させる信号遅延回路（６６）と、 前記補正データ作成回路（６０）からの補正データ信号
（６２）及び前記信号遅延回路（６６）からの遅延映像
データ信号（６８）を合成し、映像データ信号（５６）
に対応する合成信号（７０）を発生するデータ合成回路
（６４）と、 該データ合成回路（６４）からの合成信号（７０）に基
づき、駆動信号（７４）を前記データドライバ回路（５
２）に供給する駆動信号作成回路（７２）と、 同期信号（７８）に基づいてタイミング信号（８２）を
作成するタイミング作成回路（７６）と、 該タイミング作成回路（７６）からのタイミング信号
（８２）に基づき、前記合成信号（７０）の遅延時間に
等しい第２の時間（ｔ2 ）だけ遅延させて、スキャン信
号（８６）をスキャンドライバ回路（５４）に供給する
スキャン信号発生回路（８４）と、 を含むことを特徴とする液晶表示装置の駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22618491A JPH0566727A (ja) | 1991-09-05 | 1991-09-05 | 液晶表示装置の駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22618491A JPH0566727A (ja) | 1991-09-05 | 1991-09-05 | 液晶表示装置の駆動装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0566727A true JPH0566727A (ja) | 1993-03-19 |
Family
ID=16841208
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22618491A Withdrawn JPH0566727A (ja) | 1991-09-05 | 1991-09-05 | 液晶表示装置の駆動装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0566727A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100451217B1 (ko) * | 1996-08-27 | 2004-12-03 | 엘지전자 주식회사 | 엘씨디프로젝터의엘씨디구동회로 |
| CN100421146C (zh) * | 2004-03-10 | 2008-09-24 | 恩益禧电子股份有限公司 | 显示设备、显示设备驱动器电路和驱动显示设备的方法 |
-
1991
- 1991-09-05 JP JP22618491A patent/JPH0566727A/ja not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100451217B1 (ko) * | 1996-08-27 | 2004-12-03 | 엘지전자 주식회사 | 엘씨디프로젝터의엘씨디구동회로 |
| CN100421146C (zh) * | 2004-03-10 | 2008-09-24 | 恩益禧电子股份有限公司 | 显示设备、显示设备驱动器电路和驱动显示设备的方法 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19981203 |