JPH05334461A - １チップマイクロコンピュータ - Google Patents
１チップマイクロコンピュータInfo
- Publication number
- JPH05334461A JPH05334461A JP4140487A JP14048792A JPH05334461A JP H05334461 A JPH05334461 A JP H05334461A JP 4140487 A JP4140487 A JP 4140487A JP 14048792 A JP14048792 A JP 14048792A JP H05334461 A JPH05334461 A JP H05334461A
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- JP
- Japan
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- supply voltage
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- voltage
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Abstract
(57)【要約】
【構成】電源電圧を充電する充電回路とその充電回路を
一定時間通電するトランジスタおよび電源電圧低下時に
前記充電回路の充電電荷を放電するダイオードからなる
電源電圧検出用入力回路１を設け、その電圧信号ＶＳを
Ａ／ＤコンバータＡＤＣによりＡ／Ｄ変換し、Ａ／Ｄ変
換結果をしきい値を比較することにより、電源電圧の瞬
時低下を検出する。 【効果】マイクロコンピュータに内蔵するＡ／Ｄコンバ
ータおよびその他のアナログ回路の誤動作のおそれを検
知することができ、電源電圧の瞬時低下に対する信頼性
を向上させることができる。
一定時間通電するトランジスタおよび電源電圧低下時に
前記充電回路の充電電荷を放電するダイオードからなる
電源電圧検出用入力回路１を設け、その電圧信号ＶＳを
Ａ／ＤコンバータＡＤＣによりＡ／Ｄ変換し、Ａ／Ｄ変
換結果をしきい値を比較することにより、電源電圧の瞬
時低下を検出する。 【効果】マイクロコンピュータに内蔵するＡ／Ｄコンバ
ータおよびその他のアナログ回路の誤動作のおそれを検
知することができ、電源電圧の瞬時低下に対する信頼性
を向上させることができる。
Description
【０００１】
【産業上の利用分野】この発明は、Ａ／Ｄコンバータを
内蔵し、機器制御等に用いられる１チップマイクロコン
ピュータに関する。
内蔵し、機器制御等に用いられる１チップマイクロコン
ピュータに関する。
【０００２】
【従来の技術】一般に、マイクロコンピュータの信頼性
を左右する１つの要素として、電源電圧の安定性が挙げ
られる。従来より、電源の瞬時停電によるマイクロコン
ピュータの誤動作を防止する目的で、電源ラインとＧＮ
Ｄ間に大容量のコンデンサを設けて、電源電圧の瞬時低
下を防止している。また、瞬時停電検出回路を外部に設
けて、瞬時停電検出時にはマイクロコンピュータを強制
リセットして、予期せぬ誤動作を防止するように周辺回
路を構成している。
を左右する１つの要素として、電源電圧の安定性が挙げ
られる。従来より、電源の瞬時停電によるマイクロコン
ピュータの誤動作を防止する目的で、電源ラインとＧＮ
Ｄ間に大容量のコンデンサを設けて、電源電圧の瞬時低
下を防止している。また、瞬時停電検出回路を外部に設
けて、瞬時停電検出時にはマイクロコンピュータを強制
リセットして、予期せぬ誤動作を防止するように周辺回
路を構成している。
【０００３】
【発明が解決しようとする課題】ところが、コンデンサ
による電源電圧の安定化効果は、結局のところ程度問題
であり、前記平滑用コンデンサの容量とマイクロコンピ
ュータを負荷とする負荷抵抗により定まる時定数を超え
る比較的長い瞬時停電状態となれば、電圧低下が生じ
る。また、瞬時停電検出回路は、１チップマイクロコン
ピュータ自信が誤動作する直前まで電源電圧が低下しな
ければ作動しない。
による電源電圧の安定化効果は、結局のところ程度問題
であり、前記平滑用コンデンサの容量とマイクロコンピ
ュータを負荷とする負荷抵抗により定まる時定数を超え
る比較的長い瞬時停電状態となれば、電圧低下が生じ
る。また、瞬時停電検出回路は、１チップマイクロコン
ピュータ自信が誤動作する直前まで電源電圧が低下しな
ければ作動しない。
【０００４】１チップマイクロコンピュータ内における
ノイズマージンの広いディジタル回路部分については、
多少の電源電圧低下によっても、正常な動作を保証する
ことができるが、そのような比較的小さな電圧低下状態
であっても、Ａ／Ｄコンバータの一部を構成するアナロ
グ回路部分は、電源電圧低下の影響をうけて、誤ったＡ
／Ｄ変換値を求める場合がある。また、Ａ／Ｄコンバー
タに限らず、内蔵されている他のアナログ回路部分につ
いても、電源電圧低下の影響をうける。何よりも問題と
なるのは、内蔵のアナログ回路部分が正しく動作せず、
たとえば正確なＡ／Ｄ変換が行われなかったことをマイ
クロコンピュータ自身が検知できず、そのために期待ど
おりの動作が行われない場合が生じることである。
ノイズマージンの広いディジタル回路部分については、
多少の電源電圧低下によっても、正常な動作を保証する
ことができるが、そのような比較的小さな電圧低下状態
であっても、Ａ／Ｄコンバータの一部を構成するアナロ
グ回路部分は、電源電圧低下の影響をうけて、誤ったＡ
／Ｄ変換値を求める場合がある。また、Ａ／Ｄコンバー
タに限らず、内蔵されている他のアナログ回路部分につ
いても、電源電圧低下の影響をうける。何よりも問題と
なるのは、内蔵のアナログ回路部分が正しく動作せず、
たとえば正確なＡ／Ｄ変換が行われなかったことをマイ
クロコンピュータ自身が検知できず、そのために期待ど
おりの動作が行われない場合が生じることである。
【０００５】この発明の目的は、電源電圧が瞬時低下し
たとき、そのことを検知可能として、誤動作を防止した
１チップマイクロコンピュータを提供することにある。
たとき、そのことを検知可能として、誤動作を防止した
１チップマイクロコンピュータを提供することにある。
【０００６】
【課題を解決するための手段】この発明の１チップマイ
クロコンピュータは、ＣＰＵ、ＲＯＭ、ＲＡＭ、Ｉ／Ｏ
ポートおよびタイミング信号発生回路を含む１チップマ
イクロコンピュータにおいて、コンデンサと抵抗の直列
回路からなり、一端がＧＮＤに接続された充電回路と、
前記充電回路の他端と電源ラインとの間に接続され、前
記充電回路の他端と電源ラインとの間を導通または遮断
するトランジスタと、前記充電回路の他端と電源ライン
との間に接続され、前記コンデンサの充電電荷を電源ラ
インへ放電するダイオードと、前記コンデンサの充電電
圧をＡ／Ｄ変換するＡ／Ｄコンバータと、前記トランジ
スタを断続するトランジスタ制御手段と、前記Ａ／Ｄコ
ンバータによるＡ／Ｄ変換値を基準値と比較する比較手
段、とを設けたことを特徴とする。
クロコンピュータは、ＣＰＵ、ＲＯＭ、ＲＡＭ、Ｉ／Ｏ
ポートおよびタイミング信号発生回路を含む１チップマ
イクロコンピュータにおいて、コンデンサと抵抗の直列
回路からなり、一端がＧＮＤに接続された充電回路と、
前記充電回路の他端と電源ラインとの間に接続され、前
記充電回路の他端と電源ラインとの間を導通または遮断
するトランジスタと、前記充電回路の他端と電源ライン
との間に接続され、前記コンデンサの充電電荷を電源ラ
インへ放電するダイオードと、前記コンデンサの充電電
圧をＡ／Ｄ変換するＡ／Ｄコンバータと、前記トランジ
スタを断続するトランジスタ制御手段と、前記Ａ／Ｄコ
ンバータによるＡ／Ｄ変換値を基準値と比較する比較手
段、とを設けたことを特徴とする。
【０００７】
【作用】この発明の１チップマイクロコンピュータで
は、コンデンサと抵抗の直列回路からなる充電回路の一
端がＧＮＤに接続され、他端と電源ライン間にトランジ
スタが接続されている。トランジスタ制御手段によって
このトランジスタが導通すれば、前記コンデンサに電荷
が充電される。また、電源ラインと充電回路間にはダイ
オードが接続されていて、電源電圧が前記コンデンサの
充電電圧より低下すれば、（正確には電源電圧がコンデ
ンサの充電電圧にダイオードの順方向降下電圧を加えた
値より低下すれば、）コンデンサの充電電荷はダイオー
ドを通して電源ラインへ放電される。したがって電源電
圧が低下すれば直ちにコンデンサの充電電荷が電源電圧
に応じて低下することになる。Ａ／Ｄコンバータは前記
コンデンサの充電電圧をＡ／Ｄ変換し、比較手段はその
Ａ／Ｄ変換値を基準値に比較して、電源電圧の低下状態
を判定する。たとえば１チップマイクロコンピュータ内
のＡ／Ｄコンバータおよびその他のアナログ回路の動作
を保証することのできる下限電圧まで電源電圧が低下し
たことを判定できるようにすれば、その判定結果に応じ
て、たとえばＡ／Ｄコンバータによる測定値を無効にす
る等のプログラム処理が可能となる。なお、前記トラン
ジスタは充電回路のコンデンサを充電する時にのみ導通
すればよいため、そのトランジスタおよび充電回路の通
電による電力消費は極めて低く抑えられる。
は、コンデンサと抵抗の直列回路からなる充電回路の一
端がＧＮＤに接続され、他端と電源ライン間にトランジ
スタが接続されている。トランジスタ制御手段によって
このトランジスタが導通すれば、前記コンデンサに電荷
が充電される。また、電源ラインと充電回路間にはダイ
オードが接続されていて、電源電圧が前記コンデンサの
充電電圧より低下すれば、（正確には電源電圧がコンデ
ンサの充電電圧にダイオードの順方向降下電圧を加えた
値より低下すれば、）コンデンサの充電電荷はダイオー
ドを通して電源ラインへ放電される。したがって電源電
圧が低下すれば直ちにコンデンサの充電電荷が電源電圧
に応じて低下することになる。Ａ／Ｄコンバータは前記
コンデンサの充電電圧をＡ／Ｄ変換し、比較手段はその
Ａ／Ｄ変換値を基準値に比較して、電源電圧の低下状態
を判定する。たとえば１チップマイクロコンピュータ内
のＡ／Ｄコンバータおよびその他のアナログ回路の動作
を保証することのできる下限電圧まで電源電圧が低下し
たことを判定できるようにすれば、その判定結果に応じ
て、たとえばＡ／Ｄコンバータによる測定値を無効にす
る等のプログラム処理が可能となる。なお、前記トラン
ジスタは充電回路のコンデンサを充電する時にのみ導通
すればよいため、そのトランジスタおよび充電回路の通
電による電力消費は極めて低く抑えられる。
【０００８】
【実施例】この発明の実施例である１チップマイクロコ
ンピュータの構成を図１および図２に示す。
ンピュータの構成を図１および図２に示す。
【０００９】図１は１チップマイクロコンピュータ全体
の構成を示すブロック図である。図１においてＲＯＭは
プログラムをあらかじめ書き込んだメモリ、ＳＲおよび
ＰＣはＲＯＭアドレス制御用レジスタである。ＲＡＭは
前記プログラムの実行時に各種データの一時記憶に用い
る。ＳＢ，ＢはＲＡＭのアドレス制御用レジスタであ
る。ＡＬＵは算術論理演算回路、Ｘ，ＡＣＣは各種演算
処理時に用いられるレジスタである。ＡＤＣはＡ／Ｄコ
ンバータ、ＺはＡＤＣに対する入力セレクタ、ＧはＡＤ
Ｃの出力を記憶するレジスタである。入力セレクタＺは
８本の電圧信号を入力し、選択信号に応じて８本のうち
１本の入力電圧信号をＡＤＣへ与える。タイマ回路は設
定された時間間隔でタイマ割り込み信号を発生させる。
Ｉ／Ｏポートは、各種データの入出力を行うラッチ回路
からなる。ＤＶはＣＬ１−ＣＬ２間にに水晶発振子を接
続してクロック信号およびその他のタイミング信号を発
生する。また、図１において１で示す回路は後述する電
源電圧検出用入力回路であり、電源ラインＶDDとＧＮＤ
ライン間に設けて、その出力信号ＶＳをＡＤＣの入力セ
レクタの１本に与えている。
の構成を示すブロック図である。図１においてＲＯＭは
プログラムをあらかじめ書き込んだメモリ、ＳＲおよび
ＰＣはＲＯＭアドレス制御用レジスタである。ＲＡＭは
前記プログラムの実行時に各種データの一時記憶に用い
る。ＳＢ，ＢはＲＡＭのアドレス制御用レジスタであ
る。ＡＬＵは算術論理演算回路、Ｘ，ＡＣＣは各種演算
処理時に用いられるレジスタである。ＡＤＣはＡ／Ｄコ
ンバータ、ＺはＡＤＣに対する入力セレクタ、ＧはＡＤ
Ｃの出力を記憶するレジスタである。入力セレクタＺは
８本の電圧信号を入力し、選択信号に応じて８本のうち
１本の入力電圧信号をＡＤＣへ与える。タイマ回路は設
定された時間間隔でタイマ割り込み信号を発生させる。
Ｉ／Ｏポートは、各種データの入出力を行うラッチ回路
からなる。ＤＶはＣＬ１−ＣＬ２間にに水晶発振子を接
続してクロック信号およびその他のタイミング信号を発
生する。また、図１において１で示す回路は後述する電
源電圧検出用入力回路であり、電源ラインＶDDとＧＮＤ
ライン間に設けて、その出力信号ＶＳをＡＤＣの入力セ
レクタの１本に与えている。
【００１０】図２は図１に示した電源電圧検出用入力回
路１の回路図である。図２において抵抗Ｒおよびコンデ
ンサＣからなる直列回路は充電回路であり、その一端を
ＧＮＤに接続している。また、図においてＰはｐチャン
ネルＭＯＳトランジスタからなるプリチャージ用トラン
ジスタであり、電源ライン側をソースとして電源ライン
ＶDDと前記充電回路の他端間に接続している。また、電
源電圧ラインと充電回路間には、電源ライン側をｐチャ
ンネルとして放電用ダイオードＤを接続している。トラ
ンジスタＰのゲートにはトランジスタ制御信号ＣＳを入
力し、トランジスタＰと充電回路との接続点の電圧信号
ＶＳを図１に示したＡＤＣの入力セレクタＺに与えるよ
うにしている。トランジスタ制御信号ＣＳは任意のプリ
チャージ命令実行時に、または一定時間ごとに発生され
る。制御信号ＣＳがＧＮＤレベルである期間、トランジ
スタＰが導通し、トランジスタのオン抵抗と充電回路の
回路定数により定まる充電時定数と電源電圧に応じてコ
ンデンサＣが充電され、電圧信号ＶＳが上昇する。コン
デンサＣに電荷が蓄積された任意の期間後に、トランジ
スタＰを遮断することによって、このトランジスタＰは
オープン状態となり、コンデンサＣの充電電荷が維持さ
れる。その一定時間後、図１に示した入力セレクタＺに
よって電圧信号ＶＳを選択させ、そのＡ／Ｄ変換値をレ
ジスタＧに求める。その際、図１に示した入力セレクタ
ＺおよびＡ／ＤコンバータＡＤＣの入力インピーダンス
と充電回路の回路定数により定まる放電時定数に応じて
コンデンサＣが放電され、電圧信号ＶＳが低下する。し
かしトランジスタＰの導通時間が一定であれば、電源電
圧ＶDDに対する電圧信号ＶＳは一義的に定まり、電圧信
号ＶＳのＡ／Ｄ変換値から電源電圧が正常範囲内である
か否かの判定が可能となる。
路１の回路図である。図２において抵抗Ｒおよびコンデ
ンサＣからなる直列回路は充電回路であり、その一端を
ＧＮＤに接続している。また、図においてＰはｐチャン
ネルＭＯＳトランジスタからなるプリチャージ用トラン
ジスタであり、電源ライン側をソースとして電源ライン
ＶDDと前記充電回路の他端間に接続している。また、電
源電圧ラインと充電回路間には、電源ライン側をｐチャ
ンネルとして放電用ダイオードＤを接続している。トラ
ンジスタＰのゲートにはトランジスタ制御信号ＣＳを入
力し、トランジスタＰと充電回路との接続点の電圧信号
ＶＳを図１に示したＡＤＣの入力セレクタＺに与えるよ
うにしている。トランジスタ制御信号ＣＳは任意のプリ
チャージ命令実行時に、または一定時間ごとに発生され
る。制御信号ＣＳがＧＮＤレベルである期間、トランジ
スタＰが導通し、トランジスタのオン抵抗と充電回路の
回路定数により定まる充電時定数と電源電圧に応じてコ
ンデンサＣが充電され、電圧信号ＶＳが上昇する。コン
デンサＣに電荷が蓄積された任意の期間後に、トランジ
スタＰを遮断することによって、このトランジスタＰは
オープン状態となり、コンデンサＣの充電電荷が維持さ
れる。その一定時間後、図１に示した入力セレクタＺに
よって電圧信号ＶＳを選択させ、そのＡ／Ｄ変換値をレ
ジスタＧに求める。その際、図１に示した入力セレクタ
ＺおよびＡ／ＤコンバータＡＤＣの入力インピーダンス
と充電回路の回路定数により定まる放電時定数に応じて
コンデンサＣが放電され、電圧信号ＶＳが低下する。し
かしトランジスタＰの導通時間が一定であれば、電源電
圧ＶDDに対する電圧信号ＶＳは一義的に定まり、電圧信
号ＶＳのＡ／Ｄ変換値から電源電圧が正常範囲内である
か否かの判定が可能となる。
【００１１】もし、電源電圧が瞬時低下すれば、トラン
ジスタＰの遮断状態で、コンデンサＣの充電電荷が抵抗
ＲおよびダイオードＤを介して電源ラインに放電され、
電源電圧に応じて電圧信号ＶＳは低下する。したがっ
て、Ａ／Ｄコンバータにより求めた電圧信号ＶＳのＡ／
Ｄ変換値から前記電源電圧の瞬時低下を検出し、Ａ／Ｄ
コンバータおよびその他のアナログ回路部分の保証電圧
を下回ったか否かの判定を行うことができる。電源電圧
があらかじめ定めた下限値を下回らなければ、Ａ／Ｄコ
ンバータのＡ／Ｄ変換結果およびその他のアナログ回路
の動作を保証することができる。もし、Ａ／Ｄ変換結果
が、電源電圧の瞬時低下が下限値を下回ったなら、たと
えばその直前に、電圧信号入力端子Ｚ0 〜Ｚ7 から入力
された電圧信号のＡ／Ｄ変換値が誤っているおそれがあ
るものとみなして、再度同一の測定を行うようにするこ
ともできる。
ジスタＰの遮断状態で、コンデンサＣの充電電荷が抵抗
ＲおよびダイオードＤを介して電源ラインに放電され、
電源電圧に応じて電圧信号ＶＳは低下する。したがっ
て、Ａ／Ｄコンバータにより求めた電圧信号ＶＳのＡ／
Ｄ変換値から前記電源電圧の瞬時低下を検出し、Ａ／Ｄ
コンバータおよびその他のアナログ回路部分の保証電圧
を下回ったか否かの判定を行うことができる。電源電圧
があらかじめ定めた下限値を下回らなければ、Ａ／Ｄコ
ンバータのＡ／Ｄ変換結果およびその他のアナログ回路
の動作を保証することができる。もし、Ａ／Ｄ変換結果
が、電源電圧の瞬時低下が下限値を下回ったなら、たと
えばその直前に、電圧信号入力端子Ｚ0 〜Ｚ7 から入力
された電圧信号のＡ／Ｄ変換値が誤っているおそれがあ
るものとみなして、再度同一の測定を行うようにするこ
ともできる。
【００１２】以上に述べたトランジスタの断続制御と、
求められた電圧信号ＶＳのＡ／Ｄ変換およびそのＡ／Ｄ
変換値の判定、さらには判定結果に基づく再測定等の処
理は、必要に応じて任意のタイミングに行ってもよい
が、たとえばタイマー割り込み処理により、一定周期で
自動的に行うことも可能である。
求められた電圧信号ＶＳのＡ／Ｄ変換およびそのＡ／Ｄ
変換値の判定、さらには判定結果に基づく再測定等の処
理は、必要に応じて任意のタイミングに行ってもよい
が、たとえばタイマー割り込み処理により、一定周期で
自動的に行うことも可能である。
【００１３】なお、電源電圧がどの程度低下した時点
で、異常電圧低下とみなすか否かは、充電回路２の時定
数によってあらかじめ設定することができ、さらにＡ／
Ｄ変換結果に対する基準値の変更により調節が可能であ
り、前記基準値をプログラム実行時に変更することによ
って、動作中にしきい値を変更することも可能である。
で、異常電圧低下とみなすか否かは、充電回路２の時定
数によってあらかじめ設定することができ、さらにＡ／
Ｄ変換結果に対する基準値の変更により調節が可能であ
り、前記基準値をプログラム実行時に変更することによ
って、動作中にしきい値を変更することも可能である。
【００１４】
【発明の効果】この発明の１チップマイクロコンピュー
タによれば、任意のタイミングまたは一定期間ごとに電
源電圧の低下をマイクロコンピュータ自身が検出するこ
とができ、仮に電源電圧の瞬時低下によってマイクロコ
ンピュータ自身が誤動作しない場合でも、Ａ／Ｄコンバ
ータおよびその他のアナログ回路部分の異常動作のおそ
れを判定できるようになる。その結果、制御すべき機器
の動作上の信頼性を高めることができる。また、この発
明に係るトランジスタは充電回路のコンデンサを充電す
る時にのみ導通するため、そのトランジスタおよび充電
回路の通電による電力消費は極めて低く抑えられ、無駄
な電力消費もない。
タによれば、任意のタイミングまたは一定期間ごとに電
源電圧の低下をマイクロコンピュータ自身が検出するこ
とができ、仮に電源電圧の瞬時低下によってマイクロコ
ンピュータ自身が誤動作しない場合でも、Ａ／Ｄコンバ
ータおよびその他のアナログ回路部分の異常動作のおそ
れを判定できるようになる。その結果、制御すべき機器
の動作上の信頼性を高めることができる。また、この発
明に係るトランジスタは充電回路のコンデンサを充電す
る時にのみ導通するため、そのトランジスタおよび充電
回路の通電による電力消費は極めて低く抑えられ、無駄
な電力消費もない。
【図１】この発明の実施例である１チップマイクロコン
ピュータの構成を示すブロック図である。
ピュータの構成を示すブロック図である。
【図２】図１における電源電圧検出用入力回路１の回路
図である。
図である。
１−電源電圧検出用入力回路 ２−充電回路
Claims (1)
- 【請求項１】ＣＰＵ、ＲＯＭ、ＲＡＭ、Ｉ／Ｏポートお
よびタイミング信号発生回路を含む１チップマイクロコ
ンピュータにおいて、 コンデンサと抵抗の直列回路からなり、一端がＧＮＤに
接続された充電回路と、 前記充電回路の他端と電源ラインとの間に接続され、前
記充電回路の他端と電源ラインとの間を導通または遮断
するトランジスタと、 前記充電回路の他端と電源ラインとの間に接続され、前
記コンデンサの充電電荷を電源ラインへ放電するダイオ
ードと、 前記コンデンサの充電電圧をＡ／Ｄ変換するＡ／Ｄコン
バータと、 前記トランジスタを断続するトランジスタ制御手段と、 前記Ａ／ＤコンバータによるＡ／Ｄ変換値を基準値と比
較する比較手段、とを設けたことを特徴とする１チップ
マイクロコンピュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4140487A JPH05334461A (ja) | 1992-06-01 | 1992-06-01 | １チップマイクロコンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4140487A JPH05334461A (ja) | 1992-06-01 | 1992-06-01 | １チップマイクロコンピュータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05334461A true JPH05334461A (ja) | 1993-12-17 |
Family
ID=15269757
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4140487A Pending JPH05334461A (ja) | 1992-06-01 | 1992-06-01 | １チップマイクロコンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05334461A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018049425A (ja) * | 2016-09-21 | 2018-03-29 | Ｎｅｃプラットフォームズ株式会社 | 要因判定装置、要因判定方法、要因判定プログラム、及び、通信装置 |
-
1992
- 1992-06-01 JP JP4140487A patent/JPH05334461A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018049425A (ja) * | 2016-09-21 | 2018-03-29 | Ｎｅｃプラットフォームズ株式会社 | 要因判定装置、要因判定方法、要因判定プログラム、及び、通信装置 |
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