JPH05324377A - プロセッサ監視システム - Google Patents
プロセッサ監視システムInfo
- Publication number
- JPH05324377A JPH05324377A JP4148283A JP14828392A JPH05324377A JP H05324377 A JPH05324377 A JP H05324377A JP 4148283 A JP4148283 A JP 4148283A JP 14828392 A JP14828392 A JP 14828392A JP H05324377 A JPH05324377 A JP H05324377A
- Authority
- JP
- Japan
- Prior art keywords
- microprocessor
- maintenance information
- shift data
- monitoring system
- information processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
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Abstract
(57)【要約】
【目的】 デュアルシステムにおいて各プロセッサでの
処理結果に差異が生じると、その不一致部分の検出を迅
速にかつ正確に行うことができるプロセッサ監視システ
ムを提供すること。 【構成】 同一の処理を同期して行う第１のマイクロプ
ロセッサ１および第２のマイクロプロセッサ２と、各マ
イクロプロセッサ１，２からのシフトデータを比較解析
する保守情報処理装置３と、この保守情報処理装置３か
らの保守情報を表示する表示部８とを具備する。
処理結果に差異が生じると、その不一致部分の検出を迅
速にかつ正確に行うことができるプロセッサ監視システ
ムを提供すること。 【構成】 同一の処理を同期して行う第１のマイクロプ
ロセッサ１および第２のマイクロプロセッサ２と、各マ
イクロプロセッサ１，２からのシフトデータを比較解析
する保守情報処理装置３と、この保守情報処理装置３か
らの保守情報を表示する表示部８とを具備する。
Description
【０００１】
【産業上の利用分野】本発明は、プロセッサ監視システ
ムに係り、とくにデュアルシステムにおけるプロセッサ
監視システムに関する。
ムに係り、とくにデュアルシステムにおけるプロセッサ
監視システムに関する。
【０００２】
【従来の技術】２つのマイクロプロセッサで同一の処理
を同期して個別に行い、結果を照合するシステムをデュ
アルシステムといい、銀行のように高度な信頼性が要求
される分野で用いられている。
を同期して個別に行い、結果を照合するシステムをデュ
アルシステムといい、銀行のように高度な信頼性が要求
される分野で用いられている。
【０００３】従来のデュアルシステムにおけるプロセッ
サ監視システムでは、各プロセッサがお互いに冗長監視
を行っており、シフトデータを保守情報としてプロセッ
サ毎に表示していた。
サ監視システムでは、各プロセッサがお互いに冗長監視
を行っており、シフトデータを保守情報としてプロセッ
サ毎に表示していた。
【０００４】
【発明が解決しようとする課題】しかしながら、上記従
来例においては、２つのプロセッサが同一の処理を同期
して行い、シフトデータを各プロセッサ毎に表示してい
たために、お互いの処理結果に差異が生じた場合に、そ
の不一致部分の検出に多くの工数を必要とするという不
都合があった。
来例においては、２つのプロセッサが同一の処理を同期
して行い、シフトデータを各プロセッサ毎に表示してい
たために、お互いの処理結果に差異が生じた場合に、そ
の不一致部分の検出に多くの工数を必要とするという不
都合があった。
【０００５】
【発明の目的】本発明の目的は、かかる従来例の有する
不都合を改善し、とくにデュアルシステムにおいて各プ
ロセッサでの処理結果に差異が生じると、その不一致部
分の検出を迅速にかつ正確に行うことができるプロセッ
サ監視システムを提供することにある。
不都合を改善し、とくにデュアルシステムにおいて各プ
ロセッサでの処理結果に差異が生じると、その不一致部
分の検出を迅速にかつ正確に行うことができるプロセッ
サ監視システムを提供することにある。
【０００６】
【課題を解決するための手段】そこで、本発明では、同
一の処理を同期して行う第１のマイクロプロセッサおよ
び第２のマイクロプロセッサと、各マイクロプロセッサ
からのシフトデータを比較解析する保守情報処理装置
と、この保守情報処理装置からの保守情報を表示する表
示部とを具備するという構成を採っている。これによっ
て前述した目的を達成しようとするものである。
一の処理を同期して行う第１のマイクロプロセッサおよ
び第２のマイクロプロセッサと、各マイクロプロセッサ
からのシフトデータを比較解析する保守情報処理装置
と、この保守情報処理装置からの保守情報を表示する表
示部とを具備するという構成を採っている。これによっ
て前述した目的を達成しようとするものである。
【０００７】
【作用】第１のマイクロプロセッサと第２のマイクロプ
ロセッサの送出信号に不一致が生じると、保守情報処理
装置は各マイクロプロセッサのシフトデータを取得す
る。
ロセッサの送出信号に不一致が生じると、保守情報処理
装置は各マイクロプロセッサのシフトデータを取得す
る。
【０００８】オペレータが、これらのシフトデータを要
求すると、保守情報処理装置は、第１のマイクロプロセ
ッサのシフトデータと第２のマイクロプロセッサのシフ
トデータを比較し、不一致部分を検出して表示部に送出
する。
求すると、保守情報処理装置は、第１のマイクロプロセ
ッサのシフトデータと第２のマイクロプロセッサのシフ
トデータを比較し、不一致部分を検出して表示部に送出
する。
【０００９】表示部は、保守情報処理装置からの各種保
守情報データを表示する。
守情報データを表示する。
【００１０】
【発明の実施例】以下、本発明の一実施例を図１に基づ
いて説明する。図１の実施例は、同一の処理を同期して
行う第１のマイクロプロセッサ１および第２のマイクロ
プロセッサ２と、各マイクロプロセッサ１，２からのシ
フトデータを比較解析する保守情報処理装置（ＳＶＰ）
３と、保守情報処理装置（ＳＶＰ）３が取得した各マイ
クロプロセッサ１，２からのシフトデータを記憶する記
憶部７と、保守情報処理装置（ＳＶＰ）３からの各種保
守情報データを表示する表示部８とから構成される。
いて説明する。図１の実施例は、同一の処理を同期して
行う第１のマイクロプロセッサ１および第２のマイクロ
プロセッサ２と、各マイクロプロセッサ１，２からのシ
フトデータを比較解析する保守情報処理装置（ＳＶＰ）
３と、保守情報処理装置（ＳＶＰ）３が取得した各マイ
クロプロセッサ１，２からのシフトデータを記憶する記
憶部７と、保守情報処理装置（ＳＶＰ）３からの各種保
守情報データを表示する表示部８とから構成される。
【００１１】ここで、第１のマイクロプロセッサ１およ
び第２のマイクロプロセッサ２は二重化システム構成と
なっており、全く同じ構造で同じ動作を行う。
び第２のマイクロプロセッサ２は二重化システム構成と
なっており、全く同じ構造で同じ動作を行う。
【００１２】また第１のマイクロプロセッサ１および第
２のマイクロプロセッサ２は冗長監視機能を有してお
り、各マイクロプロセッサ１，２はお互いの出力信号を
比較し、不一致が発生した場合にはどちらかのマイクロ
プロセッサに何らかの障害が発生したと判断し、動作を
停止させる仕組みになっている。
２のマイクロプロセッサ２は冗長監視機能を有してお
り、各マイクロプロセッサ１，２はお互いの出力信号を
比較し、不一致が発生した場合にはどちらかのマイクロ
プロセッサに何らかの障害が発生したと判断し、動作を
停止させる仕組みになっている。
【００１３】保守情報処理装置（ＳＶＰ）３は、第１の
マイクロプロセッサ１か第２のマイクロプロセッサ２の
どちらかに障害が発生して動作が停止すると、各マイク
ロプロセッサ１，２のシフトデータを取得し記憶部７に
格納する記憶制御部４と、この記憶制御部４から送られ
てくる第１のマイクロプロセッサ１のシフトデータと第
２のマイクロプロセッサ２のシフトデータを比較する比
較部５と、記憶制御部４から送られてくる各マイクロプ
ロセッサ１，２のそれぞれのシフトデータと比較部５で
の比較結果をまとめて表示部８に送出する表示制御部６
を具備している。
マイクロプロセッサ１か第２のマイクロプロセッサ２の
どちらかに障害が発生して動作が停止すると、各マイク
ロプロセッサ１，２のシフトデータを取得し記憶部７に
格納する記憶制御部４と、この記憶制御部４から送られ
てくる第１のマイクロプロセッサ１のシフトデータと第
２のマイクロプロセッサ２のシフトデータを比較する比
較部５と、記憶制御部４から送られてくる各マイクロプ
ロセッサ１，２のそれぞれのシフトデータと比較部５で
の比較結果をまとめて表示部８に送出する表示制御部６
を具備している。
【００１４】記憶部７は、フロッピーディスク、ハード
ディスク等の記憶装置であり、ログデータなどの保守情
報を格納するエリアを専用に持っている。
ディスク等の記憶装置であり、ログデータなどの保守情
報を格納するエリアを専用に持っている。
【００１５】表示部８は、コンソール画面等の表示装置
であり、表示制御部６からのシフトデータおよび不一致
箇所データの表示を行う。
であり、表示制御部６からのシフトデータおよび不一致
箇所データの表示を行う。
【００１６】次に、本実施例の動作について説明する。
第１のマイクロプロセッサ１と第２のマイクロプロセッ
サ２の送出信号に不一致が生じ、何らかの障害が発生し
たと判断して動作が停止したとする。
第１のマイクロプロセッサ１と第２のマイクロプロセッ
サ２の送出信号に不一致が生じ、何らかの障害が発生し
たと判断して動作が停止したとする。
【００１７】．記憶制御部４は、第１のマイクロプロ
セッサ１のシフトデータを信号線１０１を介して取り込
み、第２のマイクロプロセッサ２のシフトデータを信号
線１０２を介して取り込む。そして、記憶制御部４は、
これらの取り込んだシフトデータを記憶部７に記憶す
る。
セッサ１のシフトデータを信号線１０１を介して取り込
み、第２のマイクロプロセッサ２のシフトデータを信号
線１０２を介して取り込む。そして、記憶制御部４は、
これらの取り込んだシフトデータを記憶部７に記憶す
る。
【００１８】．オペレータがこれらのシフトデータを
要求すると、記憶制御部４は、記憶部７に記憶している
シフトデータを比較部５および表示制御部６に送出す
る。
要求すると、記憶制御部４は、記憶部７に記憶している
シフトデータを比較部５および表示制御部６に送出す
る。
【００１９】．比較部５は、記憶制御部４からの第１
のマイクロプロセッサ１のシフトデータと第２のマイク
ロプロセッサ２のシフトデータを比較し、不一致部分を
検出して表示制御部６に送出する。
のマイクロプロセッサ１のシフトデータと第２のマイク
ロプロセッサ２のシフトデータを比較し、不一致部分を
検出して表示制御部６に送出する。
【００２０】．表示制御部６は、記憶制御部４からの
第１のマイクロプロセッサ１のシフトデータと第２のマ
イクロプロセッサ２のシフトデータ、および比較部５か
らの不一致部分データを表示部８に送出する。
第１のマイクロプロセッサ１のシフトデータと第２のマ
イクロプロセッサ２のシフトデータ、および比較部５か
らの不一致部分データを表示部８に送出する。
【００２１】．表示部８は、表示制御部６からの各種
データを表示する。
データを表示する。
【００２２】
【発明の効果】本発明は以上のように構成され機能する
ので、これによると、障害解析時に各マイクロプロセッ
サのどのレジスタで不一致が発生したかを容易に知るこ
とができ、これがため、障害解析の工数を減少でき、早
期に回復させることができるという従来にない優れたプ
ロセッサ監視システムを提供することができる。
ので、これによると、障害解析時に各マイクロプロセッ
サのどのレジスタで不一致が発生したかを容易に知るこ
とができ、これがため、障害解析の工数を減少でき、早
期に回復させることができるという従来にない優れたプ
ロセッサ監視システムを提供することができる。
【図１】本発明の一実施例を示す構成図である。
１：第１のマイクロプロセッサ ２：第２のマイクロプロセッサ ３：保守情報処理装置（ＳＶＰ） ４：記憶制御部 ５：比較部 ６：表示制御部 ７：記憶部 ８：表示部
Claims (2)
- 【請求項１】 同一の処理を同期して行う第１のマイク
ロプロセッサおよび第２のマイクロプロセッサと、前記
各マイクロプロセッサからのシフトデータを比較解析す
る保守情報処理装置とを備え、この保守情報処理装置か
らの保守情報を表示する表示部を装備したことを特徴と
するプロセッサ監視システム。 - 【請求項２】 前記保守情報処理装置が、前記第１のマ
イクロプロセッサか前記第２のマイクロプロセッサのど
ちらかに障害が発生して動作が停止すると前記各マイク
ロプロセッサのシフトデータを取得し比較する比較部
と、取得した前記各マイクロプロセッサのシフトデータ
と前記比較部での比較結果を前記表示部に送出する表示
制御部とを具備したことを特徴とする請求項１記載のプ
ロセッサ監視システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4148283A JPH05324377A (ja) | 1992-05-14 | 1992-05-14 | プロセッサ監視システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4148283A JPH05324377A (ja) | 1992-05-14 | 1992-05-14 | プロセッサ監視システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05324377A true JPH05324377A (ja) | 1993-12-07 |
Family
ID=15449306
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4148283A Withdrawn JPH05324377A (ja) | 1992-05-14 | 1992-05-14 | プロセッサ監視システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05324377A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH086854A (ja) * | 1993-12-23 | 1996-01-12 | Unisys Corp | アウトボードファイルキャッシュ外部処理コンプレックス |
| JP2003084801A (ja) * | 2001-09-12 | 2003-03-19 | Tokyo Electron Ltd | インターロック機構，インターロック方法および熱処理装置 |
-
1992
- 1992-05-14 JP JP4148283A patent/JPH05324377A/ja not_active Withdrawn
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH086854A (ja) * | 1993-12-23 | 1996-01-12 | Unisys Corp | アウトボードファイルキャッシュ外部処理コンプレックス |
| JP2003084801A (ja) * | 2001-09-12 | 2003-03-19 | Tokyo Electron Ltd | インターロック機構，インターロック方法および熱処理装置 |
| JP4571350B2 (ja) * | 2001-09-12 | 2010-10-27 | 東京エレクトロン株式会社 | インターロック機構，インターロック方法および熱処理装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990803 |