JPH0524672B2 - - Google Patents
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- JPH0524672B2 JPH0524672B2 JP9064083A JP9064083A JPH0524672B2 JP H0524672 B2 JPH0524672 B2 JP H0524672B2 JP 9064083 A JP9064083 A JP 9064083A JP 9064083 A JP9064083 A JP 9064083A JP H0524672 B2 JPH0524672 B2 JP H0524672B2
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/45—Ohmic electrodes
- H01L29/456—Ohmic electrodes on silicon
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- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は半導体装置にかかり、特に個別素
子、集積回路などの電極配線層の構造に関する。
子、集積回路などの電極配線層の構造に関する。
半導体素子における電極配線層の構造には種々
のものがある。特に個別素子において、第1図に
示す電極配線層が多く用いられている。これのシ
リコン基板1には例えばP1領域層2、N1領域層
3、P2領域層4、N2領域層5の4層が形成され
たものが用意される。上記シリコン基板の主面に
ホーニングを施してホーニング面6に形成し、こ
れに第1層のV層7、さらに積層させて第2層の
Ni層8と第3層のAu層9を蒸着形成する。上記
V層7はNi層8がシリコン基板1のSiとシリサ
イドを形成するのを防止するバリヤ金属層であ
り、第3層のAu層9はNi層8の酸化防止と、は
んだ電極形成のために濡れをよくするために設け
られている。
のものがある。特に個別素子において、第1図に
示す電極配線層が多く用いられている。これのシ
リコン基板1には例えばP1領域層2、N1領域層
3、P2領域層4、N2領域層5の4層が形成され
たものが用意される。上記シリコン基板の主面に
ホーニングを施してホーニング面6に形成し、こ
れに第1層のV層7、さらに積層させて第2層の
Ni層8と第3層のAu層9を蒸着形成する。上記
V層7はNi層8がシリコン基板1のSiとシリサ
イドを形成するのを防止するバリヤ金属層であ
り、第3層のAu層9はNi層8の酸化防止と、は
んだ電極形成のために濡れをよくするために設け
られている。
なお、10は接合面を保護し電気絶縁をはかる
ためのSiO2層である。
ためのSiO2層である。
叙上のV―Ni―Auの3層電極配線層におい
て、まず、V層は200Å以下の場合にはシリコン
基板上に「蒸着むら」が発生しやすく、第2層目
のNi層と半導体基板との反応を阻止するバリヤ
効果が小さくなる。さらに、Vは膜ストレスが
Niより大きいため1000Å以上の膜厚では膜厚の
増加とともにストレスが増大し、ペレツトカツト
のときにはがれを生じやすい。
て、まず、V層は200Å以下の場合にはシリコン
基板上に「蒸着むら」が発生しやすく、第2層目
のNi層と半導体基板との反応を阻止するバリヤ
効果が小さくなる。さらに、Vは膜ストレスが
Niより大きいため1000Å以上の膜厚では膜厚の
増加とともにストレスが増大し、ペレツトカツト
のときにはがれを生じやすい。
次にNi層は6000Å以上の層厚において蒸着中
に膜に蓄積される内部応力が大になり、膜ひずみ
により蒸着膜が剥れることがある。また、2000Å
以下でははんだ電極層形成時、はんだによる喰わ
れがあり、はんだがV層にまで達してはんだつき
が不良になる。
に膜に蓄積される内部応力が大になり、膜ひずみ
により蒸着膜が剥れることがある。また、2000Å
以下でははんだ電極層形成時、はんだによる喰わ
れがあり、はんだがV層にまで達してはんだつき
が不良になる。
また、Au層は1000Åを超えると高価につき、
薄いと蒸着むらによるはんだ濡れの不良部分が発
生する。
薄いと蒸着むらによるはんだ濡れの不良部分が発
生する。
叙上に加えVはシリコン基板のSiとの接着性が
弱く、常温ではSiと反応しにくいため、層間シン
タのない3層連続蒸着においてはVの層から電極
はがれを生じやすいという重大な欠点がある。
弱く、常温ではSiと反応しにくいため、層間シン
タのない3層連続蒸着においてはVの層から電極
はがれを生じやすいという重大な欠点がある。
この発明は叙上の従来の欠点に鑑み積層して形
成される電極の改良構造を提供する。
成される電極の改良構造を提供する。
この発明に係る半導体装置は、シリコン基板に
少なくとも一つの接合を有する半導体装置におい
て、前記シリコン基板上にはんだ浸漬程度の温度
でシリコンとシリサイドを形成するAl,Ni,Ti,
Zr,Hf,Mo,W,Ta,Pt,Nbの中から一つを
選んで形成された低抵抗オーミツク性電極層と、
前記電極層に順次積層して形成されたV,Ni,
Auの各電極層とを具備し、はんだ浸漬によつて
前記低抵抗オーミツク性電極層とシリコン基板と
の間にシリサイドが形成されてなることを特徴と
する。
少なくとも一つの接合を有する半導体装置におい
て、前記シリコン基板上にはんだ浸漬程度の温度
でシリコンとシリサイドを形成するAl,Ni,Ti,
Zr,Hf,Mo,W,Ta,Pt,Nbの中から一つを
選んで形成された低抵抗オーミツク性電極層と、
前記電極層に順次積層して形成されたV,Ni,
Auの各電極層とを具備し、はんだ浸漬によつて
前記低抵抗オーミツク性電極層とシリコン基板と
の間にシリサイドが形成されてなることを特徴と
する。
以下にこの発明を1実施例につき改良点を説明
する。
する。
この半導体装置におけるシリコン基板1は主面
にホーニングを施さず、パツシベーシヨンのため
のSiO2層10を形成したのち、Siとシリサイド
を形成するAl,Ni,Ti,Zr,Hf,Mo,W,
Ta,Pt,Nbのオーミツク金属の中から選んだ1
つを、例えば蒸着によつて第1層の低抵抗オーミ
ツク性電極層11を被着形成する。上記電極層1
1は一例のNiを層厚1000Åに形成して好適であ
る。
にホーニングを施さず、パツシベーシヨンのため
のSiO2層10を形成したのち、Siとシリサイド
を形成するAl,Ni,Ti,Zr,Hf,Mo,W,
Ta,Pt,Nbのオーミツク金属の中から選んだ1
つを、例えば蒸着によつて第1層の低抵抗オーミ
ツク性電極層11を被着形成する。上記電極層1
1は一例のNiを層厚1000Åに形成して好適であ
る。
次に上記電極層11に従来のように、V,Ni,
Auの各電極層を順次積層して被着する。すなわ
ち、一例の層厚が第2層のV層7を400Å、第3
層のNi層8を5000Å、第4層のAu層9を1000Å
に夫々形成した。
Auの各電極層を順次積層して被着する。すなわ
ち、一例の層厚が第2層のV層7を400Å、第3
層のNi層8を5000Å、第4層のAu層9を1000Å
に夫々形成した。
上記の如く積層して形成した後はんだ溶着を施
し、該電極を導出するはんだ電極が形成される。
し、該電極を導出するはんだ電極が形成される。
この発明は電極配線層がNi―V―Ni―Auのよ
うに4層でなり、半導体基板に直接被着される第
1層11がシリコン基板のSiとシリサイドを形成
するとともに、この層はV層7とも良好な強度で
被着するので、電極層配線層の強度試験で電極は
がれ、電気的諸特性不良などが皆無で歩留100%
を示した。これにたいし、従来はシリコン基板の
SiとV層との間にはんだ浸漬程度の温度では低温
合金反応、すなわち、シリサイド化が充分生じな
いので、積層をすすめる毎に大きくなる内部応力
に耐えられず電極層はがれや電気的諸特性不良に
より歩留が70%程度にとどまつていた。
うに4層でなり、半導体基板に直接被着される第
1層11がシリコン基板のSiとシリサイドを形成
するとともに、この層はV層7とも良好な強度で
被着するので、電極層配線層の強度試験で電極は
がれ、電気的諸特性不良などが皆無で歩留100%
を示した。これにたいし、従来はシリコン基板の
SiとV層との間にはんだ浸漬程度の温度では低温
合金反応、すなわち、シリサイド化が充分生じな
いので、積層をすすめる毎に大きくなる内部応力
に耐えられず電極層はがれや電気的諸特性不良に
より歩留が70%程度にとどまつていた。
この発明によれば各層の層厚を大にしても、発
生する内部応力に充分耐える低温合金層(シリサ
イド層)があるため、電極はがれを完全に防止す
る顕著な効果がある。
生する内部応力に充分耐える低温合金層(シリサ
イド層)があるため、電極はがれを完全に防止す
る顕著な効果がある。
第1図は従来の半導体装置における半導体素子
の電極構造を示す一部の断面図、第2図は1実施
例の半導体装置における半導体素子の電極構造を
示す一部の断面図である。 1…シリコン基板、7…V層、8…Ni層、9
…Au層、10…SiO2層、11…第1層(Ni層)。
の電極構造を示す一部の断面図、第2図は1実施
例の半導体装置における半導体素子の電極構造を
示す一部の断面図である。 1…シリコン基板、7…V層、8…Ni層、9
…Au層、10…SiO2層、11…第1層(Ni層)。
Claims (1)
- 1 シリコン基板に少なくとも一つの接合を有す
る半導体装置において、前記シリコン基板上には
んだ浸漬程度の温度でシリコンとシリサイドを形
成するAl,Ni,Ti,Zr,Hf,Mo,W,Ta,
Pt,Nbの中から一つを選んで形成された低抵抗
オーミツク性電極層と、前記電極層に順次積層し
て形成されたV,Ni,Auの各電極層とを具備
し、はんだ浸漬によつて前記低抵抗オーミツク性
電極層とシリコン基板との間にシリサイドが形成
されてなる半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9064083A JPS59217360A (ja) | 1983-05-25 | 1983-05-25 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9064083A JPS59217360A (ja) | 1983-05-25 | 1983-05-25 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59217360A JPS59217360A (ja) | 1984-12-07 |
JPH0524672B2 true JPH0524672B2 (ja) | 1993-04-08 |
Family
ID=14004094
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9064083A Granted JPS59217360A (ja) | 1983-05-25 | 1983-05-25 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59217360A (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5652444A (en) * | 1995-09-22 | 1997-07-29 | Hughes Electronics | Structure and method for making FETs and HEMTs insensitive to hydrogen gas |
US8802461B2 (en) | 2011-03-22 | 2014-08-12 | Micron Technology, Inc. | Vertical light emitting devices with nickel silicide bonding and methods of manufacturing |
-
1983
- 1983-05-25 JP JP9064083A patent/JPS59217360A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS59217360A (ja) | 1984-12-07 |
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