JPH05100640A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JPH05100640A JPH05100640A JP3287001A JP28700191A JPH05100640A JP H05100640 A JPH05100640 A JP H05100640A JP 3287001 A JP3287001 A JP 3287001A JP 28700191 A JP28700191 A JP 28700191A JP H05100640 A JPH05100640 A JP H05100640A
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- JP
- Japan
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- liquid crystal
- scanning lines
- circuit
- crystal display
- display mode
- Prior art date
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-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02E—REDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
- Y02E60/00—Enabling technologies; Technologies with a potential or indirect contribution to GHG emissions mitigation
- Y02E60/30—Hydrogen technology
- Y02E60/50—Fuel cells
Landscapes
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
(57)【要約】
【目的】 ドレインバイラバの電流駆動能力を大きくし
たり、ＴＦＴのサイズを大きくすることなく拡大表示モ
ード機能を実現した液晶表示装置を提供する。 【構成】 隣接する複数の走査線を同時に選択する機能
を持つ走査線駆動回路と、拡大画面に対応した画像デー
タのサンプリングを行う信号線駆動回路とを用いてアク
ティブマトリックス方式の液晶表示パネルを駆動して拡
大表示動作を実現する。 【効果】 通常の表示モードの同様に１Ｈ期間を使って
画素への書き込みを行うことができ、拡大表示モードの
ために格別にドレインドライバのチップサイズを大きく
したり、ＴＦＴトランジスタのサイズを大きくする必要
がない。
たり、ＴＦＴのサイズを大きくすることなく拡大表示モ
ード機能を実現した液晶表示装置を提供する。 【構成】 隣接する複数の走査線を同時に選択する機能
を持つ走査線駆動回路と、拡大画面に対応した画像デー
タのサンプリングを行う信号線駆動回路とを用いてアク
ティブマトリックス方式の液晶表示パネルを駆動して拡
大表示動作を実現する。 【効果】 通常の表示モードの同様に１Ｈ期間を使って
画素への書き込みを行うことができ、拡大表示モードの
ために格別にドレインドライバのチップサイズを大きく
したり、ＴＦＴトランジスタのサイズを大きくする必要
がない。
Description
【０００１】
【産業上の利用分野】この発明は、液晶表示装置に関
し、主にアクティブマトリックス方式の液晶表示パネル
を用い、拡大表示モード機能を備えたものに利用して有
効な技術に関するものである。
し、主にアクティブマトリックス方式の液晶表示パネル
を用い、拡大表示モード機能を備えたものに利用して有
効な技術に関するものである。
【０００２】
【従来の技術】ＴＦＴ（薄膜トランジスタ）を用いたア
クティブマトリックス方式の液晶表示装置がある。この
ようなフラットパネル・ディスプレイ装置に関しては、
例えば１９９１年発行、『フラットパネル・ディスプレ
イ’９１』日経エレクトロニクス、日経マイクロデバイ
ス編がある。
クティブマトリックス方式の液晶表示装置がある。この
ようなフラットパネル・ディスプレイ装置に関しては、
例えば１９９１年発行、『フラットパネル・ディスプレ
イ’９１』日経エレクトロニクス、日経マイクロデバイ
ス編がある。
【０００３】
【発明が解決しようとする課題】液晶表示パネルを用い
て、縦横２倍ずつ拡大した４倍拡大（４倍ズーム）表示
を行うことができる。例えば、図８のタイミング図に示
すように、走査線選択信号を形成するクロックパルスの
周波数を２倍にし、通常の１Ｈ期間の前半に奇数走査線
Ｇ１を選択し、後半に偶数走査線Ｇ２を選択する。そし
て、ドレインドライバは、サンプリング時間を１／２に
し、Ｈ／２分のビディオ信号をサンプリングして出力す
る。
て、縦横２倍ずつ拡大した４倍拡大（４倍ズーム）表示
を行うことができる。例えば、図８のタイミング図に示
すように、走査線選択信号を形成するクロックパルスの
周波数を２倍にし、通常の１Ｈ期間の前半に奇数走査線
Ｇ１を選択し、後半に偶数走査線Ｇ２を選択する。そし
て、ドレインドライバは、サンプリング時間を１／２に
し、Ｈ／２分のビディオ信号をサンプリングして出力す
る。
【０００４】この構成では、１Ｈの前半でマトリックス
型液晶表示パネルの奇数走査線と偶数走査線のライン用
にドレインバスに書き込み（Ｔ３）、ＴＦＴトランジス
タによってドレインバスから奇数走査線に対応した画素
に書き込み（Ｔ４）、１Ｈの後半でＴＦＴトランジスタ
とによってドレインバスから偶数走査線に対応した画素
に書き込み（Ｔ５）を行う。これらを全走査線について
繰り返すことにより、縦及び横がそれぞれ２倍ずつに拡
大された４倍拡大表示動作を行わせることができる。
型液晶表示パネルの奇数走査線と偶数走査線のライン用
にドレインバスに書き込み（Ｔ３）、ＴＦＴトランジス
タによってドレインバスから奇数走査線に対応した画素
に書き込み（Ｔ４）、１Ｈの後半でＴＦＴトランジスタ
とによってドレインバスから偶数走査線に対応した画素
に書き込み（Ｔ５）を行う。これらを全走査線について
繰り返すことにより、縦及び横がそれぞれ２倍ずつに拡
大された４倍拡大表示動作を行わせることができる。
【０００５】このような拡大表示動作モードにおいて、
ドレインドライバは１Ｈ期間中の前半の極く限られた短
い時間Ｔ３内に、多数のＴＦＴトランジスタのドレイン
が共通接続されたドレインバス（信号線）へ書き込みを
行う必要があり、大きな電流駆動能力を必要とする。そ
のため、ドレインドライバを構成するＭＯＳＦＥＴのサ
イズが大きく形成する必要があり、ドレインドライバを
構成する半導体集積回路装置のチップサイズの大型化が
免れない。また、ＴＦＴ液晶パネルにあっても、短い時
間内に画素へのデータ書き込みを行う必要があり、ＴＦ
Ｔのサイズを大きくする必要がある。ＴＦＴのサイズを
大きくすると、その分画素電極の大きさが犠牲になって
開口率を低下させてしまうという問題が生じる。この発
明の目的は、ドレインバイラバの電流駆動能力を大きく
したり、ＴＦＴのサイズを大きくすることなく拡大表示
モード機能を実現した液晶表示装置を提供することにあ
る。この発明の前記ならびにそのほかの目的と新規な特
徴は、本明細書の記述および添付図面から明らかになる
であろう。
ドレインドライバは１Ｈ期間中の前半の極く限られた短
い時間Ｔ３内に、多数のＴＦＴトランジスタのドレイン
が共通接続されたドレインバス（信号線）へ書き込みを
行う必要があり、大きな電流駆動能力を必要とする。そ
のため、ドレインドライバを構成するＭＯＳＦＥＴのサ
イズが大きく形成する必要があり、ドレインドライバを
構成する半導体集積回路装置のチップサイズの大型化が
免れない。また、ＴＦＴ液晶パネルにあっても、短い時
間内に画素へのデータ書き込みを行う必要があり、ＴＦ
Ｔのサイズを大きくする必要がある。ＴＦＴのサイズを
大きくすると、その分画素電極の大きさが犠牲になって
開口率を低下させてしまうという問題が生じる。この発
明の目的は、ドレインバイラバの電流駆動能力を大きく
したり、ＴＦＴのサイズを大きくすることなく拡大表示
モード機能を実現した液晶表示装置を提供することにあ
る。この発明の前記ならびにそのほかの目的と新規な特
徴は、本明細書の記述および添付図面から明らかになる
であろう。
【０００６】
【課題を解決するための手段】本願において開示される
発明のうち代表的なものの概要を簡単に説明すれば、下
記の通りである。すなわち、隣接する複数の走査線を同
時に選択する機能を持つ走査線駆動回路と、拡大画面に
対応した画像データのサンプリングを行う信号線駆動回
路とを用いてアクティブマトリックス方式の液晶表示パ
ネルを駆動して拡大表示動作を実現する。
発明のうち代表的なものの概要を簡単に説明すれば、下
記の通りである。すなわち、隣接する複数の走査線を同
時に選択する機能を持つ走査線駆動回路と、拡大画面に
対応した画像データのサンプリングを行う信号線駆動回
路とを用いてアクティブマトリックス方式の液晶表示パ
ネルを駆動して拡大表示動作を実現する。
【０００７】
【作用】上記した手段によれば、通常の表示モードの同
様に１Ｈ期間を使って画素への書き込みを行うことがで
き、拡大表示モードのために格別にドレインドライバの
チップサイズを大きくしたり、ＴＦＴトランジスタのサ
イズを大きくする必要がない。
様に１Ｈ期間を使って画素への書き込みを行うことがで
き、拡大表示モードのために格別にドレインドライバの
チップサイズを大きくしたり、ＴＦＴトランジスタのサ
イズを大きくする必要がない。
【０００８】
【実施例】図６には、この発明に係る液晶表示装置の一
実施例の概略要部ブロック図が示されている。同図にお
いて、液晶表示パネルＬＣＤは、特に制限されないが、
横方向に延長される複数の走査線Ｇ１ないしＧ４８０
と、縦方向に延長される複数の信号線Ｄ１ないしＤｎを
持つ。上記走査線と信号線の各交差点にはそれぞれ１つ
の画素ＰＸが配置される。画素ＰＸは、上記走査線にゲ
ートが接続され、信号線にドレインが接続されたＴＦＴ
トランジスタと、このＴＦＴトランジスタのソースに設
けられた画素電極とから構成される。なお、ＴＦＴトラ
ンジスタは、双方向の信号伝達を行うものであるので、
上記ドレインとソースとは便宜的なものであると理解さ
れたい。上記のようにマトリックス配置される複数の画
素ＰＸは、カラー表示の場合にはそれぞれに三原色のカ
ラーフィルタが配置される。
実施例の概略要部ブロック図が示されている。同図にお
いて、液晶表示パネルＬＣＤは、特に制限されないが、
横方向に延長される複数の走査線Ｇ１ないしＧ４８０
と、縦方向に延長される複数の信号線Ｄ１ないしＤｎを
持つ。上記走査線と信号線の各交差点にはそれぞれ１つ
の画素ＰＸが配置される。画素ＰＸは、上記走査線にゲ
ートが接続され、信号線にドレインが接続されたＴＦＴ
トランジスタと、このＴＦＴトランジスタのソースに設
けられた画素電極とから構成される。なお、ＴＦＴトラ
ンジスタは、双方向の信号伝達を行うものであるので、
上記ドレインとソースとは便宜的なものであると理解さ
れたい。上記のようにマトリックス配置される複数の画
素ＰＸは、カラー表示の場合にはそれぞれに三原色のカ
ラーフィルタが配置される。
【０００９】上記走査線電極Ｇ１ないしＧ４８０は、走
査線駆動回路ＧＤＶにより順次選択状態にされる。走査
線駆動回路ＧＤＶは、特に制限されないが、シフトレジ
スタを含んでおり、フレームの最初に供給されるスター
トパルスＳＰにより、選択信号を受け取り、それをクロ
ックパルスＣＬＫに同期して順次シフトさせる。通常の
表示モードでは、このシフトレジスタのシフト動作に対
応して走査線Ｇ１〜Ｇ４８０が順次選択される。
査線駆動回路ＧＤＶにより順次選択状態にされる。走査
線駆動回路ＧＤＶは、特に制限されないが、シフトレジ
スタを含んでおり、フレームの最初に供給されるスター
トパルスＳＰにより、選択信号を受け取り、それをクロ
ックパルスＣＬＫに同期して順次シフトさせる。通常の
表示モードでは、このシフトレジスタのシフト動作に対
応して走査線Ｇ１〜Ｇ４８０が順次選択される。
【００１０】上記信号線Ｄ１ないしＤｎには、信号線駆
動回路ＤＤにより、画像信号が供給される。この信号線
駆動回路ＤＤは、後述するようにシリアルに供給される
表示データＤinをパラレルに変換して保持するシリアル
／パラレル変換回路及び駆動回路を持つ。階調表示のと
きには、デコーダ回路が設けられ、１画素当たり複数ビ
ットからなる表示データが、階調電圧を選択する１つの
選択信号に変換されて出力される。上記のようなシリア
ル／パラレル変換動作によって、１水平ライン分の表示
に対応した駆動電圧が、上記各信号線電極Ｄ１ないしＤ
ｎに対してパラレルに出力される。なお、液晶の交流駆
動のために、特に制限されないが、上記信号線駆動回路
ＤＤは、上記画像信号の極性を反転させる機能を持つ。
これに代えて、上記信号駆動回路ＤＤに入力する信号を
反転させるものであってもよい。
動回路ＤＤにより、画像信号が供給される。この信号線
駆動回路ＤＤは、後述するようにシリアルに供給される
表示データＤinをパラレルに変換して保持するシリアル
／パラレル変換回路及び駆動回路を持つ。階調表示のと
きには、デコーダ回路が設けられ、１画素当たり複数ビ
ットからなる表示データが、階調電圧を選択する１つの
選択信号に変換されて出力される。上記のようなシリア
ル／パラレル変換動作によって、１水平ライン分の表示
に対応した駆動電圧が、上記各信号線電極Ｄ１ないしＤ
ｎに対してパラレルに出力される。なお、液晶の交流駆
動のために、特に制限されないが、上記信号線駆動回路
ＤＤは、上記画像信号の極性を反転させる機能を持つ。
これに代えて、上記信号駆動回路ＤＤに入力する信号を
反転させるものであってもよい。
【００１１】タイミング制御回路ＴＧは、同期信号ＳＹ
ＮＣを受けて、後述するような上記シリアル／パラレル
変換のための各種制御信号及びタイミング信号（これら
の総称して信号ＣＬとして示している）並びに上記走査
線駆動回路ＧＤＶの動作に必要なスタートパルスＳＰ、
クロックパルスＣＬＫを発生させる。また、同図では、
省略されているが、拡大表示モードのために、タイミン
グ制御回路ＴＧは、後述するような拡大エリアに対応し
た入力データのサンプリングに必要なタイミングパルス
や走査線の選択切り替え用の制御信号を形成する。
ＮＣを受けて、後述するような上記シリアル／パラレル
変換のための各種制御信号及びタイミング信号（これら
の総称して信号ＣＬとして示している）並びに上記走査
線駆動回路ＧＤＶの動作に必要なスタートパルスＳＰ、
クロックパルスＣＬＫを発生させる。また、同図では、
省略されているが、拡大表示モードのために、タイミン
グ制御回路ＴＧは、後述するような拡大エリアに対応し
た入力データのサンプリングに必要なタイミングパルス
や走査線の選択切り替え用の制御信号を形成する。
【００１２】図１には、上記走査線駆動回路ＧＤＶの一
実施例の要部回路図が示されている。同図には、Ｇ１〜
Ｇ６の６本分の走査線に対応した駆動回路が代表として
例示的に示されている。
実施例の要部回路図が示されている。同図には、Ｇ１〜
Ｇ６の６本分の走査線に対応した駆動回路が代表として
例示的に示されている。
【００１３】シフトレジスタの各段ＳＲ１〜ＳＲ６は、
フレームの最初に発生されるスタートパルスＳＰに走査
線の選択を指示する初期値が初段回路ＳＲ１に入力さ
れ、それが、クロックパルスＣＬＫに同期して、ＳＲ２
〜ＳＲ６・・・・のように順次シフトされる。シフトレ
ジスタの各段ＳＲ１〜ＳＲ６の出力信号は、初段回路Ｓ
Ｒ１を除いてマルチプレクサを構成するクロックドイン
バータ回路ＣＮ２、ＣＮ４、ＣＮ６、ＣＮ８及びＣＮ１
０を通してバッファ回路Ｂ１〜Ｂ６の入力に伝えられ
る。
フレームの最初に発生されるスタートパルスＳＰに走査
線の選択を指示する初期値が初段回路ＳＲ１に入力さ
れ、それが、クロックパルスＣＬＫに同期して、ＳＲ２
〜ＳＲ６・・・・のように順次シフトされる。シフトレ
ジスタの各段ＳＲ１〜ＳＲ６の出力信号は、初段回路Ｓ
Ｒ１を除いてマルチプレクサを構成するクロックドイン
バータ回路ＣＮ２、ＣＮ４、ＣＮ６、ＣＮ８及びＣＮ１
０を通してバッファ回路Ｂ１〜Ｂ６の入力に伝えられ
る。
【００１４】バッファ回路Ｂ１〜Ｂ６は、レベルシフト
機能と走査線Ｇ１〜Ｇ６を駆動する電力増幅機能を持
つ。すなわち、シフトレジスタやマルチプレクサを構成
するクロックドインバータ回路等は、５Ｖのような比較
的低い動作電圧により動作させられる。これに対して、
走査線の選択信号は、画素に書き込まれる最も高い電圧
に対して、少なくともＴＦＴトランジスタのしきい値電
圧以上に高くする関係上約２０Ｖ以上の高電圧にされ
る。そのため、バッファ回路Ｂ１〜Ｂ６等は、上記クロ
ックドインバータ回路等のマルチプレクサを通して伝え
られた５Ｖ系の選択信号をレベルシフトし、多数のＴＦ
Ｔトランジスタが接続されることにより大きな容量性負
荷を持つ走査線を高速に選択／非選択に切り替えるよう
にするための電力増幅を行うものである。
機能と走査線Ｇ１〜Ｇ６を駆動する電力増幅機能を持
つ。すなわち、シフトレジスタやマルチプレクサを構成
するクロックドインバータ回路等は、５Ｖのような比較
的低い動作電圧により動作させられる。これに対して、
走査線の選択信号は、画素に書き込まれる最も高い電圧
に対して、少なくともＴＦＴトランジスタのしきい値電
圧以上に高くする関係上約２０Ｖ以上の高電圧にされ
る。そのため、バッファ回路Ｂ１〜Ｂ６等は、上記クロ
ックドインバータ回路等のマルチプレクサを通して伝え
られた５Ｖ系の選択信号をレベルシフトし、多数のＴＦ
Ｔトランジスタが接続されることにより大きな容量性負
荷を持つ走査線を高速に選択／非選択に切り替えるよう
にするための電力増幅を行うものである。
【００１５】これらのクロックドインバータ回路ＣＮ
２，ＣＮ４，ＣＮ６，ＣＮ８及びＣＮ１０は、通常動作
モードのとき活性化されて信号の伝達を行う。これに対
して、その出力が共通化されたクロックドインバータ回
路ＣＮ１，ＣＮ３，ＣＮ５，ＣＮ９は、拡大表示モード
のときに活性化される。これらの各クロックドインバー
タ回路ＣＮ１〜ＣＮ１０は制御信ＳＬにより制御され
て、例えば制御信号ＳＬがロウレベルときには、黒丸で
示したように偶数番号を付した各クロックドインバータ
回路ＣＮ２〜ＣＮ１０が活性化され、白丸で示したよう
に奇数番号を付したクロックドインバータ回路ＣＮ１〜
ＣＮ９が非活性化、言い換えるならば、出力ハイインピ
ーダンス状態にされる。逆に、制御信号ＳＬがハイレベ
ルときには、白丸で示したように奇数番号を付した各ク
ロックドインバータ回路ＣＮ１〜ＣＮ９が活性化され、
黒丸で示したように偶数番号を付したクロックドインバ
ータ回路ＣＮ２〜ＣＮ１０が非活性化、言い換えるなら
ば、出力ハイインピーダンス状態にされる。
２，ＣＮ４，ＣＮ６，ＣＮ８及びＣＮ１０は、通常動作
モードのとき活性化されて信号の伝達を行う。これに対
して、その出力が共通化されたクロックドインバータ回
路ＣＮ１，ＣＮ３，ＣＮ５，ＣＮ９は、拡大表示モード
のときに活性化される。これらの各クロックドインバー
タ回路ＣＮ１〜ＣＮ１０は制御信ＳＬにより制御され
て、例えば制御信号ＳＬがロウレベルときには、黒丸で
示したように偶数番号を付した各クロックドインバータ
回路ＣＮ２〜ＣＮ１０が活性化され、白丸で示したよう
に奇数番号を付したクロックドインバータ回路ＣＮ１〜
ＣＮ９が非活性化、言い換えるならば、出力ハイインピ
ーダンス状態にされる。逆に、制御信号ＳＬがハイレベ
ルときには、白丸で示したように奇数番号を付した各ク
ロックドインバータ回路ＣＮ１〜ＣＮ９が活性化され、
黒丸で示したように偶数番号を付したクロックドインバ
ータ回路ＣＮ２〜ＣＮ１０が非活性化、言い換えるなら
ば、出力ハイインピーダンス状態にされる。
【００１６】上記白丸で示されたクロックドインバータ
回路ＣＮ１は、初段回路ＳＲ１の出力信号を受けて、出
力信号を第２走査線Ｇ２に対応したバッファ回路Ｂ２の
入力に伝える。白丸で示されたクロックドインバータ回
路ＣＮ３とＣＮ５は、２段目回路ＳＲ２の出力信号を共
通に受け、出力信号を第３走査線Ｇ３と第４走査線Ｇ４
に対応したバッファ回路Ｂ３，Ｂ４の入力にそれぞれ伝
える。また、白丸で示されたクロックドインバータ回路
ＣＮ７とＣＮ９は、第３段目回路ＳＲ３の出力信号を共
通に受け、出力信号を第５走査線Ｇ５と第６走査線Ｇ６
に対応したバッファ回路Ｂ５，Ｂ６の入力にそれぞれ伝
える。
回路ＣＮ１は、初段回路ＳＲ１の出力信号を受けて、出
力信号を第２走査線Ｇ２に対応したバッファ回路Ｂ２の
入力に伝える。白丸で示されたクロックドインバータ回
路ＣＮ３とＣＮ５は、２段目回路ＳＲ２の出力信号を共
通に受け、出力信号を第３走査線Ｇ３と第４走査線Ｇ４
に対応したバッファ回路Ｂ３，Ｂ４の入力にそれぞれ伝
える。また、白丸で示されたクロックドインバータ回路
ＣＮ７とＣＮ９は、第３段目回路ＳＲ３の出力信号を共
通に受け、出力信号を第５走査線Ｇ５と第６走査線Ｇ６
に対応したバッファ回路Ｂ５，Ｂ６の入力にそれぞれ伝
える。
【００１７】このように、拡大表示モードのときには、
シフトレジスタの各段の出力信号は、初段回路ＳＲ１に
より第１と第２の走査線Ｇ１，Ｇ２を同時選択するよう
に、第２段回路ＳＲ２により第３と第４の走査線Ｇ３，
Ｇ４を同時選択するように、第３段回路ＳＲ３により第
５と第６の走査線Ｇ５，Ｇ６を同時選択するように、そ
れぞれ飛び越して２本ずつの走査線に伝えられる。この
結果、この実施例のように４８０本の走査線が有る場
合、シフトレジスタの初段から第２４０段目までのシフ
ト動作によって、２本ずつの走査線Ｇ１とＧ２，Ｇ３と
Ｇ４・・・・のように順次選択される。これにより、縦
方向に２倍の拡大表示を行わせることができる。
シフトレジスタの各段の出力信号は、初段回路ＳＲ１に
より第１と第２の走査線Ｇ１，Ｇ２を同時選択するよう
に、第２段回路ＳＲ２により第３と第４の走査線Ｇ３，
Ｇ４を同時選択するように、第３段回路ＳＲ３により第
５と第６の走査線Ｇ５，Ｇ６を同時選択するように、そ
れぞれ飛び越して２本ずつの走査線に伝えられる。この
結果、この実施例のように４８０本の走査線が有る場
合、シフトレジスタの初段から第２４０段目までのシフ
ト動作によって、２本ずつの走査線Ｇ１とＧ２，Ｇ３と
Ｇ４・・・・のように順次選択される。これにより、縦
方向に２倍の拡大表示を行わせることができる。
【００１８】図２には、拡大表示モードにおける走査線
の選択動作の一例を説明するためのタイミング図が示さ
れている。クロックパルスＣＬＫに同期して、初段回路
ＳＲ１にスタートパルス（選択信号）の取り込みが行わ
れ、それがクロックパルスＣＬＫに同期して順次ＳＲ
２，ＳＲ３・・・・のようにシフトされる。そして、図
示しない制御信号ＳＬのハイレベルにより、それが２本
ずつの走査線Ｇ１とＧ２、Ｇ３とＧ４，Ｇ５とＧ６に順
次伝えられて、２本ずつの走査線の同時選択動作が行わ
れる。
の選択動作の一例を説明するためのタイミング図が示さ
れている。クロックパルスＣＬＫに同期して、初段回路
ＳＲ１にスタートパルス（選択信号）の取り込みが行わ
れ、それがクロックパルスＣＬＫに同期して順次ＳＲ
２，ＳＲ３・・・・のようにシフトされる。そして、図
示しない制御信号ＳＬのハイレベルにより、それが２本
ずつの走査線Ｇ１とＧ２、Ｇ３とＧ４，Ｇ５とＧ６に順
次伝えられて、２本ずつの走査線の同時選択動作が行わ
れる。
【００１９】図３には、上記走査線駆動回路ＧＤＶの他
の一実施例の要部回路図が示されている。同図において
も、Ｇ１〜Ｇ６の６本分の走査線に対応した駆動回路が
代表として例示的に示されている。なお、同図に示され
たクロックドインバータ回路に付された回路記号は、図
１のものとはそれぞれ別個の回路機能を持つものである
と理解されたい。初段回路ＳＲ１と第２段目回路に対応
したクロックドインバータ回路及びゲート回路のみ回路
記号が付されている。
の一実施例の要部回路図が示されている。同図において
も、Ｇ１〜Ｇ６の６本分の走査線に対応した駆動回路が
代表として例示的に示されている。なお、同図に示され
たクロックドインバータ回路に付された回路記号は、図
１のものとはそれぞれ別個の回路機能を持つものである
と理解されたい。初段回路ＳＲ１と第２段目回路に対応
したクロックドインバータ回路及びゲート回路のみ回路
記号が付されている。
【００２０】初段回路ＳＲ１と次段回路ＳＲ２の出力信
号は、それぞれクロックドインバータ回路ＣＮ１とＣＮ
４を介してバッファ回路Ｂ１，Ｂ２の入力に伝えられ
る。上記クロックドインバータ回路ＣＮ１とＣＮ４は、
黒丸で示されているように制御信号ＳＬのロウレベルに
より活性化され、それぞれの出力信号をバッファ回路Ｂ
１，Ｂ２に伝える。すなわち、これらのクロックドイン
バータ回路ＣＮ１とＣＮ４は、通常の表示モードのとき
に活性化され、後述するような拡大表示モードのときに
は非活性化状態に置かれる。
号は、それぞれクロックドインバータ回路ＣＮ１とＣＮ
４を介してバッファ回路Ｂ１，Ｂ２の入力に伝えられ
る。上記クロックドインバータ回路ＣＮ１とＣＮ４は、
黒丸で示されているように制御信号ＳＬのロウレベルに
より活性化され、それぞれの出力信号をバッファ回路Ｂ
１，Ｂ２に伝える。すなわち、これらのクロックドイン
バータ回路ＣＮ１とＣＮ４は、通常の表示モードのとき
に活性化され、後述するような拡大表示モードのときに
は非活性化状態に置かれる。
【００２１】拡大表示モードのために、上記初段回路Ｓ
Ｒ１と次段回路ＳＲ２の出力信号はオア（ＯＲ）ゲート
回路ＯＲ１に入力される。このゲート回路ＯＲ１の出力
信号は、白丸で示されたクロックドインバータ回路ＣＮ
２，ＣＮ３の入力に供給される。これらのクロックドイ
ンバータ回路ＣＮ２，ＣＮ３の出力信号は、上記バッフ
ァ回路Ｂ１，Ｂ２の入力にそれぞれ伝えられる。走査線
Ｇ３とＧ４及びＧ５とＧ６に対応したシフトレジスタの
各段ＳＲ３とＳＲ４及びＳＲ５とＳＲ６に対しても、上
記と同じ構成のクロックドインバータ回路及びオアゲー
ト回路が設けられる。
Ｒ１と次段回路ＳＲ２の出力信号はオア（ＯＲ）ゲート
回路ＯＲ１に入力される。このゲート回路ＯＲ１の出力
信号は、白丸で示されたクロックドインバータ回路ＣＮ
２，ＣＮ３の入力に供給される。これらのクロックドイ
ンバータ回路ＣＮ２，ＣＮ３の出力信号は、上記バッフ
ァ回路Ｂ１，Ｂ２の入力にそれぞれ伝えられる。走査線
Ｇ３とＧ４及びＧ５とＧ６に対応したシフトレジスタの
各段ＳＲ３とＳＲ４及びＳＲ５とＳＲ６に対しても、上
記と同じ構成のクロックドインバータ回路及びオアゲー
ト回路が設けられる。
【００２２】図４には、通常表示モードにおける走査線
の選択動作の一例を説明するためのタイミング図が示さ
れている。クロックパルスＣＬＫに同期して、初段回路
ＳＲ１にスタートパルス（選択信号）の取り込みが行わ
れ、それがクロックパルスＣＬＫに同期して順次ＳＲ
２，ＳＲ３・・・・のようにシフトされる。そして、図
示しない制御信号ＳＬのロウレベルにより、黒丸で示さ
れたクロックドインバータ回路ＣＮ１，ＣＮ４等が活性
化されているので、それぞれに対応して１本ずつの走査
線Ｇ１，Ｇ２，Ｇ３の順に走査線が選択される。この動
作は、上記図１の実施例回路においても同様である。
の選択動作の一例を説明するためのタイミング図が示さ
れている。クロックパルスＣＬＫに同期して、初段回路
ＳＲ１にスタートパルス（選択信号）の取り込みが行わ
れ、それがクロックパルスＣＬＫに同期して順次ＳＲ
２，ＳＲ３・・・・のようにシフトされる。そして、図
示しない制御信号ＳＬのロウレベルにより、黒丸で示さ
れたクロックドインバータ回路ＣＮ１，ＣＮ４等が活性
化されているので、それぞれに対応して１本ずつの走査
線Ｇ１，Ｇ２，Ｇ３の順に走査線が選択される。この動
作は、上記図１の実施例回路においても同様である。
【００２３】図５には、拡大表示モードにおける走査線
の選択動作の一例を説明するためのタイミング図が示さ
れている。クロックパルスＣＬＫに同期して、初段回路
ＳＲ１にスタートパルス（選択信号）の取り込みが行わ
れ、それがクロックパルスＣＬＫに同期して順次ＳＲ
２，ＳＲ３・・・・のようにシフトされる。このこと
は、通常表示モードと同じあるが、クロックパルスＣＬ
Ｋの周波数が２倍に高くされている。そして、図示しな
い制御信号ＳＬのハイレベルにより、白丸で示されたク
ロックドインバータ回路ＣＮ２，ＣＮ３等が活性化され
ている。このため、１Ｈ期間の前半には初段回路ＳＲ１
の選択信号によりＧ１とＧ２が同時選択状態にされ、１
Ｈの後半には次段回路ＳＲ２の選択信号により同じくＧ
１とＧ２が１Ｈ期間にわたって同時選択状態にされる。
以下、同様にしてＳＲ３とＳＲ４の選択信号によりＧ３
とＧ４が１Ｈ期間にわたって同時選択状態にされる。こ
れにより、縦方向に２倍の拡大表示を行わせることがで
きる。
の選択動作の一例を説明するためのタイミング図が示さ
れている。クロックパルスＣＬＫに同期して、初段回路
ＳＲ１にスタートパルス（選択信号）の取り込みが行わ
れ、それがクロックパルスＣＬＫに同期して順次ＳＲ
２，ＳＲ３・・・・のようにシフトされる。このこと
は、通常表示モードと同じあるが、クロックパルスＣＬ
Ｋの周波数が２倍に高くされている。そして、図示しな
い制御信号ＳＬのハイレベルにより、白丸で示されたク
ロックドインバータ回路ＣＮ２，ＣＮ３等が活性化され
ている。このため、１Ｈ期間の前半には初段回路ＳＲ１
の選択信号によりＧ１とＧ２が同時選択状態にされ、１
Ｈの後半には次段回路ＳＲ２の選択信号により同じくＧ
１とＧ２が１Ｈ期間にわたって同時選択状態にされる。
以下、同様にしてＳＲ３とＳＲ４の選択信号によりＧ３
とＧ４が１Ｈ期間にわたって同時選択状態にされる。こ
れにより、縦方向に２倍の拡大表示を行わせることがで
きる。
【００２４】図７には、拡大表示モードにおける液晶表
示パネルの書き込み動作を説明するためのタイミング図
が示されている。信号線駆動回路ＤＤは、１Ｈ期間中の
画像データＤinのうち、２倍に拡大するときには指定さ
れた表示エリアに対応した半分のデータをサンプリング
して取り込む。そして、第１列と第２列目のように隣接
する２つの信号線のデータが同じくなるように横方向に
２倍に拡大してパラレル出力する。
示パネルの書き込み動作を説明するためのタイミング図
が示されている。信号線駆動回路ＤＤは、１Ｈ期間中の
画像データＤinのうち、２倍に拡大するときには指定さ
れた表示エリアに対応した半分のデータをサンプリング
して取り込む。そして、第１列と第２列目のように隣接
する２つの信号線のデータが同じくなるように横方向に
２倍に拡大してパラレル出力する。
【００２５】このようなドレインバスへの書き込みに対
して、走査線駆動回路ＧＤＶでは、図１や図３の実施例
のように、１Ｈ期間に２本ずつの走査線Ｇ１とＧ２、Ｇ
３とＧ４のように順次選択する。このため、１Ｈ期間に
おいて２ラインの同時書き込みが行われるから、ドレイ
ンバスへの書き込み時間Ｔ６及び各画素への書き込み時
間Ｔ７は、１Ｈ期間を使って行うことができる。このこ
とは、走査線が２本同時選択されていることを除いて通
常表示モードと同じである。したがって、拡大表示機能
を付加するために、ドレインドライバの出力ＭＯＳＦＥ
Ｔのサイズを大きく形成したり、あるいは液晶表示パネ
ルに形成されるＴＦＴトランジスタのサイズを大きくす
る必要がない。液晶表示パネルにあっては、拡大表示モ
ードのためにＴＦＴトランジスタのサイズを大きくする
必要がないから、開口率を犠牲にすることもない。
して、走査線駆動回路ＧＤＶでは、図１や図３の実施例
のように、１Ｈ期間に２本ずつの走査線Ｇ１とＧ２、Ｇ
３とＧ４のように順次選択する。このため、１Ｈ期間に
おいて２ラインの同時書き込みが行われるから、ドレイ
ンバスへの書き込み時間Ｔ６及び各画素への書き込み時
間Ｔ７は、１Ｈ期間を使って行うことができる。このこ
とは、走査線が２本同時選択されていることを除いて通
常表示モードと同じである。したがって、拡大表示機能
を付加するために、ドレインドライバの出力ＭＯＳＦＥ
Ｔのサイズを大きく形成したり、あるいは液晶表示パネ
ルに形成されるＴＦＴトランジスタのサイズを大きくす
る必要がない。液晶表示パネルにあっては、拡大表示モ
ードのためにＴＦＴトランジスタのサイズを大きくする
必要がないから、開口率を犠牲にすることもない。
【００２６】上記の実施例から得られる作用効果は、下
記の通りである。すなわち、 （１） 隣接する複数の走査線を同時に選択する機能を
持つ走査線駆動回路と、拡大画面に対応した画像データ
のサンプリングを行う信号線駆動回路とを用いてアクテ
ィブマトリックス方式の液晶表示パネルを駆動すること
により、通常の表示モードの同様に１Ｈ期間を使って拡
大表示用の画素への書き込みを行うことができるから、
ドレインドライバのチップサイズを大きくしたり、ＴＦ
Ｔトランジスタのサイズを大きくすることなく、拡大表
示モードを実現できるという効果が得られる。 （２） シフトレジスタの出力信号を飛び越して２本ず
つの走査線に対応して出力させるというマルチプレクサ
を設けることにより、シフトレジスタのシフトクロック
を変えることなく、拡大表示に必要な走査線の同時選択
が実現できるという効果が得られる。
記の通りである。すなわち、 （１） 隣接する複数の走査線を同時に選択する機能を
持つ走査線駆動回路と、拡大画面に対応した画像データ
のサンプリングを行う信号線駆動回路とを用いてアクテ
ィブマトリックス方式の液晶表示パネルを駆動すること
により、通常の表示モードの同様に１Ｈ期間を使って拡
大表示用の画素への書き込みを行うことができるから、
ドレインドライバのチップサイズを大きくしたり、ＴＦ
Ｔトランジスタのサイズを大きくすることなく、拡大表
示モードを実現できるという効果が得られる。 （２） シフトレジスタの出力信号を飛び越して２本ず
つの走査線に対応して出力させるというマルチプレクサ
を設けることにより、シフトレジスタのシフトクロック
を変えることなく、拡大表示に必要な走査線の同時選択
が実現できるという効果が得られる。
【００２７】以上本発明者よりなされた発明を実施例に
基づき具体的に説明したが、本願発明は前記実施例に限
定されるものではなく、その要旨を逸脱しない範囲で種
々変更可能であることはいうまでもない。例えば、マル
チプレクサは、３状態出力機能を持つクロックドインバ
ータ回路を用いるもの他、伝送ゲートＭＯＳＦＥＴを用
いるものや、論理ゲートにより実現するもの等種々の実
施形態を採ることができる。また、走査線選択信号は、
シフトレジスタにより形成するもの他、カウンタとデコ
ーダ回路から構成するものであってもよい。縦横３倍ず
つ拡大する場合には、隣接する３本ずつの走査線を同時
選択状態にすればよい。また、縦方向と横方向の拡大倍
率が異なるものであってもよい。液晶表示パネルにテレ
ビジョン用の映像信号を表示させる場合、信号線駆動回
路ＤＤに設けられるシリアル／パラレル変換回路は、各
信号線に対応してアナログサンプリング回路を設けるよ
うにすればよい。階調表示は、複数の画素を１組とし
て、その点灯／非点灯の数により行というディザ方式
や、ＦＲＣ（フレーム・レイト・コントロール）方式の
もの等種々の実施形態を採ることができる。液晶表示パ
ネルは、前記のようなアクティブマトリックス方式のも
の他、信号線電極と走査線電極とのオーバーラップした
交点に画素を構成する単純マトリックス方式のものであ
ってもよいことはいうまでもない。この発明は、拡大表
示モードを持つ液晶表示装置に広く利用できる。
基づき具体的に説明したが、本願発明は前記実施例に限
定されるものではなく、その要旨を逸脱しない範囲で種
々変更可能であることはいうまでもない。例えば、マル
チプレクサは、３状態出力機能を持つクロックドインバ
ータ回路を用いるもの他、伝送ゲートＭＯＳＦＥＴを用
いるものや、論理ゲートにより実現するもの等種々の実
施形態を採ることができる。また、走査線選択信号は、
シフトレジスタにより形成するもの他、カウンタとデコ
ーダ回路から構成するものであってもよい。縦横３倍ず
つ拡大する場合には、隣接する３本ずつの走査線を同時
選択状態にすればよい。また、縦方向と横方向の拡大倍
率が異なるものであってもよい。液晶表示パネルにテレ
ビジョン用の映像信号を表示させる場合、信号線駆動回
路ＤＤに設けられるシリアル／パラレル変換回路は、各
信号線に対応してアナログサンプリング回路を設けるよ
うにすればよい。階調表示は、複数の画素を１組とし
て、その点灯／非点灯の数により行というディザ方式
や、ＦＲＣ（フレーム・レイト・コントロール）方式の
もの等種々の実施形態を採ることができる。液晶表示パ
ネルは、前記のようなアクティブマトリックス方式のも
の他、信号線電極と走査線電極とのオーバーラップした
交点に画素を構成する単純マトリックス方式のものであ
ってもよいことはいうまでもない。この発明は、拡大表
示モードを持つ液晶表示装置に広く利用できる。
【００２８】
【発明の効果】本願において開示される発明のうち代表
的なものによって得られる効果を簡単に説明すれば、下
記の通りである。すなわち、隣接する複数の走査線を同
時に選択する機能を持つ走査線駆動回路と、拡大画面に
対応した画像データのサンプリングを行う信号線駆動回
路とを用いてアクティブマトリックス方式の液晶表示パ
ネルを駆動することにより、通常の表示モードの同様に
１Ｈ期間を使って拡大表示用の画素への書き込みを行う
ことができるから、ドレインドライバのチップサイズを
大きくしたり、ＴＦＴトランジスタのサイズを大きくす
ることなく、拡大表示モードを実現できる。
的なものによって得られる効果を簡単に説明すれば、下
記の通りである。すなわち、隣接する複数の走査線を同
時に選択する機能を持つ走査線駆動回路と、拡大画面に
対応した画像データのサンプリングを行う信号線駆動回
路とを用いてアクティブマトリックス方式の液晶表示パ
ネルを駆動することにより、通常の表示モードの同様に
１Ｈ期間を使って拡大表示用の画素への書き込みを行う
ことができるから、ドレインドライバのチップサイズを
大きくしたり、ＴＦＴトランジスタのサイズを大きくす
ることなく、拡大表示モードを実現できる。
【図１】この発明に係る走査線駆動回路の一実施例を示
す要部回路図である。
す要部回路図である。
【図２】図１の回路における拡大表示モードの動作を説
明するためのタイミング図である。
明するためのタイミング図である。
【図３】この発明に係る走査線駆動回路の他の一実施例
を示す要部回路図である。
を示す要部回路図である。
【図４】図３の回路における通常表示モードの動作を説
明するためのタイミング図である。
明するためのタイミング図である。
【図５】図３の回路における拡大表示モードの動作を説
明するためのタイミング図である。
明するためのタイミング図である。
【図６】この発明に係る液晶表示装置の一実施例を示す
要部回路図である。
要部回路図である。
【図７】拡大表示モードにおける液晶表示パネルの書き
込み動作を説明するためのタイミング図である。
込み動作を説明するためのタイミング図である。
【図８】この発明に先立って考えらた拡大表示モードに
おける液晶表示パネルの書き込み動作を説明するための
タイミング図である。
おける液晶表示パネルの書き込み動作を説明するための
タイミング図である。
ＣＮ１〜ＣＮ１０…クロックドインバータ回路、ＳＲ１
〜ＳＲ６…シフトレジスタの各段回路、Ｂ１〜Ｂ６…バ
ッファ回路、ＯＲ１…オアゲート回路、ＬＣＤ…液晶表
示パネル、ＰＸ…画素、ＧＤＶ…走査線駆動回路、ＤＤ
（Ｓ／Ｐ）…信号線駆動回路、ＴＧ…タイミング制御回
路、Ｇ１〜Ｇ４８０…走査線、Ｄ１〜Ｄｎ…信号線。
〜ＳＲ６…シフトレジスタの各段回路、Ｂ１〜Ｂ６…バ
ッファ回路、ＯＲ１…オアゲート回路、ＬＣＤ…液晶表
示パネル、ＰＸ…画素、ＧＤＶ…走査線駆動回路、ＤＤ
（Ｓ／Ｐ）…信号線駆動回路、ＴＧ…タイミング制御回
路、Ｇ１〜Ｇ４８０…走査線、Ｄ１〜Ｄｎ…信号線。
Claims (3)
- 【請求項１】 アクティブマトリックス方式又は単純マ
トリックス方式の液晶表示パネルと、拡大表示モードの
とき隣接する複数の走査線を同時に選択する機能を持つ
走査線駆動回路と、拡大画面に対応した画像データのサ
ンプリングを行う機能を持つ信号線駆動回路とを備えて
なることを特徴とする液晶表示装置。 - 【請求項２】 上記拡大表示モードのとき隣接する複数
の走査線を同時に選択する機能は、走査線の数に対応し
た選択信号を順次形成するシフトレジスタの出力部にマ
ルチプレクサを設け、シフトレジスタにより形成された
選択信号を上記複数の走査線に対応して飛び越して順次
伝えることにより行われるものであることを特徴とする
請求項１の液晶表示装置。 - 【請求項３】 上記拡大表示モードのとき隣接する複数
の走査線を同時に選択する機能は、走査線の数に対応し
た選択信号を順次形成するシフトレジスタの出力部に論
理和ゲート回路を設けて複数の走査線を同時選択すると
ともに、シフトレジスタのクロック周波数を同時選択さ
れる走査線の数に対応した複数倍に高く設定することを
特徴とする請求項１の液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3287001A JPH05100640A (ja) | 1991-10-07 | 1991-10-07 | 液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3287001A JPH05100640A (ja) | 1991-10-07 | 1991-10-07 | 液晶表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05100640A true JPH05100640A (ja) | 1993-04-23 |
Family
ID=17711743
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3287001A Pending JPH05100640A (ja) | 1991-10-07 | 1991-10-07 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05100640A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6020873A (en) * | 1996-07-19 | 2000-02-01 | Nec Corporation | Liquid crystal display apparatus with arbitrary magnification of displayed image |
| JP2003044013A (ja) * | 2001-07-31 | 2003-02-14 | Toshiba Corp | 駆動回路、電極基板及び液晶表示装置 |
| JP2003228349A (ja) * | 2001-11-30 | 2003-08-15 | Sharp Corp | 信号線駆動回路、および、それを用いた表示装置 |
| JP2003330430A (ja) * | 2002-05-17 | 2003-11-19 | Sharp Corp | 信号線駆動回路、および、それを用いた画像表示装置 |
-
1991
- 1991-10-07 JP JP3287001A patent/JPH05100640A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6020873A (en) * | 1996-07-19 | 2000-02-01 | Nec Corporation | Liquid crystal display apparatus with arbitrary magnification of displayed image |
| JP2003044013A (ja) * | 2001-07-31 | 2003-02-14 | Toshiba Corp | 駆動回路、電極基板及び液晶表示装置 |
| JP2003228349A (ja) * | 2001-11-30 | 2003-08-15 | Sharp Corp | 信号線駆動回路、および、それを用いた表示装置 |
| JP2003330430A (ja) * | 2002-05-17 | 2003-11-19 | Sharp Corp | 信号線駆動回路、および、それを用いた画像表示装置 |
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