JPH0473256U - - Google Patents

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JPH0473256U
JPH0473256U JP11393190U JP11393190U JPH0473256U JP H0473256 U JPH0473256 U JP H0473256U JP 11393190 U JP11393190 U JP 11393190U JP 11393190 U JP11393190 U JP 11393190U JP H0473256 U JPH0473256 U JP H0473256U
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JP
Japan
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processor
control device
host processor
shared memory
acknowledgment
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Application number
JP11393190U
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【図面の簡単な説明】
第１図はこの考案の一実施例によるホストプロ
セツサ、コ・プロセツサ、共有メモリの構成を示
すための構成図、第２図はこの一実施例によるホ
ストプロセツサ、コ・プロセツサ、共有メモリ間
のバス動作を示す図、第３図は従来のホストプロ
セツサ、コ・プロセツサ、共有メモリの構成を示
すための構成図、第４図は従来のホストプロセツ
サ、コ・プロセツサ、共有メモリ間のバス動作を
示す図である。 図において、１はホストプロセツサ、２はコ・
プロセツサ、３は共有メモリ、４はバス制御装置
、５はアクノリツジ生成装置、６は動作フラグ制
御装置、７は動作フラグセンス装置である。なお
、図中同一符号は同一又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. ホストプロセツサとプロセツサが共有メモリを
    介して密結合している目標情報処理プロセツサシ
    ステムにおいて、ホストプロセツサから演算起動
    命令をかけられたコ・プロセツサの動作を監視し
    て、コ・プロセツサ上の処理が全て終了してから
    ホストプロセツサへのアクノリツジを生成し且つ
    バス制御装置を制御するアクノリツジ生成装置と
    、アクノリツジ生成装置で生成されるアクノリツ
    ジ信号を用いてホストプロセツサ、共有メモリ、
    コ・プロセツサとの間のバスの方向等を制御する
    バス制御装置とを具備したことを特徴とするプロ
    セツサ制御装置。
JP11393190U 1990-10-30 1990-10-30 Pending JPH0473256U (ja)

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JP11393190U JPH0473256U (ja) 1990-10-30 1990-10-30

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JPH0473256U true JPH0473256U (ja) 1992-06-26

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