JPH0468867A - 変倍回路 - Google Patents

変倍回路

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JPH0468867A
JPH0468867A JP17924490A JP17924490A JPH0468867A JP H0468867 A JPH0468867 A JP H0468867A JP 17924490 A JP17924490 A JP 17924490A JP 17924490 A JP17924490 A JP 17924490A JP H0468867 A JPH0468867 A JP H0468867A
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JP
Japan
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data
line
picture
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control means
Prior art date
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Pending
Application number
JP17924490A
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English (en)
Inventor
Masayoshi Shiraishi
政良 白石
Toru Ariga
徹 有賀
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Seiko Instruments Inc
Original Assignee
Seiko Instruments Inc
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Filing date
Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、イメージスキャナ、プリンタ、複写機等の画
像機器に用いられる変倍回路に関し、特にカラー画像を
対象とした変倍回路に関する。
〔従来の技術〕
従来、2次元で構成されるカラー画像データを扱う画像
機器においては、扱われるデータ形式としてイメージス
キャナでは線順次データが、プリンタや複写機は面順次
データが多用化されている。
例えば、R(赤)、G(緑)、B(青)の3原色に色分
解された入力データを例とすると、点順次データでは第
5図に、線順次データでは第6図に、面順次データでは
第7図に示すようなデータ配列となり、主走査方向に関
しては点順次データでは2画素おきに、線順次データ及
び面順次データでは全画素が同色データとなり、また、
副走査方向に関しては点順次データ及び面順次データで
は全ラインが、線順次データでは2ラインおきに同色デ
ータとなる。
このため、カラー画像を扱おうとするとデータ形式によ
り、データの配列が異なっており、それぞれのデータ形
式に応じて特定の変倍回路が構成されている。
〔発明が解決しようとする課題〕
上記のような従来の技術では、画像処理装置の汎用性が
乏しく、データ形式の異なる他の装置との接続が困難で
あった。例えば、データ形式として線順次データが多用
されるイメージスキャナで用いられる変倍回路は、面順
次データが多用されているプリンタや複写機では用いる
ことが出来ず、面順次データの扱える変倍回路を用意し
なければならなかった。
そこで、本発明は複数のデータ形式に対応できる変倍回
路を提供することを目的とする。
〔課題を解決するための手段〕
上記の問題点を解決するために、本発明では2次元で構
成されるカラー画像データのN×M(N、M〉1)の領
域に注目して変倍処理を行う変倍回路において、画素に
対応し演算に用いられる画像データを記憶するデータ記
憶手段と、データ形式に応じ前記データ記憶手段を制御
する制御手段と、前記データ記憶手段に接続し領域内の
画像データを出力するための順序回路と、入力画素デー
タに前記領域内の画像データを用いて変倍処理を施し出
力する変倍回路から成ることを特徴とする。また、前記
順序回路は直列に接続された3個以上のフリップフロッ
プ(以下、FFで表記する。)と前記フリップフロップ
のそれぞれの出力のうちいずれかの出力を選択する少な
くとも1個以上のデータ選択手段から構成した。
〔作用〕
上記のような構成によれば、制御手段の基にデータ形式
に応してデータ記憶手段より読み出すデータを選択し、
順序回路により画像データを並び替えることにより、デ
ータ形式に関わらず画素密度変換が可能となる6 〔実施例〕 以下に、本発明の実施例を図面に基づいて説明する。
第1図は、本発明の変倍回路の実施例の構成ブロック図
である。
制御手段1は各データ形式間でのデータ配列の違いによ
る演算への影響、例えば、同色データ間の演夏時に他色
のデータを用いてしまう等の悪影響をなくすためのもの
で、レジスタ、セレクタカウンタ等で構成され、入力画
像データの形式が点順次データ、線順次データ、面順次
データのいずれかを示すデータ形式信号6と、データの
有効範囲を示すライン信号5と、人力データと同期する
クロック8を入力することにより、各色のデータ配列に
応じ、アドレス9の発生方法を変えてデータ記憶手段に
相当するラインメモリ2へ出力する。
制御手段1を第2図にもとすき説明すると、3ライン分
のライン信号を計数するラインカウンタ20と、八人力
とB入力を有しセレクト端子に人力される信号にもとす
きいずれかの信号を出力するセレクタ21と、クロック
8に同期してアドレスを計数するアドレスカウンタ22
から構成され、ラインカウンタ20のクロック入力、セ
レクタ21のA入力、アドレスカウンタ22のイネーブ
ル端子Eにはそれぞれライン信号5が入力されており、
セレクタ21のB入力には前記ラインカウンタのQ出力
が、またセレクタ端子Sにはデータ形式信号6が入力さ
れている。前記アドレスカウンタのリセット信号Rには
セレクタ2■のY出力が接続され、またクロック端子に
はクロ、り8が入力されている。前記アドレスカウンタ
のリセット信号Rにライン信号5と3ライン分のライン
信号を1ラインとする3ライン信号24のどちらを用い
るかデータ形式信号6で選択し、ラインメモリ2のアド
レス9を発生させる。
点順次データ及び面順次データではアドレス9はライン
信号5をアドレスカウンタ22のリセット信号23とし
第3図のようにライン信号5がアサートの期間、クロッ
クに同期してインクリメントされ、ライン信号5がネゲ
ートになる毎にリセットされる。vA点順次データは3
ライン信号24をアドレスカウンタ22のリセット信号
23とし第4図のようにライン信号5がアサートの期間
、クロック8に同期してインクリメントされ、3ライン
信号24がネゲートになる毎にリセットされる、第2図
で、アドレスカウンタ22はカウンタで、ラインカウン
タ20はカウンタとゲートで構成できる。
変倍処理回路3は公知の線形補間演算のアルゴリズムを
実現するものである。変倍率により決定される一定の周
期に、それをはさむ最も近い変倍率100%に相当する
原周期の2つのデータを用いて、新たなデータをつくり
画素密度変換する。
ラインメモリ2はデータ記憶手段に相当しRAM、レジ
スタ等の記憶素子で構成でき、演算に用いられる1ライ
ン前の画像データを記憶するもので、アドレス9により
指定される1ライン前のデータを出力したり、入力デー
タを新たな1ライン前のデータとして記憶する。
次に、第1図の動作について説明する。
データ形式信号6を制御手段Iに入力し、アドレスカウ
ンタ22のリセット信号23にライン信号5と3ライン
分のライン信号を1ラインとする3ライン信号24のど
ちらを用いるか選択する。
点順次データ及び面順次データではアドレス9はライン
信号5をアドレスカウンタ22のリセット信号23とし
第3図のようにインクリメントされ、線順次データでは
3ライン信号24をアドレスカウンタ22のリセット信
号23とし第4図のようにインクリメントされる。
上記により、同じアドレスにはデータ形式に関わらず同
色データが並べられる。
制御手段1はデータ形式に応じてアドレス9を発生し、
ラインメモリ2から1ライン前の同色データを出力させ
、且つ、入力データ7を同一のアドレスでラインメモリ
2に書き込む、これにより、入力データ7と1ライン前
の同色データが変倍処理回路3に入力され、画素密度変
換され出力される。
〔発明の効果) 本発明は、以上説明したように、各データ形式に対し演
算処理を可能とし画像処理装置の汎用性を著しく向上さ
せ、他の装置との接続を容易とした。
【図面の簡単な説明】
第1図は本発明の実施例の構成ブロック図で、第2図は
制御手段1の構成ブロフク図で、第3図は本発明の実施
例の点順次データ処理時におけるタイミングチャート、
第4図は本発明の実施例の線順次データ処理時における
タイミングチャート、第5図は点順次データのデータ配
列を示す説明図で、第6図は線順次データのデータ配列
を示す説明図で、第7図は面順次データのデータ配列を
示す説明図である。 1・・・制御手段 2・・・ラインメモリ 3・・・変倍処理回路 6・・・データ形式信号 以上 出願人 セイコー電子工業株式会社 代理人 弁理士 林  敬 之 助 □主定査方向 方 EI Rrno GITIOBmo RITII Gm
+ BmIRmz Gmz 8m2−Rmn Gmn 
Bmn第5図 □主LJ方勾 RmORm+ Rrn2Rm3−−−−−−−−−−一
−−−−RmnGrnOGrr++Gm2Gm3 −−
−−−−−−−−−−−−  GmnBmOBm+Bm
2Bm3 −−−−−−− −−−− −−  Bmn
第6図 □主疋五方勾 ”?o+  Roz Ft3−−−−  R□、。 ”?n  RI2  R13−−−−R1nF?2+ 
 R22R23−−−−R21,14+ Rm2 Rm
3 Gmn 301  GO2GO3−−−−GonGlo  G1
1 G12 0+3 −−−−  G+n620 G2
T G22 G23 −−−−  G2nGm□ Gm
s Grn2Gm3 Gmn Boo  BOI  B02 BO3−−−−BonB
oo  BIT  B12 8+3 −−−−  B1
n820  B21 B22 B23 −−−−  B
znBrylo 8m18m28m:+ mn 第 図

Claims (1)

  1. 【特許請求の範囲】 2次元で構成されるカラー画像データのN×M(N、M
    >1)の領域に注目して変倍処理を行う変倍回路におい
    て、 画素に対応し演算に用いられる画像データを記憶するデ
    ータ記憶手段と、データ形式に応じ前記データ記憶手段
    を制御する制御手段と、前記データ記憶手段に接続し領
    域内の画像データと入力画像データを用いて画素密度変
    換し出力する変倍処理回路から成ることを特徴とする変
    倍回路。
JP17924490A 1990-07-05 1990-07-05 変倍回路 Pending JPH0468867A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17924490A JPH0468867A (ja) 1990-07-05 1990-07-05 変倍回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17924490A JPH0468867A (ja) 1990-07-05 1990-07-05 変倍回路

Publications (1)

Publication Number Publication Date
JPH0468867A true JPH0468867A (ja) 1992-03-04

Family

ID=16062459

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17924490A Pending JPH0468867A (ja) 1990-07-05 1990-07-05 変倍回路

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