JPH0461489U - - Google Patents

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JPH0461489U
JPH0461489U JP10394490U JP10394490U JPH0461489U JP H0461489 U JPH0461489 U JP H0461489U JP 10394490 U JP10394490 U JP 10394490U JP 10394490 U JP10394490 U JP 10394490U JP H0461489 U JPH0461489 U JP H0461489U
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limit
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switching element
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JP10394490U
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Description

【図面の簡単な説明】
第１図及び第２図は本考案の第１実施例を示し
、第１図は回路構成図、第２図は制御用ＩＣの動
作を示す波形図、第３図は本考案の第２実施例を
示す最大デユーテイ制限電圧可変回路の回路構成
図、第４図及び第５図は従来例を示し、第４図は
回路構成図、第５図は制御用ＩＣの動作を示す波
形図である。 ２……トランス、３……スイツチング素子、６
……デツドタイム制御端子、７……制御用ＩＣ、
１９……最大デユーテイ制限電圧可変回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 直流入力電圧をスイツチング素子によりスイツ
    チングしてトランスの一次巻線に印加し、前記ト
    ランスの二次巻線に誘起された電圧を整流平滑し
    て出力し、この出力電圧を安定化するための帰還
    回路に前記スイツチング素子を制御する制御用Ｉ
    Ｃを用い、前記制御用ＩＣは前記スイツチング素
    子に対する最大デユーテイを制限するための最大
    デユーテイ制限電圧が印加されるデツドタイム制
    御端子を有し、通常は出力電圧に基づくＰＷＭ制
    御が行われ、出力電圧が前記最大デユーテイ制限
    電圧との対比において所定レベルより低下したと
    き最大デユーテイを制限する制御が行われるスイ
    ツチング電源装置において、前記直流入力電圧が
    一定値以上に達したときにこの直流入力電圧に基
    づいて前記デツドタイム制御端子に印加される電
    圧を上昇させる最大デユーテイ制限電圧可変回路
    を前記デツドタイム制御端子に接続したことを特
    徴とするスイツチング電源装置。
JP10394490U 1990-10-01 1990-10-01 Pending JPH0461489U (ja)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20150020326A (ko) * 2012-05-21 2015-02-25 발라드 파워 시스템즈 인크. 소스 보호를 위한 dc/dc 전력 컨버터 제어 전략

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