JPH0461490U - - Google Patents

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JPH0461490U
JPH0461490U JP10394690U JP10394690U JPH0461490U JP H0461490 U JPH0461490 U JP H0461490U JP 10394690 U JP10394690 U JP 10394690U JP 10394690 U JP10394690 U JP 10394690U JP H0461490 U JPH0461490 U JP H0461490U
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Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す回路構成図、
第２図は制御用ＩＣの動作を示す波形図である。 １……直流入力電圧源、２……トランス、３…
…スイツチング素子、４……整流平滑回路、６…
…最大デユーテイ制限電圧切換回路、７……制御
用ＩＣ、８……基準電圧回路、９……デツドタイ
ム制御端子、Ｒ１，Ｒ２，Ｒ３，Ｒ４，Ｒ５，Ｒ
７……抵抗、Ｑ１，Ｑ２……トランジスタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 直流入力電圧をスイツチング素子によりスイツ
    チングしてトランスの一次巻線に印加し、前記ト
    ランスの二次巻線に誘起された電圧を整流平滑し
    て出力し、この出力電圧を安定化するための帰還
    回路に前記スイツチング素子を制御する制御用Ｉ
    Ｃを用い、前記制御用ＩＣは前記スイツチング素
    子に対する最大デユーテイを制限するための最大
    デユーテイ制限電圧が印加されるデツドタイム制
    御端子を有するスイツチング電源装置において、
    前記入力電圧を抵抗により分圧し、ベース電圧と
    して供給し、このベース電圧が一定値より低いと
    きはオン動作により前記制御用ＩＣから出力され
    る基準電圧を前記デツドタイム制御端子に供給し
    てスイツチング素子の駆動信号の出力を禁止し、
    前記ベース電圧が一定値より高いときはオフ動作
    により前記基準電圧を抵抗により分圧した電圧を
    前記デツドタイム制御端子に供給する第１のトラ
    ンジスタと、前記第１のトランジスタとともにオ
    ン動作することにより前記第１のトランジスタの
    ベース電圧を低下させ、前記第１のトランジスタ
    とともにオフ動作することにより前記第１のトラ
    ンジスタのベース電圧を上昇させて入力電圧の上
    昇時と下降時の最大デユーテイ制限電圧切換動作
    点を変える第２のトランジスタからなる最大デユ
    ーテイ制限電圧切換回路を前記デツドタイム制御
    端子に接続したことを特徴とするスイツチング電
    源装置。
JP1990103946U 1990-10-01 1990-10-01 スイッチング電源装置 Expired - Lifetime JP2548026Y2 (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012217336A (ja) * 2000-06-30 2012-11-08 Power Integrations Inc スイッチング・レギュレータの軽負荷時の効率を改善するための方法および装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02228248A (ja) * 1989-02-28 1990-09-11 Nec Corp スイッチング電源

Patent Citations (1)

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