JPH0454718A - エコーキャンセラ - Google Patents
エコーキャンセラInfo
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- JPH0454718A JPH0454718A JP2165909A JP16590990A JPH0454718A JP H0454718 A JPH0454718 A JP H0454718A JP 2165909 A JP2165909 A JP 2165909A JP 16590990 A JP16590990 A JP 16590990A JP H0454718 A JPH0454718 A JP H0454718A
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- 230000003044 adaptive effect Effects 0.000 claims abstract description 31
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B3/00—Line transmission systems
- H04B3/02—Details
- H04B3/20—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other
- H04B3/23—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other using a replica of transmitted signal in the time domain, e.g. echo cancellers
-
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
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- H04B3/02—Details
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- H04B3/23—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other using a replica of transmitted signal in the time domain, e.g. echo cancellers
- H04B3/238—Reducing echo effects or singing; Opening or closing transmitting path; Conditioning for transmission in one direction or the other using a replica of transmitted signal in the time domain, e.g. echo cancellers using initial training sequence
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
- Filters That Use Time-Delay Elements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は2線式デジタル伝送装置等に用いるエコーキャ
ンセラに関し、特にアダプティブ・デジタル・フィルタ
を用いた適応可変型エコーキャンセラに関する。
ンセラに関し、特にアダプティブ・デジタル・フィルタ
を用いた適応可変型エコーキャンセラに関する。
従来のエコーキャンセラは入力信号をA/D変換回路に
よりデジタル信号に変換し、そのデジタル信号とアダプ
ティブ・デジタル・フィルタにより発生したエコーレプ
リカ信号をデジタル的に減算し、エコー信号のキャンセ
ルを行う構成となっていた(例えば、l5SCC’89
DIGESTpp256−257 ”An ANS
I 5tandard l5DN Trans−cev
er Chip Set”、同D I GE S T
pp258−259”An l5IIN Echo
Cancelling TransceverChip
Set for 2BIQ Coded U−1nt
erface同DIGEST pp260−261
”2BIQ Transceverfor the l
5DN 5ubscriber Loop”)。
よりデジタル信号に変換し、そのデジタル信号とアダプ
ティブ・デジタル・フィルタにより発生したエコーレプ
リカ信号をデジタル的に減算し、エコー信号のキャンセ
ルを行う構成となっていた(例えば、l5SCC’89
DIGESTpp256−257 ”An ANS
I 5tandard l5DN Trans−cev
er Chip Set”、同D I GE S T
pp258−259”An l5IIN Echo
Cancelling TransceverChip
Set for 2BIQ Coded U−1nt
erface同DIGEST pp260−261
”2BIQ Transceverfor the l
5DN 5ubscriber Loop”)。
次に従来のエコーキャンセラの動作について説明する。
第9図に従来の2線式デジタル伝送装置に用いるエコー
キャンセラの基本的な構成を示す。図9において、参照
数字83は遅延回路、84はD/A変換回路、85はロ
ーパス・フィルタ、86はライン・ドライバ、87はバ
ランシング・ネットワーク、88は加算回路、89はロ
ーパス・フィルタ、90はA/D変換回路、91はデジ
タル・ローパス・フィルタ、92は加算回路、93は線
路等化回路、94はアダプティブ・デジタル・フィルタ
、95はスイッチ、R3及びR4は抵抗、Trはトラン
ス、TDは送信信号、RDはエコーキャンセラ後の受信
信号を示し、端子L1及びR2に2線式伝送路が接続さ
れる。送信信号TDは遅延回路、D/A変換回路、ロー
パス・フィルタ、ライン・ドライバ、トランスを介して
伝送路に送出される。抵抗R3及びR4とバラシング・
ネットワーク(87)と加算回路(88)はノ1イブリ
ッド回路を構成している。今、トランスと伝送路のイン
ピーダンスをZl、バランシング・ネットワークのイン
ピーダンスをzbとすると、R4/Zb=R3/Zlの
条件が満足されれば、ブリッジ回路が平衡状態にあり加
算回路の出力には相手側の送信信号、即ちファー・エン
ド′・シフナルのみが圧力される。この様にバランシン
グ・ネットワークのみで完全な平衡条件を実現する事が
できれば、送信信号の受信部への回り込み、即ちエコー
は発生しない。ところが、伝送路が分布定数回路である
のに対して、バランシング・ネットワークは一般的に集
中定数回路で構成されるため、完全な平衡条件を実現す
る事ができない。
キャンセラの基本的な構成を示す。図9において、参照
数字83は遅延回路、84はD/A変換回路、85はロ
ーパス・フィルタ、86はライン・ドライバ、87はバ
ランシング・ネットワーク、88は加算回路、89はロ
ーパス・フィルタ、90はA/D変換回路、91はデジ
タル・ローパス・フィルタ、92は加算回路、93は線
路等化回路、94はアダプティブ・デジタル・フィルタ
、95はスイッチ、R3及びR4は抵抗、Trはトラン
ス、TDは送信信号、RDはエコーキャンセラ後の受信
信号を示し、端子L1及びR2に2線式伝送路が接続さ
れる。送信信号TDは遅延回路、D/A変換回路、ロー
パス・フィルタ、ライン・ドライバ、トランスを介して
伝送路に送出される。抵抗R3及びR4とバラシング・
ネットワーク(87)と加算回路(88)はノ1イブリ
ッド回路を構成している。今、トランスと伝送路のイン
ピーダンスをZl、バランシング・ネットワークのイン
ピーダンスをzbとすると、R4/Zb=R3/Zlの
条件が満足されれば、ブリッジ回路が平衡状態にあり加
算回路の出力には相手側の送信信号、即ちファー・エン
ド′・シフナルのみが圧力される。この様にバランシン
グ・ネットワークのみで完全な平衡条件を実現する事が
できれば、送信信号の受信部への回り込み、即ちエコー
は発生しない。ところが、伝送路が分布定数回路である
のに対して、バランシング・ネットワークは一般的に集
中定数回路で構成されるため、完全な平衡条件を実現す
る事ができない。
従ってバランシング・ネットワークによりある程度エコ
ーが抑圧されるが、完全に零にすることはできない。そ
こで受信部にエコーキャンセラが必要となる。今、バラ
ンシング・ネットワークのエコー抑圧量を20dB、伝
送線路の最大損失を50dBとし、20dBの信号/エ
コー信号比を得ようとすると、エコーキャンセラーは5
0dBのエコー抑圧を実現しなければならないことにな
る。
ーが抑圧されるが、完全に零にすることはできない。そ
こで受信部にエコーキャンセラが必要となる。今、バラ
ンシング・ネットワークのエコー抑圧量を20dB、伝
送線路の最大損失を50dBとし、20dBの信号/エ
コー信号比を得ようとすると、エコーキャンセラーは5
0dBのエコー抑圧を実現しなければならないことにな
る。
次に受信部の動作について説明する。
前述の様に加算回路(88)の出力にはファーエンド信
号とエコー信号の加算信号が出力される。
号とエコー信号の加算信号が出力される。
この信号はローパス・フィルタ(89)で帯域外雑音を
除去した後A/D変換回路(90)でデジタル信号に変
換される。このA/D変換回路は高い線形性が要求され
るため、一般的にはオーバーサンプリング型のA/D変
換器が用いられる。本従来例はこのオーバーサンプリン
グ型A/D変換器を用いた構成をしめしている。デジタ
ル・ローパス・フィルタ(91)はオーバーサンプリン
グ型A/D変換器の出力を入力し、高周波の量子化雑音
除去及びオーバーサンプリング周波数からボーレート周
波数(送信信号TDの周波数)へのデシメーションを行
う。次にデジタル・ローパス・フィルタの出力はアダプ
ティブ・デジタル・フィルタ(94)の出力と加算回路
(92)で加算される。アダプティブ・デジタル・フィ
ルタの動作の詳細は後で説明するが、ここでボーレート
のエコーレプリカが発生され、アダプティブ・デジタル
・フィルタが引き込みを完了していれば加算回路(92
)の出力では完全にエコー信号が除去される。従って加
算回路(92)の出力にはファーエンド信号のみが出力
される。このファーエンド信号は線路等化回路(93)
で伝送歪を除去し、受信信号(RD)を出力する。
除去した後A/D変換回路(90)でデジタル信号に変
換される。このA/D変換回路は高い線形性が要求され
るため、一般的にはオーバーサンプリング型のA/D変
換器が用いられる。本従来例はこのオーバーサンプリン
グ型A/D変換器を用いた構成をしめしている。デジタ
ル・ローパス・フィルタ(91)はオーバーサンプリン
グ型A/D変換器の出力を入力し、高周波の量子化雑音
除去及びオーバーサンプリング周波数からボーレート周
波数(送信信号TDの周波数)へのデシメーションを行
う。次にデジタル・ローパス・フィルタの出力はアダプ
ティブ・デジタル・フィルタ(94)の出力と加算回路
(92)で加算される。アダプティブ・デジタル・フィ
ルタの動作の詳細は後で説明するが、ここでボーレート
のエコーレプリカが発生され、アダプティブ・デジタル
・フィルタが引き込みを完了していれば加算回路(92
)の出力では完全にエコー信号が除去される。従って加
算回路(92)の出力にはファーエンド信号のみが出力
される。このファーエンド信号は線路等化回路(93)
で伝送歪を除去し、受信信号(RD)を出力する。
次にエコーレプリカを発生するアダプティブ・デジタル
・フィルタについて説明する。第10図は代表的なアダ
プティブ・デジタルフィルタの構成例を示した物である
。入力端子(INI)には送信信号(TD)が入力され
、入力端子(IN2)には加算回路(92)の出力また
は線路等化回路(93)の出力が入力される。入力端子
(IN2)に入力される信号の選択はスイッチ(95)
により行われ、アダプティブ・デジタル・フィルタが引
き込みを完了するまでは加算回路出力が選択され、引き
込み完了後線路等化回路出力が選択される。今ファーエ
ンド信号が零の状態を仮定すると入力端子(IN2)に
加わる信号はエコキャンセラの誤差信号を意味する。図
中αは引き込み速度を決定する定数で、一般的にはα(
1の値が用いられる。又、図の単位遅延回路(T)はボ
ーレートの1周期の遅延を発生する。各タックに接続さ
れた積分回路(98)で送信信号と誤差信号の相関を取
って積分を行なう。この結果として各積分器にはボーレ
ート周期でサンプリングしたエコー波形が蓄積される。
・フィルタについて説明する。第10図は代表的なアダ
プティブ・デジタルフィルタの構成例を示した物である
。入力端子(INI)には送信信号(TD)が入力され
、入力端子(IN2)には加算回路(92)の出力また
は線路等化回路(93)の出力が入力される。入力端子
(IN2)に入力される信号の選択はスイッチ(95)
により行われ、アダプティブ・デジタル・フィルタが引
き込みを完了するまでは加算回路出力が選択され、引き
込み完了後線路等化回路出力が選択される。今ファーエ
ンド信号が零の状態を仮定すると入力端子(IN2)に
加わる信号はエコキャンセラの誤差信号を意味する。図
中αは引き込み速度を決定する定数で、一般的にはα(
1の値が用いられる。又、図の単位遅延回路(T)はボ
ーレートの1周期の遅延を発生する。各タックに接続さ
れた積分回路(98)で送信信号と誤差信号の相関を取
って積分を行なう。この結果として各積分器にはボーレ
ート周期でサンプリングしたエコー波形が蓄積される。
またこのエコー波形は送信信号のタイミングに合わせて
各タップから出力され、加算回路(99)で加算され、
アダプティブ・ディジタル・フィルタの出力となる。又
、ファーエンド信号が加わった場合においても、ファー
エンド信号と送信信号とは無相関であるため上記と同様
の動作となる。
各タップから出力され、加算回路(99)で加算され、
アダプティブ・ディジタル・フィルタの出力となる。又
、ファーエンド信号が加わった場合においても、ファー
エンド信号と送信信号とは無相関であるため上記と同様
の動作となる。
この従来のエコーキャンセラでは、エコー信号がA/D
変換回路に入力されるためA/D変換回路の非線形性が
エコーキャンセラの特性を決定してしまう。又、A/D
変換回路にはエコー信号とファーエンド信号の加算信号
が入力されるためA/D?IfJ回路及びエコーレプリ
カを加算する加算回路に広いダイナミックレンジが要求
されるため、回路規模が大きくなるという欠点があった
。
変換回路に入力されるためA/D変換回路の非線形性が
エコーキャンセラの特性を決定してしまう。又、A/D
変換回路にはエコー信号とファーエンド信号の加算信号
が入力されるためA/D?IfJ回路及びエコーレプリ
カを加算する加算回路に広いダイナミックレンジが要求
されるため、回路規模が大きくなるという欠点があった
。
上記の欠点を解決する手段として、アダプティブ・デジ
タル・フィルタの出力をD/A変換し、ローパス・フィ
ルタで波形成形したエコーレプリカを作成し、A/D変
換器の前でエコーレプリカ減算する手段が考えられるが
、この方法を実現するためには線形性の非常に高いD/
A変換回路おヨヒローパス・フィルタが必要になり、実
現が困難である。
タル・フィルタの出力をD/A変換し、ローパス・フィ
ルタで波形成形したエコーレプリカを作成し、A/D変
換器の前でエコーレプリカ減算する手段が考えられるが
、この方法を実現するためには線形性の非常に高いD/
A変換回路おヨヒローパス・フィルタが必要になり、実
現が困難である。
本発明のエコーキャンセラは、送信信号とエコーキャン
セラ後の受信信号の相関を取りタップ係数を適応可変す
るアダプティブ・デジタル・フィルタと、該アダプティ
ブ・デジタル・フィルタの圧力信号を該アダプティブ・
デジタル・フィルタの動作周波数の整数倍でサンプリン
グしデルタ・シグマ変調を行う変調回路と、該変調回路
出力を入力とするD/A変換回路と、該D/A変換回路
の出力と受信信号を加算する加算回路とを備えている。
セラ後の受信信号の相関を取りタップ係数を適応可変す
るアダプティブ・デジタル・フィルタと、該アダプティ
ブ・デジタル・フィルタの圧力信号を該アダプティブ・
デジタル・フィルタの動作周波数の整数倍でサンプリン
グしデルタ・シグマ変調を行う変調回路と、該変調回路
出力を入力とするD/A変換回路と、該D/A変換回路
の出力と受信信号を加算する加算回路とを備えている。
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例のエコーキャンセラのブロッ
ク図である。図中参照数字1は遅延回路、2はD/A変
換回路、3はローパス・フィルタ、4はライン・ドライ
バ、5はバランシング・ネットワーク、6はアダプティ
ブ・デジタル・フィルタ、7は2次ΔΣ変調回路、8は
D/A変換回路、9は加算回路、10はローパス・フィ
ルタ、11は加算回路、12は2次ΔΣA/D変換回路
、13はデジタル・ローパス・フィルタ、14は線路等
化回路を示す。ここで遅延回路(1)、D/A変換回路
(2)、ローパス・フィルタ(3) 、ライン・ドライ
バ(4)、バランシング・ネットワーク(5) 、アダ
プティブ・デジタル・フィルタ(6)、加算回路(9)
、ローパス・フィルタGO)、デジタル・ローハス・フ
ィルタ03)、線路等化回路04)は従来例と同じであ
るので説明を省略する。以下従来例と異なる点について
のみ説明する。アダプティブ・デジタル・フィルタ(6
)は従来例と同様にボーレートのエコーレプリカを出力
する。アダプティブ・デジタル。
ク図である。図中参照数字1は遅延回路、2はD/A変
換回路、3はローパス・フィルタ、4はライン・ドライ
バ、5はバランシング・ネットワーク、6はアダプティ
ブ・デジタル・フィルタ、7は2次ΔΣ変調回路、8は
D/A変換回路、9は加算回路、10はローパス・フィ
ルタ、11は加算回路、12は2次ΔΣA/D変換回路
、13はデジタル・ローパス・フィルタ、14は線路等
化回路を示す。ここで遅延回路(1)、D/A変換回路
(2)、ローパス・フィルタ(3) 、ライン・ドライ
バ(4)、バランシング・ネットワーク(5) 、アダ
プティブ・デジタル・フィルタ(6)、加算回路(9)
、ローパス・フィルタGO)、デジタル・ローハス・フ
ィルタ03)、線路等化回路04)は従来例と同じであ
るので説明を省略する。以下従来例と異なる点について
のみ説明する。アダプティブ・デジタル・フィルタ(6
)は従来例と同様にボーレートのエコーレプリカを出力
する。アダプティブ・デジタル。
フィルタの出力は2次ΔΣ変調回路(7)に入力され、
ボーレートの整数倍のオーバーサンプリングレートでサ
ンプリングされた後変調され、オーバーサンプリング周
波数の1 bitの信号を出力する。この1bitのデ
ジタル信号はD/A変換回路(8)により2値のアナロ
グ信号に変換される。この2値のアナログ信号はローパ
ス・フィルタ00)で帯域制限された入力信号と加算回
路01)で加算される。この加算回路出力は2次ΔΣA
/D変換回路aりに入力され、1 bitのデジタル信
号に変換される。以下従来例と同様の動作によりエコー
キャンセルを行なう。第2図は本実施例に用いるアダプ
ティブ・デジタル・フィルタの例を示したものである。
ボーレートの整数倍のオーバーサンプリングレートでサ
ンプリングされた後変調され、オーバーサンプリング周
波数の1 bitの信号を出力する。この1bitのデ
ジタル信号はD/A変換回路(8)により2値のアナロ
グ信号に変換される。この2値のアナログ信号はローパ
ス・フィルタ00)で帯域制限された入力信号と加算回
路01)で加算される。この加算回路出力は2次ΔΣA
/D変換回路aりに入力され、1 bitのデジタル信
号に変換される。以下従来例と同様の動作によりエコー
キャンセルを行なう。第2図は本実施例に用いるアダプ
ティブ・デジタル・フィルタの例を示したものである。
この回路は従来例の7ダプテイブ・デジタル・フィルタ
とほとんど同じであるが、エコーレプリカの加算点をA
/D変換回路の前に出したことによるループ遅延の増加
を補正するために、乗算回路に加える送信信号のタイミ
ングをずらしている。
とほとんど同じであるが、エコーレプリカの加算点をA
/D変換回路の前に出したことによるループ遅延の増加
を補正するために、乗算回路に加える送信信号のタイミ
ングをずらしている。
第3図は本実施例に用いた2次ΔΣ変調回路のブロック
図である。図中参照数字19.20は積分回路、21は
量子化回路、22は単位遅延回路、23.24は加算回
路を示し、すべてオーバーサンプリング周波数で動作す
る。
図である。図中参照数字19.20は積分回路、21は
量子化回路、22は単位遅延回路、23.24は加算回
路を示し、すべてオーバーサンプリング周波数で動作す
る。
第4図は第1図のD/A変換回路(8)と加算回路αυ
をスイッチド・キャパシタ・フィルタで構成した実施例
を示したものである。図中参照数字25から37はスイ
ッチ、38から41は容量、42は演算増幅器、43は
インバータ、44及び45はANDゲートを示す。本実
施例を用いることにより、D/A変換回路と加算回路の
演算増幅器を共用化することができる。
をスイッチド・キャパシタ・フィルタで構成した実施例
を示したものである。図中参照数字25から37はスイ
ッチ、38から41は容量、42は演算増幅器、43は
インバータ、44及び45はANDゲートを示す。本実
施例を用いることにより、D/A変換回路と加算回路の
演算増幅器を共用化することができる。
第5図はD/A変換回路及び加算回路の第二の実施例を
示したものである。図中参照数字46から68はスイッ
チ、69から75は容量、76及び77は演算増幅器、
78はコンパレータ、79はスイッチ制御回路、80は
インバータ、81及び82はANDゲートをしめす。本
実施例は2次ΔΣ変換回路にD/A変換回路と加算回路
の機能を加えたもので、スイッチ64から68および容
量75で構成される部分が1bitのD/A変換回路を
構成し、2次ΔΣA/D変換回路の第一積分器で加算を
行なっている。本実施例を用いることにより、D/A変
換回路及び加算回路の演算増幅器が必要なくなり、回路
規模を最少化する事が出来る。
示したものである。図中参照数字46から68はスイッ
チ、69から75は容量、76及び77は演算増幅器、
78はコンパレータ、79はスイッチ制御回路、80は
インバータ、81及び82はANDゲートをしめす。本
実施例は2次ΔΣ変換回路にD/A変換回路と加算回路
の機能を加えたもので、スイッチ64から68および容
量75で構成される部分が1bitのD/A変換回路を
構成し、2次ΔΣA/D変換回路の第一積分器で加算を
行なっている。本実施例を用いることにより、D/A変
換回路及び加算回路の演算増幅器が必要なくなり、回路
規模を最少化する事が出来る。
第6図は2次ΔZ変調回路の第二の実施例を示す。図中
記号Aはデジタル・ローパス・フィルタ、Bは2次ΔΣ
変調回路(第3図と同一回路)をしめす。本実施例はア
ダプティブ・デンタル・フィルタの出力であるボーレー
トのエコーレプリカの補間な行うため、2次ΔΣ変調回
路の前にオーバーサンプリング周波数で動作するデジタ
ル・ローパス・フィルタを置いたものである。この構成
を用いることによりボーレートサンプル点間のエコー抑
圧特性が向上する。具体的な効果については後で説明を
行なう。
記号Aはデジタル・ローパス・フィルタ、Bは2次ΔΣ
変調回路(第3図と同一回路)をしめす。本実施例はア
ダプティブ・デンタル・フィルタの出力であるボーレー
トのエコーレプリカの補間な行うため、2次ΔΣ変調回
路の前にオーバーサンプリング周波数で動作するデジタ
ル・ローパス・フィルタを置いたものである。この構成
を用いることによりボーレートサンプル点間のエコー抑
圧特性が向上する。具体的な効果については後で説明を
行なう。
以上説明したように本発明は、送信信号とエコーキャン
セラ後の受信信号の相関を取りタップ係数を適応可変す
るアダプティブ・デジタル・フィルタラ有スるエコー・
キャンセラにおいて、該アダプティブ・デジタル・フィ
ルタの圧力信号を該アダプティブ・デジタル・フィルタ
の動作周波数の整数倍でサンプリングしデルタ・シグマ
変調を行う変調回路と、該変調回路出力を入力とするD
/A変換回路と、該D/A変換回路の出力と受信信号を
加算する加算回路を用いることにより、線形性の高いエ
コーレプリカをA/D変換回路の前で加算することがで
きる。この事によりA/D変換回路の非線形性の影響を
小さくすることが出米又、エコー信号がA/D変換回路
の前で抑圧されるため、A/D変換回路以降の回路に要
求されるダイナミックレンジを小さくすることが出来、
また回路の小型化も可能となる。
セラ後の受信信号の相関を取りタップ係数を適応可変す
るアダプティブ・デジタル・フィルタラ有スるエコー・
キャンセラにおいて、該アダプティブ・デジタル・フィ
ルタの圧力信号を該アダプティブ・デジタル・フィルタ
の動作周波数の整数倍でサンプリングしデルタ・シグマ
変調を行う変調回路と、該変調回路出力を入力とするD
/A変換回路と、該D/A変換回路の出力と受信信号を
加算する加算回路を用いることにより、線形性の高いエ
コーレプリカをA/D変換回路の前で加算することがで
きる。この事によりA/D変換回路の非線形性の影響を
小さくすることが出米又、エコー信号がA/D変換回路
の前で抑圧されるため、A/D変換回路以降の回路に要
求されるダイナミックレンジを小さくすることが出来、
また回路の小型化も可能となる。
次にシミュレーション結果により本発明の詳細な説明す
る。第7図(a)及び(b)は非線形性を有するA/D
変換回路を使用した場合の残留エコーを示したものであ
る。A/D変換回路の非線形性はA/D変換回路内のス
イッチド・キャパシタ積分器のモデルとして5%の入出
力間歪を与えることによりモデル化した。(a)は従来
のエコーキャンセラ、(b)は本発明によるエコーキャ
ンセラの特性を示したものである。本シミュレーション
結果から本発明によるエコーキャンセラの方が約10d
Bエコー抑圧量がおおきいことがわかる。
る。第7図(a)及び(b)は非線形性を有するA/D
変換回路を使用した場合の残留エコーを示したものであ
る。A/D変換回路の非線形性はA/D変換回路内のス
イッチド・キャパシタ積分器のモデルとして5%の入出
力間歪を与えることによりモデル化した。(a)は従来
のエコーキャンセラ、(b)は本発明によるエコーキャ
ンセラの特性を示したものである。本シミュレーション
結果から本発明によるエコーキャンセラの方が約10d
Bエコー抑圧量がおおきいことがわかる。
従って本発明のエコーキャンセラはA/D変換回路の非
線形性の影響を受けにくいことが判る。
線形性の影響を受けにくいことが判る。
第8図(a)及び(b)は本発明の第一の実施例(a)
と第6図に示した第二の実施例(b)の特性を示したも
のである。デジタル・ローパス・フィルタは96タツプ
のFIRフィルタを用いた。この図は引き込み完了後の
エコーキャンセラ出力をプロットしたもので、縦の線は
ボーレートサンプル点を示ス。エコーキャンセラはボー
レートサンプル点の在留エコーを零にするように動作す
るため、ボーレートサンプル点では両方ともエコーが十
分抑圧されている。但しボーレートサンプル点以外のエ
コー抑圧特性はエコーキャンセラループの補間特性で決
まるため、第二の実施例の方がボーレートサンプル点以
外のエコーが小さくなっている。この様にボーレートサ
ンプル点以外のエコーを小さくすることにより、受信ク
ロックの位相ズしによる残留エコーの増加を少なくでき
る為、タイミング抽出特性を改善する事が出来る。
と第6図に示した第二の実施例(b)の特性を示したも
のである。デジタル・ローパス・フィルタは96タツプ
のFIRフィルタを用いた。この図は引き込み完了後の
エコーキャンセラ出力をプロットしたもので、縦の線は
ボーレートサンプル点を示ス。エコーキャンセラはボー
レートサンプル点の在留エコーを零にするように動作す
るため、ボーレートサンプル点では両方ともエコーが十
分抑圧されている。但しボーレートサンプル点以外のエ
コー抑圧特性はエコーキャンセラループの補間特性で決
まるため、第二の実施例の方がボーレートサンプル点以
外のエコーが小さくなっている。この様にボーレートサ
ンプル点以外のエコーを小さくすることにより、受信ク
ロックの位相ズしによる残留エコーの増加を少なくでき
る為、タイミング抽出特性を改善する事が出来る。
以上説明したように、本発明を用いることにより、高性
能で小型のエコーキャンセルを実現することが出来る。
能で小型のエコーキャンセルを実現することが出来る。
第1図は本発明の一実施例のブロック図、第2図は第1
図の7ダプテイブ・デジタル・フィルタの構成図、第3
図は第1図の2次ΔΣ変調回路の構成図、第4図及び第
5図は第1図のD/A変換機及び加算回路の第−及び第
二の構成図、第6図は第1図の2次ΔL変調回路の第二
の構成図、第7図は従来例及び本発明のエコーキャンセ
ラの残留エコーのシミューレー、ジョン結果、i8図は
本発明の第−及び第二の実施例のボーレートサンプル点
外の残留エコーのシミュレーション結果、第9図は従来
のエコーキャンセラのブロック図、第1O図は第9図の
アダプティブ・デジタル・フィルタの構成図である。 1・・・・・・遅延回路、2・・・・・D/A変換回路
、3・・・・・・ローパス・フィルタ、4・・・・・・
ライン・ドライバ、5・・・・・・バランシング・ネッ
トワーク、6・・・・・アダプティブ・デジタル・フィ
ルタ、7・・・・・・2次ΔΣ変調回路、8・・・・・
・D/A変換回路、9・・・・・・加算回路、10・・
・・・・ローパス・フィルタ、11・・・・・・加算回
路、12・・・・・・2次ΔΣA/D変換回路、13・
・・・・・デジタル・ローパス・フィルタ、14・・・
・・線路等化回路、15・・・・・・単位遅延回路(記
号:T)、16・・・・・・乗算回路(記号:X)、1
7・・・・・・積分回路(記号:■)、18・・・・・
・加算回路(記号:十)、19.20・・・・・・積分
回路、21・・・・・・量子化回路、22・・・・・・
単位遅延回路、23.24・・・・・・加算回路、25
.37・・・・・・スイッチ、38.41・・・・・容
量、42・・・・・・演算増幅器、43・・・・・・イ
ンバータ、44.45・・・・・・ANDゲート、46
.68・・・・・・スイッチ、69.75・・・・・・
容量、76.77・・・・・・演’l増幅器、78・・
・・・・コンパレータ、79・・・・・スイッチ制御回
路、80・・・・・・インバータ、81.82・・・・
・・ANDゲート、A・・・・・・デジタル・ローパス
・フィルタ、B・・・・・・2次ΔΣ変調回路、83・
・・・・・遅延回路、84・・・・・・D/A変換回路
、85・・・・・・ロパス・フィルタ、86・・・・・
・ライン・ドライバ、87・・・・・・バランシング・
ネットワーク、88・・・・・・加算回路、89・・・
・・・ローパス・フィルタ、90・・・・・・A/D変
換回路、91・・・・・・デジタル・ローパス・フィル
タ、92・・・・・・加算回路、93・・・・・・線路
等化回路、94・・・・・・アダプティブ・デジタル・
フィルタ、95・・・・・・スイッチ、96・・・・・
・単位遅延回路(記号:T)、97・・・・・・乗算回
路(記号:X)、98・・・・・・積分回路(記号:工
)、99・・・・・・加算回路(記号:十)。 代理人 弁理士 内 原 晋 1’1lLJ迫ρ”l& 2:”9A質jナコ#
J、−Zl)−ハ“ス・スルり4、ライン・L′)(
バ 5.バラシシン2′・半1.I−ワーフ j!、
ニア9”)Oティア゛・プ゛シ′りlし・74/l/り
7.2;χd2?炙縛淫引4シ躬l 胆 t、f:#J冴縫0がqt名:丁2 第2胆 14.4jニア4A/D’r’−ト 第4 薦 7、デυZ佑0−パス乃ルタ z: z;r:A>t−@rib 第z図 ダウ1−了 L つ− (Aタノ 列i−エフ−(ppLV) へ暢しフ <thノ 憾らデLコー (wtV) 第 q開 第1θ渕
図の7ダプテイブ・デジタル・フィルタの構成図、第3
図は第1図の2次ΔΣ変調回路の構成図、第4図及び第
5図は第1図のD/A変換機及び加算回路の第−及び第
二の構成図、第6図は第1図の2次ΔL変調回路の第二
の構成図、第7図は従来例及び本発明のエコーキャンセ
ラの残留エコーのシミューレー、ジョン結果、i8図は
本発明の第−及び第二の実施例のボーレートサンプル点
外の残留エコーのシミュレーション結果、第9図は従来
のエコーキャンセラのブロック図、第1O図は第9図の
アダプティブ・デジタル・フィルタの構成図である。 1・・・・・・遅延回路、2・・・・・D/A変換回路
、3・・・・・・ローパス・フィルタ、4・・・・・・
ライン・ドライバ、5・・・・・・バランシング・ネッ
トワーク、6・・・・・アダプティブ・デジタル・フィ
ルタ、7・・・・・・2次ΔΣ変調回路、8・・・・・
・D/A変換回路、9・・・・・・加算回路、10・・
・・・・ローパス・フィルタ、11・・・・・・加算回
路、12・・・・・・2次ΔΣA/D変換回路、13・
・・・・・デジタル・ローパス・フィルタ、14・・・
・・線路等化回路、15・・・・・・単位遅延回路(記
号:T)、16・・・・・・乗算回路(記号:X)、1
7・・・・・・積分回路(記号:■)、18・・・・・
・加算回路(記号:十)、19.20・・・・・・積分
回路、21・・・・・・量子化回路、22・・・・・・
単位遅延回路、23.24・・・・・・加算回路、25
.37・・・・・・スイッチ、38.41・・・・・容
量、42・・・・・・演算増幅器、43・・・・・・イ
ンバータ、44.45・・・・・・ANDゲート、46
.68・・・・・・スイッチ、69.75・・・・・・
容量、76.77・・・・・・演’l増幅器、78・・
・・・・コンパレータ、79・・・・・スイッチ制御回
路、80・・・・・・インバータ、81.82・・・・
・・ANDゲート、A・・・・・・デジタル・ローパス
・フィルタ、B・・・・・・2次ΔΣ変調回路、83・
・・・・・遅延回路、84・・・・・・D/A変換回路
、85・・・・・・ロパス・フィルタ、86・・・・・
・ライン・ドライバ、87・・・・・・バランシング・
ネットワーク、88・・・・・・加算回路、89・・・
・・・ローパス・フィルタ、90・・・・・・A/D変
換回路、91・・・・・・デジタル・ローパス・フィル
タ、92・・・・・・加算回路、93・・・・・・線路
等化回路、94・・・・・・アダプティブ・デジタル・
フィルタ、95・・・・・・スイッチ、96・・・・・
・単位遅延回路(記号:T)、97・・・・・・乗算回
路(記号:X)、98・・・・・・積分回路(記号:工
)、99・・・・・・加算回路(記号:十)。 代理人 弁理士 内 原 晋 1’1lLJ迫ρ”l& 2:”9A質jナコ#
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バ 5.バラシシン2′・半1.I−ワーフ j!、
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Claims (1)
- 送信信号とエコーキャンセラ後の受信信号の相関を取り
その結果を用いてアダプティブ・デジタル・フィルタの
タップ係数を適応可変するエコー・キャンセラにおいて
、該アダプティブ・デジタル・フィルタの出力信号を該
アダプティブ・デジタル・フィルタの動作周波数の整数
倍でサンプリングしデルタ・シグマ変調を行う変調回路
と、該変調回路出力を入力とするD/A変換回路と、該
D/A変換回路の出力と受信信号を加算する加算回路を
有する事を特徴とするエコーキャンセラ。
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Application Number | Priority Date | Filing Date | Title |
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EP91110190A EP0464500B1 (en) | 1990-06-25 | 1991-06-20 | Echo canceler having adaptive digital filter unit associated with delta-sigma modulation circuit |
CA002045250A CA2045250C (en) | 1990-06-25 | 1991-06-21 | Echo canceler having adaptive digital filter unit associated with delta-sigma modulation circuit |
US07/720,321 US5222084A (en) | 1990-06-25 | 1991-06-25 | Echo canceler having adaptive digital filter unit associated with delta-sigma modulation circuit |
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Publication Number | Publication Date |
---|---|
JPH0454718A true JPH0454718A (ja) | 1992-02-21 |
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ID=15821314
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---|---|---|---|
JP16590990A Expired - Fee Related JP3158414B2 (ja) | 1990-06-25 | 1990-06-25 | エコーキャンセラ |
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EP (1) | EP0464500B1 (ja) |
JP (1) | JP3158414B2 (ja) |
CA (1) | CA2045250C (ja) |
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