JPH04306016A - プログラム可能な反時限遅延回路 - Google Patents
プログラム可能な反時限遅延回路Info
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- JPH04306016A JPH04306016A JP3197074A JP19707491A JPH04306016A JP H04306016 A JPH04306016 A JP H04306016A JP 3197074 A JP3197074 A JP 3197074A JP 19707491 A JP19707491 A JP 19707491A JP H04306016 A JPH04306016 A JP H04306016A
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- JP
- Japan
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- voltage
- magnitude
- input
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- 238000000034 method Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 6
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 101000582320 Homo sapiens Neurogenic differentiation factor 6 Proteins 0.000 description 1
- 102100030589 Neurogenic differentiation factor 6 Human genes 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
- H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
- H02H3/02—Details
- H02H3/027—Details with automatic disconnection after a predetermined time
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06J—HYBRID COMPUTING ARRANGEMENTS
- G06J1/00—Hybrid computing arrangements
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
- H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
- H02H3/00—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection
- H02H3/006—Calibration or setting of parameters
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- Engineering & Computer Science (AREA)
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- Theoretical Computer Science (AREA)
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- Measuring Or Testing Involving Enzymes Or Micro-Organisms (AREA)
- Medicines That Contain Protein Lipid Enzymes And Other Medicines (AREA)
- Measurement Of Current Or Voltage (AREA)
- Relay Circuits (AREA)
- Electronic Switches (AREA)
- Breakers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は電気及び電子装置の保護
回路に関し、さらに詳細には電力スイッチング装置を保
護するため過電流または過電圧故障状態を検知するため
の反時限遅延回路に関する。
回路に関し、さらに詳細には電力スイッチング装置を保
護するため過電流または過電圧故障状態を検知するため
の反時限遅延回路に関する。
【０００２】
【従来の技術】単相または多相交流電圧装置または直流
電圧装置のような電力装置は、配線及び負荷の電流容量
により制限されるある範囲の条件に亘って作動する必要
がある。ソリッドステート電力コントローラのような保
護装置は、これらの電圧装置の過電流または過電圧状態
を検知して種々の装置のコンポーネントを必要に応じて
隔離または再接続するよう動作しなければならない。
電圧装置のような電力装置は、配線及び負荷の電流容量
により制限されるある範囲の条件に亘って作動する必要
がある。ソリッドステート電力コントローラのような保
護装置は、これらの電圧装置の過電流または過電圧状態
を検知して種々の装置のコンポーネントを必要に応じて
隔離または再接続するよう動作しなければならない。
【０００３】かかる保護装置は、感知した過電圧または
過電流状態に応答してスイッチング装置の動作を制御す
るトリップ回路を備えることがあり、下式で与えられる
トリップ時間対入力特性を有する反時限遅延回路を含む
。
過電流状態に応答してスイッチング装置の動作を制御す
るトリップ回路を備えることがあり、下式で与えられる
トリップ時間対入力特性を有する反時限遅延回路を含む
。
【０００４】
【数１】
上式において、Ｔはその回路のトリップ時間、Ｘは電圧
または電流を表わす入力信号の大きさ、Ａ、Ｂ、Ｃは定
数である。上式（１）に従うトリップ時間を有する反時
限トリップ回路は、１９７２年１０月１０日発行の米国
特許第３，６９７，８１３号明細書に記載がある。その
回路の第１の基準電圧レベルである定数Ｂはその回路の
即時トリップ時間を決定し、また第２の基準電圧レベル
である定数Ｃはトリップ時間が無限に近付く場合の極限
トリップ時間を決定する。定数Ａは、即時トリップ時間
と極限トリップ時間との間の間隔を調整するスケール係
数である。
または電流を表わす入力信号の大きさ、Ａ、Ｂ、Ｃは定
数である。上式（１）に従うトリップ時間を有する反時
限トリップ回路は、１９７２年１０月１０日発行の米国
特許第３，６９７，８１３号明細書に記載がある。その
回路の第１の基準電圧レベルである定数Ｂはその回路の
即時トリップ時間を決定し、また第２の基準電圧レベル
である定数Ｃはトリップ時間が無限に近付く場合の極限
トリップ時間を決定する。定数Ａは、即時トリップ時間
と極限トリップ時間との間の間隔を調整するスケール係
数である。
【０００５】上式（１）に従うトリップ時間を有する別
のトリップ回路が、１９８１年１月１３日発行の米国特
許第４，２４５，１８４号明細書の第２図のブロック３
８に示されている。この回路は、過負荷状態を表わす信
号と基準信号を受信して過電流信号と基準信号との間の
差の積分に比例する制御信号を発生する非反転積分器を
有する。この制御信号はさらに別の基準信号と比較され
て、制御信号の大きさが第２の基準信号の大きさを超え
ると論理状態を変化させるトリップ信号が発生する。
のトリップ回路が、１９８１年１月１３日発行の米国特
許第４，２４５，１８４号明細書の第２図のブロック３
８に示されている。この回路は、過負荷状態を表わす信
号と基準信号を受信して過電流信号と基準信号との間の
差の積分に比例する制御信号を発生する非反転積分器を
有する。この制御信号はさらに別の基準信号と比較され
て、制御信号の大きさが第２の基準信号の大きさを超え
ると論理状態を変化させるトリップ信号が発生する。
【０００６】かかる回路は所望の反時限遅延トリップ信
号を与えるが、ただ一組の動作パラメータに適応するよ
う設計されているに過ぎない。従って、種々の動作仕様
に適応させるには多数のこのような回路を設ける必要が
ある。したがって、ある範囲の動作条件に亘り満足な動
作が可能な反時限遅延トリップ回路を考案してかかる回
路の必要な在庫量を減らすことが望まれる。
号を与えるが、ただ一組の動作パラメータに適応するよ
う設計されているに過ぎない。従って、種々の動作仕様
に適応させるには多数のこのような回路を設ける必要が
ある。したがって、ある範囲の動作条件に亘り満足な動
作が可能な反時限遅延トリップ回路を考案してかかる回
路の必要な在庫量を減らすことが望まれる。
【０００７】本発明による反時限遅延回路は、外部回路
の電圧または電流を表わす信号を受信する第１の入力と
基準信号を受信する第２の入力とを有し、第１と第２の
入力の信号間の差の積分を表わす制御信号を発生する積
分器を有する。制御信号を受信してそれを第２の基準信
号と比較することにより、制御信号の大きさが第２の基
準信号を超えると論理状態を変化させる出力信号を発生
するよう接続した比較器を用いる。第１の基準信号また
は第２の基準信号もしくはその両方の大きさを制御する
プログラム手段を用いるため、即時トリップ時間、極限
トリップ時間またはその両方のトリップ時間を共に、若
しくはそれぞれ独立に制御することが可能となって、広
い範囲の動作条件に亘り動作可能な反時限遅延回路が提
供される。
の電圧または電流を表わす信号を受信する第１の入力と
基準信号を受信する第２の入力とを有し、第１と第２の
入力の信号間の差の積分を表わす制御信号を発生する積
分器を有する。制御信号を受信してそれを第２の基準信
号と比較することにより、制御信号の大きさが第２の基
準信号を超えると論理状態を変化させる出力信号を発生
するよう接続した比較器を用いる。第１の基準信号また
は第２の基準信号もしくはその両方の大きさを制御する
プログラム手段を用いるため、即時トリップ時間、極限
トリップ時間またはその両方のトリップ時間を共に、若
しくはそれぞれ独立に制御することが可能となって、広
い範囲の動作条件に亘り動作可能な反時限遅延回路が提
供される。
【０００８】以下、添付図面を参照して本発明を実施例
につき詳細に説明する。
につき詳細に説明する。
【０００９】
【実施例】図１は、本発明による反時限遅延回路の第１
実施例の概略図である。この回路は、演算増幅器Ｕ１、
キャパシタＣ、抵抗Ｒ１、Ｒ２よりなる積分器１０を有
する。外部回路の電圧または電流信号を表わす信号Ｖｓ
はスケール回路１２によりスケール係数Ｋの倍数に逓倍
され、演算増幅器Ｕ１の非反転入力に印加される。第１
の基準信号Ｖ１は演算増幅器Ｕ１の反転入力に送られる
。この結果、演算増幅器Ｕ１の反転及び非反転入力の信
号間の差の積分を表わす制御信号がライン１４上に発生
する。比較器Ｕ２は、ライン１４上の制御信号を受信し
てこれを第２の基準信号Ｖ２と比較することにより、制
御信号の大きさが第２の基準信号の大きさを超えると論
理低レベルから論理高レベルへ変化する出力信号Ｓを発
生させる。図１の回路は、上式（１）にしたがってトリ
ップ時間Ｔで出力信号Ｓの論理状態を変化させる。上式
（１）の定数Ａ、Ｂ、Ｃは、図１の回路のパラメーター
にしたがって以下のように決定することが可能である。 Ｘ＝Ｂ＝ＫＶｓである即時トリップレベルでは、
実施例の概略図である。この回路は、演算増幅器Ｕ１、
キャパシタＣ、抵抗Ｒ１、Ｒ２よりなる積分器１０を有
する。外部回路の電圧または電流信号を表わす信号Ｖｓ
はスケール回路１２によりスケール係数Ｋの倍数に逓倍
され、演算増幅器Ｕ１の非反転入力に印加される。第１
の基準信号Ｖ１は演算増幅器Ｕ１の反転入力に送られる
。この結果、演算増幅器Ｕ１の反転及び非反転入力の信
号間の差の積分を表わす制御信号がライン１４上に発生
する。比較器Ｕ２は、ライン１４上の制御信号を受信し
てこれを第２の基準信号Ｖ２と比較することにより、制
御信号の大きさが第２の基準信号の大きさを超えると論
理低レベルから論理高レベルへ変化する出力信号Ｓを発
生させる。図１の回路は、上式（１）にしたがってトリ
ップ時間Ｔで出力信号Ｓの論理状態を変化させる。上式
（１）の定数Ａ、Ｂ、Ｃは、図１の回路のパラメーター
にしたがって以下のように決定することが可能である。 Ｘ＝Ｂ＝ＫＶｓである即時トリップレベルでは、
【００
１０】
１０】
【数２】
【００１１】
【数３】
【００１２】
【数４】
【００１３】
【数５】
Ｘ＝Ｃである極限トリップレベルでは、
【００１４】
【数６】
【００１５】
【数７】
式（５）及び（７）は図１の回路の設計及び分析に用い
ることができる。これらの式を分析すると、即時トリッ
プレベルは第２の基準信号Ｖ２の大きさにより決まるこ
とが分かる。デジタル−アナログコンバータ１６を用い
ると、ライン１８上のデジタルコマンド信号を受けてラ
イン２０上にプログラムされた基準電圧Ｖｐを発生させ
ることにより、信号Ｖ２の大きさをプログラムすること
が可能となる。このプログラムされた基準電圧は抵抗Ｒ
３、Ｒ４よりなる抵抗性分圧器に送られ、抵抗Ｒ３とＲ
４の間の接続点にその基準電圧Ｖ２が発生する。Ｒ３、
Ｒ４よりなる分圧器は、デジタル−アナログコンバータ
の典型的な出力範囲０−１０ボルトを必要なＶ２の値の
範囲にマッチさせる。
ることができる。これらの式を分析すると、即時トリッ
プレベルは第２の基準信号Ｖ２の大きさにより決まるこ
とが分かる。デジタル−アナログコンバータ１６を用い
ると、ライン１８上のデジタルコマンド信号を受けてラ
イン２０上にプログラムされた基準電圧Ｖｐを発生させ
ることにより、信号Ｖ２の大きさをプログラムすること
が可能となる。このプログラムされた基準電圧は抵抗Ｒ
３、Ｒ４よりなる抵抗性分圧器に送られ、抵抗Ｒ３とＲ
４の間の接続点にその基準電圧Ｖ２が発生する。Ｒ３、
Ｒ４よりなる分圧器は、デジタル−アナログコンバータ
の典型的な出力範囲０−１０ボルトを必要なＶ２の値の
範囲にマッチさせる。
【００１６】図２は、即時トリップレベル及び極限トリ
ップレベルの両方をプログラムできる本発明の別の実施
例の概略図である。
ップレベルの両方をプログラムできる本発明の別の実施
例の概略図である。
【００１７】この例では、直列に接続した抵抗Ｒ５とＲ
６よりなる第２の抵抗性分圧器を付加することにより、
抵抗Ｒ５とＲ６との間の接続点に第１の基準電圧信号Ｖ
１が現われるようにする。式（５）及び（７）は、定数
Ｂ及びＣがＶ１及びＶ２が共にＶｐと比例関係にある場
合共に変化することを示している。
６よりなる第２の抵抗性分圧器を付加することにより、
抵抗Ｒ５とＲ６との間の接続点に第１の基準電圧信号Ｖ
１が現われるようにする。式（５）及び（７）は、定数
Ｂ及びＣがＶ１及びＶ２が共にＶｐと比例関係にある場
合共に変化することを示している。
【００１８】図３は、極限トリップレベルＣがプログラ
ム可能な本発明のさらに別の実施例の概略図である。こ
れは、積分器１０の出力と比較器Ｕ２の非反転入力との
間に抵抗Ｒ７を接続し、さらにデジタル−アナログコン
バータ１６の出力と比較器Ｕ２の非反転入力との間に抵
抗Ｒ８を接続することにより実現できる。基準電圧Ｖ３
が比較器Ｕ２の反転入力に送られる。式（５）から、基
準信号Ｖ１の値を変化させると定数Ｂの値も変化するこ
とが分かる。Ｂの変化が望ましくない場合、第２の基準
信号Ｖ２をＶｐにより修正して即時トリップレベルＢを
Ｖｐの変化に無関係に、したがって定数Ｃの変化に無関
係にする必要がある。図３の回路では、抵抗Ｒ７、Ｒ８
の値は即時トリップレベルがプログラム電圧Ｖｐの大き
さとは無関係になるように選択する。抵抗Ｒ７、Ｒ８の
必要な比率は以下の式で与えられる。
ム可能な本発明のさらに別の実施例の概略図である。こ
れは、積分器１０の出力と比較器Ｕ２の非反転入力との
間に抵抗Ｒ７を接続し、さらにデジタル−アナログコン
バータ１６の出力と比較器Ｕ２の非反転入力との間に抵
抗Ｒ８を接続することにより実現できる。基準電圧Ｖ３
が比較器Ｕ２の反転入力に送られる。式（５）から、基
準信号Ｖ１の値を変化させると定数Ｂの値も変化するこ
とが分かる。Ｂの変化が望ましくない場合、第２の基準
信号Ｖ２をＶｐにより修正して即時トリップレベルＢを
Ｖｐの変化に無関係に、したがって定数Ｃの変化に無関
係にする必要がある。図３の回路では、抵抗Ｒ７、Ｒ８
の値は即時トリップレベルがプログラム電圧Ｖｐの大き
さとは無関係になるように選択する。抵抗Ｒ７、Ｒ８の
必要な比率は以下の式で与えられる。
【００１９】
【数８】
上式において、ρはＶ１とＶｐの比率である。従って、
Ｖ３は下式より導かれる。
Ｖ３は下式より導かれる。
【００２０】
【数９】
上式において、Ｖ２は図１の回路の設計において想定し
た基準値である。
た基準値である。
【００２１】図４は、図１、２、３の回路のプログラム
能力を示す一連の曲線である。曲線２２は、Ｖ２が予め
選択した一定値である場合における第１図の回路の動作
特性を示す。曲線２４は全体のトリップ特性を２倍に増
加させた結果を示すものである。極限トリップレベル及
び即時トリップレベルの両方が同じ量だけ増加している
ことがわかる。曲線２６は即時トリップレベルを２分の
１に減少させた結果を示す。極限トリップレベルには変
化のないことがわかる。曲線２８は、もとの即時トリッ
プレベルはそのままの状態で極限トリップレベルを２倍
に増加させた結果を示す。
能力を示す一連の曲線である。曲線２２は、Ｖ２が予め
選択した一定値である場合における第１図の回路の動作
特性を示す。曲線２４は全体のトリップ特性を２倍に増
加させた結果を示すものである。極限トリップレベル及
び即時トリップレベルの両方が同じ量だけ増加している
ことがわかる。曲線２６は即時トリップレベルを２分の
１に減少させた結果を示す。極限トリップレベルには変
化のないことがわかる。曲線２８は、もとの即時トリッ
プレベルはそのままの状態で極限トリップレベルを２倍
に増加させた結果を示す。
【００２２】図４の曲線により表わされる結果から、上
述した方法を用いるとトリップ特性を完全に柔軟にプロ
グラムできることがわかる。本発明による反時限遅延回
路は、プログラム可能な基準電圧レベルを用いることに
よりプログラム可能なトリップ特性を提供する。極限ト
リップレベル及び即時トリップレベルはそれぞれ独立に
プログラムすることが可能であり、必要な回路コンポー
ネントの値を計算により容易に求めることができる。
述した方法を用いるとトリップ特性を完全に柔軟にプロ
グラムできることがわかる。本発明による反時限遅延回
路は、プログラム可能な基準電圧レベルを用いることに
よりプログラム可能なトリップ特性を提供する。極限ト
リップレベル及び即時トリップレベルはそれぞれ独立に
プログラムすることが可能であり、必要な回路コンポー
ネントの値を計算により容易に求めることができる。
【００２３】本発明を現時点において好ましいと思われ
る実施例につき詳細に説明したが、当業者には本発明の
範囲から逸脱することなく種々の変形例及び設計変更が
想倒できることが明らかであろう。例えば、プログラム
可能な電圧基準レベルＶｐを与えるためにデジタル−ア
ナログコンバータを用いる例を示したが、電圧レベルＶ
ｐを調整するアナログ回路をデジタル−アナログコンバ
ータの代わりに用いてもよい。従って、頭書した特許請
求範囲はかかる変形例及び設計変更を包含するものと意
図されている。
る実施例につき詳細に説明したが、当業者には本発明の
範囲から逸脱することなく種々の変形例及び設計変更が
想倒できることが明らかであろう。例えば、プログラム
可能な電圧基準レベルＶｐを与えるためにデジタル−ア
ナログコンバータを用いる例を示したが、電圧レベルＶ
ｐを調整するアナログ回路をデジタル−アナログコンバ
ータの代わりに用いてもよい。従って、頭書した特許請
求範囲はかかる変形例及び設計変更を包含するものと意
図されている。
【図１】図１は、本発明の第１実施例の概略図である。
【図２】図２は、本発明の第２実施例の概略図である。
【図３】図３は、本発明の第３実施例の概略図である。
【図４】図４は、図１、図２及び図３の回路の動作を示
す一連の曲線を示す。
す一連の曲線を示す。
１０ 積分器
１２ スケール回路
１６ デジタル−アナログコンバータ１８ デジタ
ルコマンド信号
ルコマンド信号
Claims (4)
- 【請求項１】 外部回路の電圧または電流信号を表わ
す信号を受信する第１の入力と第１の基準信号を受信す
る第２の入力とを有し、第１と第２の入力における信号
間の差の積分を表わす制御信号を発生する積分器と、制
御信号を受信するよう接続した第１の入力と第２の基準
信号を受信するように接続した第２の入力とを有し、制
御信号の大きさが第２の基準信号を超えると論理状態を
変化させる出力信号を発生する比較器と、コマンド信号
に応答して第２の基準信号の大きさをプログラムする手
段とよりなり、前記プログラム手段は、コマンド信号を
受信して第１のプログラムされた基準電圧を発生するデ
ジタル−アナログコンバータと、互いに直列に接続した
第１及び第２の抵抗よりなる第１の分圧器とを有し、第
１の抵抗が第１のプログラムされた基準電圧を受けて第
１と第２の抵抗の接続点に第２の基準信号が発生するよ
うに接続してあることを特徴とする反時限遅延回路。 - 【請求項２】 第１の基準信号の大きさをプログラム
する手段をさらに備えてなることを特徴とする請求項１
に記載の反時限遅延回路。 - 【請求項３】 第１の基準信号の大きさをプログラム
する前記手段が、互いに直列に接続した第３及び第４の
抵抗よりなる第２の分圧器を有し、第３の抵抗が第１の
プログラムされた基準電圧を受けて第３と第４の抵抗の
接続点に第１の基準信号が発生するように接続してある
ことを特徴とする請求項２に記載の反時限遅延回路。 - 【請求項４】 外部回路の電圧または電流信号を表わ
す信号を受信する第１の入力と、第１の基準信号を受信
する第２の入力とを有し、第１と第２の入力の信号間の
差の積分を表わす制御信号を発生する積分器と、第１の
入力と第２の基準信号を受けるように接続した第２の入
力とを有する比較器と、コマンド信号に応答して第１の
基準信号の大きさをプログラムする手段とよりなり、第
１の基準信号の大きさをプログラムする前記手段が、コ
マンド信号を受信してプログラムされた基準信号を発生
する手段と、直列に接続した第１及び第２の抵抗よりな
る第１の分圧器とよりなり、第１の分圧器の第１の端部
がプログラムされた基準信号を受けるように接続され、
第１の分圧器の第２の端部が接地され、第１と第２の抵
抗の接続点に第１の基準信号が発生するように接続され
、さらに、直列に接続した第３及び第４の抵抗よりなる
第２の分圧器を有し、第２の分圧器の第１の端部がプロ
グラムされた基準電圧を受けるように接続され、第２の
分圧器の第２の端部が制御信号を受けるように接続され
、第３と第４の抵抗の接続点が比較器の第１の入力に接
続されていることを特徴とする反時限遅延回路。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US07/553,508 US5073724A (en) | 1990-07-18 | 1990-07-18 | Programmable inverse time delay circuit |
| US553508 | 1990-07-18 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04306016A true JPH04306016A (ja) | 1992-10-28 |
Family
ID=24209657
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3197074A Pending JPH04306016A (ja) | 1990-07-18 | 1991-07-11 | プログラム可能な反時限遅延回路 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5073724A (ja) |
| EP (1) | EP0467675A3 (ja) |
| JP (1) | JPH04306016A (ja) |
| CN (1) | CN1023365C (ja) |
| CA (1) | CA2046077A1 (ja) |
| TW (1) | TW215504B (ja) |
Families Citing this family (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2750015B2 (ja) * | 1991-04-23 | 1998-05-13 | 三菱電機株式会社 | 比較判定回路 |
| US5684466A (en) * | 1995-09-12 | 1997-11-04 | The Charles Machine Work, Inc. | Electrical strike system control for subsurface boring equipment |
| JPH11134972A (ja) * | 1997-10-28 | 1999-05-21 | Matsushita Electric Works Ltd | 遅れスイッチ |
| DE20109687U1 (de) * | 2001-06-13 | 2002-10-24 | Weidmüller Interface GmbH & Co., 32760 Detmold | Sicherungsschaltung für ein Gleichstrom abgebendes, geregeltes Netzgerät |
| DE10146509C2 (de) * | 2001-09-21 | 2003-07-31 | Infineon Technologies Ag | Integrierte Schaltung mit einer Eingangsschaltung |
| US7582986B2 (en) * | 2004-10-08 | 2009-09-01 | Schweitzer Engineering Laboratories, Inc. | Compensated inverse-time undervoltage load shedding systems |
| CN1851492B (zh) * | 2006-04-07 | 2011-05-04 | 福建师范大学 | 一种航标灯灯质测量的信号调理装置 |
| US7460441B2 (en) * | 2007-01-12 | 2008-12-02 | Microchip Technology Incorporated | Measuring a long time period |
| US7961485B2 (en) * | 2007-12-12 | 2011-06-14 | Semiconductor Components Industries, Llc | Method of forming a PWM controller and structure therefor |
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