JPH04273602A - 発振制御回路 - Google Patents
発振制御回路Info
- Publication number
- JPH04273602A JPH04273602A JP3454291A JP3454291A JPH04273602A JP H04273602 A JPH04273602 A JP H04273602A JP 3454291 A JP3454291 A JP 3454291A JP 3454291 A JP3454291 A JP 3454291A JP H04273602 A JPH04273602 A JP H04273602A
- Authority
- JP
- Japan
- Prior art keywords
- cmos inverter
- oscillation
- output
- circuit
- inverter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
- 230000010355 oscillation Effects 0.000 title claims abstract description 31
- 239000013078 crystal Substances 0.000 claims description 5
- 239000003990 capacitor Substances 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は発振制御回路に関する。
【０００２】
【従来の技術】ＣＭＯＳトランジスタを用いた水晶発振
回路の発振出力を後段に伝える場合、発振回路を構成す
る第１ＣＭＯＳインバ―タの出力に第２ＣＭＯＳインバ
ータを接続し、この第２ＣＭＯＳインバータの出力に後
段回路を接続している。この種の回路において、従来は
、第１ＣＭＯＳインバ―タの反転電位と第２ＣＭＯＳイ
ンバータの反転電位とは同一であった。
回路の発振出力を後段に伝える場合、発振回路を構成す
る第１ＣＭＯＳインバ―タの出力に第２ＣＭＯＳインバ
ータを接続し、この第２ＣＭＯＳインバータの出力に後
段回路を接続している。この種の回路において、従来は
、第１ＣＭＯＳインバ―タの反転電位と第２ＣＭＯＳイ
ンバータの反転電位とは同一であった。
【０００３】
【発明が解決しようとする課題】上記従来の回路では、
発振開始時における微少振幅の発振出力が第２ＣＭＯＳ
インバータで反転され、その反転出力により後段回路が
動作状態になる。したがって、後段回路で生じるノイズ
の影響で発振動作が不安定となり、微少振幅の発振動作
から通常振幅の発振動作への移行が妨げられるという問
題点があった。
発振開始時における微少振幅の発振出力が第２ＣＭＯＳ
インバータで反転され、その反転出力により後段回路が
動作状態になる。したがって、後段回路で生じるノイズ
の影響で発振動作が不安定となり、微少振幅の発振動作
から通常振幅の発振動作への移行が妨げられるという問
題点があった。
【０００４】本発明の目的は、発振開始時の微少振幅時
には後段回路が動作せず、振幅が一定以上の大きさにな
ってから後段回路が動作を開始する発振制御回路を提供
することである。
には後段回路が動作せず、振幅が一定以上の大きさにな
ってから後段回路が動作を開始する発振制御回路を提供
することである。
【０００５】
【課題を解決するための手段】本発明では、第１ＣＭＯ
Ｓインバータとこの第１ＣＭＯＳインバータに並列に接
続された水晶振動子とを有する発振回路と、第１ＣＭＯ
Ｓインバータからの発振出力を入力する第２ＣＭＯＳイ
ンバータとからなる回路において、第１ＣＭＯＳインバ
ータの反転電位と第２ＣＭＯＳインバータの反転電位と
を互いに異なったものにした。
Ｓインバータとこの第１ＣＭＯＳインバータに並列に接
続された水晶振動子とを有する発振回路と、第１ＣＭＯ
Ｓインバータからの発振出力を入力する第２ＣＭＯＳイ
ンバータとからなる回路において、第１ＣＭＯＳインバ
ータの反転電位と第２ＣＭＯＳインバータの反転電位と
を互いに異なったものにした。
【０００６】
【実施例】図１（Ａ）〜（Ｃ）は、本発明に係わる発振
制御回路の実施例を示したものである。
制御回路の実施例を示したものである。
【０００７】図１（Ａ）に示した各回路要素はつぎの通
りである。ＩＶ１は第１ＣＭＯＳインバータであり、図
１（Ｂ）に示すような入出力特性（伝達特性）を有して
おり、その反転電位（論理しきい電圧）は２．５ボルト
である。ここでいう反転電位とは、入出力特性における
立ち下がり開始入力電圧と立ち下がり終了入力電圧との
中点の入力電圧であり、通常は出力電圧が電源電圧（５
ボルト）の半分（２．５ボルト）のときの入力電圧であ
る。ＱＺ１は水晶振動子、Ｒ１は帰還抵抗、Ｃ１および
Ｃ２はコンデンサである。以上の回路要素により発振回
路が構成される。ＩＶ２は第２ＣＭＯＳインバータであ
り、図１（Ｃ）に示すような入出力特性を有しており、
その反転電位は２．０ボルトである。この第２ＣＭＯＳ
インバータＩＶ２の出力にはＣＭＯＳ構成の後段回路（
図示せず）が接続されている。なお、以上述べた回路は
同一のＩＣチップ内に収められている。
りである。ＩＶ１は第１ＣＭＯＳインバータであり、図
１（Ｂ）に示すような入出力特性（伝達特性）を有して
おり、その反転電位（論理しきい電圧）は２．５ボルト
である。ここでいう反転電位とは、入出力特性における
立ち下がり開始入力電圧と立ち下がり終了入力電圧との
中点の入力電圧であり、通常は出力電圧が電源電圧（５
ボルト）の半分（２．５ボルト）のときの入力電圧であ
る。ＱＺ１は水晶振動子、Ｒ１は帰還抵抗、Ｃ１および
Ｃ２はコンデンサである。以上の回路要素により発振回
路が構成される。ＩＶ２は第２ＣＭＯＳインバータであ
り、図１（Ｃ）に示すような入出力特性を有しており、
その反転電位は２．０ボルトである。この第２ＣＭＯＳ
インバータＩＶ２の出力にはＣＭＯＳ構成の後段回路（
図示せず）が接続されている。なお、以上述べた回路は
同一のＩＣチップ内に収められている。
【０００８】つぎに、本実施例の動作を図２を参照して
説明する。図２（Ａ）に示すように、電源投入により第
１ＣＭＯＳインバータＩＶ１からは微少振幅の発振出力
が生じる。この発振出力の振幅はしだいに増大するが、
図２（Ｂ）に示すように、その振幅が第２ＣＭＯＳイン
バータＩＶ２の反転電位（２．０ボルト）を越えるまで
は、第２ＣＭＯＳインバータＩＶ２の出力はローレベル
に保持される。第１ＣＭＯＳインバータＩＶ１の発振出
力が第２ＣＭＯＳインバータＩＶ２の反転電位（２．０
ボルト）を越えると、第２ＣＭＯＳインバータＩＶ２か
ら反転出力が生じ、後段回路が動作状態になる。後段回
路が動作することによりノイズが発生するが、このとき
には発振出力の振幅が十分大きくなっているので、発振
動作が妨げられることはない。
説明する。図２（Ａ）に示すように、電源投入により第
１ＣＭＯＳインバータＩＶ１からは微少振幅の発振出力
が生じる。この発振出力の振幅はしだいに増大するが、
図２（Ｂ）に示すように、その振幅が第２ＣＭＯＳイン
バータＩＶ２の反転電位（２．０ボルト）を越えるまで
は、第２ＣＭＯＳインバータＩＶ２の出力はローレベル
に保持される。第１ＣＭＯＳインバータＩＶ１の発振出
力が第２ＣＭＯＳインバータＩＶ２の反転電位（２．０
ボルト）を越えると、第２ＣＭＯＳインバータＩＶ２か
ら反転出力が生じ、後段回路が動作状態になる。後段回
路が動作することによりノイズが発生するが、このとき
には発振出力の振幅が十分大きくなっているので、発振
動作が妨げられることはない。
【０００９】なお、以上述べた実施例では第２ＣＭＯＳ
インバータＩＶ２の反転電位を第１ＣＭＯＳインバータ
ＩＶ１の反転電位よりも低くしたが、第２ＣＭＯＳイン
バータＩＶ２の反転電位を第１ＣＭＯＳインバータＩＶ
１の反転電位よりも高く（例えば３．０ボルト）しても
よい。
インバータＩＶ２の反転電位を第１ＣＭＯＳインバータ
ＩＶ１の反転電位よりも低くしたが、第２ＣＭＯＳイン
バータＩＶ２の反転電位を第１ＣＭＯＳインバータＩＶ
１の反転電位よりも高く（例えば３．０ボルト）しても
よい。
【００１０】
【発明の効果】本発明では、第１ＣＭＯＳインバータの
反転電位と第２ＣＭＯＳインバータの反転電位とを互い
に異なったものにしたため、第１ＣＭＯＳインバータの
発振出力の振幅が一定以上の大きさになってから後段回
路が動作を開始する。したがって、後段回路で生じるノ
イズの影響で発振動作が妨げられることがない。
反転電位と第２ＣＭＯＳインバータの反転電位とを互い
に異なったものにしたため、第１ＣＭＯＳインバータの
発振出力の振幅が一定以上の大きさになってから後段回
路が動作を開始する。したがって、後段回路で生じるノ
イズの影響で発振動作が妨げられることがない。
【図１】本発明に係わる発振制御回路の実施例を示した
ものである。
ものである。
【図２】図１の動作を説明したものである。
ＩＶ１……第１ＣＭＯＳインバータ
ＩＶ２……第２ＣＭＯＳインバータ
ＱＺ１……水晶振動子
Claims (1)
- 【請求項１】 第１ＣＭＯＳインバータとこの第１Ｃ
ＭＯＳインバータに並列に接続された水晶振動子とを有
する発振回路と、上記第１ＣＭＯＳインバータの反転電
位と異なった反転電位を有し、上記第１ＣＭＯＳインバ
ータからの発振出力を入力して上記発振回路の発振周波
数と同一周波数の信号を出力する第２ＣＭＯＳインバー
タとからなる発振制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3454291A JPH04273602A (ja) | 1991-02-28 | 1991-02-28 | 発振制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3454291A JPH04273602A (ja) | 1991-02-28 | 1991-02-28 | 発振制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04273602A true JPH04273602A (ja) | 1992-09-29 |
Family
ID=12417189
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3454291A Withdrawn JPH04273602A (ja) | 1991-02-28 | 1991-02-28 | 発振制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04273602A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002237723A (ja) * | 2001-02-08 | 2002-08-23 | Nippon Precision Circuits Inc | 発振制御回路 |
| JP2007104050A (ja) * | 2005-09-30 | 2007-04-19 | Mitsumi Electric Co Ltd | 発振回路 |
| JP2007295410A (ja) * | 2006-04-26 | 2007-11-08 | Interchip Kk | パルス信号発生器及びクロック信号発生器 |
-
1991
- 1991-02-28 JP JP3454291A patent/JPH04273602A/ja not_active Withdrawn
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002237723A (ja) * | 2001-02-08 | 2002-08-23 | Nippon Precision Circuits Inc | 発振制御回路 |
| JP2007104050A (ja) * | 2005-09-30 | 2007-04-19 | Mitsumi Electric Co Ltd | 発振回路 |
| JP2007295410A (ja) * | 2006-04-26 | 2007-11-08 | Interchip Kk | パルス信号発生器及びクロック信号発生器 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19980514 |