JPH04230033A - 半導体装置の製造およびパッシベーション方法 - Google Patents
半導体装置の製造およびパッシベーション方法Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は、拡散マスク層の付着お
よびフォトリソグラフパターン化の後に、不純物原子が
ドープされた領域を形成するために拡散され、その基体
に対する境界面がp−n接合を形成し、拡散マスク層ま
たはパッシベーション層の付着に先立つて、基体表面は
プラズマに露出されることによって前処理される化合物
半導体基体上の装置領域を形成しパッシベーションする
方法に関する。
よびフォトリソグラフパターン化の後に、不純物原子が
ドープされた領域を形成するために拡散され、その基体
に対する境界面がp−n接合を形成し、拡散マスク層ま
たはパッシベーション層の付着に先立つて、基体表面は
プラズマに露出されることによって前処理される化合物
半導体基体上の装置領域を形成しパッシベーションする
方法に関する。
【0002】
【従来の技術】III−V族化合物半導体の場合、製造
過程中、半導体表面上に形成する自然発生(nativ
e)酸化物層は、そのような半導体から構成される装置
の電気特性が理論的に予測されるほど良くない、或いは
望ましくない理由であることが以前から知られている。
過程中、半導体表面上に形成する自然発生(nativ
e)酸化物層は、そのような半導体から構成される装置
の電気特性が理論的に予測されるほど良くない、或いは
望ましくない理由であることが以前から知られている。
【0003】
【発明が解決しようとする課題】例えば、文献(“Ap
pl.Phys.Lett. ”48 (15),19
86, 978 乃至980 頁)に記載されているよ
うに、III−V族化合物半導体材料から製造された電
界効果トランジスタのドレイン電流は安定ではない。ま
た、そのような半導体材料から製造されたフォトダイオ
ードでは、非常に高い暗電流が測定され、光電子装置用
において不所望な雑音ソースを示す。 この暗電流の減少は欧州特許出願128 724 号の
発明の目的とされている。
pl.Phys.Lett. ”48 (15),19
86, 978 乃至980 頁)に記載されているよ
うに、III−V族化合物半導体材料から製造された電
界効果トランジスタのドレイン電流は安定ではない。ま
た、そのような半導体材料から製造されたフォトダイオ
ードでは、非常に高い暗電流が測定され、光電子装置用
において不所望な雑音ソースを示す。 この暗電流の減少は欧州特許出願128 724 号の
発明の目的とされている。
【0004】多くの著者はIII−V族化合物半導体装
置の製造中に自然発生酸化物層の不所望な影響を抑制す
る方法を提案している。これは普通自然発生酸化物層の
形成を阻止するか或いは少なくとも減少させるか、或い
は絶縁層またはパッシベーション層の付着の前に自然発
生酸化物層を選択的に除去することによって行われる。
置の製造中に自然発生酸化物層の不所望な影響を抑制す
る方法を提案している。これは普通自然発生酸化物層の
形成を阻止するか或いは少なくとも減少させるか、或い
は絶縁層またはパッシベーション層の付着の前に自然発
生酸化物層を選択的に除去することによって行われる。
【0005】LeuvenでのINFOS 1987
年3 月12日から14日の会議で発表され、本発明に
最も近いP.Boher 氏他による文献では、水素プ
ラズマの作用による自然発生酸化物層の除去が記載され
ている。しかし、物質表面は製造された直後に窒化ケイ
素(Si3 N4 )で被覆されたが、Si3 N4
による被覆前の薄い自然発生酸化物層の形成は阻止する
ことが不可能である。
年3 月12日から14日の会議で発表され、本発明に
最も近いP.Boher 氏他による文献では、水素プ
ラズマの作用による自然発生酸化物層の除去が記載され
ている。しかし、物質表面は製造された直後に窒化ケイ
素(Si3 N4 )で被覆されたが、Si3 N4
による被覆前の薄い自然発生酸化物層の形成は阻止する
ことが不可能である。
【0006】この方法は予想されるように半導体装置の
電気的特性を改良するが、この改良はまだ不十分である
。
電気的特性を改良するが、この改良はまだ不十分である
。
【0007】したがって、本発明の目的は、半導体装置
を製造するのに必要な拡散マスクおよびパッシベーショ
ン層が装置の電気的特性を劣化するような半導体表面に
悪影響を与えることなく付着されることができるような
上述の方法を提供することである。
を製造するのに必要な拡散マスクおよびパッシベーショ
ン層が装置の電気的特性を劣化するような半導体表面に
悪影響を与えることなく付着されることができるような
上述の方法を提供することである。
【0008】
【課題を解決するための手段】この目的は、前記のよう
な方法においてプラズマが少なくとも1つのハロゲンと
炭素の化合物を含む雰囲気中で励起されることによって
達成される。
な方法においてプラズマが少なくとも1つのハロゲンと
炭素の化合物を含む雰囲気中で励起されることによって
達成される。
【0009】プラズマ作用でのハロゲンと炭素の化合物
による半導体表面の前処理はp−n接合逆電流の顕著な
減少を生じさせる。例えば、本発明により前処理された
表面を有するpinダイオードは非常に低い暗電流を有
する。したがって表面劣化によるアバランシェフォトダ
イオード(APD)のエッジ絶縁破壊は生じない。
による半導体表面の前処理はp−n接合逆電流の顕著な
減少を生じさせる。例えば、本発明により前処理された
表面を有するpinダイオードは非常に低い暗電流を有
する。したがって表面劣化によるアバランシェフォトダ
イオード(APD)のエッジ絶縁破壊は生じない。
【0010】しかし、従来技術とは異なり、これらの利
点は本質的に保持される自然発生酸化物層の除去ではな
く、直接のプラズマ作用に対する層の次の付着中に半導
体および自然発生酸化物層を保護する薄層(恐らくポリ
マー層である)の形成に基づくものである。
点は本質的に保持される自然発生酸化物層の除去ではな
く、直接のプラズマ作用に対する層の次の付着中に半導
体および自然発生酸化物層を保護する薄層(恐らくポリ
マー層である)の形成に基づくものである。
【0011】本発明による方法の好ましい実施例では、
CF4 がハロゲンと炭素の化合物として使用される。 この化合物は良好な結果をもたらし、表面前処理に使用
された多くのフッ化水素酸含有エッチング液と同じハロ
ゲンを含む利点を有する。
CF4 がハロゲンと炭素の化合物として使用される。 この化合物は良好な結果をもたらし、表面前処理に使用
された多くのフッ化水素酸含有エッチング液と同じハロ
ゲンを含む利点を有する。
【0012】本発明の別の実施態様は、プラズマの生成
(普通の平行板反応装置を使用することが好ましい)お
よび本発明による方法により使用するのに特に適してい
る半導体と絶縁層の組合わせに関する。
(普通の平行板反応装置を使用することが好ましい)お
よび本発明による方法により使用するのに特に適してい
る半導体と絶縁層の組合わせに関する。
【0013】
【実施例】図1の(a)はn型リン化インジウム(In
P)およびその上に付着されたn型ヒ化インジウムガリ
ウム(InGaAs)の2層基体Sを示す。例えば、Z
nまたはCdはp型領域を形成するためにこの基体Sに
拡散されるので、この基体SはSiOx 、SiNy
、またはSiOx Ny の絶縁層で被覆される。予め
定められた形状および面積の開口Lはこの領域を限定す
るためにフォトリソグラフ技術によって形成されている
。したがって、この絶縁層は拡散マスクとなる。
P)およびその上に付着されたn型ヒ化インジウムガリ
ウム(InGaAs)の2層基体Sを示す。例えば、Z
nまたはCdはp型領域を形成するためにこの基体Sに
拡散されるので、この基体SはSiOx 、SiNy
、またはSiOx Ny の絶縁層で被覆される。予め
定められた形状および面積の開口Lはこの領域を限定す
るためにフォトリソグラフ技術によって形成されている
。したがって、この絶縁層は拡散マスクとなる。
【0014】図1の(b)は拡散によって形成されたp
型領域Pおよびそのp型領域Pとn型基体の間のp−n
接合を有する基体Sを示す。
型領域Pおよびそのp型領域Pとn型基体の間のp−n
接合を有する基体Sを示す。
【0015】図1の(c)は付着された金属接触Kと、
光入射面上の反射防止層Aと、拡散マスクの除去後、基
体の上方のn型およびp型領域を被覆するパッシベーシ
ョン層PSを有する完成したpinダイオードを示す。
光入射面上の反射防止層Aと、拡散マスクの除去後、基
体の上方のn型およびp型領域を被覆するパッシベーシ
ョン層PSを有する完成したpinダイオードを示す。
【0016】異なる製造段階における図1の(a)乃至
(c)に示された装置は種々の方法によって生成される
ことが可能である。個々の半導体および絶縁層は例えば
スパッタリングまたは化学蒸着(CVD)によって付着
される。後者の方法はその化学反応が熱、プラズマまた
は短波長光のいずれによって生じるかに依存する熱CV
D、プラズマ強化CVD(PECVD)、または光子援
助CVDとして知られている。
(c)に示された装置は種々の方法によって生成される
ことが可能である。個々の半導体および絶縁層は例えば
スパッタリングまたは化学蒸着(CVD)によって付着
される。後者の方法はその化学反応が熱、プラズマまた
は短波長光のいずれによって生じるかに依存する熱CV
D、プラズマ強化CVD(PECVD)、または光子援
助CVDとして知られている。
【0017】図1の(a)乃至(c)に示される通常に
製造された装置は不十分な電気特性、特に非常に高い逆
電流(暗電流)を有する。ここでは説明しない種々の研
究において、この不十分な原因はp−n接合の区域中の
半導体表面に対する損傷であることがわかった。この損
傷は拡散マスクまたはパッシベーション層の付着中に半
導体表面上に存在する自然発生酸化物層の作用によって
明らかに生じられる。
製造された装置は不十分な電気特性、特に非常に高い逆
電流(暗電流)を有する。ここでは説明しない種々の研
究において、この不十分な原因はp−n接合の区域中の
半導体表面に対する損傷であることがわかった。この損
傷は拡散マスクまたはパッシベーション層の付着中に半
導体表面上に存在する自然発生酸化物層の作用によって
明らかに生じられる。
【0018】本発明による方法すなわちプラズマ強化C
VD方法はこの種の通常の方法とは異なる。本発明にお
いては、拡散マスクとして機能する絶縁層またはパッシ
ベーション層の付着より前に、被覆されるべき表面はハ
ロゲン炭素プラズマで前処理される。これために、被覆
されるべき基体表面は希釈されたフッ化水素酸で清浄に
された後に市販のPECVD平行板反応装置中に配置さ
れ約200 ℃の温度まで加熱される。その後に、0.
8 mbの圧力のCF4 雰囲気が入口と出口の接続に
よって反応装置中に生成され、プラズマがRF電圧を反
応装置の電極板に供給することによって生成される。
VD方法はこの種の通常の方法とは異なる。本発明にお
いては、拡散マスクとして機能する絶縁層またはパッシ
ベーション層の付着より前に、被覆されるべき表面はハ
ロゲン炭素プラズマで前処理される。これために、被覆
されるべき基体表面は希釈されたフッ化水素酸で清浄に
された後に市販のPECVD平行板反応装置中に配置さ
れ約200 ℃の温度まで加熱される。その後に、0.
8 mbの圧力のCF4 雰囲気が入口と出口の接続に
よって反応装置中に生成され、プラズマがRF電圧を反
応装置の電極板に供給することによって生成される。
【0019】半導体表面が約1分間CF4 プラズマに
露出された後に、CF4 は絶縁層またはパッシベーシ
ョン層を積層するのに必要な他の反応ガス(例えば、S
iH4 、N2 O、N2 )と置換され、基体は約6
、7分間被覆される。形成された層は反応ガスの組成に
依存してSiO2 、Si3 N4 、またはSiOx
Ny から構成されることができる。
露出された後に、CF4 は絶縁層またはパッシベーシ
ョン層を積層するのに必要な他の反応ガス(例えば、S
iH4 、N2 O、N2 )と置換され、基体は約6
、7分間被覆される。形成された層は反応ガスの組成に
依存してSiO2 、Si3 N4 、またはSiOx
Ny から構成されることができる。
【0020】この方法によって製造されたフォトダイオ
ードの電気的特性は通常の方法によって形成されたその
ような装置の値と比較して大いに改良される。図2は、
以上説明された方法によってInGaAsおよびInP
に製造されたプレーナ型pinダイオードの暗電流特性
を示し、図の(I)はInPの場合であり、(II)は
InGaAsの場合である。これらの特性が示されるよ
うに、上述の方法はInGaAsおよびInPの両基体
上の絶縁層またはパッシベーション層の付着中に半導体
表面に対する損傷を避けるのに適しているので、良好で
安定な電気的特性を有する装置の製造を可能にする。
ードの電気的特性は通常の方法によって形成されたその
ような装置の値と比較して大いに改良される。図2は、
以上説明された方法によってInGaAsおよびInP
に製造されたプレーナ型pinダイオードの暗電流特性
を示し、図の(I)はInPの場合であり、(II)は
InGaAsの場合である。これらの特性が示されるよ
うに、上述の方法はInGaAsおよびInPの両基体
上の絶縁層またはパッシベーション層の付着中に半導体
表面に対する損傷を避けるのに適しているので、良好で
安定な電気的特性を有する装置の製造を可能にする。
【0021】上述の方法はpinフォトダイオードおよ
びプレーナ型装置に限定されない。図3は表面が本発明
の方法によって前処理された後に、SiNxのパッシベ
ーション層ISが付着されることが可能なプレーナ型2
重ヘテロ接合APDの構造を示している。図における符
号n、pは材料の化学組成によって示された半導体領域
内のドーパントの極性を示し、上付きの符号+、−はド
ーpinグレベル(+=強、−=弱、符号なし=普通)
を示す。図4は本発明の方法によって付着されたパッシ
ベーション層PSを有するメサpinダイオードを示し
ている。
びプレーナ型装置に限定されない。図3は表面が本発明
の方法によって前処理された後に、SiNxのパッシベ
ーション層ISが付着されることが可能なプレーナ型2
重ヘテロ接合APDの構造を示している。図における符
号n、pは材料の化学組成によって示された半導体領域
内のドーパントの極性を示し、上付きの符号+、−はド
ーpinグレベル(+=強、−=弱、符号なし=普通)
を示す。図4は本発明の方法によって付着されたパッシ
ベーション層PSを有するメサpinダイオードを示し
ている。
【図1】製造の異なる段階の通常のInGaAsInP
のプレーナ型pinフォトダイオードの概略図。
のプレーナ型pinフォトダイオードの概略図。
【図2】本発明の方法によってInGaAsおよびIn
Pに製造されたプレーナ型pinダイオードの暗電流特
性のグラフ図。
Pに製造されたプレーナ型pinダイオードの暗電流特
性のグラフ図。
【図3】表面が本発明の方法によって前処理された後に
、SiNx のパッシベーション層が付着されることが
可能なプレーナ型2重ヘテロ接合APD構造の概略図。
、SiNx のパッシベーション層が付着されることが
可能なプレーナ型2重ヘテロ接合APD構造の概略図。
【図4】本発明の方法によって付着されたパッシベーシ
ョン層PSを有するメサpinダイオードの概略図。
ョン層PSを有するメサpinダイオードの概略図。
S…基体、PS…パッシベーション層、K…金属接触、
A…反射防止層。
A…反射防止層。
Claims (4)
- 【請求項1】 拡散マスク層の付着およびフォトリソ
グラフパターン化の後に、不純物原子がドープされた領
域を形成するために拡散され、その基体に対する境界面
がp−n接合を形成し、拡散マスク層またはパッシベー
ション層の付着に先立つて、基体表面はプラズマに露出
されることによって前処理される化合物半導体基体上の
装置領域を形成しパッシベーションする方法において、
プラズマは少なくとも1つのハロゲンと炭素の化合物を
含む雰囲気中で励起されることを特徴とする方法。 - 【請求項2】 ハロゲンと炭素の化合物は4フッ化炭
素(CF4 )であることを特徴とする請求項1記載の
方法。 - 【請求項3】 基体表面の前処理および拡散マスク層
またはパッシベーション層の付着はPECVD平行板反
応装置中で直接連続的に実行することを特徴とする請求
項1または2記載の方法。 - 【請求項4】 化合物半導体はリン化インジウム(I
nP)、ヒ化インジウムガリウム(InGaAs)、ヒ
化リン化インジウムガリウム(InGaAsP)、ヒ化
インジウムアルミニウム(InAlAs)、またはヒ化
インジウムガリウムアルミニウム(InGaAlAs)
であり、拡散マスク層またはパッシベーション層は二酸
化ケイ素(SiO2 )、窒化ケイ素(Six Ny
)、または酸化窒化ケイ素(SiOx Ny )から構
成されていることを特徴とする請求項1乃至3のいずれ
か1項記載の方法。
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE4017870:6 | 1990-06-02 | ||
DE4017870A DE4017870A1 (de) | 1990-06-02 | 1990-06-02 | Verfahren zur herstellung und passivierung von halbleiterbauelementen |
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Publication Number | Publication Date |
---|---|
JPH04230033A true JPH04230033A (ja) | 1992-08-19 |
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Family
ID=6407742
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15247991A Expired - Fee Related JP3207869B2 (ja) | 1990-06-02 | 1991-05-28 | 半導体装置の製造およびパッシベーション方法 |
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---|---|
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EP (1) | EP0464372B1 (ja) |
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---|---|---|---|---|
US5593902A (en) * | 1994-05-23 | 1997-01-14 | Texas Instruments Incorporated | Method of making photodiodes for low dark current operation having geometric enhancement |
US5888890A (en) * | 1994-08-12 | 1999-03-30 | Lg Semicon Co., Ltd. | Method of manufacturing field effect transistor |
US20040241948A1 (en) * | 2003-05-29 | 2004-12-02 | Chun-Feng Nieh | Method of fabricating stacked gate dielectric layer |
DE10359371A1 (de) * | 2003-12-18 | 2005-07-28 | Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung e.V. | Passivierte Endoberflächen |
US10020187B2 (en) | 2012-11-26 | 2018-07-10 | Applied Materials, Inc. | Apparatus and methods for backside passivation |
DE102018124576A1 (de) * | 2018-10-05 | 2020-04-09 | Osram Opto Semiconductors Gmbh | Verfahren zur herstellung eines halbleiterbauelements mit durchführung einer plasmabehandlung und halbleiterbauelement |
US10666353B1 (en) * | 2018-11-20 | 2020-05-26 | Juniper Networks, Inc. | Normal incidence photodetector with self-test functionality |
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---|---|---|---|---|
US3969164A (en) * | 1974-09-16 | 1976-07-13 | Bell Telephone Laboratories, Incorporated | Native oxide technique for preparing clean substrate surfaces |
US4246296A (en) * | 1979-02-14 | 1981-01-20 | Bell Telephone Laboratories, Incorporated | Controlling the properties of native films using selective growth chemistry |
US4455351A (en) * | 1983-06-13 | 1984-06-19 | At&T Bell Laboratories | Preparation of photodiodes |
US4987008A (en) * | 1985-07-02 | 1991-01-22 | Semiconductor Energy Laboratory Co., Ltd. | Thin film formation method |
US4830705A (en) * | 1987-07-16 | 1989-05-16 | Texas Instruments Incorporated | Method for etch of GaAs |
US5098851A (en) * | 1989-02-10 | 1992-03-24 | Hitachi, Ltd. | Fabricating a semiconductor photodetector by annealing to smooth the PN junction |
-
1990
- 1990-06-02 DE DE4017870A patent/DE4017870A1/de not_active Withdrawn
-
1991
- 1991-05-28 JP JP15247991A patent/JP3207869B2/ja not_active Expired - Fee Related
- 1991-05-29 US US07/707,047 patent/US5248635A/en not_active Expired - Fee Related
- 1991-05-29 AT AT91108781T patent/ATE152289T1/de not_active IP Right Cessation
- 1991-05-29 ES ES91108781T patent/ES2103285T3/es not_active Expired - Lifetime
- 1991-05-29 EP EP91108781A patent/EP0464372B1/de not_active Expired - Lifetime
- 1991-05-29 DE DE59108673T patent/DE59108673D1/de not_active Expired - Fee Related
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---|---|
US5248635A (en) | 1993-09-28 |
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DE59108673D1 (de) | 1997-05-28 |
EP0464372A3 (en) | 1992-05-27 |
EP0464372B1 (de) | 1997-04-23 |
EP0464372A2 (de) | 1992-01-08 |
DE4017870A1 (de) | 1991-12-05 |
ATE152289T1 (de) | 1997-05-15 |
ES2103285T3 (es) | 1997-09-16 |
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