JPH0420508B2 - - Google Patents
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- JPH0420508B2 JPH0420508B2 JP58238369A JP23836983A JPH0420508B2 JP H0420508 B2 JPH0420508 B2 JP H0420508B2 JP 58238369 A JP58238369 A JP 58238369A JP 23836983 A JP23836983 A JP 23836983A JP H0420508 B2 JPH0420508 B2 JP H0420508B2
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- registration
- pattern
- memory
- circuit
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- 230000015654 memory Effects 0.000 claims description 29
- 230000003287 optical effect Effects 0.000 claims description 3
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- 238000003909 pattern recognition Methods 0.000 description 1
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Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は光学文字を認識する際のパターン認識
に関し、特にパターンの外郭特徴を登録する装置
に関する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to pattern recognition when recognizing optical characters, and more particularly to an apparatus for registering contour features of a pattern.
(従来技術)
従来、パターンの最外郭座標を検出するには、
第1図aに示すように上下方向、あるいは第1図
bに示すように左右方向より主走査を開始し、最
初に白から黒へと変化した箇所の座標によつて登
録して行つていた。したがつて、上下と左右とに
それぞれ1回、合計4回の主走査が必要であると
いう欠点があつた。(Prior art) Conventionally, to detect the outermost coordinates of a pattern,
Main scanning is started in the vertical direction as shown in Figure 1a, or in the horizontal direction as shown in Figure 1b, and is performed by registering the coordinates of the point where the color first changes from white to black. Ta. Therefore, there is a drawback that main scanning is required a total of four times, once each for the top and bottom and left and right sides.
また、最外郭座標の不連続点の検出は、それぞ
れ隣接する外郭座標を求め、求めた差の値により
実施していたので、動作がきわめて繁雑であると
いう欠点があつた。 Furthermore, since the detection of discontinuous points in the outermost coordinates is carried out by determining adjacent outer coordinates and using the obtained difference value, there is a drawback that the operation is extremely complicated.
(発明の目的)
本発明の目的は、主走査の順方向ならびに逆方
向への外郭を検出するための外郭検出手段と、順
方向ならびに逆方向への外郭の不連続点を検出す
るための不連続点検出手段とを付加することによ
り上記欠点を除去し、水平方向に一回と、垂直方
向に一回との合計二回の主走査により上下ならび
に左右の方向からの最外郭座標と、最外郭座標の
不連続点とを登録することができるように構成し
たパターン外郭特徴登録装置を提供することにあ
る。(Object of the Invention) The object of the present invention is to provide an outline detection means for detecting outlines in the forward and reverse directions of main scanning, and a discontinuity point for detecting discontinuous points of the outline in the forward and reverse directions. By adding continuous point detection means, the above-mentioned drawbacks are removed, and the outermost coordinates from the vertical and horizontal directions can be determined by main scanning twice, once in the horizontal direction and once in the vertical direction. An object of the present invention is to provide a pattern contour feature registration device configured to be able to register discontinuous points of contour coordinates.
(発明の構成)
本発明によるパターン外郭特徴登録装置は光学
文字読取り装置に使用されるものであり、外郭検
出手段と不連続点検出手段とを具備して構成した
ものである。(Structure of the Invention) The pattern contour feature registration device according to the present invention is used in an optical character reading device, and is configured to include contour detection means and discontinuous point detection means.
外郭検出手段は対象となる単位ビツトより成る
ドツトの周辺を取囲んで、二次元状に8ビツトを
付加し、これらの8ビツトと上記単位ビツトとに
よつて決定される9ビツトの二次元状の方形パタ
ーンを一度に読出すことが可能であるように形成
して外郭座標を登録しておき、順方向ならびに逆
方向への主走査により方形パターンの外郭を検出
することができるように形成したものである。 The contour detection means adds 8 bits to a two-dimensional shape surrounding a dot made up of target unit bits, and generates a 9-bit two-dimensional shape determined by these 8 bits and the above-mentioned unit bits. The rectangular pattern was formed so that it was possible to read it out at once, and the outline coordinates were registered, and the outline of the rectangular pattern could be detected by main scanning in the forward and reverse directions. It is something.
不連続点検出手段は上記外郭検出手段に関連
し、外郭座標の不連続点を登録しておき、順方
向、および逆方向への主走査により二次元状の方
形パターンの外郭座標の不連続点を検出すること
ができるように形成したものである。 The discontinuous point detection means is related to the above-mentioned outline detection means, and registers the discontinuous points of the outline coordinates, and detects the discontinuous points of the outline coordinates of the two-dimensional rectangular pattern by main scanning in the forward and reverse directions. It is designed so that it can be detected.
(実施例)
次に、本発明について図面を参照して詳細に説
明する。(Example) Next, the present invention will be described in detail with reference to the drawings.
本発明によるパターン外郭特徴登録装置は、メ
モリ上に展開された2値化パターンのアドレスの
1ビツトに対して、その周囲に該当ビツトを取囲
んで8ビツトを付加し、一度に9ビツトを同時に
読出せるように構成した9層メモリを使用して一
度に主走査することにより主走査の順方向、およ
び逆方向からみた最外郭座標を登録すると共に、
外郭座標の不連続点を登録する装置である。第2
図aは本発明により水平方向に一回だけ主走査し
たパターン例、第2図bは垂直方向に一回だけ主
走査したパターン例であり、いずれも上記主走査
により構成した文字を表わした図である。 The pattern contour feature registration device according to the present invention adds 8 bits to 1 bit of the address of a binary pattern developed on the memory by surrounding the corresponding bit, and adds 8 bits at a time to 1 bit of the address of a binary pattern developed on the memory. By performing main scanning at once using a 9-layer memory configured to be readable, the outermost coordinates seen from the forward and reverse directions of main scanning are registered, and
This is a device that registers discontinuous points in outer coordinates. Second
Figure a is an example of a pattern in which main scanning is performed only once in the horizontal direction according to the present invention, and Figure 2 b is an example of a pattern in which main scanning is performed only once in the vertical direction, both of which represent characters formed by the above-mentioned main scanning. It is.
次に、図面を参照して動作を説明する。 Next, the operation will be explained with reference to the drawings.
第3図にパターン外郭特徴登録装置の一実施例
のブロツク構成図を示す。第3図において、11
は第1のパターンメモリ、12は上記8ビツトを
付加するための付加回路、13は上記8ビツトと
中心の上記1ビツトの合計9ビツトを一度に読出
すことが可能な第2のパターンメモリ、14は外
郭座標を登録するための第1の登録回路、15は
外郭座標の不連続点を登録するための第2の登録
回路、16は順方向側外郭座標および不連続点の
登録結果を記憶するための第1の登録メモリ、1
7は逆方向側外郭座標および不連続点の登録結果
を記憶するための第2の登録メモリ、18は各メ
モリのアドレス制御および登録用外郭座標発生の
ための制御回路、19は読出したデータをマルチ
プレクシングするためのマルチプレクサである。 FIG. 3 shows a block diagram of an embodiment of the pattern contour feature registration device. In Figure 3, 11
is a first pattern memory; 12 is an additional circuit for adding the 8 bits; 13 is a second pattern memory capable of reading out a total of 9 bits at once, including the 8 bits and the central 1 bit; 14 is a first registration circuit for registering the outer coordinates; 15 is a second registration circuit for registering discontinuous points in the outer coordinates; 16 is for storing the registration results of forward side outer coordinates and discontinuous points. a first registration memory for
Reference numeral 7 denotes a second registration memory for storing the registration results of backward side outer coordinates and discontinuous points, 18 a control circuit for controlling addresses of each memory and generating outer coordinates for registration, and 19 storing read data. This is a multiplexer for multiplexing.
第3図において、パターン外郭特徴登録装置は
水平方向に主走査を行つている。第3図におい
て、第1のパターンメモリ11上に記憶されてい
る2値化パターンは、付加回路12に加えられて
いる。例えば、第4図は2値化パターンの一例を
示す図であるが、第4図aに示すパターンの中心
には同図bに示すパターンのように、この中心を
取巻く周囲の情報が付加されている。第2のパタ
ーンメモリ13には、付加回路12から送出され
た情報が同時に9ビツト読出せるパターンとして
展開されている。 In FIG. 3, the pattern contour feature registration device performs main scanning in the horizontal direction. In FIG. 3, the binarized pattern stored on the first pattern memory 11 is applied to the additional circuit 12. In FIG. For example, FIG. 4 is a diagram showing an example of a binarized pattern, and information surrounding the center is added to the center of the pattern shown in FIG. 4 a, as in the pattern shown in FIG. 4 b. ing. In the second pattern memory 13, the information sent from the additional circuit 12 is developed as a pattern that can be read out in 9 bits at the same time.
第5図は外郭検出用パターンの実例を示す図で
あり、第5図aは主走査の順方向からみた外郭検
出用パターン、第5図bは主走査の逆方向からみ
た外郭検出用パターンの実例を示す図である。 FIG. 5 is a diagram showing an example of the contour detection pattern, and FIG. 5a shows the contour detection pattern as seen from the forward direction of main scanning, and FIG. It is a figure which shows an example.
次に、第2のパターンメモリ13の内容を制御
回路18により制御された水平走査に従つて読出
し、第1の登録回路14においては第6図aに示
すパターンに対して最初に一致した水平方向のア
ドレスを第1の登録メモリ16に書込む。また、
第1の登録回路14においては、第6図bに示す
パターンに一致した水平方向のアドレスを第2の
登録メモリ17に書込む。第2の登録メモリ17
には、入力情報が最後に第6図bに示すパターン
と一致した時に書込むべきであるが、毎回、情報
を書込むことによつて、そのたびに内容が更新さ
れ、最後の内容が残るようになつている。また、
登録メモリを第1および第2の登録メモリ16,
17に分けることにより、順方向と逆方向との外
郭座標および不連続点が同時に登録することがで
きる構成が得られている。 Next, the contents of the second pattern memory 13 are read out according to the horizontal scanning controlled by the control circuit 18, and the first registration circuit 14 reads out the contents of the second pattern memory 13 in the horizontal direction that first matches the pattern shown in FIG. 6a. write the address in the first registration memory 16. Also,
The first registration circuit 14 writes horizontal addresses matching the pattern shown in FIG. 6b into the second registration memory 17. Second registration memory 17
should be written when the input information finally matches the pattern shown in Figure 6b, but by writing the information each time, the content is updated each time, and the last content remains. It's becoming like that. Also,
The registration memory is connected to the first and second registration memories 16,
By dividing into 17, a configuration is obtained in which outer coordinates and discontinuous points in forward and reverse directions can be registered simultaneously.
次に、不連続点の登録について説明する。 Next, registration of discontinuous points will be explained.
最外郭部を含むパターンと、このパターンに隣
接する外郭部との差が正の整数(n:本実施例で
はn=5)以上の場合には、外郭座標の不連続点
として登録する。第6図aに示すような順方向の
場合には、矢印(→)の箇所が不連続点として第
2の登録回路15により検出され、第1の登録メ
モリ16に登録される。第3図に示す第2の登録
回路15の詳細を第7図に示す。 If the difference between the pattern including the outermost part and the outer part adjacent to this pattern is a positive integer (n: n=5 in this embodiment) or more, it is registered as a discontinuous point in the outline coordinates. In the case of the forward direction as shown in FIG. 6a, the point indicated by the arrow (→) is detected as a discontinuous point by the second registration circuit 15 and registered in the first registration memory 16. FIG. 7 shows details of the second registration circuit 15 shown in FIG. 3.
第7図において、21,22はそれぞれ第1お
よび第2のシフトレジスタ、23,24,28,
29はそれぞれ第1〜第4のゲート、25,2
6,27はそれぞれ第1〜第3のフリツプフロツ
プである。信号線251〜254を介して加えら
れた信号は、第3および第4のゲート28,29
を介して第1および第2のシフトレジスタ21,
22に加えられる。第1および第2のシフトレジ
スタ21,22では5ビツトの連続した白空間を
検出し、第1のゲート23により第1および第2
のシフトレジスタ21,22の出力がAND演算
され、第1のゲート23の出力により第1のフリ
ツプフロツプ25がセツトされる。その後、第2
のフリツプフロツプ26は第6図dに示すような
最初のパターン、第3のフリツプフロツプ27は
第6図eに示すようなパターンによつてのみそれ
ぞれラツチされる。 In FIG. 7, 21 and 22 are first and second shift registers, 23, 24, 28,
29 are the first to fourth gates, 25, 2
6 and 27 are first to third flip-flops, respectively. Signals applied via signal lines 251 to 254 are applied to third and fourth gates 28 and 29.
via the first and second shift registers 21,
Added to 22. The first and second shift registers 21 and 22 detect a 5-bit continuous white space, and the first gate 23 detects the first and second white spaces.
The outputs of the shift registers 21 and 22 are ANDed, and the first flip-flop 25 is set by the output of the first gate 23. Then the second
The first flip-flop 26 is latched only by the first pattern shown in FIG. 6d, and the third flip-flop 27 is latched only by the pattern shown in FIG. 6e.
次に、第6図aにおいて、パターン上のドツト
aにより第6図bに示されたパターンが満足さ
れ、第3および第4のゲート28,29が開き、
ドツトbの上の列が第1のシフトレジスタ21に
シフトインされ、ドツトbの下の列が第2のシフ
トレジスタ22にシフトインされる。続いて、第
1のゲート23により上記第1および第2のシフ
トレジスタ21,22の内容のANDが取られ、
不連続点の条件が満足される。次に、第1のフリ
ツプフロツプ25がセツトされ、第1の登録メモ
リ16に登録される。 Next, in FIG. 6a, the pattern shown in FIG. 6b is satisfied by the dot a on the pattern, and the third and fourth gates 28 and 29 are opened.
The column above dot b is shifted into the first shift register 21, and the column below dot b is shifted into the second shift register 22. Subsequently, the contents of the first and second shift registers 21 and 22 are ANDed by the first gate 23,
The discontinuity condition is satisfied. Next, the first flip-flop 25 is set and registered in the first registration memory 16.
逆方向の不連続点については、第6図fに従つ
て次のように説明される。第6図fの“d”によ
りゲート条件が満足され、“e”により5ビツト
の連続した白空間が検出され、“f”により第3
のフリツプフロツプ27のラツチ条件(第6図b
に示すパターン)が満足される。逆方向の場合に
は“g”あるいはそれ以後の走査において第6図
dのパターンが満足された場合には、不連続点は
リセツトされる。 The discontinuity in the opposite direction is explained as follows according to FIG. 6f. The gate condition is satisfied by "d" in FIG. 6f, the 5-bit continuous white space is detected by "e", and the third
The latch condition of the flip-flop 27 (Fig. 6b)
) is satisfied. In the reverse direction, if the pattern of FIG. 6d is satisfied in "g" or subsequent scans, the discontinuity point is reset.
垂直方向についても同様の方法で最外郭座標、
ならびに隣接する最外郭座標の不連続点を登録す
ることが可能である。 In the vertical direction, use the same method to find the outermost coordinates,
It is also possible to register discontinuous points of adjacent outermost coordinates.
なお、第8図はゲート条件、ラツチ条件、リセ
ツト条件をまとめて示した図である。 Incidentally, FIG. 8 is a diagram showing all gate conditions, latch conditions, and reset conditions.
(発明の効果)
本発明は以上説明したように、主走査の順方
向、ならびに逆方向への外郭を検出するための外
郭検出手段と、順方向ならびに逆方向への外郭の
不連続点を検出するための不連続検出手段とを付
加することにより、二回の主走査を行えばパター
ンの上記4方向へのすべての最外郭座標を求め、
最外郭座標の不連続点の有無を上記走査時に同時
に登録できるという効果がある。(Effects of the Invention) As described above, the present invention includes a contour detection means for detecting contours in the forward and reverse directions of main scanning, and detecting discontinuous points of contours in the forward and reverse directions. By adding a discontinuity detection means to detect the pattern, all the outermost coordinates of the pattern in the above four directions can be obtained by performing two main scans.
This has the advantage that the presence or absence of a discontinuous point in the outermost coordinates can be registered at the same time during the above scanning.
第1図は、従来方式によるパターン外郭座標検
出のための主走査の一例を示す図である。第2図
は本発明による主走査により構成した文字を表わ
した図であり、第2図aは水平方向に一回だけ主
走査したパターン例、第2図bは垂直方向に一回
だけ主走査したパターン例である。第3図は、本
発明によるパターン外郭特徴登録装置の一実施例
を示すブロツク構成図である。第4図は、パター
ンメモリの内容例を示す図であり、第4図aは第
3図における第1のパターンメモリの内容例、第
4図bは第3図における第2のパターンメモリの
内容例を示す図である。第5図は、外郭検出用パ
ターンの実例を示す図であり、第5図aは主走査
の順方向からみた外郭検出用パターン、第5図b
は主走査の逆方向からみた外郭検出用パターンの
実例を示す図である。第6図は、不連続点の検出
を示すパターン例を示す図であり、第6図aは順
方向への水平走査時の不連続点の検出を示す例、
第6図b〜eはそれぞれ不連続点を検出するため
のゲート条件、ラツチ条件、またはリセツト条件
となるパターン例、第6図fは逆方向への水平走
査時の不連続点の検出を示す例である。第7図
は、第3図に示す第2の登録回路の詳細な構成を
示す実施例のブロツク図である。第8図は、ゲー
ト条件、ラツチ条件、リセツト条件をまとめて示
した図である。
11,13……パターンメモリ、12……付加
回路、14,15……登録回路、16,17……
登録メモリ、18……制御回路、19……マルチ
プレクサ、21,22……シフトレジスタ、2
3,24,28,29……ゲート、25,26,
27……フリツプフロツプ、121〜130,2
51〜254……信号線。
FIG. 1 is a diagram showing an example of main scanning for detecting pattern outer coordinates using a conventional method. Fig. 2 is a diagram showing a character formed by main scanning according to the present invention, Fig. 2a is an example of a pattern in which main scanning is performed only once in the horizontal direction, and Fig. 2b is an example of a pattern in which main scanning is performed only once in the vertical direction. This is an example of a pattern. FIG. 3 is a block diagram showing an embodiment of a pattern contour feature registration device according to the present invention. 4 is a diagram showing an example of the contents of the pattern memory, FIG. 4a is an example of the contents of the first pattern memory in FIG. 3, and FIG. 4b is an example of the contents of the second pattern memory in FIG. 3. It is a figure which shows an example. FIG. 5 is a diagram showing an example of the contour detection pattern, in which FIG. 5a is the contour detection pattern viewed from the forward direction of main scanning, and FIG. 5b
FIG. 2 is a diagram showing an example of an outline detection pattern viewed from the opposite direction of main scanning. FIG. 6 is a diagram showing an example of a pattern showing the detection of a discontinuous point; FIG. 6a is an example showing the detection of a discontinuous point during horizontal scanning in the forward direction;
Figures 6b to 6e show examples of patterns that serve as gate conditions, latch conditions, or reset conditions for detecting discontinuous points, respectively, and Figure 6f shows detection of discontinuous points during horizontal scanning in the opposite direction. This is an example. FIG. 7 is a block diagram of an embodiment showing the detailed configuration of the second registration circuit shown in FIG. 3. FIG. 8 is a diagram showing all gate conditions, latch conditions, and reset conditions. 11, 13... Pattern memory, 12... Additional circuit, 14, 15... Registration circuit, 16, 17...
Registration memory, 18... Control circuit, 19... Multiplexer, 21, 22... Shift register, 2
3, 24, 28, 29...gate, 25, 26,
27...Flip-flop, 121-130,2
51-254...Signal line.
Claims (1)
単位ビツトより成るドツトの周辺を取囲んで二次
元状に8ビツトを付加する8ビツト付加回路と、
前記8ビツトと前記単位ビツトとによつて決定さ
れる9ビツトの前記二次元状の方形パターンを一
度に読出すことが可能であるように形成して記憶
するパターンメモリとを備えたパターン外郭特徴
登録装置において、前記パターンメモリの出力に
ついて順方向ならびに逆方向への主走査により得
られるべき前記方形パターンの外郭座標を検出す
る第1の登録回路と、前記外郭座標の検出に関連
して順方向および逆方向への主走査により得られ
るべき前記方形パターンの前記外郭座標の不連続
点を検出する第2の登録回路と、前記第1の登録
回路および第2の登録回路の出力により順方向側
の外郭座標および不連続点の登録結果を記憶する
第1の登録メモリと、前記第1の登録回路および
第2の登録回路の出力により逆方向側の外郭座標
および不連続点の登録結果を記憶する第2の登録
メモリと、前記第1の登録メモリおよび第2の登
録メモリから読出したデータを多量化して一つの
情報信号として出力する手段とを具備して構成し
たことを特徴とするパターン外郭特徴登録装置。1. An 8-bit addition circuit that is used in an optical character reading device and adds 8 bits in a two-dimensional manner surrounding the periphery of a dot consisting of a target unit bit;
A pattern outline feature comprising a pattern memory for forming and storing the two-dimensional rectangular pattern of 9 bits determined by the 8 bits and the unit bit so that it can be read out at once. In the registration device, a first registration circuit detects the outer coordinates of the rectangular pattern to be obtained by main scanning the output of the pattern memory in the forward and reverse directions; and a second registration circuit for detecting discontinuous points of the outer coordinates of the rectangular pattern to be obtained by main scanning in the reverse direction, and a forward direction side by the outputs of the first registration circuit and the second registration circuit. a first registration memory that stores the registration results of the outer coordinates and the discontinuous points, and stores the outer coordinates and the registration results of the discontinuous points in the opposite direction by the outputs of the first registration circuit and the second registration circuit; and means for amplifying the data read from the first registration memory and the second registration memory and outputting it as one information signal. Feature registration device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58238369A JPS60129893A (en) | 1983-12-16 | 1983-12-16 | Register for pattern contour feature |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58238369A JPS60129893A (en) | 1983-12-16 | 1983-12-16 | Register for pattern contour feature |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60129893A JPS60129893A (en) | 1985-07-11 |
JPH0420508B2 true JPH0420508B2 (en) | 1992-04-03 |
Family
ID=17029160
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58238369A Granted JPS60129893A (en) | 1983-12-16 | 1983-12-16 | Register for pattern contour feature |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60129893A (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5720881A (en) * | 1980-07-15 | 1982-02-03 | Nec Corp | Optical character reader |
JPS57212582A (en) * | 1981-06-25 | 1982-12-27 | Fujitsu Ltd | Feature quantity extracting and processing system |
-
1983
- 1983-12-16 JP JP58238369A patent/JPS60129893A/en active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5720881A (en) * | 1980-07-15 | 1982-02-03 | Nec Corp | Optical character reader |
JPS57212582A (en) * | 1981-06-25 | 1982-12-27 | Fujitsu Ltd | Feature quantity extracting and processing system |
Also Published As
Publication number | Publication date |
---|---|
JPS60129893A (en) | 1985-07-11 |
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