JPH04139896A - セラミック多層基板 - Google Patents

セラミック多層基板

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Publication number
JPH04139896A
JPH04139896A JP2264043A JP26404390A JPH04139896A JP H04139896 A JPH04139896 A JP H04139896A JP 2264043 A JP2264043 A JP 2264043A JP 26404390 A JP26404390 A JP 26404390A JP H04139896 A JPH04139896 A JP H04139896A
Authority
JP
Japan
Prior art keywords
resistance
wall
green sheet
resistor
ceramic
Prior art date
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Pending
Application number
JP2264043A
Other languages
English (en)
Inventor
Hiroyuki Otani
博之 大谷
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
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  • Production Of Multi-Layered Print Wiring Board (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、電子機器等の回路に広く用いるセラミック多
層基板に関する。
従来の技術 近年、セラミック多層基板は、熱伝導性や耐熱性や化学
的耐久性で有機材料基板より秀れた特性を有するため、
有機材料基板の代替品として、又電子機器の小型化や多
様化に伴い高密度配線・高密度実装用の基板として多く
使用されている。
以下に従来のセラミック多層基板について説明する。
第4図に示すように、セラミック層9は、熱可塑性樹脂
と無機物等からなるグリーンシートに開孔されたウイア
ホール内に導体ペーストを印刷等で充填した、導体層1
1と、抵抗材料からなる抵抗ペーストを厚さ10〜20
μrnで塗布して形成した印刷抵抗12で構成される。
第3図に示すように、セラミック層9を所定の枚数を所
定位置に導体層13や内部印刷抵抗14を形成さぜつつ
順次積層し、室温から600 ’Cの熱処理をして、有
機物を蒸発2分解、燃焼除去し、900℃で焼結させて
セラミック多層基板を形成する。
発明が解決しようとする課題 しかしながら、上記の従来の構成では、内蔵しようとす
る抵抗が多い場合、内部の配線に使用可能な面積が少な
くなり、層数を増やすなどしなければならないという問
題点や、印刷抵抗の厚さが10〜20μmと薄いために
大容量の電流を流すためには、印刷抵抗の形状を幅を1
111111以上で長さを数mmとらねばならず、印刷
面積で数平方mmにもなり、同一層内での配線面積が小
さくなるという問題点を有していた。
本発明は、上記従来の問題点を解決するもので、配線面
積を削減することなく大電流を流すことができる抵抗を
内蔵したセラミック多層基板を提供することを目的とす
る。
課題を解決するための手段 この課題を解決するために、本発明のセラミック多層基
板は、抵抗材料からなる抵抗体ペーストをグリーンシー
トに開孔されたヴイアホールに充填するか、あるいは、
その内壁に塗布したセラミック層を順次積層し、焼結し
て形成した構成を有している。
作用 この構成によって、抵抗素子数が増えても、配線可能な
面積を削減することがなく、抵抗の断面積を大きくする
こととなる。
実施例 以下、本発明の一実施例について図面を参照しながら説
明する。
第2図に示すように、アルミリ−とガラスとの主材と熱
可塑性樹脂等からなるグリーンシートのパンチ等て開孔
した穴に酸化ルテニウムを主成分とする抵抗ペーストを
印刷等で充填した埋込み抵抗2、またはパンチで開孔し
た穴の内壁に塗布した内壁抵抗3と埋込み抵抗2または
内壁抵抗3のAgからなる端子電極4でセラミック層1
を構成する。
第1図に示すように、セラミック層1を所定の枚数積層
して900℃で焼結し、内部に埋込み抵抗6や内壁抵抗
7や導体層8を形成したセラミック多層基板上する。セ
ラミック多層基板に内蔵された抵抗体は、次式で決まる
抵抗値を有する。
l・の抵抗定数、t・・・・・・セラミック層の厚さ、
ρ・・・・・・抵抗体の断面積。
以上のように、本実施例によれば、グリーンシートに開
孔されたヴイアホールを抵抗材料からなる抵抗体ペース
トを充填するか、内壁に塗布した抵抗を設けることによ
り、グリーンシートを開孔するパンチや金型の径を任意
に選択することによって、ヴイアホールの径を変え、埋
込み抵抗や内壁抵抗の断面積を調整することができる。
したがって、大きな抵抗断面積を得ることができて、大
電流も流すことが可能となる。さらに、抵抗体は導体層
間を形成する絶縁体のセラミック層内に形成されるため
、導体層の配線可能な面積を減らすことがない。
なお、本実施例では基材をアルミナとガラスを主成分と
したが他の成分で構成したセラミックでも良く、抵抗体
を酸化ルテニウムとガラスを主成分としたが他の成分の
構成でも良い。
発明の効果 以上の実施例の説明からも明らかなように、本発明は、
グリーンシートに開孔されたヴイアホールの少なくとも
1ケ所以上、またはヴイアホールを重ねてなるヴイアホ
ールまたは、スルーホールの1ケ所以上に抵抗材料を充
填するかあるいはそれらの内壁に塗布した構成により、
内層の配線に必要となるグリーンシート表面の配線可能
面積を減らずことなく、抵抗を形成することができる。
さらに抵抗の断面積を任意に選択でき断面積を太き(し
て大電流を流す回路にも使用できる優れたセラミック多
層基板を実現できるものである。
【図面の簡単な説明】
第1図および第2図は本発明の一実施例のセラミック多
層基板の構成を示す断面図、第3図および第4図は従来
のセラミック多層基板の構成を示す断面図である。 ■・・・・・・セラミック層、5・・・・・・ヴイアホ
ール、6・・・・・・埋込み抵抗、7・・・・・・内壁
抵抗、8・・・・・・導体層。 代理人の氏名 弁理士小鍜治明 ばか2名1 −−− 
で  ラ  ミ  ツ  フ  八i5− ヴイアボー
ル 6一 理乃み弛張 第 図 第 図 第 図

Claims (1)

    【特許請求の範囲】
  1. 抵抗体ペーストを無機物と熱可塑性樹脂を主成分とする
    グリーンシートに開孔したヴイアホールに充填あるいは
    その内壁に塗布したセラミック層を順次積層した後焼結
    して形成したセラミック多層基板。
JP2264043A 1990-10-01 1990-10-01 セラミック多層基板 Pending JPH04139896A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0574206A2 (en) * 1992-06-08 1993-12-15 Nippon CMK Corp. Multilayer printed circuit board and method for manufacturing the same
JP2001257471A (ja) * 2000-03-10 2001-09-21 Ngk Insulators Ltd 多層配線基板及びその製造方法
US6778037B1 (en) 1999-06-11 2004-08-17 Nokia Corporation Means for handling high-frequency energy

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