JPH03195271A - 同期分離装置 - Google Patents
同期分離装置Info
- Publication number
- JPH03195271A JPH03195271A JP33564289A JP33564289A JPH03195271A JP H03195271 A JPH03195271 A JP H03195271A JP 33564289 A JP33564289 A JP 33564289A JP 33564289 A JP33564289 A JP 33564289A JP H03195271 A JPH03195271 A JP H03195271A
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- JP
- Japan
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- circuit
- signal
- pass filter
- low pass
- synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000000926 separation method Methods 0.000 claims description 21
- 238000000605 extraction Methods 0.000 claims description 2
- 239000000284 extract Substances 0.000 abstract description 5
- 238000010586 diagram Methods 0.000 description 5
- 230000003111 delayed effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 239000000470 constituent Substances 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
Landscapes
- Synchronizing For Television (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はテレビジョン受像機における映像信号に含まれ
る同期信号を分離するだめの同期分離装置に関する。
る同期信号を分離するだめの同期分離装置に関する。
従来の技術
近年、携帯用小型テレビジョン受像機、は、小型化にあ
いまって少電力化、高機能化などが要求されてきている
。少電力化の−・つとし２て回路の簡略化、低電圧化が
ずずんでいるが、受像機の基本をなす同期信号を映像信
号から安定に分離する同期分離装置が開発されてきてい
る。
いまって少電力化、高機能化などが要求されてきている
。少電力化の−・つとし２て回路の簡略化、低電圧化が
ずずんでいるが、受像機の基本をなす同期信号を映像信
号から安定に分離する同期分離装置が開発されてきてい
る。
以下に従来の同期分離装置について説明する。
第４図は従来の同期分離装置構成のブロック図である。
第４図において、ビデオ信号入力端子１を持つローパス
フィルター回路２の出力は、同期分離回路３の入力に接
続されている。
フィルター回路２の出力は、同期分離回路３の入力に接
続されている。
この同期分離回路３の出力は、画面制御回路５、および
同期信号を必要とする回路６の入力端子に接続されてい
る。
同期信号を必要とする回路６の入力端子に接続されてい
る。
以上のように構成された同期分離装置についてその構成
要素の互いの関連動作について説明する。
要素の互いの関連動作について説明する。
まず、入力端子１にビデオ信号が入力される。
入力されたビデオ信号は、ローパスフィルター回路２に
入力され、ローパスフィルター回路２において、ビデオ
信号の高周波成分が除去され、同期分離回路３に入力さ
れる。同期分離回路３にて、ビデオ信号に含まれる同期
信号を取り出し、同期信号を出力する。出力された同期
信号は画面制御回路５、その他同期信号を必要とする回
路６に入力される。
入力され、ローパスフィルター回路２において、ビデオ
信号の高周波成分が除去され、同期分離回路３に入力さ
れる。同期分離回路３にて、ビデオ信号に含まれる同期
信号を取り出し、同期信号を出力する。出力された同期
信号は画面制御回路５、その他同期信号を必要とする回
路６に入力される。
発明が解決しようとする課題
しかしながら上記の従来の構成では、第４図内点線で囲
まれたブロック４において、第５図（ａ）のノイズのな
いビデオ信号、または第５図（Ａ）のノイズのあるビデ
オ信号が入力されると、第４図に示すローパスフィルタ
ー回路２により、第５図（ｂｌの高域成分のないビデオ
信号となる。ビデオ信号は第４図に示す同期分離回路３
により、同期信号だけ取り出された第５図（Ｃ１の同期
信号となる。しかし、本来の同期信号に対して、時間ｔ
８遅れた同期信号となる。携帯用小型テレビジョン受像
機のように、ビデオ信号処理回路にデイレーラインを入
れられない機器の場合、ビデオ信号処理回路において作
られるバースト抜き取りパルスは、第６図（ｂｌに示す
時間ｔ８遅れた同期信号により、第６図（Ｃ）に示すパ
ルスとなる。そのため、ビデオ信号に含まれる第４図（
ａｌに示すバースト信号すべてを抜きとれるパルス幅を
有しないため、ビデオ信号処理回路において動作不良を
引き起こさせるという欠点を有していた。
まれたブロック４において、第５図（ａ）のノイズのな
いビデオ信号、または第５図（Ａ）のノイズのあるビデ
オ信号が入力されると、第４図に示すローパスフィルタ
ー回路２により、第５図（ｂｌの高域成分のないビデオ
信号となる。ビデオ信号は第４図に示す同期分離回路３
により、同期信号だけ取り出された第５図（Ｃ１の同期
信号となる。しかし、本来の同期信号に対して、時間ｔ
８遅れた同期信号となる。携帯用小型テレビジョン受像
機のように、ビデオ信号処理回路にデイレーラインを入
れられない機器の場合、ビデオ信号処理回路において作
られるバースト抜き取りパルスは、第６図（ｂｌに示す
時間ｔ８遅れた同期信号により、第６図（Ｃ）に示すパ
ルスとなる。そのため、ビデオ信号に含まれる第４図（
ａｌに示すバースト信号すべてを抜きとれるパルス幅を
有しないため、ビデオ信号処理回路において動作不良を
引き起こさせるという欠点を有していた。
本発明は上記従来の問題点を解決するもので、前記同様
ビデオ信号処理回路にデイレーラインなどを用いずに、
ビデオ信号に含まれるバースト信号を完全に抜き取れる
ようにする同期分離装置を提供することを目的としてい
る。
ビデオ信号処理回路にデイレーラインなどを用いずに、
ビデオ信号に含まれるバースト信号を完全に抜き取れる
ようにする同期分離装置を提供することを目的としてい
る。
課題を解決するための手段
この目的を達成するために本発明の同期分離装置は、ロ
ーパスフィルターを同期分離回路に配置し、画面制御回
路の入力側にのみ、ローパスフィルターを設けるという
構成を有している。
ーパスフィルターを同期分離回路に配置し、画面制御回
路の入力側にのみ、ローパスフィルターを設けるという
構成を有している。
作用
この構成によって、入力ビデオ信号が直接同期分離回路
に入力されるため、時間遅れのほとんどない同期信号が
得られ、バースト信号の抜き取りがほぼ完全に行われ、
画面にノイズが影響する画面制御回路への入力のみ、ロ
ーパスフィルタを介して入力することにより、デイレー
ラインなどを用いずに、確実な性能の同期分離が行われ
る。
に入力されるため、時間遅れのほとんどない同期信号が
得られ、バースト信号の抜き取りがほぼ完全に行われ、
画面にノイズが影響する画面制御回路への入力のみ、ロ
ーパスフィルタを介して入力することにより、デイレー
ラインなどを用いずに、確実な性能の同期分離が行われ
る。
実施例
以下本発明の一実施例について、図面を参照しながら説
明する。
明する。
第１図において、ビデオ入力端子１を持つ同期分離回路
３の出力は、ローパスフィルター回路２および同期信号
を必要とする回路６に接続されている。ローパスフィル
ター回路２の出力は画面制御回路５に接続されている。
３の出力は、ローパスフィルター回路２および同期信号
を必要とする回路６に接続されている。ローパスフィル
ター回路２の出力は画面制御回路５に接続されている。
第１図において、第２図における第２図（ａｌのノイズ
のないビデオ信号または第２図（Ａ）のノイズのあるビ
デオ信号が入力端子１に入力されると同期分離回路３の
出力において、第２図（ｂｌに示すノイズのない同期信
号または第２図（Ｂ）のノイズのある同期信号が出力さ
れる。
のないビデオ信号または第２図（Ａ）のノイズのあるビ
デオ信号が入力端子１に入力されると同期分離回路３の
出力において、第２図（ｂｌに示すノイズのない同期信
号または第２図（Ｂ）のノイズのある同期信号が出力さ
れる。
出力された波形は、第１図の、同期信号の必要な回路６
、およびローパスフィルター回路２に入力される。そし
て、ローパスフィルター回路２により、第２図（Ｃ１に
示す同期信号内のノイズを取り除いた信号が第１図の画
面制御回路５に入力される。
、およびローパスフィルター回路２に入力される。そし
て、ローパスフィルター回路２により、第２図（Ｃ１に
示す同期信号内のノイズを取り除いた信号が第１図の画
面制御回路５に入力される。
以上のように本実施例によれば、第２図に示す遅れ時間
ｔｂはほとんどなくなり、第３図（ａ）に示すバースト
信号に対し第３図（ｂｌの同期信号と第３図Ｃのバース
ト抜き取りパルスの関係となり、完全にバースト信号を
抜き取れるようになる。
ｔｂはほとんどなくなり、第３図（ａ）に示すバースト
信号に対し第３図（ｂｌの同期信号と第３図Ｃのバース
ト抜き取りパルスの関係となり、完全にバースト信号を
抜き取れるようになる。
発明の効果
本発明によればローパスフィルター回路を同期分離回路
の後段に、それも画面制御回路の前段のみにローパスフ
ィルター回路を設けることにより、ビデオ信号に含まれ
るバースト信号を完全に抜き取れるようになり、ビデオ
信号処理回路の安定動作を可能にすることができる優れ
た同期分離装置を実現できるものである。
の後段に、それも画面制御回路の前段のみにローパスフ
ィルター回路を設けることにより、ビデオ信号に含まれ
るバースト信号を完全に抜き取れるようになり、ビデオ
信号処理回路の安定動作を可能にすることができる優れ
た同期分離装置を実現できるものである。
第１図は本発明の実施例の同期分離装置のブロック線図
、第２図は一実施例における各主要な接続点における信
号波形図、第３図は一実施例におけるバースト信号との
パルス関係を示す波形図、第４図は従来の同期分離装置
のブロック線図、第５図は従来例装置の各主要な接続点
における信号波形図、第６図は従来例におけるバースト
信号とのパルス関係を示す波形図である。 １・・・・・・ビデオ信号入力端子、２・・・・・・ロ
ーパスフィルター回路、３・・・・・・同期分離回路、
５・・・・・・画面制御回路。６・・・・・・同期信号
を必要とする回路。
、第２図は一実施例における各主要な接続点における信
号波形図、第３図は一実施例におけるバースト信号との
パルス関係を示す波形図、第４図は従来の同期分離装置
のブロック線図、第５図は従来例装置の各主要な接続点
における信号波形図、第６図は従来例におけるバースト
信号とのパルス関係を示す波形図である。 １・・・・・・ビデオ信号入力端子、２・・・・・・ロ
ーパスフィルター回路、３・・・・・・同期分離回路、
５・・・・・・画面制御回路。６・・・・・・同期信号
を必要とする回路。
Claims (1)
- 映像信号を同期分離回路に直接入力する手段と、出力さ
れた同期信号をバースト抜き取りなど同期信号を用いる
処理回路に入力する手段と、画面制御を行う回路にはロ
ーパスフィルターを介して同期信号を入力する手段を有
する同期分離装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33564289A JPH03195271A (ja) | 1989-12-25 | 1989-12-25 | 同期分離装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33564289A JPH03195271A (ja) | 1989-12-25 | 1989-12-25 | 同期分離装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03195271A true JPH03195271A (ja) | 1991-08-26 |
Family
ID=18290884
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33564289A Pending JPH03195271A (ja) | 1989-12-25 | 1989-12-25 | 同期分離装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03195271A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6715094B2 (en) * | 2000-12-20 | 2004-03-30 | Intel Corporation | Mult-mode I/O interface for synchronizing selected control patterns into control clock domain to obtain interface control signals to be transmitted to I/O buffers |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63318886A (ja) * | 1987-06-20 | 1988-12-27 | Fujitsu General Ltd | ゲ−トパルス生成回路 |
| JPH01296856A (ja) * | 1988-05-25 | 1989-11-30 | Matsushita Electric Ind Co Ltd | 同期信号分離装置 |
-
1989
- 1989-12-25 JP JP33564289A patent/JPH03195271A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63318886A (ja) * | 1987-06-20 | 1988-12-27 | Fujitsu General Ltd | ゲ−トパルス生成回路 |
| JPH01296856A (ja) * | 1988-05-25 | 1989-11-30 | Matsushita Electric Ind Co Ltd | 同期信号分離装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6715094B2 (en) * | 2000-12-20 | 2004-03-30 | Intel Corporation | Mult-mode I/O interface for synchronizing selected control patterns into control clock domain to obtain interface control signals to be transmitted to I/O buffers |
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