JPH03108745A - 半導体装置 - Google Patents
半導体装置Info
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- JPH03108745A JPH03108745A JP24754689A JP24754689A JPH03108745A JP H03108745 A JPH03108745 A JP H03108745A JP 24754689 A JP24754689 A JP 24754689A JP 24754689 A JP24754689 A JP 24754689A JP H03108745 A JPH03108745 A JP H03108745A
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- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K1/02—Details
- H05K1/0201—Thermal arrangements, e.g. for cooling, heating or preventing overheating
-
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- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
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-
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- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野コ
本発明は半導体装置のパッケージ構造に関する。
[従来の技術]
従来の半導体装置は、第2図に示す様に、ダイパッド2
1上に搭載されたICチップ22は、各リード端子25
にポンディングワイヤー24で電気的接続をとり、樹脂
25でモールドしていたその後ハンダメツキを行ない、
リードをフォーミングした後、外部リード端子26はプ
リント基板上のパターン27と、ハンダリフロー等で、
接続されていた。
1上に搭載されたICチップ22は、各リード端子25
にポンディングワイヤー24で電気的接続をとり、樹脂
25でモールドしていたその後ハンダメツキを行ない、
リードをフォーミングした後、外部リード端子26はプ
リント基板上のパターン27と、ハンダリフロー等で、
接続されていた。
[発明が解決しようとする課題]
しかし、前述の従来技術では、半導体装置の熱抵抗が非
常に高いという問題点があった。
常に高いという問題点があった。
すなわち、工Cチップから発生した熱は、リード23及
び樹脂25を通じ外部に枚数される。しかし、従来の半
導体装置では樹脂25の周囲は、プリント基板15に搭
載後も周囲は大気20で囲まれている為、熱伝達性が悪
(、熱抵抗は非常に高かった。
び樹脂25を通じ外部に枚数される。しかし、従来の半
導体装置では樹脂25の周囲は、プリント基板15に搭
載後も周囲は大気20で囲まれている為、熱伝達性が悪
(、熱抵抗は非常に高かった。
又、外部リード端子26は、曲げ部30、及び曲げ部2
8の2ケ所で曲げてからハンダ付する為外部リードはた
いへん長(なり、リードコブラナリティー、ベントリー
ド等、バラツキを少な(加工する事は非常に難しかった
。
8の2ケ所で曲げてからハンダ付する為外部リードはた
いへん長(なり、リードコブラナリティー、ベントリー
ド等、バラツキを少な(加工する事は非常に難しかった
。
又、加工した後も、わずかな外部力で容易に変形し、ハ
ンダ付性が低下した。
ンダ付性が低下した。
さらに、外部リード端子2ろは、2カ所で曲げなげれば
ならず、フォーミング金型はたいへん複雑になり、高価
になった。
ならず、フォーミング金型はたいへん複雑になり、高価
になった。
本発明は、この様な問題点を解決するもので、その目的
とするところは、半導体装置の熱抵抗を下げ、外部端子
リードの形状を均一に保ち、さらにフォーミング金型の
構造を簡単にする。又半導体装置のハンドリング性を容
易にし、収納容器の構造を簡単にすることにある。
とするところは、半導体装置の熱抵抗を下げ、外部端子
リードの形状を均一に保ち、さらにフォーミング金型の
構造を簡単にする。又半導体装置のハンドリング性を容
易にし、収納容器の構造を簡単にすることにある。
[課題を解決するための手段]
本発明の半導体装置は、半導体素子をリードフレームに
搭載し、各リード端子とワイヤボンディングで接続し、
樹脂でモールドした半導体素子において、リードフレー
ムの半導体素子搭載面、及び、リードフレームの側面の
みをモールドしたことを特徴とする。
搭載し、各リード端子とワイヤボンディングで接続し、
樹脂でモールドした半導体素子において、リードフレー
ムの半導体素子搭載面、及び、リードフレームの側面の
みをモールドしたことを特徴とする。
[実施例コ
第1図は本発明の実施における断面図であってICチッ
プ22はダイパッド21上に搭載されており外部リード
11とボンディングワイヤー24で接続されている。樹
脂25はダイバット21、及び外部リード11の工Cチ
ップ搭載側及び側面のみをモールドしている。外部リー
ド、及びダイパッドはハンダペースト12により、プリ
ント基板15上のリードパターン13、及びダイパッド
に対応した接続パターン14にハンダ付されている。
プ22はダイパッド21上に搭載されており外部リード
11とボンディングワイヤー24で接続されている。樹
脂25はダイバット21、及び外部リード11の工Cチ
ップ搭載側及び側面のみをモールドしている。外部リー
ド、及びダイパッドはハンダペースト12により、プリ
ント基板15上のリードパターン13、及びダイパッド
に対応した接続パターン14にハンダ付されている。
この様な構成において、工Cチップ22かも発生した熱
はダイパッド、ハンダ、プリント基板と直接伝導で伝わ
る為、熱抵抗は著しく低下する。
はダイパッド、ハンダ、プリント基板と直接伝導で伝わ
る為、熱抵抗は著しく低下する。
さらに、外部リード11には曲げ部がな(、リード長も
短かいため、フォーミング金型は単純で安価でできる。
短かいため、フォーミング金型は単純で安価でできる。
さらにリードコブラナリティー、ベントリード等のバラ
ツキも少ない。
ツキも少ない。
第6図は本発明の半導体装置のモールド時の説明図であ
る。51は上型、32は下型で平担な面になっている。
る。51は上型、32は下型で平担な面になっている。
33は上型に設けられたゲートである。モールド成型後
、下型とリード間に樹脂が入って形成されたレジンフラ
ッシュ34は、ハンダメツキ前のデフラノシュ工程にて
剥離させる。
、下型とリード間に樹脂が入って形成されたレジンフラ
ッシュ34は、ハンダメツキ前のデフラノシュ工程にて
剥離させる。
第4図は本発明の他の実施例である。外部端子リード4
1間の樹脂部42はそのまま残し、リードの保護部とし
て使用してもよい。又、リード断面43は逆台形になる
様形成すると、リードの樹脂への(い込みが確実になり
、リード部が剥離する様なことがなくなる。
1間の樹脂部42はそのまま残し、リードの保護部とし
て使用してもよい。又、リード断面43は逆台形になる
様形成すると、リードの樹脂への(い込みが確実になり
、リード部が剥離する様なことがなくなる。
第5図も本発明の他の実施例である。外部端子リードは
モールド部が突出しておらず取扱いが非常に容易である
。
モールド部が突出しておらず取扱いが非常に容易である
。
[発明の効果]
以上述べた様に、本発明によれば、リードフレームの半
導体側及びリードフレームの側面のみをモールドしたこ
とにより、ダイパッドを直接プリント基板にハンダ付で
き、半導体装置の熱抵抗を著しく下げることができる。
導体側及びリードフレームの側面のみをモールドしたこ
とにより、ダイパッドを直接プリント基板にハンダ付で
き、半導体装置の熱抵抗を著しく下げることができる。
さらに、外部端子リードの形状バラツキを少な(するこ
とができ、パッケージの取扱いも容易になり、フォーミ
ング金型のコストも下げることが、できる。
とができ、パッケージの取扱いも容易になり、フォーミ
ング金型のコストも下げることが、できる。
第1図は本発明の半導体装置の一実施例を示ず図。
第2図は従来の半導体装置を示す説明図。
第3図は本発明の半導体装置のモールド時の説明図。
第4図、第5図は本発明の半導体装置の他の実施例を示
す図。 21・・・・・・・ダイパット 22・・・・・・・・・工Cチップ 11.26・・・・・・・・・外部端リード25・・・
・・・・・・樹 脂 20・・・・・・・・・大 気 4・・・・・・・・・ボンディングワ 4・・・・・・・・・接続パターン 5・・・・・・・・・プリント基板 イヤー
す図。 21・・・・・・・ダイパット 22・・・・・・・・・工Cチップ 11.26・・・・・・・・・外部端リード25・・・
・・・・・・樹 脂 20・・・・・・・・・大 気 4・・・・・・・・・ボンディングワ 4・・・・・・・・・接続パターン 5・・・・・・・・・プリント基板 イヤー
Claims (1)
- 半導体素子をリードフレームに搭載し、該半導体素子と
各リード端子をワイヤボンディングにて接続し、樹脂で
モールドした半導体素子において、リードフレームの、
半導体素子搭載側、及びリードフレームの側面のみをモ
ールドした事を特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24754689A JPH03108745A (ja) | 1989-09-22 | 1989-09-22 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP24754689A JPH03108745A (ja) | 1989-09-22 | 1989-09-22 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03108745A true JPH03108745A (ja) | 1991-05-08 |
Family
ID=17165104
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP24754689A Pending JPH03108745A (ja) | 1989-09-22 | 1989-09-22 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03108745A (ja) |
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6329224B1 (en) * | 1998-04-28 | 2001-12-11 | Tessera, Inc. | Encapsulation of microelectronic assemblies |
US6372539B1 (en) | 2000-03-20 | 2002-04-16 | National Semiconductor Corporation | Leadless packaging process using a conductive substrate |
US6399415B1 (en) | 2000-03-20 | 2002-06-04 | National Semiconductor Corporation | Electrical isolation in panels of leadless IC packages |
KR20020065273A (ko) * | 2001-02-06 | 2002-08-13 | 앰코 테크놀로지 코리아 주식회사 | 반도체 패키지 및 반도체 패키지의 마더보드 실장방법 |
US6452255B1 (en) * | 2000-03-20 | 2002-09-17 | National Semiconductor, Corp. | Low inductance leadless package |
US6476478B1 (en) * | 1999-11-12 | 2002-11-05 | Amkor Technology, Inc. | Cavity semiconductor package with exposed leads and die pad |
US6686652B1 (en) | 2000-03-20 | 2004-02-03 | National Semiconductor | Locking lead tips and die attach pad for a leadless package apparatus and method |
US6800508B2 (en) * | 2000-04-25 | 2004-10-05 | Torex Semiconductor Ltd | Semiconductor device, its manufacturing method and electrodeposition frame |
US7098081B2 (en) | 2001-09-27 | 2006-08-29 | Hamamatsu Photonics K.K. | Semiconductor device and method of manufacturing the device |
-
1989
- 1989-09-22 JP JP24754689A patent/JPH03108745A/ja active Pending
Cited By (10)
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US6541874B2 (en) | 1998-04-28 | 2003-04-01 | Tessera, Inc. | Encapsulation of microelectronic assemblies |
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US7098081B2 (en) | 2001-09-27 | 2006-08-29 | Hamamatsu Photonics K.K. | Semiconductor device and method of manufacturing the device |
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