JPH026274U - - Google Patents

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JPH026274U
JPH026274U JP8561788U JP8561788U JPH026274U JP H026274 U JPH026274 U JP H026274U JP 8561788 U JP8561788 U JP 8561788U JP 8561788 U JP8561788 U JP 8561788U JP H026274 U JPH026274 U JP H026274U
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  • Testing Of Individual Semiconductor Devices (AREA)
  • Control Of Voltage And Current In General (AREA)

Description

【図面の簡単な説明】
第1図はこの考案の一実施例を示す接続図、第
2図はこの考案の変形実施例を示す接続図、第3
図及び第4図は従来の技術を説明するための接続
図である。 10:プログラマブル電源、11:主増幅器、
20:負荷、30:DA変換器、40:電流測定
回路、50:電流制限回路、51A,51B:演
算増幅器、53A,53B:制限値を出力するD
A変換器、55A,55B:ダイオードスイツチ
、56A,56B:補正電圧発生回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 A 負荷に対して規定した電圧又は規定した電流
    を印加する主増幅器と、 B この主増幅器から負荷に与えられる電流測定
    値又は電圧測定値に対応した電圧信号が一方の入
    力端子に与えられ、他方の入力端子には入力抵抗
    器を通じて電流制限値又は電圧制限値に対応する
    電圧信号が比較電圧源から与えられ、入力抵抗器
    との抵抗比によつて利得が規定される帰還抵抗器
    を具備した演算増幅器と、 C この演算増幅器の出力と上記主増幅器の入力
    端子との間に挿入されたダイオードスイツチと、 D 上記演算増幅器の出力端子と共通電位点の間
    に接続され上記帰還抵抗器の一端に上記演算増幅
    器の出力電圧から上記ダイオードスイツチの電圧
    降下に相当する電圧を差し引いた補正電圧を与え
    る補正電圧発生回路と、 によつて構成した電流・電圧制限回路。
JP8561788U 1988-06-27 1988-06-27 電流・電圧制限回路 Expired - Lifetime JPH0639344Y2 (ja)

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JPH026274U true JPH026274U (ja) 1990-01-16
JPH0639344Y2 JPH0639344Y2 (ja) 1994-10-12

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2005116672A1 (ja) * 2004-05-26 2008-04-03 株式会社アドバンテスト 電源電流測定装置、及び試験装置
WO2009081522A1 (ja) * 2007-12-21 2009-07-02 Advantest Corporation 試験装置および測定装置
JP2011075308A (ja) * 2009-09-29 2011-04-14 Ricoh Co Ltd 半導体試験装置、半導体試験装置の制御方法、プログラム、及び記録媒体
JP2016512331A (ja) * 2013-03-14 2016-04-25 テラダイン、 インコーポレイテッド コンプライアンスリミット閾値における円滑な電圧電流モードクロスオーバー方法

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JPH0639344Y2 (ja) 1994-10-12

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