JPH025086U - - Google Patents

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JPH025086U
JPH025086U JP8362988U JP8362988U JPH025086U JP H025086 U JPH025086 U JP H025086U JP 8362988 U JP8362988 U JP 8362988U JP 8362988 U JP8362988 U JP 8362988U JP H025086 U JPH025086 U JP H025086U
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JP
Japan
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line
clocked inverter
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clocked
effect transistor
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JP8362988U
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Description

【図面の簡単な説明】
第1図は本考案の第1の実施例の回路図、第2
図は本考案の第2の実施例の回路図、第3図は本
考案の第3の実施例の回路図、第4図は従来例の
回路図、第5図は第4図中のクロツクドインバー
タを示す回路図である。 1……クロツクドインバータ、2……クロツク
信号、3……インバータ、4……クロツクドイン
バータ、5……逆相クロツク信号、6……入力静
電容量、7……電界効果型トランジスタ、8……
ゲート端子、9……ソース端子、10……ドレイ
ン端子、11……クロツクドインバータ4の出力
線、12……クロツクドインバータ4とインバー
タ3との接続点、13,14……電源線、15…
…インバータ、16,17,18……ゲート端子
、19,20……電界効果型トランジスタ(Pチ
ヤンネル型)、21,22……電界効果型トラン
ジスタ(Nチヤンネル型)、23……電源線、2
4……クロツクドインバータ出力線。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第1及び第2のクロツクドインバータのクロツ
    ク信号が互いに逆位相であり、該第1のクロツク
    ドインバータ出力線と該第2のクロツクドインバ
    ータ出力線と第1のインバータ入力線とが接続さ
    れ、かつ該接続点と第1の電界効果型トランジス
    タのドレイン端子が接続され、該第1の電界効果
    型トランジスタのソース端子が電源線又は接地線
    に接続され、該第1の電界効果型トランジスタの
    ゲート線が電源線又は接地線又は第1のクロツク
    ドインバータのクロツク信号の逆相信号に接続さ
    れ、かつ該第1のインバータ出力線が、該第2の
    クロツクドインバータの入力線に接続されて構成
    されることを特徴とするクロツクドインバータ型
    スタテイツクラツチ回路。
JP8362988U 1988-06-23 1988-06-23 Pending JPH025086U (ja)

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JP8362988U JPH025086U (ja) 1988-06-23 1988-06-23

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JP8362988U JPH025086U (ja) 1988-06-23 1988-06-23

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JPH025086U true JPH025086U (ja) 1990-01-12

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JP8362988U Pending JPH025086U (ja) 1988-06-23 1988-06-23

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