JPH01108623U - - Google Patents
Info
- Publication number
- JPH01108623U JPH01108623U JP404288U JP404288U JPH01108623U JP H01108623 U JPH01108623 U JP H01108623U JP 404288 U JP404288 U JP 404288U JP 404288 U JP404288 U JP 404288U JP H01108623 U JPH01108623 U JP H01108623U
- Authority
- JP
- Japan
- Prior art keywords
- mos transistor
- terminal
- conductivity type
- transistor
- series
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Electronic Switches (AREA)
- Manipulation Of Pulses (AREA)
Description
第1図は本考案の一実施例の回路図、第2図は
第1図の実施例のヒステリシス特性を説明するた
めの入力電圧対出力電圧の相関を示す特性図、第
3図は従来のシユミツト回路の一例の回路図であ
る。 1……入力端子、2,4,8……P―MOST
、3,5,9……N―MOST、7……出力端子
、6,10……インバータ、11……選択信号入
力端子、12……スイツチング回路。
第1図の実施例のヒステリシス特性を説明するた
めの入力電圧対出力電圧の相関を示す特性図、第
3図は従来のシユミツト回路の一例の回路図であ
る。 1……入力端子、2,4,8……P―MOST
、3,5,9……N―MOST、7……出力端子
、6,10……インバータ、11……選択信号入
力端子、12……スイツチング回路。
Claims (1)
- ゲートが入力端子に接続され電源端子と接地端
子間に直列に接続される第1の導電型の第1のM
OSトランジスタと前記第1の導電型と反対導電
型の第2の導電型の第2のMOSトランジスタと
から成る第1の直列回路と、前記電源端子と接地
端子間に直列に接続される前記第1の導電型の第
3のMOSトランジスタと前記第2の導電型の第
4のMOSトランジスタとから成る第2の直列回
路と、入力端が前記第1のMOSトランジスタと
第2のMOSトランジスタの接続節点及び前記第
3のMOSトランジスタと第4のMOSトランジ
スタの接続節点に接続され出力端が前記第3のM
OSトランジスタと第4のMOSトランジスタと
のゲートと出力端子とに接続されるインバータと
を備えるシユミツト回路において、前記電源端子
と前記第3のMOSトランジスタとの間と前記接
地端子と前記第4のMOSトランジスタとの間と
にそれぞれ挿入される選択信号により制御される
スイツチング回路を有することを特徴とするシユ
ミツト回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP404288U JPH01108623U (ja) | 1988-01-14 | 1988-01-14 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP404288U JPH01108623U (ja) | 1988-01-14 | 1988-01-14 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01108623U true JPH01108623U (ja) | 1989-07-24 |
Family
ID=31206203
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP404288U Pending JPH01108623U (ja) | 1988-01-14 | 1988-01-14 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01108623U (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003283303A (ja) * | 2002-03-27 | 2003-10-03 | Nec Microsystems Ltd | 半導体集積回路 |
JP2004282349A (ja) * | 2003-03-14 | 2004-10-07 | Seiko Epson Corp | シュミットトリガー回路、半導体装置及びシュミットトリガー回路の製造方法 |
-
1988
- 1988-01-14 JP JP404288U patent/JPH01108623U/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003283303A (ja) * | 2002-03-27 | 2003-10-03 | Nec Microsystems Ltd | 半導体集積回路 |
JP2004282349A (ja) * | 2003-03-14 | 2004-10-07 | Seiko Epson Corp | シュミットトリガー回路、半導体装置及びシュミットトリガー回路の製造方法 |