JPH0239627A - 誤り訂正回路 - Google Patents
誤り訂正回路Info
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- JPH0239627A JPH0239627A JP18819388A JP18819388A JPH0239627A JP H0239627 A JPH0239627 A JP H0239627A JP 18819388 A JP18819388 A JP 18819388A JP 18819388 A JP18819388 A JP 18819388A JP H0239627 A JPH0239627 A JP H0239627A
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- 238000000926 separation method Methods 0.000 claims description 4
- 230000005540 biological transmission Effects 0.000 abstract description 4
- 238000000034 method Methods 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 4
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 2
- 230000008054 signal transmission Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野）
本発明は衛星放送データチャンネルを利用するデータ放
送デコーダの誤り訂正回路に関するもので、高速データ
列の中から、希望するサービスのみを順次誤り訂正し取
込む誤り訂正回路に関する。
送デコーダの誤り訂正回路に関するもので、高速データ
列の中から、希望するサービスのみを順次誤り訂正し取
込む誤り訂正回路に関する。
この発明は、衛星データチャンネルデコーダにおいて、
希望するサービスのパケットデータのみを選択的に受信
するようにし、処理時間を要する（２７２，１９０）符
号の処理中に受信パケットをメモリーに蓄え、１つの（
２７２，１９０）符号の誤り訂正が終了した時点で、そ
のメモリーから受信データを順次取り出し誤り訂正を行
うようにし、高速データ処理が可能になるようにしたも
のである。
希望するサービスのパケットデータのみを選択的に受信
するようにし、処理時間を要する（２７２，１９０）符
号の処理中に受信パケットをメモリーに蓄え、１つの（
２７２，１９０）符号の誤り訂正が終了した時点で、そ
のメモリーから受信データを順次取り出し誤り訂正を行
うようにし、高速データ処理が可能になるようにしたも
のである。
従来この種の誤り訂正回路としては、（１６，５）符号
誤り訂正回路（特願昭６２−１０６３７０号） 、
（２７２゜１９０）符号誤り訂正回路（特願昭５９−１
８１８４１号なと）がある。
誤り訂正回路（特願昭６２−１０６３７０号） 、
（２７２゜１９０）符号誤り訂正回路（特願昭５９−１
８１８４１号なと）がある。
（発明が解決しようとする課題）
しかしながら、前記の２つの符号が連結した高速データ
列を復号するものはなかった。
列を復号するものはなかった。
例えば衛星放送データチャンネルの伝送容量は、音声伝
送モード（Ａモード、Ｂモード、ステレオ等）によって
異なるが、文字放送、 ＦＭ多重放送等の従来のデータ
放送に比べ非常に高速であり（約２２０にｂｐｓ〜Ｉ
Ｍｂｐｓ程度）、受信機ではリアルタイム処理ができな
いので、信号送出手順になんらかの工夫が必要であった
。
送モード（Ａモード、Ｂモード、ステレオ等）によって
異なるが、文字放送、 ＦＭ多重放送等の従来のデータ
放送に比べ非常に高速であり（約２２０にｂｐｓ〜Ｉ
Ｍｂｐｓ程度）、受信機ではリアルタイム処理ができな
いので、信号送出手順になんらかの工夫が必要であった
。
本発明の目的は以上のような問題を解消した誤り訂正回
路を提供することにあるや 〔課題を解決するための手段〕 本発明は、（１６，５）符号と（２７２，１９０）符号
とを分離する分離回路と、分離回路からの（１６，５）
符号を復号し、誤り訂正する復号回路と、復号回路から
の復号データがあらかじめ設定したデータと一致するか
を判断する判断回路と、判断回路が一致判断のときに分
離回路からの（２７２，１９０）符号を記憶するメモリ
ーと、メモリーから読み出したデータを復号し、誤り訂
正する手段とを具えたことを特徴とする。
路を提供することにあるや 〔課題を解決するための手段〕 本発明は、（１６，５）符号と（２７２，１９０）符号
とを分離する分離回路と、分離回路からの（１６，５）
符号を復号し、誤り訂正する復号回路と、復号回路から
の復号データがあらかじめ設定したデータと一致するか
を判断する判断回路と、判断回路が一致判断のときに分
離回路からの（２７２，１９０）符号を記憶するメモリ
ーと、メモリーから読み出したデータを復号し、誤り訂
正する手段とを具えたことを特徴とする。
本発明によれば衛星データチャンネル伝送信号のうち、
先頭部分の（ｌδ、５）符号に関しては、誤り訂正に要
する時間が短かくリアルタイム処理が十分可能であるこ
とを利用して同（１６，５）符号復号データがあらかじ
め定めたデータと一致したときのみ（２７２，１９０）
符号を復号するようにして、必要なサービスだけを取込
み誤り訂正することができる。
先頭部分の（ｌδ、５）符号に関しては、誤り訂正に要
する時間が短かくリアルタイム処理が十分可能であるこ
とを利用して同（１６，５）符号復号データがあらかじ
め定めたデータと一致したときのみ（２７２，１９０）
符号を復号するようにして、必要なサービスだけを取込
み誤り訂正することができる。
（実施例）
本発明を説明する前に、衛星データチャンネルの信号形
式について簡単に述べる。例えば、第１図に示すように
、ディジタルフレーム信号から分離されたデータチャン
ネル信号列は、ｌｏｔの信号列と１０２の同期信号が基
本信号となると考えられる。信号列１０１のうち、１０
３は１パケット分２８８ビット信号を示す。１０４，１
０５，１０６．１０７は、パケット信号の送られない無
信号の期間である。パケット信号のうち１０８はサービ
ス識別信号であり、（１６，５）拡大ＢＣＩ＋符号で保
護された１６ビツトを示し、 １１０．１１１は、文字
放送と同様の（２７２，１９０）符号によって保護され
た、１９０ビツトの情報ビットと８２ビツトのパリティ
ピットを示す。
式について簡単に述べる。例えば、第１図に示すように
、ディジタルフレーム信号から分離されたデータチャン
ネル信号列は、ｌｏｔの信号列と１０２の同期信号が基
本信号となると考えられる。信号列１０１のうち、１０
３は１パケット分２８８ビット信号を示す。１０４，１
０５，１０６．１０７は、パケット信号の送られない無
信号の期間である。パケット信号のうち１０８はサービ
ス識別信号であり、（１６，５）拡大ＢＣＩ＋符号で保
護された１６ビツトを示し、 １１０．１１１は、文字
放送と同様の（２７２，１９０）符号によって保護され
た、１９０ビツトの情報ビットと８２ビツトのパリティ
ピットを示す。
同期信号１０２における１０９は１０８部に相当するサ
ンプリングクロックを示している。クロック信号周波数
は、例えばディジタル信号のクロックレートと同じ２，
０４８Ｍｂｐｓ とすれば良い。
ンプリングクロックを示している。クロック信号周波数
は、例えばディジタル信号のクロックレートと同じ２，
０４８Ｍｂｐｓ とすれば良い。
〔実施例１〕
第２図に、本発明の実施例の構成図を示す。
２０１は信号列１０１ と同期信号１０２および各部回
路からのタイミングをもとに、各回路が必要とするクロ
ック信号と制御信号とを発生させるタイミング信号発生
回路である。２０２は第１図１０８で示す（１６，５）
符号と、第１図１１０と１１１で示すビットを含む（２
７２，１９０）符号とを分離する分離回路、２ｏ３は分
１１！１回路２０２からノ（１６，５）符号列を示し、
２ｏ４は同じ＜ （２７２，１９０）符号列を示す。
路からのタイミングをもとに、各回路が必要とするクロ
ック信号と制御信号とを発生させるタイミング信号発生
回路である。２０２は第１図１０８で示す（１６，５）
符号と、第１図１１０と１１１で示すビットを含む（２
７２，１９０）符号とを分離する分離回路、２ｏ３は分
１１！１回路２０２からノ（１６，５）符号列を示し、
２ｏ４は同じ＜ （２７２，１９０）符号列を示す。
２０５は（１ｓ、５）符号復号回路を示し、２ｏδは（
１５，５）符号復号回路２０５からの出力５ビツトデー
タを示す。２０７は受信すべき５ビツトサ一ビス信号を
示す。２０８は、５ビツトデータ２０６ と５ビツトサ
一ビス信号２０７が一致したか否かを判定する識別回路
を示し、２０９はその出力信号を示す。
１５，５）符号復号回路２０５からの出力５ビツトデー
タを示す。２０７は受信すべき５ビツトサ一ビス信号を
示す。２０８は、５ビツトデータ２０６ と５ビツトサ
一ビス信号２０７が一致したか否かを判定する識別回路
を示し、２０９はその出力信号を示す。
２１０は（１８，５）符号復号回路２０５での時間遅れ
を調整するための遅延回路、 ２１１はその出力信号を
示す。２１２は、メモリー書き込み、読み出しのための
アドレス制御回路であり、２１３はアドレス信号を示す
。２１４は（２７２，１９０）誤り訂正前の信号を蓄え
ておくためのメモリーを示し、２１５はそのメモリー出
力を示す。
を調整するための遅延回路、 ２１１はその出力信号を
示す。２１２は、メモリー書き込み、読み出しのための
アドレス制御回路であり、２１３はアドレス信号を示す
。２１４は（２７２，１９０）誤り訂正前の信号を蓄え
ておくためのメモリーを示し、２１５はそのメモリー出
力を示す。
２１６は、遅延回路２１０からの信号２１１か、メモリ
ー２１４からの信号２１５かを選択するためのセレクタ
ーを示し、このセクター２１６はアドレス制御回路２１
２からの信号２１７によって制御される。２１８は（２
７２，１９０）符号復号回路２１９への人力を示す。２
２０は、復号回路２１９が動作中あるいはＲｅａｄｙを
示す信号である。２２１は復号回路２１９からの（２７
２，１９０）符号復号出力信号を示す。
ー２１４からの信号２１５かを選択するためのセレクタ
ーを示し、このセクター２１６はアドレス制御回路２１
２からの信号２１７によって制御される。２１８は（２
７２，１９０）符号復号回路２１９への人力を示す。２
２０は、復号回路２１９が動作中あるいはＲｅａｄｙを
示す信号である。２２１は復号回路２１９からの（２７
２，１９０）符号復号出力信号を示す。
次に第２図の回路の動作について説明する。
入力信号列１０１とこれに対応する同期信号１０２から
、分離回路２０２によって（１６，５）符号と（２７２
１９０）符号とを分離する。（１６，５）符号は（１６
，５）符号復号回路２０５によって誤り訂正され、その
５ビツトが希望するサービス識別符号か否かが識別回路
２０８によって判定される。信号２０７と２０６とが一
致している場合には、識別回路２０８はアドレス制御回
路２１２を制御して、遅延回路２１０からの（２７２，
１９０）符号データ列をメモリー２１４へ書き込む。た
だし、（２７２，１９０）符号復号回路２１９がＲｅａ
ｄｙであり、メモリー２１４が空の場合には、データ列
はそのままメモリー２１４を通さずにセレクタ２１６経
由で、（２７２，１９０）符号復号回路２１９へロート
する。同回路２１９が動作中の場合は、メモＩＪ−２１
４へ順次データ書込みを行う。信号２２０がＲｅａｄｙ
を示すごとに、メモリー２１４からデータを読み出し、
セレクタ２１６を介し、（２７２，１９０）符号復号回
路２１９により誤り訂正を行う。誤り訂正後の２７２ビ
ット信号２２１が回路２１９から出力される。当然信号
２２１は同期信号１０２と同様な同期タイミングを示す
タイミング信号発生回路２０１からの信号２２２と共に
出力される。
、分離回路２０２によって（１６，５）符号と（２７２
１９０）符号とを分離する。（１６，５）符号は（１６
，５）符号復号回路２０５によって誤り訂正され、その
５ビツトが希望するサービス識別符号か否かが識別回路
２０８によって判定される。信号２０７と２０６とが一
致している場合には、識別回路２０８はアドレス制御回
路２１２を制御して、遅延回路２１０からの（２７２，
１９０）符号データ列をメモリー２１４へ書き込む。た
だし、（２７２，１９０）符号復号回路２１９がＲｅａ
ｄｙであり、メモリー２１４が空の場合には、データ列
はそのままメモリー２１４を通さずにセレクタ２１６経
由で、（２７２，１９０）符号復号回路２１９へロート
する。同回路２１９が動作中の場合は、メモＩＪ−２１
４へ順次データ書込みを行う。信号２２０がＲｅａｄｙ
を示すごとに、メモリー２１４からデータを読み出し、
セレクタ２１６を介し、（２７２，１９０）符号復号回
路２１９により誤り訂正を行う。誤り訂正後の２７２ビ
ット信号２２１が回路２１９から出力される。当然信号
２２１は同期信号１０２と同様な同期タイミングを示す
タイミング信号発生回路２０１からの信号２２２と共に
出力される。
（実施例２）
第２図の実施例では、（１６，５）符号の５ビツトが指
定した１つのサービスと一致した時のみ（２７２゜１９
０）符号の誤り訂正を行い、データ取り込みを行うよう
な回路構成となっているが、複数のサービスについてデ
ータ取込みを行うことも考えられる。第３図では、第２
図の５ビツトを示す信号２０７の代りにＩＯビットの信
号３０１として、２種類のサービスを指定できるように
している。信号３０１ のうち、３０２ と３０３、・
・・３１０ と３１１ は同一のビット位置を示す。
定した１つのサービスと一致した時のみ（２７２゜１９
０）符号の誤り訂正を行い、データ取り込みを行うよう
な回路構成となっているが、複数のサービスについてデ
ータ取込みを行うことも考えられる。第３図では、第２
図の５ビツトを示す信号２０７の代りにＩＯビットの信
号３０１として、２種類のサービスを指定できるように
している。信号３０１ のうち、３０２ と３０３、・
・・３１０ と３１１ は同一のビット位置を示す。
３１２は第２図全体と同一構成であるが、出力信号２２
１には、訂正後の５ビツトのサービス識別または、訂正
後の（１６，５）符号を付けて出力する構成としている
。
１には、訂正後の５ビツトのサービス識別または、訂正
後の（１６，５）符号を付けて出力する構成としている
。
（実施例３）
サービス識別信号としては、先頭の（１６，５）符号に
含まれる５ビツトのみではなく、その後につづく、（２
７２，１９０）符号のうち例えば先頭の８ビツトも使用
することが考えられる。この場合には、このビットも外
から指定するようにして、（２７２゜１９０）符号訂正
後の先頭の８ビツトを見て、指定した８ビツトと同一の
場合のみ出力するようにすれば回路構成とソフト構成が
簡単になる。
含まれる５ビツトのみではなく、その後につづく、（２
７２，１９０）符号のうち例えば先頭の８ビツトも使用
することが考えられる。この場合には、このビットも外
から指定するようにして、（２７２゜１９０）符号訂正
後の先頭の８ビツトを見て、指定した８ビツトと同一の
場合のみ出力するようにすれば回路構成とソフト構成が
簡単になる。
（実施例４）
実施例１〜３では述べていないが、必要な単数または複
数のサービス識別ビットパターンをコンピュータによっ
て外部から指定するようにして、訂正後のデータも自動
的にメモリー内に蓄えられるような回路構成にして、コ
ンピュータとの接続を容易にすることも可能である。
数のサービス識別ビットパターンをコンピュータによっ
て外部から指定するようにして、訂正後のデータも自動
的にメモリー内に蓄えられるような回路構成にして、コ
ンピュータとの接続を容易にすることも可能である。
以上のように本発明では、パケット信号の先頭部にある
（１６．５）拡大ＢＣ）Ｉ符号の誤り訂正後、その５ビ
ツト・のサービス識別信号が、あらかじめセットした希
望するサービスか否か判定する回路を設け、必要なサー
ビスの時のみそれ以後の２７２ビット分をメモリーに蓄
えるようにする。ただし、メモリーが空で、（２７２，
１９０）符号誤り訂正回路もＲｅａｄｙであれば、メモ
リーに蓄えず、そのまま誤り訂正回路ヘロードする。メ
モリーに蓄えられた希望のサービス信号は順次読み出さ
れ、誤り訂正するので、信号の高速処理に対応出来るよ
うになった。したがって、送出側での信号送出タイミン
グについては、考慮しなくても良くなった。また、信号
の送出から信号受信、提示までの所要時間が最短になり
、番組効果も向上した。
（１６．５）拡大ＢＣ）Ｉ符号の誤り訂正後、その５ビ
ツト・のサービス識別信号が、あらかじめセットした希
望するサービスか否か判定する回路を設け、必要なサー
ビスの時のみそれ以後の２７２ビット分をメモリーに蓄
えるようにする。ただし、メモリーが空で、（２７２，
１９０）符号誤り訂正回路もＲｅａｄｙであれば、メモ
リーに蓄えず、そのまま誤り訂正回路ヘロードする。メ
モリーに蓄えられた希望のサービス信号は順次読み出さ
れ、誤り訂正するので、信号の高速処理に対応出来るよ
うになった。したがって、送出側での信号送出タイミン
グについては、考慮しなくても良くなった。また、信号
の送出から信号受信、提示までの所要時間が最短になり
、番組効果も向上した。
さらに、希望するサービスを複数指定できるようにして
、２７２ビツトとともにそのサービス識別ビットも付加
して出力するようにし、回路の信号処理能力を増大させ
た。
、２７２ビツトとともにそのサービス識別ビットも付加
して出力するようにし、回路の信号処理能力を増大させ
た。
また、（１［＋、５）符号のサービス識別ビットと同時
に２７２ビツトの先頭部８ビットについても外部から指
定できるようにし、指定したビットパターンに合致した
信号だけが出力信号になる構成として、受信側のソフト
の軽減をはかった。
に２７２ビツトの先頭部８ビットについても外部から指
定できるようにし、指定したビットパターンに合致した
信号だけが出力信号になる構成として、受信側のソフト
の軽減をはかった。
出力側にメモリーを設け、入力端と同じように訂正後の
データは順次ロードするようにし、受信側ＣＰｕによフ
て常時アクセス出来る構成とし、ＣＰｕとのインターフ
ェースが容易になる回路構成とした。
データは順次ロードするようにし、受信側ＣＰｕによフ
て常時アクセス出来る構成とし、ＣＰｕとのインターフ
ェースが容易になる回路構成とした。
第１図は衛星データチャンネル信号を示す図、第２図は
本発明による実施例の構成図、第３図は複数のサービス
を指定することかできる本発明による実施例２の構成図
である。 〔発明の効果〕 以上説明したように本発明によれば、高速データ列の中
から希望するデータのみを順次組合し誤り訂正すること
ができる。 第３図
本発明による実施例の構成図、第３図は複数のサービス
を指定することかできる本発明による実施例２の構成図
である。 〔発明の効果〕 以上説明したように本発明によれば、高速データ列の中
から希望するデータのみを順次組合し誤り訂正すること
ができる。 第３図
Claims (1)
- 【特許請求の範囲】 １）（１６、５）符号と（２７２、１９０）符号とを分
離する分離回路と、 該分離回路からの（１６、５）符号を復号し、誤り訂正
する復号回路と、 該復号回路からの復号データがあらかじめ設定したデー
タと一致するかを判断する判断回路と、 該判断回路が一致判断のときに前記分離回路からの（２
７２、１９０）符号を記憶するメモリーと、該メモリー
から読み出したデータを復号し、誤り訂正する手段とを
具えたことを特徴とする誤り訂正回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18819388A JPH0239627A (ja) | 1988-07-29 | 1988-07-29 | 誤り訂正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18819388A JPH0239627A (ja) | 1988-07-29 | 1988-07-29 | 誤り訂正回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0239627A true JPH0239627A (ja) | 1990-02-08 |
Family
ID=16219397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18819388A Pending JPH0239627A (ja) | 1988-07-29 | 1988-07-29 | 誤り訂正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0239627A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2000048322A1 (fr) * | 1999-02-09 | 2000-08-17 | Sony Corporation | Recepteur de donnees, systeme de transmission de donnees et procede de transmission de donnees afferent |
| WO2000048323A1 (fr) * | 1999-02-09 | 2000-08-17 | Sony Corporation | Systeme de transmission de donnees, recepteur de donnees et procede de transmission de donnees |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60227522A (ja) * | 1984-03-30 | 1985-11-12 | Oki Electric Ind Co Ltd | 符号誤り訂正復号回路 |
-
1988
- 1988-07-29 JP JP18819388A patent/JPH0239627A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60227522A (ja) * | 1984-03-30 | 1985-11-12 | Oki Electric Ind Co Ltd | 符号誤り訂正復号回路 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2000048322A1 (fr) * | 1999-02-09 | 2000-08-17 | Sony Corporation | Recepteur de donnees, systeme de transmission de donnees et procede de transmission de donnees afferent |
| WO2000048323A1 (fr) * | 1999-02-09 | 2000-08-17 | Sony Corporation | Systeme de transmission de donnees, recepteur de donnees et procede de transmission de donnees |
| US6681363B1 (en) | 1999-02-09 | 2004-01-20 | Sony Corporation | Data receiver, data transmission system, and data transmitting method therefor |
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