JPH0227217U - - Google Patents
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- Publication number
- JPH0227217U JPH0227217U JP10337188U JP10337188U JPH0227217U JP H0227217 U JPH0227217 U JP H0227217U JP 10337188 U JP10337188 U JP 10337188U JP 10337188 U JP10337188 U JP 10337188U JP H0227217 U JPH0227217 U JP H0227217U
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- JP
- Japan
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- output
- converter
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- signal
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- 230000006870 function Effects 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図はこの考案による信号処理装置の一実施
例、第２図はそのタイミングチヤートを示す図、
第３図は従来の信号処理装置を示す図である。 図において、１はＡ／Ｄコンバータ、２はレジ
スタ、３は減算器、４はフアンクシヨンメモリ、
５は加算器、６はＤ／Ａコンバータ、７はマルチ
プレクサである。なお、各図中同一符号は相当部
分を示す。
例、第２図はそのタイミングチヤートを示す図、
第３図は従来の信号処理装置を示す図である。 図において、１はＡ／Ｄコンバータ、２はレジ
スタ、３は減算器、４はフアンクシヨンメモリ、
５は加算器、６はＤ／Ａコンバータ、７はマルチ
プレクサである。なお、各図中同一符号は相当部
分を示す。
Claims (1)
- 入力信号をアナログ信号からデジタル信号に変
換するＡ／Ｄコンバータと、上記デジタル信号を
保持するレジスタと、上記レジスタの出力と上記
Ａ／Ｄコンバータの出力の差をとる減算器と、こ
の減算器出力と切換信号をアドレス線としフアン
クシヨンデータを出力するフアンクシヨンメモリ
と、このフアンクシヨンメモリの出力と上記レジ
スタの出力を加算する加算器と、この加算器の出
力をアナログに変換するＤ／Ａコンバータとを具
備してなる信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10337188U JPH0227217U (ja) | 1988-08-04 | 1988-08-04 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10337188U JPH0227217U (ja) | 1988-08-04 | 1988-08-04 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0227217U true JPH0227217U (ja) | 1990-02-22 |
Family
ID=31334141
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10337188U Pending JPH0227217U (ja) | 1988-08-04 | 1988-08-04 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0227217U (ja) |
-
1988
- 1988-08-04 JP JP10337188U patent/JPH0227217U/ja active Pending