JPH0245480U - - Google Patents
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- Publication number
- JPH0245480U JPH0245480U JP12365688U JP12365688U JPH0245480U JP H0245480 U JPH0245480 U JP H0245480U JP 12365688 U JP12365688 U JP 12365688U JP 12365688 U JP12365688 U JP 12365688U JP H0245480 U JPH0245480 U JP H0245480U
- Authority
- JP
- Japan
- Prior art keywords
- output
- circuit
- converter
- selector
- signal processing
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Radar Systems Or Details Thereof (AREA)
Description
第１図は本考案の実施例であるレーダ信号処理
装置を示す図、第２図ア〜ウは第１図に示す装置
の動作を示す波形図、第３図は従来から用いられ
ているレーダ信号処理装置、第４図ア〜ウは第３
図に示す装置の動作を示す波形図である。 図中、１はＡ／Ｄ変換器、２は間引き回路、３
は信号処理回路、４は加算回路、５はセレクタ、
アは受信ビデオ信号、イはＡ／Ｄ変換器１の出力
、ウはサンプル間引き回路２の出力を示す。なお
図中同一あるいは相当部分には同一符号を付して
ある。
装置を示す図、第２図ア〜ウは第１図に示す装置
の動作を示す波形図、第３図は従来から用いられ
ているレーダ信号処理装置、第４図ア〜ウは第３
図に示す装置の動作を示す波形図である。 図中、１はＡ／Ｄ変換器、２は間引き回路、３
は信号処理回路、４は加算回路、５はセレクタ、
アは受信ビデオ信号、イはＡ／Ｄ変換器１の出力
、ウはサンプル間引き回路２の出力を示す。なお
図中同一あるいは相当部分には同一符号を付して
ある。
Claims (1)
- 受信ビデオ信号をデイジタル信号に変換するＡ
／Ｄ変換器、前記Ａ／Ｄ変換器の２回連続したサ
ンプル値を加算する加算回路、前記加算回路の出
力を間引き、データを削減する間引き回路、前記
間引き回路の出力と前記Ａ／Ｄ変換器の出力を用
途により選択するセレクタ、このセレクタの出力
を処理する信号処理回路を備えたことを特徴とす
るレーダ信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12365688U JPH0245480U (ja) | 1988-09-21 | 1988-09-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12365688U JPH0245480U (ja) | 1988-09-21 | 1988-09-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0245480U true JPH0245480U (ja) | 1990-03-28 |
Family
ID=31372705
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12365688U Pending JPH0245480U (ja) | 1988-09-21 | 1988-09-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0245480U (ja) |
-
1988
- 1988-09-21 JP JP12365688U patent/JPH0245480U/ja active Pending
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