JPS5928734U - 信号入力装置 - Google Patents

信号入力装置

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Publication number
JPS5928734U
JPS5928734U JP12466882U JP12466882U JPS5928734U JP S5928734 U JPS5928734 U JP S5928734U JP 12466882 U JP12466882 U JP 12466882U JP 12466882 U JP12466882 U JP 12466882U JP S5928734 U JPS5928734 U JP S5928734U
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JP
Japan
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input device
signal input
data
input
input timing
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Pending
Application number
JP12466882U
Other languages
English (en)
Inventor
真 五十嵐
Original Assignee
三菱電機株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は信号入力装置が使用されるディジタル制御シス
テムの概念構成図、第２図は従来方式の信号入力装置を
示す図、第３図は実際の入力信号の値の変化と入力タイ
クングの説明図、第４図はこの考案の信号入力装置の構
成図、第５図は第４図の入力タイミング機構を示すブロ
ック図である。 各図において、１はディジタル制御装置、２は制御対象
、３はマルチプレクサ、４はＡＤ変換器、５は入力デー
タメモリ、６はディジタル制御計算処理機構、７は１次
メモｌへ８は入力タイミング整合機構、９，１０．１１
は入力タイミング整合計算のための一次記憶メモリ、１
２は計算プロセサである。なお図中同一あるいは相当部
分には同一符号を付して示しである。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数のセンサ信号を切換えるためのマルチプレクサと、
    上記センサ信号をディジタル値に変換するアナログ・デ
    ィジタルコンバータと、このＡＤコンバータの出力デー
    タを格納する１次メモリと、この１次メモリに格納され
    ているデータを時間的に整合する入力タイミング整合機
    構と、この入力タイミング整合機構により整合されたデ
    ータを格納する入力データメモリとを備えた信号入力装
    置。
JP12466882U 1982-08-18 1982-08-18 信号入力装置 Pending JPS5928734U (ja)

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JP12466882U JPS5928734U (ja) 1982-08-18 1982-08-18 信号入力装置

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JP12466882U JPS5928734U (ja) 1982-08-18 1982-08-18 信号入力装置

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Publication Number Publication Date
JPS5928734U true JPS5928734U (ja) 1984-02-22

Family

ID=30284106

Family Applications (1)

Application Number Title Priority Date Filing Date
JP12466882U Pending JPS5928734U (ja) 1982-08-18 1982-08-18 信号入力装置

Country Status (1)

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JP (1) JPS5928734U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02146615A (ja) * 1988-11-29 1990-06-05 Yokogawa Electric Corp データ記憶装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02146615A (ja) * 1988-11-29 1990-06-05 Yokogawa Electric Corp データ記憶装置

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