JPS58124804U - プロセス入出力装置 - Google Patents
プロセス入出力装置Info
- Publication number
- JPS58124804U JPS58124804U JP2156182U JP2156182U JPS58124804U JP S58124804 U JPS58124804 U JP S58124804U JP 2156182 U JP2156182 U JP 2156182U JP 2156182 U JP2156182 U JP 2156182U JP S58124804 U JPS58124804 U JP S58124804U
- Authority
- JP
- Japan
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- output
- input
- signal
- interface circuit
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来の一例を示せブ吊ツク図、第２図は本考案
の一実施例を示すブロック図である。 １：入力インターフェース回路、３：出力インターフェ
ース回路、４：中央演算処理装置、７：シフトレジスタ
、６：選択回路。
の一実施例を示すブロック図である。 １：入力インターフェース回路、３：出力インターフェ
ース回路、４：中央演算処理装置、７：シフトレジスタ
、６：選択回路。
Claims (1)
- プロセスからの入出力処理機能を有するシーケンスコス
トローラに於いて、′外部入力信号を内部の信号レベル
に変換する為の入力インタフェース回路と、ラッチされ
た内部レベルの出力信号を外部の信号レベルに変換する
為の出力インタフェース回路と、出力状態を時系列的に
記憶しておく為のシフトレジスタと、シフトレジスタへ
の入力データ及び出力データを選択する為の選択回路と
を具備し、プロセスからの入力信号及び出力信号の変化
に合わせて中央演算処理装置の制御を受けずに出力信号
を出力してプロセスを制御し得るようにしたことを特徴
とするプロセス入出力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2156182U JPS58124804U (ja) | 1982-02-19 | 1982-02-19 | プロセス入出力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2156182U JPS58124804U (ja) | 1982-02-19 | 1982-02-19 | プロセス入出力装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58124804U true JPS58124804U (ja) | 1983-08-25 |
Family
ID=30033677
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2156182U Pending JPS58124804U (ja) | 1982-02-19 | 1982-02-19 | プロセス入出力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58124804U (ja) |
-
1982
- 1982-02-19 JP JP2156182U patent/JPS58124804U/ja active Pending
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