JPH02243974A - 半導体装置の試験治具 - Google Patents
半導体装置の試験治具Info
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- JPH02243974A JPH02243974A JP6656989A JP6656989A JPH02243974A JP H02243974 A JPH02243974 A JP H02243974A JP 6656989 A JP6656989 A JP 6656989A JP 6656989 A JP6656989 A JP 6656989A JP H02243974 A JPH02243974 A JP H02243974A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 34
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- 239000004020 conductor Substances 0.000 description 4
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 2
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- Testing Of Individual Semiconductor Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
半導体装置(])を試験する際に使用する試験治具に関
し、 半導体装置のり−ドピンの高密度化に対して柔軟に対応
し得る簡易構造の試験治具の提供を目的とし、 半導体装置のリードピン対応にテスト用の基板パターン
を有してなるテスト用基板と、該テスト用基板上に設け
られたガイド部材に対応するガイド孔を装備すると共に
、その厚さ方向にのみ電気的導通を有してなる通電部、
材と、前記ガイ゛ド部材対応に設けられた位置決め孔お
よび前記半導体装置のり−ドビン対応に設けられたリー
ドピン挿通孔がその厚さ方向に形成されてなるサポート
部材とによって構成する。
し、 半導体装置のり−ドピンの高密度化に対して柔軟に対応
し得る簡易構造の試験治具の提供を目的とし、 半導体装置のリードピン対応にテスト用の基板パターン
を有してなるテスト用基板と、該テスト用基板上に設け
られたガイド部材に対応するガイド孔を装備すると共に
、その厚さ方向にのみ電気的導通を有してなる通電部、
材と、前記ガイ゛ド部材対応に設けられた位置決め孔お
よび前記半導体装置のり−ドビン対応に設けられたリー
ドピン挿通孔がその厚さ方向に形成されてなるサポート
部材とによって構成する。
本発明は半導体装置を試験する際に使用する試験治具に
関する。
関する。
第3図(alと(b)は従来の半導体装置の試験治具の
構成を示す一部破断した模式的側面図と構成部材の細部
構造を示す要部側断面図である。
構成を示す一部破断した模式的側面図と構成部材の細部
構造を示す要部側断面図である。
第3図(a)と(b)に示すように、従来の半導体装置
の試験治具(以下試験治具と呼ぶ)は、半導体装置lの
リードピン2対応に設けられたコンタクトピン21と、
該コンタクトピン21を矢印U方向に付勢する付勢バネ
22を具備してなる通電パッド30と、付勢バネ22を
介して前記コンタクトピン21と電気的tこ結合された
テスト用の基板パターン(以下基板パターンと呼ぶ)5
を有してなるテスト用基板20Aとによって構成されて
いる。図中、5aは基板パターン5の電極パッドを、5
bはビアをそれぞれ示す。なお、これら通電パッド30
とテスト用基板20Aは、図示されない結合部材によっ
て各コンタクトピン21の中心と電極バッド5aの中心
が一致する形で〔第3図(bl惨照〕結合されている。
の試験治具(以下試験治具と呼ぶ)は、半導体装置lの
リードピン2対応に設けられたコンタクトピン21と、
該コンタクトピン21を矢印U方向に付勢する付勢バネ
22を具備してなる通電パッド30と、付勢バネ22を
介して前記コンタクトピン21と電気的tこ結合された
テスト用の基板パターン(以下基板パターンと呼ぶ)5
を有してなるテスト用基板20Aとによって構成されて
いる。図中、5aは基板パターン5の電極パッドを、5
bはビアをそれぞれ示す。なお、これら通電パッド30
とテスト用基板20Aは、図示されない結合部材によっ
て各コンタクトピン21の中心と電極バッド5aの中心
が一致する形で〔第3図(bl惨照〕結合されている。
この試験治具は、半導体装置1を矢印り方向から各リー
ドピン2がそれぞれ対応するコンタクトピン21に当接
するように押し当てて当該半導体装置1の性能試験を行
う治具であって、これら各基板パターン5は、試験装置
(図示せず)側の試験回路にそれぞれ接続されている。
ドピン2がそれぞれ対応するコンタクトピン21に当接
するように押し当てて当該半導体装置1の性能試験を行
う治具であって、これら各基板パターン5は、試験装置
(図示せず)側の試験回路にそれぞれ接続されている。
従来の試験治具は上記の如く、試験治具側のコンタクト
ピン21が、半導体装置1側のり−ドビン2とそれぞれ
1対1で対応する構成になっていることから、リードピ
ン2相互間の間隔が極端に狭くなった最近の半導体装置
1に対しては、コンタクトピン21の小型化に限度があ
るため、この方式を適用できなくなりつつある。
ピン21が、半導体装置1側のり−ドビン2とそれぞれ
1対1で対応する構成になっていることから、リードピ
ン2相互間の間隔が極端に狭くなった最近の半導体装置
1に対しては、コンタクトピン21の小型化に限度があ
るため、この方式を適用できなくなりつつある。
本発明はこの問題に対処するためになされたもので、コ
ネクタピン2間の間隔が狭くなってもこれに柔軟に対応
し得る点に特徴がある。
ネクタピン2間の間隔が狭くなってもこれに柔軟に対応
し得る点に特徴がある。
本発明による試験治具は第1図に示すように、半導体装
置1のリードピン2対応に基板パターン5を有してなる
テスト用基板20と、該テスト用基板20上に設けられ
たガイドピン19に対応するガイド孔11を装備すると
共に、その厚さ方向にのみ電気的導通を有してなる通電
パッドlOと、前記ガイドピン19対応に設けられた位
置決め孔16および前記半導体装置lのリードピン2対
応に設けられたリードピン挿通孔14がその厚さ方向に
形成されてなるサポート部材15とによって構成されて
いる。
置1のリードピン2対応に基板パターン5を有してなる
テスト用基板20と、該テスト用基板20上に設けられ
たガイドピン19に対応するガイド孔11を装備すると
共に、その厚さ方向にのみ電気的導通を有してなる通電
パッドlOと、前記ガイドピン19対応に設けられた位
置決め孔16および前記半導体装置lのリードピン2対
応に設けられたリードピン挿通孔14がその厚さ方向に
形成されてなるサポート部材15とによって構成されて
いる。
このように本発明による試験治具は、半導体装置1例の
リードピン2とテスト用基板20側の基板パターン5と
を電気的に結合するための手段として、その厚さ方向に
のみ電気的導通を有してなる1111電パツド10を用
いているため、テスト用基板20側の電極パッド5aの
形成寸法或いはその間隔を半導体装置1側のリードピン
2対応に形成するようにすれば、リードピン2と基板パ
ターン5を電気的に結合することができる。従って本方
式を適用すれば、リードピン2相互間の間隔の狭い半導
体装置1に対して柔軟に対応し得る試験治具が得られる
。
リードピン2とテスト用基板20側の基板パターン5と
を電気的に結合するための手段として、その厚さ方向に
のみ電気的導通を有してなる1111電パツド10を用
いているため、テスト用基板20側の電極パッド5aの
形成寸法或いはその間隔を半導体装置1側のリードピン
2対応に形成するようにすれば、リードピン2と基板パ
ターン5を電気的に結合することができる。従って本方
式を適用すれば、リードピン2相互間の間隔の狭い半導
体装置1に対して柔軟に対応し得る試験治具が得られる
。
以下実施例図に基づいて本発明の詳細な説明する。
第1図(alと(b)は本発明の一実施例を示す模式的
要部側断面図とその細部構造を示す要部側断面図、第2
図(a)と(b)と(C)および(dlは構成部材の一
構造例を示す要部斜視図と要部側断面図であるが、前記
第3図と同一部分には同一符号を付している。
要部側断面図とその細部構造を示す要部側断面図、第2
図(a)と(b)と(C)および(dlは構成部材の一
構造例を示す要部斜視図と要部側断面図であるが、前記
第3図と同一部分には同一符号を付している。
第1図(alと(b)に示すように、本発明による試験
治具は、半導体装置1のリードピン2対応に設けられた
電極バッド5aとビア5bより成る基板パターン5を有
してなるテスト用基板20と、該テスト用基板20上に
設けられたガイドピン19に嵌合状態で係入するガイド
孔11を装備すると共に、図中、上下方向に並列に配置
された複数本の導電性繊維8を合成ゴム等の弾性体部9
で固めることによってその厚さ方向(矢印U−D方向)
にのみ電気的導通を有してなる通電パッド10と、前記
ガイドピン19対応に設けられた位置決め孔16および
前記半導体装置lのリードピン2対応に設けられたり−
ドピン挿通孔14がその厚さ方向(図の上下方向)に形
成されてなるサポート部材15とによって構成されてい
る。
治具は、半導体装置1のリードピン2対応に設けられた
電極バッド5aとビア5bより成る基板パターン5を有
してなるテスト用基板20と、該テスト用基板20上に
設けられたガイドピン19に嵌合状態で係入するガイド
孔11を装備すると共に、図中、上下方向に並列に配置
された複数本の導電性繊維8を合成ゴム等の弾性体部9
で固めることによってその厚さ方向(矢印U−D方向)
にのみ電気的導通を有してなる通電パッド10と、前記
ガイドピン19対応に設けられた位置決め孔16および
前記半導体装置lのリードピン2対応に設けられたり−
ドピン挿通孔14がその厚さ方向(図の上下方向)に形
成されてなるサポート部材15とによって構成されてい
る。
この試験治具は、テスト用基板20側のガイドピン19
にガイド孔11を係入させた形で配置された通電パッド
10上に、前記ガイドピン19に位置決め孔16を係入
させた形でサポート部材15を配置し、当該サポート部
材15側のリードピン挿通孔14に半導体装置1のリー
ドピン2を係入8せてこれを矢印8方向に押圧すること
により、半導体装置1側のリードピン2とテスト用基板
20側の電極パッド5aが通電パッド10の導電性繊維
8を介して電気的に接続される構成になっている。
にガイド孔11を係入させた形で配置された通電パッド
10上に、前記ガイドピン19に位置決め孔16を係入
させた形でサポート部材15を配置し、当該サポート部
材15側のリードピン挿通孔14に半導体装置1のリー
ドピン2を係入8せてこれを矢印8方向に押圧すること
により、半導体装置1側のリードピン2とテスト用基板
20側の電極パッド5aが通電パッド10の導電性繊維
8を介して電気的に接続される構成になっている。
以下第2図(alと(blと(C1および(d)を用い
て前記導電パッド10の構造を説明する。
て前記導電パッド10の構造を説明する。
この導電バッド10は、導体部8aと被覆部8bとより
成る例えばエナメル銅線のような導電性繊維8〔第2図
(81参照〕を第2図(b)に示すように複数本束ね、
これらを例えば合成ゴム等の弾性体部9で固めて固形化
した後、これを点線で示すように仮型に切り取って製作
する。第2図(C)と(d)は該界雷バッド10の細部
構造を示す要部斜視図と要部側断面図であるが、第2図
fc)と(dlに示すように、この導電バッド10は、
各導電性繊維8が絶縁物より成る弾性体部9によってそ
の厚さ方向(矢印U−D方向)にそれぞれ弾力性を有す
る状態で配置された形になっている。なお、前記導電性
繊維8は、例えば導体部8aの直径が100μm前後の
ものを用いているので、断面積の小さいリードピン2に
対しても複数本が接触し、またリードピン2間の間隔が
狭くてもピン間で短絡事故が生じる危険性は全(無い。
成る例えばエナメル銅線のような導電性繊維8〔第2図
(81参照〕を第2図(b)に示すように複数本束ね、
これらを例えば合成ゴム等の弾性体部9で固めて固形化
した後、これを点線で示すように仮型に切り取って製作
する。第2図(C)と(d)は該界雷バッド10の細部
構造を示す要部斜視図と要部側断面図であるが、第2図
fc)と(dlに示すように、この導電バッド10は、
各導電性繊維8が絶縁物より成る弾性体部9によってそ
の厚さ方向(矢印U−D方向)にそれぞれ弾力性を有す
る状態で配置された形になっている。なお、前記導電性
繊維8は、例えば導体部8aの直径が100μm前後の
ものを用いているので、断面積の小さいリードピン2に
対しても複数本が接触し、またリードピン2間の間隔が
狭くてもピン間で短絡事故が生じる危険性は全(無い。
また、これら各導電性繊維8は、それぞれが前記弾性体
部9によって保持された形になっているため、試験中に
軸方向の力が加わっても座屈等を生じることが無い。
部9によって保持された形になっているため、試験中に
軸方向の力が加わっても座屈等を生じることが無い。
このように、本発明による試験治具は、導電性繊維8に
よって半導体装置1側のリードピン2とテスト用基板2
0側の基板パターン5の電気的接続を行う構成であるた
め、その構造が著しく簡素化され、特にリードピン2間
の間隔の狭い半導体装置1に対しても適用が可能である
ことから、将来の半導体装置lの試験にも充分対応でき
る。
よって半導体装置1側のリードピン2とテスト用基板2
0側の基板パターン5の電気的接続を行う構成であるた
め、その構造が著しく簡素化され、特にリードピン2間
の間隔の狭い半導体装置1に対しても適用が可能である
ことから、将来の半導体装置lの試験にも充分対応でき
る。
以上の説明から明らかなように、本発明の試験治具は、
半導体装置側のリードピンとテスト用基板側の基板パタ
ーン間の接続をエナメル銅線のよう′な導電性繊維を用
いて行う構成になっていることから、その構造が著しく
簡素化され、特にり−トピンの間隔如何に関わらずこれ
を適用し得るといった優れた工業的効果がある。
半導体装置側のリードピンとテスト用基板側の基板パタ
ーン間の接続をエナメル銅線のよう′な導電性繊維を用
いて行う構成になっていることから、その構造が著しく
簡素化され、特にり−トピンの間隔如何に関わらずこれ
を適用し得るといった優れた工業的効果がある。
第1図(alと(blはは本発明の一実施例を示す模式
的要部側断面図とその細部構造を示す要部側断面図、 第2図(a)と(b)と(C)および(diは構成部材
の一構造例を示す要部斜視図と要部側断面図、 第3図(a)と(b)は従来の試験治具の構成を示す一
部破断した模式的側面図と構成部材の細部構造を示す要
部側断面図である。 図において、1は半導体装置、 2はリードピン、 5は基板パターン、 5aは電極パッド、 5bはビア、 8は導電性繊維、 8aは導体部、 8bは被覆部、 9は弾性体部、 10と30は通電パッド、 11はガイド孔、 14はリードピン挿通孔、 15はサポート部材、 16は位置決め孔、 19はガイドピン、 20と20Aはテスト用基牟反、 21はコンタク トピン、 22は付勢バネ、 をそれぞれ示す。 (す
的要部側断面図とその細部構造を示す要部側断面図、 第2図(a)と(b)と(C)および(diは構成部材
の一構造例を示す要部斜視図と要部側断面図、 第3図(a)と(b)は従来の試験治具の構成を示す一
部破断した模式的側面図と構成部材の細部構造を示す要
部側断面図である。 図において、1は半導体装置、 2はリードピン、 5は基板パターン、 5aは電極パッド、 5bはビア、 8は導電性繊維、 8aは導体部、 8bは被覆部、 9は弾性体部、 10と30は通電パッド、 11はガイド孔、 14はリードピン挿通孔、 15はサポート部材、 16は位置決め孔、 19はガイドピン、 20と20Aはテスト用基牟反、 21はコンタク トピン、 22は付勢バネ、 をそれぞれ示す。 (す
Claims (1)
- 【特許請求の範囲】 半導体装置(1)を試験する際に使用する治具であって
、 半導体装置(1)のリードピン(2)対応にテスト用の
基板パターン(5)を有してなるテスト用基板(20)
と、該テスト用基板(20)上に設けられたガイド部材
(19)に対応するガイド孔(11)を装備すると共に
、その厚さ方向にのみ電気的導通を有してなる通電部材
(10)と、 前記ガイド部材(19)対応に設けられた位置決め孔(
16)および前記半導体装置(1)のリードピン(2)
対応に設けられたリードピン挿通孔(14)がその厚さ
方向に形成されてなるサポート部材(15)と、 によって構成したことを特徴とする半導体装置の試験治
具。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6656989A JPH02243974A (ja) | 1989-03-16 | 1989-03-16 | 半導体装置の試験治具 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6656989A JPH02243974A (ja) | 1989-03-16 | 1989-03-16 | 半導体装置の試験治具 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02243974A true JPH02243974A (ja) | 1990-09-28 |
Family
ID=13319718
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6656989A Pending JPH02243974A (ja) | 1989-03-16 | 1989-03-16 | 半導体装置の試験治具 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02243974A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0682521A (ja) * | 1991-12-02 | 1994-03-22 | American Teleph & Telegr Co <Att> | 電子デバイスの試験方法 |
EP1650801A2 (en) * | 2004-10-22 | 2006-04-26 | Sun Microsystems, Inc. | Method and apparatus to facilitate capacitive communication between chips |
-
1989
- 1989-03-16 JP JP6656989A patent/JPH02243974A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0682521A (ja) * | 1991-12-02 | 1994-03-22 | American Teleph & Telegr Co <Att> | 電子デバイスの試験方法 |
EP1650801A2 (en) * | 2004-10-22 | 2006-04-26 | Sun Microsystems, Inc. | Method and apparatus to facilitate capacitive communication between chips |
EP1650801A3 (en) * | 2004-10-22 | 2007-09-05 | Sun Microsystems, Inc. | Method and apparatus to facilitate capacitive communication between chips |
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