JPH02143845U - - Google Patents

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JPH02143845U
JPH02143845U JP5298389U JP5298389U JPH02143845U JP H02143845 U JPH02143845 U JP H02143845U JP 5298389 U JP5298389 U JP 5298389U JP 5298389 U JP5298389 U JP 5298389U JP H02143845 U JPH02143845 U JP H02143845U
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Japan
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converter
signal delay
clock
converters
time difference
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JP5298389U
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  • Measurement Of Current Or Voltage (AREA)
  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第１図は本考案の構成を示すブロツク図、第２
図は第１図の動作説明のためのタイミング図、第
３図は従来例を示すブロツク図、第４図は第３図
の動作を表わすタイミング図、第５図はサンプル
ホールド回路の一例を示す回路図である。 １：サンプルホルダ、２：信号デイレイライン
、３：ＡＤ駆動増幅器、５，６：ＡＤ変換器、７
，８：メモリ、９：クロツクデイレイライン、１
０…デイレイライン駆動増幅器。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数のアナログデイジタル（以下ＡＤと称す）
    変換器を有し、各ＡＤ変換器は各々順次略一定の
    信号遅延時間差を持つ信号遅延回路を通して信号
    を加えられると共に、前記ＡＤ変換器の変換クロ
    ツク信号は略同一タイミングであり、かつ前記信
    号遅延時間差は、前記ＡＤ変換器クロツク周期の
    、前記ＡＤ変換器の個数分の一であり、また前記
    各信号遅延回路には、入力信号を前記ＡＤ変換器
    のクロツクと同期した、前記ＡＤ変換器のクロツ
    ク周波数の前記ＡＤ変換器の個数倍の周波数でサ
    ンプリングをするサンプルホルダを通して加える
    ことを特徴とするアナログデイジタル変換装置。
JP5298389U 1989-05-10 1989-05-10 Pending JPH02143845U (ja)

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JPH02143845U true JPH02143845U (ja) 1990-12-06

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ID=31573766

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008147922A (ja) * 2006-12-08 2008-06-26 Anritsu Corp Ａ／ｄ変換装置

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JPS5712493A (en) * 1980-06-26 1982-01-22 Kokusai Electric Co Ltd Parallel type sample holding circuit
JPS58106914A (ja) * 1981-12-21 1983-06-25 Sony Corp Ａ／ｄ変換回路
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JPS631119A (ja) * 1986-06-19 1988-01-06 General Bijinesu Mach Kk アナログ／デジタル変換システム

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